JP2007194535A - 半導体装置 - Google Patents
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Abstract
【課題】従来に比べて反りの発生を抑制することのできる半導体装置を提供する。
【解決手段】配線基板2の略中央部には、半導体チップ3が搭載されている。配線基板2の四隅には、夫々チップスケールパッケージ5〜8が搭載されている。半導体チップ3の外周部であって、チップスケールパッケージ5〜8の間に位置する配線基板2の領域には、複数の電子部品9が搭載されている。半導体チップ3の上部には、放熱板10が配設されている。放熱板10には、配線基板2の縁部において当該配線基板2と固定される少なくとも4つの柱状固定部13が設けられている。
【選択図】図1
【解決手段】配線基板2の略中央部には、半導体チップ3が搭載されている。配線基板2の四隅には、夫々チップスケールパッケージ5〜8が搭載されている。半導体チップ3の外周部であって、チップスケールパッケージ5〜8の間に位置する配線基板2の領域には、複数の電子部品9が搭載されている。半導体チップ3の上部には、放熱板10が配設されている。放熱板10には、配線基板2の縁部において当該配線基板2と固定される少なくとも4つの柱状固定部13が設けられている。
【選択図】図1
Description
本発明は、半導体装置に係り、特に配線基板上に半導体チップと電子部品とチップスケールパッケージとが搭載されたマルチチップモジュール構造の半導体装置に関する。
従来から、配線基板上に複数の半導体チップ及び電子部品等を搭載したマルチチップモジュール型の半導体装置が知られている。また、このようなマルチチップモジュール型の半導体装置において、半導体チップの放熱のため、半導体チップと接触するように放熱板を設けたものも知られている(例えば、特許文献1参照。)。
特開平9−82882号公報
しかしながら、上記のような半導体装置では、高機能化及び高集積化の要求等により、電極の狭ピッチ化(例えばピッチ1mm等)や、配線基板の大型化(例えば配線基板の1辺の大きさが35〜45mm等)が図られる傾向にある。一方、半導体チップと配線基板との間に充填されるアンダーフィル等の影響により、配線基板には反りが発生するため、このような反りを低減させることが必要となり、このような反りを抑制することのできる半導体装置の開発が求められていた。なお、例えばピッチが1mmの場合、反り(配線基板下面に形成された半田ボールの最大高低差)を200μm以下程度とすることが要求される。
本発明は、上記従来の事情に対処してなされたもので、従来に比べて反りの発生を抑制することのできる半導体装置を提供しようとするものである。
本発明の一態様によれば、配線基板と、前記配線基板上に搭載された半導体チップと、前記配線基板上に搭載された電子部品と、前記配線基板上に搭載されたチップスケールパッケージと、前記半導体チップと接触するように配設され、前記配線基板の縁部において当該配線基板と固定される少なくとも4つの柱状固定部を有する放熱板とを具備したことを特徴とする半導体装置が提供される。
また、本発明の他の一態様によれば、配線基板と、前記配線基板上に搭載された半導体チップと、前記配線基板上に搭載された電子部品と、前記配線基板上に搭載されたチップスケールパッケージと、前記半導体チップと接触するように配設され、前記配線基板の前記半導体チップ及び前記電子部品及びチップスケールパッケージの搭載領域より外周部において当該配線基板と固定される少なくとも4つの柱状固定部を有する放熱板とを具備したことを特徴とする半導体装置が提供される。
また、本発明のさらに他の一態様によれば、矩形状の配線基板と、前記配線基板上の中央部に搭載された半導体チップと、前記配線基板の角部に夫々搭載されたチップスケールパッケージと、前記第1の半導体チップの外周部であって、前記チップスケールパッケージの間に搭載された複数の電子部品と、前記半導体チップと接触するように配設され、前記配線基板の前記チップスケールパッケージの間であって、前記電子部品の搭載領域より外周部において当該配線基板と固定される少なくとも4つの柱状固定部を有する放熱板とを具備したことを特徴とする半導体装置が提供される。
本発明によれば、従来に比べて。反りの発生を抑制することのできる半導体装置を提供することができる。
以下図面を参照しながら、本発明の実施形態について説明する。図1〜3は、本発明の一実施形態に係る半導体装置1の構成を模式的に示すものである。図1は半導体装置1の上面図であり、図2は図1のA−A方向に沿った断面図、図3は図1のB−B方向に沿った断面図である。
図1〜3に示すように、半導体装置1は、略矩形状の配線基板2を具備している。この配線基板2の略中央部には、半導体チップ3が搭載されている。この半導体チップ3は、例えば、フリップチップ接続により、配線基板2と接続されている。配線基板2と半導体チップ3との間には、必要に応じてアンダーフィル4が充填される。
また、配線基板2の4つの角部には、夫々チップスケールパッケージ(CSP(chip scale package))5〜8が搭載されている。これらのチップスケールパッケージ5〜8は、例えばメモリーパッケージ等からなり、BGA構造等を有し、半田ボール等により配線基板2に接続されている。
また、半導体チップ3の外周部であって、チップスケールパッケージ5〜8の間に位置する配線基板2の領域には、キャパシタ等の複数の電子部品9が搭載されている。
半導体チップ3の上部には、配線基板2と略同じ外形とされた矩形状の放熱板10が配設されている。この放熱板10は、熱伝導性の良好な金属等から構成されている。放熱板10と半導体チップ3との間には、熱伝導性の良好な放熱用樹脂11が充填されており、
この放熱用樹脂11を介して半導体チップ3と放熱板10とは接触した状態に維持されている。そして、半導体チップ3からこの放熱用樹脂11を介して放熱板10に熱が伝わり、放熱板10から放熱が行われるようになっている。
この放熱用樹脂11を介して半導体チップ3と放熱板10とは接触した状態に維持されている。そして、半導体チップ3からこの放熱用樹脂11を介して放熱板10に熱が伝わり、放熱板10から放熱が行われるようになっている。
上記放熱用樹脂11は、比較的軟らかい樹脂から構成されており、放熱板10と半導体チップ3の熱膨張率の差等により、半導体チップ3に過剰な力が加わり、半導体チップ3に割れ等が生じないように構成されている。なお、半導体チップ3の高さは、チップスケールパッケージ5〜8の高さに比べて低いため、放熱板10には、半導体チップ3に対応した位置に、半導体チップ3側(図2,3中下側)に向けて突出する凸部12が形成されている。
放熱板10には、配線基板2の縁部において当該配線基板2と固定される少なくとも4つの柱状固定部13が設けられている。本実施形態において、柱状固定部13は、配線基板2のチップスケールパッケージ5〜8の間であって、電子部品9の搭載領域より外周部において当該配線基板2と固定されている。これらの柱状固定部13は、放熱板10から配線基板2側(図2中下側)に向けて突出するように柱状に形成されており、柱状固定部13と配線基板2とは、樹脂14等により固定されている。
上記構成の本実施形態の半導体装置1では、放熱板10の柱状固定部13によって、配線基板2の4辺の縁部が固定されているので、配線基板2に反りが発生することを効果的に抑制することができる。これによって、配線基板2の下面側に形成されている半田ボール等の外部との電気的接続部(図示せず。)に高さのばらつきが生じることを抑制することができ、他の基板上等に良好な状態で半導体装置1を搭載することが可能となる。また、配線基板2の縁部を固定することによって、配線基板2の内側部分を固定する場合に比べてより効率的に反りの発生を抑制できるとともに、配線基板2上の実装領域が減少することを抑制できる。
図4は、他の実施形態の半導体装置1bの構成を模式的に示すものである。この実施形態の半導体装置1bでは、チップスケールパッケージ5〜8と、放熱板10との間に、熱伝導性の良好な放熱用樹脂11が充填されており、チップスケールパッケージ5〜8からこの放熱用樹脂11を介して放熱板10に熱が伝わり、放熱板10から放熱が行われるようになっている。
このような構成の半導体装置1bによれば、前述した半導体装置1と同様な効果を得ることができるとともに、チップスケールパッケージ5〜8の放熱も効果的に行うことができる。
図5,6は、他の実施形態の半導体装置1cの構成を模式的に示すものである。図5は半導体装置1cの上面図であり、図6は図5のB−B方向に沿った断面図である。この実施形態の半導体装置1cは、チップスケールパッケージ5〜8が、特に放熱を必要としない場合のものであり、放熱板10cが、矩形状ではなく、略十字状に形成されている。したがって、チップスケールパッケージ5〜8の上部は、放熱板10cによって覆われることなく、露出した状態となっている。
このような構成の半導体装置1cによれば、前述した半導体装置1と同様な効果を得ることができるとともに、放熱板10cの製造に必要とされる材料の量を削減することができ、製造コストの低減と、装置の重量の低減とを図ることができる。
図7は、他の実施形態の半導体装置1dの構成を模式的に示すものである。この実施形態の半導体装置1dでは、配線基板2dの半導体チップ3及び電子部品9及びチップスケールパッケージ5〜8の搭載領域より外周部において、配線基板2dと、放熱板10dの4つの柱状固定部13dとが固定されるようになっている。すなわち、前述した図1等に示した実施形態の半導体装置1と比べた場合、配線基板2dの外形が僅かに拡大されており、この拡大された部分において、配線基板2dに4つの柱状固定部13dが固定される構造となっている。また、配線基板2dの4つの角部において、配線基板2dに柱状固定部13dが固定されるようになっており、各柱状固定部13dは、横断面形状が略L字状とされている。
このような構成の半導体装置1dによれば、前述した半導体装置1等と比べて、さらに、反りの抑制効果を高めることができる。しかしながら、配線基板2dの外形が大きくなるため、装置全体の大きさは、前述した半導体装置1等と比べて、僅かに大きくなる。
なお、本発明は、上記した各実施形態に限定されるものではなく、各種の変形が可能であることは、勿論である。例えば、上記した各実施形態では、中央に1つの半導体チップ3が設けられ、4つの角部に1つずつ合計4つのチップスケールパッケージ5〜8が設けられている場合について説明したが、これらの数や配置は、どのようなものでも良い。
1……半導体装置、2……配線基板、3……半導体チップ、4……アンダーフィル、5〜8……チップスケールパッケージ、9……電子部品、10……放熱板、11……放熱用樹脂、12……凸部、13……柱状固定部、14……樹脂。
Claims (5)
- 配線基板と、
前記配線基板上に搭載された半導体チップと、
前記配線基板上に搭載された電子部品と、
前記配線基板上に搭載されたチップスケールパッケージと、
前記半導体チップと接触するように配設され、前記配線基板の縁部において当該配線基板と固定される少なくとも4つの柱状固定部を有する放熱板と
を具備したことを特徴とする半導体装置。 - 配線基板と、
前記配線基板上に搭載された半導体チップと、
前記配線基板上に搭載された電子部品と、
前記配線基板上に搭載されたチップスケールパッケージと、
前記半導体チップと接触するように配設され、前記配線基板の前記半導体チップ及び前記電子部品及びチップスケールパッケージの搭載領域より外周部において当該配線基板と固定される少なくとも4つの柱状固定部を有する放熱板と
を具備したことを特徴とする半導体装置。 - 矩形状の配線基板と、
前記配線基板上の中央部に搭載された半導体チップと、
前記配線基板の角部に夫々搭載されたチップスケールパッケージと、
前記第1の半導体チップの外周部であって、前記チップスケールパッケージの間に搭載された複数の電子部品と、
前記半導体チップと接触するように配設され、前記配線基板の前記チップスケールパッケージの間であって、前記電子部品の搭載領域より外周部において当該配線基板と固定される少なくとも4つの柱状固定部を有する放熱板と
を具備したことを特徴とする半導体装置。 - 請求項1〜3いずれか1項記載の半導体装置であって、
前記放熱板が、前記チップスケールパッケージと接触するように配置されていることを特徴とする半導体装置。 - 請求項1〜3いずれか1項記載の半導体装置であって、
前記放熱板が、前記チップスケールパッケージの上側を除いた領域に配置されていることを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2006013501A JP2007194535A (ja) | 2006-01-23 | 2006-01-23 | 半導体装置 |
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JP2006013501A JP2007194535A (ja) | 2006-01-23 | 2006-01-23 | 半導体装置 |
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JP2006013501A Withdrawn JP2007194535A (ja) | 2006-01-23 | 2006-01-23 | 半導体装置 |
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JP (1) | JP2007194535A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11776866B2 (en) | 2019-12-12 | 2023-10-03 | Samsung Electronics Co., Ltd. | Semiconductor module heatspreading lid having integrated separators for multiple chips |
-
2006
- 2006-01-23 JP JP2006013501A patent/JP2007194535A/ja not_active Withdrawn
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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US11776866B2 (en) | 2019-12-12 | 2023-10-03 | Samsung Electronics Co., Ltd. | Semiconductor module heatspreading lid having integrated separators for multiple chips |
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