JP2006314028A - 局部発振回路、携帯情報端末および局部発振制御方法 - Google Patents
局部発振回路、携帯情報端末および局部発振制御方法 Download PDFInfo
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Abstract
【解決手段】 2系統のPLL回路をそれぞれ有する第1の集積回路(40a)および第2の集積回路(40b)と、基準発振回路(30)と、2系統の周波数帯域の信号を出力する出力回路(50,60)とを備える。互いに同一系統となる2つの第1PLL回路(70A,70B)は、該各PLL回路をフレーム期間中の異なるタイムスロットにて動作させるための制御信号が供給される信号線(70AC,70BC)と出力回路とに接続される。第1の集積回路の第2PLL回路(80A)は、該PLL回路を上記タイムスロットの双方にて動作させるための制御信号が供給される信号線(80AC)と出力回路とに接続される。第2の集積回路の第2PLL回路(80B)は、出力回路には接続されず、第1の集積回路のPLL回路が接続された信号線(70AC,80AC)のうちのいずれかと接続される。
【選択図】 図1
Description
40a/40b PLLIC
50 VCO
60 アンプ
70A/70B 第1PLL回路
80A/80B 第2PLL回路
90a/90b 入力端子
90c 出力端子
91a/91b 接続点
100a/100b DCカットコンデンサ
Claims (6)
- TDMA/TDDのフレーム期間に出力すべき2系統の周波数帯域の信号に対応する2系統のPLL回路をそれぞれ有する第1の集積回路および第2の集積回路と、前記各PLL回路に対し基準周波数の信号を並列的に供給すべく前記第1および第2の両集積回路に接続された基準発振回路と、前記第1の集積回路および第2の集積回路の出力信号に基づき前記2系統の周波数帯域の信号を出力する出力回路とを備え、
前記第1の集積回路の一方のPLL回路および該回路と同一系統となる前記第2の集積回路の一方のPLL回路は、該各PLL回路をフレーム期間中の異なるタイムスロットにて動作させるための制御信号が供給される信号線と前記出力回路とに接続され、
前記第1の集積回路の他方のPLL回路は、該PLL回路を前記相互に異なるタイムスロットの双方にて動作させるための制御信号が供給される信号線と前記出力回路とに接続され、
前記第2の集積回路の他方のPLL回路は、前記第1の集積回路のPLL回路が接続された前記信号線のうちのいずれかと接続され且つ前記出力回路に接続されないことを特徴とする局部発振回路。 - 前記第1および第2の各集積回路と前記基準発振回路との間にコンデンサが接続されていることを特徴とする請求項1記載の局部発振回路。
- 請求項1又は2記載の局部発振回路を備え、該局部発振回路から出力される2系統の周波数帯域の信号により無線通信を行うことを特徴とする携帯情報端末。
- 情報処理装置に着脱可能なデータ通信カードであることを特徴とする請求項3記載の携帯情報端末。
- 携帯電話機であることを特徴とする請求項3記載の携帯情報端末。
- TDMA/TDDのフレーム期間に出力すべき2系統の周波数帯域の信号に対応する2系統のPLL回路をそれぞれ有する第1の集積回路および第2の集積回路と、前記各PLL回路に対し基準周波数の信号を並列的に供給すべく前記第1および第2の両集積回路に接続された基準発振回路と、前記第1の集積回路および第2の集積回路の出力信号に基づき前記2系統の周波数帯域の信号を出力する出力回路とを備える局部発振回路において、
前記第1および第2の両集積回路のPLL回路に対し基準周波数の信号を並列的に入力し、
前記第1の集積回路の一方のPLL回路および該回路と同一系統となる前記第2の集積回路の一方のPLL回路に対し、該各PLL回路をフレーム期間中の異なるタイムスロットにて動作させるための制御信号を入力し、該各PLL回路の出力信号を前記出力回路へ入力し、
前記第1の集積回路の他方のPLL回路に対し、該PLL回路を前記相互に異なるタイムスロットの双方にて動作させるための制御信号を入力し、該PLL回路の出力信号を前記出力回路へ入力し、
前記第2の集積回路の他方のPLL回路を前記出力回路に接続することなく、該PLL回路に対し、前記第1の集積回路のPLL回路へ入力される何れかの制御信号を入力することを特徴とする局部発振制御方法。
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