JP2006278813A - スイッチ回路並びに半導体装置及びその製造方法 - Google Patents
スイッチ回路並びに半導体装置及びその製造方法 Download PDFInfo
- Publication number
- JP2006278813A JP2006278813A JP2005096903A JP2005096903A JP2006278813A JP 2006278813 A JP2006278813 A JP 2006278813A JP 2005096903 A JP2005096903 A JP 2005096903A JP 2005096903 A JP2005096903 A JP 2005096903A JP 2006278813 A JP2006278813 A JP 2006278813A
- Authority
- JP
- Japan
- Prior art keywords
- fet
- gate electrode
- conduction
- layer
- fets
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000004065 semiconductor Substances 0.000 title claims abstract description 83
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 28
- 238000000034 method Methods 0.000 title claims description 12
- 230000015556 catabolic process Effects 0.000 claims abstract description 7
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 28
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 21
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 21
- 229910001218 Gallium arsenide Inorganic materials 0.000 claims description 15
- 239000000203 mixture Substances 0.000 claims description 14
- 229910052757 nitrogen Inorganic materials 0.000 claims description 14
- -1 GaAs compound Chemical class 0.000 claims description 5
- 238000003780 insertion Methods 0.000 abstract description 15
- 230000037431 insertion Effects 0.000 abstract description 15
- 239000010410 layer Substances 0.000 description 117
- 229910004205 SiNX Inorganic materials 0.000 description 33
- 229910004304 SiNy Inorganic materials 0.000 description 24
- 238000010586 diagram Methods 0.000 description 24
- 239000000758 substrate Substances 0.000 description 7
- 229910000980 Aluminium gallium arsenide Inorganic materials 0.000 description 6
- 101100205174 Caenorhabditis elegans lars-1 gene Proteins 0.000 description 6
- 230000001681 protective effect Effects 0.000 description 5
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 239000002344 surface layer Substances 0.000 description 4
- 229910000530 Gallium indium arsenide Inorganic materials 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 230000005669 field effect Effects 0.000 description 3
- 239000012535 impurity Substances 0.000 description 3
- 238000002488 metal-organic chemical vapour deposition Methods 0.000 description 3
- 230000015572 biosynthetic process Effects 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 2
- 230000003247 decreasing effect Effects 0.000 description 2
- 229920002120 photoresistant polymer Polymers 0.000 description 2
- 230000005533 two-dimensional electron gas Effects 0.000 description 2
- 101100060390 Arabidopsis thaliana CLT3 gene Proteins 0.000 description 1
- 102100031699 Choline transporter-like protein 1 Human genes 0.000 description 1
- 101100113686 Clitocybe nebularis clt4 gene Proteins 0.000 description 1
- 102000014778 Concentrative nucleoside transporters Human genes 0.000 description 1
- 108050005111 Concentrative nucleoside transporters Proteins 0.000 description 1
- 101000940912 Homo sapiens Choline transporter-like protein 1 Proteins 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 238000006731 degradation reaction Methods 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
- H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
- H01L27/085—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only
- H01L27/088—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/778—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
- H01L29/7782—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with confinement of carriers by at least two heterojunctions, e.g. DHHEMT, quantum well HEMT, DHMODFET
- H01L29/7783—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with confinement of carriers by at least two heterojunctions, e.g. DHHEMT, quantum well HEMT, DHMODFET using III-V semiconductor material
- H01L29/7785—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with confinement of carriers by at least two heterojunctions, e.g. DHHEMT, quantum well HEMT, DHMODFET using III-V semiconductor material with more than one donor layer
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/778—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
- H01L29/7786—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with direct single heterostructure, i.e. with wide bandgap layer formed on top of active layer, e.g. direct single heterostructure MIS-like HEMT
- H01L29/7787—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface with direct single heterostructure, i.e. with wide bandgap layer formed on top of active layer, e.g. direct single heterostructure MIS-like HEMT with wide bandgap charge-carrier supplying layer, e.g. direct single heterostructure MODFET
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/687—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors
- H03K17/693—Switching arrangements with several input- or output-terminals, e.g. multiplexers, distributors
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Ceramic Engineering (AREA)
- Chemical & Material Sciences (AREA)
- Materials Engineering (AREA)
- Junction Field-Effect Transistors (AREA)
Abstract
【解決手段】 入力端子(70)または出力端子(72)のいずれか一方に接続され、制御端子(74)に接続されたゲート電極により、導通・非導通が制御される第1のFET(81)と、入力端子(70)または出力端子(72)のいずれか他方と第1のFET(81)との間に接続され、制御端子(74)に接続されたゲート電極により、導通・非導通が制御される第2のFET(82、83,84)とを具備し、第1のFETのゲート逆方向耐圧が第2のFETより大きい、または第1のFETのオフ容量が第2のFETより小さいスイッチ回路並びに半導体装置およびその製造方法。
【選択図】 図6
Description
12、16 電子供給層
14、14a チャネル層
18 ショットキ層
20、20a、20b 埋込層
22、22a、22b 高濃度層
24、24a、24b、24c、24d 半導体層
28、28a、28b 空乏層
30 ソース電極
32 ゲート電極
34 ドレイン電極
50、80 スイッチ回路(1)
51、61、81、91 1段目FET
52、62、82、92 2段目FET
53、63、83、93 3段目FET
54、64、84、94 4段目FET
55、65、85、95 5段目FET
58、68、88、98 抵抗Rgg
60、90 スイッチ回路(2)
70 入力端子
71 抵抗
72 出力端子(1)
74 制御端子(1)
76 出力端子(2)
78 制御端子(2)
122 半導体チップ
124 制御回路
126 RFスイッチ
Claims (16)
- 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
前記入力端子または出力端子のいずれか他方と前記第1のFETとの間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備し、
前記第1のFETのゲート逆方向耐圧が、前記第2のFETよりも大きいことを特徴とするスイッチ回路。 - 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
前記入力端子または出力端子のいずれか他方と前記第1のFETとの間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備し、
前記第1のFETのオフ容量が、前記第2のFETよりも小さいことを特徴とするスイッチ回路。 - 前記入力端子または出力端子のいずれか他方に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御されるとともに、ゲート逆方向耐圧が前記第2のFETよりも大きいか、または、オフ容量が前記第2のFETよりも小さい第3のFETを更に備えることを特徴とする請求項1または2記載のスイッチ回路。
- 前記第1のFETと前記入力端子または出力端子のいずれか他方との間には、前記第2のFETが複数直列に設けられてなることを特徴とする請求項1乃至3のいずれか一項記載のスイッチ回路。
- 前記制御端子を接地することにより、前記非導通をなすことを特徴とする請求項1乃至4のいずれか一項記載のスイッチ回路。
- 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
前記第1のFETと前記入力端子または出力端子のいずれか他方の間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備し、
前記第1のFETと前記第2のFETとは、そのゲート電極が埋込層内に埋め込まれてなるとともに、前記第1のFETにおける埋込層に埋め込まれた埋込厚は、前記第2のFETにおける埋込層に埋め込まれた埋込厚よりも薄いことを特徴とする半導体装置。 - 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
前記第1のFETと前記入力端子または出力端子のいずれか他方の間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備し、
前記第1のFETと前記第2のFETとは、そのゲート電極とソース電極並びにゲート電極とドレイン電極の間の半導体層表面が、窒化シリコン膜によって被覆されてなり、前記第1のFETにおける前記窒化シリコン膜の窒素組成は、前記第2のFETにおける窒化シリコン膜の窒素組成比よりも小さいことを特徴とする半導体装置。 - 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
前記第1のFETと前記入力端子または出力端子のいずれか他方の間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備し、
前記第1のFETと前記第2のFETとは、そのゲート電極はゲートリセス内に設けられるとともに、前記第1のFETにおけるゲートリセス幅は、前記第2のFETにおけるゲートリセス幅よりも広いことを特徴とする半導体装置。 - 前記第1のFETおよび前記第2のFETは、電子供給層とチャネル層を備えるHEMTであることを特徴とする請求項6乃至8のいずれか一項記載の半導体装置。
- 前記電子供給層は、前記チャネル層の上下に設けられていることを特徴とする請求項9記載の半導体装置。
- 前記第1のFETおよび前記第2のFETは、GaAs系化合物半導体により構成されてなることを特徴とする請求項6乃至8のいずれか一項記載の半導体装置。
- 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
前記第1のFETと前記入力端子または出力端子のいずれか他方の間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備する半導体装置の製造方法であって、
前記ゲート電極が設けられるショットキ層上に埋込層を形成する工程と、
前記第1のFETのゲート電極が形される領域の前記埋込層を露出し、前記第2のFETのゲート電極が形される領域の前記埋込層をマスク層で被覆して、前記第1のFETの前記ゲート電極が形される領域の前記埋込層の厚みを選択的に減じる工程と、
前記第1のFETおよび第2のFETそれぞれの前記ゲートが形される領域の前記埋込層に前記ショットキ層を露出する開口部を形成する工程と、
前記開口部のそれぞれにゲート電極を形成する工程と、
を有することを特徴とする半導体装置の製造方法。 - 入力端子または出力端子のいずれか一方に接続され、制御端子に接続されたゲート電極により、導通・非導通が制御される第1のFETと、
記第1のFETと前記入力端子または出力端子のいずれか他方の間に接続され、前記制御端子に接続されたゲート電極により、導通・非導通が制御される第2のFETとを具備する半導体装置の製造方法であって、
半導体層上に第1の窒化シリコン膜を形成する工程と、
前記第1のFETのゲート電極とソース電極の間並びにゲート電極とドレイン電極の間となるべき領域の前記第1の窒化シリコン膜を前記第2のFETのゲート電極とソース電極の間並びにゲート電極とドレイン電極の間となるべき領域の前記第1の窒化シリコン膜を残して選択的に除去する工程と、
前記半導体層上の前記第1のFETのゲート電極とソース電極の間並びにゲート電極とドレイン電極の間となるべき領域に前記第1の窒化シリコン膜よりも窒素組成比が小さい第2の窒化シリコン膜を形成する工程と、
を有することを特徴とする半導体装置の製造方法。 - 前記第1のFETおよび前記第2のFETは、電子供給層とチャネル層を備えるHEMTであることを特徴とする請求項12または13記載の半導体装置の製造方法。
- 前記電子供給層は、前記チャネル層の上下に設けられていることを特徴とする請求項14記載の半導体装置の製造方法。
- 前記第1のFETおよび前記第2のFETは、GaAs系化合物半導体により構成されてなることを特徴とする請求項12または13記載の半導体装置の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005096903A JP4854980B2 (ja) | 2005-03-30 | 2005-03-30 | スイッチ回路及び半導体装置の製造方法 |
US11/391,487 US7821031B2 (en) | 2005-03-30 | 2006-03-29 | Switch circuit, semiconductor device, and method of manufacturing said semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005096903A JP4854980B2 (ja) | 2005-03-30 | 2005-03-30 | スイッチ回路及び半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2006278813A true JP2006278813A (ja) | 2006-10-12 |
JP4854980B2 JP4854980B2 (ja) | 2012-01-18 |
Family
ID=37068988
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005096903A Expired - Fee Related JP4854980B2 (ja) | 2005-03-30 | 2005-03-30 | スイッチ回路及び半導体装置の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US7821031B2 (ja) |
JP (1) | JP4854980B2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008181911A (ja) * | 2007-01-23 | 2008-08-07 | Eudyna Devices Inc | 半導体装置 |
JP2012094798A (ja) * | 2010-10-22 | 2012-05-17 | Jiaotong Univ | 直列接続式の高電子移動度トランジスターデバイス及びその製造方法 |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6299117B2 (ja) * | 2013-08-30 | 2018-03-28 | 三菱電機株式会社 | 窒化物半導体デバイスの製造方法、バーンイン装置 |
KR20220001812A (ko) * | 2020-06-30 | 2022-01-06 | 삼성전기주식회사 | Rf 스위치 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6165480A (ja) * | 1984-09-07 | 1986-04-04 | Fujitsu Ltd | 半導体装置の製造方法 |
JPH08139014A (ja) * | 1994-11-10 | 1996-05-31 | Sanyo Electric Co Ltd | スイッチ回路装置 |
JP2003086767A (ja) * | 2001-09-14 | 2003-03-20 | Matsushita Electric Ind Co Ltd | 半導体装置 |
JP2003243977A (ja) * | 2002-02-21 | 2003-08-29 | Sony Corp | 高周波信号のスイッチングを行う半導体集積回路 |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH088350B2 (ja) * | 1985-04-08 | 1996-01-29 | 日本電気株式会社 | 半導体装置 |
JP3447438B2 (ja) * | 1994-12-06 | 2003-09-16 | 本田技研工業株式会社 | 電界効果トランジスタ |
JP3707766B2 (ja) * | 1999-09-09 | 2005-10-19 | 株式会社村田製作所 | 電界効果型半導体装置 |
-
2005
- 2005-03-30 JP JP2005096903A patent/JP4854980B2/ja not_active Expired - Fee Related
-
2006
- 2006-03-29 US US11/391,487 patent/US7821031B2/en not_active Expired - Fee Related
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6165480A (ja) * | 1984-09-07 | 1986-04-04 | Fujitsu Ltd | 半導体装置の製造方法 |
JPH08139014A (ja) * | 1994-11-10 | 1996-05-31 | Sanyo Electric Co Ltd | スイッチ回路装置 |
JP2003086767A (ja) * | 2001-09-14 | 2003-03-20 | Matsushita Electric Ind Co Ltd | 半導体装置 |
JP2003243977A (ja) * | 2002-02-21 | 2003-08-29 | Sony Corp | 高周波信号のスイッチングを行う半導体集積回路 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008181911A (ja) * | 2007-01-23 | 2008-08-07 | Eudyna Devices Inc | 半導体装置 |
JP4494423B2 (ja) * | 2007-01-23 | 2010-06-30 | 住友電工デバイス・イノベーション株式会社 | 半導体装置 |
JP2012094798A (ja) * | 2010-10-22 | 2012-05-17 | Jiaotong Univ | 直列接続式の高電子移動度トランジスターデバイス及びその製造方法 |
Also Published As
Publication number | Publication date |
---|---|
US20060219534A1 (en) | 2006-10-05 |
US7821031B2 (en) | 2010-10-26 |
JP4854980B2 (ja) | 2012-01-18 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US11791340B2 (en) | Butted body contact for SOI transistor, amplifier circuit and method of providing the same | |
US5313083A (en) | R.F. switching circuits | |
US6642578B1 (en) | Linearity radio frequency switch with low control voltage | |
US20170201250A1 (en) | Switching system and method | |
JP4024762B2 (ja) | 高周波スイッチ | |
US7087957B2 (en) | Semiconductor device and manufacturing method of the same | |
EP3460843B1 (en) | Transistor with shield structure, packaged device, and method of manufacture | |
WO2007062369A2 (en) | Semiconductor device and circuit having multiple voltage controlled capacitors | |
US20170338251A1 (en) | Butted Body Contact for SOI Transistor | |
US20040021175A1 (en) | Field effect transistor and method of manufacturing same | |
JP4854980B2 (ja) | スイッチ回路及び半導体装置の製造方法 | |
JP2008034406A (ja) | スイッチ半導体集積回路装置 | |
US7015545B2 (en) | Split source RF MOSFET device | |
WO2017164904A1 (en) | Butted body contact for soi transistor | |
CN107395169A (zh) | 开关 | |
US7880549B1 (en) | Transistor including intrinsic harmonic trap | |
JP2005353991A (ja) | 半導体装置 | |
JP5652392B2 (ja) | 半導体スイッチ装置、および半導体スイッチ装置の製造方法 | |
JP2007299948A (ja) | 高周波半導体スイッチ | |
JP2007194413A (ja) | 化合物半導体スイッチ回路装置 | |
KR20050021580A (ko) | 전계 효과 트랜지스터 및 그 제조 방법 | |
IE20100668U1 (en) | Switching system and method |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20080312 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20110727 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20110802 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20110928 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20111025 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20111026 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20141104 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |