JP2006268419A - メモリバックアップ回路およびこれを用いた電子機器 - Google Patents
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Abstract
【課題】 停電検出回路の単一故障によるバックアップ動作不良を回避し、バッテリの長寿命化を実現する。
【解決手段】 例えばディスクアレイ装置のメモリバックアップ回路に、外部電力を入力し回路に必要な直流電圧を出力する直流電源回路と、前記外部電力の入力状態を監視する第1の停電検出回路と、前記直流電源回路の出力電圧を監視する第2の停電検出回路と、前記外部電力の消失時に揮発性メモリへ電力を供給するバックアップ電源と、前記第1または第2の停電検出手段から停電検出信号を受けた場合に前記揮発性メモリのバックアップ制御を実施するメモリ制御手段と、前記第2の停電検出手段のみが電圧低下を検出した場合に前記バックアップ電源の電力を所定期間前記メモリ制御手段へ供給するスイッチ手段とを設ける。
【選択図】 図1
Description
20 直流電源回路
22 停電検出回路
24 メモリ制御回路
26 メモリ制御回路用DCDCコンバータ
28 揮発性メモリ
30 揮発性メモリ用DCDCコンバータ
32 二次電源
34 充電回路
40 第2の停電検出回路
42 入力電圧監視回路
44 タイマ回路
50 放電制御回路
52 半導体スイッチ
54 ダイオード
56 2入力NAND回路
62,64,66 ダイオード
Claims (6)
- 外部電力を入力し回路に必要な直流電圧を出力する直流電源回路と、前記外部電力の入力状態を監視する第1の停電検出回路と、前記直流電源回路の出力電圧を監視する第2の停電検出回路と、前記外部電力の消失時に揮発性メモリへ電力を供給するバックアップ電源と、前記第1または第2の停電検出手段から停電検出信号を受けた場合に前記揮発性メモリのバックアップ制御を実施するメモリ制御手段と、前記第2の停電検出手段のみが電圧低下を検出した場合に前記バックアップ電源の電力を所定期間前記メモリ制御手段へ供給するスイッチ手段を備えることを特徴とするメモリバックアップ回路。
- 請求項1に記載のメモリバックアップ回路において、前記第2の停電検出回路が電圧低下を検出した場合に検出信号を所定期間だけ出力するタイマ回路を備えることを特徴とするメモリバックアップ回路。
- 請求項2に記載のメモリバックアップ回路において、前記スイッチ手段は、前記第1の停電検出回路の停電検出信号がなく、且つ前記タイマ回路の検出信号がある場合に、前記バックアップ電源の電力を前記メモリ制御手段に供給するよう制御されることを特徴とするメモリバックアップ回路。
- 請求項1乃至3のいずれかに記載のメモリバックアップ回路において、前記メモリ制御手段は、前記第1または第2の停電検出手段から停電検出信号を受けた場合に、前記揮発性メモリの格納データを不揮発性メモリに待避させる処理を所定期間行い、その後前記揮発性メモリをセルフリフレッシュモードに移行させることを特徴とするメモリバックアップ回路。
- 請求項1乃至4のいずれかに記載のメモリバックアップ回路を具備することを特徴とする電子機器。
- 請求項5に記載の電子機器であって、当該機器がディスクアレイ装置であることを特徴とする電子機器。
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