JP2006127751A - 同じ極性を有するmisトランジスタを用いるシフトレジスタの改良 - Google Patents
同じ極性を有するmisトランジスタを用いるシフトレジスタの改良 Download PDFInfo
- Publication number
- JP2006127751A JP2006127751A JP2005341578A JP2005341578A JP2006127751A JP 2006127751 A JP2006127751 A JP 2006127751A JP 2005341578 A JP2005341578 A JP 2005341578A JP 2005341578 A JP2005341578 A JP 2005341578A JP 2006127751 A JP2006127751 A JP 2006127751A
- Authority
- JP
- Japan
- Prior art keywords
- output
- stage
- node
- transistor
- semiconductor device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
- G11C19/28—Digital stores in which the information is moved stepwise, e.g. shift registers using semiconductor elements
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2300/00—Aspects of the constitution of display devices
- G09G2300/04—Structural and physical details of display devices
- G09G2300/0404—Matrix technologies
- G09G2300/0408—Integration of the drivers onto the display substrate
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3674—Details of drivers for scan electrodes
- G09G3/3677—Details of drivers for scan electrodes suitable for active matrices only
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3685—Details of drivers for data electrodes
- G09G3/3688—Details of drivers for data electrodes suitable for active matrices only
Landscapes
- Shift Register Type Memory (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
【解決手段】各段nは、ノードDの出力より成り、段n−1の出力と、段n+1の出力と、第1及び第2のクロック信号(φ1,φ2)とに接続されている。段は、クロック信号φ1のハイとロウとの間で切り替わる第1の半導体装置(MN2)により構成され、第1の半導体装置はノードGの電位により制御される。ノードGは、段n−1の出力により制御される第2の半導体装置(MN1)を介して前の段(n−1)の出力に接続され、段n+1の出力により制御される第3の半導体装置(MN3)を介して負電位(V−)に接続され、キャパシタンス(C2)を介して第2のクロック信号φ2に接続される。シフトレジスタは、ノードGと段n+1の出力との間に設けられたキャパシタンス(C3)を更に有する。上記シフトレジスタは液晶ディスプレイ用ドライバに使用される。
【選択図】図7
Description
上記段は、上記第1のクロック信号の高い値と低い値との間で出力を切り替える第1の半導体出力装置を含み、
上記第1の半導体出力装置は第2のノードの電位により制御され、
上記第2のノード自体は、
−上記前の段の出力によって制御された第2の半導体装置を介して上記前の段の出力に接続され、
−上記次の段の出力によって制御された第3の半導体装置を介して負電位に接続され、
−第1のキャパシタンスを介して上記第2のクロック信号を送出する手段に接続されたシフトレジスタであって、
上記第2のノードと上記次の段の出力との間に設けられたキャパシタンスを更に有することを特徴とするシフトレジスタである。
上記段は、上記第1のクロック信号の高い値と低い値との間で出力を切り替える第1の半導体出力装置を含み、
上記第1の半導体出力装置は第2のノードの電位により制御され、
上記第2のノード自体は、
−上記前の段の出力によって制御された第2の半導体装置を介して上記前の段の出力に接続され、
−上記次の段の出力によって制御された第3の半導体装置を介して負電位に接続され、
−第1のキャパシタンスを介して上記第2のクロック信号を送出する手段に接続されたシフトレジスタであって、
上記第2の半導体装置の制御電圧をゼロ以下の値にラッチする手段を更に有することを特徴とするシフトレジスタである。
上記段は、上記第1のクロック信号の高い値と低い値との間で出力を切り替える第1の半導体出力装置を含み、
上記第1の半導体出力装置は第2のノードの電位により制御され、
上記第2のノード自体は、
−上記前の段の出力によって制御された第2の半導体装置を介して上記前の段の出力に接続され、
−上記次の段の出力によって制御された第3の半導体装置を介して負電位に接続され、
−第1のキャパシタンスを介して上記第2のクロック信号を送出する手段に接続されたシフトレジスタであって、
出力ラインを低いレベルに維持する手段を更に有することを特徴とするシフトレジスタである。
上記段は、上記第1のクロック信号の高い値と低い値との間で出力を切り替える第1の半導体出力装置を含み、
上記第1の半導体出力装置は第2のノードの電位により制御され、
上記第2のノード自体は、第1のキャパシタンスを介して上記第2のクロック信号を送出する手段に接続されたシフトレジスタであって、
上記第2のノードは、
−上記前の段の出力によって制御された第2の半導体装置を介して第1の高電位若しくは低電位に接続され、
−上記次の段の出力によって制御された第3の半導体装置を介して第2の高電位若しくは低電位に接続されることを特徴とするシフトレジスタである。
この場合、トランジスタMN1のゲートは、図5の実施例と同様に、カップリングキャパシタンスC5を介して前の段の出力ラインに接続され、ダイオードマウント型MOSトランジスタMN5は、キャパシタンスC及びトランジスタMN1の共通ポイントと、ポイントGとの間に接続される。同様に、放電トランジスタMN3は、カップリングキャパシタンスC6を介して次の段に接続され、トランジスタMN6からなる"クランプ"ダイオードが更に設けられている。図8の実施例において、ノードGは電圧V1に連結されている。実際上、図7及び8の実施例において、トランジスタMN1及びMN3は、段が双方向に動作し得るように対称的な役割を果たす。
22,30 ライン
32 接地
J,J−1,J+1 ライン
n,n−1.n+1 出力ライン
D,G,Z ノード
C1,C2,C3,C5,Cb,Cl,Cp キャパシタンス
Ccomp 補償容量
Tp,Td,Tl,MN1,MN2,MN3,MN4,MN5,MN6,MN7 トランジスタ
φ1,φ2 クロック信号
V−,Vgoff,Vcomp 電圧
Reset リセット・ツウ・ゼロパル
Claims (7)
- 各段(n)が第1のノード(D)に出力を有し、前の段(n−1)の出力、次の段(n+1)の出力、並びに、第1及び第2のクロック信号(φ1,φ2)を送出する手段に接続されている複数の縦続された段(n−1,n,n+1)を含み、
上記段は上記第1のクロック信号(φ1)の高い値と低い値との間で出力(n)を切り替える第1の半導体出力装置(MN2)を含み、
上記第1の半導体出力装置は第2のノード(G)の電位により制御され、
上記第2のノード自体は、
−第1のキャパシタンスを介して上記第2のクロック信号(φ2)を送出する手段に接続されている、シフトレジスタであって、
上記第2のノードは、更に、
−上記前の段(n−1)の出力によって制御される第2の半導体装置(MN1)を介して第1の高い若しくは低い電位(Vb)に接続され、
−上記次の段(n+1)の出力によって制御される第3の半導体装置(MN3)を介して第2の低い若しくは高い電位(Vh)に接続されていることを特徴とするレジスタ。 - 出力ラインと、負電圧(Vgoff)との間に接続され、上記前の段の出力により制御される第6の半導体装置を更に有することを特徴とする請求項1記載のレジスタ。
- 上記段の出力(n)は、上記次の段(n+1)の出力又は一つおいて次の段(n+2)の出力により制御される第4の半導体装置(MN4)を介して負電圧(Vgoff)に接続されていることを特徴とする請求項1又は2記載のレジスタ。
- 上記第2のノード(G)は電圧(V1)に接続され、
上記第2及び第3の半導体装置の制御電圧をゼロ以下の値にラッチする手段を更に有することを特徴とする請求項1乃至3のうちいずれか1項記載のレジスタ。 - 上記ラッチする手段は、
上記半導体装置(MN1,MN3)と上記第2のノード(G)との間に接続されたキャパシタンス(C5,C6)と、
上記第2の半導体装置と上記第2のノード(G)との間、及び、上記第3の半導体装置と上記第2のノード(G)との間に夫々接続され、上記第2のノード(G)の上記電圧(V1)により制御される第5及び第6の半導体装置(MN5,MN6)とにより構成されることを特徴とする請求項4記載のレジスタ。 - 上記半導体装置は、MISトランジスタ、好ましくは、TFTトランジスタにより構成されることを特徴とする請求項1乃至5のうちいずれか1項記載のレジスタ。
- 上記第1及び第2のクロック信号(φ1,φ2)は逆位相の同じくロック信号から得られることを特徴とする請求項1乃至6のうちいずれか1項記載のレジスタ。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9600260A FR2743662B1 (fr) | 1996-01-11 | 1996-01-11 | Perfectionnement aux registres a decalage utilisant des transistors mis de meme polarite |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP52492397A Division JP3856048B2 (ja) | 1996-01-11 | 1997-01-09 | 同じ極性を有するmisトランジスタを用いるシフトレジスタの改良 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2006127751A true JP2006127751A (ja) | 2006-05-18 |
JP4035548B2 JP4035548B2 (ja) | 2008-01-23 |
Family
ID=9488037
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005341578A Expired - Lifetime JP4035548B2 (ja) | 1996-01-11 | 2005-11-28 | 同じ極性を有するmisトランジスタを用いるシフトレジスタの改良 |
Country Status (4)
Country | Link |
---|---|
EP (1) | EP1156491B1 (ja) |
JP (1) | JP4035548B2 (ja) |
KR (1) | KR100450865B1 (ja) |
DE (2) | DE69732867T2 (ja) |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2009084272A1 (ja) * | 2007-12-28 | 2009-07-09 | Sharp Kabushiki Kaisha | 半導体装置及び表示装置 |
US8547368B2 (en) | 2007-12-28 | 2013-10-01 | Sharp Kabushiki Kaisha | Display driving circuit having a memory circuit, display device, and display driving method |
US8587572B2 (en) | 2007-12-28 | 2013-11-19 | Sharp Kabushiki Kaisha | Storage capacitor line drive circuit and display device |
US8675811B2 (en) | 2007-12-28 | 2014-03-18 | Sharp Kabushiki Kaisha | Semiconductor device and display device |
JP2014131263A (ja) * | 2012-11-28 | 2014-07-10 | Semiconductor Energy Lab Co Ltd | 半導体装置、表示装置、及び電子機器 |
JP2014518039A (ja) * | 2011-05-10 | 2014-07-24 | トリクセル エス.アー.エス. | アクティブ検出マトリックス用の制御回路のラインをアドレス指定する装置 |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100685307B1 (ko) * | 1999-11-05 | 2007-02-22 | 엘지.필립스 엘시디 주식회사 | 쉬프트 레지스터 |
JP3866070B2 (ja) * | 2000-10-20 | 2007-01-10 | 株式会社 日立ディスプレイズ | 表示装置 |
KR100853720B1 (ko) * | 2002-06-15 | 2008-08-25 | 삼성전자주식회사 | 비정질-실리콘 박막 트랜지스터 게이트 구동 쉬프트레지스터 및 이를 가지는 액정 표시 장치 |
TW200703224A (en) * | 2005-03-22 | 2007-01-16 | Koninkl Philips Electronics Nv | A shift register circuit |
WO2007013010A2 (en) * | 2005-07-26 | 2007-02-01 | Koninklijke Philips Electronics N.V. | A multiple input circuit |
FR2920907B1 (fr) * | 2007-09-07 | 2010-04-09 | Thales Sa | Circuit de commande des lignes d'un ecran plat a matrice active. |
CN102800272B (zh) * | 2011-05-27 | 2016-07-06 | 凌巨科技股份有限公司 | 显示装置的驱动电路 |
CN103943054B (zh) | 2014-01-27 | 2016-07-13 | 上海中航光电子有限公司 | 栅极驱动电路、tft阵列基板、显示面板及显示装置 |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5282234A (en) * | 1990-05-18 | 1994-01-25 | Fuji Photo Film Co., Ltd. | Bi-directional shift register useful as scanning registers for active matrix displays and solid state image pick-up devices |
FR2720185B1 (fr) * | 1994-05-17 | 1996-07-05 | Thomson Lcd | Registre à décalage utilisant des transistors M.I.S. de même polarité. |
-
1997
- 1997-01-09 EP EP01119573A patent/EP1156491B1/fr not_active Expired - Lifetime
- 1997-01-09 DE DE69732867T patent/DE69732867T2/de not_active Expired - Lifetime
- 1997-01-09 DE DE69713687T patent/DE69713687T2/de not_active Expired - Lifetime
- 1997-01-09 KR KR1019970706365A patent/KR100450865B1/ko not_active IP Right Cessation
-
2005
- 2005-11-28 JP JP2005341578A patent/JP4035548B2/ja not_active Expired - Lifetime
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2009084272A1 (ja) * | 2007-12-28 | 2009-07-09 | Sharp Kabushiki Kaisha | 半導体装置及び表示装置 |
JP4902750B2 (ja) * | 2007-12-28 | 2012-03-21 | シャープ株式会社 | 半導体装置及び表示装置 |
US8547368B2 (en) | 2007-12-28 | 2013-10-01 | Sharp Kabushiki Kaisha | Display driving circuit having a memory circuit, display device, and display driving method |
US8587572B2 (en) | 2007-12-28 | 2013-11-19 | Sharp Kabushiki Kaisha | Storage capacitor line drive circuit and display device |
US8675811B2 (en) | 2007-12-28 | 2014-03-18 | Sharp Kabushiki Kaisha | Semiconductor device and display device |
US8718223B2 (en) | 2007-12-28 | 2014-05-06 | Sharp Kabushiki Kaisha | Semiconductor device and display device |
JP2014518039A (ja) * | 2011-05-10 | 2014-07-24 | トリクセル エス.アー.エス. | アクティブ検出マトリックス用の制御回路のラインをアドレス指定する装置 |
JP2014131263A (ja) * | 2012-11-28 | 2014-07-10 | Semiconductor Energy Lab Co Ltd | 半導体装置、表示装置、及び電子機器 |
US10032428B2 (en) | 2012-11-28 | 2018-07-24 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device, display device, and electronic device |
Also Published As
Publication number | Publication date |
---|---|
KR19980702957A (ko) | 1998-09-05 |
EP1156491B1 (fr) | 2005-03-23 |
EP1156491A2 (fr) | 2001-11-21 |
KR100450865B1 (ko) | 2005-01-13 |
JP4035548B2 (ja) | 2008-01-23 |
DE69732867T2 (de) | 2006-04-13 |
DE69732867D1 (de) | 2005-04-28 |
EP1156491A3 (fr) | 2003-11-05 |
DE69713687T2 (de) | 2003-02-06 |
DE69713687D1 (de) | 2002-08-08 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3856048B2 (ja) | 同じ極性を有するmisトランジスタを用いるシフトレジスタの改良 | |
JP4035548B2 (ja) | 同じ極性を有するmisトランジスタを用いるシフトレジスタの改良 | |
US6052426A (en) | Shift register using M.I.S. transistors of like polarity | |
JP4126613B2 (ja) | 液晶表示装置のゲート駆動装置及び方法 | |
US6426743B1 (en) | Shift register | |
KR100516238B1 (ko) | 표시 장치 | |
US6339631B1 (en) | Shift register | |
US6300928B1 (en) | Scanning circuit for driving liquid crystal display | |
US7586473B2 (en) | Active matrix array device, electronic device and operating method for an active matrix array device | |
US7825888B2 (en) | Shift register circuit and image display apparatus containing the same | |
US6243066B1 (en) | Drive circuit for liquid-crystal displays and liquid-crystal display including drive circuits | |
US8159484B2 (en) | Liquid crystal device, pixel circuit, active matrix substrate, and electronic apparatus | |
CN109935204B (zh) | 移位寄存器单元、栅极驱动电路、显示装置及驱动方法 | |
US20080036717A1 (en) | Liquid crystal display apparatus | |
US20130272487A1 (en) | Shift register circuit and image display comprising the same | |
US20070268227A1 (en) | Active matrix display device | |
WO2007086601A1 (en) | Shift register circuit and display drive device | |
KR101137859B1 (ko) | 쉬프트 레지스터 | |
KR20070073634A (ko) | 시프트 레지스터 회로 및 그것을 구비한 화상표시장치 | |
US5631940A (en) | Thin film boot strap shift register | |
US20050018807A1 (en) | Shift register | |
KR20080011896A (ko) | 게이트 온 전압 발생회로와 게이트 오프 전압 발생회로 및이들을 갖는 액정표시장치 | |
US6919874B1 (en) | Shift register using M.I.S. transistors and supplementary column | |
JP2014521985A (ja) | 蓄積画素の反転に適したアクティブ型のディスプレイデバイス、およびその駆動方法 | |
JPH1185115A (ja) | 液晶装置及びその駆動方法、並びにそれを用いた投写型表示装置及び電子機器 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070626 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20070904 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20071002 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20071029 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101102 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111102 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121102 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121102 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131102 Year of fee payment: 6 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
S533 | Written request for registration of change of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313533 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
EXPY | Cancellation because of completion of term |