JP2006041363A - 樹脂封止型半導体装置 - Google Patents
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Abstract
【課題】 無鉛化と無アンチモン化による対環境性と信頼性に優れた樹脂封止型半導体装置を提供すること。
【解決手段】 半導体素子1とセラミックス回路基板3の回路パターンのろう付け接合使用されているチップ接合用ハンダ層2と、セラミックス回路基板3と金属基板6のろう付け接合使用されている基板接合用ハンダ層5に、固相線温度220℃の錫−銀−銅系ハンダなど、鉛及びアンチモンを含有しないハンダ材料を用い、これらのハンダ層を同時にリフローして樹脂封止型半導体装置を完成させた。
【選択図】 図1
【解決手段】 半導体素子1とセラミックス回路基板3の回路パターンのろう付け接合使用されているチップ接合用ハンダ層2と、セラミックス回路基板3と金属基板6のろう付け接合使用されている基板接合用ハンダ層5に、固相線温度220℃の錫−銀−銅系ハンダなど、鉛及びアンチモンを含有しないハンダ材料を用い、これらのハンダ層を同時にリフローして樹脂封止型半導体装置を完成させた。
【選択図】 図1
Description
本発明は、モジュール化された半導体装置に係り、特にインバータ装置などのパワーデバイスに好適な樹脂封止型半導体装置に関するものである。
近年、半導体装置は、各種の電子機器に不可欠な電子部品になっているが、このとき、インバータ、コンバータ、サーボシステムなど、かなりの電力を扱う電子機器の場合は、それを考慮して、半導体装置も、いわゆるパワー半導体装置としてのパッケージ構成が採用されている。
ここで、このときのモジュール構成の一種に、合成樹脂の絶縁容器を用い、モジュールの底面金属板とモジュール内の電流通電部がモジュールの内部で電気的に絶縁されている、いわゆる内部絶縁構造に作られているものがあり、インバータなどに対する実装が容易なため、近年、このようなパワー半導体装置の応用範囲が拡がってきている(例えば、特許文献1参照。)。
そして、このパワー半導体装置では、底面金属板となるベース部材の一方の面に配線基板を、例えばハンダ(はんだ又は半田ともいう)などによりろう付け接合させ、該配線基板の回路パターン用導体に、同じくハンダなどにより、半導体チップをろう付け接合する方式になっている。
そこで、以下、このようなパワー半導体装置の従来技術について、図2により説明する。
この図2は、模式断面図で示した半導体装置の組立工程を示したもので、ここで、セラミックス回路基板3は、アルミナや窒化アルミニウムなどのセラミックス板の両面に銅箔などの導体層が形成されているもので、その表面(一方の面)の導体層には所定のパターンを形成して回路パターンとし、裏面(他方の面)は接合面として使用するため、導体層のままにしてある。
そして、まず、セラミックス回路基板3の表面にある回路パターンの所定の部分に半導体素子1を搭載し、チップ接合用ハンダ層2により、回路パターンにろう付け接合する(図2(a))。
次に、半導体素子1と回路パターンの他の所定の部分をアルミニウムなどのボンディングワイヤ4により接続する(図2(b))。
次いで、このセラミックス回路基板3を、基板接合用ハンダ層5により、銅板材からなる金属基板6の表面(一方の面)の所定の位置に、ろう付け接合する(図2(c))。
ここで、外部取り出し端子7がインサート成型されている外囲ケース8を金属基板6に接着し、セラミックス回路基板3の表面にある回路パターンの所定の部分を、アルミニウムなどのボンディングワイヤ4により、外部取り出し端子7に接続する(図2(d))。
この後、外囲ケース8の中にシリコーンゲルなどの封止樹脂9を充填し、半導体素子1が搭載されているセラミックス回路基板3を封止してやれば、パワー半導体装置の主要な組立を完了させることができる(図2(e))。
そして、このパワー半導体装置は、図示してないが、ベース板となっている金属基板6の裏面(他方の面)にフィンなどの放熱用部材が取付けられ、これにより、動作中、半導体素子1などが発熱し、温度が上昇したときでも、温度上昇が許容範囲内に収まるようにして使用される。
そして、従来技術では、このときのチップ接合用ハンダ層2と基板接合用ハンダ層5に固相線温度(又は融点)が異なるハンダを用いるという固相線温度の階層化を行ない、チップ接合用ハンダ層2には固相線温度の高いハンダを用い、セラミックス回路基板3を金属基板6に接合する際、チップ接合用ハンダ層2が溶融してしまうのを抑え、半導体素子1と回路パターンの接合が解けてしまわないようにしている。
例えば、従来技術では、チップ接合用ハンダ層2には、少なくとも90wt%の鉛を含有した高固相線温度(300℃以上)のハンダを使用し、基板接合用ハンダ層5には、鉛−錫共晶の低固相線温度(183℃)のハンダを使用している。
一方、近年は環境負荷低減が大きな命題になり、このため、鉛やアンチモンを含む環境有害物質の排除が要件になっているが、このことはパワー半導体装置についても例外ではなく、この点に配慮した従来技術も知られている(例えば、特許文献2参照)。
特開2000−183249号公報
特開2004−63688号公報
上記従来技術は、半導体装置の無鉛化と無アンチモン化及びハンダの固相線温度温度の階層化について配慮がされておらず、環境汚染と信頼性の保持に問題があった。
ここで、これまでに開発され、且つ実用性を有するとされている鉛及びアンチモンを含まないハンダ材は、固相線温度が固相線温度で230℃程度までのものであり、上記した従来技術の組立工程に必要な固相線温度温度の階層化を実現することは困難な状況である。
また、このような半導体装置では、半導体素子をセラミックス回路基板に接合したとき、両者の熱膨張係数のバランスから、半導体素子の搭載側を凸とする反りがセラミックス回路基板に発生することがある。
この場合、従来技術では、上記した固相線温度温度の階層化の結果、次のような問題が発生してしまう。すなわち、このように反りが発生しているセラミックス回路基板を金属基板に接合した場合、このセラミックス回路基板の反りが原因となって基板接合用ハンダ層の中にボイド欠陥が発生してしまうのである。
このような基板接合用ハンダ層中のボイド欠陥は、当該基板接合用ハンダ層が半導体素子から金属基板に至る熱の伝達経路に存在することから、半導体素子の熱放散を阻害し、ボイド欠陥の発生個所及び大きさによっては半導体装置の温度上昇をもたらし、従って、従来技術では、信頼性に問題が生じてしまうのである。
本発明の目的は、無鉛化と無アンチモン化による対環境性と信頼性に優れた樹脂封止型半導体装置を提供することにある。
上記目的は、少なくとも半導体素子が搭載された回路基板を金属基板に接合した内部絶縁構造の樹脂封止型半導体装置において、前記半導体素子と前記回路基板の回路パターンのろう付け接合に使用されているハンダ材と、前記回路基板の導体層と前記金属基板のろう付け接合に使用されているハンダ材が、概略同一の固相線温度を有する合金のハンダ材であることにより達成される。
このとき、前記合金のハンダ材が、錫、銀、銅、ニッケル、亜鉛、ゲルマニウム、ビスマス、インジウムから選択された複数の金属材料で構成されているようにしても上記目的が達成でき、同じくこのとき、前記回路基板の導体層と前記金属基板のろう付け接合に使用されているハンダが、ニッケル、銅、亜鉛、チタンから選択された概略球状の最大径が50μmから200μmの範囲の金属粒子を含んでいるようにしても上記目的が達成できる。
本発明によれば、鉛とアンチモンを含有しないハンダ材が使用できるので、対環境性の向上が得られ、同時リフローによりボイド欠陥が抑制できるので、信頼性の向上を得ることができる。
以下、本発明による樹脂封止型半導体装置について、図示の実施の形態により詳細に説明する。
図1は、本発明に係る樹脂封止型半導体装置の一実施形態で、ここでも模式断面図で示した半導体装置の組立工程を示したものである。
ここで、まず、図1(a)には、半導体素子1とチップ接合用ハンダシート20、セラミックス回路基板3、基板接合用ハンダシート50、それに金属基板6が示されているが、これらは、厚さ4mmの銅板で作られている金属基板6を一番下にして、基板接合用ハンダシート50、セラミックス回路基板3、チップ接合用ハンダシート20、それに半導体素子1が順番に積み重ねられている。
そして、まず、チップ接合用ハンダシート20は、固相線温度220℃の錫
−銀−銅系ハンダ(Sn 96.5wt%、Ag 銀3.0wt%、Cu 0.5wt%)のシートで作られ、溶融されたときチップ接合用ハンダ層2を形成する働きをする。
−銀−銅系ハンダ(Sn 96.5wt%、Ag 銀3.0wt%、Cu 0.5wt%)のシートで作られ、溶融されたときチップ接合用ハンダ層2を形成する働きをする。
次に、セラミックス回路基板3は、厚さ0.3mmのアルミナ板で、その表面には0.3mmの銅箔が接合され、裏面には0.2mmの銅箔が接合されている。そして、表面の銅箔には回路パターンが形成され、裏面の銅箔はそのまま導体層としてある。
このとき基板接合用ハンダシート50も、チップ接合用ハンダシート20と同じく固相線温度220℃の錫−銀−銅系ハンダ(Sn 96.5wt%、Ag 銀3.0wt%、Cu 0.5wt%)のシートで作られているが、この基板接合用ハンダシート50の場合は、更に、その中に最大粒径100μm、平均粒径70μmのニッケル粒子が分散させてあり、これにより、溶融されたとき、ニッケル粒子により厚さが制御された状態で基板接合用ハンダ層5を形成する働きをする。
次に、この図1(a)に示す構成品を、水素100%雰囲気のリフロー炉(図示せず)において、ピーク温度280℃に加熱する。このとき、各部材を図1(a)に示す配置状態にするためには、図示していないがカーボン製治具が用いられている。
ここで、図1(b)が、図1(a)に示す構成品を、水素100%雰囲気のリフロー炉でピーク温度280℃に加熱した結果で、チップ接合用ハンダシート20が溶融されてチップ接合用ハンダ層2を形成し、半導体素子1がセラミックス回路基板3の回路パターンにろう付け接合され、基板接合用ハンダシート50が溶融されて基板接合用ハンダ層5を形成し、セラミックス回路基板3が金属基板6にろう付け接合されている。
そこで、更に半導体素子1と回路パターンの他の所定の部分をアルミニウムなどのボンディングワイヤ4により接続し、この後、図1(c)に示すように、外部取り出し端子7がインサート成型されている外囲ケース8を金属基板6に接着し、セラミックス回路基板3の表面にある回路パターンの所定の部分を、アルミニウムなどのボンディングワイヤ4により、外部取り出し端子7に接続する。
そして、この後、図1(d)に示すように、外囲ケース8の中にシリコーンゲルなどの封止樹脂9を充填し、半導体素子1が搭載されているセラミックス回路基板3を封止してやれば、この実施形態に係るパワー半導体装置の主要な組立を完了させることができ、この後、図示してないが、ベース板となっている金属基板6の裏面(他方の面)にフィンなどの放熱用部材が取付けられて使用される。
このとき、外囲ケース8は、例えばPPS(ポリ・フェニレン・サルファイド)などの樹脂(合成樹脂)により底のない浅い箱型に作られていて、これがベース板となる金属基板6に対して、それが底板となるようにして被せられ、この状態で、接着剤により相互に接合されている。
そこで、このようにして完成したパワー半導体装置の実施形態におけるチップ接合用ハンダ層2と基板接合用ハンダ層5を、超音波探傷装置で観察したところ、両ハンダ層中にボイド欠陥はほとんど見られなかった。そして、このときのハンダ接合領域に対する欠陥部の面積比は0.5%以下であった。
このとき、基板接合用ハンダ層5には、応力緩和機能を持たせなければならないので、熱伝導性を犠牲にしない範囲で、或る程度の厚さを確保する必要があり、通常、100μm程度の厚さに設定している。
また、このとき、基板接合用ハンダ層5は、チップ接合用ハンダ層2に比較してかなり大きな面積になる。そこで、この基板接合用ハンダ層5の厚さを均一に制御するため、ハンダ層5の中に概略球状をした金属粒子が分散されるようにしてある。
ここで、この分散させる金属粒子としては、ハンダが溶融した状態でも溶融せずに安定に存在できるものであり、ハンダとの濡れ性も考慮すると、ニッケル、銅、亜鉛、チタンから選択すればよい。そして、このときの金属粒子の最大粒径は50μmから200μmの範囲内に設定すれば良く、この実施形態では、図1(a)で説明したように、基板接合用ハンダシート50の中に最大粒径が100μmで平均粒径が70μmのニッケル粒を分散させている。
そして、このときの金属粒子の添加量は、少な過ぎると粒子の偏在による弊害が発生し、多過ぎると凝集等が発生し易いため、ハンダ成分に対して0.005vol%〜5vol%の範囲内で調整すればよい。
次に、チップ接合用ハンダ層2と基板接合用ハンダ層5に用いるハンダの材質については、錫、銀、銅、ニッケル、亜鉛、ゲルマニウム、ビスマス、インジウムから選択される複数の金属材料で構成されていれば良い。このとき肝要な点は、チップ接合用ハンダ層2と基板接合用ハンダ層5でハンダ材の固相線温度が概略同一であることである。
そうすれば、チップ接合用ハンダ層2と基板接合用ハンダ層5のハンダはほぼ同時に固化するので、これにより反りの発生が抑えられ、この反りに起因するハンダ接合部の欠陥(ボイド)発生を抑えることができる。
この場合、上記要件を満たすものであれば、チップ接合用ハンダ層2と基板接合用ハンダ層5でハンダが異なる材質であっても構わない。
従って、この実施形態によれば、鉛もアンチモンも含有しないハンダ材料を用い、且つ、チップ接合用ハンダ層2と基板接合用ハンダ層5を同時リフローすることにより、対環境性に優れると共に、ハンダ層に欠陥が少なく信頼性に優れたパワー半導体装置を実現することができる。
ここで、比較例として、ハンダ材料以外は、上記の実施形態と同一の部材を用い、図2に示した従来技術と同じ組立工程によりパワー半導体装置を組み立てみた。
まず、鉛95wt%−錫5wt%ハンダシートを用い、これをアルミナ回路基板3の回路パターン(図示せず)上に載置し、この上に半導体素子1を載置して、水素100%雰囲気のリフロー炉(図示せず)で、ピーク温度360℃に加熱した(図2(a))。
そして、チップ接合用ハンダ層2による接合が完了し時点でアルミナ回路基板3についてみると、これには半導体素子搭載面を凸にした50μm〜100μmの反りが発生していた。
そこで、次に、このアルミナ回路基板3にアルミニウムボンディングワイヤ4を施し(図2(b))、この後、このアルミナ回路基板3を、鉛-錫系共晶ハンダのハンダシートを介して、金属基板6上に載置し、水素100%雰囲気のリフロー炉(図示せず)で、ピーク温度240℃に加熱した(図2(c))。
次に、外部取り出し端子7がインサート成型されている外囲ケース8を金属基板6に接着し、セラミックス回路基板3の表面にある回路パターンの所定の部分を、アルミニウムなどのボンディングワイヤ4により、外部取り出し端子7に接続する(図2(d))。
この後、外囲ケース8の中にシリコーンゲルなどの封止樹脂9を充填し、半導体素子1が搭載されているセラミックス回路基板3を封止してやれば、パワー半導体装置の主要な組立を完了させる(図2(e))。
そして、このようにして完成したパワー半導体装置のチップ接合用ハンダ層2と基板接合用ハンダ層5を超音波探傷装置で観察した結果、チップ接合用ハンダ層2の中にボイド欠陥はほとんど見られなかった。ちなみに、このときのハンダ接合領域に対する欠陥部の面積比は0.5%以下であった。
一方、基板接合用ハンダ層5中には、検査に供したパワー半導体装置の個数の20%にわたり、5%を超えるボイド欠陥が見付かっており、従って、本発明の実施形態の優位性は、ほとんど疑問の余地がないといえる。
1:半導体素子
2:チップ接合用ハンダ層
3:セラミックス回路基板
4:ボンディングワイヤ
5:基板接合用ハンダ層
6:金属基板
7:外部取出し端子
8:外囲ケース
9:封止樹脂
20:チップ接合用ハンダシート
50:基板接合用ハンダシート
2:チップ接合用ハンダ層
3:セラミックス回路基板
4:ボンディングワイヤ
5:基板接合用ハンダ層
6:金属基板
7:外部取出し端子
8:外囲ケース
9:封止樹脂
20:チップ接合用ハンダシート
50:基板接合用ハンダシート
Claims (3)
- 少なくとも半導体素子が搭載された回路基板を金属基板に接合した内部絶縁構造の樹脂封止型半導体装置において、
前記半導体素子と前記回路基板の回路パターンのろう付け接合に使用されているハンダ材と、前記回路基板の導体層と前記金属基板のろう付け接合に使用されているハンダ材が、概略同一の固相線温度を有する合金のハンダ材であることを特徴とする樹脂封止型半導体装置。 - 請求項1に記載の樹脂封止型半導体装置において、
前記合金のハンダ材が、錫、銀、銅、ニッケル、亜鉛、ゲルマニウム、ビスマス、インジウムから選択された複数の金属材料で構成されていることを特徴とする樹脂封止型半導体装置。 - 請求項1に記載の樹脂封止型半導体装置において、
前記回路基板の導体層と前記金属基板のろう付け接合に使用されているハンダ材が、ニッケル、銅、亜鉛、チタンから選択された概略球状の最大径が50μmから200μmの範囲の金属粒子を含んでいることを特徴とする樹脂封止型半導体装置。
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---|---|---|---|
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Cited By (6)
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---|---|---|---|---|
JP2007294626A (ja) * | 2006-04-25 | 2007-11-08 | Hitachi Ltd | 半導体パワーモジュール |
JP2010283169A (ja) * | 2009-06-04 | 2010-12-16 | Honda Motor Co Ltd | 半導体装置の製造方法 |
US8415801B2 (en) | 2009-06-04 | 2013-04-09 | Honda Motor Co., Ltd. | Semiconductor device having thermal endurance and method of manufacturing the same |
JP5566289B2 (ja) * | 2008-06-12 | 2014-08-06 | 三菱電機株式会社 | 電力半導体回路装置およびその製造方法 |
JP2019091804A (ja) * | 2017-11-15 | 2019-06-13 | シャープ株式会社 | パワー半導体モジュールおよび電子機器 |
WO2023073752A1 (ja) * | 2021-10-25 | 2023-05-04 | 三菱電機株式会社 | 半導体装置、電力変換装置、および半導体装置の製造方法 |
-
2004
- 2004-07-29 JP JP2004221924A patent/JP2006041363A/ja active Pending
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007294626A (ja) * | 2006-04-25 | 2007-11-08 | Hitachi Ltd | 半導体パワーモジュール |
JP4595877B2 (ja) * | 2006-04-25 | 2010-12-08 | 株式会社日立製作所 | 半導体パワーモジュール |
JP5566289B2 (ja) * | 2008-06-12 | 2014-08-06 | 三菱電機株式会社 | 電力半導体回路装置およびその製造方法 |
JP2010283169A (ja) * | 2009-06-04 | 2010-12-16 | Honda Motor Co Ltd | 半導体装置の製造方法 |
US8415801B2 (en) | 2009-06-04 | 2013-04-09 | Honda Motor Co., Ltd. | Semiconductor device having thermal endurance and method of manufacturing the same |
JP2019091804A (ja) * | 2017-11-15 | 2019-06-13 | シャープ株式会社 | パワー半導体モジュールおよび電子機器 |
WO2023073752A1 (ja) * | 2021-10-25 | 2023-05-04 | 三菱電機株式会社 | 半導体装置、電力変換装置、および半導体装置の製造方法 |
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