JP2005508080A - 半導体のエレクトロマイグレーション特性の加速決定のための方法および装置 - Google Patents
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Abstract
Description
【0001】
本発明は、一般に、集積回路デバイスの製造および試験に関し、更に具体的には、集積回路の相互接続物質(interconnect material)のエレクトロマイグレーション特性(electromigcation characteristics)を決定するための方法および装置に関する。
【背景技術】
【0002】
集積回路は、通常、多レベルのパターニングした金属化ライン(metallization line)で形成され、これらは層間誘電体によって相互に電気的に分離され、選択された位置にビア(via)を含み、パターニングした金属化ラインのレベル間の電気的接続を提供する。これらの集積回路は、(例えば、デバイス速度を上げ、所与のエリアチップ内でより大きい回路機能性を提供することによって)高い密度および性能を提供するための絶え間ない努力で、より小さい寸法に縮小されるにつれて、相互接続線幅の寸法はますます狭くなるが、これによって、エレクトロマイグレーション等の有害な影響を受けやすくなる。
【0003】
エレクトロマイグレーションは、相互接続物質を通る電流伝導の結果として、相互接続物質を形成する金属原子(例えばアルミニウム)が大量に移動する現象を指す。更に具体的には、電子流が金属イオンと衝突することで、それらを電流の流れる方向に押す。長い時間期間が経つと、移動した原子により、典型的にラインの一端においてボイド(void)の形成が生じる傾向があり、一方、ラインの他方における原子の蓄積は、ヒロック(hillock)の形成を生じる傾向がある。かかる変形はラインの抵抗を増大させ、場合によっては、開路、短絡、およびデバイスの故障に至る。この現象は、集積回路設計においてますます顕著になっている。なぜなら、線幅の寸法が小さくなるにつれて、金属化ラインを通る相対的な電流密度が高くなり続けるからである。
【0004】
金属相互接続のエレクトロマイグレーション(EM)信頼性を評価するため、業界では一般にパッケージレベルの試験が用いられる。この目的のため、標準的な試験構造および試験方法論が規定され実施されている。これらのパッケージレベルの試験は、通常、高価で特殊な機器を用いて、オーブン内に生成した高温で、適度に加速したストレスのもとで行われる。収集した破損時間(time to failure)データに基づいて、EM試験において加速ファクタを求めるためのブラックの式(Black’s equation)を用いることにより、現場の条件のもとでの寿命を推定する。
【0005】
しかしながら、集積回路技術が発展するにつれて、その中の相互接続システムはいっそう複雑化し、この結果、信頼性を保証するために評価しなければならないプロセスモジュールの数が増えている。競争のプレッシャーは、同様に、EM試験時間(これは通常、パッケージレベルの試験について約10から100時間である)を短縮する必要性を高める。従って、試験時間を短縮するために、パッケージレベルの試験の代わりとしてウエハレベルの試験が実施されている。
【0006】
ウエハレベルの試験は、通常、プローブステーションを用いて行われ、約数秒から数分の破損時間の短縮を生じる。その際に、ウエハ試験は、約1x107A/cm2の単位の高電流密度の導入を伴う。ウエハレベルの試験とパッケージレベルの試験との間の別の大きな違いは、ウエハレベルの試験では、高温条件の生成を、外部のオーブンによる加熱ではなく、(印加したストレス電流(stress current)からの)ジュール加熱(Joule heating)によって行うことである。
【発明の開示】
【発明が解決しようとする課題】
【0007】
ウエハレベルの試験技法の1例は、「SWEAT(Standard Wafer−level Electromigration Acceleration Test)」として知られるものであり、この場合、金属試験構造に比較的大きい電流を流す。この特定の試験では、試験ごとに一定の「破損時間」を維持することが望ましい。他のタイプのウエハレベル試験には、等温(isothermal)(定温)試験および定電流試験が含まれる。しかしながら、これらのウエハレベル試験を実行する速さは、ジュール加熱に関連する温度の不確かさと合わせて、試験の有用性を、事実上、リアルタイムでウエハロットの質を監視するための「抜き取り検査(spot check)」に限定する。換言すると、ウエハレベルの試験において独立して温度および電流を制御する難しさのため、これらの方法によって生成される寿命予測は信頼できない。
【0008】
いくつかの従来のウエハレベル試験に伴う別の欠点は、試験構造自体が、通常、単一レベルの金属によって製造されることである。しかしながら、かかる単一レベル金属構造は、製品チップ上に見られる実際の構造を表していない。特に、それらは、スタッド(stud)またはビア等のレベル間接続を組み込んでいないので、チップ上の構造の寿命予測を決定するには適していない。更に、スタッドおよびビアを組み込んだ構造は、幾何学的形状の影響または物質の相違によって引き起こされるラインの選択的な加熱のため、更に温度の非均一性を伴う場合がある。
【課題を解決するための手段】
【0009】
前述の従来技術の欠点および欠陥は、集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための方法により、克服または軽減される。本発明の例示的な実施形態では、この方法は、集積回路デバイスのための規定された試験構造タイプを構成することを含む。規定された試験構造タイプは、更に、半導体基板の主面に主に配置された第1の配線ラインと、第1の配線ラインに接続された第2の配線ラインとを含む。第2の配線ラインは、主面に実質的に平行な第2の面に配置され、第1および第2の配線ラインはそれらの間のビア構造によって接続されている。第1の配線ラインおよびビア構造について抵抗の熱係数を求め、規定された試験構造タイプの第1の個別試験構造に、ウエハレベルのストレス条件を導入する。次いで、第1の個別試験構造について少なくとも1つのパラメータ値を求め、このパラメータ値を用いて、集積回路デバイスにおける配線構造の寿命予測を行う。
【0010】
好適な実施形態において、規定された試験構造タイプの第2の個別試験構造に、パッケージレベルのストレス条件を導入する。第2の個別試験構造について少なくとも1つのパラメータ値を求め、第2の個別試験構造について求めた少なくとも1つのパラメータ値を、第1の個別試験構造について求めた少なくとも1つのパラメータ値に関連付ける。
【0011】
別の実施形態では、規定された試験構造タイプは、半導体基板の主面に主に配置された第1の配線ラインを含む。第1の配線ラインに第2の配線ラインが接続されており、第2の配線ラインは、主面に実質的に平行な第2の面に配置されている。更に、第1の配線ラインに隣接してヒートシンク(heat sink)構造が配置され、このヒートシンク構造は、第1の配線ラインを通る電流の通過に伴う熱を放散させることができる。好ましくは、第1の配線ラインは、細長い部分を介して第2の端部に接続された第1の端部を含む。第2の配線ラインは、金属スタッドまたはビアを介して、第1および第2の端部において第1の配線ラインに接続されている。
【0012】
いくつかの図面において同様の要素が同様に付番されている例示的な図面を参照する。
【発明を実施するための最良の形態】
【0013】
最初に図1を参照すると、本発明の1実施形態による、集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための方法10を例示するブロック図が示されている。方法10は、ブロック12において、EM試験で用いる試験構造タイプの構成から開始する。試験構造タイプは、最初のパッケージレベルのストレス試験セットにおいて用いられて、モデリングパラメータを決定する。パッケージレベルのストレス印加は、概ね約48時間持続する一連のストレスを伴う。その後、もっと短いウエハレベルのストレス印加(約100秒)を実施することができ、最初のパッケージレベル試験およびウエハレベル試験から得たデータを関連付けて、対象のIC配線構造のための実際の寿命予測を行う。
【0014】
図2に、方法10において用いる具体的な試験構造タイプを示す。この具体的な実施形態では、半導体基板102上に形成された試験構造100は、第1の配線ライン104を含み、これは、第1のライン104の端部に位置する複数の金属スタッド108を介して第2の配線ライン106に接続されている。第1のライン104は、アルミニウムまたはアルミニウムおよび銅の合金等の金属から形成され、その第1の端部112および第2の端部114を接続して延在する細長い部分110を有する。第1および第2の端部112、114は、スタッド108が接続されており、それらの間の細長い部分110よりも広い。更に、第1の配線ライン104は、第2の配線ライン106が位置する第2の面に実質的に平行な主面内に配置されている。
【0015】
第2の配線ライン106は、好ましくはタングステン等の高融点金属であり、第1のライン104を入力試験電流源(図示せず)に接続するために用いられる。第2のライン106は、更に、絶縁誘電層116の上に形成されて図示され、一方、絶縁誘電層116は、シリコン基板102の上に形成されている。また、別の誘電層(図示せず)が、スタッド108を囲み、第1のライン104および第2のライン106を含む層等の金属化層を分離する。しかしながら、第2のライン106は、これに代えて、第1のライン104の上の配線レベル上に配置可能であることを注記しておく。EMストレス試験において用いられる具体的な試験構造タイプの1例として、0.21μm幅、300μm長の第1のライン104を、単一のタングステンスタッド108によって第1の端部112で、更に、3つのタングステンスタッド108によって第2の端部114で終端させた。
【0016】
図3に、例示した試験構造100と共に用いる例示的な給電構造140を示す。図示した実施形態では、給電構造140は、第2の配線レベル106と同じ金属化レベルに形成されている。第1のパッド接続142が、試験構造に対する印加のための外部の電流源(例えば電極)からの接触を受ける。そして、第1のパッド接続142は給電線144に接続されており、これは、外部の電流源(図示せず)から試験構造100への給電電流経路を提供する。更に、試験構造の所望のパラメータを測定するための外部測定デバイス(例えばマルチメータ)に接続するために、第2のパッド接続146が設けられている。同様に、検知ライン148は、第2のパッド接続146と第1の相互接続パッド150における第2の配線ライン106との間の伝導経路を提供する。更に、見てわかるように、給電線144は、第1の接続パッド150に直接接続された第2の接続パッド152を介して第2の配線ライン106に結合されている。
【0017】
給電構造140は、更に、給電線144および第2の接続パッド152に関連付けられたヒートシンク154を含む。後に更に詳しく説明するが、試験構造(または実際のICの配線構造)の全ヒートシンク容量は、そのエレクトロマイグレーション特性の決定において重要である。
【0018】
再び図1を参照すると、いったん試験構造タイプを構成すると、方法10はブロック14に進み、試験構造100のための抵抗の熱係数(TCR)すなわちβを求める。TCRの値は、等温タイプのウエハレベルのストレス印加と組み合わせて用いられるが、これについては後に更に詳しく述べる。一般的に言って、TCRは、所与の構造について、抵抗の変化対温度の変化を関連付けるために用いられる。等温ストレス試験は、試験構造について一定の温度を用いるので(更に、これは一般に、試験構造の温度を直接測定する最も簡単かつ安価な方法であるので)、測定した抵抗値を用いて温度を求める。試験構造100についてβを求めるための詳細な手順を、図4に示す。
【0019】
まず、試験構造100を含むウエハを、より良い温度安定性のために室温よりわずかに高いと好ましい(例えば29℃)初期温度に設定したチャック上にセットする。初期温度において、試験構造100に電圧を印加し、結果として得られる電流を測ることによって、その初期抵抗を測定する。しかしながら、印加電圧は、構造内に著しいジュール加熱を生じないように、充分に小さいものとする。いったん最初の抵抗を測定したら、これらのステップを、約100℃まで、温度間隔を広げながら繰り返す。各温度間隔において、生成した特定の温度で安定するために、ウエハには充分な時間を与えるものとする。更に、各温度における抵抗は、順方向および逆方向の双方の極性での印加電圧で数回測定するものとする。
【0020】
各温度間隔ごとに平均抵抗を求め、次いで、このデータを用いて抵抗対温度曲線を作図することができる。TCRすなわちβは、この曲線の傾きから求められ、極めて線形でなければならない。ここで、βはΔ抵抗/Δ温度に等しい。従って、求めたβの値を、初期抵抗および温度値と共に、等温ウエハレベルストレス試験において用いる。このステップで行う別の測定は、試験構造タイプの熱抵抗(Rθ)を求めるための温度対電力曲線である。抵抗対温度曲線と同様、熱抵抗は、温度対電力曲線の傾きから求められる。なぜならP=I2Rだからである。また、ラインの温度とそれに印加する電力との間には、線形の挙動が存在する。
【0021】
図1に見られるように、試験構造タイプについてTCR(β)および熱抵抗(Rθ)を求めた後、方法10はブロック16に進み、個別の試験構造の等温ウエハレベルストレス印加を行う。図5に、等温ストレス印加のための好ましいアルゴリズムの概要を示す。最初に、βおよびRθをチェックして、それらが有効な入力を表すか否かを調べる。その場合、試験構造にストレス電流を印加する。
【0022】
TCRの決定の間そうであったように、ストレスを印加する特定の構造の初期抵抗R0を求めるには、ウエハチャックの温度を約29℃に上げ(チャック温度は全ストレス試験の間そのままである)、それに低い(非加熱)電圧を印加する。(初期構造温度で測定された)初期抵抗R0の値を、TCRと共に用いて、測定した抵抗によって構造の温度を間接的に監視する。
【0023】
等温タイプのウエハレベルストレスの性質のため、ストレスについての目標構造温度TTARGETを選択する。ジュール加熱によって構造をTTARGETまで加熱するため、初期電流I0の正確な推定値を得る(オームの法則、TCR、R0、およびTTARGETを用いて)。次いで、印加電流を、TTARGETに達するまで、比較的等しい温度増分で、ゆっくり増大すなわち「ランプアップ(ramp up)」する。これは、温度の上げすぎを回避し、従って構造の過剰ストレスを回避するために行う。連続した各電流増大ステップ間の例示的な時間間隔は、約140msである。
【0024】
いったん、印加ストレス電流の値がI0になる(更に、おそらく構造の実際のジュール温度がTTARGETに等しい)と、構造の抵抗を監視し、その結果をフィードバック経路に導入して、変化が検出された場合は印加電流を調整する。フィードバック経路は、電流を更新し、抵抗を測定し、温度、ΔT、dT/dI、および電流の次の値を計算することによって、TTARGETを特徴付ける。電流の各変化は、約250msの待機時間の後に起こり、そうでなければ過剰訂正およびシステムの不安定さを引き起こしかねない小さい温度ドリフトの理由を明らかにする。
【0025】
等温ストレスは、構造抵抗の所定の変化または構造の故障などの終了基準に達するまで継続する。本実施形態では、終了基準は、抵抗の100%の変化に設定されている。また、ループから出るために、最大試験時間を設定することも可能である。等温ストレスの終了時に、抵抗の具体的な変化および特定の故障モード(例えば抵抗の増大、開路等)と共に、破損時間を記録する。等温ウエハレベルストレス試験に関するこれ以上の詳細は、Tom C.Lee等の、Comparison of Isothermal,Constant Current and SWEAT Wafer Level EM Testing Methods(IRPS Proceedings、2001、p172〜183)に見ることができる。これは、引用により本願にも含まれる。
【0026】
再び図1に戻ると、等温ストレス試験の後、方法10は最後にブロック18に進み、ウエハレベルストレス試験(複数の試験)で得られたデータを、パッケージレベルストレス試験から得られたデータに関連付ける。また、パッケージレベルストレス試験は、EMモデリングパラメータを得るために用いられ、ウエハレベルストレス試験よりも長い時間、高温で行う。図2の試験構造100に適用可能である例示的なパッケージレベルストレス条件の2つのセットには、(1)約200℃の温度および約23.3mA/μm2の電流密度、(2)約250℃の温度および約17.8mA/μm2の電流密度が含まれる。
【0027】
概して、パッケージレベルストレス試験は、動特性パラメータ、すなわち、以下のブラックの式に従った活性化エネルギ(ΔH)および電流密度指数(n)の計算を可能とする。
τ=A/jneΔ H/kT
ここで、τは試験構造の破損時間、
Aはブラックの定数、
Jは印加した電流の密度、
kはボルツマン定数、
Tは温度である。
【0028】
等温ウエハレベル試験のための動特性パラメータの決定は、もっと難しい。なぜなら、そのタイプの試験では、温度および印加電流は独立して変動しないからである。しかしながら、ウエハレベル試験の活性化エネルギ(ΔH)は、In[(τ50)(Jn)]対1/kTの(ブラックの式から導出された)プロットの傾きを求めることによって、信頼性高く得ることができる。ここで、τ50は、ウエハレベルストレス構造の所与の母集団分布について中央値の破損時間を表す。かかるプロットでは、nについての値はパッケージレベル試験(複数の試験も可)から得ることができる。ウエハレベル試験におけるΔHの決定に関する更に詳しい情報は、Deborah Tibel等のComoparison of Via/Line Package Level Vs.Wafer Level Results(IRPS Proceedings、2001、p194〜199)に見ることができる。これは引用により本願にも含まれる。
【0029】
パッケージレベルおよびウエハレベルの試験の双方について動特性パラメータを得た後、2つの試験間の加速ファクタを求めて、試験構造の寿命予測を行う。最初に、パッケージレベルおよびウエハレベルの試験から、対数正規(lognormal)τ50値の比を単に取ることで、実験的加速度ファクタ(AFexperimental)を計算する。
AFexperimental=τ50 Pkg/τ50 Waf
【0030】
また、算出された加速ファクタ(AFcalculated)は、算出した熱加速度(Tacc)および算出した電流密度加速度(JaccCalc)の積である。ここで、
JaccCalc=(js Waf/js Pkg)n
Jaccexperimental=AFcalc/Tacc
Tacc=exp{(ΔH/k)[1/TsPkg−1/TsWaf]}
【0031】
実験的および算出した加速度ファクタを比較すると、それらの間に良好な一致があることがわかった。ウエハレベル試験のストレス条件が試験構造のジュール加熱によって達成されたとしても、算出した加速度ファクタ(TaccおよびJaccCalc)の成分は分離可能であると見られる。通常のストレス状況とは対照的に、電流密度は、パッケージレベル試験からウエハレベル試験への全加速に対する2つの寄与分のうち大きい方である。
【0032】
試験構造100(および基礎にある給電構造140)に適用される前述の方法10の実施によって、約48時間の最初のエレクトロマイグレーションストレスを実行した後、約100秒の時間単位で、エレクトロマイグレーション寿命を予測することができる。これによって、最初のパッケージレベルの試験セットを関連付けの目的のために行う限り、単に良いロット/悪いロットを決定するため以上に、高速のウエハレベル試験を使用可能である。
【0033】
上述のパッケージレベル試験と等温ウエハレベル試験との間の相関方法論にもかかわらず、試験構造における特定の故障位置(複数の位置)を分析することによって、EM故障機構に関する有用な情報が更に得られる。ウエハレベル試験の物理的故障モードは、パッケージレベル試験のものとは異なる。印加ストレス電流があるレベル未満でなければ、(図2に示すような)従来の試験構造の中央に近い部分にエレクトロマイグレーション損傷(すなわちボイド形成)が現れる傾向があることがわかっている。この現象は、ラインの中央部分の過熱によって生じると考えられ、これによってスタッドとラインの中央部との間に熱勾配(thermal gradient)を生成する。このため、温度の高い領域および低い領域におけるアルミニウムの拡散の相違のため、熱勾配および絶対温度の組み合わせ作用が最大の原子束発散(atomic flux divergence)を生成する位置にボイドが凝集する。
【0034】
具体的には、図2に示した構造および図3の基礎にある給電構造について、約220℃を超える温度を生成する電流によって、スタッドから離れた所で、細長い部分の中央部の近くにボイドの形成が起こることがわかっている。一方、約220℃未満のライン温度を生成する電流は、スタッドの隣にボイドの凝集を生じる傾向がある。更に、約220℃未満の温度では、タングステンのスタッド物質はアルミニウムラインよりも熱くなると考えられる。なぜなら、基礎にある給電構造のヒートシンク容量が限られているとすると、抵抗が高くなり、結果として局所的なジュール加熱が起こるためである。ある程度、この加熱は、スタッドの下の第2の配線ラインの熱伝導率によって決定される。例えば、第2の配線ライン幅が大きくなればなるほど、その下の基板への熱伝導率が高くなる。従って、当然、誘電体の厚さまたは種類の変化、基礎にあるタングステン接続の幅または用いるビアの数が、各々、ラインの端部における温度に影響を与える。
【0035】
そして、図6は、本発明の更に別の実施形態による、集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための改良した試験装置200を示す。説明を容易にするため、様々な図において、同様に付番した要素は同様の参照番号で示す。
【0036】
スタッドで接続された前述の第1および第2の配線ラインに加えて、試験装置200は、更にヒートシンク構造120を含み、これは、第1の配線ライン104を通る電流の通過に伴う熱を放散させることができる。1実施形態では、ヒートシンク構造120は、好ましくはタングステンである金属パッドから形成される。更に、図示の実施形態では、ヒートシンク構造120は、第1の配線ラインの細長い部分110の下に位置し、第2の配線ラインと同じ金属化レベルである。しかしながら、ヒートシンク構造120は、あるいは、細長い部分110に隣接したいずれかの場所に配置することも可能であり、いくつかの形状および構成を有する可能性がある。
【0037】
任意選択として、ヒートシンク構造120は、誘電層116内に形成された一連のビアまたはスタッド122を介して、シリコン基板102と直接熱的に結合することも可能である。しかしながら、ヒートシンク構造120は、第2のライン106から電気的に分離されることは注記しておく。第1の配線ライン104の細長い部分110の下に位置する他に、ヒートシンク構造120は、あるいは、上レベルの配線上の細長い部分110の上に配置することも可能である。更に別の実施形態は、第1のライン104の上および下の双方に、連続した金属層上のヒートシンク構造アレイを有する。かかる構成では、個々の各ヒートシンク構造は、更に、金属スタッド108を介して相互に(レベルごとに)接続することも可能である。
【0038】
ここで図7を参照すると、ヒートシンク構造120の更に別の可能な実施形態の上面図が示されている。一体に形成された金属板の代わりに、ヒートシンク構造120は、第1のライン104の下(または上)に延在する一連の金属ストリップ130を含むことができる。図示のように、ストリップ130は、細長い部分110の軸に対して概ね垂直に延在するが、細長い部分110に対して平行なストリップ130の構成も考えられる。更に、ストリップは、相互に対して均一に離間することも可能であり、または、それらは、所望の熱プロファイルを得るために、(図6に示すように)非均一に離間させることも可能である。
【0039】
最後に、例えば、第1および第2の端部112、114を、細長い部分110のものとほぼ同等の幅に形成することによって、第1のライン104の熱プロファイルも調整可能である。更に、スタッド108は、第1および第2の端部112、114との接続部に対して中央に配置することも可能である。または、スタッドは、第1および第2の端部112および114の縁部に対してジグザグパターンまたは重複するように配置させて、スタッドのある部分が第1のライン104と接触し、別の部分が絶縁層(図示せず)と接触するようにすることも可能である。
【0040】
このように構成されたヒートシンク構造または複数のヒートシンク構造を用いて、これがない場合に上述の試験構造タイプに存在する熱勾配を変えることができる。その際、ウエハレベルおよびパッケージレベルの試験の故障モード間で、改善した関連付けを行うことができる。最終的に、個々のロットの質を決定するためだけでなく、より長く継続するストレス条件で以前に行われた寿命予測のためにも、迅速な、高ストレス試験を用いることができる。
【図面の簡単な説明】
【0041】
【図1】本発明の1実施形態による、集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための方法を示すブロック図である。
【図2】図1に示した方法において用いることができる1つの可能な試験構造タイプの斜視図である。
【図3】図2の試験構造タイプの上面図であり、更に、それに外部から試験電流を供給しそれから様々な測定パラメータを検知する給電構造を示す。
【図4】図1に示すような抵抗の熱係数を求める際に用いるステップを示すフローチャートである。
【図5】図1に記載した等温ウエハレベルストレスのためのアルゴリズムを示すフローチャートである。
【図6】本発明の更に別の実施形態による、集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための新規な試験装置の斜視図である。
【図7】図6に示すヒートシンク構造の代替的な実施形態の上面図である。
Claims (10)
- 集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための試験装置(200)であって、
半導体基板(102)の主面に配置された第1の配線ライン(104)と、
前記第1の配線ラインに接続され、前記主面に実質的に平行な第2の面に配置された第2の配線ライン(106)と、
前記第1の配線ラインに隣接して配置され、前記第1の配線ラインを通る電流の通過に伴う熱を放散させることができるヒートシンク構造(120)と、
を具備する試験装置(200)。 - 前記第1の配線ライン(104)は、更に、細長い部分(110)を介して第2の端部(114)に接続された第1の端部(112)を具備し、前記第1の端部および前記第2の端部は各々、前記細長い部分の幅よりも大きい幅を有する、請求項1の試験装置。
- 前記第2の配線ライン(106)は、金属スタッド(108)を介して前記第1および第2の端部(112、114)において前記第1の配線ライン(104)に接続されている、請求項1または2の試験装置。
- 前記ヒートシンク構造(120)は、更に金属板(120)を具備し、前記金属板は前記第1の配線ライン(104)と前記半導体基板(102)との間に配置されている、請求項1ないし3のいずれかの試験装置。
- 前記金属板(120)は、複数の金属スタッド(122)を介して前記基板(102)に接続されている、請求項4の試験装置。
- 前記ヒートシンク構造(120)は、更に金属ラインアレイ(130)を具備し、前記金属ラインアレイは前記第1の配線ライン(104)と前記半導体基板(102)との間に配置されている、請求項1ないし3のいずれかの試験装置。
- 半導体デバイスであって、
半導体基板上に形成された集積回路と、
請求項1ないし6のいずれかによる試験装置と、
を具備する半導体デバイス。 - 請求項1ないし6のいずれかによる試験装置(200)を用いて集積回路デバイスにおける配線構造のエレクトロマイグレーション特性を決定するための方法であって、
試験装置(200)を構成するステップ(12)と、
前記試験装置に特徴的な、前記第1の配線ライン(104)および前記ビア構造(108)における抵抗の熱係数を求めるステップ(14)と、
前記規定された試験構造タイプの第1の個別試験構造にウエハレベルストレス条件を導入するステップ(16)であって、前記ウエハレベルストレス条件は第1の時間に渡る電気ストレスの印加を含む、ステップと、
前記第1の個別試験構造についての少なくとも1つのパラメータ値を求めるステップ(18)であって、前記第1の個別試験構造についての前記少なくとも1つのパラメータ値は、前記集積回路デバイスにおける前記配線構造の寿命予測を行うために用いられる、ステップと、
を具備する、方法。 - 更に、
第2の個別試験装置(200)にパッケージレベルストレス条件を導入するステップであって、前記パッケージレベルストレス条件は前記第1の時間よりも長い第2の時間に渡る電気ストレスの印加を含む、ステップと、
前記第2の個別試験構造についての少なくとも1つのパラメータ値を求めるステップと、
前記第2の個別試験構造について求めた前記少なくとも1つのパラメータ値を、前記第1の個別試験構造について求めた前記少なくとも1つのパラメータ値に関連付けるステップと、
を具備する、請求項8の方法。 - 前記第1および第2の個別試験構造の各々について求めた前記少なくとも1つのパラメータ値は、以下の式
τ=A/JneΔ H/kT
に従った、活性化エネルギ(ΔH)および電流密度指数(n)を含み、ここで、
τは試験構造の破損時間、
Aはブラックの定数、
Jは印加した電流の密度、
kはボルツマン定数、
Tは温度である、請求項9の方法。
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