JP2003282722A - アモルファス金属酸化膜を有する容量素子および半導体装置の各製造方法 - Google Patents
アモルファス金属酸化膜を有する容量素子および半導体装置の各製造方法Info
- Publication number
- JP2003282722A JP2003282722A JP2002086553A JP2002086553A JP2003282722A JP 2003282722 A JP2003282722 A JP 2003282722A JP 2002086553 A JP2002086553 A JP 2002086553A JP 2002086553 A JP2002086553 A JP 2002086553A JP 2003282722 A JP2003282722 A JP 2003282722A
- Authority
- JP
- Japan
- Prior art keywords
- metal oxide
- film
- oxide film
- amorphous metal
- manufacturing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Semiconductor Integrated Circuits (AREA)
- Formation Of Insulating Films (AREA)
Abstract
よび半導体装置の製造にあって、低温処理をもって膜質
にすぐれたアモルファス金属酸化膜を成膜し、信頼性の
高い容量素子および半導体装置を製造する。 【解決手段】 アモルファス金属酸化膜例えばアモルフ
ァス酸化タンタル膜の成膜工程と、その後に、イオンお
よびラディカル反応による少なくとも酸素を含む、イオ
ン電流密度で5mA/cm2 以上の高密度プラズマ照射
処理によってアモルファス状態を維持した状態でこのア
モルファス酸化タンタル薄膜の膜質改善処理を行う膜質
改善処理工程とを行うことによって全工程における低温
処理が可能になり、しかも膜質にすぐれたアモルファス
金属酸化膜の成膜を行うことができ、信頼性の向上、コ
ストの低廉化を図ることができるものである。
Description
酸化膜を有する容量素子および半導体装置の各製造方
法、例えばアモルファス酸化タンタル薄膜によるアモル
ファス金属酸化膜を誘電絶縁膜とする静電容量素子、例
えばアモルファス酸化タンタル薄膜を具備する半導体装
置のそれぞれの製造方法に係わる。
において、静電容量素子の容量絶縁膜としては、窒化シ
リコン膜(Si3 N4 )が一般に用いられているが、微
細化、高集積化、高速化の要求から、より高比誘電率を
有する材料、例えば、Al2 O 3 、酸化タンタル、Ba
SrTiO、SrTaO、PbTiO3 −PbZrO3
に関する成膜の研究開発が盛んになされている。中でも
酸化タンタル膜は注目されているところである。
uctor)構造の容量素子形成においてはその容量絶縁層の
例えば酸化タンタル膜の成膜として、現在、多く試みら
れている成膜方法は、図11にそのフロー図を示すよう
に、減圧CVD法(化学的気相成長法)装置に基板例え
ば半導体ウエーハを導入し、酸化タンタル膜の成膜を行
う。この成膜の多くは、ペンタエトキシタンタル(Ta
(OC2 H5 )5 )を原材料とし、これを気化させ酸素
と減圧下で450℃程度の熱エネルギーによって反応さ
せることによる成膜方法による。
にペンタエトキシタンタルに由来するカーボン(C)や
水酸基(OH)が多量に成膜中に残留し、また、十分な
Ta−O結合ができない酸素不足な膜が成膜される。こ
の結果、この成膜のみでは十分な電気的特性、特にリー
ク電流特性、耐圧特性、比誘電率などが得られない。
膜質改善処理は、上述した減圧CVD装置から膜質改善
処理装置、例えば400℃〜500℃程度でオゾン雰囲
気中の紫外線照射アニール処理(いわゆるUV−O3 処
理)装置に搬送されてここでアニール処理がなされる。
この処理装置からウエーハの取出しがなされ、更に60
0℃以上の酸素雰囲気内でアニール処理がなされる。
ーCVD装置で成膜される。このCVD装置は、例えば
図12に概略構成を示すように、成膜がなされる基板例
えばウエーハの搬送室100に対して、最大4つのチャ
ンバー101a〜101dが設置され、基板のカセット
のロードロックから、基板が、搬送ロボット103によ
って、各チャンバーに対する搬入、搬出がなされる。そ
して、この装置おいて、2つチャンバーを成膜チャンバ
ー、他の2つのチャンバーを酸化後処理としてのUV−
O3 チャンバーとして構成し、いずれかの成膜チャンバ
ーで酸化タンタル膜を成膜した後、いずれかのUV−O
3 チャンバーで後処理を行う。その後に600℃以上の
少なくとも酸素を含む酸化雰囲気下でアニールを行うこ
とで膜質改善を行う。
のより高速化が要求され、電極、配線層等における金属
層化がなされる方向にあり、これに伴って、その製造過
程において、熱処理プロセスの低温化が望まれている。
例えば半導体集積回路における回路素子としての容量素
子においても、上述した金属層化によるいわゆるMIM
(Metal-Insulator-Metal) 構造の導入の要求が高まって
いる。
て、MIM構造の容量素子等を形成する場合、その誘電
絶縁層として酸化タンタル層等の金属酸化膜の形成を、
上述した高温処理を伴う成膜方法では、容量素子、ひい
ては半導体装置の特性および信頼性に問題が生じる。す
なわち、上述したような高温処理を伴う金属酸化膜を形
成する段階において、既に金属層が存在する場合、すな
わち例えばMIM構造における下層の電極金属層が存在
する構造による場合、この金属層としては、耐熱性に富
み、かつ低抵抗率を有する高融点金属の例えばPt,R
u等の高価な金属によって構成することが必要となる。
しかしながら、これら金属は、微細パターン化等加工性
に問題があり、製造工程、製造設備等が煩雑となり、コ
スト高を来す。
代替技術として、図13にそのフローを示すように、成
膜後に、O2 プラズマ酸化処理を行う方法の検討もなさ
れている。しかしながら、この場合の一般的な平行平板
型のプラズマ処理装置でのプラズマ酸化処理では、十分
高い膜特性が得られていない。また、この場合、成膜用
のCVD装置と、高密度プラズマ装置の両方を用意する
必要があり、たとえこれらを一台化したとしても高コス
ト化は必至となる。
ぐれた、誘電絶縁膜として成膜することができるアモル
ファス酸化タンタル膜、すなわちアモルファス金属酸化
膜を形成し容量素子、および半導体装置を低コストをも
って製造することができる製造方法を見出し、これら製
造を提供するものである。
製造方法においては、アモルファス金属酸化膜を容量絶
縁膜とする容量素子の製造方法であって、アモルファス
金属酸化膜例えばアモルファス酸化タンタル膜の成膜工
程と、その後に、イオンおよびラディカル反応による少
なくとも酸素を含む、イオン電流密度で5mA/cm2
以上の高密度プラズマ照射処理によってアモルファス状
態を維持した状態でアモルファス酸化タンタル薄膜の膜
質改善処理を行う膜質改善処理工程とを行う。
膜を具備する半導体装置の製造方法にあって、アモルフ
ァス金属酸化膜例えばアモルファス酸化タンタル膜の成
膜工程と、その後に、イオンおよびラディカル反応によ
る少なくとも酸素を含む、イオン電流密度で5mA/c
m2 以上の高密度プラズマ照射処理によってアモルファ
ス状態を維持した状態でアモルファス酸化タンタル薄膜
の膜質改善処理を行う膜質改善処理工程とを行う。
体装置の製造においては、そのアモルファス金属酸化膜
を形成をはじめとしてすべての処理を、低温下、具体的
には430℃以下で行うことができるものであり、これ
によって例えば下層電極、配線等における導電層として
加工性にすぐれ、低抵抗率の低融点金属層の使用が可能
となる。
膜工程と膜質改善処理とを同一反応容器で行うことが可
能となるものであり、これによって、装置の簡略化、作
業性の向上を図ることができる。
化膜を有する容量素子および半導体装置の製造方法は、
そのアモルファス金属酸化膜例えばアモルファス酸化タ
ンタル膜の製造工程にあって、図1にそのフロー図を示
すように、このアモルファス酸化タンタル膜の成膜を行
う基板例えばシリコン半導体ウエーハを、このアモルフ
ァス酸化タンタルの成膜装置内に導入してウエーハ上に
アモルファス酸化タンタルの成膜を行う。その後、イオ
ンおよびラディカル反応による少なくとも酸素O原子を
含む、イオン電流密度で5mA/cm2 以上の高密度プ
ラズマ照射処理、例えばヘリコン波プラズマ照射処理に
よってアモルファス状態を維持した状態で酸素プラズマ
処理を行ってアモルファス酸化タンタル薄膜の膜質改善
処理を行う。
ァス酸化タンタルの成膜工程は、上述の高密度プラズマ
ソースを用いたラディカル反応を主体とした成膜工程と
することができ、この成膜工程のプラズマ電力は40W
以上200W以下とする。また、その膜質改善処理工程
のプラズマ電力は、500W以上2000W以下とす
る。
る膜厚が例えば15nm以上である場合にあって、図1
に示すように、成膜工程とその後の膜質改善処理工程と
を、繰り返し、それぞれの成膜を15nm未満の厚さで
行い、アモルファス金属酸化膜の総厚が例えば15nm
以上の目的とする厚さとなるようにする。
工程と、膜質改善処理工程とは、図2にそのフロー図で
模式的に示すように、同一反応容器内で行うことができ
る。また、上述したアモルファス金属酸化膜の成膜工程
および膜質改善処理工程は、すべて430℃以下の温度
で行う。
は、誘電体絶縁層を、アモルファス金属酸化膜によって
構成する容量素子の製造方法であって、その誘電体絶縁
層を上述した本発明によるアモルファス金属酸化膜の製
造方法によって形成する。
は、アモルファス金属酸化膜を具備する半導体装置の製
造方法にあって、そのアモルファス金属酸化膜を上述し
た本発明によるアモルファス金属酸化膜の製造方法によ
って形成する。
度プラズマソースを用いたプラズマ処理装置としてのヘ
リコン波プラズマ処理装置1を、図3の概略構成図を参
照して説明する。この装置1は、ヘリコン波プラズマ発
生源2と、そのプラズマ生成がなされる石英から成るベ
ルジャー3に連通する反応容器4を有して成る。反応容
器4内には、半導体ウエーハ等の被成膜基板5が載置さ
れてこの基板5を所要の温度に加熱するヒータが設けら
れたサセプタ6が配置される。反応容器4には、プロセ
スガスを導入するガス導入口7が設けられ、排気口8か
ら、排気ポンプ(図示せず)によって排気され、反応容
器4内が、圧力調整器(図示せず)によって所望の真空
度に調整されるようになされる。
にヘリコンアンテナ9が配置され、このヘリコンアンテ
ナ9に、高周波(RF)発信器10から13.56MH
zのRFパワーが、インピーダンス整合手段11を介し
て印加される。
2Aと外側コイル12Bとが巻回される。これらコイル
12Aおよび12Bには、互いに向きが異なる直流(D
C)がそれぞれDC電源13Aおよび13Bから電流制
御手段14Aおよび14Bを通じて供給され、それぞれ
磁場を形成し、この電流値およびこれら比率を調整する
ことでベルジャー3内で発生したプラズマをヘリコン波
伝搬によって引き出すと共に、反応容器4の側面に設置
された永久磁石あるいは電磁石による磁場発生手段15
による磁界との相互作用で基板5の近傍でのプラズマ均
一性を調整するようになされている。この構成によるプ
ラズマ処理装置1によれば、供給するガス種を適宜変更
することによって成膜処理および酸化処理がなされる。
て本発明製造方法を実施する実施形態の例を説明する
が、本発明はこれに限定されるものではない。〔第1の
実施形態〕この実施形態においては、アモルファス酸化
タンタル膜を成膜するものであり、先ずRFパワーを2
00W以下として、ヘリコン伝搬を積極的に使用せず
に、ラディカルを主体とした領域での成膜処理工程がな
される。次に、酸素ガス等の酸素を含む酸化性ガスをガ
ス導入口7から供給し、この酸化性ガスを主体とし、R
Fパワーを500W〜2000Wとするヘリコン伝搬を
積極的に活用したイオンおよびラディカル混合高密度プ
ラズマ雰囲気を生成し、この雰囲気下で、先に成膜した
アモルファス酸化タンタル膜を、アモルファス状態を維
持したままで酸化処理する。このようにして、成膜プロ
セスだけでは不十分であった膜質改善処理工程がなされ
る。
電力、すなわちRFパワーは、200W以下とするとき
アモルファス膜の成膜、すなわち微細結晶をも発生する
ことがない非晶質膜の成膜を行うことができた。そし
て、200Wを上回ると成膜中に微細結晶が発生し、完
全なアモルファス膜が成膜しがたく、また40W未満で
は安定したプラズマ放電が得られず、安定した成膜がで
きないことが確認された。すなわち、成膜工程のプラズ
マ電力は40W以上200W以下に選定する。
ーク電流密度を測定した結果を示すもので、これによれ
ば、200W〜40Wでリーク電流密度が低い成膜を得
ることができることが分かる。
質改善処理におけるRF電力を変化させた場合の各リー
ク電流密度を測定した結果を示すもので、これによれ
ば、500W未満では膜質改善効果が不十分である。ま
た、2000Wを超えると、同様に、リーク電流密度が
急激に増加する。これは膜を破壊、もしくは部分的に結
晶化させることによるものである。したがって、この酸
化プロセスによる膜質改善処理におけるRF電力は、5
00W以上2000W以下に選定する。
および膜質改善処理工程がなされる処理装置は、上述し
た装置に限定されるものではなく、例えば図6にその概
略構成図を示すように、基板搬送室20に対して第1お
よび第2のチャンバー21および22が設けられた構成
を有し、搬送ロボット23によって、基板のカセットが
配置されるロードロック室24から被成膜基板を第1の
チャンバー21と第2の22でそれぞれ成膜処理と膜質
改善処理の酸化処理とを別個に行うこともできる。
は、前述した図1のフロー図で示すように、複数回の成
膜処理と、各成膜処理後にそれぞれ膜質改善の酸化処理
を行うという繰り返し作業を行う。このようにすること
によって時間的効率と十分にすぐれた膜質を得る。
膜すなわち酸化タンタル(Ta2 O 5 )の成膜膜厚を変
更し、また膜質改善処理の酸化処理時間をパラメータと
した膜厚とリーク電流密度の測定結果を図7に示す。図
7中、曲線71、72、73は、それぞれその処理時間
を30秒、60秒、90秒とした場合である。
密度とは、図8に示すように、印加電圧を上げて行った
ときにリーク電流が急激に上昇するいわゆるプール フ
レンケル(Pool Frenkel)電流領域に移行しはじめる点
の電流流密度である。
密度は、処理時間に依存するものの、膜厚が15nm以
上となると、酸化時間に対するリーク電流密度の抑制効
果率が低下する。そこで、この実施形態においては、1
5nm以上の膜厚の成膜を行う場合には、前述した図1
のフロー図で示すように、15nm未満の成膜を複数回
行い、各成膜処理後にそれぞれ膜質改善の酸化処理を行
うという繰り返し作業を行ものである。
は、15nm未満の成膜及び酸化処理を整数倍繰り返す
ことが効果的である。例えば、30nmの成膜を行う場
合には、10nmの成膜と酸化処理を3サイクル繰り返
し、全体として30nmの膜厚を得る。このようにする
ことによって、時間的効率と十分な膜質を得るものであ
る。
善の酸化処理とをそれぞれ異なるチャンバーで行うこと
も可能であるが、この場合、異なるチャンバーに対し、
基板5を搬入、搬出させる時間が、作業のロスタイムと
なる。特に上述したように、膜厚15nm以上の成膜を
行う場合には、繰り返しチャンバー間を行き来する作業
が必要となることから、このロスタイムは顕著となり生
産性の低下を来す。
は、図2のフロー図で示したように、同一の反応容器内
で成膜処理と酸化による膜質改善処理とを連続して実施
する。このような実施形態は、ヘリコン波プラズマ等の
高密度プラズマ発生源を用いる成膜と、膜質改善処理と
を行うことによって成り立つ成膜プロセスである。
ャワーヘッドを用いた平行平板型のプラズマCVD装置
によるときは、発生できるプラズマの密度が低いことか
ら、実用的な膜質およびプロセスを構築することは困難
である。
に、成膜終了までの段階は、前述の第1および第2の実
施形態と同様に、成膜工程終了後、成膜残留雰囲気排出
および酸化条件を整えるステップを設けて次に酸化ステ
ップすなわちO2 プラズマ処理を行う。そして、この酸
化が終了した段階で、目的とする成膜が15nm未満で
ある場合は、アモルファス金属酸化膜、すなわちアモル
ファス酸化タンタル膜の成膜プロセスを完了するが、こ
の完了にあたり、実際には、反応室内のガスパージを行
い、その後、基板の取出しがなされる。
合は、図9に示すように、前述した再度の成膜工程を行
うために、その前に成膜条件を整えるための成膜条件準
備工程がが設けられ、次に成膜工程、更に成膜雰囲気排
出およびO2 プラズマ処理による膜質改善処理工程の条
件設定すなわち準備工程を経てO2 プラズマ処理がなさ
れ、この繰り返し作業を目的とする膜厚を得るまで繰り
返し行い、その後、反応室内のガスパージを行い、その
後、基板の取出しがなされる。
程および膜質改善処理工程は、430℃以下の領域で行
う。因みに、430℃を超えると、膜質の低下を来すこ
とを見出したことによる。すなわち、430℃を超える
温度領域になると、熱反応による成膜反応が開始される
温度帯となり、そこにプラズマエネルギーを加えること
は過剰にエネルギーを投入することとなり、原材料の過
分解及び必要以上に反応が促進される事で、余剰反応物
や不要な元素が膜中に取り込まれ安くなり、逆に膜質を
劣化させてしまうためと考えられる。
属酸化膜の成膜条件と、その後の膜質改善処理の酸化処
理条件を例示する。 〔実施例〕 成膜条件: ペンタエトキシタンタル分圧 1.7mTorr 酸素分圧 4.2mTorr RF電力 100W 温度 300℃ 酸化条件: 酸素分圧 8mTorr RF電力 1500W 温度 300℃
ァス金属酸化膜の電気的特性は、図5、図6、図8に鎖
線をもって示すように、リーク電流値が1×10-8〔A
/cm2 〕程度以下であることが望ましい。このような
電気的特性および膜厚の均一性が得られる成膜条件およ
び酸化条件は、次のように選定される。 成膜条件: ペンタエトキシタンタル分圧 0.15〜4.3mTorr 酸素分圧 0.7〜8.6mTorr RF電力 40〜200W 温度 100〜430℃ 酸化条件: 酸素分圧 5〜15mTorr RF電力 500〜2000W 温度 100〜430℃
リーク電流特性にすぐれた、したがって信頼性の高いア
モルファス金属酸化膜、例えばアモルファス酸化タンタ
ル膜を十分薄く形成することができる。
においては、例えばMIM構造等における上下電極層間
に介在させる誘電体絶縁層の成膜において、上述した本
発明によるアモルファス金属酸化膜の製造方法と同一工
程を適用するものである。
においては、その誘電体層、あるいは絶縁層、もしくは
回路素子における容量素子を構成する場合において、上
述した本発明によるアモルファス金属酸化膜の製造方法
と同一工程を適用するものである。
集積回路装置における1回路素子としてのMIM容量素
子の一例の概略断面図を示す。この例では、半導体集積
回路を構成する半導体基板50、例えばSi半導体基板
の表面の、各回路素子間に局部的熱酸化膜いわゆる LOC
OS(Local Oxidationof Silicon)による分離絶縁層5
1が形成され、その上には、例えばSiO2 による層間
絶縁層52が形成されている。
を構成する下層電極層53が形成され、この上に、本発
明によるアモルファス金属酸化膜による誘電体絶縁層5
4が形成され、この上に、下層金属電極層53と対向す
る部位に、上層金属電極層55が形成される。このよう
にして、下層金属電極層53と、上層金属電極層55と
の間に、静電容量が形成されるMIM容量素子56が構
成される。
7が被覆され、この絶縁層57に、この容量素子56に
対する両端子、すなわち下層金属電極層54および上層
金属電極層55上に、コンタクト透孔58および59を
穿設する。図においては、コンタクト透孔58が、下層
金属電極層54に至るように、誘電体絶縁層53を貫通
して形成される。これら、コンタクト透孔58および5
9を通じて、例えば表面にTiNによる保護膜60が形
成された例えばAl合金層による配線層59が所要のパ
ターンに形成される。この容量素子は、他の回路素子の
形成と平行して形成することができる。
装置は、信頼性が高く、それぞれの電気的特性にすぐれ
た容量素子、半導体装置を得ることができた。
酸化膜、例えばアモルファス酸化タンタル膜を有する容
量素子、および半導体装置の各製造方法によれば、すべ
ての処理を低温下、具体的には430℃以下で行うこと
ができるものであり、これによって例えば下層電極、配
線等における導電層として加工性にすぐれ、低抵抗率の
低融点金属層の使用が可能となる。
低廉で、加工性にすぐれたしたがって、微細パターン化
が可能で、また低抵抗率であるAl、Cuをはじめとす
る金属、WN,TiN等を下層電極、配線等に用いるこ
とができる。また、すぐれた特性を有する信頼性の高い
アモルファス金属酸化膜、例えばアモルファス酸化タン
タルを誘電性絶縁層として形成でき、十分薄い誘電性絶
縁層の形成が可能となること、更に上述した電極、配線
層として加工性にすぐれた金属層を用いることができる
こととが相俟って、より容量素子の微細化が可能とな
る。これによって、例えば半導体集積回路装置における
回路素子の高密度化を図ることができ、またMIM構造
化を可能にすることによって高速化を図ることができ
る。
同一反応容器によって構成することができることによ
り、装置の簡易化、取り扱いの簡便化、作業性の向上、
信頼性の向上、生産性の向上が図られ、製造コストの低
減化を図ることができるなど工業的に多くの利益をもた
らすものである。
化タンタル薄膜の成膜方法の一例のフロー図である。
化タンタル薄膜の成膜方法の他の一例のフロー図であ
る。
置の概略構成図である。
のRF電力依存性を示す図である。
のRF電力依存性を示す図である。
きのリーク電流密度のタンタル膜厚依存性の測定結果を
示す図である。
に対するリーク電流密度の特性を示す図である。
タル薄膜の成膜方法の一例のフロー図である。
る半導体装置の一例の概略断面図である。
構成図である。
3・・・ベルジャー、4・・・反応容器、5・・・基
板、6・・・サセプタ、7・・・ガス導入口、8・・・
排気口、9・・・ヘリコンアンテナ、10・・・高周波
発信器、11・・・インピーダンス整合手段、12A・
・・内側コイル、12B・・・外側コイル、13A,1
3B・・・DC電源、14A,14B・・・電流制限手
段、15・・・磁場発生手段、20,100・・・基板
搬送室、21・・・第1のチャンバー、22・・・第2
のチャンバー、23,103・・・搬送ロボット、2
4,102・・・ロードロック室、101a〜101d
・・・チャンバー、50・・・半導体基板、51・・・
分離絶縁層、52・・・層間絶縁層、53・・・下層金
属電極層、54・・・誘電体絶縁層、55・・・上層金
属電極層、56・・・MIM容量素子、57・・・絶縁
層、58・・・コンタクト透孔、59・・・金属配線
層、60・・・保護膜
Claims (18)
- 【請求項1】 アモルファス金属酸化膜を容量絶縁膜と
するアモルファス金属酸化膜を有する容量素子の製造方
法であって、 上記アモルファス金属酸化膜の成膜工程と、 その後に、イオンおよびラディカル反応による少なくと
も酸素を含む、イオン電流密度で5mA/cm2 以上の
高密度プラズマ照射処理によってアモルファス状態を維
持した状態で上記アモルファス金属酸化膜の膜質改善処
理を行う膜質改善処理工程とを有することを特徴とする
アモルファス金属酸化膜を有する容量素子の製造方法。 - 【請求項2】 上記高密度プラズマ照射処理がヘリコン
波プラズマ照射処理であることを特徴とする請求項1に
記載のアモルファス金属酸化膜を有する容量素子の製造
方法。 - 【請求項3】 上記アモルファス金属酸化膜の成膜工程
が、上記高密度プラズマソースを用い、ラディカル反応
を主体とした成膜工程であり、該成膜工程のプラズマ電
力が40W以上200W以下とされたことを特徴とする
請求項1または2に記載のアモルファス金属酸化膜を有
する容量素子の製造方法。 - 【請求項4】 上記膜質改善処理工程のプラズマ電力が
500W以上2000W以下であることを特徴とする請
求項1、2または3に記載のアモルファス金属酸化膜を
有する容量素子の製造方法。 - 【請求項5】 上記成膜工程と、上記膜質改善処理工程
とが同一反応容器内で行われることを特徴とする請求項
1、2、3または4に記載のアモルファス金属酸化膜を
有する容量素子の製造方法。 - 【請求項6】 上記成膜工程を15nm未満の厚さで複
数回行い、各成膜工程後にそれぞれ膜質改善処理工程を
行うことを特徴とする請求項1、2、3、4または5に
記載のアモルファス金属酸化膜を有する容量素子の製造
方法。 - 【請求項7】 上記アモルファス金属酸化膜の目的とす
る膜厚が15nm以上である場合にあって、 上記成膜工程を15nm未満の厚さで複数回行い、各成
膜工程後にそれぞれ膜質改善処理工程を行い、上記アモ
ルファス金属酸化膜の総厚が上記15nm以上の目的と
する厚さとなるようにすることを特徴とする請求項1、
2、3、4、5または6に記載のアモルファス金属酸化
膜を有する容量素子の製造方法。 - 【請求項8】 上記アモルファス金属酸化膜が、アモル
ファス酸化タンタル薄膜であることを特徴とする請求項
1、2、3、4、5、6または7に記載のアモルファス
金属酸化膜を有する容量素子の製造方法。 - 【請求項9】 上記アモルファス金属酸化膜の成膜工程
および膜質改善処理工程のすべてを430℃以下の温度
で行うことを特徴とする請求項1、2、3、4、5、
6、7または8に記載のアモルファス金属酸化膜を有す
る容量素子の製造方法。 - 【請求項10】 アモルファス金属酸化膜を有する半導
体装置の製造方法にあって、 上記アモルファス金属酸化膜の成膜工程と、 その後に、イオンおよびラディカル反応による少なくと
も酸素を含む、イオン電流密度で5mA/cm2 以上の
高密度プラズマ照射処理によってアモルファス状態を維
持した状態で上記アモルファス金属酸化膜の膜質改善処
理を行う膜質改善処理工程とを有することを特徴とする
アモルファス金属酸化膜を有する半導体装置の製造方
法。 - 【請求項11】 上記高密度プラズマ照射処理がヘリコ
ン波プラズマ照射処理であることを特徴とする請求項1
0に記載のアモルファス金属酸化膜を有する半導体装置
の製造方法。 - 【請求項12】 上記アモルファス金属酸化膜の成膜工
程が、上記高密度プラズマソースを用い、ラディカル反
応を主体とした成膜工程であり、 該成膜工程のプラズマ電力が40W以上200W以下と
されたことを特徴とする請求項10または11に記載の
アモルファス金属酸化膜を有する半導体装置の製造方
法。 - 【請求項13】 上記膜質改善処理工程のプラズマ電力
が500W以上2000W以下であることを特徴とする
請求項10、11または12に記載のアモルファス金属
酸化膜を有する半導体装置の製造方法。 - 【請求項14】 上記成膜工程と、上記膜質改善処理工
程とが同一反応容器内で行われることを特徴とする請求
項10、11、12または13に記載のアモルファス金
属酸化膜を有する半導体装置の製造方法。 - 【請求項15】 上記成膜工程を15nm未満の厚さで
複数回行い、各成膜工程後にそれぞれ膜質改善処理工程
を行うことを特徴とする請求項10、11、12、13
または14に記載のアモルファス金属酸化膜を有する半
導体装置の製造方法。 - 【請求項16】 上記アモルファス金属酸化膜の目的と
する膜厚が15nm以上である場合にあって、 上記成膜工程を15nm未満の厚さで複数回行い、各成
膜工程後にそれぞれ膜質改善処理工程を行い、上記アモ
ルファス金属酸化膜の総厚が上記15nm以上の目的と
する厚さとなるようにすることを特徴とする請求項1
0、11、12、13、14または15に記載のアモル
ファス金属酸化膜を有する半導体装置の製造方法。 - 【請求項17】 アモルファス金属酸化膜を具備する半
導体装置の製造方法にあって、 上記アモルファス金属酸化膜が、アモルファス酸化タン
タル薄膜であることを特徴とする請求項10、11、1
2、13、14、15または16に記載のアモルファス
金属酸化膜を有する半導体装置の製造方法。 - 【請求項18】 上記アモルファス金属酸化膜の成膜工
程および膜質改善処理工程のすべてを430℃以下の温
度で行うことを特徴とする請求項10、11、12、1
3、14、15、16または17に記載のアモルファス
金属酸化膜を有する半導体装置の製造方法。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002086553A JP2003282722A (ja) | 2002-03-26 | 2002-03-26 | アモルファス金属酸化膜を有する容量素子および半導体装置の各製造方法 |
KR1020030017551A KR101153978B1 (ko) | 2002-03-26 | 2003-03-20 | 비결정질 금속 산화막의 제조 방법 및 비결정질 금속산화막을 가지는 커패시턴스 소자와 반도체 장치를제조하는 방법 |
EP03290729A EP1355348A3 (en) | 2002-03-26 | 2003-03-21 | Method of manufacturing amorphous metal oxide film and methods of manufacturing capacitance element having said film and semiconductor device |
TW092106509A TWI244138B (en) | 2002-03-26 | 2003-03-24 | Method of manufacturing amorphous metal oxide film and methods of manufacturing capacitance element having amorphous metal oxide film and semiconductor device |
US10/395,389 US6916747B2 (en) | 2002-03-26 | 2003-03-25 | Method of manufacturing amorphous metal oxide film and methods of manufacturing capacitance element having amorphous metal oxide film and semiconductor device |
CNB031384579A CN1264205C (zh) | 2002-03-26 | 2003-03-26 | 制造非晶金属氧化物膜、电容元件和半导体器件的方法 |
US10/998,759 US7666793B2 (en) | 2002-03-26 | 2004-11-30 | Method of manufacturing amorphous metal oxide film and methods of manufacturing capacitance element having amorphous metal oxide film and semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002086553A JP2003282722A (ja) | 2002-03-26 | 2002-03-26 | アモルファス金属酸化膜を有する容量素子および半導体装置の各製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2003282722A true JP2003282722A (ja) | 2003-10-03 |
Family
ID=29233119
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002086553A Pending JP2003282722A (ja) | 2002-03-26 | 2002-03-26 | アモルファス金属酸化膜を有する容量素子および半導体装置の各製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2003282722A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6939760B2 (en) | 2002-07-02 | 2005-09-06 | Elpida Memory, Inc. | Method for semiconductor device manufacturing to include multistage chemical vapor deposition of material oxide film |
CN109666920A (zh) * | 2017-10-13 | 2019-04-23 | 三星显示有限公司 | 制造金属氧化物膜的方法和包括金属氧化物膜的显示装置 |
-
2002
- 2002-03-26 JP JP2002086553A patent/JP2003282722A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6939760B2 (en) | 2002-07-02 | 2005-09-06 | Elpida Memory, Inc. | Method for semiconductor device manufacturing to include multistage chemical vapor deposition of material oxide film |
CN109666920A (zh) * | 2017-10-13 | 2019-04-23 | 三星显示有限公司 | 制造金属氧化物膜的方法和包括金属氧化物膜的显示装置 |
US11362162B2 (en) | 2017-10-13 | 2022-06-14 | Samsung Display Co., Ltd. | Method of manufacturing metal oxide film and display device including metal oxide film |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR0167570B1 (ko) | 반도체 디바이스에 있어서의 유전체막(誘電體膜)의 형성방법 | |
KR100639147B1 (ko) | 플라즈마 처리 방법 | |
TWI385721B (zh) | Etching method and etching device | |
US20010043453A1 (en) | Method of forming metal electrodes | |
KR100354797B1 (ko) | 피처리체의표면에티탄막및배리어금속막을적층하여형성하는방법 | |
KR20010027867A (ko) | 박막 형성장치 및 이를 이용한 반도체소자의 커패시터 형성방법 | |
KR19990014269A (ko) | 복합 금속 산화물로 만들어진 유전체층을 포함하는 메모리 커패시터를 갖는 반도체 장치의 제조 방법 | |
TWI729495B (zh) | 高溫rf加熱器座 | |
US6177305B1 (en) | Fabrication of metal-insulator-metal capacitive structures | |
KR20000027398A (ko) | 플라즈마를 이용한 강유전체막의 페롭스카이트핵 형성 방법 | |
JPH09102492A (ja) | 半導体装置の製造方法および半導体製造装置 | |
KR101153978B1 (ko) | 비결정질 금속 산화막의 제조 방법 및 비결정질 금속산화막을 가지는 커패시턴스 소자와 반도체 장치를제조하는 방법 | |
JPH11297964A (ja) | 高誘電率の誘電膜を有する半導体装置のキャパシタ製造方法 | |
JPWO2004017396A1 (ja) | 半導体基体上の絶縁膜を形成する方法 | |
JP2004193409A (ja) | 絶縁膜の形成方法 | |
JP7476319B2 (ja) | ドープされたald窒化タンタルにおける不純物の除去 | |
JP2003282722A (ja) | アモルファス金属酸化膜を有する容量素子および半導体装置の各製造方法 | |
KR100400248B1 (ko) | 반도체소자의 배선 형성방법 | |
JP3875906B2 (ja) | アモルファス金属酸化膜の製造方法 | |
US6372519B1 (en) | In-situ formation of metal oxide and ferroelectic oxide films | |
WO2000045429A1 (fr) | Procede de fabrication d'un dispositif de circuit integre a semi-conducteur | |
KR100504554B1 (ko) | 반도체 소자의 캐패시터 제조 방법 | |
TWI505360B (zh) | 用於氟碳化物膜之金屬碳化物阻障層的形成方法 | |
US20240191353A1 (en) | Electrochemical reduction of surface metal oxides | |
JPS62274082A (ja) | ドライエツチング方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Effective date: 20040701 Free format text: JAPANESE INTERMEDIATE CODE: A971007 |
|
A131 | Notification of reasons for refusal |
Effective date: 20060829 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
|
A521 | Written amendment |
Effective date: 20061027 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
|
A131 | Notification of reasons for refusal |
Effective date: 20061219 Free format text: JAPANESE INTERMEDIATE CODE: A131 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20070216 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20070313 |