JP2003051738A - 1又は複数のクロック信号から出力信号を選択的に生成するための回路 - Google Patents
1又は複数のクロック信号から出力信号を選択的に生成するための回路Info
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Abstract
1、CLK_SRC_2、…、CLK_SRC_n)の
中から1つを選択し、出力信号(CLK_OUT)に伝
達することのできる回路(100)に関する。 【解決手段】入力クロック信号はマルチプレクサ(MU
X)に現れて、マルチプレクサは、そのコントロール入
力からの選択信号(CFG_i)に基づいて、これらの
信号の中の1つを、その出力に与える。マルチプレクサ
の出力信号(MUX_OUT)は、スイッチ(S)及び
信号ラッチ(LATCH)を介して、出力信号(CLK
_OUT)として、回路の出力に与えられる。2つの入
力信号の間の切り替えは、ステートマシン(FSM)に
よりコントロールされる。外部コンフィギュレーション
信号(CFG)の切り替わりの後、ステートマシンは始
めに、信号ラッチ(LATCH)を非トランスペアレン
トに切り替える。
Description
ら、出力信号を選択的に生成するための回路に関する。
は、その動作のために、クロック信号を必要とする。こ
の信号は、クロックレートを予め決定する。事情によっ
ては、異なるクロック信号から得られる異なるクロック
レートで、ロジック回路が交互に動作すべきであるとい
う状況が生じるかもしれない。例えば、何らかの遅い周
辺装置に適合できるようにするために、マイクロコンピ
ュータの中央処理装置(CPU)を任意に速い及び遅い
クロックで動作させることができるようにする必要があ
るかもしれない。同様に、スマート・カード・コントロ
ーラにおいては、チップ・クロック用のソースは、その
アプリケーションに応じて、異なるかもしれない。例え
ば、外部クロックがスマート・カードのピンを介して供
給されるかもしれず、或いは、外部クロックがオンチッ
プ発振器用の内部ソースとして、機能するかもしれな
い。
グをする場合には、スイッチングの間に、定義されてい
ない状態又は電圧パルス(グリッチ)が発生しないこと
を、考慮すべきである。このような事情の下、複数のク
ロック信号の間の切り替え又は2つの異なるクロック信
号の間の切り替えを可能にする回路が、例えば、米国特
許第5,483,185号、米国特許第5,604,4
52号、及び、米国特許第5,790,609号に記述
されている。既知の回路においては、予め定められたク
ロック信号がマルチプレクサに与えられ、マルチプレク
サの出力が、これらのクロック信号のうちの1つを出力
信号として供給する。これはマルチプレクサのコントロ
ール入力により、選択することができる。2つのクロッ
ク信号の間の切り替えは、定義されていない信号状態が
その出力に生じないように、コントロール手段により、
コントロールされる。この目的のために、スイッチング
プロセスの間、出力信号はロジックハイ状態に対応する
レベルに、維持される。この状態から開始して、出力信
号は新しく選択されたクロックにより連続的に進行す
る。しかしながら、ハイ状態を待つので、出力信号がス
イッチングプロセスの始まりでちょうどロジックロー状
態になった場合には、スイッチングプロセスでは、比例
した長い時間を消失する。したがって、頻繁にスイッチ
ングプロセスがある場合には、顕著な遅延が回路に発生
する。さらに、既知の回路は、共通して、回路のコント
ロールは外部クロック信号の1つにより行われる。この
クロック信号が乱れたり停止したりした場合、回路の機
能は中断する。
は、複数の入力クロック信号から1つの出力信号を選択
的に生成し、速くて干渉のないクロック信号の間のスイ
ッチングを可能にする回路を、提供することである。同
時に、回路はフェールセーフであるべきであり、且つ、
好ましくは、簡単な手段でCMOS技術により実現され
るべきである。
より、解決される。有利な実施形態が従属の請求項に定
義されている。
の出力信号を選択的に生成する回路は、次のようなエレ
メントを備えている。
力と、入力クロック信号の中から1つを選択する信号の
ためのコントロール入力と、選択された入力クロック信
号を供給するためのマルチプレクサ出力とを有する、マ
ルチプレクサと、 B) マルチプレクサ出力と回路の出力との間に設けら
れた信号ラッチであって、マルチプレクサ出力への接続
ラインはスイッチを有している、信号ラッチと、 C) 外部クロック選択信号のためのコントロール入力
と、マルチプレクサ出力の信号と回路の出力信号のため
の信号入力と、ロジッククロック信号のためのクロック
入力と、マルチプレクサのコントロール入力に接続され
るコントロール出力と、スイッチに接続されるディセー
ブル信号出力とを有する、スイッチングロジック。
ロール入力で信号が切り替わった場合にスイッチを開に
し、そのコントロール入力からそのコントロール出力
へ、切り替わった信号を伝達し、マルチプレクサ出力の
出力信号が、少なくとも1回切り替わって且つ信号ラッ
チに保持された回路の出力信号と等しくなった場合に、
スイッチを再び閉にするように構成されている。
力信号に選択的に切り替えることを可能にし、2つの異
なる入力クロック信号の切り替えの間に、出力信号に、
定義されていない状態、又は、干渉電圧が生じない。こ
れは、マルチプレクサ出力が信号ラッチを介して回路の
出力に接続されることにより、また、マルチプレクサと
信号ラッチとの間の接続がスイッチにより遮断されるこ
とにより、達成される。このような遮断は、2つの入力
クロック信号の間のスイッチングの前に行われ、このた
め、スイッチングの間、回路の出力は信号ラッチのみに
接続され、この結果、現在の信号レベル(ハイ又はロ
ー)が一定に保たれ、干渉が生じない。スイッチングプ
ロセスが終了し、安定した信号(そのレベルは信号ラッ
チの信号のレベルに対応している)がマルチプレクサ出
力に現れた場合にのみ、スイッチは再び閉になり、出力
信号が直ちに新しく選択された入力クロック信号に追随
するようになる。
ングプロセスの開始時における出力信号のレベルを、少
なくとも、入力クロック信号間で生じる最も短いクロッ
ク周期の間、維持することを確保する。このようにし
て、短すぎるクロック信号によって、接続されたロジッ
ク回路が干渉することが、排除される。この効果は、ス
イッチを再び閉にすることにより、マルチプレクサ出力
が信号ラッチに再び接続する前に、まず、コントロール
が、少なくともマルチプレクサ出力の信号の切り替わり
を待つことにより達成される。それ故、現在のラッチ状
態が、少なくとも、新しい信号の1フルクロック長だけ
維持される。
ロック信号を利用可能にするために、スイッチングロジ
ックのクロック入力に接続されたクロック生成器を少な
くとも備えている。それ固有のクロック発生器であるの
で、回路は、外部クロック信号と独立したものとなり、
故障又は干渉の場合にも、動作を続けることができる。
さらに、固有のクロックは、入力クロック信号に対する
実質的な遅延なしに反応するのに十分な速さで、スイッ
チングロジックが動作をすることを可能にする。
特に、ステートマシンとして構成されていてもよく、こ
のスイッチングロジックの状態及び状態遷移は、次のよ
うなステップを行うことを実現する。
選択信号の切り替わりを待つ、ステップと、 b) コントロール入力における信号が切り替わった場
合に、スイッチを開にするために、ディセーブル信号出
力にディセーブル信号を供給する、ステップと、 c) コントロール入力から、マルチプレクサへのコン
トロール出力に、信号を伝達する、ステップと、 d) マルチプレクサ出力における信号の切り替わりを
待つ、ステップと、 e) マルチプレクサ出力における切り替わった信号
が、回路の出力信号と等しくない場合に、マルチプレク
サ出力における信号の切り替わりを再び待つ、ステップ
と、 f) スイッチを閉にするために、ディセーブル信号出
力におけるディセーブル信号を除去し、ステップa)に
戻る、ステップ。
を、標準化された回路記述言語により定義できるという
利点を有しており、この回路記述言語は、具体的な回路
における予め定められたロジックステップの機能を、簡
単に且つ自動的に変換することを、可能にする。
S技術により実現される。これは、回路を既知のマイク
ロチップに集積化することを可能にする、既知の信頼性
のある技術である。特に、回路は、スマートカードチッ
プに関して使用されてもよい。スマートカードにおいて
は、チップを、外部から供給されたクロック又は内部で
生成したクロックで任意にコントロールし、且つ、スマ
ートカードの機能に課せられたセキュリティー条件が極
めて厳格である状況が、しばしば、生じる。スイッチン
グプロセスの間、出力信号が定義されていない状態、又
は、チップのリセットさえ、発生するのが、如何なる場
合でも回避される。
路100は、複数の所定の入力クロック信号CLK_S
RC_1,CLK_SRC_2,…,CLK_SRC_
nから、1つの入力クロック信号を選択することによ
り、1つの出力信号CLK_OUTの生成を可能にす
る。このような回路は、特に、スマートカードチップに
用いられてもよく、チップに外部クロック又は内部クロ
ックを任意に供給する。入力クロック信号は、必ずしも
同期されている必要はない。
極めて厳格なセキュリティー条件が考慮されるべきであ
る。動作状態において、このようなスマートカードコン
トローラは、定義されていない状態に決してしてはなら
ない。従って、スマートカードコントローラを常に定義
された状態に維持するために、システムクロックCLK
_OUTとして、生成されるパルスは、システムに依存
した最小期間に達しない状態に陥らないことが必要であ
る。特に、短いラスティングパルス(グリッチ)がシス
テムクロック上で発生してはならない。
のスイッチングフューズは、クリティカルである。スイ
ッチングプロセスの間又は後のスマートカードコントロ
ーラのリセットは、スマートカードコントローラを再び
定義された状態にするかもしれないが、データを維持す
るという理由から、行われてはならない。さらに、特に
テスト目的のためには、できる限り歪みのない態様で、
入力クロック信号からシステムクロックを得ることが重
要である。
クロック信号CLK_SRC1,…,CLK_SRC_
nは、図1の回路の入力に現れる。回路の別の入力は、
コンフィギュレーション又はクロック選択信号CFGを
供給するために用いられる。この信号CFGは、システ
ムクロックを生成すべき入力クロック信号を指定してい
る。信号CFGは、信号ベルトであり、つまり入力クロ
ック信号の数nに依存する。CFGはm個の別個の信号
からなり、ここで2mはnより大きいか又は等しい関係
にある。回路100は、その出力に、所望のシステムク
ロックCLK_OUTを供給する。
CLK_SRC_1,…,CLK_SRC_nは、既知
のマルチプレクサMUXの入力に接続されている。マル
チプレクサMUXは、ステートマシンFSMのコントロ
ール出力に接続されたコントロール入力を有している。
このコントロール入力を介して、マルチプレクサMUX
は、ステートマシンから内部コントロール信号CFG_
iを受信する。このコントロール信号は、入力クロック
信号からの選択をコントロールする。CFG_iは、C
FGと同様に、信号ベクトルである。
X_OUTを伝達し、この信号MUX_OUTは現在の
選択された入力クロック信号に対応している。この信号
はトランジスタスイッチSを介して、スタテック型CM
OSラッチに与えられる。このラッチは、スイッチSを
開にすべき場合でも、現在のレベル(ロー又はハイ)を
維持する信号メモリとして機能する。CMOSラッチの
出力は、この回路の出力及びステートマシンFSMに接
続される。所望の出力は信号CLK_OUTが、この回
路の出力から得られる。
に、コンフィギュレーション信号CFGが現れる、この
回路の入力に接続されている。さらに、これはディセー
ブル信号出力を介して、スイッチSに接続されており、
ディセーブル信号DISABLEを介して、このスイッ
チを任意に開閉する。ステートマシンは、出力信号CL
K_OUTと同様に、マルチプレクサ出力からの入力信
号として、信号MUX_OUTを受信する。
発振器ROに接続されており、リング発振器ROは、そ
れ独自のクロックFCLKを供給する。このクロック
は、最も速い入力クロック信号又はシステムクロックの
クロックレートを明らかに越えており、これによりステ
ートマシンFSMは、入力クロック信号のクロック周期
の間に、必要なプロセスステップを行い、擬似的には瞬
時に入力クロック信号の変化に反応することができる。
号に切り替えることを、回路100で行う場合、これ
は、外部コンフィギュレーション信号CFGの変化に対
応することにより、指示される。コンフィギュレーショ
ン信号のこのような変化の後、ステートマシンFSMに
より及びコントロール信号DISABLE手段により、
スイッチSを介して、信号ラッチLATCHは最初に非
トランスペアレントにスイッチされる。この結果、シス
テムクロックCLK_OUTは、瞬間的に現在のレベル
を維持する。信号ラッチLATCHが確実に非トランス
ペアレントである場合、ステートマシンは、信号CFG
の変化を信号CFG_iとして、マルチプレクサMUX
のコントロール入力に与える。その結果として、マルチ
プレクサMUXは、新しい入力クロック信号にセットさ
れる。グリッチは、マルチプレクサの出力信号MUX_
OUTのこの切り替えの間に発生するかもしれないが、
非トランスペアレントな信号ラッチLATCHによりブ
ロックされる。
が、安定し且つ信号ラッチLATCHに保持した値に変
化し終えた瞬間に、信号ラッチLATCHは再びステー
トマシンFSMによりトランスペアレントに切り替えら
れる。信号ラッチをリリースするこの条件は、出力信号
CLK_OUTに、システムクロックの最小フューズ長
の短かさまで陥ることが、発生しないことを保証する。
076〜1987)等の既知のハードウェア記述言語に
より記述することができ、必要さとれるセルライブラリ
ーに課せられた最小条件下で、合成することができる。
原則として、スイッチング合成のスタティックラッチと
同様に、NANDゲート又はNODゲートだけで、提供
されなければならない。
は、特に、システムクロックCLK_OUT上にグリッ
チを生成することなく、異なる入力クロック信号の間の
切り替えを可能にすることである。この切り替えは、プ
ログラムを現在実行しているコントローラにより行って
もよいが、スイッチングプロセスの間又は後のコントロ
ーラのリセットは必要とされない。スイッチングプロセ
ス以外では、マルチプレクサMUX及び信号ラッチLA
TCHによる遅延時間だけが、入力クロック信号による
システムクロックの生成に影響を与える。
おいて、現在のシステムクロックCLK_OUTが、現
在のロジックレベルに維持されるという利点がある。レ
ベルが所定の値(例えば、ハイレベル)に切り替わるま
で最初に待つ必要がなくなる。このため、このスイッチ
ングプロセスを、特に、遅いものから速い入力クロック
信号への切り替えに適用した場合において、スイッチン
グプロセスは、一般的に既知の回路よりも速く進行す
る。重要な利点は、回路を任意数の入力クロック信号に
対して構成することができることであり、つまり、任意
数の入力クロック信号に基本的に拡張することができる
ことである。
チプレクサとピン・コンパチブルであることであり、つ
まり、追加の入力又は出力信号は必要とされず、生成も
されない。
離されたクロック生成器ROによりコントロールされる
であることである。このため、入力クロック信号の質に
依存しておらず、特に、これらの信号のうちの1つが乱
れたり、停止したりした場合でも、機能する。
Mの動作可能モードの状態遷移図である。
LEにある。ステートマシンは、外部コンフィギュレー
ション信号CFGが変化しない限り、この状態を維持す
る。このため、マルチプレクサMUXは切り替わらな
い。ステートマシンは、この信号と、ステートマシンの
コントロール入力の信号CFG_iとを比較することに
より、外部コンフィギュレーション信号が同じ状態を維
持しているかどうかをチェックする。
合には、前述の信号CFGとCFG_iが等しくなくな
る。そして、ステートマシンは、状態WTに変化する。
この状態で、信号DISABLEはアクティブになり、
スイッチSが開になる。これにより、非トランスペアレ
ントに信号ラッチLATCHを切り替える。
態RECFGに変化する。信号CFG_i上の外部コン
フィギュレーション信号CFGが、最初に、マルチプレ
クサMUXに伝達される。これにより、マルチプレクサ
MUXは、新しく選択された入力クロック信号に切り替
わる。
OUTのロジックレベル(0又は1)に応じて、ステー
トマシンは連続して状態WT_0又はWT_1に切り替
わり、この信号が対応する他のレベルに切り替わるのを
待つ。このような切り替わりの後、ステートマシンは状
態DECIDEに切り替わる。
マシンは、マルチプレクサ出力における新しいレベルM
UX_OUTが、信号ラッチLATCHにおけるレベル
CLK_OUTに一致するかどうかを、チェックする。
これらのレベルが一致していない場合には、マルチプレ
クサ出力は、回路の出力にまだ接続することができな
い。したがって、ステートマシンは、RECFGに戻
り、信号MUX_OUTの切り替わりを待つための新し
い周期を開始する。
レベルMUX_OUTは、ラッチのレベルCLK_OU
Tに一致する。状態DECIDEでこの条件が確立した
場合には、ステートマシンは状態ENABLEに切り替
わる。この状態において、スイッチSは閉になり、これ
により信号ラッチLATCHは再びトランスペアレント
に切り替わる。マルチプレクサ出力の信号MUX_OU
Tは、これにより、回路の出力に伝達される。
IDLEに再び戻り、クロック信号の切り替えプロセス
全体が、終了する。
おける状態遷移図である。
_SRC_n 入力クロック信号 DISABLE コントロール信号 FCLK ロジッククロック信号 FSM ステートマシン LATCH 信号ラッチ MUX マルチプレクサ MUX_OUT マルチプレクサ出力信号 RO リング発振器
Claims (4)
- 【請求項1】1又は複数の入力クロック信号から、1つ
の出力信号を選択的に生成する回路であって、 A) 入力クロック信号のための複数の入力と、入力ク
ロック信号の中から1つを選択する信号のためのコント
ロール入力と、選択された入力クロック信号を供給する
ためのマルチプレクサ出力とを有する、マルチプレクサ
と、 B) マルチプレクサ出力と回路の出力との間に設けら
れた信号ラッチであって、マルチプレクサ出力への接続
ラインはスイッチを有している、信号ラッチと、 C) 外部クロック選択信号のためのコントロール入力
と、マルチプレクサ出力の信号と回路の出力信号のため
の信号入力と、ロジッククロック信号のためのクロック
入力と、マルチプレクサのコントロール入力に接続され
るコントロール出力と、スイッチに接続されるディセー
ブル信号出力とを有する、スイッチングロジックとを備
え、 前記スイッチングロジックは、そのコントロール入力で
信号が切り替わった場合にスイッチを開にし、そのコン
トロール入力からそのコントロール出力へ、切り替わっ
た信号を伝達し、マルチプレクサ出力の出力信号が、少
なくとも1回切り替わって且つ回路の出力信号と等しく
なった場合に、スイッチを再び閉にするように構成され
ている、 ことを特徴とする回路。 - 【請求項2】請求項1に記載の回路であって、ロジック
クロック信号を利用可能にするために、スイッチングロ
ジックのクロック入力に接続されたクロック生成器を備
えていることを特徴とする回路。 - 【請求項3】請求項1又は請求項2に記載の回路であっ
て、スイッチングロジックは、 a) コントロール入力におけるクロック選択信号の切
り替わりを待つ、ステップと、 b) コントロール入力における信号が切り替わった場
合に、スイッチを開にするために、ディセーブル信号出
力にディセーブル信号を供給する、ステップと、 c) コントロール入力から、マルチプレクサへのコン
トロール出力に、信号を伝達する、ステップと、 d) マルチプレクサ出力における信号の切り替わりを
待つ、ステップと、 e) マルチプレクサ出力における切り替わった信号
が、回路の出力信号と等しくない場合に、マルチプレク
サ出力における信号の切り替わりを再び待つ、ステップ
と、 f) スイッチを閉にするために、ディセーブル信号出
力におけるディセーブル信号を除去し、ステップa)に
戻る、ステップと、 を行うように実現された状態及び状態遷移のステートマ
シンである、ことを特徴とする回路。 - 【請求項4】請求項1乃至請求項3のいずれかに記載の
回路であって、CMOSにより実現されることを特徴と
する回路。
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