JP2001521284A - 高速昇降温処理(rtp)システムにおける半導体ウェーハの酸化方法 - Google Patents

高速昇降温処理(rtp)システムにおける半導体ウェーハの酸化方法

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Abstract

(57)【要約】 a)第一の反応性ガスの実質的な蒸気圧を含有する雰囲気中で第一の温度T1でウェーハを高速加工し;ついでb)第一のガスが実質的に不含の雰囲気中で第二の温度T2でウェーハを高速加工することからなる、RTPシステムにおける半導体の表面上に薄膜を製造する方法が記載されている。

Description

【発明の詳細な説明】
【0001】 発明の技術分野 本発明は、高速昇降温処理(Rapid Thermal Processing)(RTP)システムに
おいて、加熱した物体の表面上に高品質の薄膜を生じさせる方法に関する。殊に
、本発明は、常法により生じさせた、物体の表面上に堆積しているかまたは成長
した層の品質を改善するための方法を開示している。本発明は、ガスと半導体材
料とを反応させることから形成される材料の層を有する半導体ウェーハの場合、
例えば高速熱酸化(Rapid Thermal Oxidation)(RTO)または高速熱窒化(Rapi
d Thermal Nitridation)(RTN)の場合、および材料がガスから堆積される場
合、例えば高速熱化学気相成長(Rapid Thermal Chemical Vapor Deposition)( RT−CVD)の場合に殊に有用である。
【0002】 本発明は、再現性を改善し、欠陥密度を低下させ、かつ先行技術のRTOプロ
セスの歩留まりを増大させる。
【0003】 発明の背景技術 多種多様な誘電体薄膜は、今日、超小形電子回路技術において使用されている
。これらの薄膜の多くは、超小形電子回路が形成される半導体上に堆積される。
しかしながら、その他のものは、半導体自身に起因しており、かつ自然薄膜であ
ることが注目される。この自然薄膜の原則的な利点は、この薄膜が汚染物質を比
較的含有しないということである。これは、不純物濃度が制限される高純度ガス
雰囲気中で、この薄膜が純粋な半導体を消費しながら成長するからである。自然
薄膜は、その形成し易さおよび下にある基板との卓越した界面のために、半導体
製造において幅広く使用されている。シリコンにおける全ての素子の表面不動態
化の基礎は、自然なSiO2であるけれども、その他の絶縁堆積薄膜も、超小形 電子回路の製造において二次層として有用である。更に、熱的に成長した酸化物
は、マスキング、スクリーン酸化物、素子分離およびトンネル誘電体またはゲー
ト誘電体に使用される。この多種多様な応用は、B. E. DealおよびS. Grove J.
Appl. Phys. 36(12), 3770-3778 (1965)およびP. Balk, THE SI-SiO2 SYSTEM, E
lsevier Science Publishing, Amsterdam, 1988に詳細に記載されているように 、先年の二酸化ケイ素の電気的性質および成長動力学の熱心な研究をもたらした
【0004】 これらの研究の多くは、上記引用文献およびB. E. Deal, J. Electrochem. So
c. 125(4), 576-579, (1978)に詳細に記載されているように、精製された乾燥酸
素(10ppm未満のH2O含量)中または湿った酸素雰囲気中での常用の炉酸 化に絞られている。数年前の最初の高速昇降温処理システムの導入と共に、乾燥
酸素雰囲気中の最初の高速熱酸化(RTO)のデータが、M. M. Moslehi, S. C.
ShatasおよびK. C. Sawaswat, Appl. Phys. Let. 47 (12), 1353-1355 (1985) により呈示されている。厚い乾燥二酸化ケイ素の成長のためには、熱履歴の多す
ぎる時間−温度が必要である。例えば、90秒間の1150℃処理は、19.3
ナノメートル(nm)のSiO2薄膜をシリコン表面上に製造するのに必要であ る。これらの極めて高い時間−温度の組合せは、酸化前に達成される電気的性質
に関連して問題を引き起こしうるので、酸化中の時間−温度の組合せの低下は、
必要不可欠である。
【0005】 Moslehi他は、CMOSウェル処理のために、25nmのマスク酸化物の初期 成長のための近大気雰囲気(650トル(86.7kPa))で実施される湿式
酸化について、Texas Instrument Technical Journal 9(5) 44-64, (1992)に報 告している。M. Glueck, U. Koenig, J. Hersener, Z. NenyeiおよびA. Tillman
n Mat.Res.Soc.Symp.Proc 第342巻 215-225 (1994)では、脱イオン水での気泡系
を用いて高速昇降温処理(RTP)システム中における湿式酸化が運転された。
しかしながら、バブラー法の再現性は、H2O分圧の不十分な制御のために乏し い。また、より高い金属汚染および粒子密度は、この方法に随伴される。
【0006】 これらの深刻な問題は、RTPシステムと、常用の炉技術から十分公知の高温
蒸気発生器とを組み合わせることにより解決されている。不純物濃度は、ガス中
の汚染残留物にのみ依存する。しかしながら、生じる酸化物は、常用の炉中で生
じる酸化物よりも低品質である。本発明は、RTPシステムにおいて生じる湿っ
た酸化物およびその他の自然薄膜または自然のではない薄膜の品質を可能な最大
限まで増大させる方法である。
【0007】 関連した応用 RTP原理に基づいた反応器は、しばしばウェーハ処理プロセス中に開放する
反応器チャンバの一端の全断面部を有する。この構造が設けられているのは、著
しく大きな寸法を有しており、かつウェーハよりも厚くなりうる多様なウェーハ
ホルダ、ガードリングおよびガス分配板がチャンバ内に導入されなければならず
、かつプロセスが変更される場合または例えば異なるウェーハサイズが使用され
る場合には、簡単にかつ直ちに変更されなければならないからである。反応チャ
ンバの寸法は、これらの付属物を念頭に置いて設計されている。本発明の譲受人
に譲渡され、これによって参考により組み込まれている米国特許第558083
0号明細書には、ガスフローの重要性およびプロセスチャンバ中のガスフローを
調節するためおよび不純物を制御するためのドア中の開口部の使用が教示されて
いる。
【0008】 極めて幅広いスペクトル応答の高温計を用いて、ウェーハの温度を測定する重
要性は、本発明の譲受人に譲渡されており、かつこれによって参考により組み込
まれている米国特許第5628564号明細書に教示されている。
【0009】 典型的には、常用のRTPシステム中で加熱すべきウェーハは、システムのリ
フレクタ壁に対して厳密に平行にウェーハを保持する複数の石英ピン上に載置さ
れている。先行技術のシステムは、ウェーハが内蔵されたサセプタ上、典型的に
は均質なシリコンウェーハ上に載置されている。本発明の譲受人に譲渡されてお
り、かつこれによって参考によりに組み込まれている、同時係属中の特許出願0
8/5374909号には、ウェーハから分離したサセプタプレートの重要性が
教示されている。
【0010】 III−IV半導体の高速昇降温処理は、シリコンのRTPと同じように成功
していない。この1つの理由は、その表面が、例えば、ヒ化ガリウム(GaAs
)の場合のヒ素(As)の相対的に高い蒸気圧を有していることである。表面領
域は、Asが減損するようになり、材料品質が損害を受ける。本発明の譲受人に
譲渡されており、かつこれによって参考によりに組み込まれている、同時係属中
の特許出願08/631265号は、この問題を克服するための方法および装置
を提供している。
【0011】 軽くドープした、光パルスでウェーハを局所的に加熱することにより相対的に
低温のウェーハの放射を上昇させる方法は、本発明の譲受人に譲渡されており、
かつこれによって参考によりに組み込まれている、同時係属中の特許出願08/
632364号において開示されている。
【0012】 発明の要約 本発明によれば、RTPシステムにおいて物体の表面上に薄膜を生じさせる常
用の段階は、最初の加工段階で使用したよりも、異なるガス雰囲気中の物体を加
工する付加的な段階に続いている。本発明の更に好ましい実施態様において、物
体の温度は、最初の加工ガスがRTPチャンバから除去される間に低下する。最
初の加工ガスの活性成分の分圧が一定の値に達した後に、物体の温度はついで、
最初の加工段階で使用したよりも、異なるガス雰囲気中で物体を加工する付加的
な段階のために上昇する。
【0013】 発明の詳細な記載 実験準備 これらの実験のための全てのウェーハを、高温蒸気発生器と組み合わせた常用
のAST SHS2800e RTPシステム中でアニールした。
【0014】 高速昇降温処理システムは、ウェーハの上方および下方のタングステンハロゲ
ン灯ならびに4個の側部灯により、独立した灯制御により、および独立した頂部
および底部のヒーターバンク制御により特徴付けられている。灯の電力は、制限
されてもよいし、または方法設計に応じて任意の方法段階でランプアップ(ramp
up)およびランプダウン(ramp down)されてよい。ウェーハは、金で被覆したミラ
ーチャンバ中の石英反応器、いわゆるフォトンボックスにより取り囲まれている
。温度を高温計により測定し、2.75mの波長でのウェーハの裏面からの放出
を検出する。
【0015】 図1において、高温システムの略示図が示されている。石英反応容器2を、ガ
スインゼクタ領域中で700℃まで抵抗加熱する。5.0等級の水素ガス4およ
び酸素ガス6は、質量流量制御器8および10により制御される。水素および酸
素の自己発火は、反応容器2中で650℃を上回る温度で起こる。ガス混合物を
、2つの質量流量制御器8および10により制御し、2つの最大H2:O2比に制
限する。安全性を考慮することにより、化学量論的ではない1.67の水素:酸
素の比がもたらされるので、9%の過剰酸素を有する91%H2O蒸気の最大濃 度を全ガス流量に決めてよい。石英反応容器2は、任意の金属接点を有しない石
英コネクタ14により石英RTP反応器12に直接接続されている。反応容器2
とRTP反応器12との間の距離が短いことは、凝縮が起こらないことを保証し
ている。反応容器2とRTP反応器12との間において、標準プロセスガスシス
テム16は、石英コネクタ14に接続されている。
【0016】 全システムの制御は、SHS制御器18によりなされている。高温制御器20
は、SHS制御器18の従属装置として作用し、かつH2O蒸気は、設定および 読取り装置と共に標準のガス管路として使用されてよい。このことは、簡単な取
扱いを保証する。全ての安全機構、例えばフレームセンサ22、H2センサおよ びO2圧力制御器(示されていない)は、システム中に実現されている。
【0017】 湿式酸化の詳細な方法は、W. Lerch, Phys. Stat. Sol. 第(a) 158巻 117-136
(1996)により記載されているのと同じ基本構造を使用する。ガスの取扱は、乾 式酸化法と比較して僅かに違うだけである。全てのこれらの方法のためには、一
定温度の(50℃/s)の望ましい酸化温度までのランプアップ速度および(2
5℃/s)のランプダウン速度が使用される。加熱中のガス流量は、H2O 1 .82slmおよびO2 0.18slmの割合を有する2.0標準l/分(sta
ndard liters per minute; slm)であり、即ち91%(692トル(92.3
kPa))蒸気が、アイソクロナルアニールおよび等温アニール中に最大の酸化 物成長をもたらす。定常状態温度からのクールダウンを、純粋な窒素ガス雰囲気
中で行った。図2は、文献値と比較した2slmの一定流速での、1150℃で
30秒間(1150℃、30秒)のH2:O2比の関数としての酸化物の厚さの実
験的結果を示している。ウェーハは、直径200mm、<100>であり、p型
でホウ素でドープしてあり、抵抗率6〜18Ω・mを有していた。増大した酸化
物の厚さは、プロセスガス中のH2O蒸気の飽和およびドルトンの法則で計算し た分圧に直接に相関している。我々の場合の湿式法は、安全上の理由により91
%の蒸気中で運転し、最大成長速度を定義している。
【0018】 本明細書中に記載されている酸化物成長実験のためには、異なる種類の125
mmのCZウェーハを、第1表にまとめられているパラメータで使用した。
【0019】
【表1】
【0020】 異なる種類のウェーハの酸化条件は、0秒〜300秒のタイムスプリットで8
25℃〜1150℃に変化させた。0秒の方法は、ランプ中の酸化物成長の影響
と考えられる。これは、全プロセス中の酸化物成長から定常状態中の酸化物成長
を分離することを可能にする。従って、バッチ炉からの文献データとの比較は、
より信頼性がある。酸化物の厚さdを、1Åの測定精度および0.1Åの再現性
を有するPLASMOS楕円偏光測定器SD2300(屈折率n=1.465)
を用いて測定した。この誤差は無視できる。酸化物の厚さの計算される誤差は、
ウェーハ上の121ポイントでのそれぞれの測定の平均値からの標準偏差ならび
に0.6%のAST SHS2800e RTPシステムの代表的な再現性であ
る。全誤差は、個々の誤差の総和である。1.9%の平均均質性は、125mm
ウェーハについて全ての異なる時間および温度条件で達成された。均質性の更な
る最適化は、測定におけるより少ない誤差をもたらすにすぎない。
【0021】 200mmウェーハについて最適化された酸化プロセス(1150℃、30秒
;酸化物の平均厚さ522Å)は、1.7%の均質性(121ポイント)をもた
らした。4A/Kの感度および35.6Åの測定された酸化物範囲で、ウェーハ
全域で8.9℃の絶対温度範囲が計算されうる。湿式酸化の感度は、乾式酸化の
感度よりも数倍高く、酸化物の厚さで変化する。
【0022】 シリコン酸化は、上記で引用されているDealおよびGroveの線形−放物線の巨 視的な形式を用いてモデル化されている。高速熱酸化の物理的機構は、常用の炉
酸化とほとんど同じものである。それというのも、入射光子は、10-3秒以内に
そのエネルギーを、フォノンを経て200μmの厚さのシリコン固体に移動させ
るからである。以下において、酸化プロセスの特徴的データを論じる。図3にお
いて、酸化物の厚さd対酸化時間tの詳細で代表的なプロットを、<111>お
よび<100>オリエンテーションを有し、軽くドープしたp(B)型ウェーハ
で示してある。第2表において、異なるウェーハの種類の最大および酸化物の平
均厚さをまとめてある。また、比較のために、同じ乾式の高速熱酸化のデータを
つけ加えてある。
【0023】
【表2】
【0024】 酸化物成長速度に関連する酸化剤の流れの微分方程式のdの解は、初期の境界
条件t=0でd0=0では、線形−放物線の成長速度の関係をもたらす。
【0025】 d2+Ad=B(t+τ) (1) 式中、
【0026】
【数1】
【0027】 式中、C*はガス雰囲気中の平衡酸化剤濃度であり、N1は単位容量の成長する酸
化物に組み込まれた酸化剤の分子数であり、ksは酸化の化学界面反応速度定数 であり、hは酸化剤の気相輸送係数であり、Deffは酸化物中の酸化剤の有効拡 散係数である。
【0028】 dの時間依存は、式(1)から誘導されうるものであり、かつ2つの制限され
た場合は分離されうる。大きな時間では、放物線則が式(1)の解である。従っ
て、定数Bは放物線の速度定数と呼ばれる。この定数は酸化の拡散の制限された
場合(厚い酸化物の場合)を記載している。短い時間では、t>>A2/4B、 式(1)は、線形則
【0029】
【数2】
【0030】 に単純化される。線形速度定数は、次のようにして定義される:
【0031】
【数3】
【0032】 この成長速度は、更に界面で依存し、ksの値および界面での酸化剤の濃度によ り制限される。
【0033】 定数A、Bの数値の評価は、式(1)から導出されうる。生じたランピング酸
化物の厚さd0により低下した酸化物の全厚さd対量t/(d−d0)は、直線を
与える。切片は−Aに等しく、傾きはBに等しい(t=0)。単純化するために
、減少した酸化物の厚さdRは、dR=d−d0として定義されている。J. Appl.
Phys. 第31巻, 3436-3439 (1992)において乾式高速熱酸化を研究したFukuda他と
比較して、湿式酸化においてランプアップ/ランプダウン中に成長した測定され
た酸化物の全厚さは、定常状態の成長と比較されることを考慮しなければならな
い(例えばp(B)、(111)、2〜6Ωmのウェーハ:1150℃、0秒
0=137Å;965℃、0秒、d0=27Å)。図3からの(111)配向し
たウェーハの湿式酸化データは、このようにして図4にプロットされている。
【0034】 全ての他の研究されたウェーハのパラメータ(オリエンテーション、抵抗)お
よび温度には、直線が得られる。AおよびBの絶対値は、様々なウェーハの性質
を決定している。
【0035】 線形および放物線の成長速度定数対温度 図5において、(111)および(100)オリエンテーションを有し、p(
B)型で軽くドープしたウェーハの線形速度定数を、参考としてDealおよびGrov
eのデータと一緒にこの仕事からプロットしてある。p型ウェーハ(100)0 .01〜0.02Ω・cmからの付加的なデータは、図5に加えられている。こ
のアレニウス状態図から計算される活性化エネルギーは、(111)配向したウ
ェーハでは類似して(1.79+/−0.04)eVおよび(100)重くドー
プしたウェーハでは(1.77+/−0.03)eVである。これらの値は、1
分子当たり1.83eVであるSi−Si結合を破壊するのに必要なエネルギー
と近接して合致している(例えばL. Pauling, The Nature of the Chemical Bon
d, Cornell University Press, New York, 1960, 第3版, 第85頁参照)。ところ
が、DealおよびGroveは、1.95eV(640トル(85.3kPa)H2O)
を報告し、Fukuda他は乾式高速熱酸化で2.0eVを報告している。軽くドープ
した(100)データのためには、傾きはわずかに急であり、従って(2.10
+/−0.02)eVの活性化エネルギーをもたらす。従って、酸化物の成長は
、同じ熱履歴で緩慢になる。
【0036】 n(リンをドープした)型で、軽くドープした(111)および(100)配
向したウェーハに類似の、Dealと比較される活性化データが見出される。我々の
データを、図6においてDealのデータと一緒に示してある。(111)配向した
ウェーハの活性化エネルギーは、(2.03+/−0.03)eVであり、(1
00)配向したウェーハは、(2.04+/−0.02)eVである。(111
)および(100)オリエンテーションの間のB/Aの比は、Dealのデータにか
なり有利に対応している。p(ホウ素をドープした)型のウェーハおよびn(P
)型ウェーハの双方のアレニウスプロットは、バッチ炉のデータと、実装した高
温選択機構を有する我々のRTPシステムとの間で適正なフィットを提供する。
速度定数の物理的な意味のより深い洞察を得る1つの有用な方法は、時間の関数
としての酸化物の厚さをプロットすることである(式(1)から導出される)。
【0037】
【数4】
【0038】 これは高速熱酸化処理に特に重要である。線形則から放物線則への移行は、約
0.5μmの厚い酸化物層を有する炉プロセスに比較したのと同じく定義されて
いない。得られた全てのデータは、式(7)により記載されうる。例として、(
111)配向したn/p型のデータを図7において示してある。図7から、多く
のデータが、線形様式にあることは明らかである。線形挙動から放物線挙動への
移行は、正確に定義されないので、DealおよびGroveからの厚い酸化物データを 、図7に加えてある。これらのデータと一緒に、WRTOデータが、極めて長い
酸化時間の放物線成長則に従わないということを述べることができる。
【0039】 放物線速度定数対温度の温度依存を、図8において示してある。p(B)型の
データ(111)、ボックスA)を例として示してあり、すべてのその他の基板
は、同様の依存性を示している。通常、速度定数は、基板のドーピングプロセス
および酸化プロセス自体からは独立している。それというのも、制限された条件
が酸化剤の拡散率だからである。図8に示されているように、RTPシステム中
の蒸気酸化時間は、殊に825℃のデータの放物線成長をもたらさない(図7参
照)。DealおよびGroveの活性化エネルギーは、0.70eVである。10時間 の最大酸化時間と比較したWRTO時間は、120倍も短い。我々の場合に、界
面で酸化を制限された反応は、酸化を制限された拡散から分離される。Fukuda他
(1.74eV)からの乾式RTOデータでさえ、DealおよびGrove(1.12 3eV)よりも放物線成長速度定数の大きな活性化エネルギーをもたらす。
【0040】 線形成長速度定数対ドーピング濃度 文献中で酸化動力学が表されている最も多くのデータは、酸化温度で真性であ
り、軽くドープしたシリコン基板(抵抗が1Ω・cmよりも大きい)に当てはま
るにすぎない。重くドープした基板には、ドーピング増強酸化(Doping-Enhance
d Oxidation; DEO)効果が、Balkにより報告されているように、観察されて いる。図9において、1150℃でのドーピング濃度に関する線形速度定数を示
してある。エラーバーの内側で、顕著なDEO効果は何も表れていない。115
0℃での酸化物成長に関する温度の影響は、バルクのドーピング濃度よりも高い
のに対して、965℃での効果はそれとは逆である(図9)。Balkは、900℃
でB/A値の線形の増大(乾式酸化)および4×1019cm-3よりも高いリンド
ーパント濃度を述べている。DEO効果は、主として、増大したドーピング濃度
での線形成長速度の増大により引き起こされるのに対して、放物線成長速度は、
濃度間隔にわたり一定のままである。Balkは、より強く、より明瞭な、はるかに
高いドーピング濃度(>1020cm-3)の挙動を報告している。
【0041】 絶縁破壊特性 シリコン−二酸化ケイ素界面での湿式酸化の化学は、未だに完全に理解されて
いない(R.B. Fair, “Diffusion and oxidation of silicon” in MACROELECTR
ONICS PROCESSING: CHEMICAL ENGINEERING ASPECTS, Eds. Dennis W. Hess and
Klavs F. Jensen, American Chemical Society, Washington, 1989, 第265〜323
頁)。SiOHの電子受容体特性およびSiHの電子供与体挙動が、認められて
いる。従って、酸化の適切な制御および水素(水)に関連するアニーリング条件
は、良好な絶縁破壊特性を有する高品質の酸化物の技術において極めて重要な段
階である。シリコン上のSiO2薄膜中の水素の影響は、ReveszによりJ. Electr
ochem. Soc. 第126巻 122-130, (1979)に記載されている。
【0042】 欠陥を殆ど有しないより均質な酸化物のために、Dealはバッチ炉処理中に金属
汚染から保護するための少量のHClの添加を使用した。我々のRTPの結果は
、付加的なHClまたはTCAの技術が必要ないことを示している。先行する卓
越した絶縁破壊の結果は、このことを印象的に説明している。1050℃で24
0秒の純粋な乾式酸化は、0.51の欠陥密度(DD)および99%の収率を有
する118Åの酸化物の厚さを与える(<0.1クーロン(キャパシタ1cm2 でのcm2)。1050℃で30秒間の純粋な湿式酸化は、97%の収率でDD =51を与える。我々の実験では、91%のH2O組成を有する1050℃で3 0秒間の湿式酸化プロセスおよび後酸化アニール(POA)を使用した。POA
は、薄膜中に残留する水素を追い出し、DDを低下させ、収率を増大させる。全
てのPOAの熱履歴は、1100℃で30秒であった。POAの間のガス雰囲気
の変化は、収率において僅かな差異をもたらす(POA(GOI I):100 % O2;POA(GOI II):90% N2および10% O2;POA(G
OI III)、POA(GOI IV):100% N2)。これらの実験は、 125mmのn(As)型エピ−ウェーハ(エピ層抵抗0.25Ω・cm、基板
抵抗5mΩ・cm)で実施する。酸化段階およびPOAの間に乾燥ガスでRTP
チャンバを適切にフラッシすることは、極めて重要である。我々が、750℃で
丁度10秒間チャンバをフラッシするのを試みた場合に、100% O2中のP OAに加えて湿った酸化物の収率は、100%から86%に低下した。フラッシ
ング段階は、チャンバの壁中に吸収された水素を除去するのに必要であると我々
は考えている。それ以外に、我々は酸化物中の水素を追い出すことを試みた場合
に、我々は、適切に除去することができなかった。それというのも、チャンバの
壁が水素源として作用するからである。以下に記載されている全ての実験のため
には、チャンバ温度を、湿式酸化温度から750℃へランプダウンし、チャンバ
を130秒間フラッシュした。ついで、温度をPOAの1100℃までランプア
ップして戻した。POAにおけるチャンバ中の水素分圧は、有利に1000pp
m未満、より有利に100ppm未満、最も有利に10ppm未満である。チャ
ンバをフラッシできるように乾燥酸素または窒素の流量中で制限した。130秒
は、チャンバ中のガスを4回交換するのに十分な時間であった。しかしながら、
POA段階における水素圧を減少させるのに必要な時間は、チャンバの壁から吸
収された水素を追い出すのに必要な時間に関連しうるのであり、かつ濃度が更な
る実験により決定すべきである同じ最大値未満である限り水素濃度の絶対値に深
く関係し得ないので、より多くの乾燥ガス流が、実質的にフラッシング時間を削
減することは明らかではない。この実験の実施は、本明細書により教示されてい
るように当業者には明瞭である。最小フラッシング時間の正確な時間−温度は、
当業者には明らかである実験法により見出されうる。
【0043】
【表3】
【0044】 RTP成長酸化物の誘電性は、現行のランプGOI(Gate Oxide Integrity;
ゲート酸化物の完全性)実験で研究されてきた。幾つかのウェーハ上のキャパシ
タの破壊特性は、図10において確率グラフ上に示されている。2つの欠損モー
ドが、W. BergholzによりMat. Sci. Eng. B4, 359-366 (1989)により示されてい
るように、このグラフ表示により同定されうる。5〜10C/cm-2の電荷密度
周辺で破壊の急激な増大は、本明細書中で使用されている材料中で真性の誘電性
SiO2破壊に典型的である。酸化物中の弱点の指標である幾つかの摩耗破壊の みが、この真性の破壊に先行して見出されうる。前破壊から生じる欠陥密度が計
算され、0.25cm-2未満である。この研究において使用されているエピタキ
シャルウェーハ上の熱酸化物は、酸化中に消費されるシリコン中の低い欠陥密度
のために極めて高いゲート酸化物の品質のポテンシャルを有することが公知であ
る。図10に示されている結果は、バッチ炉心管(furnace tube)中で達成される
ゲート酸化物品質に匹敵する。エピタキシャルウェーハは、最高の結晶完全性、
ひいては欠陥を誘導した方法に関連して最高の感受性試験を提供するので、我々
のRTP蒸気酸化法が、最先端の技術の高品質な酸化物を生じさせることができ
ると我々は結論づけた。
【0045】 SiO2、シリコンおよびシリコンもしくは他の基板上の他の薄膜の高速熱化 学気相成長(RT−CVD)は、典型的には、必要とされる薄膜を生じさせるた
めに、水素またはハロゲン含有ガスの絶縁破壊を用いる。また、チャンバ中に生
じるか、または薄膜中に残留した水素またはハロゲンが、薄膜特性を変化させう
ることは明らかである。従って、また、異なるガス中での後アニール(PA)は
、CVD反応に使用されるよりも必要である。この場合には、正しく選択された
パラメータを有するフラッシング段階がより良好な材料品質に有用である。
【0046】 図11は、本発明の方法のフローチャートである。示されているランプレート
が好ましいが、しかしウェーハに有害でなければ低くてよい。ランプレートは、
照度の均質性またはウェーハの均質性が増大するにつれて速くなってよい。段階
1110は、水蒸気の雰囲気中で酸化温度にランプアップしたウェーハの温度を
示している。温度は、選択的にランプアップされてよく、次いで水蒸気が導入さ
れる。段階1120は、1050℃で30秒間の湿式酸化段階である。段階11
30は、温度をフラッシング温度、この場合に750℃までランプダウンし、段
階1140は、このシステムを130秒間フラッシングすることを示している。
実験により見出されているように、選択的な時間および温度は、選択的にこの段
階で使用されてよい。段階1150において温度は1100℃に上昇し、段階1
160においてウェーハは、水素を含有しない雰囲気中で、30秒間、POAを
有する。段階1170において温度を750℃にランプダウンし、プロセスを段
階1180で終了する。
【0047】 複数の方法は、当業者には明白である。これらの中では、1つの活性ガスが、
RTPシステムにおいて加熱された半導体ウェーハの表面上に薄膜を堆積させる
かまたは成長させるためにチャンバ中で使用され、かつ異なるガスが、第二のガ
ス雰囲気中でウェーハを加熱することにより、生じた材料から第一ガスの活性成
分を追い出すのに使用される場合の方法である。より好ましい実施態様は、薄膜
または第二のガス雰囲気が、第一ガス処理と第二ガス処理との間にチャンバの適
切なフラッシングにより、第一ガスの成分により汚染されないことを確実にする
ことである。フラッシング段階の時間および温度は、上記に概説された方法に従
うことによるそれぞれの処理の実験により見出されうる。
【0048】 上記の同一視される米国特許および特許明細書ならびに上記で引用された参考
文献は、これにより本明細書に参考により含まれる。
【図面の簡単な説明】
【図1】 AST SHS2800e RTPシステム中に実装された高温蒸気発生器を
示す略図。
【図2】 文献値と比較した2slmの一定流速での、1150℃で30秒間(1150
℃、30秒)のH22割合の関数としての酸化物の厚さの実験結果をプロットし
た点を示す略図。
【図3】 蒸気中のシリコンのアイソクロナル酸化および等温酸化を示す線図(91%H 2 O、692トル(92.3kPa);黒塗りの記号はp(B)、(111)、2 〜6Ω・cm;白抜きの記号はp(B)、(100)、1.7〜12Ω・cm)
【図4】 p(B)、(111)、2〜6Ω・cmのシリコンの酸化定数の評価を示す線
図。
【図5】 線形速度定数B/Aが、軽く/重くドープし、p(B)型で(111)および
(100)配向したシリコンウェーハ上の湿式酸化の温度に依存していることを
示す線図。
【図6】 線形速度定数B/Aが、軽くドープし、n(P)型で(100)および(11
1)配向したシリコンウェーハ上の湿式酸化の温度に依存していることを示す線
図。
【図7】 異なる温度、時間で、(111)配向したウェーハならびに異なる基板の、蒸
気中で成長する酸化物の酸化速度を示す線図。
【図8】 (111)配向したp(B)型ウェーハ(ボックスA、第1表)の放物線速度
定数Bの温度依存を示す線図。
【図9】 965℃および115℃で、線形速度定数が最初のドーピング濃度に依存して
いることを示す略図。
【図10】 n(As)型基板上のRTP成長酸化物の降伏特性を示す線図。
【図11】 本発明の方法を示すフローチャート。
【符号の説明】
2 石英反応容器、 4 水素ガス、 6 酸素ガス、 8、10 質量流量
制御器、 12 石英RTP反応器、 14 石英コネクタ、 16 標準処理
ガスシステム、 18 SHS制御器、 20 高温制御器、 22 フレーム
センサ
【手続補正書】特許協力条約第34条補正の翻訳文提出書
【提出日】平成12年4月14日(2000.4.14)
【手続補正1】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正内容】
【特許請求の範囲】
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ペーター ミュンツィンガー ドイツ連邦共和国 ノイ−ウルム ハイン リッヒガッセ 11 (72)発明者 ゲオルク ロータース ドイツ連邦共和国 デュルメン ヴェゼラ ー シュトラーセ 37 Fターム(参考) 5F058 BA01 BC02 BF56 BF63 BH01 BJ01

Claims (7)

    【特許請求の範囲】
  1. 【請求項1】 RTPシステムにおける半導体ウェーハの表面上に薄膜を生
    じさせる方法において、 a)実質的に蒸気圧の第一の反応性ガスを含有する雰囲気中で、第一の温度T1 でウェーハを高速加工し;ついで b)第一の反応性ガスを実質的に含有しない雰囲気中で、第二の温度T2でウェ ーハを高速加工する ことを特徴とする、半導体ウェーハの表面上に薄膜を生じさせる方法。
  2. 【請求項2】 c)ウェーハ温度をT1から第三の温度T3に低下させ、その
    際、温度T3は、温度T1より実質的に低く; d)第一の反応性ガスを実質的に含有しないガスでシステムをフラッシングし;
    かつ e)ウェーハ温度をT2に上昇させる ことからなる段階を、段階aとbとの間に挿入する、請求項1記載の方法。
  3. 【請求項3】 RTPシステムにおける半導体ウェーハの酸化方法において
    、 a)実質的に蒸気圧の水蒸気を含有する雰囲気中で、第一の温度T1でウェーハ を高速加工し、 b)水蒸気を実質的に含有しない雰囲気中で、第二の温度T2でウェーハを高速 アニールする ことを特徴とする半導体ウェーハの酸化方法。
  4. 【請求項4】 段階bにおける水蒸気濃度が1000ppm未満である、請
    求項3記載の方法。
  5. 【請求項5】 段階bにおける水蒸気濃度が100ppm未満である、請求
    項4記載の方法。
  6. 【請求項6】 段階bにおける水蒸気濃度が10ppm未満である、請求項
    5記載の方法。
  7. 【請求項7】 c)ウェーハ温度をT1から第三の温度T3に低下させ、その
    際、温度T3は、温度T1より実質的に低く; d)水蒸気を実質的に含有しないガスでシステムをフラッシングし;かつ e)ウェーハ温度をT2に上昇させる ことからなる段階を含む、請求項3記載の方法。
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Families Citing this family (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TW200746302A (en) * 1997-03-05 2007-12-16 Hitachi Ltd Method of making semiconductor IC device
US6077751A (en) * 1998-01-29 2000-06-20 Steag Rtp Systems Gmbh Method of rapid thermal processing (RTP) of ion implanted silicon
US6291868B1 (en) 1998-02-26 2001-09-18 Micron Technology, Inc. Forming a conductive structure in a semiconductor device
NL1008749C2 (nl) * 1998-03-30 1999-10-05 Asm Int Werkwijze voor het chemisch behandelen van een halfgeleidersubstraat.
US6387777B1 (en) * 1998-09-02 2002-05-14 Kelly T. Hurley Variable temperature LOCOS process
US6255231B1 (en) * 1998-10-02 2001-07-03 Taiwan Semiconductor Manufacturing Co., Ltd Method for forming a gate oxide layer
KR100682190B1 (ko) 1999-09-07 2007-02-12 동경 엘렉트론 주식회사 실리콘 산질화물을 포함하는 절연막의 형성 방법 및 장치
US6171911B1 (en) * 1999-09-13 2001-01-09 Taiwan Semiconductor Manufacturing Company Method for forming dual gate oxides on integrated circuits with advanced logic devices
KR100653976B1 (ko) * 1999-12-30 2006-12-05 주식회사 하이닉스반도체 Goi평가용 실리콘 웨이퍼의 형성방법
US6417070B1 (en) 2000-12-13 2002-07-09 International Business Machines Corporation Method for forming a liner in a trench
US6727140B2 (en) * 2001-07-11 2004-04-27 Micron Technology, Inc. Capacitor with high dielectric constant materials and method of making
US6495428B1 (en) 2001-07-11 2002-12-17 Micron Technology, Inc. Method of making a capacitor with oxygenated metal electrodes and high dielectric constant materials
US7037730B2 (en) * 2001-07-11 2006-05-02 Micron Technology, Inc. Capacitor with high dielectric constant materials and method of making
JP3965167B2 (ja) * 2003-07-04 2007-08-29 東京エレクトロン株式会社 熱処理方法及び熱処理装置
US7385954B2 (en) * 2003-07-16 2008-06-10 Lucent Technologies Inc. Method of transmitting or retransmitting packets in a communication system

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4544418A (en) * 1984-04-16 1985-10-01 Gibbons James F Process for high temperature surface reactions in semiconductor material
US4791071A (en) * 1986-02-20 1988-12-13 Texas Instruments Incorporated Dual dielectric gate system comprising silicon dioxide and amorphous silicon
FR2605647B1 (fr) * 1986-10-27 1993-01-29 Nissim Yves Procede de depot en phase vapeur par flash thermique d'une couche isolante sur un substrat en materiau iii-v, application a la fabrication d'une structure mis
JPS6414025A (en) * 1987-06-15 1989-01-18 Nippo Co Ltd Bonding-section press drier for paper bag
US5059448A (en) * 1990-06-18 1991-10-22 Dow Corning Corporation Rapid thermal process for obtaining silica coatings
KR940009597B1 (ko) * 1991-08-22 1994-10-15 삼성전자 주식회사 반도체장치의 게이트산화막 형성법
US5498577A (en) * 1994-07-26 1996-03-12 Advanced Micro Devices, Inc. Method for fabricating thin oxides for a semiconductor technology
US5612249A (en) * 1996-05-14 1997-03-18 Advanced Micro Devices, Inc. Post-gate LOCOS

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