JP2001242917A - 車両内の駆動シーケンスの制御方法及びその装置，メモリ手段 - Google Patents

車両内の駆動シーケンスの制御方法及びその装置，メモリ手段

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JP2001242917A
JP2001242917A JP2000400603A JP2000400603A JP2001242917A JP 2001242917 A JP2001242917 A JP 2001242917A JP 2000400603 A JP2000400603 A JP 2000400603A JP 2000400603 A JP2000400603 A JP 2000400603A JP 2001242917 A JP2001242917 A JP 2001242917A
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ピッツアル フォルケル
Ralf Knitz
クニッツ ラルフ
Udo Schulz
シュルツ ウド
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Abstract

(57)【要約】 【課題】 車両内の駆動シーケンスの制御において，メ
モリの省スペース化及びバリアントのより大きな多様性
を実現する。 【解決手段】 データセットバリアントの同一あるいは
一致可能データを有する基本データセットがメモリ手段
に格納されており，データセットバリアントの非同一及
び／又は非一致データは，各データセットバリアントの
差分データセットに含まれており，予め設定されたバリ
アントに応じて，少なくとも１つのデータセットが各差
分データセット及び基本データセットの結合により設定
されて，車両内の駆動シーケンスが制御される。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は，車両の駆動シーケ
ンスの制御方法及びその装置，メモリ手段に関し，さら
に詳細には，少なくとも１つの制御ユニットによる車両
の駆動シーケンスの制御方法及びその装置，メモリ手段
及びその装置に関する。
【０００２】
【従来の技術】従来では，ドイツ公開公報ＤＥ４４３６
３７１Ａ１において，少なくとも１つのマイクロプロセ
ッサによる車両の内燃機関の制御方法及び装置が開示さ
れている。上記公報においては，第１のメモリ手段に，
少なくとも２つのデータセットを格納することができ
る。各データセットの優先メモリセルに，識別子を格納
することができる。このとき，各データセットは，車両
の各バリアント又は車両タイプの装備バリアントを表
す。かかる識別子により，バリアントのコード化が簡易
になり，各付属のデータセットの発見が容易になる。
【０００３】
【発明が解決しようとする課題】しかしながら，上記公
報においては，設置される各バリアントの全てのデータ
セットがメモリ手段に格納されるので，バリアント数の
増大に伴って，大きなメモリスペースやレイアウト面積
が必要となる。
【０００４】一方，例えばマイクロプロセッサやコント
ローラのアドレス空間によりメモリの大きさが制限され
る場合には，バリアントの多様性（即ち，格納されるデ
ータセット数）が限定されるという問題もある。このよ
うに，従来技術においては，様々な観点から好適な効果
を期待できない。
【０００５】したがって，本発明の目的は，上記課題を
解決し，メモリの省スペース化及びバリアントのより大
きな多様性を実現することが可能な新規かつ改良された
車両内の駆動シーケンスの制御方法及びその装置，メモ
リ装置を提供することにある。
【０００６】上記課題を解決するため，請求項１に記載
の発明では，少なくとも１つのプロセッサと少なくとも
１つのメモリ手段と具備する少なくとも１つの制御ユニ
ットを有し，前記メモリ手段に格納されている少なくと
も１つの予め設定可能なデータセットにより制御が実行
され，かつ前記制御の各バリアントが各データセットバ
リアントにより実現され，前記データセットバリアント
からデータセットが選択可能である，車両内の駆動シー
ケンスの制御方法であって，前記データセットバリアン
トの同一あるいは一致可能データを有する基本データセ
ットがメモリ手段に格納されており，前記データセット
バリアントの非同一及び／又は非一致データは，前記各
データセットバリアントの差分データセットに含まれて
おり，予め設定されたバリアントに応じて，少なくとも
１つのデータセットが各差分データセット及び基本デー
タセットの結合により設定されて，前記車両内の駆動シ
ーケンスが制御される，ことを特徴とする車両内の駆動
シーケンス制御方法が提供される。
【０００７】本項記載の発明では，メモリスペース需要
（レイアウト面積）を効果的に低減でき，メモリスペー
ス効率が向上する。さらに，マイクロプロセッサのアド
レス空間又は通常設定されるオンチップメモリの最大の
大きさでメモリの大きさが制限されても，バリアント多
様性あるいはデータセット数が増大する。従って，メモ
リスペースが同一であれば，より高いバリアント多様性
を得ることができる。また，基本データセットと，小さ
い領域の差分データセットを複数使用することで，バン
ドエンドプログラミングの際のプログラミング時間を著
しく低減することができる。差分データセットが各デー
タセットバリアントに応じて制御ユニットあるいは制御
装置の基本データセットと共に，例えばメモリ手段に格
納される場合には，１回のプログラミングしか必要とし
ないので，後続のプログラミング（例えばバンドエンド
プログラミング）及びその手間を回避することができ
る。
【０００８】上記課題を解決するため，請求項２に記載
の発明では，少なくとも１つのプロセッサと少なくとも
１つのメモリ手段と具備する少なくとも１つの制御ユニ
ットを有し，前記メモリ手段に格納されている少なくと
も１つの予め設定可能なデータセットにより制御が実行
され，かつ前記制御の各バリアントが各データセットバ
リアントにより実現され，前記データセットバリアント
からデータセットが選択可能である，車両内の駆動シー
ケンスの制御方法において，前記各データセットバリア
ントを比較することにより，少なくとも同一データ及び
／又は非同一及び／又は非一致データが求める工程と，
前記同一データから基本データセットを生成する工程
と，前記非同一及び／又は非一致データから前記各デー
タバリアントについて差分データセットを生成する工程
と，前記差分データセットから，前記データセットバリ
アントの前記差分データセットが選択されて，前記基本
データセットと結合されることにより，前記基本データ
セットと前記差分データセットからなる前記データセッ
トを提供する工程と，を有する，ことを特徴とする車両
内の駆動シーケンス制御方法が提供される。
【０００９】本項記載の発明では，メモリスペース需要
（レイアウト面積）を効果的に低減でき，メモリスペー
ス効率が向上する。さらに，マイクロプロセッサのアド
レス空間又は通常設定されるオンチップメモリの最大の
大きさでメモリの大きさが制限されても，バリアント多
様性あるいはデータセット数が増大する。従って，メモ
リスペースが同一であれば，より高いバリアント多様性
を得ることができる。また，基本データセットと，小さ
い領域の差分データセットを複数使用することで，バン
ドエンドプログラミングの際のプログラミング時間を著
しく低減することができる。差分データセットが各デー
タセットバリアントに応じて制御ユニットあるいは制御
装置の基本データセットと共に，例えばメモリ手段に格
納される場合には，１回のプログラミングしか必要とし
ないので，後続のプログラミング（例えばバンドエンド
プログラミング）及びその手間を回避することができ
る。
【００１０】また，請求項３に記載の発明のように，前
記一致可能データは，全てのデータセットバリアントの
予め設定可能な同一データにより代用される，如く構成
すれば，例えば物理平面におけるその差が無視できるよ
うなデータは，予め設定可能な同一データ内容により置
き換えられて，基本データセットに付加されるので，差
分データセット内のデータ内容をさらに減少させること
ができる。
【００１１】また，請求項４に記載の発明のように，前
記データセットバリアントは，同一構造を有する，如く
構成すれば，データセットバリアントのプログラミング
される最小のデータ内容を，差分データセットを形成す
るために比較することができる。
【００１２】また，請求項５に記載の発明のように，前
記差分データセットのデータは，各ワード幅に相当す
る，如く構成するのが好ましい。
【００１３】また，請求項６に記載の発明のように，前
記差分データセットのデータは，前記メモリ手段に書き
込み可能な最小単位に相当する，如く構成するのが好ま
しい。
【００１４】また，請求項７に記載の発明のように，さ
らに，メモリ手段に書き込み可能な最小単位を有するコ
ピーデータセットを生成する工程を有しており，前記最
小単位は，差分データセットのデータを具備すると共
に，前記コピーデータセットは，駆動シーケンスを制御
するためのデータセットを形成するために使用される，
如く構成するのが好ましい。
【００１５】また，請求項８に記載の発明のように，前
記基本データセット及び前記各差分データセットを結合
する際に，安全データが付加されると共に，前記形成さ
れたデータセットが安全データにより検査される，如く
構成すれば，基本データセット内の，差分データセット
のデータ内容の予約データ領域は，さらに安全データ
（例えばチェックサム値）が書き込まれるので，車両内
の駆動シーケンスを制御するのに使用可能な基本データ
セットと差分データセットとからなるデータセットを検
査することができる。
【００１６】また，請求項９に記載の発明のように，前
記差分データセットのデータが，制御ユニットの外部メ
モリ手段に格納されると共に，駆動シーケンス制御のデ
ータセットを形成するために，前記制御ユニットにロー
ドされる，如く構成することもできる。
【００１７】また，請求項１０に記載の発明のように，
前記メモリ手段内の基本データセット内で，前記データ
セットバリアント内の非同一及び／又は非一致データを
有するメモリ領域が，予め設定可能な値により占有され
る，如く構成するのが好ましい。
【００１８】上記課題を解決するため，請求項１１の記
載の発明では，少なくとも１つのプロセッサと少なくと
も１つのメモリ手段と具備し，前記メモリ手段に格納さ
れている少なくとも１つの予め設定可能なデータセット
により制御が実行され，かつ前記制御の各バリアントが
各データセットバリアントにより実現され，前記データ
セットバリアントからデータセットが選択可能である，
車両内の駆動シーケンスの制御装置であって，前記デー
タセットバリアントの同一あるいは一致可能データを有
する基本データセットがメモリ手段に格納されており，
前記データセットバリアントの非同一及び／又は非一致
データは，前記各データセットバリアントの差分データ
セットに含まれており，前記車両内の駆動シーケンスを
制御するための少なくとも１つのデータセットが，予め
設定されたバリアントに応じて，各差分データセット及
び基本データセットを結合することにより設定する手段
を有する，ことを特徴とする車両内の駆動シーケンス制
御制御ユニットが提供される。
【００１９】本項記載の発明では，メモリスペース需要
（レイアウト面積）を効果的に低減でき，メモリスペー
ス効率が向上する。さらに，マイクロプロセッサのアド
レス空間又は通常設定されるオンチップメモリの最大の
大きさでメモリの大きさが制限されても，バリアント多
様性あるいはデータセット数が増大する。従って，メモ
リスペースが同一であれば，より高いバリアント多様性
を得ることができる。また，基本データセットと，小さ
い領域の差分データセットを複数使用することで，バン
ドエンドプログラミングの際のプログラミング時間を著
しく低減することができる。差分データセットが各デー
タセットバリアントに応じて制御ユニットあるいは制御
装置の基本データセットと共に，例えばメモリ手段に格
納される場合には，１回のプログラミングしか必要とし
ないので，後続のプログラミング（例えばバンドエンド
プログラミング）及びその手間を回避することができ
る。
【００２０】上記課題を解決するため，請求項１２の記
載の発明では，少なくとも１つのプロセッサと少なくと
も１つのメモリ手段と具備する少なくとも１つの制御ユ
ニットを有し，前記メモリ手段に格納されている少なく
とも１つの予め設定可能なデータセットにより制御が実
行され，かつ前記制御の各バリアントが各データセット
バリアントにより実現され，前記データセットバリアン
トからデータセットが選択可能である，車両内の駆動シ
ーケンスの制御装置において，基本データセットと差分
データセットとからデータセットを形成する第１の手段
と，前記データセットバリアントを比較して，同一ある
いは一致可能データ，及び／又は非同一及び／又は非一
致データを求めると共に，少なくとも，前記同一あるい
は一致可能データから基本データセットを生成し，か
つ，前記非同一及び／又は非一致データから各データセ
ットバリアントの差分データセットを形成する，第２の
手段と，を有し，前記第１の手段は，基本データセット
と結合してデータセットを形成するための前記データセ
ットバリアントの差分データセットを，前記差分データ
セットから選択する，ことを特徴とする車両内の駆動シ
ーケンス制御方法が提供される。
【００２１】本項記載の発明では，メモリスペース需要
（レイアウト面積）を効果的に低減でき，メモリスペー
ス効率が向上する。さらに，マイクロプロセッサのアド
レス空間又は通常設定されるオンチップメモリの最大の
大きさでメモリの大きさが制限されても，バリアント多
様性あるいはデータセット数が増大する。従って，メモ
リスペースが同一であれば，より高いバリアント多様性
を得ることができる。また，基本データセットと，小さ
い領域の差分データセットを複数使用することで，バン
ドエンドプログラミングの際のプログラミング時間を著
しく低減することができる。差分データセットが各デー
タセットバリアントに応じて制御ユニットあるいは制御
装置の基本データセットと共に，例えばメモリ手段に格
納される場合には，１回のプログラミングしか必要とし
ないので，後続のプログラミング（例えばバンドエンド
プログラミング）及びその手間を回避することができ
る。
【００２２】上記課題を解決するため，請求項１３の記
載の発明では，格納されている少なくとも１つの予め設
定可能なデータセットにより制御が実施され，かつ前記
制御のバリアントがデータセットバリアントにより実現
され，前記データセットバリアントからデータセットが
選択可能である，車両内の駆動シーケンスの制御データ
を格納するメモリ手段であって，予め設定可能なバリア
ントに応じて車両内の駆動シーケンスを制御する少なく
とも１つのデータセットが，データセットバリアントの
差分データセットと基本データセットとの結合により設
定されると共に，前記基本データセットは，データセッ
トバリアントの少なくとも同一あるいは一致可能データ
を有し，かつ，前記差分データセットは，データセット
バリアントの非同一及び／又は非一致データを有してお
り，前記少なくとも基本データセットと少なくとも１つ
の差分データセットが格納される，ことを特徴とするメ
モリ手段が提供される。
【００２３】本項記載の発明では，メモリスペース需要
（レイアウト面積）を効果的に低減でき，メモリスペー
ス効率が向上する。さらに，マイクロプロセッサのアド
レス空間又は通常設定されるオンチップメモリの最大の
大きさでメモリの大きさが制限されても，バリアント多
様性あるいはデータセット数が増大する。従って，メモ
リスペースが同一であれば，より高いバリアント多様性
を得ることができる。また，基本データセットと，小さ
い領域の差分データセットを複数使用することで，バン
ドエンドプログラミングの際のプログラミング時間を著
しく低減することができる。差分データセットが各デー
タセットバリアントに応じて制御ユニットあるいは制御
装置の基本データセットと共に，例えばメモリ手段に格
納される場合には，１回のプログラミングしか必要とし
ないので，後続のプログラミング（例えばバンドエンド
プログラミング）及びその手間を回避することができ
る。
【００２４】
【発明の実施の形態】以下，本発明の好適な実施の形態
について，添付図面を参照しながら詳細に説明する。
尚，以下の説明及び添付図面において，同一の機能及び
構成を有する構成要素については，同一符号を付するこ
とにより，重複説明を省略する。
【００２５】（第１の実施の形態）まず，図１を参照し
ながら，第１の実施の形態にかかる制御装置の構成につ
いて説明する。なお，図１は，第１の実施の形態にかか
る制御装置の構成を概略的に示すブロック図である。
【００２６】まず，図１に示すように，本実施形態にか
かる制御装置１００は，シリアル入出力装置１１０，及
びパラレル入出力装置１０９を有する。シリアル入出力
装置１１０には，周辺装置１１１が，配線１１４を介し
てシリアルかつ双方向に接続されている。
【００２７】周辺装置１１１は，インテリジェントセン
サ装置又はアクチュエータ装置などの周辺装置，及びセ
ンサ装置とアクチュエータ装置とを具備する内蔵周辺装
置，あるいはシリアルインターフェイスを介して接続さ
れる制御装置，例えばアプリケーションの他の計算ユニ
ット又は制御ユニットが該当する。
【００２８】他の周辺装置（例えばセンサ装置）１１２
は，配線１１５を介して制御装置１００と一方向に接続
されており，例えば測定値又は既に処理あるいは選別さ
れている測定結果を制御装置に供給する。同様に，周辺
装置（例えば操作部材）１１３は，制御装置により入出
力装置１１０を介してシリアルに制御される。なお，配
線１１６は，一方向の信号伝達を示している。
【００２９】本実施形態にかかる制御装置は，上記シリ
アル接続と同様に，少なくとも１つのパラレル接続（入
出力装置）１０９を有する。入出力装置１０９には，周
辺装置１１７が，配線１２０を介して，パラレルかつ双
方向に接続される。かかるシステムは，例えば車両内の
バスシステムが該当し，パラレル接続可能なセンサ装
置，アクチュエータ装置，車両の他の制御装置及び制御
ユニットなどと接続される。
【００３０】同様に，周辺装置１１８は，配線１２１を
介して，一方向かつパラレルに制御装置に接続され，周
辺装置１１８から制御装置にのみ信号が伝達される。同
様に，周辺装置（例えばアクチュエータ装置）１１９
は，配線１２２を介して，パラレルかつ一方向で制御装
置１００に接続され，制御装置１００によってのみ操作
される。
【００３１】なお，上記周辺装置の設置は，選択的であ
って，制御装置あるいは車両内の他の制御装置の仕様に
応じて設置あるいは省略することができる。さらに，制
御装置内の他の装置も同様であり，各々車両内で制御装
置あるいは制御タスクに応じて変更することができる。
【００３２】また，プロセッサユニット１０３及び内部
メモリ１０２（例えばフラッシュメモリ又は内部レジス
タバンク）を具備する，少なくとも１つのマイクロコン
ピュータ１０１を有する。
【００３３】さらに，内部メモリ１０２は，不揮発性メ
モリ（例えば，フラッシュメモリ）として形成されてお
り，マイクロコンピュータ１０１内で内部導線システム
あるいはバスシステム１０４を介して，他の選択的な構
成装置１０５と相互に接続されている。付加的な装置１
０５は，例えば他のメモリ装置，例えばプロセス時間計
算の付加的なプロセッサユニット，入出力装置などが該
当する。
【００３４】このとき，マイクロコンピュータ１０１
は，少なくとも１つの制御装置内部の導線／バスシステ
ム１０７を介して，他の構成要素（即ち，入出力装置）
１０９，１１０と接続されている。また，制御装置１０
０は，他のメモリ手段１０６（例えば，ＥＥＰＲＯＭ又
はフラッシュＥＰＲＯＭ，ＥＰＲＯＭ又はＲＯＭなどの
不揮発性メモリ）を有しており，かかるメモリ手段１０
６はバスシステム１０７と接続されている。なお，メモ
リ装置は，ＥＥＰＲＯＭ，あるいは，フラッシュＥＰＲ
ＯＭであるのが好ましい。
【００３５】他の選択的な装置１０８は，例えば他のマ
イクロコンピュータ，プロセッサユニット，他のメモリ
手段，例えば温度監視用の内部センサ装置，少なくとも
１つのエネルギ供給装置などが該当する。
【００３６】本実施形態にかかる制御装置を使用して，
例えば駆動ユニット，ドライブトレイン（例えばトラン
スミッション，ブレーキ装置）を制御するため，あるい
は快適システム及び安全システムなどの，車両内の駆動
シーケンスが制御される。また，近年におけるＸ−バイ
−ワイヤシステムは，ステアリング制御，ブレーキ制
御，エンジン制御又はシャシ制御などに使用される。
【００３７】制御装置のソフトウェアは，主としてプロ
グラムコードとデータとに分けられる。適用の理由によ
り，データは，所定のアドレスから，それ自体完結して
格納される。データセットの内容は，車両本体，駆動さ
れる構成要素（例えばエンジン，及びエンジン特性量に
影響を与える部材）により決定される。各制御バリアン
ト数として統合される，１台の車両又は各種車両の可能
な装備バリアント，搭載バリアント及び他のバリアント
数は，実質的に，各種データセット，即ち，同一プログ
ラムコードあるいはプログラムコードの同一ブロックに
適合するデータセットバリアントを可能にする。
【００３８】また，マイクロコンピュータ１０１内のメ
モリ手段１０２は，不揮発性メモリ（例えばフラッシュ
メモリ）である。かかるメモリ手段１０２には，車両の
駆動シーケンスを制御するために必要な少なくとも１つ
のデータセット及びプログラムコードが格納される。ソ
フトウェアは，主としてプログラムコードとデータに分
けられる。
【００３９】次に，図２に基づいて，本実施形態にかか
る第１のデータセットバリアントについて説明する。な
お，図２は，本実施形態にかかる第１のデータセットバ
リアントＤＶ１の構成を示すブロック図である。
【００４０】まず，図２には，第１のデータセットバリ
アントＤＶ１において，メモリ１０２内のメモリスペー
スの占有範囲２００が示されている。なお，メモリスペ
ースの占有範囲２００は，一例であり，メモリ１０２内
のプログラミングの最小単位の大きさにより異なる。
【００４１】例えばフラッシュメモリでは一般的である
ように，プログラミング単位が１ページである場合には
（ＭＰ：Ｍｅｍｏｒｙ Ｐａｇｅ），差分データを含む
ページ２０１〜２０８がアドレスされて，選択されなけ
ればならない。これは，後のデータセットを結合する際
に，かかる単位でしかプログラミングできないという理
由によるものである。
【００４２】一方，プログラミングの最小単位が，例え
ば１ワード，特に１バイト（即ち，８ビット）である場
合には，差分データはワード単位（即ち，例えばバイト
単位）で選択される。図２に示す各メモリページ（Ｍ
Ｐ）２０１〜２０９において，メモリページ２０１〜２
０８は，差分データ（例えば差分ワードあるいは差分バ
イトＢ）２１０〜２１４を有する。このメモリページ２
０１〜２０８に含まれる差分バイトＢは，非同一及び／
又は非一致差分データと見なされる。
【００４３】メモリページＭＰ２０９は，例えば非同一
ではあるが，同等とされる一致差分データを有するの
で，基本データセットＢＤに供給することができる。こ
のとき，データセットバリアントＤＶ１の領域２２５〜
２３２（及び２０９）は，同一及び／又は一致可能デー
タ内容を有する。即ち，領域２２５〜２３２は，データ
セットバリアントＤＶ１の基本データＤＶ１Ｂである。
【００４４】次に，図３に基づいて，本実施形態にかか
るデータセットバリアントＤＶ２を説明する。なお，図
３は，本実施形態にかかるデータセットバリアントＤＶ
２を示すブロック図である。
【００４５】まず，図３には，データセットバリアント
ＤＶ２の範囲は，ブロック３００で示される。メモリペ
ージＭＰ３０１〜３０５は，差分データあるいは差分バ
イトＢ３０７〜３２０を有する。メモリページＭＰ３０
６は，上記と同様に，各種データセットバリアントに関
して，非同一であるが一致可能データ内容を有する。従
って領域３２１〜３２６（及び３０６）は，上記と同様
に，同一及び／又は一致可能データ内容を有するので，
データセットバリアントＤＶ２の基本データＤＶ２Ｂを
形成する。
【００４６】次に，図４に基づいて，本実施形態にかか
る他のデータセットバリアントＤＶ３を説明する。な
お，図４は，本実施形態にかかる他のデータセットバリ
アントＤＶ３を示すブロック図である。
【００４７】まず，図４には，他のデータセットバリア
ントＤＶ３の範囲がブロック４００で示されている。メ
モリページＭＰ４０１〜４０５は，例えばバイトＢのワ
ード幅の差分データＢ４０７〜４１９を有する。メモリ
ページＭＰ４０６は，上記と同様に，１ページを示して
おり，残りのデータセットバリアントに関して非同一で
あるが一致可能なデータを有する。領域４２０〜４２５
（及び４０６）は，上記と同様に，同一及び／又は一致
可能データ内容を有するので，データセットバリアント
ＤＶ３の基本データＤＶ３Ｂを形成する。
【００４８】全てのデータセット（即ち，データセット
バリアントＤＶ１，ＤＶ２及びＤＶ３）は，同一データ
構造を有する（即ち，例えば特性曲線，マップ，固定値
及びその他のデータ構造は，同一アドレスで始まる）の
が好ましい。同様に，例えば特性曲線とマップの最大可
能な支持値点数が同一であるのが好ましい。
【００４９】なお，適用された支持値点数は，予め与え
られている最大可能な支持値点数とは異なることがで
き，各データセットバリアントに応じて固有に選択可能
あるいは変更可能である。
【００５０】この場合には，基本データセットと差分デ
ータセットを形成するために，データセット（データセ
ットバリアント）の表示値に基づいて，比較する際に，
複数のデータセットバリアントの値を同一である仮定す
る。
【００５１】なお，本実施形態においては，例えば１６
進数ファイルで示されるデータセットバリアントを例に
説明しているが，他の表示方法とすることもできる。こ
のとき，各データセットバリアントの比較される単位の
大きさは，自由に設定することができる。特にメモリス
ペースの理由から，ワード幅，特にバイトであるのが効
果的である。
【００５２】次に，図５に基づいて，ページ単位でプロ
グラミングされるメモリあるいはメモリ領域の基本デー
タセットあるいは差分データセットの形成するための第
１の方法について説明する。なお，図５は，ページ単位
でプログラミングされるメモリあるいはメモリ領域の基
本データセットあるいは差分データセットの形成する方
法を示すフローチャートである。なお，図５に示すデー
タセットバリアントＤＶ１，ＤＶ２及びＤＶ３は，図
２，３及び４に示すデータセットバリアントＤＶ１，Ｄ
Ｖ２及びＤＶ３と同様である。
【００５３】まず，図５に示すように，補助モジュール
５００が全てのデータセット（即ち，データセットバリ
アント）について，同一の１６進数値を有するアドレス
（例えば１６進数表示の場合）を検索し，基本データセ
ット５０２を形成する。
【００５４】かかる基本データセット５０２内では，同
一構造のデータセットバリアントＤＶ１，ＤＶ２及びＤ
Ｖ３間で，同一アドレス値が調節されている。基本デー
タセット５０２では，全ての異なるアドレス値は，予め
設定可能な値（例えばメモリ１０２の消去値）で充填さ
れる。したがって，上記のように，ページ単位でプログ
ラミング可能なメモリの場合には，メモリページＭＰあ
るいはその位置（メモリスペースｓ）は，メモリ（例え
ばフラッシュメモリ）の消去値で充填される。なお，各
メモリスペースｓは，各データセットバリアントのメモ
リページと同一番号にｓを付加しているので，メモリ１
０２の消去値で充填されたページは，ページ２０１ｓ〜
２０９ｓ，３０１ｓ〜３０６ｓ及び４０１ｓ〜４０６ｓ
である。
【００５５】１つのプログラムコードに属する全てのデ
ータセット（データセットバリアント）間の異なるデー
タ数をさらに減少させるためには，補助モジュール５０
０により，かかるデータあるいはデータ内容を予め設定
可能な同一データで覆うことであって，特に物理平面に
おける差は無視される。このとき，各種方法により実施
することができる。
【００５６】第１に，基本データセットＢＤと差分デー
タセットＤＤＳ１，ＤＤＳ２及びＤＤＳ３を形成する際
に，比較値の許容差を調節することができ，許容差内の
値は，予め設定された値（例えばデータセットバリアン
トの平均値又は実際値）を割り当てられる。マップにお
いては，例えば有用な補間方法を選択することにより，
修正値が得られる。同様に，各値をアクノレッジメント
により確認することができる。
【００５７】例えば２つの特性曲線あるいは同一値ある
いは修正値においては，例えば両特性曲線にわたって許
容誤差範囲が設けられる。同様に，１つの特性曲線を基
準特性曲線として選択し，その特性曲線上に許容誤差範
囲を設けることもできる。
【００５８】さらに，２つの特性曲線は，同一の座標シ
ステムに挿入され，まず第１の工程で，異なる特性曲線
の支持値点が修正される。このことにより，同一データ
構造が存在していない場合であっても，同一データ構造
が生成される。
【００５９】許容誤差範囲内の特性曲線の値は，両特性
曲線について同一の基本特性曲線を形成し，基本特性曲
線の同一値が基本データセットに格納される。なお，許
容誤差範囲外の特性曲線領域から，許容誤差範囲内の第
１の値の飛躍も考えられるが，補間ルーチンにより値間
で補間が実行されるため，実際には存在しない。
【００６０】上記に説明した支持値点の修正は，例えば
全ての支持値点を捨てることにより行われるが，データ
を削減することにはならない。したがって，例えば準線
形の特性曲線の所定領域が，例えば許容誤差範囲内で選
択されマーキングされる。その後，各始点と終点が支持
値点として選択され，始点と終点との間の残りの支持値
点は，データ削減のために省略することができる。従っ
て，一般に，始点，終点及びその間で補間を使用して，
特性曲線を特徴づけることにより，データを削減するこ
とができる。
【００６１】同様に，支持値点を検索あるいは調査する
ために，他のコンピュータ支援される最適化アルゴリズ
ム（最大許容偏差，支持値点数などの入力）を使用する
こともできる。
【００６２】上記好適な支持値点の調査及び／又はデー
タの修正方法により，差分データセット範囲を基本デー
タセットに付加されるので，データを減少させることが
できる。
【００６３】従って，同一構造の場合には，アドレスの
同一データ値は，基本データセット５０２の領域５０４
〜５２０に位置している（メモリスペース２０９ｓ，３
０６ｓ及び４０６ｓの一致可能データ）。
【００６４】基本データセットＢＤに対するデータセッ
トあるいはデータセットバリアントの異なるアドレスの
値については，補助モジュール５００により，各データ
セットあるいは各データセットバリアントに対するアド
レス情報や値情報が低減され，データセットバリアント
ＤＶ１，ＤＶ２及びＤＶ３に応じて差分データセットＤ
ＤＳ１，ＤＤＳ２及びＤＤＳ３としてメモリに格納され
る。
【００６５】かかる差分データセットＤＤＳ１，ＤＤＳ
２及びＤＤＳ３は，基本データセットＢＤと同一のメモ
リ１０２，あるいはマイクロコンピュータの外部メモリ
１０６，あるいは制御装置１００と通信配線を介して接
続される例えばアプリケーション装置の外部メモリなど
に格納することができる。
【００６６】また，基本データセットＢＤはマイクロコ
ンピュータあるいは制御装置内に残留し，各差分データ
セットＤＤＳ１，ＤＤＳ２，ＤＤＳ３は制御装置外部の
データ担体上に格納することもできる。このとき，安全
上の理由により，利用可能な完全なデータセットは，差
分データセットと基本データセットとを結合した後に使
用することができる。このことにより，基本データセッ
トの設定のみでは，制御装置が駆動しないようにするこ
とができる。
【００６７】また，安全上の理由から，基本データセッ
トＢＤ５０２をコピーして基本データセットＢＤ５０３
を形成し，同一メモリ，他のメモリ又は外部データ担体
上に格納することができる。
【００６８】また，フラッシュメモリ装置により，フラ
ッシュプログラミングの各種方法により形成されるが好
ましい。フラッシュセルのロード問題に基づいて，例え
ば消去される前のセルに何度も書き込むこと，あるいは
プログラミングすることは許可されない。従って，各プ
ログラミングプロセスの前には，消去プロセスが実行さ
れなければならない。このとき，フラッシュメモリの消
去は，セクション単位で，例えば３２キロバイトブロッ
クでしか実行することができない。
【００６９】一方，フラッシュメモリは，例えばメモリ
ページＭＰを含めて６４バイトの大きさのセグメントで
しかプログラミングすることができない。かかる６４バ
イトの大きさのメモリページＭＰが，プログラミング可
能な最小の大きさに相当する。このように，基本バリア
ントに加えてコピーデータセット５０１が生成されるよ
うに，基本バリアントを拡大することができる。
【００７０】フラッシュメモリの消去値で占有され，選
択される差分データセットの１又は２以上の値によりプ
ログラミングされる基本データセットに含まれる全ての
メモリページは，ページ番号と共にコピーデータセット
５０１に格納される。従って，コピーデータセットに
は，メモリページＭＰ１〜ＭＰｎが含まれる。
【００７１】本実施形態においては，データセットバリ
アントＤＶ１ではページ２０１〜２０９，データセット
バリアントＤＶ２では３０１〜３０６及びデータセット
バリアントＤＶ３では４０１〜４０６が該当する。ま
た，一致可能データ２０９，３０６及び４０６を有する
ページが結合される場合には，メモリデータセット５０
１には含まれない。
【００７２】従って，基本データセットにおいては，上
記と同様に，プログラミングするページ全体（例えば６
４バイト（セグメント））は，補助モジュール５００に
よりフラッシュメモリの消去値により占有される。コピ
ーデータセット５０１は，コピーデータセットを意図す
る概念においては，付加的なメモリを占有しない。
【００７３】このとき，補助モジュールにより，自由ペ
ージあるいはフラッシュメモリの消去値により占有され
ているページ（差分データセットが含まれていたペー
ジ）を有する基本データセットＢＤ５０２，アドレス情
報と差分データあるいは差分バイト又は差分ビットを含
む各差分データセットＤＤＳ１，ＤＤＳ２，ＤＤＳ３及
びコピーデータセット５０１が形成される。
【００７４】なお，補助モジュールは，後述するよう
に，制御ユニット１００の内部又は外部の独立した装置
あるいは制御ユニットとすることができ，あるいは機能
性をソフトウェア，制御装置１００あるいはマイクロコ
ンピュータ１０１又は外部の制御ユニット（例えばアプ
リケーション装置）が実行することもできる。
【００７５】次に，図６に基づいて，プログラミングの
最小単位がメモリあるいはメモリ領域のワード幅に相当
する場合の基本データセットと差分データセットの形成
方法を説明する。なお，図６は，プログラミングの最小
単位がメモリあるいはメモリ領域のワード幅に相当する
場合の基本データセットと差分データセットの形成方法
を説明するための説明図である。なお，図６に示すデー
タセットバリアントＤＶ１，ＤＶ２及びＤＶ３は，図
２，３及び４に示すデータセットバリアントＤＶ１，Ｄ
Ｖ２及びＤＶ３と同様である。
【００７６】まず，図６に示すように，補助モジュール
６００は，後述するように，基本データセットと差分デ
ータセットを形成する。なお，図５及び図６に示す補助
モジュール５００，６００は，ソフトウェアで実現する
ことができ，あるいはハードウェアで実現することもで
きる。
【００７７】メモリ（例えばフラッシュメモリ装置）
は，メモリページよりも小さい単位でプログラミングす
ることができる。このとき，ビット単位又はワード単位
あるいはバイト単位のプログラミングであると仮定す
る。
【００７８】一方，メモリ（例えばフラッシュメモリ）
の消去は，同様にセクション単位で行われる。このと
き，基本データセット６０１は，全てのデータを有す
る。データセットバリアントＤＶ１，ＤＶ２及びＤＶ３
の非同一及び／又は非一致データに該当しない基本デー
タＢＤの差分バイトＢの部分は，図２，３及び４と同
様，メモリページ番号にｓ（メモリスペース）を付加し
て示している。
【００７９】差分バイトあるいは差分データ（最小単位
は，同様に，１バイトよりも大きくてもよく，小さくて
もよい）の代わりに，領域２１０ｓ〜２２４ｓ，３０７
ｓ〜３２０ｓ及び４０６ｓ〜４１８ｓでは，メモリ消去
値あるいは他の予め設定される一義的に同定可能な値が
プログラミングされ，あるいはこれらの自由領域とさ
れ，プログラミングされない。
【００８０】このように，基本データＢＤには，上記領
域とは異なる領域が形成されている。差分データセット
ＤＤＳ１，ＤＤＳ２及びＤＤＳ３は，上記と同様に，ア
ドレス情報と差分データ（例えば差分バイトＢ）を有す
るように形成される。なお，ここでは，コピーデータセ
ットしない調査方法を説明したが，アドレッシングの理
由から，コピーセットを形成することもできる。
【００８１】次に，図７に基づいて，車両内の駆動シー
ケンスを制御するデータセットの形成方法を説明する。
なお，図７は，車両内の駆動シーケンスを制御するデー
タセットの形成方法を説明するための説明図である。
【００８２】まず，図７に示すように，コピーデータセ
ットと個別ワードプログラミングを有さずに，各差分デ
ータセットに格納されている差分ワードあるいは差分バ
イトを，基本データセットの該当領域に書き込むことが
できる。即ち，有効バイトＢ（即ち，差分バイトＢと結
合されたＤＤＳ１内のアドレスデータＡ）は，移行７０
４により，基本データセット７００のメモリ領域２１０
ｓに書き込まれる。
【００８３】図５及び図６に示される各バリアントに従
って基本データセット５０２，６０１に応じて基本デー
タＢＤが満たされる。基本データセット７００を有す
る，図６に示す上記例については，基本データセット７
００は基本データセット６０１に相当する。
【００８４】図７に示すバリアントを例にとると，ま
ず，コピーデータセット５０１から，移行７０１によ
り，好適なメモリページ（例えばメモリページ２０１）
に取り出される。さらに，移行７０２で示すように，付
属のアドレス情報（当然ながら，図６に示す方法よりも
短くすることができる）により，メモリページ２０１か
ら，差分バイトＢが，差分バイト２１０としてメモリペ
ージ２０１の付属領域に書き込まれる。
【００８５】図５に示したメモリは，ページ単位でしか
プログラミングできないので，移行７０３を介して，完
全なページ２０１は，差分バイト２１０と共に基本デー
タセット７００の好適なメモリ領域２０１Ｓに書き込ま
れる。
【００８６】このとき，基本データセット７００は，図
５に示す基本データセット５０２に該当する。選択され
た差分データセットは，本実施形態においては，差分デ
ータセットＤＤＳ１であるが，同様に差分データセット
ＤＤＳ２又はＤＤＳ３を選択することもできる。
【００８７】戻し伝達及びそれに伴う機能データセット
の形成は，他の補助モジュールにおいて，あるいは上記
の拡大された機能を有する補助モジュール５００及び６
００により，実行することができる。かかるデータセッ
トの形成は，制御装置自体内で実行することができる。
このとき，差分データセットは，マイクロコンピュータ
１０２のメモリ，他の制御装置メモリ１０６又は外部メ
モリに格納することができ，車両内の駆動シーケンスを
制御するデータセットを形成するために基本データセッ
トと結合することができる。
【００８８】また，メモリセルが基本データセット又は
メモリ１０６などの付加的なメモリ内でプログラミング
可能であり，かつ基本データセット上にどの差分データ
セット（アドレスに関する個別値）をプログラミングす
べきか，という情報を有するのが好ましい。
【００８９】設定されたあるいは予め設定可能なニュー
トラル値とは同一でない値が，エネルギ供給後に（即
ち，例えばスイッチオン又はリセット後に），例えば基
本データセット内の他のメモリセルにより，フラッシュ
プログラミングが未だ実行されていないこと，あるいは
完全に終了していること，が表示された場合には，自動
的に，制御装置内のメモリプログラムプロセスを開始さ
せる。
【００９０】安全上の理由から，上記セルは，一回だけ
書き込み可能であり，かつその後はロックされるように
構成することができる。このことにより，例えば電圧変
動あるいは電圧オフなどによりプログラミングプロセス
が中断した場合に，再始動の際に他の差分データセット
が選択されないことが保証される。
【００９１】また，フラッシュメモリがページ単位でし
か消去できない場合には，必ず，ビット的に１から０に
プログラミングされているデータを，一度，先にフラッ
シュメモリページ全体を消去してから，０から１へプロ
グラミングしなければならない。しかしながら，このこ
とにより消去値とは異なる基本データが最初に消失され
る。フラッシュメモリがページ単位でしか消去できない
場合には，例えば基本データセット内にメモリセルを提
供することにより対応することができる。
【００９２】かかるメモリセルは，最後に書き込まれ
て，定めるべき，あるいは設定可能なニュートラル値と
は異なる値の場合には，プログラミングプロセスが完全
に終了しているか否か，を表示する。
【００９３】したがって，プログラミングプロセスが中
断された場合でも，常に繰り返し初めから，選択された
差分データセットの，アドレスに関してプログラミング
すべき最初の値から始めることができる。これは，従前
に実施された変更は，メモリセルがその変更を表示しな
い間は，まだ有効とはならないからである。
【００９４】また，各データセット（即ち，基本データ
セット及び差分データセット）の検査を，例えば特徴的
なチェックサムあるいはチェックサム−トリム−バイト
により，例えば上記最後に書き込みされるメモリセル内
でプログラミング可能に実施することができる。このこ
とにより，チューニング防止（Ｔｕｎｉｎｇｓｃｈｕｔ
ｚ）とプログラミングを保全することができる。
【００９５】次に，図８に基づいて，本実施形態にかか
る差分データセットの構成を説明する。なお，図８は，
本実施形態にかかる差分データセットの構成を示すブロ
ック図である。
【００９６】まず，図８に示すように，ブロック８００
ではアドレス情報が表示され，ブロック８０１には利用
可能な差分バイトＢの総数あるいは数ＢＺの情報（本実
施形態では１０）が表示されている。各ブロックは，差
分バイトＢ１〜Ｂ１０で満たされており，全て同一ペー
ジあるいは同一アドレスブロックに位置している。
【００９７】アドレスブロックは，ブロック８０２内の
アドレス情報が示されており，有効バイトあるいは差分
バイトＢ８０３が示されている。ブロック８０４，８０
５，８０６，８０７も同様である。ブロック８０８は，
差分データセットの最後エンド−オフ−データＥＯＤを
表示している。
【００９８】また，図９に示すように，アドレス情報
は，完全なアドレスとして，あるいはメモリスペースを
節約する他の手段として，又はアドレスオフセットとし
て記載することができる。
【００９９】基本アドレスは，図９（ａ）に示すよう
に，例えばＡ１５〜Ａ３１の１７ビットを有する。アド
レスオフセットは，図９（ｂ）に示すように，同様にＡ
０〜Ａ１４の１５ビットを有する。このとき，可能な付
加ビットＺＡ１５は，長さ情報の識別子を設定してい
る。ＺＡ１５が二値のデータでハイあるいは１である場
合には，次の１６ビットは有効バイト数を表す。一方，
ＺＡ１５がローあるいは０である場合には，次のバイト
のみが有効バイトである。したがって，１バイトしか続
かない場合には，情報ＢＺを省略することができる。
【０１００】以上，本発明に係る好適な実施の形態につ
いて説明したが，本発明はかかる構成に限定されない。
当業者であれば，特許請求の範囲に記載された技術思想
の範囲内において，各種の修正例および変更例を想定し
得るものであり，それらの修正例および変更例について
も本発明の技術範囲に包含されるものと了解される。
【０１０１】
【発明の効果】メモリスペース需要（レイアウト面積）
を効果的に低減でき，メモリスペース効率が向上する。
さらに，マイクロプロセッサのアドレス空間又は通常設
定されるオンチップメモリの最大の大きさでメモリの大
きさが制限されても，バリアント多様性あるいはデータ
セット数が増大する。従って，メモリスペースが同一で
あれば，より高いバリアント多様性を得ることができ
る。また，基本データセットと，小さい領域の差分デー
タセットを複数使用することで，バンドエンドプログラ
ミングの際のプログラミング時間を著しく低減すること
ができる。差分データセットが各データセットバリアン
トに応じて制御ユニットあるいは制御装置の基本データ
セットと共に，例えばメモリ手段に格納される場合に
は，１回のプログラミングしか必要としないので，後続
のプログラミング（例えばバンドエンドプログラミン
グ）及びその手間を回避することができる。
【図面の簡単な説明】
【図１】本実施形態にかかる制御装置の構成を示すブロ
ック図である。
【図２】本実施形態にかかる第１のデータセットバリア
ントＤＶ１を示すブロック図である。
【図３】本実施形態にかかる第２のデータセットバリア
ントＤＶ２を示すブロック図である。
【図４】本実施形態にかかる第３のデータセットバリア
ントＤＶ３を示すブロック図である。
【図５】ページ単位でプログラミングされるメモリある
いはメモリ領域の基本データセットあるいは差分データ
セットの形成する方法を示すフローチャートである
【図６】プログラミングの最小単位がメモリあるいはメ
モリ領域のワード幅に相当する場合の基本データセット
と差分データセットの形成方法を説明するための説明図
である。
【図７】車両内の駆動シーケンスを制御するデータセッ
トの形成方法を説明するための説明図である。
【図８】本実施形態にかかる差分データセットの構成を
示すブロック図である。
【図９】本実施形態にかかる差分データの基本アドレス
とアドレスオフセットを示す説明図である。
【符号の説明】
１００ 制御装置 １０１ マイクロコンピュータ １０２ 内部メモリ １０３ プロセッサユニット １０４ バスシステム １０５ 付加的な装置 １０６ 他のメモリ手段 １０７ 導線／バスシステム １０８ 他の装置 １０９，１１０ 入出力装置 １１１，１１２，１１３ 周辺装置 １１４，１１５，１１６，１２１，１２２ 配線 １１７，１１８，１１９ 周辺装置 ５００ 補助モジュール ５０２ 基本データセット
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ウド ヴェルシング ドイツ連邦共和国 74211 ラインガルテ ン， ノルトハイマー シュトラーセ 31 (72)発明者 フォルケル ピッツアル ドイツ連邦共和国 73550 ヴァルトシュ テッテン／ヴィスゴールディンゲン， ウ ーラントシュトラーセ 21 (72)発明者 ラルフ クニッツ ドイツ連邦共和国 74321 ビーティッヒ ハイム−ビッシンゲン， トロッパウエル シュトラーセ 26 (72)発明者 ウド シュルツ ドイツ連邦共和国 71665 ファイヒンゲ ン／エンツ， コルンブルーメンヴェーク 34

Claims (13)

    【特許請求の範囲】
  1. 【請求項１】 少なくとも１つのプロセッサと少なくと
    も１つのメモリ手段と具備する少なくとも１つの制御ユ
    ニットを有し，前記メモリ手段に格納されている少なく
    とも１つの予め設定可能なデータセットにより制御が実
    行され，かつ前記制御の各バリアントが各データセット
    バリアントにより実現され，前記データセットバリアン
    トからデータセットが選択可能である，車両内の駆動シ
    ーケンスの制御方法であって，前記データセットバリア
    ントの同一あるいは一致可能データを有する基本データ
    セットがメモリ手段に格納されており，前記データセッ
    トバリアントの非同一及び／又は非一致データは，前記
    各データセットバリアントの差分データセットに含まれ
    ており，予め設定されたバリアントに応じて，少なくと
    も１つのデータセットが各差分データセット及び基本デ
    ータセットの結合により設定されて，前記車両内の駆動
    シーケンスが制御される，ことを特徴とする車両内の駆
    動シーケンス制御方法。
  2. 【請求項２】 少なくとも１つのプロセッサと少なくと
    も１つのメモリ手段と具備する少なくとも１つの制御ユ
    ニットを有し，前記メモリ手段に格納されている少なく
    とも１つの予め設定可能なデータセットにより制御が実
    行され，かつ前記制御の各バリアントが各データセット
    バリアントにより実現され，前記データセットバリアン
    トからデータセットが選択可能である，車両内の駆動シ
    ーケンスの制御方法において，前記各データセットバリ
    アントを比較することにより，少なくとも同一データ及
    び／又は非同一及び／又は非一致データが求める工程
    と，前記同一データから基本データセットを生成する工
    程と，前記非同一及び／又は非一致データから前記各デ
    ータバリアントについて差分データセットを生成する工
    程と，前記差分データセットから，前記データセットバ
    リアントの前記差分データセットが選択されて，前記基
    本データセットと結合されることにより，前記基本デー
    タセットと前記差分データセットからなる前記データセ
    ットを提供する工程と，を有する，ことを特徴とする車
    両内の駆動シーケンス制御方法。
  3. 【請求項３】 前記一致可能データは，全てのデータセ
    ットバリアントの予め設定可能な同一データにより代用
    される，ことを特徴とする請求項１又は２に記載の車両
    内の駆動シーケンス制御方法。
  4. 【請求項４】 前記データセットバリアントは，同一構
    造を有する，ことを特徴とする請求項１又は２に記載の
    車両内の駆動シーケンス制御方法。
  5. 【請求項５】 前記差分データセットのデータは，各ワ
    ード幅に相当する，ことを特徴とする請求項１又は２に
    記載の車両内の駆動シーケンス制御方法。
  6. 【請求項６】 前記差分データセットのデータは，前記
    メモリ手段に書き込み可能な最小単位に相当する，こと
    を特徴とする請求項１，２あるいは５項のうちいずれか
    １項に記載の車両内の駆動シーケンス制御方法。
  7. 【請求項７】 さらに，メモリ手段に書き込み可能な最
    小単位を有するコピーデータセットを生成する工程を有
    しており，前記最小単位は，差分データセットのデータ
    を具備すると共に，前記コピーデータセットは，駆動シ
    ーケンスを制御するためのデータセットを形成するため
    に使用される，ことを特徴とする請求項１又は２に記載
    の車両内の駆動シーケンス制御方法。
  8. 【請求項８】 前記基本データセット及び前記各差分デ
    ータセットを結合する際に，安全データが付加されると
    共に，前記形成されたデータセットが安全データにより
    検査される，ことを特徴とする請求項１又は２に記載の
    車両内の駆動シーケンス制御方法。
  9. 【請求項９】 前記差分データセットのデータが，制御
    ユニットの外部メモリ手段に格納されると共に，駆動シ
    ーケンス制御のデータセットを形成するために，前記制
    御ユニットにロードされる，ことを特徴とする請求項１
    又は２に記載の車両内の駆動シーケンス制御方法。
  10. 【請求項１０】 前記メモリ手段内の基本データセット
    内で，前記データセットバリアント内の非同一及び／又
    は非一致データを有するメモリ領域が，予め設定可能な
    値により占有される，ことを特徴とする請求項１又は２
    に記載の車両内の駆動シーケンス制御方法。
  11. 【請求項１１】 少なくとも１つのプロセッサと少なく
    とも１つのメモリ手段と具備し，前記メモリ手段に格納
    されている少なくとも１つの予め設定可能なデータセッ
    トにより制御が実行され，かつ前記制御の各バリアント
    が各データセットバリアントにより実現され，前記デー
    タセットバリアントからデータセットが選択可能であ
    る，車両内の駆動シーケンスの制御装置であって，前記
    データセットバリアントの同一あるいは一致可能データ
    を有する基本データセットがメモリ手段に格納されてお
    り，前記データセットバリアントの非同一及び／又は非
    一致データは，前記各データセットバリアントの差分デ
    ータセットに含まれており，前記車両内の駆動シーケン
    スを制御するための少なくとも１つのデータセットが，
    予め設定されたバリアントに応じて，各差分データセッ
    ト及び基本データセットを結合することにより設定する
    手段を有する，ことを特徴とする車両内の駆動シーケン
    ス制御制御ユニット。
  12. 【請求項１２】 少なくとも１つのプロセッサと少なく
    とも１つのメモリ手段と具備する少なくとも１つの制御
    ユニットを有し，前記メモリ手段に格納されている少な
    くとも１つの予め設定可能なデータセットにより制御が
    実行され，かつ前記制御の各バリアントが各データセッ
    トバリアントにより実現され，前記データセットバリア
    ントからデータセットが選択可能である，車両内の駆動
    シーケンスの制御装置において，基本データセットと差
    分データセットとからデータセットを形成する第１の手
    段と，前記データセットバリアントを比較して，同一あ
    るいは一致可能データ，及び／又は非同一及び／又は非
    一致データを求めると共に，少なくとも，前記同一ある
    いは一致可能データから基本データセットを生成し，か
    つ，前記非同一及び／又は非一致データから各データセ
    ットバリアントの差分データセットを形成する，第２の
    手段と，を有し，前記第１の手段は，基本データセット
    と結合してデータセットを形成するための前記データセ
    ットバリアントの差分データセットを，前記差分データ
    セットから選択する，ことを特徴とする車両内の駆動シ
    ーケンス制御方法。
  13. 【請求項１３】 格納されている少なくとも１つの予め
    設定可能なデータセットにより制御が実施され，かつ前
    記制御のバリアントがデータセットバリアントにより実
    現され，前記データセットバリアントからデータセット
    が選択可能である，車両内の駆動シーケンスの制御デー
    タを格納するメモリ手段であって，予め設定可能なバリ
    アントに応じて車両内の駆動シーケンスを制御する少な
    くとも１つのデータセットが，データセットバリアント
    の差分データセットと基本データセットとの結合により
    設定されると共に，前記基本データセットは，データセ
    ットバリアントの少なくとも同一あるいは一致可能デー
    タを有し，かつ，前記差分データセットは，データセッ
    トバリアントの非同一及び／又は非一致データを有して
    おり，前記少なくとも基本データセットと少なくとも１
    つの差分データセットが格納される，ことを特徴とする
    メモリ手段。
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