JP2000295044A - 出力回路 - Google Patents
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- G09G3/3614—Control of polarity reversal in general
Abstract
(57)【要約】
【課題】 スルーレートを向上させることができ、消費
電力を低減することができる出力回路を提供する。 【解決手段】 出力回路には、複数個の演算増幅器１が
設けられている。各演算増幅器１にスルーレート調整信
号ＢＩＡＳ＿Ｓを供給するバイアス回路２が設けられて
いる。また、各演算増幅器１の出力端には、相互に並列
に接続された２個のスイッチ素子３ａ及び３ｂが接続さ
れている。スイッチ素子３ａ及び３ｂは、例えば電界効
果トランジスタから構成されており、スイッチ素子３ａ
の抵抗値は、スイッチ素子３ｂの抵抗値の８０乃至１０
０倍程度である。更に、演算増幅器１の出力端に接続さ
れたスイッチ素子３ａ及び３ｂの他端には、抵抗素子４
及び容量素子５がこの順で直列に接続されている。スイ
ッチ素子３ａ及び３ｂと抵抗素子４との接続点（出力端
子）には、スイッチ素子６が接続されている。また、各
スイッチ素子６は相互に直列に接続されている。
電力を低減することができる出力回路を提供する。 【解決手段】 出力回路には、複数個の演算増幅器１が
設けられている。各演算増幅器１にスルーレート調整信
号ＢＩＡＳ＿Ｓを供給するバイアス回路２が設けられて
いる。また、各演算増幅器１の出力端には、相互に並列
に接続された２個のスイッチ素子３ａ及び３ｂが接続さ
れている。スイッチ素子３ａ及び３ｂは、例えば電界効
果トランジスタから構成されており、スイッチ素子３ａ
の抵抗値は、スイッチ素子３ｂの抵抗値の８０乃至１０
０倍程度である。更に、演算増幅器１の出力端に接続さ
れたスイッチ素子３ａ及び３ｂの他端には、抵抗素子４
及び容量素子５がこの順で直列に接続されている。スイ
ッチ素子３ａ及び３ｂと抵抗素子４との接続点（出力端
子）には、スイッチ素子６が接続されている。また、各
スイッチ素子６は相互に直列に接続されている。
Description
【０００１】
【発明の属する技術分野】本発明は、液晶表示装置のド
ット反転用駆動回路又はライン反転用駆動回路等として
使用される出力回路に関し、特に、低電力及び高スルー
レートの出力回路に関する。
ット反転用駆動回路又はライン反転用駆動回路等として
使用される出力回路に関し、特に、低電力及び高スルー
レートの出力回路に関する。
【０００２】
【従来の技術】液晶表示装置（ＬＣＤ）には、各ピクセ
ルに画像に応じた電圧を印加する駆動回路が設けられて
いる。例えば、特表平９−５０４３８９号公報に従来の
ドット反転用駆動回路が開示されている。図８は従来の
ドット反転用駆動回路の構成を示すブロック図である。
ルに画像に応じた電圧を印加する駆動回路が設けられて
いる。例えば、特表平９−５０４３８９号公報に従来の
ドット反転用駆動回路が開示されている。図８は従来の
ドット反転用駆動回路の構成を示すブロック図である。
【０００３】従来のドット反転用駆動回路には、複数個
の演算増幅器５１が設けられている。図８には、２個の
演算増幅器５１を示している。各演算増幅器５１の出力
端にはスイッチ素子５３が接続されている。スイッチ素
子５３の他端が駆動回路の出力端子となっている。全て
のスイッチ素子５３には、そのオン／オフを制御する制
御信号Ｓ５１が入力される。そして、各出力端子に抵抗
素子５４及び容量素子５５からなるパネル負荷が接続さ
れている。
の演算増幅器５１が設けられている。図８には、２個の
演算増幅器５１を示している。各演算増幅器５１の出力
端にはスイッチ素子５３が接続されている。スイッチ素
子５３の他端が駆動回路の出力端子となっている。全て
のスイッチ素子５３には、そのオン／オフを制御する制
御信号Ｓ５１が入力される。そして、各出力端子に抵抗
素子５４及び容量素子５５からなるパネル負荷が接続さ
れている。
【０００４】図９は従来のドット反転用駆動回路の動作
を示すタイミングチャートである。上述のように構成さ
れた従来のドット反転用駆動回路においては、スイッチ
素子５３がオフ状態となっているときにハイインピーダ
ンス状態で電圧が出力される。また、スイッチ素子５３
がオン状態となっているときに演算増幅器５１の出力電
圧がそのまま出力される。
を示すタイミングチャートである。上述のように構成さ
れた従来のドット反転用駆動回路においては、スイッチ
素子５３がオフ状態となっているときにハイインピーダ
ンス状態で電圧が出力される。また、スイッチ素子５３
がオン状態となっているときに演算増幅器５１の出力電
圧がそのまま出力される。
【０００５】また、ドット反転用駆動回路等に使用され
る演算増幅器が開示されている（特開平７−２２１５６
０号公報）。この公報に記載された従来の演算増幅器に
おいては、容量性負荷を充電する際に直流バイアス電圧
のレベルを下げて供給電流を大きくし、充電完了後に直
流バイアス電圧のレベルを上げることにより、平均消費
電力を低減している。
る演算増幅器が開示されている（特開平７−２２１５６
０号公報）。この公報に記載された従来の演算増幅器に
おいては、容量性負荷を充電する際に直流バイアス電圧
のレベルを下げて供給電流を大きくし、充電完了後に直
流バイアス電圧のレベルを上げることにより、平均消費
電力を低減している。
【０００６】
【発明が解決しようとする課題】しかしながら、特表平
９−５０４３８９号公報に記載された従来の駆動回路に
よれば、複数個の出力端子の短絡によりそれらの中間電
位が得られて消費電力を低減することは可能であるが、
演算増幅器には常に電流が供給されているので、全体的
な消費電流が高いという問題点がある。
９−５０４３８９号公報に記載された従来の駆動回路に
よれば、複数個の出力端子の短絡によりそれらの中間電
位が得られて消費電力を低減することは可能であるが、
演算増幅器には常に電流が供給されているので、全体的
な消費電流が高いという問題点がある。
【０００７】演算増幅器のみを特開平７−２２１５６０
号公報に記載されたものに置換すれば、全体的な消費電
力を低減することが可能なように見えるが、実際には出
力電圧に不要な発振、リンギングが発生したり、スルー
レートが低減してしまうという不具合が生じる。
号公報に記載されたものに置換すれば、全体的な消費電
力を低減することが可能なように見えるが、実際には出
力電圧に不要な発振、リンギングが発生したり、スルー
レートが低減してしまうという不具合が生じる。
【０００８】本発明はかかる問題点に鑑みてなされたも
のであって、スルーレートを向上させることができ、消
費電力を低減することができる出力回路を提供すること
を目的とする。
のであって、スルーレートを向上させることができ、消
費電力を低減することができる出力回路を提供すること
を目的とする。
【０００９】
【課題を解決するための手段】本発明に係る出力回路
は、演算増幅器と、この演算増幅器からの出力信号の立
ち上がり時及び立ち下がり時に前記演算増幅器に電流を
供給する電流供給手段と、前記演算増幅器と出力端子と
の間のインピーダンスを変化させるインピーダンス変化
手段と、を有することを特徴とする。
は、演算増幅器と、この演算増幅器からの出力信号の立
ち上がり時及び立ち下がり時に前記演算増幅器に電流を
供給する電流供給手段と、前記演算増幅器と出力端子と
の間のインピーダンスを変化させるインピーダンス変化
手段と、を有することを特徴とする。
【００１０】本発明においては、演算増幅器の出力の立
ち上がり時及び立ち下がり時に電流供給手段から電流が
演算増幅器に供給される。従って、立ち上がり又は立ち
下がりが行われないときには、演算増幅器への電流の供
給は下限まで低下可能である。また、立ち上がり又は立
ち下がり開始後にインピーダンス変化手段により出力端
子との間のインピーダンスを変化させて演算増幅器の負
荷を下げることにより、立ち上がり時及び立ち下がり時
のスルーレートが向上する。
ち上がり時及び立ち下がり時に電流供給手段から電流が
演算増幅器に供給される。従って、立ち上がり又は立ち
下がりが行われないときには、演算増幅器への電流の供
給は下限まで低下可能である。また、立ち上がり又は立
ち下がり開始後にインピーダンス変化手段により出力端
子との間のインピーダンスを変化させて演算増幅器の負
荷を下げることにより、立ち上がり時及び立ち下がり時
のスルーレートが向上する。
【００１１】なお、本発明においては、前記インピーダ
ンス変化手段は、前記演算増幅器と前記出力端子との間
に相互に並列に接続され抵抗値が相違する２個のスイッ
チ素子を有することができる。このとき、２個の前記ス
イッチ素子のうち抵抗値が高いスイッチ素子の抵抗値
は、抵抗値が低いスイッチ素子の抵抗値の８０乃至１０
０倍であることが望ましい。
ンス変化手段は、前記演算増幅器と前記出力端子との間
に相互に並列に接続され抵抗値が相違する２個のスイッ
チ素子を有することができる。このとき、２個の前記ス
イッチ素子のうち抵抗値が高いスイッチ素子の抵抗値
は、抵抗値が低いスイッチ素子の抵抗値の８０乃至１０
０倍であることが望ましい。
【００１２】また、前記インピーダンス変化手段は、前
記演算増幅器と前記出力端子との間に接続されたトラン
スファゲートスイッチを有することができる。このと
き、前記インピーダンス変化手段は、前記トランスファ
ゲートスイッチを構成する２個の電界効果トランジスタ
のゲート電圧を制御する制御素子を有することができ
る。
記演算増幅器と前記出力端子との間に接続されたトラン
スファゲートスイッチを有することができる。このと
き、前記インピーダンス変化手段は、前記トランスファ
ゲートスイッチを構成する２個の電界効果トランジスタ
のゲート電圧を制御する制御素子を有することができ
る。
【００１３】更に、前記出力端子には、液晶表示装置の
容量性負荷が接続されてもよい。この場合、例えばドッ
ト反転用駆動回路又はライン反転用駆動回路として使用
されることになる。
容量性負荷が接続されてもよい。この場合、例えばドッ
ト反転用駆動回路又はライン反転用駆動回路として使用
されることになる。
【００１４】更にまた、少なくとも１組の前記演算増幅
器、前記バイアス回路及び前記インピーダンス変化手段
を更に有し、複数個の前記出力端子を短絡する短絡手段
を有することができる。ドット反転用駆動回路として使
用される場合、出力端子の短絡によりそれらの中間電位
が得られることにより、消費電力がより一層低減され
る。
器、前記バイアス回路及び前記インピーダンス変化手段
を更に有し、複数個の前記出力端子を短絡する短絡手段
を有することができる。ドット反転用駆動回路として使
用される場合、出力端子の短絡によりそれらの中間電位
が得られることにより、消費電力がより一層低減され
る。
【００１５】
【発明の実施の形態】以下、本発明の実施例に係る出力
回路について、添付の図面を参照して具体的に説明す
る。図１は本発明の第１の実施例に係る出力回路の構成
を示すブロック図である。第１の実施例は、液晶表示装
置のドット反転用駆動回路として使用されるものであ
る。
回路について、添付の図面を参照して具体的に説明す
る。図１は本発明の第１の実施例に係る出力回路の構成
を示すブロック図である。第１の実施例は、液晶表示装
置のドット反転用駆動回路として使用されるものであ
る。
【００１６】第１の実施例には、複数個の演算増幅器１
が設けられている。各演算増幅器１にスルーレート調整
（ＳＲＣ）信号ＢＩＡＳ＿Ｓを供給するバイアス回路２
が設けられている。各演算増幅器１は、スルーレート制
御信号ＢＩＡＳ＿Ｓに関連づけてその増幅能力（増幅
率）を変化させる。
が設けられている。各演算増幅器１にスルーレート調整
（ＳＲＣ）信号ＢＩＡＳ＿Ｓを供給するバイアス回路２
が設けられている。各演算増幅器１は、スルーレート制
御信号ＢＩＡＳ＿Ｓに関連づけてその増幅能力（増幅
率）を変化させる。
【００１７】また、各演算増幅器１の出力端には、相互
に並列に接続された２個のスイッチ素子３ａ及び３ｂが
接続されている。スイッチ素子３ａ及び３ｂは、例えば
電界効果トランジスタから構成されており、オン抵抗を
有している。スイッチ素子３ａ及び３ｂの抵抗値は相違
しており、例えば、スイッチ素子３ａの抵抗値は２０ｋ
乃至３０ｋΩ程度であり、スイッチ素子３ｂの抵抗値は
２００乃至３００Ω程度である。スイッチ素子３ａに
は、そのオン／オフを制御する制御信号Ｓ１が入力さ
れ、スイッチ素子３ｂには、そのオン／オフを制御する
制御信号Ｓ２が入力される。
に並列に接続された２個のスイッチ素子３ａ及び３ｂが
接続されている。スイッチ素子３ａ及び３ｂは、例えば
電界効果トランジスタから構成されており、オン抵抗を
有している。スイッチ素子３ａ及び３ｂの抵抗値は相違
しており、例えば、スイッチ素子３ａの抵抗値は２０ｋ
乃至３０ｋΩ程度であり、スイッチ素子３ｂの抵抗値は
２００乃至３００Ω程度である。スイッチ素子３ａに
は、そのオン／オフを制御する制御信号Ｓ１が入力さ
れ、スイッチ素子３ｂには、そのオン／オフを制御する
制御信号Ｓ２が入力される。
【００１８】更に、演算増幅器１の出力端に接続された
スイッチ素子３ａ及び３ｂの他端には、抵抗素子４及び
容量素子５がこの順で直列に接続されている。抵抗素子
４及び容量素子５が液晶表示装置のパネル負荷となって
いる。スイッチ素子３ａ及び３ｂと抵抗素子４との接続
点（出力端子）には、スイッチ素子６が接続されてい
る。スイッチ素子６は、例えばトランスファゲートスイ
ッチである。スイッチ素子６には、そのオン／オフを制
御するスタンバイ（ＳＴＢ）信号Ｓ３が入力される。ま
た、各スイッチ素子６は相互に直列に接続されており、
その一端には他方の電極が接地された容量素子（図示せ
ず）の一電極が接続されている。
スイッチ素子３ａ及び３ｂの他端には、抵抗素子４及び
容量素子５がこの順で直列に接続されている。抵抗素子
４及び容量素子５が液晶表示装置のパネル負荷となって
いる。スイッチ素子３ａ及び３ｂと抵抗素子４との接続
点（出力端子）には、スイッチ素子６が接続されてい
る。スイッチ素子６は、例えばトランスファゲートスイ
ッチである。スイッチ素子６には、そのオン／オフを制
御するスタンバイ（ＳＴＢ）信号Ｓ３が入力される。ま
た、各スイッチ素子６は相互に直列に接続されており、
その一端には他方の電極が接地された容量素子（図示せ
ず）の一電極が接続されている。
【００１９】なお、ドット反転用であるため、隣り合う
パネル負荷に接続された出力端子同士は出力反転してい
る。
パネル負荷に接続された出力端子同士は出力反転してい
る。
【００２０】また、第１の実施例には、制御信号Ｓ１、
Ｓ２及びＳ３を制御する制御回路（図示せず）が設けら
れている。
Ｓ２及びＳ３を制御する制御回路（図示せず）が設けら
れている。
【００２１】図２は演算増幅器１の構成を示す回路図で
ある。演算増幅器１には、２本の信号線１１及び１２間
に接続された差動増幅回路１３が設けられている。差動
増幅回路１３の出力端には、ＮチャネルＭＯＳトランジ
スタ１４のゲート及び容量素子１５の一端が接続されて
いる。トランジスタ１４のソースは信号線１１に接続さ
れ、ドレインは容量素子１５の他端に接続されている。
トランジスタ１４のソースと容量素子１５の他端との接
続点１６から演算増幅器１の出力信号が出力される。ま
た、差動増幅回路１３又は接続点１６と信号線１２との
間には、夫々電流源１７又は１８が接続されている。図
３は電流源１７及び１８の具体例を示す回路図である。
ある。演算増幅器１には、２本の信号線１１及び１２間
に接続された差動増幅回路１３が設けられている。差動
増幅回路１３の出力端には、ＮチャネルＭＯＳトランジ
スタ１４のゲート及び容量素子１５の一端が接続されて
いる。トランジスタ１４のソースは信号線１１に接続さ
れ、ドレインは容量素子１５の他端に接続されている。
トランジスタ１４のソースと容量素子１５の他端との接
続点１６から演算増幅器１の出力信号が出力される。ま
た、差動増幅回路１３又は接続点１６と信号線１２との
間には、夫々電流源１７又は１８が接続されている。図
３は電流源１７及び１８の具体例を示す回路図である。
【００２２】例えば、差動増幅回路１３と信号線１２と
の間には、ゲートにＳＲＣ信号ＢＩＡＳ＿Ｓが入力され
るＮチャネルＭＯＳトランジスタ１７ａが電流源１７と
して接続され、接続点１６と信号線１２との間には、ゲ
ートにＳＲＣ信号ＢＩＡＳ＿Ｓが入力されるＮチャネル
ＭＯＳトランジスタ１８ａが電流源１８として接続され
る。
の間には、ゲートにＳＲＣ信号ＢＩＡＳ＿Ｓが入力され
るＮチャネルＭＯＳトランジスタ１７ａが電流源１７と
して接続され、接続点１６と信号線１２との間には、ゲ
ートにＳＲＣ信号ＢＩＡＳ＿Ｓが入力されるＮチャネル
ＭＯＳトランジスタ１８ａが電流源１８として接続され
る。
【００２３】このように構成された演算増幅器１におい
ては、容量素子１５の容量値をＣ、電流源１７を流れる
電流の値をＩとすると、そのスルーレートは（Ｃ／Ｉ）
に比例する。
ては、容量素子１５の容量値をＣ、電流源１７を流れる
電流の値をＩとすると、そのスルーレートは（Ｃ／Ｉ）
に比例する。
【００２４】次に、演算増幅器１の動作について説明す
る。図４は演算増幅器１の動作を示すタイミングチャー
トである。
る。図４は演算増幅器１の動作を示すタイミングチャー
トである。
【００２５】ＳＲＣ信号ＢＩＡＳ＿Ｓがオンとなる以前
は、トランジスタ１７ａに流れる電流は低く、出力信号
も低いものとなっている。この状態で、出力が上昇する
際、バイアスをオンしてトランジスタ１７ａに流れる電
流を大きくする。これにより、立ち上がりを早くでき
る。
は、トランジスタ１７ａに流れる電流は低く、出力信号
も低いものとなっている。この状態で、出力が上昇する
際、バイアスをオンしてトランジスタ１７ａに流れる電
流を大きくする。これにより、立ち上がりを早くでき
る。
【００２６】次いで、出力が上昇し、安定したところ
で、ＳＲＣ信号ＢＩＡＳ＿Ｓをオフしてやり、トランジ
スタ１７ａに流れる電流を小さくさせる。
で、ＳＲＣ信号ＢＩＡＳ＿Ｓをオフしてやり、トランジ
スタ１７ａに流れる電流を小さくさせる。
【００２７】次に、ＳＲＣ信号ＢＩＡＳ＿Ｓを再びオン
させてやり、トランジスタ１７ａに流れる電流を大きく
させる。
させてやり、トランジスタ１７ａに流れる電流を大きく
させる。
【００２８】そして、出力が下降し、安定したところで
ＳＲＣ信号ＢＩＡＳ＿Ｓを再びオフとさせ、トランジス
タ１７ａに流れる電流を小さくさせる。
ＳＲＣ信号ＢＩＡＳ＿Ｓを再びオフとさせ、トランジス
タ１７ａに流れる電流を小さくさせる。
【００２９】次に、上述のように構成された第１の実施
例の出力回路の動作について説明する。図５は本発明の
第１の実施例に係る出力回路の動作を示すタイミングチ
ャートである。また、下記表１は各期間における制御信
号のオン／オフを示すものである。
例の出力回路の動作について説明する。図５は本発明の
第１の実施例に係る出力回路の動作を示すタイミングチ
ャートである。また、下記表１は各期間における制御信
号のオン／オフを示すものである。
【００３０】
【表１】
【００３１】先ず、負荷リセット期間（期間Ａ）におい
て、ＳＲＣ信号ＢＩＡＳ＿Ｓをオン、制御信号Ｓ１及び
Ｓ２をオフ、ＳＴＢ信号Ｓ３をオンとする。これによ
り、出力端子が全て短絡され、パネル負荷に充電されて
いる電荷がリセットされる。このとき、前述のように隣
り合う出力端子同士が出力反転しているため、各出力端
子間で電荷の受け渡しが行われ、それらの電位は中間電
位となる。また、演算増幅器１においては、ＳＲＣ信号
ＢＩＡＳ＿Ｓが最初のオンとなっているため、増幅能力
が高く、そのスルーレートは高い。
て、ＳＲＣ信号ＢＩＡＳ＿Ｓをオン、制御信号Ｓ１及び
Ｓ２をオフ、ＳＴＢ信号Ｓ３をオンとする。これによ
り、出力端子が全て短絡され、パネル負荷に充電されて
いる電荷がリセットされる。このとき、前述のように隣
り合う出力端子同士が出力反転しているため、各出力端
子間で電荷の受け渡しが行われ、それらの電位は中間電
位となる。また、演算増幅器１においては、ＳＲＣ信号
ＢＩＡＳ＿Ｓが最初のオンとなっているため、増幅能力
が高く、そのスルーレートは高い。
【００３２】その後、高速書込期間（期間Ｂ）におい
て、ＳＲＣ信号ＢＩＡＳ＿Ｓをオンに保持したまま、制
御信号Ｓ１及びＳ２をオン、ＳＴＢ信号Ｓ３をオフに変
更する。ＳＴＢ信号Ｓ３がオフとなるので、出力端子の
短絡が解除される。また、制御信号Ｓ１及びＳ２がオン
となるので、演算増幅器１の負荷が低下する。更に、Ｓ
ＲＣ信号ＢＩＡＳ＿Ｓはオンのままであるので、出力電
圧が高速で変化する。
て、ＳＲＣ信号ＢＩＡＳ＿Ｓをオンに保持したまま、制
御信号Ｓ１及びＳ２をオン、ＳＴＢ信号Ｓ３をオフに変
更する。ＳＴＢ信号Ｓ３がオフとなるので、出力端子の
短絡が解除される。また、制御信号Ｓ１及びＳ２がオン
となるので、演算増幅器１の負荷が低下する。更に、Ｓ
ＲＣ信号ＢＩＡＳ＿Ｓはオンのままであるので、出力電
圧が高速で変化する。
【００３３】その後、制御信号Ｓ１及びＳ３を夫々オ
ン、オフに保持したまま、ＳＲＣ信号ＢＩＡＳ＿Ｓをオ
フ、制御信号Ｓ２をオフに変更する。ＳＲＣ信号ＢＩＡ
Ｓ＿Ｓがオフとなるので、演算増幅器１の増幅能力は下
限まで低下する。また、低抵抗のスイッチ素子３ｂのた
めの制御信号Ｓ２がオフとなるので、負荷が大きくな
り、出力電圧の発振が抑制される。
ン、オフに保持したまま、ＳＲＣ信号ＢＩＡＳ＿Ｓをオ
フ、制御信号Ｓ２をオフに変更する。ＳＲＣ信号ＢＩＡ
Ｓ＿Ｓがオフとなるので、演算増幅器１の増幅能力は下
限まで低下する。また、低抵抗のスイッチ素子３ｂのた
めの制御信号Ｓ２がオフとなるので、負荷が大きくな
り、出力電圧の発振が抑制される。
【００３４】このように、本実施例によれば、演算増幅
器１と出力端子との間のインピーダンスがスイッチ素子
３ａ及び３ｂにより２段階に変化することが可能である
ので、所望の出力電圧を高速に得ることが可能である。
即ち、スルーレートが高い。また、ドット反転用駆動回
路として出力電圧の上昇開始と共に出力端子同士を短絡
させることが可能であるので、中間電位を利用すること
により消費電力を低減することが可能である。
器１と出力端子との間のインピーダンスがスイッチ素子
３ａ及び３ｂにより２段階に変化することが可能である
ので、所望の出力電圧を高速に得ることが可能である。
即ち、スルーレートが高い。また、ドット反転用駆動回
路として出力電圧の上昇開始と共に出力端子同士を短絡
させることが可能であるので、中間電位を利用すること
により消費電力を低減することが可能である。
【００３５】なお、演算増幅器１と出力端子との間のイ
ンピーダンスを変化させることができない場合には、以
下のような不具合がある。例えば、スイッチ素子３ａが
設けられていない場合には、抵抗値が２００乃至３００
Ω程度のスイッチ素子３ｂのみが存在することになるの
で、出力電圧が上昇したときに発振が生じてしまう。一
方、例えば、スイッチ素子３ｂが設けられていない場合
には、抵抗値が２０ｋ乃至３０ｋΩ程度のスイッチ素子
３ａのみが存在することになるので、出力電圧の上昇が
遅くなり、スルーレートが低くなってしまう。
ンピーダンスを変化させることができない場合には、以
下のような不具合がある。例えば、スイッチ素子３ａが
設けられていない場合には、抵抗値が２００乃至３００
Ω程度のスイッチ素子３ｂのみが存在することになるの
で、出力電圧が上昇したときに発振が生じてしまう。一
方、例えば、スイッチ素子３ｂが設けられていない場合
には、抵抗値が２０ｋ乃至３０ｋΩ程度のスイッチ素子
３ａのみが存在することになるので、出力電圧の上昇が
遅くなり、スルーレートが低くなってしまう。
【００３６】なお、スイッチ素子３ａ及び３ｂの抵抗値
は上述のようなものに、特に限定されるものではなく、
演算増幅器１の利得に応じて設定することが可能であ
る。但し、発振の防止及び高スルーレートの確保のため
には、一方の抵抗値が他方の８０倍程度以上であること
が望ましい。また、実用性を考慮すると８０乃至１００
倍程度が適当である。
は上述のようなものに、特に限定されるものではなく、
演算増幅器１の利得に応じて設定することが可能であ
る。但し、発振の防止及び高スルーレートの確保のため
には、一方の抵抗値が他方の８０倍程度以上であること
が望ましい。また、実用性を考慮すると８０乃至１００
倍程度が適当である。
【００３７】また、第１の実施例には、２個のスイッチ
素子３ａ及び３ｂが設けられているが、インピーダンス
を少なくとも２段階に変化させることができれば、例え
ば１個のスイッチ素子が設けられていてもよい。ここ
で、１個のスイッチ素子によりインピーダンスを変化さ
せる第２の実施例について説明する。図６は本発明の第
２の実施例に係る出力回路の構成を示すブロック図であ
る。なお、図６に示す第２の実施例において、図１に示
す第１の実施例と同一の構成要素には、同一の符号を付
してその詳細な説明は省略する。また、演算増幅器１等
の繰り返し設けられているものは、１個のみを図示して
いる。
素子３ａ及び３ｂが設けられているが、インピーダンス
を少なくとも２段階に変化させることができれば、例え
ば１個のスイッチ素子が設けられていてもよい。ここ
で、１個のスイッチ素子によりインピーダンスを変化さ
せる第２の実施例について説明する。図６は本発明の第
２の実施例に係る出力回路の構成を示すブロック図であ
る。なお、図６に示す第２の実施例において、図１に示
す第１の実施例と同一の構成要素には、同一の符号を付
してその詳細な説明は省略する。また、演算増幅器１等
の繰り返し設けられているものは、１個のみを図示して
いる。
【００３８】第２の実施例においては、演算増幅器１と
抵抗素子４との間にＰチャネルＭＯＳトランジスタ７ａ
及びＮチャネルＭＯＳトランジスタ７ｂからなるトラン
スファゲートスイッチ７が接続されている。トランジス
タ７ａ又は７ｂのゲートには、夫々抵抗調整用電源（制
御素子）８ａ又は８ｂが接続されている。トランジスタ
７ａ又は７ｂのゲートには、夫々抵抗調整用電源８ａ又
は８ｂから電圧が供給され、各ゲート電圧は抵抗調整用
電源８ａ又は８ｂにより制御される。
抵抗素子４との間にＰチャネルＭＯＳトランジスタ７ａ
及びＮチャネルＭＯＳトランジスタ７ｂからなるトラン
スファゲートスイッチ７が接続されている。トランジス
タ７ａ又は７ｂのゲートには、夫々抵抗調整用電源（制
御素子）８ａ又は８ｂが接続されている。トランジスタ
７ａ又は７ｂのゲートには、夫々抵抗調整用電源８ａ又
は８ｂから電圧が供給され、各ゲート電圧は抵抗調整用
電源８ａ又は８ｂにより制御される。
【００３９】図７（ａ）は抵抗調整用電源８ａ及び８ｂ
における印加電圧の関係を示すグラフ図、（ｂ）は抵抗
要請用電源８ａの印加電圧とトランスファゲートスイッ
チ７の抵抗値との関係を示すグラフ図である。なお、図
７（ａ）において、実線は抵抗調整用電源８ａによる印
加電圧を示し、破線は抵抗調整用電源８ｂによる印加電
圧を示している。
における印加電圧の関係を示すグラフ図、（ｂ）は抵抗
要請用電源８ａの印加電圧とトランスファゲートスイッ
チ７の抵抗値との関係を示すグラフ図である。なお、図
７（ａ）において、実線は抵抗調整用電源８ａによる印
加電圧を示し、破線は抵抗調整用電源８ｂによる印加電
圧を示している。
【００４０】図７（ａ）に示すように、抵抗調整用電源
８ａによる印加電圧と抵抗調整用電源８ｂによる印加電
圧との和は常にＶDDとなっている。従って、抵抗調整用
電源８ａによる印加電圧が増加すれば、その増加分だけ
抵抗調整用電源８ｂによる印加電圧が低減する。そし
て、図７（ｂ）に示すように、抵抗調整用電源８ａによ
る印加電圧の増加及び抵抗調整用電源８ｂによる印加電
圧の低減に伴って、トランスファゲートスイッチ７のオ
ン抵抗が上昇する。
８ａによる印加電圧と抵抗調整用電源８ｂによる印加電
圧との和は常にＶDDとなっている。従って、抵抗調整用
電源８ａによる印加電圧が増加すれば、その増加分だけ
抵抗調整用電源８ｂによる印加電圧が低減する。そし
て、図７（ｂ）に示すように、抵抗調整用電源８ａによ
る印加電圧の増加及び抵抗調整用電源８ｂによる印加電
圧の低減に伴って、トランスファゲートスイッチ７のオ
ン抵抗が上昇する。
【００４１】従って、例えば、抵抗調整用電源８ａによ
る印加電圧が低い図７（ｂ）中の範囲Ｄと、抵抗調整用
電源８ａによる印加電圧が高い範囲Ｅとを２段階のイン
ピーダンスとして使用することが可能である。なお、図
７（ｂ）中の範囲Ｆでは、トランジスタ７ａ及び７ｂは
共にオフ状態となる。この状態を図５中の期間Ａで利用
すればよい。
る印加電圧が低い図７（ｂ）中の範囲Ｄと、抵抗調整用
電源８ａによる印加電圧が高い範囲Ｅとを２段階のイン
ピーダンスとして使用することが可能である。なお、図
７（ｂ）中の範囲Ｆでは、トランジスタ７ａ及び７ｂは
共にオフ状態となる。この状態を図５中の期間Ａで利用
すればよい。
【００４２】なお、インピーダンスを変化させる素子と
して１個のＭＯＳトランジスタを使用することも可能で
ある。この場合も、ゲート電圧を制御することによりオ
ン抵抗を少なくとも２段階に切替えることが可能であ
る。
して１個のＭＯＳトランジスタを使用することも可能で
ある。この場合も、ゲート電圧を制御することによりオ
ン抵抗を少なくとも２段階に切替えることが可能であ
る。
【００４３】また、前述の第１及び第２の実施例は、ド
ット反転用駆動回路として使用されるものであるが、ラ
イン反転用駆動回路として使用されてもよい。この場
合、隣り合う出力端子間での出力反転は行われないの
で、スイッチ素子６は不要である。
ット反転用駆動回路として使用されるものであるが、ラ
イン反転用駆動回路として使用されてもよい。この場
合、隣り合う出力端子間での出力反転は行われないの
で、スイッチ素子６は不要である。
【００４４】更にまた、これらは全て液晶表示装置の駆
動回路として使用するものであるが、その他の装置の出
力回路として使用することも可能である。この場合、出
力端子には、パネル負荷ではなくその用途に応じて種々
の回路が接続されることになる。
動回路として使用するものであるが、その他の装置の出
力回路として使用することも可能である。この場合、出
力端子には、パネル負荷ではなくその用途に応じて種々
の回路が接続されることになる。
【００４５】
【発明の効果】以上詳述したように、本発明によれば、
出力の立ち上がり時及び立ち下がり時に演算増幅器に電
流を供給する電流供給手段及び演算増幅器と出力端子と
の間のインピーダンスを変化させるインピーダンス変化
手段を設けているので、立ち上がり又は立ち下がり以外
の時には演算増幅器への電流の供給は不要となり、消費
電力を低減することができる。また、立ち上がり時及び
立ち下がり時の演算増幅器の負荷を下げることにより、
スルーレートを向上させることができる。従って、液晶
表示装置の駆動回路として使用した場合には、液晶表示
パネル上での消費電力の低減とそれによるパネルの長寿
命化を可能とすると共に、パネル上での多少の欠陥によ
る負荷増大に対しても立ち上がり及び立ち下がりを高速
化することにより歩留まりを向上させることができる。
出力の立ち上がり時及び立ち下がり時に演算増幅器に電
流を供給する電流供給手段及び演算増幅器と出力端子と
の間のインピーダンスを変化させるインピーダンス変化
手段を設けているので、立ち上がり又は立ち下がり以外
の時には演算増幅器への電流の供給は不要となり、消費
電力を低減することができる。また、立ち上がり時及び
立ち下がり時の演算増幅器の負荷を下げることにより、
スルーレートを向上させることができる。従って、液晶
表示装置の駆動回路として使用した場合には、液晶表示
パネル上での消費電力の低減とそれによるパネルの長寿
命化を可能とすると共に、パネル上での多少の欠陥によ
る負荷増大に対しても立ち上がり及び立ち下がりを高速
化することにより歩留まりを向上させることができる。
【図１】本発明の第１の実施例に係る出力回路の構成を
示すブロック図である。
示すブロック図である。
【図２】演算増幅器１の構成を示す回路図である。
【図３】電流源１７及び１８の具体例を示す回路図であ
る。
る。
【図４】演算増幅器１の動作を示すタイミングチャート
である。
である。
【図５】本発明の第１の実施例に係る出力回路の動作を
示すタイミングチャートである。
示すタイミングチャートである。
【図６】本発明の第２の実施例に係る出力回路の構成を
示すブロック図である。
示すブロック図である。
【図７】（ａ）は抵抗調整用電源８ａ及び８ｂにおける
印加電圧の関係を示すグラフ図、（ｂ）は抵抗要請用電
源８ａの印加電圧とトランスファゲートスイッチ７の抵
抗値との関係を示すグラフ図である。
印加電圧の関係を示すグラフ図、（ｂ）は抵抗要請用電
源８ａの印加電圧とトランスファゲートスイッチ７の抵
抗値との関係を示すグラフ図である。
【図８】従来のドット反転用駆動回路の構成を示すブロ
ック図である。
ック図である。
【図９】従来のドット反転用駆動回路の動作を示すタイ
ミングチャートである。
ミングチャートである。
１、５１；演算増幅器 ２；バイアス回路 ３ａ、３ｂ、６、５３；スイッチ素子 ４、５４；抵抗素子 ５、１５、５５；容量素子 ７；トランスファゲートスイッチ ７ａ、７ｂ、１４、１７ａ、１８ａ；ＭＯＳトランジス
タ ８ａ、８ｂ；抵抗調整用電源 １１、１２；信号線 １３；差動増幅回路 １６；接続点 １７、１８；電流源
タ ８ａ、８ｂ；抵抗調整用電源 １１、１２；信号線 １３；差動増幅回路 １６；接続点 １７、１８；電流源
───────────────────────────────────────────────────── フロントページの続き Ｆターム(参考） 5C006 AC27 AF52 BF25 BF34 BF37 FA14 FA33 FA47 5C080 AA10 BB05 DD24 DD26 DD29 FF09 JJ03 JJ04 JJ05 5J092 AA01 AA21 AA42 AA47 AA54 CA36 CA65 CA78 CA81 CA85 FA10 FA18 GR02 GR07 HA10 HA25 HA29 HA39 HA40 HA44 KA02 KA05 KA23 KA25 MA19 SA08 TA01 TA02 TA06 VM05 VM06
Claims (7)
- 【請求項１】 演算増幅器と、この演算増幅器からの出
力信号の立ち上がり時及び立ち下がり時に前記演算増幅
器に電流を供給する電流供給手段と、前記演算増幅器と
出力端子との間のインピーダンスを変化させるインピー
ダンス変化手段と、を有することを特徴とする出力回
路。 - 【請求項２】 前記インピーダンス変化手段は、前記演
算増幅器と前記出力端子との間に相互に並列に接続され
抵抗値が相違する２個のスイッチ素子を有することを特
徴とする請求項１に記載の出力回路。 - 【請求項３】 ２個の前記スイッチ素子のうち抵抗値が
高いスイッチ素子の抵抗値は、抵抗値が低いスイッチ素
子の抵抗値の８０乃至１００倍であることを特徴とする
請求項２に記載の出力回路。 - 【請求項４】 前記インピーダンス変化手段は、前記演
算増幅器と前記出力端子との間に接続されたトランスフ
ァゲートスイッチを有することを特徴とする請求項１に
記載の出力回路。 - 【請求項５】 前記インピーダンス変化手段は、前記ト
ランスファゲートスイッチを構成する２個の電界効果ト
ランジスタのゲート電圧を制御する制御素子を有するこ
とを特徴とする請求項４に記載の出力回路。 - 【請求項６】 前記出力端子には、液晶表示装置の容量
性負荷が接続されることを特徴とする請求項１乃至５の
いずれか１項に記載の出力回路。 - 【請求項７】 少なくとも１組の前記演算増幅器、前記
バイアス回路及び前記インピーダンス変化手段を更に有
し、複数個の前記出力端子を短絡する短絡手段を有する
ことを特徴とする請求項６に記載の出力回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09730099A JP3478989B2 (ja) | 1999-04-05 | 1999-04-05 | 出力回路 |
| TW089106176A TW538399B (en) | 1999-04-05 | 2000-04-01 | Output circuit |
| US09/541,596 US6496175B1 (en) | 1999-04-05 | 2000-04-03 | Output circuit |
| KR10-2000-0017554A KR100375259B1 (ko) | 1999-04-05 | 2000-04-04 | 출력 회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP09730099A JP3478989B2 (ja) | 1999-04-05 | 1999-04-05 | 出力回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2000295044A true JP2000295044A (ja) | 2000-10-20 |
| JP3478989B2 JP3478989B2 (ja) | 2003-12-15 |
Family
ID=14188651
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP09730099A Expired - Fee Related JP3478989B2 (ja) | 1999-04-05 | 1999-04-05 | 出力回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6496175B1 (ja) |
| JP (1) | JP3478989B2 (ja) |
| KR (1) | KR100375259B1 (ja) |
| TW (1) | TW538399B (ja) |
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| KR100712553B1 (ko) | 2006-02-22 | 2007-05-02 | 삼성전자주식회사 | 프레임 주파수에 따라 슬루율이 조절되는 소스 드라이버회로 및 소스 드라이버 회로에서 프레임 주파수에 따른슬루율 조절 방법 |
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| KR100790492B1 (ko) | 2005-07-01 | 2008-01-02 | 삼성전자주식회사 | 슬루 레이트를 제어하는 소스 드라이버 및 그것의 구동방법 |
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| JP2009008948A (ja) * | 2007-06-28 | 2009-01-15 | Nec Electronics Corp | データ線の駆動回路と駆動方法 |
| KR100893392B1 (ko) | 2007-10-18 | 2009-04-17 | (주)엠씨테크놀로지 | 전압 증폭 출력 회로 및 이를 이용하는 액정 표시 장치의구동 장치 |
| JP2009300866A (ja) * | 2008-06-16 | 2009-12-24 | Nec Electronics Corp | 駆動回路および表示装置 |
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| US7928953B2 (en) | 2005-03-29 | 2011-04-19 | Panasonic Corporation | Display driver circuit |
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| KR101378054B1 (ko) * | 2006-12-29 | 2014-03-27 | 엘지디스플레이 주식회사 | 액정표시장치 |
| JP2017181701A (ja) * | 2016-03-30 | 2017-10-05 | ラピスセミコンダクタ株式会社 | 表示ドライバ |
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