JP2000286271A - 半導体装置 - Google Patents
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Abstract
(57)【要約】
【課題】 半導体素子を基板に装着する際の接着剤の流
れ出しを防止する。 【解決手段】 基板2aの一面に形成された絶縁層4a
の半導体素子6a搭載領域を凹部13として形成する。
れ出しを防止する。 【解決手段】 基板2aの一面に形成された絶縁層4a
の半導体素子6a搭載領域を凹部13として形成する。
Description
【0001】
【発明の属する技術分野】本発明は半導体装置に係り、
更に詳細には、BGA(Ball Grid Array)型の半導体
装置に関するものである。
更に詳細には、BGA(Ball Grid Array)型の半導体
装置に関するものである。
【0002】
【従来の技術】近年、半導体集積回路の小型化、高集積
化に伴い、BGA型半導体装置が各社から提案されてい
る。図3にこのような半導体装置の一例を示す。
化に伴い、BGA型半導体装置が各社から提案されてい
る。図3にこのような半導体装置の一例を示す。
【0003】ここで示す半導体装置1は、絶縁性材料か
らなる基板2の半導体素子搭載面側に配線パターンが形
成されており、この配線パターンはその一部がボンディ
ングパッド3として機能し、また基板2の配線パターン
形成面のボンディングパッド3となる部分を除いた領域
には絶縁層4が形成されている。そして基板2のほぼ中
央部の絶縁層4上には、ペースト状接着剤5を介して半
導体素子6が装着されている。この半導体素子6の電極
パッド7と基板2上のボンディングパッド3とはボンデ
ィングワイヤ8によって電気的に接続され、また基板2
の半導体素子6搭載面側は、全面が封止樹脂9によって
樹脂封止されている。更に基板2の半導体素子6搭載面
の裏面側には外部接続端子ランド10が形成されてお
り、この外部接続端子ランド10は基板2の半導体素子
6搭載面とその裏面とを貫通するスルーホール11によ
ってボンディングパッド3と電気的に接続されている。
この外部接続端子ランド10には、半田ボールなどの外
部接続端子12が装着されている。このような半導体装
置1によれば、装置の小型化及び高集積化が図れるとと
もに、外部接続端子12として半田ボールなどを使用し
ているので、実装性も良好であるという利点がある。
らなる基板2の半導体素子搭載面側に配線パターンが形
成されており、この配線パターンはその一部がボンディ
ングパッド3として機能し、また基板2の配線パターン
形成面のボンディングパッド3となる部分を除いた領域
には絶縁層4が形成されている。そして基板2のほぼ中
央部の絶縁層4上には、ペースト状接着剤5を介して半
導体素子6が装着されている。この半導体素子6の電極
パッド7と基板2上のボンディングパッド3とはボンデ
ィングワイヤ8によって電気的に接続され、また基板2
の半導体素子6搭載面側は、全面が封止樹脂9によって
樹脂封止されている。更に基板2の半導体素子6搭載面
の裏面側には外部接続端子ランド10が形成されてお
り、この外部接続端子ランド10は基板2の半導体素子
6搭載面とその裏面とを貫通するスルーホール11によ
ってボンディングパッド3と電気的に接続されている。
この外部接続端子ランド10には、半田ボールなどの外
部接続端子12が装着されている。このような半導体装
置1によれば、装置の小型化及び高集積化が図れるとと
もに、外部接続端子12として半田ボールなどを使用し
ているので、実装性も良好であるという利点がある。
【0004】
【発明が解決しようとする課題】ここで前述した半導体
装置1においては、半導体素子6は絶縁層4上に接着剤
5を介して装着されるのであるが、この接着剤5として
は、通常ペースト状の樹脂系接着剤が使用されるため、
半導体素子6の装着時に、半導体素子6の外径を超えて
この接着剤5が流れ出してしまうという問題がある。と
ころで前述したように、この種の半導体装置1において
は、半導体素子6と配線パターンのボンディングパッド
3とはボンディングワイヤ8によって電気的に接続され
るため、半導体素子6の周囲にはボンディングパッド3
が設けられているのであるが、流れ出した接着剤5がボ
ンディングパッド3まで達してしまうと、ワイヤボンデ
ィングの際に支障を来してしまうので、従来はこれを防
止するため、図2に示すように、絶縁層4の半導体素子
6搭載領域は、半導体素子6の外径と比較してある程度
余裕を持った寸法の外径とせざるを得ず、これが半導体
装置1の外径のより一層の小型化を阻害する一因となっ
ていた。
装置1においては、半導体素子6は絶縁層4上に接着剤
5を介して装着されるのであるが、この接着剤5として
は、通常ペースト状の樹脂系接着剤が使用されるため、
半導体素子6の装着時に、半導体素子6の外径を超えて
この接着剤5が流れ出してしまうという問題がある。と
ころで前述したように、この種の半導体装置1において
は、半導体素子6と配線パターンのボンディングパッド
3とはボンディングワイヤ8によって電気的に接続され
るため、半導体素子6の周囲にはボンディングパッド3
が設けられているのであるが、流れ出した接着剤5がボ
ンディングパッド3まで達してしまうと、ワイヤボンデ
ィングの際に支障を来してしまうので、従来はこれを防
止するため、図2に示すように、絶縁層4の半導体素子
6搭載領域は、半導体素子6の外径と比較してある程度
余裕を持った寸法の外径とせざるを得ず、これが半導体
装置1の外径のより一層の小型化を阻害する一因となっ
ていた。
【0005】また、これに伴って半導体素子6とボンデ
ィングパッド3との距離が遠くなってしまうので、この
ためボンディングワイヤ8の長さが長くなってしまい、
その分材料コストが増大し、更に隣接するボンディング
ワイヤ8間に短絡が発生しやすくなってしまうといった
問題がある。更に、ワイヤ長の延長によりインダクタン
ス成分が大きくなり、半導体装置の電気的性能が悪化し
てしまうという問題もあった。
ィングパッド3との距離が遠くなってしまうので、この
ためボンディングワイヤ8の長さが長くなってしまい、
その分材料コストが増大し、更に隣接するボンディング
ワイヤ8間に短絡が発生しやすくなってしまうといった
問題がある。更に、ワイヤ長の延長によりインダクタン
ス成分が大きくなり、半導体装置の電気的性能が悪化し
てしまうという問題もあった。
【0006】
【課題を解決するための手段】上記の問題点を解決する
ために、本発明は、絶縁層上の半導体素子搭載領域を接
着剤の流れ出しを防止する構造とすることによって、半
導体素子搭載領域の外径を狭小化するものである。
ために、本発明は、絶縁層上の半導体素子搭載領域を接
着剤の流れ出しを防止する構造とすることによって、半
導体素子搭載領域の外径を狭小化するものである。
【0007】
【発明の実施の形態】本発明は、基板に形成された絶縁
層上に半導体素子が搭載されてなる半導体装置におい
て、絶縁層の半導体素子搭載領域は、少なくとも半導体
素子の外径よりも大きな外径を有する凹部として形成
し、この凹部内に半導体素子を搭載するものである。
層上に半導体素子が搭載されてなる半導体装置におい
て、絶縁層の半導体素子搭載領域は、少なくとも半導体
素子の外径よりも大きな外径を有する凹部として形成
し、この凹部内に半導体素子を搭載するものである。
【0008】なお凹部の形状としては、方形状や円形状
など、ペースト状接着剤の流れ出しを良好に防止できる
限りどのような形状にも形成可能である。また凹部の深
さについては、接着剤の流れ出しを防止するという本発
明の目的を良好に達成するためには、少なくとも0.0
05mm以上、好ましくは0.010mm以上とするの
が良い。
など、ペースト状接着剤の流れ出しを良好に防止できる
限りどのような形状にも形成可能である。また凹部の深
さについては、接着剤の流れ出しを防止するという本発
明の目的を良好に達成するためには、少なくとも0.0
05mm以上、好ましくは0.010mm以上とするの
が良い。
【0009】
【実施例】以下、本発明について、図面を参照しつつ説
明する。図1に示すような半導体装置1aを得るには、
まず、BTレジンなどの絶縁性材料からなる基板2aの
一面に、Cuなどの導電性金属により配線パターンを形
成する。それからこの配線パターン形成面のボンディン
グパッド3aとなる部分を除く領域を、ソルダーレジス
トなどの絶縁材料により被覆し、絶縁層4aを形成す
る。
明する。図1に示すような半導体装置1aを得るには、
まず、BTレジンなどの絶縁性材料からなる基板2aの
一面に、Cuなどの導電性金属により配線パターンを形
成する。それからこの配線パターン形成面のボンディン
グパッド3aとなる部分を除く領域を、ソルダーレジス
トなどの絶縁材料により被覆し、絶縁層4aを形成す
る。
【0010】次に絶縁層4aの半導体素子6aの搭載領
域となる部分を、グラインダーなどの研削工具により削
り、少なくとも半導体素子の外径よりも大きな外径を有
する凹部13を形成する。なお本実施例においては、凹
部13の外径は半導体素子の外径よりも0.1mm大き
く形成し、また0.04mmの厚さの絶縁層に対して
0.01mmの深さに形成している。そしてこの凹部1
3内に、エポキシ樹脂系ペーストなどの接着剤5aを介
して半導体素子6aを装着する。このとき凹部13の縁
部が接着剤5aの流れ出しを防止する堰として機能す
る。
域となる部分を、グラインダーなどの研削工具により削
り、少なくとも半導体素子の外径よりも大きな外径を有
する凹部13を形成する。なお本実施例においては、凹
部13の外径は半導体素子の外径よりも0.1mm大き
く形成し、また0.04mmの厚さの絶縁層に対して
0.01mmの深さに形成している。そしてこの凹部1
3内に、エポキシ樹脂系ペーストなどの接着剤5aを介
して半導体素子6aを装着する。このとき凹部13の縁
部が接着剤5aの流れ出しを防止する堰として機能す
る。
【0011】それから、半導体素子6aの電極パッド7
aとボンディングパッド3aとを、Au線などからなる
ボンディングワイヤ8aによって電気的に接続し、基板
2aの半導体素子6a搭載面側の全面を封止樹脂9aに
よって樹脂封止する。そして基板2aの半導体素子6a
搭載面側の裏面に形成された外部接続端子ランド10a
に、半田ボールからなる外部接続端子12aを装着す
る。なお、外部接続端子ランド10aとボンディングパ
ッド3aとは、基板2aを貫通する、壁面にCuなどの
導電性金属メッキが施されたスルーホール11aにより
電気的に接続されている。
aとボンディングパッド3aとを、Au線などからなる
ボンディングワイヤ8aによって電気的に接続し、基板
2aの半導体素子6a搭載面側の全面を封止樹脂9aに
よって樹脂封止する。そして基板2aの半導体素子6a
搭載面側の裏面に形成された外部接続端子ランド10a
に、半田ボールからなる外部接続端子12aを装着す
る。なお、外部接続端子ランド10aとボンディングパ
ッド3aとは、基板2aを貫通する、壁面にCuなどの
導電性金属メッキが施されたスルーホール11aにより
電気的に接続されている。
【0012】なお本実施例においては、凹部13の形成
をグラインダーによる研削加工にて行ったが、凹部13
の形成に際しては、その他の周知の機械的あるいは化学
的な方法が適用可能であることは言うまでもない。
をグラインダーによる研削加工にて行ったが、凹部13
の形成に際しては、その他の周知の機械的あるいは化学
的な方法が適用可能であることは言うまでもない。
【0013】
【発明の効果】本発明は、以上説明したような形態で実
施され、以下に記載されるような効果を奏する。
施され、以下に記載されるような効果を奏する。
【0014】基板上の絶縁層の半導体素子搭載領域を凹
部として形成しているので、半導体素子装着時に使用す
るペースト状接着剤の流れ出しを防止することができ、
これにより絶縁層の半導体素子搭載領域を狭小化できる
ので、その分半導体装置の外径を小型化することができ
る。
部として形成しているので、半導体素子装着時に使用す
るペースト状接着剤の流れ出しを防止することができ、
これにより絶縁層の半導体素子搭載領域を狭小化できる
ので、その分半導体装置の外径を小型化することができ
る。
【0015】また、これに伴ってボンディングワイヤ長
を短くできるので、その分コストを低減することができ
るとともに、隣接するボンディングワイヤ間での短絡を
抑止することができる。更に半導体装置の電気的性能の
悪化を防ぐことができ、更にまた凹部内に半導体素子を
搭載することにより、半導体装置を従来と比較して若干
薄く形成することが可能となる。
を短くできるので、その分コストを低減することができ
るとともに、隣接するボンディングワイヤ間での短絡を
抑止することができる。更に半導体装置の電気的性能の
悪化を防ぐことができ、更にまた凹部内に半導体素子を
搭載することにより、半導体装置を従来と比較して若干
薄く形成することが可能となる。
【図1】本発明の実施例を示す図。
【図2】従来の実施例を示す図。
【図3】従来の実施例を示す図。
1、1a 半導体装置 2、2a 基板 3、3a ボンディングパッド 4、4a 絶縁層 5、5a 接着剤 6、6a 半導体素子 7、7a 電極パッド 8、8a ボンディングワイヤ 9、9a 封止樹脂 10、10a 外部接続端子ランド 11、11a スルーホール 12、12a 外部接続端子 13 凹部
Claims (1)
- 【請求項1】 基板に形成された絶縁層上に半導体素子
が装着されてなる半導体装置において、絶縁層の半導体
素子搭載領域は、少なくとも半導体素子の外径よりも大
きな外径を有する凹部として形成され、この凹部内に半
導体素子が搭載されることを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11087235A JP2000286271A (ja) | 1999-03-29 | 1999-03-29 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11087235A JP2000286271A (ja) | 1999-03-29 | 1999-03-29 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2000286271A true JP2000286271A (ja) | 2000-10-13 |
Family
ID=13909184
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11087235A Pending JP2000286271A (ja) | 1999-03-29 | 1999-03-29 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2000286271A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6853089B2 (en) | 2001-09-18 | 2005-02-08 | Renesas Technology Corp. | Semiconductor device and method of manufacturing the same |
-
1999
- 1999-03-29 JP JP11087235A patent/JP2000286271A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6853089B2 (en) | 2001-09-18 | 2005-02-08 | Renesas Technology Corp. | Semiconductor device and method of manufacturing the same |
KR100918745B1 (ko) * | 2001-09-18 | 2009-09-24 | 가부시키가이샤 히타치세이사쿠쇼 | 반도체 장치 및 그 제조 방법 |
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