JP2000066637A - プラズマディスプレイパネルの階調表示方法 - Google Patents
プラズマディスプレイパネルの階調表示方法Info
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- JP2000066637A JP2000066637A JP10231654A JP23165498A JP2000066637A JP 2000066637 A JP2000066637 A JP 2000066637A JP 10231654 A JP10231654 A JP 10231654A JP 23165498 A JP23165498 A JP 23165498A JP 2000066637 A JP2000066637 A JP 2000066637A
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Abstract
(57)【要約】
【課題】 ＰＤＰの階調表示方法に関し、最小単位画素
を複数の画素で構成し、これら複数の画素の点灯数を段
階的に制御することにより、高い発光効率で、階調数の
多い、画質の優れたＰＤＰを実現する。 【解決手段】 一画素を構成するＲ，Ｇ，Ｂの最小単位
画素をそれぞれ複数の画素で構成し、これら複数の画素
の点灯数を段階的に制御することにより階調表示を行
う。
を複数の画素で構成し、これら複数の画素の点灯数を段
階的に制御することにより、高い発光効率で、階調数の
多い、画質の優れたＰＤＰを実現する。 【解決手段】 一画素を構成するＲ，Ｇ，Ｂの最小単位
画素をそれぞれ複数の画素で構成し、これら複数の画素
の点灯数を段階的に制御することにより階調表示を行
う。
Description
【０００１】
【発明の属する技術分野】この発明は、プラズマディス
プレイパネル（ＰＤＰ）の階調表示方法に関し、さらに
詳しくは、マトリクス表示方式のＰＤＰの階調表示方法
に関する。
プレイパネル（ＰＤＰ）の階調表示方法に関し、さらに
詳しくは、マトリクス表示方式のＰＤＰの階調表示方法
に関する。
【０００２】
【従来の技術および発明が解決しようとする課題】従来
のＰＤＰ（プラズマディスプレイパネル）の階調表示方
法としては、１フレームまたは１フィールド（以後単に
「１フィールド」という）の表示期間を、輝度の重み付
けの異なる複数のサブフィールドに分割し、分割したサ
ブフィールドの期間の点灯、非点灯によって各画素の輝
度をコントロールし階調表示する方法（フィールド内時
分割駆動法）や、表示の単位画素を複数のサブ画素で構
成し、それらサブ画素の点灯、非点灯によって各単位画
素の輝度をコントロールし階調表示する方法（ディザ
法）が知られている。
のＰＤＰ（プラズマディスプレイパネル）の階調表示方
法としては、１フレームまたは１フィールド（以後単に
「１フィールド」という）の表示期間を、輝度の重み付
けの異なる複数のサブフィールドに分割し、分割したサ
ブフィールドの期間の点灯、非点灯によって各画素の輝
度をコントロールし階調表示する方法（フィールド内時
分割駆動法）や、表示の単位画素を複数のサブ画素で構
成し、それらサブ画素の点灯、非点灯によって各単位画
素の輝度をコントロールし階調表示する方法（ディザ
法）が知られている。
【０００３】この発明は、より有効な階調表示の実現の
ためになされたもので、最小単位画素を複数の画素で構
成し、これら複数の画素の点灯数を段階的に制御するこ
とにより、高い発光効率で、階調数の多い、画質の優れ
たプラズマディスプレイパネルの階調表示方法を提供す
るものである。
ためになされたもので、最小単位画素を複数の画素で構
成し、これら複数の画素の点灯数を段階的に制御するこ
とにより、高い発光効率で、階調数の多い、画質の優れ
たプラズマディスプレイパネルの階調表示方法を提供す
るものである。
【０００４】
【課題を解決するための手段】この発明は、一画素を構
成するＲ，Ｇ，Ｂの最小単位画素をそれぞれ複数の画素
で構成し、これら複数の画素の点灯数を段階的に制御す
ることにより階調表示を行うことを特徴とするプラズマ
ディスプレイパネルの階調表示方法である。
成するＲ，Ｇ，Ｂの最小単位画素をそれぞれ複数の画素
で構成し、これら複数の画素の点灯数を段階的に制御す
ることにより階調表示を行うことを特徴とするプラズマ
ディスプレイパネルの階調表示方法である。
【０００５】
【発明の実施の形態】本発明の階調表示方法は、マトリ
クス表示方式のＰＤＰであれば、ＤＣ型、ＡＣ型、面放
電型、対向放電型、２電極構造、３電極構造等、いずれ
のＰＤＰであっても適用可能である。
クス表示方式のＰＤＰであれば、ＤＣ型、ＡＣ型、面放
電型、対向放電型、２電極構造、３電極構造等、いずれ
のＰＤＰであっても適用可能である。
【０００６】この発明においては、一画素を構成する
Ｒ，Ｇ，Ｂの最小単位画素を、それぞれ複数の画素で構
成する。この場合、最小単位画素を２画素、３画素、あ
るいはそれ以上の多数の画素で構成することができる
が、最小単位画素を多数の画素で構成する場合、画素の
縮小化に限界があるため、必然的に解像度が低下する。
したがって、最小単位画素は２画素程度で構成すること
が望ましい。
Ｒ，Ｇ，Ｂの最小単位画素を、それぞれ複数の画素で構
成する。この場合、最小単位画素を２画素、３画素、あ
るいはそれ以上の多数の画素で構成することができる
が、最小単位画素を多数の画素で構成する場合、画素の
縮小化に限界があるため、必然的に解像度が低下する。
したがって、最小単位画素は２画素程度で構成すること
が望ましい。
【０００７】例えば、最小単位画素を２画素で構成した
場合、フィールド内時分割駆動法を用いないとすると、
階調は、「両方の画素を点灯する（明明）」、「一方の
画素のみ点灯する（明）」、「両方の画素を消灯する
（暗）」の３階調とすることができる。
場合、フィールド内時分割駆動法を用いないとすると、
階調は、「両方の画素を点灯する（明明）」、「一方の
画素のみ点灯する（明）」、「両方の画素を消灯する
（暗）」の３階調とすることができる。
【０００８】一方、従来においては、通常、Ｒ，Ｇ，Ｂ
の最小単位画素は、それぞれ１画素で構成されているた
め、フィールド内時分割駆動法を用いないとすると、階
調は、「画素を点灯する（明）」、「画素を消灯する
（暗）」の２階調しかとれない。
の最小単位画素は、それぞれ１画素で構成されているた
め、フィールド内時分割駆動法を用いないとすると、階
調は、「画素を点灯する（明）」、「画素を消灯する
（暗）」の２階調しかとれない。
【０００９】このように、本発明においては、画素の点
灯数を段階的に制御することにより、従来よりも多くの
階調を表示することができる。
灯数を段階的に制御することにより、従来よりも多くの
階調を表示することができる。
【００１０】上記階調表示方法は、１フィールドを複数
のサブフィールドに分割し所望の画素を所望のサブフィ
ールドの期間点灯させるフィールド内時分割による階調
表示と組み合わせて用いることができる。
のサブフィールドに分割し所望の画素を所望のサブフィ
ールドの期間点灯させるフィールド内時分割による階調
表示と組み合わせて用いることができる。
【００１１】Ｒ，Ｇ，Ｂの最小単位画素が、それぞれ２
つの画素からなる場合、フィールド内時分割による階調
表示時に、２つの画素の一方が点灯される階調が連続し
て選択される際には、２つの画素を交互に点灯させて、
画面のチラつきを抑えるようにすることが望ましい。
つの画素からなる場合、フィールド内時分割による階調
表示時に、２つの画素の一方が点灯される階調が連続し
て選択される際には、２つの画素を交互に点灯させて、
画面のチラつきを抑えるようにすることが望ましい。
【００１２】以下、図面に示す実施の形態に基づいてこ
の発明を詳述する。なお、これによってこの発明が限定
されるものではない。
の発明を詳述する。なお、これによってこの発明が限定
されるものではない。
【００１３】図１は本発明に係るプラズマ表示装置の構
成図である。プラズマ表示装置１００は、マトリクス形
式のカラー表示デバイスであるＡＣ型のＰＤＰ１と、画
面（スクリーン）ＳＣを構成する縦横に並んだセルＣを
選択的に点灯させるための駆動ユニット８０とから構成
されており、壁掛け式テレビジョン受像機、コンピュー
タシステムのモニターなどとして利用される。
成図である。プラズマ表示装置１００は、マトリクス形
式のカラー表示デバイスであるＡＣ型のＰＤＰ１と、画
面（スクリーン）ＳＣを構成する縦横に並んだセルＣを
選択的に点灯させるための駆動ユニット８０とから構成
されており、壁掛け式テレビジョン受像機、コンピュー
タシステムのモニターなどとして利用される。
【００１４】ＰＤＰ１は、対をなす第１及び第２の主放
電用電極としてのサステイン電極Ｘ，Ｙが平行配置さ
れ、各セルＣにおいてサステイン電極Ｘ，Ｙと第３の電
極としてのアドレス電極Ａとが交差する３電極面放電構
造のＰＤＰである。サステイン電極Ｘ，Ｙは画面の行方
向（水平方向）に延び、一方のサステイン電極Ｙはアド
レッシングに際して行単位にセルＣを選択するためのス
キャン電極として用いられる。アドレス電極Ａは列方向
（垂直方向）に延びており、列単位にセルＣを選択する
ためのデータ電極として用いられる。サステイン電極群
とアドレス電極群とが交差する領域が表示領域、すなわ
ち画面ＳＣである。
電用電極としてのサステイン電極Ｘ，Ｙが平行配置さ
れ、各セルＣにおいてサステイン電極Ｘ，Ｙと第３の電
極としてのアドレス電極Ａとが交差する３電極面放電構
造のＰＤＰである。サステイン電極Ｘ，Ｙは画面の行方
向（水平方向）に延び、一方のサステイン電極Ｙはアド
レッシングに際して行単位にセルＣを選択するためのス
キャン電極として用いられる。アドレス電極Ａは列方向
（垂直方向）に延びており、列単位にセルＣを選択する
ためのデータ電極として用いられる。サステイン電極群
とアドレス電極群とが交差する領域が表示領域、すなわ
ち画面ＳＣである。
【００１５】駆動ユニット８０は、コントローラ８１、
フレームメモリ８２、データ処理回路８３、サブフィー
ルドメモリ８４、電源回路８５、Ｘドライバ８７、Ｙド
ライバ８８、及びアドレスドライバ８９を有している。
駆動ユニット８０には、ＴＶチューナ、コンピュータな
どの外部装置からＲ，Ｇ，Ｂの各色の輝度レベル（階調
レベル）を示す画素単位のフィールドデータＤｆが各種
の同期信号とともに入力される。
フレームメモリ８２、データ処理回路８３、サブフィー
ルドメモリ８４、電源回路８５、Ｘドライバ８７、Ｙド
ライバ８８、及びアドレスドライバ８９を有している。
駆動ユニット８０には、ＴＶチューナ、コンピュータな
どの外部装置からＲ，Ｇ，Ｂの各色の輝度レベル（階調
レベル）を示す画素単位のフィールドデータＤｆが各種
の同期信号とともに入力される。
【００１６】フィールドデータＤｆは、フレームメモリ
８２に一旦格納された後、データ処理回路８３へ送られ
る。データ処理回路８３は、階調表示を行うために１フ
ィールドを所定数のサブフィールドに分割し、その内の
点灯させるサブフィールドの組合せを設定するデータ変
換手段であり、フィールドデータＤｆに応じたサブフィ
ールドデータＤｓｆを出力する。サブフィールドデータ
Ｄｓｆはサブフィールドメモリ８４に格納される。サブ
フィールドデータＤｓｆの各ビットの値は、サブフィー
ルドにおけるセルの点灯の要否を示す情報、厳密にはア
ドレス放電の要否を示す情報である。
８２に一旦格納された後、データ処理回路８３へ送られ
る。データ処理回路８３は、階調表示を行うために１フ
ィールドを所定数のサブフィールドに分割し、その内の
点灯させるサブフィールドの組合せを設定するデータ変
換手段であり、フィールドデータＤｆに応じたサブフィ
ールドデータＤｓｆを出力する。サブフィールドデータ
Ｄｓｆはサブフィールドメモリ８４に格納される。サブ
フィールドデータＤｓｆの各ビットの値は、サブフィー
ルドにおけるセルの点灯の要否を示す情報、厳密にはア
ドレス放電の要否を示す情報である。
【００１７】Ｘドライバ８７はサステイン電極Ｘに駆動
電圧を印加し、Ｙドライバ８８はサステイン電極Ｙに駆
動電圧を印加する。アドレスドライバ８９は、サブフィ
ールドデータＤｓｆに応じてアドレス電極Ａに駆動電圧
を印加する。これらドライバには電源回路８５から所定
の電力が供給される。
電圧を印加し、Ｙドライバ８８はサステイン電極Ｙに駆
動電圧を印加する。アドレスドライバ８９は、サブフィ
ールドデータＤｓｆに応じてアドレス電極Ａに駆動電圧
を印加する。これらドライバには電源回路８５から所定
の電力が供給される。
【００１８】図２はＰＤＰの内部構造を示す斜視図であ
る。ＰＤＰ１は、前面側のガラス基板１１の内面に、行
Ｌ毎に二対ずつサステイン電極Ｘ，Ｙが配列されてい
る。行Ｌは画面における水平方向のセル列である。サス
テイン電極Ｘ，Ｙは、それぞれがＩＴＯからなる透明導
電膜４１とＣｒ−Ｃｕ−Ｃｒからなる金属膜（バス導
体）４２で形成され、低融点ガラスからなる厚さ３０μ
ｍ程度の誘電体層１７で被覆されている。誘電体層１７
の表面にはマグネシア（ＭｇＯ）からなる厚さ数千オン
グストロームの保護膜１８が設けられている。アドレス
電極Ａは、背面側のガラス基板２１の内面を覆う下地層
２２の上に配列されており、厚さ１０μｍ程度の誘電体
層２４によって被覆されている。誘電体層２４の上に
は、高さ１５０μｍの平面視直線帯状の隔壁２９が、各
アドレス電極Ａの間に１つずつ設けられている。これら
の隔壁２９によって放電空間３０が行方向にサブピクセ
ル（単位発光領域）毎に区画され、且つ放電空間３０の
間隙寸法が規定されている。そして、アドレス電極Ａの
上方及び隔壁２９の側面を含めて背面側の内面を被覆す
るように、カラー表示のためのＲ，Ｇ，Ｂの３色の蛍光
体層２８Ｒ，２８Ｇ，２８Ｂが設けられている。３色の
配置パターンは、１列のセルの発光色が同一で且つ隣接
する列どうしの発光色が異なるストライプパターンであ
る。なお、隔壁形成に際しては、コントラストを高める
ために頂上部を暗色に着色し、他の部分を白色に着色し
て可視光の反射率を高めるのが望ましい。着色は材料の
ガラスペーストに所定色の顔料を添加することにより行
う。
る。ＰＤＰ１は、前面側のガラス基板１１の内面に、行
Ｌ毎に二対ずつサステイン電極Ｘ，Ｙが配列されてい
る。行Ｌは画面における水平方向のセル列である。サス
テイン電極Ｘ，Ｙは、それぞれがＩＴＯからなる透明導
電膜４１とＣｒ−Ｃｕ−Ｃｒからなる金属膜（バス導
体）４２で形成され、低融点ガラスからなる厚さ３０μ
ｍ程度の誘電体層１７で被覆されている。誘電体層１７
の表面にはマグネシア（ＭｇＯ）からなる厚さ数千オン
グストロームの保護膜１８が設けられている。アドレス
電極Ａは、背面側のガラス基板２１の内面を覆う下地層
２２の上に配列されており、厚さ１０μｍ程度の誘電体
層２４によって被覆されている。誘電体層２４の上に
は、高さ１５０μｍの平面視直線帯状の隔壁２９が、各
アドレス電極Ａの間に１つずつ設けられている。これら
の隔壁２９によって放電空間３０が行方向にサブピクセ
ル（単位発光領域）毎に区画され、且つ放電空間３０の
間隙寸法が規定されている。そして、アドレス電極Ａの
上方及び隔壁２９の側面を含めて背面側の内面を被覆す
るように、カラー表示のためのＲ，Ｇ，Ｂの３色の蛍光
体層２８Ｒ，２８Ｇ，２８Ｂが設けられている。３色の
配置パターンは、１列のセルの発光色が同一で且つ隣接
する列どうしの発光色が異なるストライプパターンであ
る。なお、隔壁形成に際しては、コントラストを高める
ために頂上部を暗色に着色し、他の部分を白色に着色し
て可視光の反射率を高めるのが望ましい。着色は材料の
ガラスペーストに所定色の顔料を添加することにより行
う。
【００１９】放電空間３０には主成分のネオンにキセノ
ンを混合した放電ガスが充填されており（封入圧力は５
００Ｔｏｒｒ）、蛍光体層２８Ｒ，２８Ｇ，２８Ｂは放
電時にキセノンが放つ紫外線によって局部的に励起され
て発光する。表示の１ピクセル（画素）は行方向に並ぶ
３個のサブピクセルの２行分の集合で構成される。各サ
ブピクセル内の構造体がセル（表示素子）Ｃである。隔
壁２９の配置パターンがストライプパターンであること
から、放電空間３０のうちの各列に対応した部分は全て
の行Ｌに跨がって列方向に連続している。そのため、隣
接する行Ｌどうしの電極間隙（逆スリットと呼称されて
いる）の寸法は各行Ｌの面放電ギャップ（例えば８０〜
１４０μｍの範囲内の値）より十分に大きく、列方向の
放電結合を防ぐことのできる値（例えば２００〜５００
μｍの範囲内の値）に選定されている。なお、逆スリッ
トには非発光の白っぽい蛍光体層を隠す目的で、ガラス
基板１１の外面側又は内面側に図示しない遮光膜が設け
られる。
ンを混合した放電ガスが充填されており（封入圧力は５
００Ｔｏｒｒ）、蛍光体層２８Ｒ，２８Ｇ，２８Ｂは放
電時にキセノンが放つ紫外線によって局部的に励起され
て発光する。表示の１ピクセル（画素）は行方向に並ぶ
３個のサブピクセルの２行分の集合で構成される。各サ
ブピクセル内の構造体がセル（表示素子）Ｃである。隔
壁２９の配置パターンがストライプパターンであること
から、放電空間３０のうちの各列に対応した部分は全て
の行Ｌに跨がって列方向に連続している。そのため、隣
接する行Ｌどうしの電極間隙（逆スリットと呼称されて
いる）の寸法は各行Ｌの面放電ギャップ（例えば８０〜
１４０μｍの範囲内の値）より十分に大きく、列方向の
放電結合を防ぐことのできる値（例えば２００〜５００
μｍの範囲内の値）に選定されている。なお、逆スリッ
トには非発光の白っぽい蛍光体層を隠す目的で、ガラス
基板１１の外面側又は内面側に図示しない遮光膜が設け
られる。
【００２０】図３はＰＤＰの詳細構成を示す説明図であ
る。この図に示すように、一単位画素は、横方向におい
ては、Ｒ，Ｇ，Ｂの３色の蛍光体層２８Ｒ，２８Ｇ，２
８Ｂで構成し、縦方向においては、第１のサステイン電
極対Ｘ１，Ｙ１と、第２のサステイン電極対Ｘ２，Ｙ２
との２本のサステイン電極対で構成する。したがって、
一単位画素は、２つのＲサブピクセル，２つのＧサブピ
クセル，２つのＢサブピクセルからなる６個のサブピク
セルで構成される。
る。この図に示すように、一単位画素は、横方向におい
ては、Ｒ，Ｇ，Ｂの３色の蛍光体層２８Ｒ，２８Ｇ，２
８Ｂで構成し、縦方向においては、第１のサステイン電
極対Ｘ１，Ｙ１と、第２のサステイン電極対Ｘ２，Ｙ２
との２本のサステイン電極対で構成する。したがって、
一単位画素は、２つのＲサブピクセル，２つのＧサブピ
クセル，２つのＢサブピクセルからなる６個のサブピク
セルで構成される。
【００２１】なお、ここでは２本の表示電極対の例を示
したが、１単位画素を３本、４本、あるいはそれ以上の
本数の表示電極対で構成することもできる。
したが、１単位画素を３本、４本、あるいはそれ以上の
本数の表示電極対で構成することもできる。
【００２２】この電極配置では、個々の放電を小さくで
きるため、従来の１本の表示電極対で表示する構成のＰ
ＤＰよりも、発光効率が高くなる。
きるため、従来の１本の表示電極対で表示する構成のＰ
ＤＰよりも、発光効率が高くなる。
【００２３】図４は各Ｒ，Ｇ，Ｂの２つのサブピクセル
における点灯状態を示す説明図であり、この図に示すよ
うに、各Ｒ，Ｇ，Ｂの２つのサブピクセルについては、
２セルを点灯させる場合（輝度レベル２）（図４（ａ）
参照）、１セルを点灯させる場合（輝度レベル１）（図
４（ｂ）参照）、点灯させない場合（輝度レベル０）
（図４（ｃ）参照）の３段階の輝度レベルを設定するこ
とができる。
における点灯状態を示す説明図であり、この図に示すよ
うに、各Ｒ，Ｇ，Ｂの２つのサブピクセルについては、
２セルを点灯させる場合（輝度レベル２）（図４（ａ）
参照）、１セルを点灯させる場合（輝度レベル１）（図
４（ｂ）参照）、点灯させない場合（輝度レベル０）
（図４（ｃ）参照）の３段階の輝度レベルを設定するこ
とができる。
【００２４】このように、３段階の輝度レベルを設定す
ることができるので、従来の単位画素をＲ，Ｇ，Ｂの３
個のサブピクセルで構成したＰＤＰでフィールド内時分
割駆動を行う場合と比較して、多くの階調レベルで表示
を行うことができる。
ることができるので、従来の単位画素をＲ，Ｇ，Ｂの３
個のサブピクセルで構成したＰＤＰでフィールド内時分
割駆動を行う場合と比較して、多くの階調レベルで表示
を行うことができる。
【００２５】すなわち、従来のフィールド内時分割駆動
では、１フィールドを複数のサブフィールドに分割し、
各サブフィールドに相対比１：２：４：８：１６……の
重み付けをし、これにより、サブフィールド数がｎのと
きには、２n 段階の階調数を得るようにしている。
では、１フィールドを複数のサブフィールドに分割し、
各サブフィールドに相対比１：２：４：８：１６……の
重み付けをし、これにより、サブフィールド数がｎのと
きには、２n 段階の階調数を得るようにしている。
【００２６】一方、本ＰＤＰのフィールド内時分割駆動
では、１フィールドを複数のサブフィールドに分割し、
各サブフィールドに相対比１：３：９：２７：８１……
の重み付けをし、これにより、サブフィールド数がｎの
ときには、３n 段階の階調数を得る。例えば、１フィー
ルドを４サブフィールドに分割した場合には８１階調、
５サブフィールドに分割した場合には２４３階調、６サ
ブフィールドに分割した場合には７２９階調でそれぞれ
表示を行うことができる。
では、１フィールドを複数のサブフィールドに分割し、
各サブフィールドに相対比１：３：９：２７：８１……
の重み付けをし、これにより、サブフィールド数がｎの
ときには、３n 段階の階調数を得る。例えば、１フィー
ルドを４サブフィールドに分割した場合には８１階調、
５サブフィールドに分割した場合には２４３階調、６サ
ブフィールドに分割した場合には７２９階調でそれぞれ
表示を行うことができる。
【００２７】その場合、ディザ法を適用した場合と同様
の効果が生じるのであるが、ディザ法を使用した場合、
複数の画素で階調表示を行うため、画面の解像度が低下
する不具合があるが、本発明では、１画素内で行うた
め、画面の解像度の低下はない。
の効果が生じるのであるが、ディザ法を使用した場合、
複数の画素で階調表示を行うため、画面の解像度が低下
する不具合があるが、本発明では、１画素内で行うた
め、画面の解像度の低下はない。
【００２８】図５はサブピクセルの点灯状態を示す説明
図である。図４（ｂ）で示したように、同色の２つのサ
ブピクセルの内、一方のサブピクセルを点灯させる場合
には、「上側：点灯、下側：非点灯」の状態と、「上
側：非点灯、下側：点灯」の状態との２通りの点灯状態
がある。このため、フィールド内時分割駆動を行うとき
に、一方のサブピクセルを点灯させる場合には、あるサ
ブフィールドでの点灯状態が図５（ａ）で示した状態で
あれば、次のサブフィールドでは図５（ｂ）で示した点
灯状態にする、というように、サブフィールド毎に点灯
状態を入れ換えることにより、画面のチラつきを抑える
ようにする。
図である。図４（ｂ）で示したように、同色の２つのサ
ブピクセルの内、一方のサブピクセルを点灯させる場合
には、「上側：点灯、下側：非点灯」の状態と、「上
側：非点灯、下側：点灯」の状態との２通りの点灯状態
がある。このため、フィールド内時分割駆動を行うとき
に、一方のサブピクセルを点灯させる場合には、あるサ
ブフィールドでの点灯状態が図５（ａ）で示した状態で
あれば、次のサブフィールドでは図５（ｂ）で示した点
灯状態にする、というように、サブフィールド毎に点灯
状態を入れ換えることにより、画面のチラつきを抑える
ようにする。
【００２９】放電電極の数が増加した場合、従来の単位
画素をＲ，Ｇ，Ｂの３個のサブピクセルで構成したＰＤ
Ｐと比較して、１サブフィールドの書き込み時間が長く
なる。したがって、フィールド内時分割駆動を行う場合
には、サブフィールド数を従来よりも少なくしなければ
ならず、階調数が少なくなってしまうが、本発明では、
サブフィールド数を少なくしても、画素内での階調表示
により、階調数は減少することがない。また、点灯点の
密度が高くなるため、画像の空間周波数が増加し、見か
け上の画質の向上にも貢献できる。
画素をＲ，Ｇ，Ｂの３個のサブピクセルで構成したＰＤ
Ｐと比較して、１サブフィールドの書き込み時間が長く
なる。したがって、フィールド内時分割駆動を行う場合
には、サブフィールド数を従来よりも少なくしなければ
ならず、階調数が少なくなってしまうが、本発明では、
サブフィールド数を少なくしても、画素内での階調表示
により、階調数は減少することがない。また、点灯点の
密度が高くなるため、画像の空間周波数が増加し、見か
け上の画質の向上にも貢献できる。
【００３０】なお、以上の説明においては、３電極構造
の面放電型のＡＣ−ＰＤＰの例を示したが、本発明の階
調表示方法は、これに限らず、対向放電型のＡＣ−ＰＤ
Ｐでも、ＤＣ−ＰＤＰでも応用することが可能である。
の面放電型のＡＣ−ＰＤＰの例を示したが、本発明の階
調表示方法は、これに限らず、対向放電型のＡＣ−ＰＤ
Ｐでも、ＤＣ−ＰＤＰでも応用することが可能である。
【００３１】また、説明では、１単位画素を２本の表示
電極対で構成した例を示したが、上述したように、１単
位画素を３本、４本、あるいはそれ以上の本数の表示電
極対で構成することも可能である。
電極対で構成した例を示したが、上述したように、１単
位画素を３本、４本、あるいはそれ以上の本数の表示電
極対で構成することも可能である。
【００３２】
【発明の効果】この発明によれば、高い発光効率で、階
調数の多い、画質の優れたプラズマディスプレイパネル
を実現することができる。
調数の多い、画質の優れたプラズマディスプレイパネル
を実現することができる。
【図１】本発明に係るプラズマ表示装置の構成図であ
る。
る。
【図２】本発明のＰＤＰの内部構造を示す斜視図であ
る。
る。
【図３】本発明のＰＤＰの詳細構成を示す説明図であ
る。
る。
【図４】本発明の各Ｒ，Ｇ，Ｂの２つのサブピクセルに
おける点灯状態を示す説明図である。
おける点灯状態を示す説明図である。
【図５】本発明のサブピクセルの点灯状態を示す説明図
である。
である。
１ ＡＣ型のＰＤＰ １１ 前面側のガラス基板 １７ 誘電体層 １８ 保護膜 ２１ 背面側のガラス基板 ２２ 下地層 ２４ 誘電体層 ２８Ｒ，２８Ｇ，２８Ｂ 蛍光体層 ２９ 隔壁 ３０ 放電空間 ４１ 透明導電膜 ４２ 金属膜 ８０ 駆動ユニット ８１ コントローラ ８２ フレームメモリ ８３ データ処理回路 ８４ サブフィールドメモリ ８５ 電源回路 ８７ Ｘドライバ ８８ Ｙドライバ ８９ アドレスドライバ １００ プラズマ表示装置 Ａ アドレス電極 Ｃ セル Ｌ 行 ＳＣ 画面 Ｘ，Ｙ サステイン電極 Ｘ１，Ｙ１ 第１のサステイン電極対 Ｘ２，Ｙ２ 第２のサステイン電極対
Claims (4)
- 【請求項１】 一画素を構成するＲ，Ｇ，Ｂの最小単位
画素をそれぞれ複数の画素で構成し、これら複数の画素
の点灯数を段階的に制御することにより階調表示を行う
ことを特徴とするプラズマディスプレイパネルの階調表
示方法。 - 【請求項２】 Ｒ，Ｇ，Ｂの最小単位画素が、それぞれ
２つの画素からなる請求項１記載のプラズマディスプレ
イパネルの階調表示方法。 - 【請求項３】 １フィールドを複数のサブフィールドに
分割し所望の画素を所望のサブフィールドの期間点灯さ
せるフィールド内時分割による階調表示と組み合わせて
用いられることを特徴とする請求項１記載のプラズマデ
ィスプレイパネルの階調表示方法。 - 【請求項４】 ２つの画素の一方が点灯される階調が連
続して選択される際には、２つの画素を交互に点灯させ
ることを特徴とする請求項２記載のプラズマディスプレ
イパネルの階調表示方法。
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|---|---|---|---|
| JP23165498A JP4111359B2 (ja) | 1998-08-18 | 1998-08-18 | プラズマディスプレイパネルの階調表示方法 |
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| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23165498A JP4111359B2 (ja) | 1998-08-18 | 1998-08-18 | プラズマディスプレイパネルの階調表示方法 |
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|---|---|
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| JP4111359B2 JP4111359B2 (ja) | 2008-07-02 |
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ID=16926889
Family Applications (1)
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| JP23165498A Expired - Fee Related JP4111359B2 (ja) | 1998-08-18 | 1998-08-18 | プラズマディスプレイパネルの階調表示方法 |
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| Publication number | Priority date | Publication date | Assignee | Title |
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-
1998
- 1998-08-18 JP JP23165498A patent/JP4111359B2/ja not_active Expired - Fee Related
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