FR2371019A1 - Procede de remplacement des blocs de donnees dans une memoire tampon intermediaire - Google Patents

Procede de remplacement des blocs de donnees dans une memoire tampon intermediaire

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    • G06F12/02Addressing or allocation; Relocation
    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
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Abstract

L'invention concerne les systèmes informatiques. Dans un système informatique à plusieurs processeurs, chaque processeur possède sa propre mémoire tampon 1, et ces mémoires communiquent avec la mémoire principale du système par une mémoire tampon intermédiaire 2. Le remplacement des blocs de données dans la mémoire 2 s'effectue en cherchant à préserver au maximum les blocs de données qui possèdent des copies dans plusieurs mémoires tampons 1. Application aux systèmes informatiques de grande taille.
FR7733572A 1976-11-10 1977-11-08 Procede de remplacement des blocs de donnees dans une memoire tampon intermediaire Granted FR2371019A1 (fr)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0062165A2 (fr) * 1981-03-31 1982-10-13 International Business Machines Corporation Ordinateurs de multitraitement avec mémoires tampon particulières et en commun
EP0088239A2 (fr) * 1982-02-23 1983-09-14 International Business Machines Corporation Remplacement d'antémémoire de multiprocesseur sans contrôle de programme

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CA2047888A1 (fr) * 1990-07-27 1992-01-28 Hirosada Tone Systeme de commande pour memoire hierarchisee
US7024519B2 (en) 2002-05-06 2006-04-04 Sony Computer Entertainment Inc. Methods and apparatus for controlling hierarchical cache memory
US7577793B2 (en) * 2006-01-19 2009-08-18 International Business Machines Corporation Patrol snooping for higher level cache eviction candidate identification
JP2008046902A (ja) * 2006-08-17 2008-02-28 Fujitsu Ltd 情報処理システム、情報処理基板、及びキャッシュタグ及びスヌープタグの更新方法
JP5404433B2 (ja) 2010-01-08 2014-01-29 株式会社東芝 マルチコアシステム

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3947823A (en) * 1973-12-26 1976-03-30 International Business Machines Corp. Means for coordinating asynchronous main store accesses in a multiprocessing system using virtual storage

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3947823A (en) * 1973-12-26 1976-03-30 International Business Machines Corp. Means for coordinating asynchronous main store accesses in a multiprocessing system using virtual storage

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0062165A2 (fr) * 1981-03-31 1982-10-13 International Business Machines Corporation Ordinateurs de multitraitement avec mémoires tampon particulières et en commun
EP0062165A3 (en) * 1981-03-31 1984-10-17 International Business Machines Corporation Multiprocessors including private and shared caches
EP0088239A2 (fr) * 1982-02-23 1983-09-14 International Business Machines Corporation Remplacement d'antémémoire de multiprocesseur sans contrôle de programme
EP0088239A3 (en) * 1982-02-23 1985-09-18 International Business Machines Corporation Multiprocessor cache replacement under task control

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DE2750126C3 (de) 1979-12-20
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JPS5373927A (en) 1978-06-30
DE2750126A1 (de) 1978-05-11

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