EP1930992B1 - Blockiervorrichtung gegen Fehlsteckungen bei Leiterplattensteckverbindern - Google Patents

Blockiervorrichtung gegen Fehlsteckungen bei Leiterplattensteckverbindern Download PDF

Info

Publication number
EP1930992B1
EP1930992B1 EP07023314A EP07023314A EP1930992B1 EP 1930992 B1 EP1930992 B1 EP 1930992B1 EP 07023314 A EP07023314 A EP 07023314A EP 07023314 A EP07023314 A EP 07023314A EP 1930992 B1 EP1930992 B1 EP 1930992B1
Authority
EP
European Patent Office
Prior art keywords
circuit board
plug
printed circuit
blocking
blocking block
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
EP07023314A
Other languages
English (en)
French (fr)
Other versions
EP1930992A2 (de
EP1930992A3 (de
Inventor
Gert Havermann
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Harting Electronics GmbH and Co KG
Original Assignee
Harting Electronics GmbH and Co KG
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Harting Electronics GmbH and Co KG filed Critical Harting Electronics GmbH and Co KG
Priority to PL07023314T priority Critical patent/PL1930992T3/pl
Publication of EP1930992A2 publication Critical patent/EP1930992A2/de
Publication of EP1930992A3 publication Critical patent/EP1930992A3/de
Application granted granted Critical
Publication of EP1930992B1 publication Critical patent/EP1930992B1/de
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01RELECTRICALLY-CONDUCTIVE CONNECTIONS; STRUCTURAL ASSOCIATIONS OF A PLURALITY OF MUTUALLY-INSULATED ELECTRICAL CONNECTING ELEMENTS; COUPLING DEVICES; CURRENT COLLECTORS
    • H01R13/00Details of coupling devices of the kinds covered by groups H01R12/70 or H01R24/00 - H01R33/00
    • H01R13/64Means for preventing incorrect coupling
    • H01R13/645Means for preventing incorrect coupling by exchangeable elements on case or base
    • H01R13/6456Means for preventing incorrect coupling by exchangeable elements on case or base comprising keying elements at different positions along the periphery of the connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01RELECTRICALLY-CONDUCTIVE CONNECTIONS; STRUCTURAL ASSOCIATIONS OF A PLURALITY OF MUTUALLY-INSULATED ELECTRICAL CONNECTING ELEMENTS; COUPLING DEVICES; CURRENT COLLECTORS
    • H01R12/00Structural associations of a plurality of mutually-insulated electrical connecting elements, specially adapted for printed circuits, e.g. printed circuit boards [PCB], flat or ribbon cables, or like generally planar structures, e.g. terminal strips, terminal blocks; Coupling devices specially adapted for printed circuits, flat or ribbon cables, or like generally planar structures; Terminals specially adapted for contact with, or insertion into, printed circuits, flat or ribbon cables, or like generally planar structures
    • H01R12/70Coupling devices
    • H01R12/7005Guiding, mounting, polarizing or locking means; Extractors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01RELECTRICALLY-CONDUCTIVE CONNECTIONS; STRUCTURAL ASSOCIATIONS OF A PLURALITY OF MUTUALLY-INSULATED ELECTRICAL CONNECTING ELEMENTS; COUPLING DEVICES; CURRENT COLLECTORS
    • H01R12/00Structural associations of a plurality of mutually-insulated electrical connecting elements, specially adapted for printed circuits, e.g. printed circuit boards [PCB], flat or ribbon cables, or like generally planar structures, e.g. terminal strips, terminal blocks; Coupling devices specially adapted for printed circuits, flat or ribbon cables, or like generally planar structures; Terminals specially adapted for contact with, or insertion into, printed circuits, flat or ribbon cables, or like generally planar structures
    • H01R12/70Coupling devices
    • H01R12/71Coupling devices for rigid printing circuits or like structures
    • H01R12/712Coupling devices for rigid printing circuits or like structures co-operating with the surface of the printed circuit or with a coupling device exclusively provided on the surface of the printed circuit
    • H01R12/716Coupling device provided on the PCB
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01RELECTRICALLY-CONDUCTIVE CONNECTIONS; STRUCTURAL ASSOCIATIONS OF A PLURALITY OF MUTUALLY-INSULATED ELECTRICAL CONNECTING ELEMENTS; COUPLING DEVICES; CURRENT COLLECTORS
    • H01R12/00Structural associations of a plurality of mutually-insulated electrical connecting elements, specially adapted for printed circuits, e.g. printed circuit boards [PCB], flat or ribbon cables, or like generally planar structures, e.g. terminal strips, terminal blocks; Coupling devices specially adapted for printed circuits, flat or ribbon cables, or like generally planar structures; Terminals specially adapted for contact with, or insertion into, printed circuits, flat or ribbon cables, or like generally planar structures
    • H01R12/70Coupling devices
    • H01R12/7082Coupling device supported only by cooperation with PCB

Definitions

  • the plug-in unit 20 shown here three daughter boards 2 are combined, which are provided for direct plugging into the printed circuit board connectors 3, the middle daughter board having a recess 24.

Landscapes

  • Details Of Connecting Devices For Male And Female Coupling (AREA)
  • Coupling Device And Connection With Printed Circuit (AREA)
  • Combinations Of Printed Boards (AREA)

Description

    Beschreibung
  • Die Erfindung betrifft eine Blockiervorrichtung gegen Fehlsteckungen von Tochterleiterplatten auf einer Mutterleiterplatte, insbesondere, wenn mehrere Tochterleiterplatten zu einer Steckeinheit zusammengefasst sind und auf der Mutterleiterplatte mindestens zwei Leiterplattensteckverbinder kontaktieren.
  • Eine derartige Vorrichtung wird benötigt, um zu verhindern, dass auf einer Mutterleiterplatte, die mit einer großen Anzahl von gleichartigen Leiterplattensteckverbindern besetzt ist, eine oder mehrere Tochterleiterplatten die wiederum zu einer Steckeinheit zusammengefasst sind, nicht in Bereiche auf der Mutterleiterplatte gesteckt wird, die für diese Konfiguration nicht vorgesehen sind und dabei eventuell Systemausfälle verursachen.
  • Stand der Technik
  • Bei umfangreichen Backplanesystemen - also großen Mutterleiterplatten - mit gleichartigen Leiterplattensteckverbindern, die einem MicroTCA-System zugeordnet sind, können zwei verschiedene Arten von Modulsteckverbindern gesteckt werden. Das eine System ist unter dem Namen "Advanced Mezzanine Card" (AMCs) bekannt, während eine weiteres unter "Mezzanines with Auxiliary Connections" (Multitongue-AMCs) bekannt ist, das auch MicroTCA-Carrier-Hub-Module aufnimmt (MCH).
  • Die Multitongue-AMC - Module sind Kartenrandsteckverbinder mit angefügten Leiterplatten, bei denen auf der Leiterkarte eine derartig große Anzahl von Signalkontakten vorgesehen ist, so dass zur Weiterleitung der Signale mindestens zwei separate Steckbereiche auf der Mutterleiterplatte notwendig sind.
  • Werden darüber hinaus zwei Tochterleiterplatten zusammengefasst, so können drei oder vier Steckbereiche erforderlich sein, die über eine gleiche Anzahl von Leiterplattensteckverbindern ihre Signale auf die Backplane übertragen.
  • Dabei können die zusammengefassten Tochterleiterplatten als Kartenrandstecker über deren Leiterbahnenenden direkt gesteckt werden oder mittels eines so genannten Mehrfach-Leiterplatten-Steckaufsatzes in die Leiterplattensteckverbinder auf der Mutterleiterplatte gesteckt werden.
  • Dieser Mehrfach-Leiterplatten-Steckaufsatz wird separat gefertigt, mit den Leiterplatten verbunden und kontaktiert die Leiterplattensteckverbinder auf der Backplane.
  • Da die Leiterplattensteckverbinder auf der Mutterleiterplatte für die AMCs und die Multitongue-AMCs jedoch die gleichen sind, aber eine unterschiedliche Kontaktbelegung aufweisen, muss sichergestellt werden, dass Fehlsteckungen bzw. Steckungen in nicht zulässigen Leiterplattensteckerbereichen vermieden werden.
  • US 3,533,045 zeigt eine Blockiervorrichtung gemäß dem Oberbegriff von Anspruch 1.
  • Aufgabenstellung
  • Der Erfindung liegt daher die Aufgabe zugrunde, dass eine aus mehreren Tochterleiterplatten bestehende Steckeinheit nicht in Bereiche auf der Mutterleiterplatte steckbar sind, die für diese Steckeinheit nicht vorgesehen sind.
  • Diese Aufgabe wird dadurch gelöst, dass zwischen zwei in einem regulären Steckabstand angeordneten Leiterplattensteckverbindern ein Blockierblock eingefügt ist, dass an dem Blockierblock Rastlaschen vorgesehen sind, dass die Leiterplattensteckverbinder auf ihren Längsseiten fensterartige Ausnehmungen aufweisen, in denen die Rastlaschen des Blockierblockes einrasten, wobei der Blockierblock eine Steckung der als Steckeinheit zusammengefassten Tochterleiterplatten auf der Mutterleiterplatte verhindert.
  • Eine vorteilhafte Ausgestaltung der Erfindung ist in den Ansprüchen 2-6 angegeben.
  • Für die Übertragung einer großen Anzahl von Signalen von einer oder mehrerer Tochterleiterplatten steckbar auf eine Mutterleiterplatte, sind prinzipiell zwei Kontaktierungsmöglichkeiten vorgegeben, einmal eine direkte Steckung der Leiterbahnenden der Tochterleiterplatte in einen Leiterplattensteckverbinder auf der Mutterleiterplatte, und eine Steckung unter Inanspruchnahme eines zusätzlichen Steckverbinders, der mit der Tochterleiterplatte fest verbunden ist und dann in den Leiterplattensteckverbinder gesteckt wird.
  • Wenn die Anzahl der nebeneinander oder in Sandwichkarten übereinander angeordneten Signalkontakte nicht mehr von einem Steckverbinder übertragen werden kann, wird ein Verbund mehrerer gestaffelter Steckverbinder, hier als Mehrfach-Leiterplatten-Steckaufsatz bezeichnet, genutzt.
  • Da bei vielen Anwendungsfällen auf größeren Mutterleiterplatten auch gleichartige Leiterplattensteckverbinder eine unterschiedliche Kontaktbelegung aufweisen, besteht die Gefahr, dass Tochterleiterplatten an einem falschen Steckplatz gesteckt, zu kompletten Systemausfällen führen können.
  • Zu einer Blockierung derartiger Steckbereiche ist vorgesehen, in die Zwischenräume des regulären Steckabstandes der Leiterplattensteckverbinder, ein Blockierelement einzufügen, das eine Fehlsteckung der Tochterleiterplatten-Steckeinheit verhindert.
  • Dazu sind vorteilhafterweise die Leiterplattensteckverbinder auf der Backplane oder Mutterleiterplatte an ihren Längsseiten mit fensterartigen Ausnehmungen versehen, die durch Längsrippen und diese kreuzende Querrippen gebildet werden.
  • Weiterhin weisen die vorgesehenen Blockierelemente vorteilhafterweise flexible Rastlaschen auf, die beim Einfügen zwischen zwei Leiterplattensteckverbindern an den Längsrippen verrasten und damit ein Stecken der Steckeinheit mit den verhindern.
  • Vorsehbar sind dabei unterschiedliche Größen für die Kodierblöcke, die auch zwischen unterschiedlich voneinander entfernten angeordneten Leiterplattensteckverbinder einfügbar sind.
  • Ausführungsbeispiel
  • Ein Ausführungsbeispiel der Erfindung ist in der Zeichnung dargestellt und wird im folgenden näher erläutert. Es zeigen:
  • Fig. 1
    einen Leiterplattensteckverbinder,
    Fig. 2a
    eine isometrische Darstellung eines Blockierblockes,
    Fig. 2b
    eine Draufsicht auf den Blockierblock,
    Fig. 3
    eine Draufsicht auf mehrere Leiterplattensteckverbinder mit dazwischen angeordneten Blockierblöcken,
    Fig. 4
    eine Schnittansicht aus der Fig. 3, und
    Fig. 5
    die Kodierung einer Steckeinheit mittels des Blockierblockes.
  • Die Fig. 1. zeigt eine Seitenansicht eines Leiterplattensteckverbinders 3 auf seine Längsseite, wobei hier vier fensterartige Ausnehmungen 4 erkennbar sind.
  • Die fensterartigen Ausnehmungen 4 sind als Vertiefungen ausgebildet, die durch mehrere senkrechte Querrippen 6 und sie kreuzende waagrechte Längsrippen 5 geformt sind.
  • In den Fig. 2a, 2b ist ein erfindungsgemäßer Blockierblock dargestellt.
  • Dabei zeigt die Fig. 2a eine isometrische Darstellung und die Fig. 2b eine Draufsicht des Blockierblockes.
  • Der Blockierblock 10 weist eine quaderförmige Grundform auf und ist als Hohlkörper ausgeführt. Beidseitig seiner Längsseiten 11 sind jeweils zwei nach außen abstehende, dreiseitig freistehende Rastlaschen 15 ausgebildet, die durch eine mittige Strebe 13 getrennt sind.
  • Weiterhin ist an jeder der Rastlaschen 15, beidseitig der mittigen Strebe 13, eine teilweise keilförmige Ausnehmung 16 vorgesehen.
  • In diesem Bereich ist die mittige Strebe 13 um eine Stufe 14 gegenüber dem übrigen Niveau der Längsseite 11 zurückgenommen.
  • Weiterhin sind an den vier Eckseiten Vorsprünge 17 angeformt, die beim Einfügen eines Blockierblockes zwischen zwei Leiterplattensteckverbinder 3 oberhalb der waagrechten Längsrippen 5 positioniert bleiben, während die Rastlaschen 15 unterhalb der Längsrippen 5 in einer der fensterartigen Ausnehmungen 4 verrasten. (Siehe dazu auch Fig. 3)
  • Um einen verrasteten Blockierblock wieder entfernen zu können, ist ein Teil der beiden an die mittige Strebe 13 angrenzenden Rastlaschen 15 keilförmig ausgenommen. Da die mittige Strebe 13 hier zurückgenommen ist, entsteht ein Steckschlitz18, in den ein entsprechendes Werkzeug, z. B. die Spitze eines Schraubendrehers, bis zu der Stufe 14 eingesetzt werden kann, so dass jeweils zwei benachbarte Rastlaschen 15 zurückgebogen und der Blockierblock entfernt werden kann.
  • Die Fig. 3 zeigt eine Draufsicht auf mehrere parallel angeordnete Leiterplattensteckverbinder 3 zwischen denen jeweils ein Blockierblock 10 eingesetzt wurde. Dabei ist es prinzipiell unerheblich, an welcher der vier möglichen fensterartigen Ausnehmungen ein Blockierblock 10 eingesetzt wird, um die Steckung einer bestimmten Steckkartenversion zu unterbinden.
  • In der Fig. 4 sind in einer Schnittansicht mehrere der aus der Fig. 3 nebeneinander beabstandete und auf einer Mutterleiterplatte 1 angeordnete Leiterplattensteckverbinder 3 dargestellt, wobei zwischen den Steckverbindern Blockierblöcke 10 eingefügt sind.
  • Dabei ist deutlich erkennbar, wie die Enden der Rastlaschen 15 an den waagrechten Längsrippen 5 verrastet sind.
  • Hieraus wird ersichtlich, wie ein eingefügter Blockierblock 10 die Steckung eine mehrere Tochterleiterplatten umfassende Steckeinheit 20 wirksam verhindert.
  • Wobei die Tochterleiterplatten 2 zur direkten Steckung als Kartenrandstecker ausgeführt sein können oder in einem Mehrfach-Leiterplatten-Steckaufsatz 20 zusammengeführt sind.
  • Eine einzelne Tochterleiterplatte kann hier natürlich problemlos gesteckt werden.
  • Mittels der in den Leiterplattensteckverbindern 3 eingeformten Fenster 4 und mindestens einem Blockierblock 10 ist jedoch auch eine Kodierung einer Steckeinheit 20 möglich, wie dies in der Fig. 5 dargestellt ist.
  • Dabei sind bei der hier gezeigten Steckeinheit 20 drei Tochterleiterplatten 2 zusammengefasst, die für eine direkte Steckung in die Leiterplattensteckverbinder 3 vorgesehen sind, wobei die mittlere Tochterleiterplatte eine Ausnehmung 24 aufweist.
  • Auf der skizzierten Mutterleiterplatte 1 sind zwei Leiterplattensteckverbinder 3 und ein zwischen diesen verrasteter Blockierblock 10 angeordnet.
  • Diese Steckeinheit kann problemlos gesteckt werden, da der Blockierblock 10 exakt in die Ausnehmung 24 der mittleren Tochterleiterplatte hineinpasst. Dabei ist bei dieser Steckeinheit sichergestellt, dass die mittlere Tochterleiterplatte ihre Signale über die beiden begrenzenden Leiterplatten weiterleitet.
  • Somit kann nur diese eine Steckeinheit gesteckt werden - trotz der eigentlich blockierenden Aufgabe des Blockierblockes, die gegeben wäre, wenn die mittlere Tochterleiterplatte keine Ausnehmung aufweisen würde.

Claims (6)

  1. Blockiervorrichtung gegen Fehlsteckungen von Tochterleiterplatten (2) auf einer Mutterleiterplatte (1), insbesondere, wenn mehrere Tochterleiterplatten (2) zu einer Steckeinheit (20) zusammengefasst sind und auf der Mutterleiterplatte (1) mindestens zwei Leiterplattensteckverbinder (3) kontaktieren,
    wobei zwischen zwei in einem regulären Steckabstand angeordneten Leiterplattensteckverbindern (3) ein Blockierblock (10) eingefügt ist,
    wobei an dem Blockierblock (10) Rastlaschen (15) vorgesehen sind,
    dadurch gekennzeichnet, dass die Leiterplattensteckverbinder (3) auf ihren Längsseiten fensterartige Ausnehmungen (4) aufweisen, in denen die Rastlaschen (15) des Blockierblockes (10) einrasten, wobei der Blockierblock (10) eine Fehlsteckung der als Steckeinheit (20) zusammengefassten Tochterleiterplatten (2) auf der Mutterleiterplatte (1) verhindert.
  2. Blockiervorrichtung nach Anspruch 1, dadurch gekennzeichnet, dass die fensterartigen Ausnehmungen (4) auf den Längsseiten der Leiterplattensteckverbinder (3) mittels Längsrippen (5) und sie kreuzende Querrippen (6) gebildet werden.
  3. Blockiervorrichtung nach Anspruch 1, dadurch gekennzeichnet, dass die Rastlaschen (15) des Blockierblockes (10) bereichsweise eine keilförmige Ausnehmung (16) aufweisen.
  4. Blockiervorrichtung nach Anspruch 1, dadurch gekennzeichnet, dass zwischen den Rastlaschen (15) eine mittlere Strebe (13) mit einer Stufe (14) vorgesehen ist.
  5. Blockiervorrichtung nach Anspruch 1, dadurch gekennzeichnet, dass ein verrasteter Blockierblock (10) mittels eines flachen Werkzeuges, welches in die keilförmigen Ausnehmungen (16) der beiden Rastlaschen (15) eingefügt wird, durch ein Zurückbiegen der Rastlaschen entgegen den Längsrippen (5) der Leiterplattensteckverbinder (3) entriegelbar ist.
  6. Blockiervorrichtung nach Anspruch 1, dadurch gekennzeichnet, dass der Blockierblock (10) in Zusammenhang mit einer oder mehreren Ausnehmungen (24) an der Steckseite an mindestens einer der Tochterleiterplatten (2) einer Steckeinheit (20) zu deren Kodierung vorgesehen ist.
EP07023314A 2006-12-08 2007-12-01 Blockiervorrichtung gegen Fehlsteckungen bei Leiterplattensteckverbindern Active EP1930992B1 (de)

Priority Applications (1)

Application Number Priority Date Filing Date Title
PL07023314T PL1930992T3 (pl) 2006-12-08 2007-12-01 Urządzenie blokujące błędne wetknięcia w złączach wtykowych płytek obwodu drukowanego

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
DE202006018590U DE202006018590U1 (de) 2006-12-08 2006-12-08 Blockiervorrichtung gegen Fehlsteckungen bei Leiterplattensteckverbindern

Publications (3)

Publication Number Publication Date
EP1930992A2 EP1930992A2 (de) 2008-06-11
EP1930992A3 EP1930992A3 (de) 2009-12-16
EP1930992B1 true EP1930992B1 (de) 2011-10-05

Family

ID=37776369

Family Applications (1)

Application Number Title Priority Date Filing Date
EP07023314A Active EP1930992B1 (de) 2006-12-08 2007-12-01 Blockiervorrichtung gegen Fehlsteckungen bei Leiterplattensteckverbindern

Country Status (9)

Country Link
US (1) US7503766B2 (de)
EP (1) EP1930992B1 (de)
JP (1) JP4700674B2 (de)
CN (1) CN101197477B (de)
AT (1) ATE527724T1 (de)
DE (1) DE202006018590U1 (de)
DK (1) DK1930992T3 (de)
ES (1) ES2372764T3 (de)
PL (1) PL1930992T3 (de)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR3004859B1 (fr) * 2013-04-19 2016-12-09 Hypertac Sa Connecteur electrique pour connecter une carte fille a une carte mere.
DE102013108888A1 (de) * 2013-08-16 2015-02-19 Phoenix Contact Gmbh & Co. Kg Kodierung für Grundleisten mit einer Mehrzahl an Kammern
DE102014117233B4 (de) 2014-11-25 2018-03-01 Phoenix Contact Gmbh & Co. Kg Grundleiste zum Verbinden mit einer Leiterplatte
US9609779B1 (en) * 2015-02-03 2017-03-28 Rick Sheffield Apparatus for securing printed circuit boards
DE102015111972A1 (de) * 2015-07-23 2017-01-26 Abb Schweiz Ag Schaltung auf Platinen in mehreren Ebenen mit Schnittstelle für Steckkarte
CN108566756B (zh) * 2017-12-30 2024-04-26 河南思维轨道交通技术研究院有限公司 一种无线扎连接结构
CN117222169B (zh) * 2023-11-07 2024-03-08 江苏华鲲振宇智能科技有限责任公司 一种服务器双电源防误插拔互锁结构

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3533045A (en) * 1968-05-29 1970-10-06 Amp Inc Supporting and keying means for printed circuit boards or the like
DE2119709C3 (de) * 1971-04-22 1986-02-13 Siemens AG, 1000 Berlin und 8000 München Baugruppenträger zur Aufnahme einschiebbarer elektrischer Baugruppen
US4046452A (en) * 1975-04-16 1977-09-06 Amp Incorporated Electrical connector housing having an improved locking means
JPS555475U (de) * 1978-06-26 1980-01-14
JPH0299583U (de) * 1989-01-27 1990-08-08
US5014163A (en) * 1990-01-30 1991-05-07 John Lin Structure of circuit board assembly
US6385053B1 (en) * 1999-02-26 2002-05-07 Cisco Technology, Inc. PCB vertical and horizontal guide
JP2002298953A (ja) * 2001-03-30 2002-10-11 Nec Corp コネクタ
JP4223525B2 (ja) * 2005-10-27 2009-02-12 山一電機株式会社 プラグコネクタ

Also Published As

Publication number Publication date
CN101197477A (zh) 2008-06-11
ATE527724T1 (de) 2011-10-15
JP2008147192A (ja) 2008-06-26
US20080139010A1 (en) 2008-06-12
ES2372764T3 (es) 2012-01-26
CN101197477B (zh) 2010-09-29
PL1930992T3 (pl) 2012-03-30
US7503766B2 (en) 2009-03-17
DE202006018590U1 (de) 2007-02-15
JP4700674B2 (ja) 2011-06-15
DK1930992T3 (da) 2012-01-23
EP1930992A2 (de) 2008-06-11
EP1930992A3 (de) 2009-12-16

Similar Documents

Publication Publication Date Title
EP2068228B1 (de) Datenverarbeitungssystem
DE69327132T2 (de) Schalt-Zwischenebene und Zwischenverbindungssystem zum Untereinanderverbinden einer grossen Anzahl von Signalen
DE69033762T2 (de) Sperrmittel für elektrischen Steckverbinder
DE60201349T2 (de) Elektrische verbinderbaugruppe zur orthogonalen verbindung von leiterplatten
EP1930992B1 (de) Blockiervorrichtung gegen Fehlsteckungen bei Leiterplattensteckverbindern
DE10036934A1 (de) Hauptplatine
EP1649549B1 (de) Aderanschlussmodul für leiterplatten
DE60127748T2 (de) Elektrischer Verbinder
DE2851749C2 (de)
DE10109571A1 (de) Leiterplattenanordnung
DE102011001486A1 (de) Leiterplatten-Direktverbinder und Leiterplattenanordnung
EP3446368B1 (de) Steckverbinder für die datenübertragung
EP3066723B1 (de) Prüfkabel sowie buchsenadapter für ein prüfkabel
DE9304929U1 (de) Schirmeinrichtung für rechteckige Kabelstecker
DE102021117571A1 (de) Kraftfahrzeugsteuergerät
DE3442056A1 (de) Steckverbindervorrichtung
DE8630076U1 (de) Surface-mount-Steckverbinder
EP0895660B1 (de) Kabelsteckverbinder mit in einem isolationskörper befestigten kontaktbahnen mit lötanschlüssen
DE19526330C2 (de) Vorrichtung zur Herstellung einer elektrischen und/oder optischen Verbindung
DE202024101274U1 (de) Zum Befestigen auf einer Befestigungsschiene eingerichtetes Modul
DE10234147A1 (de) Kammartige Abstandshalterleiste, Leiterplattenverbund mit kammartigen Abstandshalterleisten und Gehäuse zur Aufnahme eines Leiterplattenverbunds
DE102021119551A1 (de) Leiterplatte umfassend Öffnung zum Anordnen einer weiteren Leiterplatte auf der Leiterplatte
DE19955783C2 (de) Montagesystem für die reihenweise Montage von Steckeinschüben
DE9315592U1 (de) Computerbaugruppe
DE102011011995A1 (de) Elektronikgerät, aufgebaut aus mindestens zwei Funktionsmodulen

Legal Events

Date Code Title Description
PUAI Public reference made under article 153(3) epc to a published international application that has entered the european phase

Free format text: ORIGINAL CODE: 0009012

AK Designated contracting states

Kind code of ref document: A2

Designated state(s): AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HU IE IS IT LI LT LU LV MC MT NL PL PT RO SE SI SK TR

AX Request for extension of the european patent

Extension state: AL BA HR MK RS

PUAL Search report despatched

Free format text: ORIGINAL CODE: 0009013

AK Designated contracting states

Kind code of ref document: A3

Designated state(s): AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HU IE IS IT LI LT LU LV MC MT NL PL PT RO SE SI SK TR

AX Request for extension of the european patent

Extension state: AL BA HR MK RS

17P Request for examination filed

Effective date: 20100301

AKX Designation fees paid

Designated state(s): AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HU IE IS IT LI LT LU LV MC MT NL PL PT RO SE SI SK TR

REG Reference to a national code

Ref country code: DE

Ref legal event code: R079

Ref document number: 502007008286

Country of ref document: DE

Free format text: PREVIOUS MAIN CLASS: H01R0013640000

Ipc: H01R0012730000

GRAP Despatch of communication of intention to grant a patent

Free format text: ORIGINAL CODE: EPIDOSNIGR1

RIC1 Information provided on ipc code assigned before grant

Ipc: H01R 12/73 20110101AFI20110420BHEP

Ipc: H01R 13/64 20060101ALI20110420BHEP

GRAS Grant fee paid

Free format text: ORIGINAL CODE: EPIDOSNIGR3

GRAA (expected) grant

Free format text: ORIGINAL CODE: 0009210

AK Designated contracting states

Kind code of ref document: B1

Designated state(s): AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HU IE IS IT LI LT LU LV MC MT NL PL PT RO SE SI SK TR

REG Reference to a national code

Ref country code: GB

Ref legal event code: FG4D

Free format text: NOT ENGLISH

REG Reference to a national code

Ref country code: CH

Ref legal event code: EP

REG Reference to a national code

Ref country code: IE

Ref legal event code: FG4D

REG Reference to a national code

Ref country code: DE

Ref legal event code: R096

Ref document number: 502007008286

Country of ref document: DE

Effective date: 20111208

REG Reference to a national code

Ref country code: RO

Ref legal event code: EPE

REG Reference to a national code

Ref country code: SE

Ref legal event code: TRGR

REG Reference to a national code

Ref country code: NL

Ref legal event code: T3

REG Reference to a national code

Ref country code: DK

Ref legal event code: T3

REG Reference to a national code

Ref country code: ES

Ref legal event code: FG2A

Ref document number: 2372764

Country of ref document: ES

Kind code of ref document: T3

Effective date: 20120126

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: SI

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

LTIE Lt: invalidation of european patent or patent extension

Effective date: 20111005

REG Reference to a national code

Ref country code: PL

Ref legal event code: T3

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: IS

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120205

Ref country code: LT

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

REG Reference to a national code

Ref country code: IE

Ref legal event code: FD4D

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: LV

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

Ref country code: GR

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120106

Ref country code: PT

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120206

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: CY

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: MC

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20111231

Ref country code: SK

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

Ref country code: BG

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120105

Ref country code: EE

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

Ref country code: IE

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

PLBE No opposition filed within time limit

Free format text: ORIGINAL CODE: 0009261

STAA Information on the status of an ep patent application or granted ep patent

Free format text: STATUS: NO OPPOSITION FILED WITHIN TIME LIMIT

26N No opposition filed

Effective date: 20120706

REG Reference to a national code

Ref country code: DE

Ref legal event code: R097

Ref document number: 502007008286

Country of ref document: DE

Effective date: 20120706

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: MT

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: LU

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20111201

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: HU

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20111005

REG Reference to a national code

Ref country code: FR

Ref legal event code: PLFP

Year of fee payment: 9

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: TR

Payment date: 20151022

Year of fee payment: 9

Ref country code: CH

Payment date: 20151211

Year of fee payment: 9

Ref country code: FI

Payment date: 20151209

Year of fee payment: 9

Ref country code: DK

Payment date: 20151210

Year of fee payment: 9

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: NL

Payment date: 20151210

Year of fee payment: 9

Ref country code: AT

Payment date: 20151125

Year of fee payment: 9

Ref country code: BE

Payment date: 20151207

Year of fee payment: 9

Ref country code: CZ

Payment date: 20151116

Year of fee payment: 9

Ref country code: RO

Payment date: 20151106

Year of fee payment: 9

Ref country code: PL

Payment date: 20151013

Year of fee payment: 9

Ref country code: SE

Payment date: 20151211

Year of fee payment: 9

Ref country code: ES

Payment date: 20151111

Year of fee payment: 9

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: IT

Payment date: 20151221

Year of fee payment: 9

REG Reference to a national code

Ref country code: DE

Ref legal event code: R081

Ref document number: 502007008286

Country of ref document: DE

Owner name: HARTING ELECTRONICS GMBH, DE

Free format text: FORMER OWNER: HARTING ELECTRONICS GMBH & CO. KG, 32339 ESPELKAMP, DE

REG Reference to a national code

Ref country code: FR

Ref legal event code: PLFP

Year of fee payment: 10

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: BE

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161231

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: CZ

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

Ref country code: RO

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

Ref country code: FI

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

REG Reference to a national code

Ref country code: DK

Ref legal event code: EBP

Effective date: 20161231

Ref country code: CH

Ref legal event code: PL

REG Reference to a national code

Ref country code: SE

Ref legal event code: EUG

REG Reference to a national code

Ref country code: NL

Ref legal event code: MM

Effective date: 20170101

REG Reference to a national code

Ref country code: AT

Ref legal event code: MM01

Ref document number: 527724

Country of ref document: AT

Kind code of ref document: T

Effective date: 20161201

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: SE

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161202

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: NL

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20170101

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: CH

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161231

Ref country code: AT

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

Ref country code: LI

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161231

Ref country code: IT

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

REG Reference to a national code

Ref country code: FR

Ref legal event code: PLFP

Year of fee payment: 11

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: DK

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161231

REG Reference to a national code

Ref country code: BE

Ref legal event code: MM

Effective date: 20161231

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: PL

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: ES

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161202

REG Reference to a national code

Ref country code: ES

Ref legal event code: FD2A

Effective date: 20181120

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: TR

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20161201

P01 Opt-out of the competence of the unified patent court (upc) registered

Effective date: 20230603

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: DE

Payment date: 20241227

Year of fee payment: 18

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: GB

Payment date: 20251223

Year of fee payment: 19

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: FR

Payment date: 20251223

Year of fee payment: 19