EP0858178A1 - Verfahren und Vorrichtung zum Mischen von digitalen Audio-Signalen - Google Patents
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- H04H60/04—Studio equipment; Interconnection of studios
Definitions
- Digital mixing consoles make it possible to use several sound signals arriving at different channels individually or collectively to any outputs.
- the individual sound signals changed and combined with other sound signals. It means that the possibility should exist to usually add a factor to each signal multiply and add with other signals and possibly also the Delay sound signals.
- DSP's digital signal processors
- Known digital mixing consoles therefore have devices in which the inputs are connected in pairs or in groups to digital signal processors (DSP's) which are able to carry out such operations as addition, multiplication and storage of audio signals without problems.
- DSP's digital signal processors
- These problems caused by the large amount of data are usually alleviated by assigning only a small number of inputs to a signal processor, which means that for a given number of inputs and outputs, several signal processors are provided which have to be cascaded.
- TDM buses or systems with shared memories so-called “shared memory” systems
- shared memory so-called “shared memory” systems
- a TDM bus is a parallel bus that provides a time window for the data from each input channel, so that the signals in the bus appear in series.
- DPRAM memory it is also conceivable to use DPRAM memory for this and to connect the processors to one another like a so-called “daisy chain”.
- all of these solutions are technically complex and expensive.
- the invention as characterized in the claims therefore solves the Task a method and an apparatus for mixing digital To create audio signals that are much easier and cheaper.
- the inputs 1 to m each lead to a processing unit 10, 11, 12, 13, which can be constructed either as a digitally operating signal processor DSP or in some other way as a unit for digital signal processing.
- a processing unit can also be connected to a plurality of inputs, as is indicated for the processing unit 10 with the inputs 1, 2 and 3.
- a summator 17, 18, 19, 20 is connected upstream of each output 21 to n.
- Each Processing unit 10, 11, 12, 13 and thus each input 1 to m is connected via connections to several or ideally all outputs 21 to n. This is done for the processing unit 10 here via lines 101, 102, 103, 104 which lead from corresponding outputs on the processing units 10 to 13 to inputs on the summers 17 to 20. In Fig. 1 such inputs and outputs and part of the necessary connections are shown. All connections have been omitted to ensure the clarity of the representation.
- the outputs, such as output 21 here can also lead to a format converter 24, which in turn can have a plurality of parallel outputs 25. This is particularly the case when audio signals from several channels are supplied in series via one input. These audio signals can then be output in parallel.
- a further processing element 26 can be inserted into the lines 101, 102, etc., which can weaken or amplify the signal.
- Such a further processing element 26 is connected together with the other processing elements 10 to 13 via control lines 28 to an operating unit 27 which has those operating elements which are usually present on the user interface of a mixing console.
- the format converter 24 can also be a digital signal processor (DSP) or another signal processing element.
- the summers 17 to 20 preferably form a sum bus in a digitally operating audio mixer.
- Fig. 2 shows an embodiment of a summer 17 to 20.
- Audio signals from more than four inputs 39, 40, 41, 42 will be processed the structure is supplemented by three further two-bit adders 45, 46, 47.
- the Outputs 48, 49 of the two-bit adders 32 and 47 open into one additional two-bit adder 50.
- Fig. 3 shows a special embodiment of a processing element 26 as it is known from FIG. 1.
- This in turn consists of a totalizer 51 with an output 52 and, for example, three inputs 53, 54, 55.
- Multipliers 56, 57, 58, each with two inputs 59, are connected upstream of these and 60, 61 and 62, 63 and 64.
- Input 63 is direct for the unchanged data stream provided.
- Received inputs 61 and 59 delays the data stream from delay units 65 or 66.
- Lines 67 indicate first clock signals that control the processes in the bit grid.
- the data words are in the direction of a Arrow 70 moves.
- Each data word W is in such an order formats that the least significant bit 68 and last that most significant bit 69 occurs.
- FIG. 5 shows a representation of data words corresponding to FIG. 4 there is a time delay between data words W11, W12 and W13 corresponding to the time period assigned to one or two or more bits is provided, which causes the data words W11, W12 and W13 to one or two or more bits are shown spatially or temporally offset.
- the device works as follows: Digitized audio signals arrive via inputs 1 to n and are formatted in processing units 10 to 13 in a manner known per se so that the least significant bit is output first and the most significant bit is output last. This can be achieved by means of a corresponding readout instruction from a buffer store. All audio signals output by the processing units 10 to 13 or possibly also all input audio signals are synchronized with the first clock signal 67, so that each bit in the device is treated synchronously, as is shown in FIGS. 4 and 5. In addition, the data words are read out from the processing units 10 to 13 word-synchronously, as shown in FIG. 4. The individual outputs of the processing units 10 to 13 are controlled via the operating unit 27 and the control lines 28. This specifies for each output of a processing unit whether an audio signal is emitted there and to what extent.
- Each summer 17 to 20 now receives audio signals from lines 101 to 104, etc., which it has to sum and then output to its output 21 to n. It can also happen that several audio signals arrive in series via an input. Such signals are treated in the same way as a single signal. After the output, however, they can be passed on in parallel, as is indicated for the output 21 and the parallel outputs 25.
- the summation of the bit-synchronized audio signals in the summers 17 to 20 can be explained with the aid of FIG. 2. Two signals a and b are at the inputs 39 and 40, two further signals b and c at the inputs 41 and 42.
- the signals a and b are summed in the two-bit adder 30 according to the following formula or instruction: (! A AND! B AND cy) OR (! A AND b AND! Cy) OR (a AND! B AND! Cy) OR (a AND b AND cy)
- the transfer cy is treated according to the following rule: (a AND b AND! pr) OR (a AND cy AND! pr) OR (b AND cy AND!
- the data streams thus summed leave the summer via the output 21. Then they can be formatted in the format converter 24, for example, so that the most significant bit in the data word now precedes them. Or the data stream can be divided and output in parallel over a number of lines 25.
- the value of the input signals can be changed or weighted in the processing units 10 to 13 before the summation. However, this can also be done in a processing element 26. If the processing element 26 is designed as a device according to FIG. 3, a sound signal is fed via the input 63 to the multiplier 58 on the one hand and to the delay unit 65 on the other hand. The output signal from the delay unit 65 is fed to both the multiplier 57 and the further delay unit 66.
- the signals applied to the multipliers 56, 57 and 58 are each offset by one bit, which is caused by the delay units 65, 66.
- the multipliers 56, 57, 58 are also each provided with a bit of a multiplier or factor by inputs 60, 62 and 64, with which the signal in input 63 is to be multiplied.
- a data word arriving via input 63 is multiplied bit by bit in multiplier 58 by the first bit of the factor, in adder 57 by the second bit and in adder 56 by the third bit of the factor. This results in three data words offset from one another by one bit, which are summed in summer 40. In other words, a situation arises as shown in FIG.
- an audio signal 63 is to be divided into several identical parallel signals 63, 61, 59 and delayed by one bit each with increasing delay. Then the original signal and the delayed signals should each be added with one bit of a factor expressed in a digital value and the resulting signals should then be summed bit by bit to form a changed signal.
Abstract
Description
Diese durch die grosse Datenmenge verursachten Probleme werden üblicherweise dadurch entschärft, dass eben einem Signalprozessor nur eine geringe Anzahl Eingänge zugeordnet wird, was bedeutet, dass bei einer gegebenen Anzahl Ein- und Ausgänge mehrere Signalprozessoren vorgesehen werden, die zu Kaskaden geschaltet werden müssen. Das grösste Problem ist dabei die Summierung der Tonsignale aus einer grossen Anzahl Eingänge oder eben aus mehreren solchen Signalprozessoren in einem sogenannten Summenbus.
Als Summenbus sind deshalb bereits Lösungen mit sogenannten TDM-Bussen oder Systeme mit gemeinsamen Speichern, sog. "shared memory"-Systeme bekannt geworden. Ein TDM-Bus ist ein Parallelbus der für die Daten aus jedem Eingangskanal ein Zeitfenster bereithält, so dass die Signale im Bus seriell hintereinander geschaltet auftreten. Ebenso ist es denkbar dafür DPRAM-Speicher einzusetzen und die Prozessoren wie eine sogenannte "daisy-chain" untereinander zu verbinden. Allerdings sind alle diese Lösungen technisch aufwendig und teuer.
Verarbeitungseinheit 10, 11, 12, 13 und damit jeder Eingang 1 bis m ist über Verbindungen mit mehreren oder idealerweise allen Ausgängen 21 bis n verbunden. Dies geschieht für die Verarbeitungseinheit 10 hier über Leitungen 101, 102, 103, 104 die von entsprechenden Ausgängen an den Verarbeitungseinheiten 10 bis 13 zu Eingängen an den Summierern 17 bis 20 führen. In Fig. 1 sind solche Ein- und Ausgänge und ein Teil der notwendigen Verbindungen eingezeichnet. Auf die Darstellung aller Verbindungen wurde verzichtet um die Klarheit der Darstellung zu gewährleisten. Wahlweise können die Ausgänge, wie hier Ausgang 21, auch in einen Formatkonverter 24 münden, der wiederum mehrere parallele Ausgänge 25 aufweisen kann. Dies insbesondere dann, wenn über einen Eingang Audiosignale aus mehreren Kanälen seriell zugeführt werden. Diese Audiosignale können dann parallel ausgegeben werden. Weiter kann in die Leitungen 101, 102, usw. ein weiteres Verarbeitungselement 26 eingefügt sein, das das Signal abschwächen oder verstärken kann. Ein solches weiteres Verarbeitungselement 26 ist zusammen mit den anderen Verarbeitungselementen 10 bis 13 über Steuerleitungen 28 mit einer Bedienungseinheit 27 verbunden, welche diejenigen Bedienungselemente aufweist, die üblicherweise auf der Bedieneroberfläche eines Mischpultes vorhanden sind. Der Formatkonverter 24 kann ebenfalls ein digital arbeitender Signalprozessor (DSP) oder sonst ein signalverarbeitendes Element sein. Vorzugsweise bilden die Summierer 17 bis 20 einen Summenbus in einem digital arbeitenden Audio-Mischpult.
Digitalisierte Tonsignal triffen über die Eingänge 1 bis n ein und werden in den Verarbeitungseinheiten 10 bis 13 in an sich bekannter Weise so formatiert, dass das niedrigstwertige Bit zuerst und das höchstwertige Bit zuletzt ausgegeben wird. Dies ist durch eine entsprechende Auslesevorschrift aus einem Zwischenspeicher zu erreichen. Alle von den Verarbeitungseinheiten 10 bis 13 ausgegebenen oder eventuall auch alle eingegebenen Audiosignale werden mit dem ersten Taktsignal 67 synchronisiert, so dass jedes Bit in der Vorrichtung synchron behandelt wird, wie dies in den Fig. 4 und 5 dargestellt ist. Zudem erfolgt das Auslesen der Datenworte aus den Verarbeitungseinheiten 10 bis 13 wortsynchron, wie dies die Fig. 4 zeigt. Über die Bedienungseinheit 27 und die Steuerleitungen 28 werden die einzelnen Ausgänge der Verarbeitungseinheiten 10 bis 13 angesteuert. Damit wird für jeden Ausgang einer Verarbeitungseinheit vorgegeben ob dort ein Audiosignal abgegeben wird und in welcher Stärke.
Die Summierung der bitweise synchronisierten Audiosignale in den Summierern 17 bis 20 kann mit Hilfe der Fig. 2 erklärt werden. Je zwei Signale a und b liegen an den Eingängen 39 und 40, weitere zwei Signale b und c an den Eingängen 41 und 42. An den Eingängen 33, 34 und 35 liegt ein erstes Taktsignal für die bitweise Synchronisierung und an den Eingängen 36, 37 und 38 liegt ein weiteres Taktsignal an, das den Anfanng (oder das Ende) eines Datenwortes angibt und damit die Wortsynchronisation bewirkt. Das weitere Taktsignal ist dabei vom ersten Taktsignal abgeleitet. Dabei werden die Signale a und b im Zweibitaddierer 30 nach folgender Formel oder Instruktion summiert: (!a UND !b UND cy) ODER (!a UND b UND !cy) ODER (a UND !b UND !cy) ODER (a UND b UND cy)
Dabei wird der Übertrag cy nach folgender Regel behandelt:
(a UND b UND !pr) ODER (a UND cy UND !pr) ODER (b UND cy UND !pr),
wobei pr ein angelegtes weiteres Taktsignal für das Wortende und !pr Fehlen eines solchen Signales bedeutet (!steht allg. für Fehlen des entspr. Signales). Die anderen Zweibitaddierer arbeiten nach dem gleichen Prinzip und ergeben immer aus zwei Eingangssignalen ein Ausgangssignal. So kann mit der gezeigten Struktur eine beliebige Anzahl Eingangssignale summiert werden. Diese Verarbeitung entspricht der Addition von mehrstelligen Zahlen wie sie im Kopf des Menschen oder bei grösseren Zahlen mit Hilfe einer Rechenmethode durchgeführt und in der Schule gelehrt wird. Das bedeutet, dass zuerst alle niedrigstwertigen Bit 68 addiert werden, wobei ein Übertrag gespeichert wird, so dass er bei der Addition der nächsthöheren Bit zugerechnet werden kann. Zuletzt werden die höchstwertigen Bit 69 untereinander addiert und, sofern vorhanden, der letzte Übertrag berücksichtigt. Die so summierten Datenströme verlassen den Summierer über den Ausgang 21. Dann können sie im Formatkonverter 24 beispielsweise so formatiert werden, dass nun das höchstwertige Bit im Datenwort vorausgeht. Oder der Datenstrom kann aufgeteilt werden und über mehrere Leitungen 25 parallel ausgegeben werden.
Die Eingangssignale können dabei in ihrem Wert in den Verarbeitungseinheiten 10 bis 13 vor der Summierung verändert oder gewichtet werden. Dies kann aber auch in einem Verarbeitungselement 26 geschehen.
Ist das Verarbeitungselement 26 als Vorrichtung gemäss Fig. 3 ausgebildet, so wird ein Tonsignal über den Eingang 63 einerseits dem Multiplizierer 58 und andererseits der Verzögerungseinheit 65 zugeführt. Aus der Verzögerungseinheit 65 wird das Ausgangssignal sowohl dem Multiplizierer 57 als auch der weiteren Verzögerungseinheit 66 zugeführt. So sind die Signale, die an den Multiplizierern 56, 57 und 58 anlegen jeweils um ein Bit zueinander versetzt, was durch die Verzögerungseinheiten 65, 66 bewirkt wird. Parallel dazu liegen an den Multiplizierern 56, 57, 58 über die Eingänge 60, 62 und 64 auch je ein Bit eines Multiplikators oder Faktors an, mit dem das Signal im Eingang 63 multipliziert werden soll. So wird ein über den Eingang 63 eintreffendes Datenwort im Multiplizierer 58 mit dem ersten Bit des Faktors, im Addierer 57 mit dem zweiten Bit und im Addierer 56 mit dem dritten Bit des Faktors bitweise multipliziert. So entstehen drei zueinander um ein Bit versetzte Datenwörter, die im Summierer 40 summiert werden. Mit anderen Worten entsteht eine Situation, wie sie Fig. 5 zeigt, so dass die drei Datenworte W11, W12 und W13 nur noch bitweise summiert werden müssen. So soll ein Audiosignal 63 in mehrere gleiche parallele Signale 63, 61, 59 aufgeteilt und mit aufsteigender Verzögerung um je ein Bit verzögert werden. Dann soll das ursprüngliche Signal und die verzögerten Signale mit je einem Bit eines in einem digitalen Wert ausgedrückten Faktor addiert und anschliessend die resultierenden Signale bitweise zu einem veränderten Signal summmiert werden.
Claims (10)
- Verfahren zum Mischen von digitalen Audio-Signalen aus einer ersten Anzahl Eingängen (1 bis m) in eine zweite Anzahl (21 bis n) Ausgänge, dadurch gekennzeichnet, dass die Datenworte der eingehenden Audio-Signale so zueinander geführt werden, dass die Datenbit in aufsteigender Reihenfolge mit dem niedrigstwertigen Bit voraus, in parallelen Datenströmen wort- und bitweise synchronisiert auftreten und bitweise summiert werden.
- Verfahren nach Anspruch 1, dadurch gekennzeichnet, dass ein Audiosignal (63) in mehrere gleiche parallele Signale (63, 61, 59) aufgeteilt und mit aufsteigender Verzögerung um je ein Bit verzögert wird und dass das Signal (63) und die verzögerten Signale (61, 59) mit je einem Bit eines in einem digitalen Wert ausgedrückten Faktor addiert und anschliessend die resultierenden Signale (53; 54, 55) bitweise zu einem veränderten Signal summmiert werden (52).
- Vorrichtung zum Mischen digitaler Audio-Signale mit einer ersten Anzahl m Eingängen (1, 2, 3, 4, 5, m) und einer zweiten Anzahl n Ausgängen (21, 22, 23, n), wobei mindestens ein Teil der Eingänge über je ein Verarbeitungselement (10 bis 13) mit mindestens einem Teil der n Ausgänge verbunden ist, dadurch gekennzeichnet, dass einem Ausgang ein Summierer (17, 18, 19, 20) vorgeschaltet ist, der mit mindestens einem Teil seiner Eingänge mit den Verarbeitungselementen (10 bis 13) verbunden ist.
- Vorrichtung nach Anspruch 3, dadurch gekennzeichnet, dass der Summierer zum bitweisen Summieren beginnend mit dem niedrigstwertigen Bit ausgebildet ist.
- Vorrichtung nach Anspruch 3, dadurch gekennzeichnet, dass der Summierer aus mindestens einem Zwei- oder Mehrbitaddierer (32) aufgebaut ist.
- Vorrichtung nach Anspruch 3, dadurch gekennzeichnet, dass der Summierer aus mindestens drei Zwei-oder Mehrbitaddierern (30, 31, 32) aufgebaut ist, die in Kaskade geschaltet sind.
- Vorrichtung nach Anspruch 3, dadurch gekennzeichnet, dass ein Verarbeitungselement (10 bis 13) aus einem digital arbeitenden Signalprozessor besteht.
- Vorrichtung nach Anspruch 3, dadurch gekennzeichnet, dass ein Verarbeitungselement aus einem Summierer (51), mindestens einem Multiplizierer (56, 57, 58) und mindestens einer Verzögerungseinheit (65, 66) aufgebaut ist.
- Vorrichtung nach Anspruch 8, dadurch gekennzeichnet, dass die Verzögerungseinheit (65, 66), der Multiplizierer (56, 57) und der Summierer (51) für mindestens einen Eingang (53, 54) des Summierers in Serie geschaltet sind.
- Vorrichtung nach Anspruch 3, dadurch gekennzeichnet, dass ein oder mehrere Summierer (17, 18, 19, 20) einen Summenbus für ein digital arbeitendes Audio-Mischpult bilden.
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CH262/97 | 1997-02-06 | ||
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Publications (2)
Publication Number | Publication Date |
---|---|
EP0858178A1 true EP0858178A1 (de) | 1998-08-12 |
EP0858178B1 EP0858178B1 (de) | 2006-06-21 |
Family
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
EP98100793A Expired - Lifetime EP0858178B1 (de) | 1997-02-06 | 1998-01-19 | Verfahren und Vorrichtung zum Mischen von digitalen Audio-Signalen |
Country Status (3)
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---|---|
US (1) | US6330338B1 (de) |
EP (1) | EP0858178B1 (de) |
DE (1) | DE59813605D1 (de) |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7062336B1 (en) * | 1999-10-08 | 2006-06-13 | Realtek Semiconductor Corp. | Time-division method for playing multi-channel voice signals |
DE10210443A1 (de) * | 2002-03-09 | 2003-09-18 | Bts Media Solutions Gmbh | Verfahren und Vorrichtung zum Verarbeiten von Signalen |
US20060023900A1 (en) * | 2004-07-28 | 2006-02-02 | Erhart George W | Method and apparatus for priority based audio mixing |
WO2006089148A2 (en) * | 2005-02-17 | 2006-08-24 | Panasonic Automotive Systems Company Of America Division Of Panasonic Corporation Of North America | Method and apparatus for optimizing reproduction of audio source material in an audio system |
US7869609B2 (en) * | 2005-08-22 | 2011-01-11 | Freescale Semiconductor, Inc. | Bounded signal mixer and method of operation |
DE102006030977A1 (de) * | 2006-07-03 | 2008-02-07 | Deutsche Thomson-Brandt Gmbh | Datenübertragungsverfahren und Gerät zur Durchführung des Verfahrens |
JP5246044B2 (ja) * | 2009-05-29 | 2013-07-24 | ヤマハ株式会社 | 音響装置 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2552958A1 (fr) * | 1983-10-03 | 1985-04-05 | Moulin Andre | Console numerique de traitements de signaux |
EP0342530A1 (de) * | 1988-05-11 | 1989-11-23 | Siemens Aktiengesellschaft Österreich | Koppelfeld für digitale Audiosignale |
AT389784B (de) * | 1987-09-10 | 1990-01-25 | Siemens Ag Oesterreich | Verfahren zur verarbeitung und konzentration von digitalen audiosignalen |
EP0462799A2 (de) * | 1990-06-21 | 1991-12-27 | Matsushita Electric Industrial Co., Ltd. | Digitale Mischschaltung |
Family Cites Families (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH087941B2 (ja) * | 1986-04-10 | 1996-01-29 | ソニー株式会社 | デジタル再生機器の同期方法 |
JPH0782423B2 (ja) * | 1987-09-16 | 1995-09-06 | 三洋電機株式会社 | データ入出力回路 |
US5524074A (en) * | 1992-06-29 | 1996-06-04 | E-Mu Systems, Inc. | Digital signal processor for adding harmonic content to digital audio signals |
US5592403A (en) * | 1993-03-11 | 1997-01-07 | Monolith Technologies Corporation | Digital-to-analog converter including integral digital audio filter |
JP3443938B2 (ja) * | 1994-03-31 | 2003-09-08 | ソニー株式会社 | ディジタル信号処理装置 |
US5621805A (en) * | 1994-06-07 | 1997-04-15 | Aztech Systems Ltd. | Apparatus for sample rate conversion |
US5517433A (en) * | 1994-07-07 | 1996-05-14 | Remote Intelligence, Inc. | Parallel digital data communications |
US5647008A (en) * | 1995-02-22 | 1997-07-08 | Aztech Systems Ltd. | Method and apparatus for digital mixing of audio signals in multimedia platforms |
US5774567A (en) * | 1995-04-11 | 1998-06-30 | Apple Computer, Inc. | Audio codec with digital level adjustment and flexible channel assignment |
GB2301003B (en) * | 1995-05-19 | 2000-03-01 | Sony Uk Ltd | Audio mixing console |
US5703794A (en) * | 1995-06-20 | 1997-12-30 | Microsoft Corporation | Method and system for mixing audio streams in a computing system |
FR2743228B1 (fr) * | 1995-12-29 | 1998-03-20 | Sgs Thomson Microelectronics | Systeme de melange et de numerisation de signaux analogiques |
-
1998
- 1998-01-19 DE DE59813605T patent/DE59813605D1/de not_active Expired - Lifetime
- 1998-01-19 EP EP98100793A patent/EP0858178B1/de not_active Expired - Lifetime
- 1998-02-05 US US09/018,915 patent/US6330338B1/en not_active Expired - Lifetime
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2552958A1 (fr) * | 1983-10-03 | 1985-04-05 | Moulin Andre | Console numerique de traitements de signaux |
AT389784B (de) * | 1987-09-10 | 1990-01-25 | Siemens Ag Oesterreich | Verfahren zur verarbeitung und konzentration von digitalen audiosignalen |
EP0342530A1 (de) * | 1988-05-11 | 1989-11-23 | Siemens Aktiengesellschaft Österreich | Koppelfeld für digitale Audiosignale |
EP0462799A2 (de) * | 1990-06-21 | 1991-12-27 | Matsushita Electric Industrial Co., Ltd. | Digitale Mischschaltung |
Non-Patent Citations (1)
Title |
---|
TERUO FUJINO ET AL: "DIGITAL MIXING CONSOLE MEETS PROFESSIONAL MIXING NEEDS", JEE JOURNAL OF ELECTRONIC ENGINEERING, vol. 28, 1 January 1991 (1991-01-01), pages 38 - 42, XP000230856 * |
Also Published As
Publication number | Publication date |
---|---|
DE59813605D1 (de) | 2006-08-03 |
EP0858178B1 (de) | 2006-06-21 |
US6330338B1 (en) | 2001-12-11 |
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