DE69327612D1 - Schaltung und Verfahren zur Generierung eines stabilen Taktsignals mit Frequenzvervielfachung - Google Patents

Schaltung und Verfahren zur Generierung eines stabilen Taktsignals mit Frequenzvervielfachung

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Families Citing this family (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5430394A (en) * 1994-03-11 1995-07-04 Advanced Micro Devices, Inc. Configuration and method for testing a delay chain within a microprocessor clock generator
US5570294A (en) * 1994-03-11 1996-10-29 Advanced Micro Devices Circuit configuration employing a compare unit for testing variably controlled delay units
US5617563A (en) * 1994-11-04 1997-04-01 Sony Corporation Of Japan Duty cycle independent tunable clock
JP3505018B2 (ja) * 1994-11-22 2004-03-08 株式会社ルネサステクノロジ 半導体集積回路
EP0743756B1 (de) * 1995-05-05 1997-08-13 Siemens Aktiengesellschaft Konfigurierbare integrierte Schaltung
JP3442924B2 (ja) * 1996-04-01 2003-09-02 株式会社東芝 周波数逓倍回路
DE19844481C1 (de) * 1998-09-28 2000-05-25 Siemens Ag Integrierte Schaltung mit einer Kontaktierungsstelle zum Wählen einer Betriebsart der integrierten Schaltung
JP3883090B2 (ja) * 1999-02-17 2007-02-21 富士通株式会社 データ再生システムにおけるクロック調整装置
CA2270516C (en) * 1999-04-30 2009-11-17 Mosaid Technologies Incorporated Frequency-doubling delay locked loop
US6671817B1 (en) * 2000-03-15 2003-12-30 Nortel Networks Limited Method and apparatus for producing a clock signal having an initial state at reference point of incoming signal thereafter changing state after a predetermined time interval
DE10149585C2 (de) 2001-10-08 2003-11-20 Infineon Technologies Ag Integrierbare, steuerbare Verzögerungseinrichtung, Verwendung einer Verzögerungseinrichtung sowie Verfahren zum Betrieb einer Verzögerungseinrichtung
DE10301239B4 (de) * 2003-01-15 2005-04-28 Infineon Technologies Ag Verfahren und Vorrichtung zur Erzeugung von verzögerten Signalen
US7126396B1 (en) * 2003-07-16 2006-10-24 National Semiconductor Corporation System for clock duty cycle stabilization
JP2006217455A (ja) * 2005-02-07 2006-08-17 Kawasaki Microelectronics Kk リングオシレータ回路
JP2008042501A (ja) * 2006-08-04 2008-02-21 Nippon Telegr & Teleph Corp <Ntt> 電子回路装置
US7592844B2 (en) * 2007-01-19 2009-09-22 Power Integrations, Inc. Comparator with complementary differential input stages
JP2009005029A (ja) * 2007-06-20 2009-01-08 Nippon Telegr & Teleph Corp <Ntt> 電子回路装置
JP5486354B2 (ja) * 2010-03-08 2014-05-07 ラピスセミコンダクタ株式会社 データ伝送回路
JP7255790B2 (ja) * 2018-06-15 2023-04-11 三菱重工業株式会社 半導体装置

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4217639A (en) * 1978-10-02 1980-08-12 Honeywell Information Systems Inc. Logic for generating multiple clock pulses within a single clock cycle
US4316148A (en) * 1979-09-04 1982-02-16 Sperry Corporation Variable frequency logic clock
US4638256A (en) * 1985-08-15 1987-01-20 Ncr Corporation Edge triggered clock distribution system
US5018111A (en) * 1988-12-27 1991-05-21 Intel Corporation Timing circuit for memory employing reset function

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EP0570158A3 (en) 1994-06-22
JPH06202756A (ja) 1994-07-22
EP0570158A2 (de) 1993-11-18

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