DE3724795A1 - D/a- und a/d-wandler mit naeherungsweise idealer logarithmischer kennlinie - Google Patents
D/a- und a/d-wandler mit naeherungsweise idealer logarithmischer kennlinieInfo
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Description
Um bei der Digitalisierung von Musik und Sprache das Quantisierungsrauschen
bei kleinen Amplituden der Signale zu senken, werden
A/D- und D/A-Wandler verwendet, die eine möglichst logarithmische
Kennlinie haben.
Stand der Technik ist es, lineare Wandler, denen logarithmische
Verstärker vorgeschaltet bzw. nachgeschaltet werden, zu verwenden
oder die Kennlinien der Wandler werden unter Verwendung von nichtlinearen
Bauteilen (Dioden, Transistoren) gekrümmt.
Nachteilig ist dabei der hohe Aufwand und die hohe Temperaturabhängigkeit
der nichtlinearen Bauteile.
Ein anderes Verfahren kodiert unter Erhöhung der Wortbreite das
Bit-Muster, wodurch ebenfalls der Aufwand steigt.
(siehe Pat. Nr. 31 20 669.)
Aufgabe der Erfindung ist es, einen logarithmischen D/A-A/D-Wandler
zu beschreiben, der mit linearen Bauteilen bei geringem Aufwand und
ohne Abgleich arbeitet und nahezu frei von Temperaturdrift ist.
Bei der Berechnung des R2R-Widerstandsnetzwerkes ergibt sich:
N ist der binäre Zahlenwert, der sich aus den Stellungen der
Analogschalter ergibt.
A = Ausgang
E = Eingang
E = Eingang
Bei der Berechnung des Eingangs (7) in Abhängigkeit des Ausgangs (6)
und des Referenzeingangs (4) ergibt sich:
Bei Gleichsetzung der Formeln 1 und 2 ergibt sich:
1024A = N (URef + 7A)
1024A = N · URef + 7A N
1024 - 7A N = N URef
A (1024 - 7N) = N URef
1024A = N · URef + 7A N
1024 - 7A N = N URef
A (1024 - 7N) = N URef
Der so ausgebildete Ausgangswert (Bild 3) wird mit dem
hochwertigsten Bit durch den OP (12) gedreht (Bild 2).
Die Funktion ist in Bild 4 dargestellt.
Durch Vorschalten eines Sukzessiven-Approximations-Registers (14)
(Bild 2) und eines Komparators (13) wird die Schaltung aus Bild 1
zu einem A/D-Wandler erweitert. Der Komparator (13) vergleicht dabei
ständig den Analog-Eingang mit dem Analog-Ausgang. Das Ergebnis wird
in Abhängigkeit des hochwertigsten Bits mit dem Gatter (10) gedreht
und dem Approximations-Register rückgemeldet. Mit dem Tri-State-Treiber
(9) können die Ausgänge des Approximations-Registers hochohmig
geschaltet werden, wodurch sich die Gesamtschaltung als
A/D- und als D/A-Wandler nutzen läßt.
Claims (6)
1. D/A-Wandler und A/D-Wandler mit näherungsweise idealer
logarithmischer Kennlinie,
dadurch gekennzeichnet, daß ein R2R-Widerstandsnetzwerk
so angeordnet ist, daß am Ausgang ein Spannungssignal zur
Verfügung steht, welches mit einem Treiber (1) niederohmig
gemacht wird und als Ausgang des A/D-Wandlers verwendet wird und
gleichzeitig über zwei in Reihe geschaltete Widerstände (2) (3) mit
dem Referenzeingang (4) verbunden ist, wobei der Mittelabgriff der
zwei Widerstände, nachdem er mit dem Treiber (5) niederohmig gemacht
wurde, als Spannungseingang für das R2R-Widerstandsnetzwerk verwendet
wird.
2. Einrichtung nach Anspruch 1,
dadurch gekennzeichnet, daß die beschriebene D/A-Wandler-Schaltung
mit Hilfe eines Sukzessiven-Approximations-Registers zum A/D-Wandler
mit logarithmischer Kennlinie erweitert wird.
3. Einrichtung nach Anspruch 1 und 2,
dadurch gekennzeichnet, daß hinter dem Sukzessiven-Approximations-Register
ein Tri-State-Treiber (9) geschaltet wird, so daß die Gesamtschaltung
als A/D- und D/A-Wandler genutzt werden kann.
4. Einrichtung nach Anspruch 1 bis 3,
dadurch gekennzeichnet, daß die Widerstände (3) und (2) durch ein
komplexes Netzwerk ersetzt werden, um die Kennlinie weiter zu
verbessern.
5. Einrichtung nach Anspruch 1 bis 4,
dadurch gekennzeichnet, daß der Ausgang der D/A-Wandlerschaltung
durch das hochwertigste Bit gedreht wird.
6. Einrichtung nach Anspruch 1 bis 5,
dadurch gekennzeichnet, daß der Referenzeingang der D/A-Wandlerschaltung
durch das hochwertigste Bit gedreht wird.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19873724795 DE3724795A1 (de) | 1987-07-27 | 1987-07-27 | D/a- und a/d-wandler mit naeherungsweise idealer logarithmischer kennlinie |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19873724795 DE3724795A1 (de) | 1987-07-27 | 1987-07-27 | D/a- und a/d-wandler mit naeherungsweise idealer logarithmischer kennlinie |
Publications (1)
Publication Number | Publication Date |
---|---|
DE3724795A1 true DE3724795A1 (de) | 1989-02-09 |
Family
ID=6332424
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19873724795 Withdrawn DE3724795A1 (de) | 1987-07-27 | 1987-07-27 | D/a- und a/d-wandler mit naeherungsweise idealer logarithmischer kennlinie |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE3724795A1 (de) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102014202470A1 (de) | 2014-02-11 | 2015-08-13 | Continental Teves Ag & Co. Ohg | Additive DA-Wandlung über einen einzigen R2R-Netzwerk-Zweig |
-
1987
- 1987-07-27 DE DE19873724795 patent/DE3724795A1/de not_active Withdrawn
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102014202470A1 (de) | 2014-02-11 | 2015-08-13 | Continental Teves Ag & Co. Ohg | Additive DA-Wandlung über einen einzigen R2R-Netzwerk-Zweig |
DE102014202470B4 (de) | 2014-02-11 | 2023-01-12 | Continental Automotive Technologies GmbH | Additive DA-Wandlung über einen einzigen R2R-Netzwerk-Zweig |
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