DE3628374A1 - Verfahren zum herstellen von aus polykristallinem silizium bestehenden schichtstrukturen, insbesondere fuer emitteranschlussgebiete in integrierten halbleiterschaltungen - Google Patents
Verfahren zum herstellen von aus polykristallinem silizium bestehenden schichtstrukturen, insbesondere fuer emitteranschlussgebiete in integrierten halbleiterschaltungenInfo
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Description
Die Erfindung betrifft ein Verfahren zum Herstellen von
aus polykristallinem Silizium bestehenden Schichtstruk
turen auf einkristallinen Siliziumsubstraten aus der
Gasphase, wie sie insbesondere als Emitteranschlußge
biete für Bipolartransistoranordnungen in integrierten
Halbleiterschaltungen verwendet werden.
In schnellen Bipolartransistorschaltungen der VLSI
(= very large scale integration)-Technik werden Transi
storen mit aus polykristallinem Silizium bestehenden
Emitteranschlußgebieten (sogenannte Polysil-Emitter)
verwendet, die neben der Nutzung als Verdrahtungsebene
auch als Diffusionsquelle zur Herstellung der Emitter
zone im einkristallinen Substrat dienen. Solche Tran
sistoren, ihre Eigenschaften und ihre speziellen Herstel
lungsverfahren sind in einem Aufsatz von A. W. Wieder
"Self-Aligned Bipolar Technology - New Chances for Very-
High-Speed Digital Integrated Circuits" in den Siemens
Forsch. und Entw. Ber. Bd. 13 (1984), Nr. 5, Seiten 246
bis 252, ausführlich beschrieben.
Diese Transistoren zeichnen sich unter anderem gegenüber
konventionellen Bipolartransistoren dadurch aus, daß die
Stromverstärkung β aufgrund eines verringerten Basis
stromes stark erhöht ist. Dabei kommt der Grenzfläche
einkristallines Siliziumsubstrat/polykristallines An
schlußmaterial bei der Herstellung der Polysil-Emitter-
Transistoren eine große Bedeutung zu. Etwaige Oxide oder
Rückstände von früheren Prozeßschritten beeinflussen die
Funktion der Transistoren stark.
Aufgabe der Erfindung ist es daher, ein Verfahren zur
Herstellung der Polysil-Emitter anzugeben, bei dem ge
währleistet ist, daß vor der Abscheidung der Polysil-
Emitter eine absolut saubere Substratoberfläche vorliegt,
welche die Bedingung für die Ausbildung einer einwand
freien Grenzfläche einkristallines Silizium/polykristal
lines Silizium ist.
Bislang ist man so vorgegangen, daß man die polykristal
line Siliziumschicht mit oder ohne Dotierung durch eine
Abscheidung aus der Gasphase bei niedrigen Drucken
(LPCVD = low pressure chemical vapor deposition) herge
stellt hat. Solche Verfahren sind aus einem Aufsatz von
F. S. Becker et. al. aus dem J. Appl. Phys. 56 (4), 15.
August 1984, auf den Seiten 1233 bis 1236 zu entnehmen.
In diesen LPCVD-Anlagen ist eine der Abscheidung voraus
gehende Behandlung der Substratoberfläche nicht oder nur
schwer möglich. Es wird deshalb vor dem Einbringen der
Substrate in die CVD-Anlage zur Oxid- und Prozeßrück
stände-Entfernung ein Naßätzschritt in Flußsäure mit an
schließender Spülung und Trocknung durchgeführt.
Die Erfindung beschreitet zur Lösung der gestellten Auf
gabe einen anderen, weniger aufwendigen Weg und ist
durch ein Verfahren der eingangs genannten Art dadurch
gekennzeichnet, daß
- a) vor der Abscheidung in der gleichen, wie für die Ab scheidung vorgesehenen Anlage die Substrate einem Plasma-Ätzprozeß unterworfen werden,
- b) die Siliziumschicht im Glimmentladungsplasma zunächst im amorphen Zustand hergestellt wird, und
- c) nach der Abscheidung der amorphen Siliziumschicht zur Entfernung des in der Schicht enthaltenen Wasser stoffs ein Temperprozeß durchgeführt wird.
Durch die Verwendung einer Plasma-CVD-Anlage für die Ab
scheidung anstelle des herkömmlichen LPCVD-Reaktors ist
die Möglichkeit gegeben, in dieser Anlage unmittelbar
vor der Abscheidung einen Plasmaätzschritt vorzunehmen
und damit die Grenzfläche einkristallines Siliziumsub
strat/polykristallines Siliziumanschlußmaterial optimal
und definiert einzustellen. Bei diesem Plasma-CVD-Prozeß
handelt es sich um das aus der Anwendung von a-Si : H (=
amorphes Silizium mit Wasserstoff-Einbindung) wohlbekann
te Glowdischarge-Verfahren, bei dem Silan (Sih4) im
kapazitiv eingekoppelten Hochfrequenz-Plasma zersetzt
wird, wobei sich a-Si : H auf dem Substrat niederschlägt.
Gemäß einem Ausführungsbeispiel nach der Lehre der Erfin
dung erfolgt die Ätzung vor der Abscheidung mit einem
Fluor-Ionen enthaltenden Ätzgas, wobei Schwefelhexafluo
rid (SF6), Trifluorammoniak (NF3) und/oder Tetrafluor
kohlenstoff (CF4) verwendet werden kann. Bei Verwendung
von SF6, einer Substrattemperatur von 25°C und einem Ätz
gasdruck von 0,14 mbar bei einem Gasstrom von 100 sccm
(= Standard cm3) wird in einer Ätzzeit von ca. 2 Minuten
bei einer HFLeistung von 100 bis 150 mWatt/cm2 die Sub
stratoberfläche vollständig von Oxid befreit.
Günstige Abscheidebedingungen für die amorphe Silizium
schicht sind: Substrattemperatur 220°C, Reaktionsgas
druck 0,4 mbar bei einer Gasströmung von 100 sccm,
Hochfrequenzleistung 5 bis 10 Watt bei einer Frequenz
von 13,56 MHz, das sind 4,4 bis 8,8 mWatt/cm2. Es stellt
sich eine Abscheiderate von 1 µm/h ein. Durch Beimengun
gen geeigneter Dotiergase, wie Diboran oder Phosphin zum
Silan kann man p- oder n-dotierte Schichten herstellen.
Erzeugt man in dem Plasmareaktor ein Sauerstoffplasma,
so ist auch eine Oxidation von Silizium möglich.
Da die durch Plasma-CVD erzeugten Siliziumschichten
amorph sind und einen großen Wasserstoffgehalt (unge
fähr 10 Atom%, a-Si : H) besitzen, ist in einer Weiter
bildung des Erfindungsgedankens vorgesehen, eine Tempe
rung durchzuführen. Führt man diese Temperung bei Tem
peraturen unterhalb ca. 600°C durch, so bleibt das Si
lizium amorph und wird erst in folgenden Hochtemperatur
schritten kristallin. Tempert man dagegen höher als
600°C, so wird der Wasserstoff ausgetrieben und die
Schichten werden gleichzeitig in die polykristalline
Phase übergeführt. Es hat sich als vorteilhaft erwiesen,
die Temperung in Stickstoffatmosphäre in einem Bereich
zwischen 560°C und 625°C durchzuführen.
Claims (7)
1. Verfahren zum Herstellen von aus polykristallinem
Silizium bestehenden Schichtstrukturen auf einkristalli
nen Siliziumsubstraten aus der Gasphase, wie sie insbe
sondere als Emitteranschlußgebiete für Bipolartransistor
anordnungen in integrierten Halbleiterschaltungen ver
wendet werden, dadurch gekennzeich
net, daß
- a) vor der Abscheidung in der gleichen, wie für die Ab scheidung vorgesehenen Anlage die Substrate einem Plasma-Ätzprozeß unterworfen werden,
- b) die Siliziumschicht im Glimmentladungsplasma zunächst im amorphen Zustand hergestellt wird, und
- c) nach der Abscheidung der amorphen Siliziumschicht zur Entfernung des in der Schicht enthaltenen Wasser stoffs ein Temperprozeß durchgeführt wird.
2. Verfahren nach Anspruch 1, dadurch ge
kennzeichnet, daß die Ätzung vor der Ab
scheidung mit einem Fluor-Ionen enthaltenden Plasmaätz
gas durchgeführt wird.
3. Verfahren nach Anspruch 2, dadurch ge
kennzeichnet, daß Schwefelhexafluorid
(SF6), Trifluorammoniak (NF3) und/oder Tetrafluorkohlen
stoff (CF4) verwendet wird.
4. Verfahren nach einem der Ansprüche 1 bis 3, da
durch gekennzeichnet, daß bei einer
Substrattemperatur von 25°C der Ätzgasdruck auf 0,14
mbar bei einem Ätzgasstrom von 100 sccm (= Standard cm3)
und 100 bis 150 mWatt/cm2 HF-Leistung eingestellt wird.
5. Verfahren nach einem der Ansprüche 1 bis 4, da
durch gekennzeichnet, daß die Ab
scheidung der amorphen Siliziumschicht durch Zersetzung
von Silan (SiH4) in einem kapazitiv eingekoppelten Hoch
frequenz-Plasma durchgeführt wird.
6. Verfahren nach Anspruch 5, dadurch ge
kennzeichnet, daß während der Abscheidung
das Substrat auf einer Temperatur im Bereich von 200 bis
250°C gehalten wird, ein Reaktionsgasdruck von 0,4 mbar
und eine Gasströmung von 100 sccm eingestellt wird und
die Hochfrequenzleistung auf 4,4 bis 8,8 mWatt/cm2 ge
halten wird.
7. Verfahren nach einem der Ansprüche 1 bis 6, da
durch gekennzeichnet, daß der
Temperprozeß in Stickstoffatmosphäre in einem Tempera
turbereich zwischen 560 und 625°C durchgeführt wird.
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DE19863628374 Withdrawn DE3628374A1 (de) | 1986-08-21 | 1986-08-21 | Verfahren zum herstellen von aus polykristallinem silizium bestehenden schichtstrukturen, insbesondere fuer emitteranschlussgebiete in integrierten halbleiterschaltungen |
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0456479A2 (de) * | 1990-05-09 | 1991-11-13 | Canon Kabushiki Kaisha | Erzeugung von Mustern, Einrichtung dafür und Herstellungsverfahren für Halbleiteranordnungen mit diesem Muster |
EP0630055A2 (de) * | 1990-03-20 | 1994-12-21 | Nec Corporation | Verfahren zum Herstellen von polykristallinem Silizium mit mikrorauher Oberfläche |
US5623243A (en) * | 1990-03-20 | 1997-04-22 | Nec Corporation | Semiconductor device having polycrystalline silicon layer with uneven surface defined by hemispherical or mushroom like shape silicon grain |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3103177A1 (de) * | 1981-01-30 | 1982-08-26 | Siemens AG, 1000 Berlin und 8000 München | Verfahren zum herstellen von polysiliziumstrukturen bis in den 1 (my)m-bereich auf integrierte halbleiterschaltungen enthaltenden substraten durch plasmaaetzen |
-
1986
- 1986-08-21 DE DE19863628374 patent/DE3628374A1/de not_active Withdrawn
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3103177A1 (de) * | 1981-01-30 | 1982-08-26 | Siemens AG, 1000 Berlin und 8000 München | Verfahren zum herstellen von polysiliziumstrukturen bis in den 1 (my)m-bereich auf integrierte halbleiterschaltungen enthaltenden substraten durch plasmaaetzen |
Cited By (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0630055A2 (de) * | 1990-03-20 | 1994-12-21 | Nec Corporation | Verfahren zum Herstellen von polykristallinem Silizium mit mikrorauher Oberfläche |
EP0630055A3 (de) * | 1990-03-20 | 1995-01-04 | Nec Corp | |
US5623243A (en) * | 1990-03-20 | 1997-04-22 | Nec Corporation | Semiconductor device having polycrystalline silicon layer with uneven surface defined by hemispherical or mushroom like shape silicon grain |
US5691249A (en) * | 1990-03-20 | 1997-11-25 | Nec Corporation | Method for fabricating polycrystalline silicon having micro roughness on the surface |
US5723379A (en) * | 1990-03-20 | 1998-03-03 | Nec Corporation | Method for fabricating polycrystalline silicon having micro roughness on the surface |
EP0456479A2 (de) * | 1990-05-09 | 1991-11-13 | Canon Kabushiki Kaisha | Erzeugung von Mustern, Einrichtung dafür und Herstellungsverfahren für Halbleiteranordnungen mit diesem Muster |
US5344522A (en) * | 1990-05-09 | 1994-09-06 | Canon Kabushiki Kaisha | Pattern forming process and process for preparing semiconductor device utilizing said pattern forming process |
US5413664A (en) * | 1990-05-09 | 1995-05-09 | Canon Kabushiki Kaisha | Apparatus for preparing a semiconductor device, photo treatment apparatus, pattern forming apparatus and fabrication apparatus |
US5490896A (en) * | 1990-05-09 | 1996-02-13 | Canon Kabushiki Kaisha | Photomask or a light shielding member having a light transmitting portion and a light shielding portion |
EP0456479B1 (de) * | 1990-05-09 | 2001-01-31 | Canon Kabushiki Kaisha | Erzeugung von Mustern und Herstellungsverfahren für Halbleiteranordnungen mit diesem Muster |
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