DE19636735B4 - Mehrschichtiges Schaltungssubstrat und Verfahren zu seiner Herstellung - Google Patents
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- 239000000758 substrate Substances 0.000 title claims abstract description 86
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 15
- 238000000034 method Methods 0.000 title claims description 12
- 239000002184 metal Substances 0.000 claims abstract description 41
- 229910052751 metal Inorganic materials 0.000 claims abstract description 41
- 239000010409 thin film Substances 0.000 claims abstract description 30
- 239000000853 adhesive Substances 0.000 claims abstract description 12
- 230000001070 adhesive effect Effects 0.000 claims abstract description 12
- 239000011248 coating agent Substances 0.000 claims abstract description 8
- 238000000576 coating method Methods 0.000 claims abstract description 8
- 239000004020 conductor Substances 0.000 claims abstract description 7
- 238000005530 etching Methods 0.000 claims abstract description 5
- 238000003825 pressing Methods 0.000 claims abstract description 3
- 238000009413 insulation Methods 0.000 claims description 16
- 239000011810 insulating material Substances 0.000 claims description 12
- 239000000463 material Substances 0.000 claims description 11
- ZWEHNKRNPOVVGH-UHFFFAOYSA-N 2-Butanone Chemical compound CCC(C)=O ZWEHNKRNPOVVGH-UHFFFAOYSA-N 0.000 claims description 9
- 230000000379 polymerizing effect Effects 0.000 claims description 7
- CSCPPACGZOOCGX-UHFFFAOYSA-N Acetone Chemical compound CC(C)=O CSCPPACGZOOCGX-UHFFFAOYSA-N 0.000 claims description 6
- 229910020220 Pb—Sn Inorganic materials 0.000 claims description 6
- 150000008064 anhydrides Chemical class 0.000 claims description 6
- 229910000881 Cu alloy Inorganic materials 0.000 claims description 5
- 229910001111 Fine metal Inorganic materials 0.000 claims description 5
- 239000000919 ceramic Substances 0.000 claims description 5
- 239000000843 powder Substances 0.000 claims description 5
- 239000002904 solvent Substances 0.000 claims description 4
- 239000000956 alloy Substances 0.000 claims description 3
- 150000001875 compounds Chemical class 0.000 claims description 3
- 239000010949 copper Substances 0.000 claims description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 2
- 229910052802 copper Inorganic materials 0.000 claims description 2
- 238000002955 isolation Methods 0.000 claims description 2
- 239000010408 film Substances 0.000 abstract 1
- 239000010410 layer Substances 0.000 description 59
- 239000000976 ink Substances 0.000 description 21
- 239000012774 insulation material Substances 0.000 description 4
- 239000007769 metal material Substances 0.000 description 3
- 229910045601 alloy Inorganic materials 0.000 description 2
- 238000010292 electrical insulation Methods 0.000 description 2
- 239000002356 single layer Substances 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000009477 glass transition Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 229920002120 photoresistant polymer Polymers 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/46—Manufacturing multilayer circuits
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4846—Leads on or in insulating or insulated substrates, e.g. metallisation
- H01L21/486—Via connections through the substrate with or without pins
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4846—Leads on or in insulating or insulated substrates, e.g. metallisation
- H01L21/4857—Multilayer substrates
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/538—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates
- H01L23/5384—Conductive vias through the substrate with or without pins, e.g. buried coaxial conductors
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- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/10—Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern
- H05K3/12—Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern using thick film techniques, e.g. printing techniques to apply the conductive material or similar techniques for applying conductive paste or ink patterns
- H05K3/1258—Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern using thick film techniques, e.g. printing techniques to apply the conductive material or similar techniques for applying conductive paste or ink patterns by using a substrate provided with a shape pattern, e.g. grooves, banks, resist pattern
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- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/46—Manufacturing multilayer circuits
- H05K3/4644—Manufacturing multilayer circuits by building the multilayer layer by layer, i.e. build-up multilayer circuits
- H05K3/4664—Adding a circuit layer by thick film methods, e.g. printing techniques or by other techniques for making conductive patterns by using pastes, inks or powders
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/09—Use of materials for the conductive, e.g. metallic pattern
- H05K1/092—Dispersed materials, e.g. conductive pastes or inks
- H05K1/095—Dispersed materials, e.g. conductive pastes or inks for polymer thick films, i.e. having a permanent organic polymeric binder
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2203/00—Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
- H05K2203/05—Patterning and lithography; Masks; Details of resist
- H05K2203/0562—Details of resist
- H05K2203/0568—Resist used for applying paste, ink or powder
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/0011—Working of insulating substrates or insulating layers
- H05K3/0017—Etching of the substrate by chemical or physical means
- H05K3/0023—Etching of the substrate by chemical or physical means by exposure and development of a photosensitive insulating layer
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/10—Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern
- H05K3/107—Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern by filling grooves in the support with conductive material
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- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/38—Improvement of the adhesion between the insulating substrate and the metal
- H05K3/386—Improvement of the adhesion between the insulating substrate and the metal by the use of an organic polymeric bonding layer, e.g. adhesive
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- H05K3/44—Manufacturing insulated metal core circuits or other insulated electrically conductive core circuits
- H05K3/445—Manufacturing insulated metal core circuits or other insulated electrically conductive core circuits having insulated holes or insulated via connections through the metal core
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- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/46—Manufacturing multilayer circuits
- H05K3/4644—Manufacturing multilayer circuits by building the multilayer layer by layer, i.e. build-up multilayer circuits
- H05K3/465—Manufacturing multilayer circuits by building the multilayer layer by layer, i.e. build-up multilayer circuits by applying an insulating layer having channels for the next circuit layer
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- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/4652—Adding a circuit layer by laminating a metal foil or a preformed metal foil pattern
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Abstract
Verfahren
zur Herstellung eines mehrschichtigen Schaltungssubstrats mit den
Verfahrensschritten des
Beschichtens der Oberseite eines Substrats (10) mit einer lichtempfindlichen Isolationsschicht (20),
Belichtens und Entwickelns der lichtempfindlichen Isolationsschicht zur Ausbildung einer lichtempfindlichen Isolationsschicht mit einem bestimmten Muster (20A) und Musterzwischenräumen (22),
Ausbildens einer leitfähigen Schicht (30) durch Drucken einer leitfähigen Tinte in die Musterzwischenräume,
Ausbildens einer Anzahl von Schichten, von denen jede aus einer lichtempfindlichen Isolationsschicht eines bestimmten Musters mit Musterzwischenräumen und einer in den Musterzwischenräumen ausgebildeten leitfähigen Schicht gebildet ist, durch Wiederholen der vorhergehenden Schritte,
Beschichtens der obersten Schicht der Anzahl von Schichten mit einer adhäsiven Isolationsschich (40), Ausbildens einer Metalldünnschicht (50) auf der adhäsiven Isolationsschicht durch thermisches Pressen, und Ätzens der Metalldünnschicht zur Ausbildung eines bestimmten Metalldünnschichtmusters, und
Ausbildens mindestens eines Durchgangslochs (70), in welches ein leitfähiges Material implantiert wird und welches Substrat, leitfähige Schichten, lichtempfindliche Isolationsschichten und Metalldünnschicht zur elektrischen Verbindung der...
Beschichtens der Oberseite eines Substrats (10) mit einer lichtempfindlichen Isolationsschicht (20),
Belichtens und Entwickelns der lichtempfindlichen Isolationsschicht zur Ausbildung einer lichtempfindlichen Isolationsschicht mit einem bestimmten Muster (20A) und Musterzwischenräumen (22),
Ausbildens einer leitfähigen Schicht (30) durch Drucken einer leitfähigen Tinte in die Musterzwischenräume,
Ausbildens einer Anzahl von Schichten, von denen jede aus einer lichtempfindlichen Isolationsschicht eines bestimmten Musters mit Musterzwischenräumen und einer in den Musterzwischenräumen ausgebildeten leitfähigen Schicht gebildet ist, durch Wiederholen der vorhergehenden Schritte,
Beschichtens der obersten Schicht der Anzahl von Schichten mit einer adhäsiven Isolationsschich (40), Ausbildens einer Metalldünnschicht (50) auf der adhäsiven Isolationsschicht durch thermisches Pressen, und Ätzens der Metalldünnschicht zur Ausbildung eines bestimmten Metalldünnschichtmusters, und
Ausbildens mindestens eines Durchgangslochs (70), in welches ein leitfähiges Material implantiert wird und welches Substrat, leitfähige Schichten, lichtempfindliche Isolationsschichten und Metalldünnschicht zur elektrischen Verbindung der...
Description
- Die Erfindung bezieht sich auf ein mehrschichtiges Schaltungssubstrat und ein Verfahren zu seiner Herstellung, und richtet sich im besonderen auf ein mehrschichtiges Schaltungssubstrat und ein Verfahren zur Herstellung eines mehrschichtigen Schaltungssubstrats unter Verwendung einer leitfähigen Tinte und einer Metalldünnschicht.
- Einschichtige und mehrschichtige Schaltungssubstrate haben bei Halbleiterkomponenten bereits breite Anwendung gefunden. Insbesondere wurden mehrschichtige Schaltungssubstrate besonders untersucht, die in Übereinstimmung mit dem Trend zu hoher Integration trotz Kleinheit des Substrats viele Vorrichtungen integrieren können.
- Ein herkömmliches mehrschichtiges Schaltungssubstrat wird hergestellt, indem schichtenweise abgelagert und geätzt wird, so daß der Herstellungsprozess kompliziert ist. Außerdem beschränken sich die Materialien für das Substrat auf solche, die geätzt werden können.
- Zur Lösung eines solchen Problems wurde vom Anmelder der vorliegenden Anmeldung bereits ein Verfahren vorgeschlagen, nach welchem ein Schaltungssubstrat, statt den Ätzprozess zu verwenden, durch Bedrucken eines Substrats mit einer leitfähigen Tinte hergestellt wird. Leitfähige Tinten, wie sie vorliegendenfalls verwendet werden, sind aus WO93/06943 bekannt.
- Bei dem Verfahren der Herstellung eines mehrschichtigen Schaltungssubstrats mit diesem Druckvorgang neigt eine Schicht aus einer leitfähigen Tinte wegen der Viskosität derselben dazu, runde Formen auf dem Substrat auszubilden. Außerdem kann die Schicht aus leitfähiger Tinte wegen ihrer Ungleichmäßigkeit infolge unterschiedlicher Größen der Tintenpartikel keine Ebenheit gewährleisten, so daß das Drahtbonden auf ihrer Oberfläche nicht einfach ist.
- Aufgabe der Erfindung ist es, ein mehrschichtiges Schaltungssubstrat zu schaffen, bei welchem die Oberfläche verbessert ist. Ferner ist es Aufgabe der Erfindung, ein Verfahren zur Herstellung eines mehrschichtigen Schaltungssubstrats mit verbesserter Oberfläche zu schaffen.
- Hierzu sieht die Erfindung ein Verfahren zur Herstellung eines mehrschichtigen Schaltungssubstrats vor, welches die Verfahrensschritte des Beschichtens der Oberseite eines Substrats mit einer lichtempfindlichen Isolationsschicht, Belichtens und Entwickelns der lichtempfindlichen Isolationsschicht zur Ausbildung einer lichtempfindlichen Isolationsschicht mit einem bestimmten Muster und Musterzwischenräumen, Ausbildens einer leitfähigen Schicht durch Drucken einer leitfähigen Tinte in die Musterzwischenräume, Ausbildens einer Anzahl von Schichten, von denen jede aus einer lichtempfindlichen Isolationsschicht eines bestimmten Musters mit Musterzwischenräumen und eine in den Musterzwischenräu men ausgebildete leitfähige Schicht gebildet ist, durch Wiederholen der vorhergehenden Schritte, Beschichtens der obersten der Anzahl von der Schichten mit einer adhäsiven Isolationsschicht, Ausbildens einer Metalldünnschicht auf der adhäsiven Isolationsschicht durch thermisches Pressen, und Ätzens der Metalldünnschicht zur Ausbildung eines bestimmten Metalldünnschichtmusters, und Ausbildens mindestens eines Durchgangsloches, in welches ein leitfähiges Material implantiert wird und welches Substrat, leitfähige Schichten, lichtempfindliche Isolationsschichten und Metalldünnschichten zur elektrischen Verbindung der leitfähigen Schicht mit der gemusterten Dünnschicht durchsetzt, aufweist.
- Zur Lösung der Aufgabe sieht die Erfindung ferner ein mehrschichtiges Schaltungssubstrat vor, welches ein Substrat, eine Anzahl von auf dem Substrat ausgebildeten Schichten, von denen jede durch eine lichtempfindliche Isolationsschicht mit bestimmten Musterzwischenräumen und eine in den Musterzwischenräumen aus einer leitfähigen Tinte ausgebildete leitfähige Schicht gebildet ist, eine Metalldünnschicht eines bestimmten Musters, welche auf der obersten Schicht der Anzahl von Schichten durch ein adhäsives Isolationsmaterial zur Anhaftung gebracht ist, mindestens ein Durchgangsloch, in welches leitfähiges Material eingebracht ist und welches das Substrat, die Anzahl von Schichten und die Metalldünnschicht zur elektrischen Verbindung der leitfähigen Schicht und die Metalldünnschicht durchsetzt, aufweist.
- Im folgenden werden bevorzugte Ausführungsformen der Erfindung anhand der beigefügten Zeichnungen beschrieben. Auf dieser ist bzw. sind
-
1A und1B Darstellungen zur Wiedergabe eines Verfahrens zur Herstellung eines mehrschichtigen Schaltungssubstrats gemäß einer Ausführungsform der Erfindung, -
2 eine Schnittansicht des nach dem Herstellungs verfahren der1 hergestellten mehrschichtigen Schaltungssubstrats, und -
3 eine Darstellung zur Wiedergabe einiger Schritte eines Verfahrens zur Herstellung eines mehrschichtigen Schaltungssubstrats gemäß einer weiteren Ausführungsform der Erfindung. - Es wird nun unter Bezugnahme auf die
1A und1B ein Verfahren zur Herstellung eines mehrschichtigen Schaltungssubstrats gemäß der Erfindung beschrieben. - Zunächst wird ein Substrat
10 aus Metall, Keramik oder einem isolierenden Material bereitgestellt (Schritt100 ). Wenn das Substrat10 aus einem leitfähigen Metall (z.B. Legierung42 bzw. Kupferlegierung) besteht, welches ausgezeichnete Wärmestabilität und Wärmeemissionsvermögen besitzt, wird ein erstes Loch11 in dem Substrat10 ausgebildet (Schritt110 ), die Oberfläche des Substrats10 und das erste Loch11 mit einem Isolationsmaterial12 beschichtet (Schritt120 ) und die Oberseite des beschichteten Isolationsmaterials12 mit einer lichtempfindlichen Isolationsschicht20 beschichtet (Schritt130 ). Andererseits wird, wenn das Substrat10 aus einer Keramik oder einem isolierenden Material besteht, die Oberseite des Substrats10 mit der lichtempfindlichen Isolationsschicht20 ohne Vornahme des Schritts120 beschichtet. - Danach wird nach Ausrichten einer Photomaske
24 mit einem bestimmten Muster auf der Oberfläche der lichtempfindlichen Isolationsschicht20 das Substrat10 belichtet (Licht26 ) und entwickelt (Schritt140 ). Der belichtete Teil der lichtempfindlichen Isolationsschicht20 wird dabei durch eine Entwicklerlösung entfernt und so eine lichtempfindliche Isolationsschicht20A mit einem bestimmten Muster ausgebildet (Schritt150 ). - Dann wird eine leitfähige Tinte in im Schritt
150 ent standene Musterzwischenräume22 der leitfähigen Isolationsschicht20A gedruckt und zur Härtung mehrere Male erwärmt, womit eine leitfähige Schicht30 ausgebildet wird (Schritt160 ). - Wie oben beschrieben, wird ein einschichtiges Schaltungssubstrat mit den Schritten
100 bis160 hergestellt. Ein mehrschichtiges Schaltungssubstrat kann also ausgebildet werden, indem diese Schritte wiederholt werden (Schritt170 ). D.h., es wird zur elektrischen Isolation des einschichtigen Schaltungssubstrats dieses mit einer lichtempfindlichen Isolationsschicht beschichtet (nicht gezeigt). Nach Ausrichtung einer Photomaske mit einem bestimmten Muster (nicht gezeigt) auf der Oberfläche der lichtempfindlichen Isolationsschicht wird eine lichtempfindliche Isolationsschicht20B eines bestimmten Musters ausgebildet, und die Musterzwischenräume werden über einen Belichtungs- und Entwicklungsvorgang ausgebildet (nicht gezeigt). Dann wird eine leitfähige Schicht30A durch Drucken einer leitfähigen Tinte in die Musterzwischenräume ausgebildet, womit ein zweischichtiges Druck-Schaltungssubstrat hergestellt ist. Wenn also diese Vorgänge wiederholt werden, lassen sich eine Anzahl von leitfähigen Schichten30 ,30A ,30B und30C durch Drucken einer leitfähigen Tinte in die Musterzwischenräume der lichtempfindlichen Isolationsschichten20A ,20B ,20C und20D ausbilden. - Als nächstes wird, nachdem das die lichtempfindliche Isolationsschicht
20D aufweisende Substrat mit einer adhäsiven bzw. klebenden Isolationsschicht40 beschichtet worden ist, eine Metalldünnschicht50 , wie etwa eine Kupferdünnschicht, thermisch gepreßt, um so an der adhäsiven Isolationsschicht40 zur Anhaftung gebracht zu werden (Schritt180 ). Die Metalldünnschicht50 als ein Material, das bei einem Schaltungssubstrat breite Anwendung findet, hat dabei überragende Ebenheit, so daß Komponenten, beispielsweise ein Chip, leicht darauf angebracht werden können. - Eine Metalldünnschicht
50A eines bestimmten Musters wird dann durch Ätzen der Metalldünnschicht50 ausgebildet, wonach Zwischenräume der Metalldünnschicht50A mit einem isolierenden Material60 gefüllt werden. - Danach wird ein Durchgangsloch
70 ausgebildet, welches das Substrat10 , das gefüllte erste Loch11 (siehe Schritt110 ), die leitfähigen Schichten30 ,30A ,30B und30C , die lichtempfindlichen Isolationsschichten20A ,20B ,20C und20D , die adhäsive Isolationsschicht40 und die Metalldünnschicht50A durchsetzt (Schritt200 ). Dann wird eine leitfähige Tinte70A in das Durchgangsloch70 implantiert, womit ein mehrschichtiges Schaltungssubstrat vervollständigt ist. Das Durchgangsloch70 , in welches die leitfähige Tinte70A implantiert worden ist, verbindet also die leitfähigen Schichten30 ,30A ,30B und30C , die in Musterzwischenräumen des Isolationsmaterials in jeder Etage ausgebildet sind, und die Metalldünnschicht50A miteinander. Das gefüllte Loch11 wird dabei um etwa 100 bis 200 μm größer als das Durchgangsloch70 ausgebildet. Das Isolationsmaterial12 ist damit in einer ausreichenden Dicke dafür gewährleistet, so daß bei der Ausbildung des Durchgangslochs17 eine elektrische Isolation zum Substrat10 erreicht werden kann. -
2 ist eine Schnittansicht, welche eine Ausführungsform des nach dem in den1A und1B gezeigten Verfahren hergestellten mehrschichtigen Schaltungssubstrats zeigt. Die gleichen Bezugszeichen wie diejenigen der1A und1B geben die gleichen Komponenten wie diejenigen der1A und1B an. - Dieses mehrschichtige Schaltungssubstrat enthält ein Substrat
10 , eine Anzahl von auf dem Substrat10 ausgebildeten lichtempfindlichen Isolationsschichten20A ,20B ,20C und20D mit Zwischenräumen22 (1A ), in den Zwischenräumen22 ausgebildete Schichten aus leitfähiger Tinte30 ,30A ,30B und30C , eine Metalldünnschicht50A mit einem bestimmten Muster, welche auf der Isolationsschicht20D und Schicht aus leitfähiger Tinte30C durch eine adhäsive Isolationsschicht40 zur Anhaftung gebracht ist, sowie ein leitfähige Tinte enthaltendes Durchgangsloch70 , welches die leitfähigen Schichten30 ,30A ,30B und30C mit der Metalldünnschicht50A verbindet. - Unabhängig von der Leitfähigkeit können verschiedene Materialien, wie Metall, Keramik oder ein isolierendes Material als Substrat
10 verwendet werden. Vorzugsweise kann ein Metallmaterial (z.B. Alloy 42, eine Kupferlegierung etc.) als Substrat10 verwendet werden. Diese Metallmaterialien bieten ausgezeichnete Wärmestabilität und Wärmeemissionsvermögen. Auch können verschiedene Arten von Metallmaterialien ausgewählt werden. Wenn ein leitfähiges Metall als Substrat10 verwendet wird, wird das erste Loch11 auf dem Substrat10 ausgebildet und das isolierende Material12 auf die Oberfläche des Substrats10 und im gefüllten Loch11 aufgebracht. - Jede lichtempfindliche Isolationsschicht
20A ,20B ,20C oder20D eines bestimmten Musters ist eine Photoresist-Schicht mit einer Glasübergangstemperatur (Tg) von 200°C oder mehr. - Die leitfähige Tinte setzt sich aus feinen Metallpulvern (z.B. Cu-Pb-Sn, Ag-Pb-Sn etc.), einem polymerisierenden reaktiven Material, wie etwa einer Anhydridreihe-Verbindung (z.B. Hexafluorisopropyl-Diphtalsäureanhydrid) und einem Lösungsmittel (z.B. Methylethylketon, Aceton etc.) zusammen. Ormet 2005®, entwickelt von der Firma Toranaga Co. (USA), kann als leitfähige Tinte verwendet werden.
- Die Metalldünnschicht
50A , ein Teil, welcher mit einer Komponente, wie etwa einem Chip, bestückt ist, liefert ein ausgezeichnetes zuverlässiges Ebenheitsmerkmal. - Wenn das Substrat
10 aus einem Metall besteht, wird das Isolationsmaterial12 in das auf dem Substrat10 ausgebildete erste Loch11 gefüllt. - Eine weitere Ausführungsform eines Verfahrens zur Herstellung eines mehrschichtigen Schaltungssubstrats gemäß der Erfindung wird nun unter Bezugnahme auf
3 beschrieben. Gleiche Bezugszeichen wie diejenigen der vorhergehenden Figuren geben die gleichen Komponenten wie in diesen vorhergehenden Figuren an. - Gemäß dieser Ausführungsform wird der Musterzwischenraum
22 der1A , in welchen leitfähige Tinte zu drucken ist, in wenigstens einer Schicht, beispielsweise der lichtempfindlichen Isolationsschicht90 , nicht ausgebildet (siehe Schritt290 ). Das heißt, die lichtempfindliche Isolationsschicht90 ist eine bloße Isolationsschicht. Die anderen Schritte werden in der gleichen Weise durchgeführt, wie die Schritte der1A und1B . - Auch wenn die lichtempfindliche Isolationsschicht
90 als bloße Isolationsschicht dient, kann das Durchgangsloch70 die Schichten aus leitfähiger Tinte30 ,30A und30B mit der Metalldünnschicht50A verbinden. - Wie oben beschrieben, bietet das unter Verwendung einer leitfähigen Tinte hergestellte mehrschichtige Schaltungssubstrat gemäß der Erfindung einen einfachen Aufbau, womit die Produktivität gefördert wird. Da sich ferner das Substrat nicht auf ein Metallsubstrat beschränkt, kann das Material in weiten Bereichen ausgewählt werden, so daß sich die Produktionskosten vermindern lassen. Insbesondere da die Ebenheit der Metalldünnschicht auf dem obersten Teil gewährleistet ist, läßt sich das Draht-Bonden ohne Schwierigkeiten durchführen.
Claims (17)
- Verfahren zur Herstellung eines mehrschichtigen Schaltungssubstrats mit den Verfahrensschritten des Beschichtens der Oberseite eines Substrats (
10 ) mit einer lichtempfindlichen Isolationsschicht (20 ), Belichtens und Entwickelns der lichtempfindlichen Isolationsschicht zur Ausbildung einer lichtempfindlichen Isolationsschicht mit einem bestimmten Muster (20A ) und Musterzwischenräumen (22 ), Ausbildens einer leitfähigen Schicht (30 ) durch Drucken einer leitfähigen Tinte in die Musterzwischenräume, Ausbildens einer Anzahl von Schichten, von denen jede aus einer lichtempfindlichen Isolationsschicht eines bestimmten Musters mit Musterzwischenräumen und einer in den Musterzwischenräumen ausgebildeten leitfähigen Schicht gebildet ist, durch Wiederholen der vorhergehenden Schritte, Beschichtens der obersten Schicht der Anzahl von Schichten mit einer adhäsiven Isolationsschich (40 ), Ausbildens einer Metalldünnschicht (50 ) auf der adhäsiven Isolationsschicht durch thermisches Pressen, und Ätzens der Metalldünnschicht zur Ausbildung eines bestimmten Metalldünnschichtmusters, und Ausbildens mindestens eines Durchgangslochs (70 ), in welches ein leitfähiges Material implantiert wird und welches Substrat, leitfähige Schichten, lichtempfindliche Isolationsschichten und Metalldünnschicht zur elektrischen Verbindung der leitfähigen Schichten mit der gemusterten Metalldünnschicht durchsetzt. - Verfahren nach Anspruch 1, wobei die leitfähige Tinte feine Metallpulver, ein polymerisierendes reaktives Material und ein Lösungsmittel enthält.
- Verfahren nach Anspruch 2, wobei die feinen Metallpulver aus der Gruppe, bestehend aus Cu-Pb-Sn und Ag-Pb-Sn, ausgewählt werden, das polymerisierende reaktive Material eine Anhydridreihe-Verbindung ist und das Lösungsmittel aus der Gruppe, bestehend aus Methylethylketon und Aceton, ausgewählt wird.
- Verfahren nach Anspruch 3, wobei das polymerisierende reaktive Material Hexafluorisopropyl-Diphtalsäureanhydrid ist.
- Verfahren nach Anspruch 1, wobei das Substrat (
10 ) aus einer Keramik gebildet ist. - Verfahren nach Anspruch 1, wobei das Substrat (
10 ) aus einem Metall, ausgewählt aus der Gruppe, bestehend aus einer Kupferlegierung und Aloy 42, ausgebildet ist. - Verfahren nach Anspruch 6, welches ferner einen Schritt des Ausbildens mindestens eines ersten Lochs (
11 ) in einem Teil des Substrats (10 ), wo das mindestens eine Durchgangsloch (70 ) auszubilden ist, und Beschichtens der Oberfläche des Substrats und des Inneren des mindesten einen ersten Lochs mit einem Isolationsmaterial vor dem Schritt des Beschichtens des Substrats mit der ersten Isolationsschicht aufweist. - Verfahren nach Anspruch 7, wobei der Durchmesser des mindestens einen ersten Lochs (
11 ) größer als derjenige des mindestens einen Durchgangslochs (70 ) ist, derart, dass in das Durchgangsloch injiziertes leitfähiges Material von dem Substrat durch in das mindestens eine erste Loch gefülltes Isolationsmaterial elektrisch isoliert ist. - Mehrschichtiges Schaltungssubstrat, welches ein Substrat (
10 ), eine Anzahl von auf dem Substrat (10 ) ausgebildeten Schichten, von denen jede durch eine lichtempfindliche Isolationsschicht (20 ) mit bestimmten Musterzwischenräumen (22 ) und eine in den Musterzwischenräumen aus einer leitfähigen Tinte ausgebildete leitfähige Schicht (30 ) gebildet ist, eine Metalldünnschicht (50 ) eines bestimmten Musters, die auf der obersten Schicht der Anzahl von Schichten durch ein adhäsives Isolationsmaterial zur Anhaftung gebracht ist, mindestens ein Durchgangsloch (70 ), in welches leitfähiges Material eingebracht ist und welches das Substrat, die Anzahl von Schichten und die Metalldünnschicht zur elektrischen Verbindung der leitfähigen Schichten und der Metalldünnschicht durchsetzt, aufweist. - Substrat nach Anspruch 9, wobei die leitfähige Tinte feine Metallpulver und ein polymerisierendes reaktives Material aufweist.
- Substrat nach Anspruch 10, wobei die feinen Metallpulver aus der Gruppe, bestehend aus Cu-Pb-Sn und Rg-Pb-Sn, ausgewählt sind, das polymerisierende reaktive Material eine Anhydridreihe-Verbindung ist und das Lösungsmittel aus der Gruppe, bestehend aus Methylethylketon und Aceton, ausgewählt ist.
- Substrat nach Anspruch 11, wobei das polymerisierende reaktive Material Hexafluorisopropyl-Diphtalsäureanhydrid ist.
- Substrat nach Anspruch 9, wobei das Substrat aus einer Keramik gebildet ist.
- Substrat nach Anspruch 9, wobei das Substrat aus einem Metall, ausgewählt aus der Gruppe, bestehend aus einer Kupferlegierung und Alloy 42, ausgebildet ist.
- Substrat nach Anspruch 14, wobei mindestens ein erstes Loch (
11 ) in einem Teil des Substrats (10 ), wo das mindestens eine Durchgangsloch (70 ) auszubilden ist, gebildet ist und die Oberfläche des Substrats und das Innere des mindestens einem ersten Lochs mit einem isolierenden Material beschichtet sind. - Substrat nach Anspruch 15, wobei der Durchmesser des mindestens einem ersten Lochs (
11 ) größer als derjenige des Durchgangslochs (70 ) ist, derart, dass das in das mindestens eine Durchgangsloch eingebrachte leitfähige Material gegenüber dem Substrat durch das in das mindestens eine erste Loch gefüllte isolierende Material elektrisch isoliert ist. - Substrat nach Anspruch 9, wobei die Metalldünnschicht (
50 ) aus Kupfer (Cu) besteht.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR95-29688 | 1995-09-12 | ||
KR1019950029688A KR0155877B1 (ko) | 1995-09-12 | 1995-09-12 | 다층 회로기판 및 그 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE19636735A1 DE19636735A1 (de) | 1997-03-13 |
DE19636735B4 true DE19636735B4 (de) | 2005-12-29 |
Family
ID=19426526
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE1996136735 Expired - Fee Related DE19636735B4 (de) | 1995-09-12 | 1996-09-10 | Mehrschichtiges Schaltungssubstrat und Verfahren zu seiner Herstellung |
Country Status (6)
Country | Link |
---|---|
US (1) | US5747222A (de) |
JP (1) | JP3765627B2 (de) |
KR (1) | KR0155877B1 (de) |
CN (1) | CN1107336C (de) |
DE (1) | DE19636735B4 (de) |
TW (1) | TW304323B (de) |
Families Citing this family (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2836616B2 (ja) * | 1997-03-05 | 1998-12-14 | 日本電気株式会社 | 導体配線パターンの形成方法 |
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- 1995-09-12 KR KR1019950029688A patent/KR0155877B1/ko not_active IP Right Cessation
-
1996
- 1996-09-06 JP JP25779996A patent/JP3765627B2/ja not_active Expired - Fee Related
- 1996-09-07 TW TW85110973A patent/TW304323B/zh not_active IP Right Cessation
- 1996-09-10 DE DE1996136735 patent/DE19636735B4/de not_active Expired - Fee Related
- 1996-09-11 US US08/712,117 patent/US5747222A/en not_active Expired - Lifetime
- 1996-09-12 CN CN96113395A patent/CN1107336C/zh not_active Expired - Fee Related
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KR0155877B1 (ko) | 1998-12-15 |
CN1107336C (zh) | 2003-04-30 |
JPH09130051A (ja) | 1997-05-16 |
DE19636735A1 (de) | 1997-03-13 |
US5747222A (en) | 1998-05-05 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8110 | Request for examination paragraph 44 | ||
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |