DE10303642A1 - Integration von Substratbauelementen bei SOI-Halbleiterstrukturen - Google Patents

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Abstract

Es wird gezeigt, wie beim Einsatz von SOI-Halbleiterscheiben (SOI: Silicon-on-Insulator) die Integrationsmöglichkeiten erweitert werden können, wobei neben den Bauelementestrukturen in der oberen Halbleiterschicht Dotierungsgebiete und Bauelemente mit von der SOI-Technologie abweichender Herstellungsweise im Substrat vorhanden sind und untereinander in elektrischen Verbindungen stehen, welche durch die Isolatorschicht geführt werden.

Description

  • Die Erfindung bezieht sich auf SOI-Strukturen (Silicon-on-Insulator), bei denen Bauelementstrukturen in der oberen Halbleiterschicht und im Halbleitersubstrat vorhanden sind, die in elektrischen Verbindungen stehen, welche durch die Isolatorschicht geführt sind.
  • Eine SOI-Struktur besteht aus einer dünnen Halbleiterschicht, welche sich auf einer dünnen Oxidschicht befindet. Die Oxidschicht wird üblicherweise als vergrabenes Oxid (buried oxide: BOX) erzeugt und liegt wiederum auf einer Halbleiterschicht, im allgemeinen einer Siliziumschicht, nämlich dem Siliziumsubstrat, welches gewöhnlich eine Dicke von 300 – 800μm hat. Dieses Substrat dient nur zur Handhabung der Struktur. Die eigentlichen Bauelementefunktionen werden wie in gewöhnlichen CMOS-Prozessen auf homo-genen Siliziumscheiben in der oberflächennahen Halbleiterschicht realisiert.
  • Ein wesentlicher Unterschied zu den Standard-CMOS-Prozessen besteht darin, daß die Bauelemente durch Gräben, die bis zur Isolationsschicht reichen, dielektrisch voneinan-der getrennt sind. Hierdurch wird die gegenseitige elektrische Beeinflussung der Bauelemente stark verringert. Diese dielektrische Isolation macht die SOI-Technologie auch für Hochvoltanwendungen geeignet.
  • Es bringt Vorteile mit sich, wenn die Bauelemente nicht über das Substrat miteinander gekoppelt sind. Es entfallen dadurch bestimmte unerwünschte Substrateffekte, wie z.B. Latch-Up, signifikante Sperrströme bei erhöhten Temperaturen, erhöhte parasitäre Kapazitäten an den Source/Bulk- bzw. Drain/Bulk-pn-Übergängen.
  • Die erfinderischen Vorstellungen gehen davon aus, das Substrat für die Erweiterung von Schaltungen mit zu nutzen, d.h. Dotierungsgebiete im Substrat zu erzeugen, um zusätzliche und andersartige Bauelemente in die SOI-Schaltungen integrieren zu können. Dabei müssen gleichzeitig die durch die elektrischen Verbindungen mit dem Substrat möglichen negativen Rückwirkungen auf die Schaltungsstrukturen in der dünnen oberseitigen Siliziumschicht unterdrückt werden. Für die Zwecke der aktiven Einbeziehung des Substrats wäre eine Rückseitenmetallisierung des Substrats einerseits zweckmäßig. Andererseits sind die in der aktiven oberen Siliziumschicht realisierten Bauelemente empfindlich gegen ein angelegtes Potential auf der Rückseite. Nachteilig ist, daß z.B. MOSFET von der Scheibenrückseite bei hohen Rückseitenspannungen aufgesteuert werden können oder der Einschaltwiderstand von Hochvolttransistoren von der Rückseitenspannung abhängt. Auch einfache Dioden besitzen eine Abhängigkeit der Durchbruchspannung vom angelegten Substratpotential. Diese Effekte sind bei der Einbeziehung des Substrats, d.h. der Herstellung elektrischer Verbindungen zum Substrat zu berücksichtigen. Substratanschlüsse (Rückseitenmetallisierung) sind ursprünglich allerdings kein Bestandteil der SOI-Technologie. Die entsprechenden Gehäuse sehen einen Rückseitenkontakt nicht vor und oft reicht bei Schaltkreisen die Anzahl der Pins nicht aus, um die Rückseite zu kontaktieren.
  • Es wurde bereits vorgeschlagen, ohne Rückseitenmetallisierung des Substrats die aktiven Strukturen der oberen Siliziumschicht mit dem Substrat mittels einer durch die Isolationsschicht führenden Metallbrücke, im speziellen Fall mit einem Stapel von gegeneinander isolierten Metallisierungsschichten elektrisch zu verbinden.
  • Diese elektrische Verbindung macht es prinzipiell möglich, das Substrat im Sinn einer kapazitiven, wie qualitativen Erweiterung von Bauelementeanordnungen zu nutzen.
  • Aufgabe der Erfindung ist es, Möglichkeiten aufzuzeigen, wie durch Anordnungen und Verfahren eine Substratnutzung für die kapazitive wie auch qualitative Verbesserung von Halbleiterschaltungen möglich ist.
  • Zweck der Erfindung ist es, die Integrationsmöglichkeiten von Schaltungsanordnungen auf SOI-Halbleiterscheiben zu erweitern, auch um Bauelemente anderer Technologien, wie z.B. Bipolarbauelemente integrieren zu können.
  • Die erfindungsgemäße Lösung ist im Anspruchs 1 dargestellt. Weitere Ausgestaltungen der Erfindung sind in den Neben- und Unteransprüchen enthalten.
  • Zur näheren Erläuterung der Erfindung dienen die 1 bis 3, die mit den angegebenen Bezeichnungen selbsterklärend sind.
  • 1 zeigt schematisch zwei unterschiedliche Typen von Transistoren, die mittels SOI-Technologie hergestellt sind.
  • In 2 ist schematisch dargestellt, wie mit einigen der ersten Verfahrensschritte der erfindungsgemäßen Verfahrensweise durch p- und n-Ionenimplantation und nachfolgende thermische Behandlung (letztere nicht dargestellt) p- und n-dotiete Gebiete dicht unterhalb der Grenze Isolationsoxid/Substrat im Substrat erzeugt werden.
  • 3 zeigt im einfachsten Fall schematisch die Durchführung des Kontaktes einer dotierten Zone im Substrat durch das Isolationsoxid zur oberen Siliziumschicht (letztere nicht dargestellt).
  • Mit den im Substrat erzeugten Schichten bestimmter Dotierungen und deren elektrischen Verbindungen mit den Bauelementestruk turen auf der Oberseite der SOI-Scheiben können durch geeignete Kombination verschiedene aktive und passive Srukturen geschaffen werden. Über die Metallbrücke zum Substrat können ohmsche Kontakte und Schottky-Kontakte erzeugt werden. Als aktive Strukturen sind Dioden, MOSFET's, Bipolartransistoren, Thyristoren und IGBT's realisierbar. Als passive Strukturen kommen Kapazitäten, Widerstände und abschirmende Schichten infrage. Während Kapazitäten und Widerstände Kontakte erfordern, ist eine Kontaktierung von abschirmenden Schichten nicht immer zwingend erforderlich. Diese Gebiete sind dann potentialmäßig frei schwebend. Durch Abschirmung mittels Subtratimplantation erreicht man die gewünschte Reduktion des negativen Substrateinflusses (Substratvorspannung) an Strukturen in der oberen aktiven Halbleiterschicht. Die Abschirmung realisiert eine Entkopplung dieser aktiven Strukturen von Effekten die an der Scheibenrückseite auftreten können.
  • Eine Vielzahl von neuen aktiven und passiven Strukturen mit verbesserten Eigenschaften werden durch die Erfindung möglich.

Claims (10)

  1. Verfahren zur Herstellung von integrierten Schaltungen auf SOI-Halbleiterscheiben, bei denen die aktiven Bauelementestrukturen in der dünnen oberen Halbleiterschicht über elektrische Verbindungen, die durch die Isolatorschicht geführt sind, mit Bauelementestrukturen im Substrat verbunden sind, gekennzeichnet durch die Reihe der folgend aufgeführten Hauptarbeitsgänge, die mit an sich bekannten Verfahren ausgeführt werden: – In bestimmten Bereichen Ionenimplantation mit hochenergetischen Ionen von der Vorderseite aus durch die einkristalline Halbleiterschicht und die Isolatorsschicht hindurch in das Substrat, gegebenenfalls unter Verwendung von Schablonen und mit unterschiedlichen Ionenarten, wie sie zur Erzeugung von Bauelementen üblich sind. – Temperaturbehandlung zur Aktivierung der implantierten Ionen, ggf. in mehreren Schritten unterschiedlicher Temperatur, angepaßt an die implantierte Ionenart. – Herstellung der Bauelementestrukturen in der dünnen oberen einkristallinen Siliziumschicht. – Erzeugung der Durchbrüche in der Isolatorschicht an Stellen, an denen keine aktive dünne einkristalline Siliziumschicht vorhanden ist (laterale Isolationsbereiche). – Füllung der Durchbrüche in der Isolatorschicht mit einem Metall. – Herstellung von im Bereich der aktiven Baueleemntestrukturen gegeneinader isolierten Metallisierungsschichten, welche die Strukturen der Oberseite mit denen des Substrats über die Metallfüllung der Durchbrüche in der Isolatorschicht elektrisch verbinden.
  2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die Isolatorschicht eine Siliziumoxidschicht ist.
  3. Verfahren nach Anspruch 1 und 2, dadurch gekennzeichnet, daß die Passivierungsschicht eine Siliziumnitridschicht ist.
  4. Verfahren nach Anspruch 1 und 2, dadurch gekennzeichnet, daß die Passivierungsschicht aus einer Doppelschicht gebildet wird, wobei die eine Schicht der elektrischen Isolation dient und die andere eine Sperre für vagabundierende Ionen darstellt.
  5. Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß das Substrat aus einer einkristallinen Siliziumscheibe besteht.
  6. Verfahren nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß mit dem Prozeß der Herstellung der Metallbrücke des Durchbruchs ein ohmscher Kontakt zum Substrat erzeugt wird.
  7. Verfahren nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, daß mit dem Prozeß der Herstellung der Metallbrücke des Durchbruchs ein Schottky-Kontakt mit dem Substrat erzeugt wird.
  8. Bauelementeanordnung unter Anwendung des Verfahrens nach einem der Ansprüche 1 bis 7.
  9. Bauelementeanordnung nach Anspruch 8, dadurch gekennzeichnet, daß im Substrat aktive Bauelemente wie Dioden, MOSFET's, Bipolartransistoren, Thyristoren und IGBT's einzeln oder in Kombination vorliegen.
  10. Bauelementeanordnung nach Anspruch 8, dadurch gekennzeichnet, daß im Substrat neben aktiven Bauelementen auch passive Strukturen wie Kapazitäten, Widerstände und abschirmende Schichten vorliegen.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2989221A1 (fr) * 2012-04-06 2013-10-11 St Microelectronics Sa Condensateur sur circuit integre

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6188122B1 (en) * 1999-01-14 2001-02-13 International Business Machines Corporation Buried capacitor for silicon-on-insulator structure
US6429477B1 (en) * 2000-10-31 2002-08-06 International Business Machines Corporation Shared body and diffusion contact structure and method for fabricating same

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6188122B1 (en) * 1999-01-14 2001-02-13 International Business Machines Corporation Buried capacitor for silicon-on-insulator structure
US6429477B1 (en) * 2000-10-31 2002-08-06 International Business Machines Corporation Shared body and diffusion contact structure and method for fabricating same

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2989221A1 (fr) * 2012-04-06 2013-10-11 St Microelectronics Sa Condensateur sur circuit integre

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