CN212257386U - 一种新型半导体封装结构 - Google Patents

一种新型半导体封装结构 Download PDF

Info

Publication number
CN212257386U
CN212257386U CN202021242001.4U CN202021242001U CN212257386U CN 212257386 U CN212257386 U CN 212257386U CN 202021242001 U CN202021242001 U CN 202021242001U CN 212257386 U CN212257386 U CN 212257386U
Authority
CN
China
Prior art keywords
metal
metal plate
columns
base island
novel semiconductor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN202021242001.4U
Other languages
English (en)
Inventor
刘恺
王亚琴
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
JCET Group Co Ltd
Original Assignee
Jiangsu Changjiang Electronics Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Jiangsu Changjiang Electronics Technology Co Ltd filed Critical Jiangsu Changjiang Electronics Technology Co Ltd
Priority to CN202021242001.4U priority Critical patent/CN212257386U/zh
Application granted granted Critical
Publication of CN212257386U publication Critical patent/CN212257386U/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321—Disposition
    • H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805—Shape
    • H01L2224/4809—Loop shape
    • H01L2224/48091—Arched
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481—Disposition
    • H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484—Connecting portions
    • H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
    • H01L2224/48465—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732—Location after the connecting process
    • H01L2224/73251—Location after the connecting process on different surfaces
    • H01L2224/73265—Layer and wire connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181—Encapsulation

Landscapes

  • Lead Frames For Integrated Circuits (AREA)

Abstract

本实用新型涉及一种新型半导体封装结构，它包括线路内芯(1)，所述线路内芯(1)包括上金属板(1.1)和下金属板(1.2)，所述上金属板(1.1)和下金属板(1.2)之间填充有塑料(2)，所述上金属板(1.1)正面设置有基岛(3)和内引脚(4)，所述下金属板(1.2)背面设置有外引脚(5)，所述基岛(3)上设置有芯片(7)，所述芯片(7)和焊线(8)外围包封有塑封料(9)。本实用新型直接在线路内芯中填充塑封料，不需使用玻璃纤维层，不需要开孔后再在孔中植入导电物质，简化了制造工艺，减少了制作成本，同时通过其结构比较稳定，在温度发生变化时不容易发生翘曲。

Description

一种新型半导体封装结构
技术领域
本实用新型涉及一种新型半导体封装结构，属于半导体封装技术领域。
背景技术
传统的基板封装结构的制造工艺流程如下所示：
步骤一、参见图13，取一玻璃纤维材料制成的基板；
步骤二、参见图14，在玻璃纤维基板上所需的位置上开孔；
步骤三、参见图15，在玻璃纤维基板的背面披覆一层铜箔；
步骤四、参见图16，在玻璃纤维基板打孔的位置填入导电物质；
步骤五、参见图17，在玻璃纤维基板的正面披覆一层铜箔；
步骤六、参见图18，在玻璃纤维基板表面披覆光阻膜；
步骤七、参见图19，将光阻膜在需要的位置进行曝光显影开窗；
步骤八、参见图20，将完成开窗的部分进行蚀刻；
步骤九、参见图21，将基板表面的光阻膜剥除；
步骤十、参见图22，在铜箔线路层的表面进行防焊漆(俗称绿漆)的披覆；
步骤十一、参见图23，在防焊漆需要进行后工序的装片以及打线键合的区域进行开窗；
步骤十二、参见图24，在步骤十一进行开窗的区域进行电镀，相对形成基岛和引脚；
步骤十三、完成后续的装片、打线、包封、切割等相关工序。
上述传统基板封装结构存在以下不足和缺陷：
1、传统的基板制造需在玻璃纤维基板上开孔，再在孔中植入导电物质，并在玻璃纤维基板上披覆铜箔，其制造工艺非常复杂，成本较高；
2、传统的基板有一层的玻璃纤维材料，同样的也多了一层玻璃纤维的成本；玻璃纤维本身就是一种发泡物质，所以容易因为放置的时间与环境吸入水分以及湿气，直接影响到可靠性的安全能力或是可靠性的等级；
3、传统的基板仅在需要进行电性连接的地方设置上下导通金属柱，所以金属柱并没有均匀分布，这就会导致基板在温度发生变化时容易发生翘曲。
实用新型内容
本实用新型所要解决的技术问题是针对上述现有技术提供一种新型半导体封装结构，其直接在线路内芯中填充塑料，不需使用玻璃纤维层，不需要开孔后再在孔中植入导电物质，简化了制造工艺，减少了制作成本，同时通过其结构比较稳定，在温度发生变化时不容易发生翘曲。
本实用新型解决上述问题所采用的技术方案为：一种新型半导体封装结构，它包括线路内芯，所述线路内芯包括上金属板和下金属板，所述上金属板和下金属板之间通过复数个金属柱相连接，所述上金属板和下金属板之间填充有塑料，所述金属柱被包覆于塑料内，所述上金属板正面设置有基岛和内引脚，所述下金属板背面设置有外引脚，所述基岛上设置有芯片，所述芯片外围包封有塑封料，所述金属柱有两种形式，分别为连接金属柱和虚拟金属柱，所述连接金属柱起电性连接和机械支撑作用，所述虚拟金属柱仅起机械支撑作用。
可选的，复数个金属柱呈阵列式排布。
可选的，所述上金属板和下金属板外围包覆有绿漆。
可选的，所述上金属板外围包覆的绿漆上表面与基岛和内引脚上表面齐平；所述下金属板外围包覆的绿漆下表面与外引脚下表面齐平。
可选的，基岛区域的连接金属柱与连接金属柱顶部之间和底部之间分别通过上层金属板和下层金属板相连，引脚区域的连接金属柱与连接金属柱顶部之间和底部之间分别通过上层金属板和下层金属板相连。
可选的，基岛区域的连接金属柱与虚拟金属柱仅通过顶部的上层金属板或底部的下层金属板相连；引脚区域的连接金属柱和虚拟金属柱仅通过顶部的上层金属板或底部的下层金属板相连。
可选的，基岛区域的虚拟金属柱与虚拟金属柱仅通过顶部的上层金属板或底部的下层金属板相连；引脚区域的虚拟金属柱与虚拟金属柱仅通过顶部的上层金属板或底部的下层金属板相连。
可选的，基岛区域的连接金属柱与连接金属柱底部之间不通过下层金属板相连。
与现有技术相比，本实用新型的优点在于：
1、本实用新型直接在线路内芯中填充塑料，不需使用玻璃纤维层，不需要开孔再在孔中植入导电物质，简化了制造工艺，减少了制作成本，提高了封装体的安全性和可靠性，减少了玻璃纤维材料带来的环境污染；
2、本实用新型的封装结构中平均分布有金属柱，部分用于连接基岛与外引脚或内引脚与外引脚，部分为虚拟金属柱，其未用于电性连接但仍起到支撑作用，所以其结构比较稳定，在温度发生变化时不容易发生翘曲。
附图说明
图1为本实用新型一种新型半导体封装结构实施例1的剖面示意图。
图2为本实用新型一种新型半导体封装结构实施例2的剖面示意图。
图3～图12为本实用新型一种新型半导体封装结构制造工艺的流程示意图。
图13～图24为传统的基板封装结构制造工艺的流程示意图。
其中：
线路内芯 1
上金属板 1.1
下金属板 1.2
金属柱 1.3
连接金属柱 1.3a
虚拟金属柱 1.3b
塑料 2
基岛 3
内引脚 4
外引脚 5
粘结物质或焊料 6
芯片 7
焊线 8
塑封料 9
绿漆 10。
具体实施方式
以下结合附图实施例对本实用新型作进一步详细描述。
实施例1：
如图1所示，本实用新型涉及的一种新型半导体封装结构，它包括线路内芯1，所述线路内芯1包括上金属板1.1和下金属板1.2，所述上金属板1.1和下金属板1.2之间通过复数个阵列式排布的金属柱1.3电性和机械连接，所述上金属板1.1和下金属板1.2之间填充有塑料2，所述金属柱1.3被包覆于塑料2内，所述上金属板1.1正面设置有基岛3和内引脚4，所述下金属板1.2背面设置有外引脚5，所述基岛3上通过粘结物质或焊料6设置有芯片7，所述芯片7通过焊线8与内引脚4电性连接，所述芯片7和焊线8外围包封有塑封料9；
所述上金属板1.1和下金属板1.2外围包覆有绿漆10；
所述上金属板1.1外围包覆的绿漆10上表面与基岛3和内引脚4上表面齐平；
所述下金属板1.2外围包覆的绿漆10下表面与外引脚5下表面齐平；
所述金属柱1.3有两种形式，分别为连接金属柱1.3a和虚拟金属柱1.3b，所述连接金属柱1.3a用于连接基岛3与外引脚5或内引脚4与外引脚5，起电性连接和机械支撑作用，所述虚拟金属柱1.3b仅起机械支撑作用；
所述塑料2为热固性塑料，可以是酚醛塑料、环氧塑料、氨基塑料、不饱和聚酯、醇酸塑料等；
基岛3区域的连接金属柱1.3a与连接金属柱1.3a顶部之间和底部之间分别通过上层金属板1.1和下层金属板1.2相连；
引脚区域(包括内引脚区域和外引脚区域)的连接金属柱1.3a与连接金属柱1.3a顶部之间和底部之间分别通过上层金属板1.1和下层金属板1.2相连；
基岛3区域的连接金属柱1.3a与虚拟金属柱1.3b顶部之间通过上层金属板1.1相连或底部之间通过下层金属板1.2相连；
引脚区域(包括内引脚区域和外引脚区域)的连接金属柱1.3a与虚拟金属柱1.3b顶部之间通过上层金属板1.1相连或底部之间通过下层金属板1.2相连；
基岛3区域的虚拟金属柱1.3b与虚拟金属柱1.3b顶部之间通过上层金属板1.1相连或底部之间通过下层金属板1.2相连；
引脚区域(包括内引脚区域和外引脚区域)的虚拟金属柱1.3b与虚拟金属柱1.3b顶部之间通过上层金属板1.1相连或底部之间通过下层金属板1.2相连。
实施例2：
如图2所示，实施例2与实施例1的区别在于：基岛3区域的连接金属柱1.3a与连接金属柱1.3a底部之间不通过下层金属板1.2相连；引脚区域(包括内引脚区域和外引脚区域)的连接金属柱1.3a与连接金属柱1.3a底部之间不通过下层金属板1.2相连。
其制造工艺如下：
步骤一、参见图3，取一线路内芯，所述线路内芯包括上金属板和下金属板，所述上金属板和下金属板为平整的金属板，所述上金属板和下金属板之间通过复数个金属柱电性和机械连接；图4为上金属板与金属柱未结合时的示意图，复数个金属柱呈阵列排布于上金属板和下金属板之间，金属柱有两种形式，分别为连接金属柱和虚拟金属柱，所述连接金属柱起电性连接和机械支撑作用，所述虚拟金属柱在后续形成的封装结构中仅起机械支撑作用；
步骤二、参见图5，在线路内芯外围通过一次性注射成型包覆塑料，所述上金属板的下表面、下金属板的上表面和金属柱包覆在塑料中，所述上金属板的上表面和下金属板的下表面暴露在塑料之外，所述塑料为热固性塑料，可以是酚醛塑料、环氧塑料、氨基塑料、不饱和聚酯、醇酸塑料等；
步骤三、参见图6，在上金属板正面及下金属板背面贴覆或印刷可进行曝光显影的光阻材料，以保护后续蚀刻金属层工艺作业；光阻材料可以是光阻膜，也可以是光刻胶。利用曝光显影设备对金属板表面的光阻材料进行曝光、显影从而去除部分光阻材料，以露出金属板需要进行蚀刻的图形区域。对金属板上完成曝光显影的区域进行化学蚀刻，化学蚀刻直至露出塑料和虚拟金属柱。蚀刻药水可以采用氯化铜或者是氯化铁或者其它可以进行化学蚀刻的药水。去除金属板表面的光阻膜，去除光阻膜的方法可以采用化学药水软化并采用高压水冲洗的方法去除光阻膜，在完成蚀刻以后，连接金属柱起到电性连接内引脚与外引脚的作用和机械支撑作用，虚拟金属柱不起电性连接作用，仅起到机械支撑作用；
步骤四，参见图7，在步骤三完成蚀刻的上金属板和下金属板外围涂覆绿漆，绿漆完全包覆上金属板、下金属板以及步骤三蚀刻暴露出的塑料和虚拟金属柱；
步骤五，参见图8，利用曝光显影设备对金属板表面的绿漆进行曝光、显影从而去除部分绿漆，以露出金属板需要进行电镀作业的图形区域；
步骤六，参见图9，在完成步骤五的金属板正反面开窗区域电镀表面金属层，表面金属层电镀完成后即在上金属板正面形成相应的基岛和内引脚，在下金属板背面形成外引脚；
步骤七，参见图10，在步骤六形成的基岛表面涂覆粘结物质或焊料，然后在粘结物质或焊料上植入芯片。在芯片正面与内引脚正面之间进行键合金属线作业，所述金属线的材料采用金、银、铜、铝或是合金的材料，金属丝的形状可以是丝状也可以是带状；
步骤八，参见图11，将步骤七完成打线作业的芯片外围采用塑封料进行塑封，塑封方式可以采用模具灌胶方式、喷涂方式或是用贴膜方式，所述可以采用有填料物质或是无填料物质的环氧树脂；
步骤九，参见图12，将步骤八完成塑封的半成品进行切割作业，使原本阵列式塑封体切割独立开来，制得新型半导体封装结构。
上述实施例外，本实用新型还包括有其他实施方式，凡采用等同变换或者等效替换方式形成的技术方案，均应落入本实用新型权利要求的保护范围之内。

Claims (8)

1.一种新型半导体封装结构，其特征在于：它包括线路内芯(1)，所述线路内芯(1)包括上金属板(1.1)和下金属板(1.2)，所述上金属板(1.1)和下金属板(1.2)之间通过复数个金属柱(1.3)相连接，所述上金属板(1.1)和下金属板(1.2)之间填充有塑料(2)，所述金属柱(1.3)被包覆于塑料(2)内，所述上金属板(1.1)正面设置有基岛(3)和内引脚(4)，所述下金属板(1.2)背面设置有外引脚(5)，所述基岛(3)上设置有芯片(7)，所述芯片(7)外围包封有塑封料(9)，所述金属柱(1.3)有两种形式，分别为连接金属柱(1.3a)和虚拟金属柱(1.3b)，所述连接金属柱(1.3a)起电性连接和机械支撑作用，所述虚拟金属柱(1.3b)仅起机械支撑作用。
2.根据权利要求1所述的一种新型半导体封装结构，其特征在于：复数个金属柱(1.3)呈阵列式排布。
3.根据权利要求1所述的一种新型半导体封装结构，其特征在于：所述上金属板(1.1)和下金属板(1.2)外围包覆有绿漆(10)。
4.根据权利要求3所述的一种新型半导体封装结构，其特征在于：所述上金属板(1.1)外围包覆的绿漆(10)上表面与基岛(3)和内引脚(4)上表面齐平；所述下金属板(1.2)外围包覆的绿漆(10)下表面与外引脚(5)下表面齐平。
5.根据权利要求1所述的一种新型半导体封装结构，其特征在于：基岛(3)区域的连接金属柱(1.3a)与连接金属柱(1.3a)顶部之间和底部之间分别通过上层金属板(1.1)和下层金属板(1.2)相连，引脚区域的连接金属柱(1.3a)与连接金属柱(1.3a)顶部之间和底部之间分别通过上层金属板(1.1)和下层金属板(1.2)相连。
6.根据权利要求1所述的一种新型半导体封装结构，其特征在于：基岛(3)区域的连接金属柱(1.3a)与虚拟金属柱(1.3b)仅顶部之间或底部之间相连；引脚区域的连接金属柱(1.3a)和虚拟金属柱(1.3b)仅顶部之间或底部之间相连。
7.根据权利要求1所述的一种新型半导体封装结构，其特征在于：基岛(3)区域的虚拟金属柱(1.3b)与虚拟金属柱(1.3b)仅顶部之间或底部之间相连；引脚区域的虚拟金属柱(1.3b)与虚拟金属柱(1.3b)顶部之间或底部之间相连。
8.根据权利要求1所述的一种新型半导体封装结构，其特征在于：基岛(3)区域的连接金属柱(1.3a)与连接金属柱(1.3a)底部之间不通过下层金属板(1.2)相连。
CN202021242001.4U 2020-06-30 2020-06-30 一种新型半导体封装结构 Active CN212257386U (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN202021242001.4U CN212257386U (zh) 2020-06-30 2020-06-30 一种新型半导体封装结构

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN202021242001.4U CN212257386U (zh) 2020-06-30 2020-06-30 一种新型半导体封装结构

Publications (1)

Publication Number Publication Date
CN212257386U true CN212257386U (zh) 2020-12-29

Family

ID=73979885

Family Applications (1)

Application Number Title Priority Date Filing Date
CN202021242001.4U Active CN212257386U (zh) 2020-06-30 2020-06-30 一种新型半导体封装结构

Country Status (1)

Country Link
CN (1) CN212257386U (zh)

Similar Documents

Publication Publication Date Title
CN109817769B (zh) 一种新型led芯片封装制作方法
KR100959957B1 (ko) 랜드 그리드 어레이 반도체 디바이스 패키지, 이를포함하는 어셈블리 및 제조 방법
KR20010022928A (ko) 플라스틱 집적회로 패키지 및 그 패키지 제조 방법 및 리드프레임
CN104538375A (zh) 一种扇出PoP封装结构及其制造方法
CN106876363A (zh) 3d连接的扇出型封装结构及其工艺方法
CN105575821A (zh) 多层堆叠扇出型封装及其制备方法
CN102738131B (zh) 半导体模组、封装结构及其封装方法
CN103972111B (zh) 引线框架结构的形成方法
CN107958882A (zh) 芯片的封装结构及其制作方法
CN114899155A (zh) 多种类多数量芯片三维堆叠集成封装结构及其制造方法
CN103730378B (zh) 封装结构的形成方法
CN112768437B (zh) 多层堆叠封装结构和多层堆叠封装结构的制备方法
CN111834330A (zh) 一种新型半导体封装结构及其制造工艺
CN112018055B (zh) 电磁屏蔽散热封装结构及其制备方法
CN103972113B (zh) 封装方法
CN107958844A (zh) 封装结构及其制作方法
CN212257386U (zh) 一种新型半导体封装结构
CN206259337U (zh) 封装结构
CN108538794A (zh) 表面贴装型封装结构及其制作方法
CN111834329B (zh) 一种半导体封装结构及其制造方法
CN112582287A (zh) 晶圆级芯片封装结构及封装方法
CN108063130B (zh) 具有引脚侧壁爬锡功能的电磁屏蔽封装结构及其制造工艺
CN202495439U (zh) 半导体封装结构及其模组
CN210692485U (zh) 天线封装结构
CN211045375U (zh) 晶圆级芯片封装结构

Legal Events

Date Code Title Description
GR01 Patent grant
GR01 Patent grant