CN211044994U - 像素驱动电路、显示面板 - Google Patents

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Abstract

本实用新型提供一种像素驱动电路、显示面板，属于显示技术领域，其可至少部分解决现有的全面显示屏的补偿电容不能解决异形区显示异常的问题。本实用新型的一种像素驱动电路，包括：驱动单元、发光单元、存储单元、重置单元、发光控制单元、数据写入单元以及第一连接线；驱动单元，包括驱动晶体管，用于驱动发光单元进行发光；数据写入单元，用于通过存储单元的调节向驱动单元写入数据线端的数据信号；发光控制单元，用于通过控制驱动单元而向发光单元写入显示电流；第一连接线与驱动晶体管的栅极一体成型，且第一连接线的宽度大于驱动晶体管的栅极的宽度，以增大像素驱动电路的负载。

Description

像素驱动电路、显示面板
技术领域
本实用新型属于显示技术领域，具体涉及一种像素驱动电路、显示面板。
背景技术
随着科学技术的发展，全面屏的终端(如手机等)得到广泛的关注。现有技术的全面屏的终端中，一般会将显示屏的一部分区域(异形区)的像素的数量小于其余部分(非异形区)的像素的数量，以保证在异形区中能够设置前置摄像头、听筒等结构。这样由于显示屏的像素分布的不均匀，从而导致异形区显示异常。
为了解决上述问题，一般在异形区的像素电路中增加补偿电容以减少异形区的显示异常。然而，由于异形区的空间有限，可增加的补偿电容的数量也相应有限，从而增大异形区的电容补偿难度，使得补偿效果不佳，异形区的显示仍存在异常。
实用新型内容
本实用新型至少部分解决现有的全面显示屏的补偿电容不能解决异形区显示异常的问题，提供一种能够使得异形区显示正常的像素驱动电路。
解决本实用新型技术问题所采用的技术方案是一种像素驱动电路，包括：驱动单元、发光单元、存储单元、重置单元、发光控制单元、数据写入单元以及连接线；
所述重置单元，用于根据第一电压端调节所述第一节点的电压；
所述存储单元的第一端连接第一节点，其第二端连接第二电压端；
所述驱动单元，包括驱动晶体管，用于驱动所述发光单元进行发光；
所述数据写入单元，用于通过所述存储单元的调节向所述驱动单元写入数据线端的数据信号；
所述发光控制单元，用于通过控制所述驱动单元而向所述发光单元写入显示电流；
所述第一连接线与所述驱动晶体管的栅极一体成型，且所述第一连接线的宽度大于所述驱动晶体管的栅极的宽度，以增大所述像素驱动电路的负载。
进一步优选的是，所述重置单元包括：第一晶体管，其第一极连接第一节点，第二极连接第一电压端，栅极通过第二连接线与重置端连接，所述第二连接线与所述第一晶体管的栅极一体成型，且所述第二连接线的宽度大于所述第一晶体管的栅极的宽度，以增大所述像素驱动电路的负载。
进一步优选的是，所述数据写入单元包括：第二晶体管，其栅极连接栅线端，第一极连接第一节点，第二极连接第二节点；第三晶体管，其栅极连接栅线端，第一极连接第三节点，第二极连接数据线端。
进一步优选的是，所述发光控制单元包括：第四晶体管，其栅极连接信号端，第一极连接第二电压端，第二极连接第三节点；第五晶体管，其栅极连接信号端，第一极连接第二节点，第二极连接所述发光单元。
进一步优选的是，所述驱动晶体管的栅极通过所述第一连接线连接第一节点，第一极连接第三节点，第二极连接第二节点。
进一步优选的是，所述存储单元包括：存储电容，其第一极连接第二电压端，第二极连接第一节点。
进一步优选的是，所有晶体管均为N型晶体管；或者，所有晶体管均为P 型晶体管。
解决本实用新型技术问题所采用的技术方案是一种显示面板，包括：
多个像素驱动电路，所述像素驱动电路为上述的像素驱动电路；
多个像素单元，至少部分所述像素单元与所述像素驱动电路一一对应。
进一步优选的是，该显示面板具有异形区和非异形区，所述异形区中的像素单元少于所述非异形区中的像素单元，所述像素驱动电路与位于所述异形区中的像素单元一一对应。
进一步优选的是，所述像素驱动电路还包括：第六晶体管，其栅极连接下一行所述像素单元对应的像素驱动电路的重置端，第一极连接第五晶体管的第二极，第二极连接第一电压端。
附图说明
附图是用来提供对本发明的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本发明，但并不构成对本发明的限制。在附图中：
图1a为现有的全面显示屏的异形区中像素驱动电路的俯视结构图；
图1b为现有的全面显示屏的结构示意图；
图2为本实用新型的实施例的一种像素驱动电路的俯视结构图；
图3为本实用新型的实施例的一种像素驱动电路的结构示意图；
图4为图3所示的像素驱动电路的工作时序图；
其中，附图标记为：1、驱动单元；2、发光单元；3、存储单元；4、重置单元；5、数据写入单元；6、发光控制单元；7、第一连接线；8、第二连接线； Init、第一电压端；VDD、第二电压端；VSS、第三电压端；Vdata、数据线端； EM、信号端；Reset、重置端；Gate、栅线端；T1、第一晶体管；T2、第二晶体管；T3、第三晶体管；T4、第四晶体管；T5、第五晶体管；T6、第六晶体管；DTFT、驱动晶体管；N1、第一节点；N2、第二节点；N3、第三节点；t1、重置阶段；t2、数据写入阶段；t3、显示阶段；C、存储电容。
具体实施方式
为使本领域技术人员更好地理解本实用新型的技术方案，下面结合附图和具体实施方式对本实用新型作进一步详细描述。
以下将参照附图更详细地描述本实用新型。在各个附图中，相同的元件采用类似的附图标记来表示。为了清楚起见，附图中的各个部分没有按比例绘制。此外，在图中可能未示出某些公知的部分。
在下文中描述了本实用新型的许多特定的细节，例如部件的结构、材料、尺寸、处理工艺和技术，以便更清楚地理解本实用新型。但正如本领域的技术人员能够理解的那样，可以不按照这些特定的细节来实现本实用新型。
现有技术的全面显示屏中，如图1b所示，具有异形区和非异形区，异形区中的像素单元的数量小于非异形区中的像素单元，以保证前置摄像头、听筒等结构的设置。这样由于显示屏的像素分布的不均匀，从而导致异形区显示异常。
为了解决上述问题，一般在异形区的像素电路中增加补偿电容，且补偿效果与补偿百分比有关，补偿百分比越接近100％，补偿效果越好。
如图1a和图1b所示，异形区从顶端(Notch Bottom Line)至底端(Notch TopLine)每行的像素单元的数量逐渐变大，像素电路的负载的差异也越来越大，从而造成显示显示亮度也是逐渐变化。为了弥补异形区的显示差异，目前通常是在异形区的像素电路中增加外电容补偿。其中，通过补偿百分比来衡量其补偿效果，即补偿百分比越接近100％，其补偿效果越好。
具体的，全面显示屏的GOA(移位寄存器)驱动电路为双边驱动，最顶端的一行(即第一行像素单元Line1)的像素单元和底端的一行(即第X行像素单元LineX)像素单元的补偿百分w1、w2的计算方式如下：
C1＝n1×Cgate+n2×Creset+Ccomp×L1，
C2＝m1×Cgate+m2×Creset+Ccomp×L2，
Figure DEST_PATH_GDA0002524334160000041
其中，LineX表示第X行像素，n1、n2、m1、m2分别表示Line1、Line2、 LineX、Line(X+1)的像素的总数，Cgate、Creset分别表示异形区一个像素电路中栅极电容(Gate)、重置电容(Reset)，Ccomp表示补偿单元电容，L1、L2分别表示 Line1、LineX的补偿电容的个数，C1、C2、C3分别为Line1、LineX、非异形区中的一行像素的GOA驱动电路的负载。
由于n1＜＜m1，n2＜＜m2，若要w1与w2均接近于1，所需L1＞＞L2，而由于空间原因，常常会因为补偿电容不足而造成异形区的显示异常。
实施例1：
如图2至图4所示，本实施例提供一种像素驱动电路，包括：驱动单元1、发光单元2、存储单元3、重置单元4、发光控制单元6、数据写入单元5以及第一连接线7；
重置单元4，用于根据第一电压端Init调节第一节点N1的电压；
存储单元3的第一端连接第一节点N1，其第二端连接第二电压端VDD；
驱动单元1，包括驱动晶体管DTFT，用于驱动发光单元2进行发光；
数据写入单元5，用于通过存储单元3的调节向驱动单元1写入数据线端 Vdata的数据信号；
发光控制单元6，用于通过控制驱动单元1而向发光单元2写入显示电流；
第一连接线7与驱动晶体管DTFT的栅极一体成型，且第一连接线7的宽度大于驱动晶体管DTFT的栅极的宽度，以增大像素驱动电路的负载。
本实施例的像素驱动电路中，如图2所示，通过将与驱动晶体管DTFT的栅极连接的第一连接线7的宽度增大，从而增大该像素驱动电路的负载，进而可以解决现有技术中的全面显示屏的异形区(全面显示屏的异形区的第一连接线7的宽度等于驱动晶体管DTFT的栅极的宽度，如图1a所示)中由于设置不了足够的补充电容而不能很好改善异形区的显示异常的问题。也就是说本实施例的像素驱动电路可用于的全面显示屏的异形区中，通过补偿电容和第一连接线7增宽的两种方式的结合，使得异形区中的显示完全正常。需要说明的是，若实际情况允许，也可只需增宽就能改善异形区的显示异常。
具体的，重置单元4包括：第一晶体管T1，其第一极连接第一节点N1，第二极连接第一电压端Init，栅极通过第二连接线8与重置端Reset连接，第二连接线8与第一晶体管T1的栅极一体成型，且第二连接线8的宽度大于第一晶体管T1的栅极的宽度，以增大像素驱动电路的负载。
其中，如图2所示，通过将与第一晶体管T1的栅极连接的第二连接线8的宽度增大，以增大第二连接线8与其下的金属层形成的电容的电容量，从而增大该像素驱动电路的负载，进而可以解决现有技术中的全面显示屏的异形区(全面显示屏的异形区的第二连接线8的宽度等于第一晶体管T1的栅极的宽度，如图1a所示)中由于设置不了足够的补充电容而不能很好改善异形区的显示异常的问题。
重置单元4包括：第一晶体管T1，其栅极连接重置端Reset，第一极连接第一节点N1，第二极连接第一电压端Init。
数据写入单元5包括：
第二晶体管T2，其栅极连接栅线端Gate，第一极连接第一节点N1，第二极连接第二节点N2；
第三晶体管T3，其栅极连接栅线端Gate，第一极连接第三节点N3，第二极连接数据线端Vdata。
发光控制单元6包括：
第四晶体管T4，其栅极连接信号端EM，第一极连接第二电压端VDD，第二极连接第三节点N3；
第五晶体管T5，其栅极连接信号端EM，第一极连接第二节点N2，第二极连接发光单元2。
驱动晶体管DTFT的栅极通过第一连接线7连接第一节点N1，第一极连接第三节点N3，第二极连接第二节点N2。
存储单元3包括：存储电容C，其第一极连接第二电压端VDD，第二极连接第一节点N1。
其中，所有晶体管均为N型晶体管；或者，所有晶体管均为P型晶体管。
在本实施例中，第二电压端VDD用于提供工作电压，第三电压端VSS用于提供参考电压。
需要说明的是，本实施例中的发光单元2可以是现有技术中包括LED(LightEmitting Diode，发光二极管)或OLED(Organic Light Emitting Diode，有机发光二极管)在内的电流驱动的发光器件，在本实施例中是以OLED为例进行的说明。
具体的，该像素驱动电路的驱动方法包括：
S11、重置阶段t1，向第一电压端Init输入重置信号，向重置端Reset输入导通信号，向栅线端Gate和信号端EM输入关断信号。
其中，导通信号是指加载在晶体管栅极上时可使晶体管导通的信号，而关断信号是指加载在晶体管栅极上时可使晶体管关断的信号。
需要说的是，以下以所有晶体管均是P型晶体管为例进行说明，故其中导通信号为低电平信号，关断信号为高电平信号。
在本阶段中，也就是，说向栅线端Gate输入高电平，使得第二晶体管T2、第三晶体管T3关断；向信号端EM输入高电平，使得第四晶体管T4、第五晶体管T5关断。向重置端Reset输入低电平，第一晶体管T1T1导通，使得第一电压端Init的电压写入第一节点N1N1。
需要说明的是，为了便于下一阶段中驱动晶体管DTFT导通，重置信号产生的电压为低电平。
S12、数据写入阶段t2，向数据线端Vdata输入数据信号，向栅线端Gate 输入导通信号，向重置端Reset和信号端EM输入关断信号。
在本阶段中，也就是说，向重置端Reset输入高电平，使第一晶体管T1关断；向信号端EM输入高电平，使得第四晶体管T4、第五晶体管T5关断。向栅线端Gate输入低电平，使得第二晶体管T2、第三晶体管T3导通；第一节点 N1由于上一阶段为低电平，故驱动晶体管DTFT导通。这样数据信号依次通过第三晶体管T3、驱动晶体管DTFT以及第二晶体管T2写入第一节点N1。
S13、显示阶段t3，向第二电压端VDD输入显示电压，向信号端EM输入导通信号，向重置端Reset、栅线端Gate输入关断信号。
在本阶段中，也就是说，向重置端Reset输入高电平，使第一晶体管T1关断；向栅线端Gate输入高电平，使得第二晶体管T2、第三晶体管T3关断。向信号端EM输入低电平，第四晶体管T4、第五晶体管T5导通。这样显示电压依次经过第四晶体管T4、驱动晶体管DTFT、第五晶体管T5写入发光单元2。
实施例2：
如图2至图4所示，本实施例提供一种显示面板，包括：
多个像素驱动电路，像素驱动电路为实施例1的像素驱动电路；
多个像素单元，至少部分像素单元与像素驱动电路一一对应。
优选的，该显示面板具有异形区和非异形区，异形区中的像素单元少于非异形区中的像素单元，像素驱动电路与位于异形区中的像素单元一一对应。
本实施例的显示面板中，如图2所示，通过将与驱动晶体管DTFT的栅极连接的第一连接线7的宽度增大，从而增大该像素驱动电路的负载，进而可以解决现有技术中的全面显示屏的异形区(全面显示屏的异形区的第一连接线7 的宽度等于驱动晶体管DTFT的栅极的宽度，如图1b所示)中由于设置不了足够的补充电容而不能很好改善异形区的显示异常的问题。也就是说本实施例的像素驱动电路可通过补偿电容和第一连接线7增宽的两种方式的结合，使得异形区中的显示完全正常。
优选的，像素驱动电路还包括：第六晶体管T6，其栅极连接下一行像素单元对应的像素驱动电路的重置端Reset，第一极连接第五晶体管T5的第二极，第二极连接第一电压端Init。
其中，也就是说当前行像素单元的显示阶段开始使得下一行的像素单元的重置阶段开始。
当然，与第六晶体管T6连接的连接线相当于第一晶体管T1的栅极连接的第二连接线8，将与第六晶体管T6连接的连接线加宽后也可增大像素驱动电路的负载，以改善异形区的显示异常的问题。
具体的，该显示面板可为有机发光二极管(OLED)显示面板、电子纸、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
应当说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括要素的过程、方法、物品或者设备中还存在另外的相同要素。
依照本实用新型的实施例如上文所述，这些实施例并没有详尽叙述所有的细节，也不限制该实用新型仅为所述的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本实用新型的原理和实际应用，从而使所属技术领域技术人员能很好地利用本实用新型以及在本实用新型基础上的修改使用。本实用新型仅受权利要求书及其全部范围和等效物的限制。

Claims (10)

1.一种像素驱动电路，其特征在于，包括：驱动单元、发光单元、存储单元、重置单元、发光控制单元、数据写入单元以及第一连接线；
所述重置单元，用于根据第一电压端调节第一节点的电压；
所述存储单元的第一端连接第一节点，其第二端连接第二电压端；
所述驱动单元，包括驱动晶体管，用于驱动所述发光单元进行发光；
所述数据写入单元，用于通过所述存储单元的调节向所述驱动单元写入数据线端的数据信号；
所述发光控制单元，用于通过控制所述驱动单元而向所述发光单元写入显示电流；
所述第一连接线与所述驱动晶体管的栅极一体成型，且所述第一连接线的宽度大于所述驱动晶体管的栅极的宽度，以增大所述像素驱动电路的负载。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述重置单元包括：
第一晶体管，其第一极连接第一节点，第二极连接第一电压端，栅极通过第二连接线与重置端连接，所述第二连接线与所述第一晶体管的栅极一体成型，且所述第二连接线的宽度大于所述第一晶体管的栅极的宽度，以增大所述像素驱动电路的负载。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述数据写入单元包括：
第二晶体管，其栅极连接栅线端，第一极连接第一节点，第二极连接第二节点；
第三晶体管，其栅极连接栅线端，第一极连接第三节点，第二极连接数据线端。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述发光控制单元包括：
第四晶体管，其栅极连接信号端，第一极连接第二电压端，第二极连接第三节点；
第五晶体管，其栅极连接信号端，第一极连接第二节点，第二极连接所述发光单元。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述驱动晶体管的栅极通过所述第一连接线连接第一节点，第一极连接第三节点，第二极连接第二节点。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述存储单元包括：
存储电容，其第一极连接第二电压端，第二极连接第一节点。
7.根据权利要求6所述的像素驱动电路，其特征在于，所有晶体管均为N型晶体管；或者，所有晶体管均为P型晶体管。
8.一种显示面板，其特征在于，包括：
多个像素驱动电路，所述像素驱动电路为权利要求1至7中任意一项的像素驱动电路；
多个像素单元，至少部分所述像素单元与所述像素驱动电路一一对应。
9.根据权利要求8所述的显示面板，其特征在于，具有异形区和非异形区，所述异形区中的像素单元少于所述非异形区中的像素单元，所述像素驱动电路与位于所述异形区中的像素单元一一对应。
10.根据权利要求8所述的显示面板，其特征在于，所述像素驱动电路为权利要求6所述的像素驱动电路，所述像素驱动电路还包括：
第六晶体管，其栅极连接下一行所述像素单元对应的像素驱动电路的重置端，第一极连接第五晶体管的第二极，第二极连接第一电压端。
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