CN1460359A - 接收数字电视信号的分集组合器 - Google Patents
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Abstract
公开了一种用于改善信号接收机中的信号接收的装置和方法。该装置包括至少两个第一接收机芯片、数字组合器电路以及单个第三接收机芯片。至少两个天线被用于接收至少两个信号,这些信号通过第一接收机芯片的前端部分和均衡器估计信号的质量。在数字组合器电路中,根据每个信号的质量智能地组合这些信号。组合结果被送到位于单个第三接收机芯片的后端部分中的解码器。
Description
本发明一般地涉及天线系统和信号接收机,更具体地说,涉及改善诸如用于数字地面电视中的数字电视信号的信号的接收的装置和方法。
当二十世纪九十年代初期,第一家卫星运营商开始广播数字格式的信号时,电视机的“数字革命”就开始了。从此,数字电视机(DTV)系统开始替代现有的地面模拟NTSC(国家电视制式委员会)电视系统。
数字电视节目广播一般由若干同时的标准清晰度电视(SDTV)图像流或单个高清晰度电视(HDTV)图像组成。SDTV一般被认为与今天的模拟电视广播具有相同的质量水平,而HDTV涉及大量更高清晰度的视频标准,这些标准大大提高了屏幕上的画面质量和声音质量。这两种主要的电视标准被认为是在ATSC(先进电视标准委员会)之内,ATSC是美国在1994年开始的用于地面广播的新标准。为了使消费者把他们的老电视机换成接收机,并且提高电视的视觉体验,ATSC标准是兼容于HDTV。HDTV标准图像的清晰度高达模拟电视图像清晰度的6倍,并且时间分辨率高达全60帧每秒,这是目前NTSC分辨率的两倍。运动看上去平滑,并且画面足够清晰,可以坐得离非常大的屏幕很近。画面以全景16∶9的水平-垂直长宽比显示,从而更象电影并增加了电视的真实感。HDTV视频信号包括的数据是NTSC图像的数据的将近四到五倍。
从开始该标准开始至今,通过室内天线接收HDTV信号就一直是一种挑战。目前的室内天线通常连接到由单个接收机芯片构成的电视接收机。图1示意了典型的信号接收机系统。这些接收机接收比HDTV预期质量差很多的低质量信号。由于15dB的SNR(信噪比)能见度的标准阈值,信号中的噪声常常使得接收机甚至难以接收这种信号。因此,不可能接收信噪比低于15dB的“噪声”电视信号。所以,需要一种接收机,它允许接收SNR低于15dB的信号。
此外,对于一个定向天线来说,天线的位置对于获得满意的接收是重要的。通过目前的接收机系统,不转动天线几乎不可能改变频道。因此,需要一种接收机,它对天线的位置要求没有那么高。
根据NAB/MSTV(全国广播工作者协会与最大服务电视台协会)联盟进行的现场试验,如ATSC官方网站(http://www.atsc.org)所报告的,30%的接收机失败源于弱场强。因此需要一种接收机,它降低接收机处于低场强中的概率。
因此,本发明的一个目的是提供一种用于在连接到至少两个位于室内或室外的天线的接收机中改善信号接收的系统和方法。
本发明致力于先有技术的要求,它提供一种装置,该装置包括:至少两个第一接收机芯片,其中每个芯片与一个天线关联,每个芯片具有前端部分、均衡器以及后端部分;用于从所述芯片接收信号的数字组合器电路,该数字组合器电路具有至少两个第一缓冲存储器、至少两个第二缓冲存储器以及时钟同步模块,其中每个缓冲存储器生成一个输出信号;连接到第一接收机芯片以及数字组合器电路的公共总线;所述时钟同步模块能够生成延迟信号并且根据公共时钟调整各缓冲存储器的输出信号;所述数字组合器电路能够生成组合输出信号;以及用于接收数字组合器电路的组合输出信号的单个第二接收机芯片,其中所述第二接收机芯片包括前端部分、均衡器以及后端部分。
在另一实施例中,提供了一种方法,该方法包括:从第一接收机芯片中的第一和第二天线接收第一信号和第二信号;在包括第一缓冲存储器、第二缓冲存储器和时钟同步模块的数字组合器电路中处理这些信号,以生成延迟信号,从而将来自缓冲存储器的输出信号进行同步和组合以生成组合输出信号;以及将组合输出信号传递到单个第二接收机芯片。
本发明的上述和其它特定及其优点,将通过以下特定有利实施例的详细描述变得显而易见,这些实施例应结合作为本说明书的一个组成部分的附图进行阅读,并且其中相应部分和部件在附图中多个视图中用相同的标号标识。本发明的范围将在所附权利要求中指出。
现参考附图对本发明的实施例进行例示性地描述,其中:
图1是根据先有技术的单个信号接收机装置的方框图;
图2是根据本发明的一个实施例的信号接收机装置的示意性实施例的方框图。
图3是根据本发明的一个实施例,说明图2的装置中接收机之间的通信的方框图;以及
图4是说明本发明的一个实施例中所用的最大比值合并算法的流程图;
如图1所示,典型的信号接收机系统包括天线1,它连接到调谐器5,用于接收电视信号,其中调谐器5接收中频(IF)信号2并且将信号下变频到低IF信号3。一般来说,标准IF信号是44Mhz的信号,而低IF信号是低于10Mhz的信号。然后,模数转换器(ADC)10将低IF信号3转换为数字信号4。接收机芯片15包括前端部分(FE)16、均衡器(EQ)17以及后端部分(BE)18,该芯片接收数字信号4并在所有三个部分中处理该信号。接收机芯片15最好是ATSC A/53依从性芯片,这意味着它能够接收8-VSB信号,这种信号是模拟NTSC电视系统目前所用的相同6Mhz频道上以地面广播模式广播的8级({±1、±3、±5、±7})VSB信号。数字和字母8-VSB指的是电视信号调制形式,其中电视信号具有8个残留边带。典型的标准符号率是10.76Mhz。
根据图2中所示的本发明的优选实施例,多个并且至少两个ATSCA/53依从性DTV接收机芯片15A、15B和15C被组合在一块板上,作为分集组合器接收机,借此将改善数字地面电视的接收机性能。具体地说,天线1A和1B接收传递到调谐器5A-5B的两个不同IF信号2A-2B。使用两个天线而不是一个天线提供了接收信号的更大可能性。I2C总线30A电连接到集成芯片(IC)板20A-20B,并建立调谐器5A-5B之间的通信。然后,通过I2C总线30A将调谐器5A-5B调谐到同一频道,其中总线30A由计算机控制并且可由计算机进行程序设计(未示出)。或者,总线30A可以由电视机控制。调谐器5A-5B必须接收相同信号。计算机一般将具有为控制I2C总线30A而安装的标准通信软件。调谐器5A-5B将IF信号2A-2B下变频到低IF信号3A-3B,然后分别通过模数转换器10A-10B将这些低IF信号转换为数字信号4A-4B。
接收机芯片15A-15B在前端部分16A-16B接收数字信号4A-4B,并且在前端部分16A-16B以及均衡器17A-17B中对这些信号进行处理。如图3所示,没有利用后端部分18A-18B。接收机芯片的前端部分一般被用于定时恢复目的,而均衡器则被用作消除干扰和回波的解调器。后端部分被用作解码器,具体地说,用于前向纠错(FEC)处理。
接收机芯片15A-15B的所有输出被送到数字组合器电路25。在本发明的优选实施例中,数字组合器电路25是现场可编程门阵列(FPGA)。或者,该数字组合器电路25可以是数字信号处理器(DSP)或运行在计算机上的软件。同步输出33A-33B被送到时钟同步模块85的相关器50。同步输出33A-33B表示段同步何时到达。在标准ATSC信号中垂直传输段同步。根据这些同步输出,相关器50生成延迟信号45,它是两个信号4A-4B之间的时间差。例如,频道1上的信号可能比频道2上的信号早0.1微秒到达,即天线1A接收信号比天线1B早。因此,产生了延迟45。相关器50一般作为减法器,它计算两个同步信号之间的时间差,即相关器50通知数字组合器25两个数据流之间的时间偏移量,以及在缓冲存储器35的流之一上延迟45为多少。然后,相关器50对多个同步信号上的偏移量进行平均。相关器50还生成同步输出信号52,该信号被送到符号时钟选择器55。同步输出信号52通知系统数据流在ATSC结构中的什么位置,每个接收机芯片独立地知道其数据流在ATSC帧中的何处。
接收机芯片15A-15B还生成锁信号34A-34B,它们表示信号4A-4B存在或不存在,即锁信号表示是否已得到信号。接收机芯片15A-15B的其他输出是均衡器输出41A-41B以及符号选通输出42A-42B,它们作为到缓冲存储器35和40的输入。然后,锁信号34A-34B以及符号选通信号42A-42B被送到符号时钟选择器。符号选通信号42A-42B最好在10.76Mhz的频率上工作。因此,存在两个与各个符号选通42A-42B对应的时钟,即各接收机芯片在不同时钟上工作。但是,由于这些信号将被组合,其结果必须在一个时钟上工作。因此,在两个时钟之间发生切换,这种切换可能导致一些时钟干扰。为了使这种时钟干扰最小化,可用12Mhz信号替代10.76Mhz。响应于输入34A-34B以及42A-42B,符号时钟选择器55生成符号选通输出60,该输出被选为图2所示系统的公共时钟。
第一存储缓冲器最好是先进先出存储器(FIFO)35。这意味着先写入存储器的数据先出去。第二存储缓冲器最好是随机存取存储器(RAM)40。最好用硬件实现FIFO 35,但是,用软件的备选实现也是可能的。FIFO 35接收均衡器输出信号41A和符号选通信号42A。这样,根据符号选通42A将均衡器输出信号41A写入FIFO 35。对两个输入的10.76Mhz符号流进行调整,从而将每个符号加到来自另一流的相应符号上。可以预期,各路径之间将不存在超过1-2个符号的变化(<200ns)。这意味着可以利用相对较短的FIFO。例如,对于2个符号变化,可以利用长度为4个符号的FIFO。相应的场同步输出可被用于调整符号流。场同步输出是标准ATSC信号的一个部分。ATSC标准具有场结构的数据-对于数据的每312段,存在一个被称为场同步的段以建立完整的ATSC场。这种场同步被用于调整数据流。符号时钟选择器55选择符号选通42A或42B,并且生成符号选通输出信号60。由相关器50生成的延迟信号45也被送到FIFO35。根据该延迟信号45,FIFO 35对信号41进行延迟,使得缓冲器输出信号74A-74B精确同步,并且在同一时间到达点75A和75B。FIFO一般以深度进行测量,该深度表示FIFO的长度。在优选实施例中,FIFO的长度与延迟相等。例如,可利用8×16的FIFO(每符号8比特,长度为16符号阵列)。在同一时间,根据符号选通输出60读出缓冲器输出信号,该信号从符号时钟选择器送到各缓冲器35和40。
处理以上提到的输出之外,接收机芯片15A-15B还生成信号质量指示符(SQI)输出(未示出)。电连接到接收机芯片15A-15B的I2C总线30B具有输入和输出。I2C总线30B从接收机芯片15A-15B读取SQI输出。一般在运行在计算机(未示出)上的软件中生成SQI值。标准ATSC信号具有水平传输的帧同步以及垂直传输的段同步。帧同步作为训练信号;一旦它到达,其后的整个信号才变得清楚。然后,将预期信号与实际达到的信号进行比较,并且根据这种比较,在每个接收机芯片中生成SNR(信噪比)。SQI是从SNR中得到的。
最大比值合并:
I2C总线30C电连接到数字组合器电路25,具体地说,连接到接口模块65,该接口模块将加权因子K以及1-K应用于缓冲器输出信号74A-75B。利用图4所示的最大比值合并算法确定加权因子。
在步骤A1接收信号之后,在接收机芯片内确定各信号的质量并通过I2C总线进行通信。SQI表示信号质量。在本发明的优选实施例中,均方误差(MSE)被用于SQI。或者,可以利用测量信号中的误差的其他函数。作为标准ATSC信号的一部分,已知的场同步每24毫秒到达一次。因为根据符号选通信号42A-42B以及同步时钟信号33A-33B,已经知道在帧中的准确位置,因此场同步是预先已知的。因此,由于已知标准帧为832乘313个符号,也就知道了下一帧到达的准确时间。将场同步与实际到达的进行比较,并且根据这种比较计算MSE。对多个场同步的各个频道执行相同的过程,并且对MSE进行平均以产生平均MSE,这就是SQI。频道上的MSE越低,信号质量越好。相反也成立:MSE越高,信号质量越差。在步骤A5,执行上述确定信号质量的过程。只有当频道1上的信号是好的,并且不使用频道2上的信号时,才在步骤A10中将加权因子K设置为零。只有当频道2上的信号是好的时,才在步骤A20中将加权因子设置为1。如果两个频道上的信号都是好的,则在步骤A15中,用加法器70智能地将它们组合,其中K被设置为:
K=MSE1/(MSE1+MSE2) (式1)
在步骤A25中计算组合输出信号77(eqout):
Eqout=(1-K)(eqout1(n))+(K)(eqout2(n)) (式2)其中加权因子K在0到1之间。K越接近零,频道1的信号越占优势。K越接近1,频道2的信号越占优势。然后,将组合输出信号77送到接收机芯片15C。具体地说,如图3所示,信号77只被送到后端部分18C,该后端部分最好是前向纠错(FEC)单元,用于解码目的。后端部分18C的输出是所需数字信号80。这种组合信号80的质量大大高于图3所示的信号13。通过将两个信号与不同噪声组合,可得到大约3db的增益。实验上,14.9dB SNR的能见度的理论阈值约被降低到根据本发明的组合信号的12.5dB。另外,根据本发明的接收机降低了接收机位于低场强区的概率。例如,通过n个天线,接收机在空场中的机会减少了n倍。同时,能见度阈值的降低有助于减少更低磁场强度效应。
在备选实施例中,可以实现两个以上的天线以及与天线有关的两个以上的平行接收机链。这将导致比双天线系统更复杂和昂贵的系统,如本领域的普通技术人员所理解的。数字组合器电路将变得更加复杂,具体地说,将需要利用多个缓冲存储器。例如,对于n个接收机链,在n>2的情况下需要(n-1)个FIFO以及(n-1)个RAM。但是,将只使用如优选实施例中的单个接收机芯片中的一个解码器以及一个时钟同步模块。
本发明的装置和方法并不只限于改善电视信号。本领域的技术人员将容易地理解,本发明的原理还可以成功地应用于其他类型的信号。
本文中所用的术语应当作为描述术语而不是限制性术语来理解,因为通过本说明书,本领域的技术人员将可以对本发明进行修改,并不背离本发明的精神。除本文中所论述的实施例以外的其他实施例在所附权利要求的精神和范围内。
Claims (12)
1.一种用于改善具有至少两个天线的接收机中的接收的装置,所述装置包括:
-至少两个第一接收芯片,其中所述每个芯片与所述天线之一相关,所述每个芯片包括前端部分、均衡器以及后端部分;
-数字组合器电路,用于从所述芯片接收信号,所述数字组合器电路包括至少两个第一缓冲存储器、至少两个第二缓冲存储器以及时钟同步模块,其中各缓冲存储器生成输出信号;
-公共总线,连接到所述第一接收机芯片以及所述数字组合器电路;
-所述时钟同步模块能够根据公共时钟生成延迟信号并调整所述各缓冲存储器的所述输出信号;
-所述数字组合器电路能够生成组合输出信号;
-单个第二接收机芯片,用于接收所述数字组合器电路的所述组合输出信号,所述第二接收机芯片包括前端部分、均衡器以及后端部分。
2.如权利要求1所述的装置,其特征在于还包括至少2个调谐器,用于从各天线接收IF信号并将所述IF信号转换为低IF信号,所述转换之后将所述低IF信号传递到所述第一接收机芯片。
3.如权利要求2所述的装置,其特征在于还包括至少2个模数转换器,每个模数转换器接收所述低IF信号并生成将传递到所述第一接收机芯片的数字输入信号。
4.如权利要求3所述的装置,其特征在于每个所述第一接收机芯片生成均衡器输出信号,以响应于所述数字输入信号,其中在所述前端部分和所述均衡器中处理所述数字输入信号,然后所述均衡器生成均衡器输出信号。
5.如权利要求4所述的装置,其特征在于每个所述第一缓冲存储器以及每个所述第二缓冲存储器接收所述均衡器输出信号,并且生成同步存储缓冲器输出信号,根据信号质量指示符的值对所述同步的存储缓冲器输出信号进行加权。
6.如权利要求5所述的装置,其特征在于通过所述公共总线传递所述信号质量指示符的值,所述公共总线由计算机控制。
7.如权利要求5所述的装置,其特征在于利用最大比值合并算法对所述同步存储缓冲输出进行加权。
8.如权利要求5所述的装置,其特征在于所述数字组合器电路还包括加法器,所述加法器产生所述组合输出信号,以响应于所述加权同步存储缓冲器输出信号。
9.如权利要求1所述的装置,其特征在于所述第二接收机芯片在所述后端部分接收所述组合输出信号。
10.一种改善具有第一天线和第二天线的信号接收机中的信号接收的方法,所述方法包括以下步骤:
-对公共总线进行程序设计,以使得第一和第二调谐器在同一频道上工作;
-分别将从所述第一和第二天线接收的第一和第二IF信号下变频到第一低IF信号以及第二低IF信号;
-将所述第一和第二低IF信号转换为所述第一和第二数字信号;
-在第一和第二接收机芯片的前端部分和均衡器中修改所述第一和第二信号,以恢复计时并调整所述第一和第二数字信号中的失真。
-将所述第一和第二数字信号传递到数字组合器电路;
-在第一和第二存储缓冲器中根据时钟同步单元生成的延迟信号,延迟所述第一和第二数字信号;
-将所述第一和第二数字信号调整到公共时钟;
-根据信号质量指示符的值,对所述第一和第二数字信号进行加权;
-将所述加权的数字信号相加;
-将组合输出信号传递到第三接收机芯片的后端部分中。
11.如权利要求10所述的方法,其特征在于,利用最大比值合并算法对所述数字信号进行加权。
12.一种用于改善至少具有第一和第二天线的接收机中的接收的方法,所述方法包括以下步骤:
-从第一接收机芯片中的所述第一和第二天线接收第一和第二信号;
-为了生成延迟信号以对来自所述缓冲存储器的输出信号进行同步和组合,从而生成组合输出信号,在数字组合器电路中处理所述信号,其中所述数字组合器电路包括第一和第二缓冲存储器以及时钟同步模块;
-将所述组合输出信号传送到单个第二接收机芯片。
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