CN1328678C - 包括实时数据通信部件的dma控制器系统及传送数据的方法 - Google Patents

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Abstract

一种系统包括用来实时地转移数据的直接存储器存取(DMA)引擎和用来传输和接收数据的通信前端。在另一个实施例中，系统也可以包括用来控制数据的传输和接收的媒体存取控制(MAC)，后者可以按照执行所选择的功能的响应时间被划分。

Description

包括实时数据通信部件的DMA控制器系统及传送数据的方法
发明领域
本发明总体涉及计算机系统、通信系统等，更具体来说，涉及一种包括实时数据传输和接收部件的系统。
背景技术
运行没有实时功能的操作系统—诸如微软视窗系列操作系统等的计算机系统或装置，需要用专用的通信协处理器实时地向通信前端提供数据和从通信前端接收数据。对于数据传输，在通信协处理器上运行的实时软件从主计算机系统接收数据，并将数据缓存在一个相关联的本地存储装置中。协处理器然后监视通信前端，在通信前端能传输数据时，以限时的(time-bounded)方式向通信前端提供数据。对于数据接收，在通信协处理器上运行的实时软件以限时的方式从通信前端接收数据，并将数据缓存在一个相关联的本地存储装置中，一直到主计算机准备好接收数据。额外的协处理器和相关联的本地存储器增加了系统的额外成本，占据额外的空间并消耗额外的电力，这是令人关心的问题，在移动系统或装置中尤其如此。
发明内容
通信/计算机系统和装置一般包括要求数据的实时输入和输出的通信前端(front-ends)，用于在通信媒体上对数据的传输和接收。在这种系统或装置中，一个包括相关联的存储器或存储装置的处理器运行一个实时操作系统，用于在没有运行不足(under-runs)或运行过度(over-runs)的情况下等时地(isochronously)向通信前端提供数据和从通信前端接收数据。
根据本发明，提供了一种用于传送数据的系统，所述系统包含：用于传输和接收数据的通信前端；用于存储数据的存储装置；适用于响应相应的流控制信号，向通信前端提供数据或从通信前端转移数据的直接存储器存取引擎，所述直接存储器存取引擎具有一个流控制协议以在所述存储装置和所述通信前端之间等时地传送数据，消除了对通信处理器的要求。
本发明还提供了一种用于传送数据的系统，所述系统包含：用于传输和接收数据的通信前端；用于存储数据的存储装置；用来控制数据的传输和接收的媒体存取控制；和用来在系统内转移用于传输和接收的数据的直接存储器访问引擎，所述直接存储器存取引擎具有一个流控制协议以在所述存储装置和所述通信前端之间等时地传送数据，消除了对通信处理器的要求。
本发明还提供了一种用于传送数据的方法，所述方法包含：在存储装置中存储数据；用信号通知直接存储器存取引擎所述数据可用于传输，且所述直接存储器存取引擎具有一个流控制协议；根据所述流控制协议生成流控制信号；响应流控制信号而向通信前端转移数据，所述数据在所述存储装置和所述通信前端之间等时地传送，消除了对通信处理器的要求；和传输数据。
本发明还提供了一种用于传送数据的方法，所述方法包含：提供用于实时地传输和接收数据的直接存储器存取引擎；和把直接存储器存取引擎连接到运行非实时操作系统的处理器，所述直接存储器存取引擎具有一个流控制协议以在所述存储装置和所述通信前端之间等时地传送数据，消除了对通信处理器的要求。
附图简述
图1是按照本发明实施例的包括实时数据传输和接收部件的系统的框图；
图2是按照本发明实施例的实时数据传输方法的流程图；
图3是按照本发明实施例的实时数据接收方法的流程图；
图4是按照本发明实施例的包括实时数据传输和接收部件的另一个系统的框图。
优选实施例描述
以下对优选实施例的详细说明参照了图解本发明具体实施例的附图。具有不同结构和操作的其它实施例，不会脱离本发明的范围。
图1是按照本发明实施例的包括实时数据传输和接收部件的系统100的框图。系统100包括主处理器102和与主处理器102相关联的数据存储器或存储装置104。存储装置104可以通过存储器接口105与处理器102相连。存储器接口105可以是总线系统等。存储装置104存储由处理器102使用的代码和数据。存储装置104也可以存储可以由系统100传输和接收的通信数据106。处理器102运行一种非实时的操作系统和应用软件108，诸如Microsoft Windows系列程序等，处理器102也可以运行通信软件110来实现执行与传输和接收数据相关联的功能。
直接存储器存取(DMA)引擎112可以通过主接口114与主处理器102相连。主接口114可以是总线系统或类似的装置。DMA引擎112可以通过数据接口115与存储装置104相连，用于向DMA引擎112来回传输数据。DMA引擎112可以包括一个相关联的缓冲器空间116，数据可以被缓存到该缓冲器空间116中，以补偿与存储装置104相关联的任何存取延迟。DMA引擎112可以采用硬件或软件或者硬件和软件的组合来实现。DMA引擎112可通过可以是总线系统之类的通信接口120，连接到诸如是射频(RF)发射器/接收器的通信前端118。DMA引擎112和通信前端118在通信接口120上交换数据和控制信号。通信前端118通过诸如是自由空间(free space)或电线或电缆连接之类的通信媒体122，传输或接收数据。
DMA引擎112方便数据以限时的方式在通信前端118与存储装置104之间的转移，而不受主处理器102和相关联的操作系统和应用软件108的干预，使得主处理器102能继续执行其它功能。本发明因此以DMA引擎112或类似的装置替代成本更高的协处理器，执行数据的实时传输和接收相关联的功能，并消除对在主处理器102上运行的通信软件110的任何实时要求。
图2是按照本发明实施例的实时数据传输方法200的流程图。在方框202中，在主处理器102上运行的通信软件110在存储装置104中为命令与数据缓冲区124(图1)分配存储空间。在方框204中，通信软件1 10在命令与数据缓冲区124中对数据和相关联的命令排队，用于传输数据。在方框106中，通信软件110用信号通知DMA引擎112数据可用于传输，在方框108中，DMA引擎112用信号通知通信前端118数据可用于传输。在方框210中，从通信前端118通过通信接口120向DMA引擎112发送一个数据流控制请求信号。在方框212中，数据被DMA引擎112从存储装置104转移到通信前端118，在方框214中，数据在一个限时的期间内或在一个预定的时间段内被传输，而不受软件干预，也不干涉处理器102的正常操作。
图3是按照本发明实施例的实时数据接收方法300的流程图。在方框302中，数据通过通信媒体122被通信前端118接收。在方框304中，从通信前端118通过通信接口120向DMA引擎112发送一个数据流控制消息。在方框306中，数据被接收在DMA引擎缓冲器116中。在方框308中，DMA引擎112在一个限时的期间内、在不干涉处理器102的正常操作的情况下，把数据转移到存储装置104。因此，本发明实际上消除了对在主处理器102上运行的通信软件110的任何实时要求。
DMA引擎112包括一个用于在存储装置104与通信前端118之间等时地传送数据的流控制协议。DMA引擎112因此提供了一个通信协处理器的功能，并消除了对通信协处理器的需要。
图4是按照本发明实施例的包括实时数据传输和接收部件的系统400的框图。系统400包括主处理器402。存储装置404可以通过存储器接口406与主处理器402相连。存储器接口406可以包括一个总线系统或类似装置。主处理器402运行非实时的应用程序和操作系统408，诸如MicrosoftWindows系列的程序或类似程序。DMA引擎410可以通过一个主接口112与主处理器402相连。主接口112可以包括一个总线系统等。DMA引擎410也可以通过数据接口413与存储装置404相连，用于在DMA引擎410与存储装置404之间传送数据。可以将一个缓冲空间414与DMA引擎410相关联，以补偿存储装置404中的延迟。DMA引擎410可以通过可以包括总线系统之类的通信接口418，连接到一个通信前端416。
系统400可以包括一个实时媒体存取控制(MAC-Medium AccessControl)，该MAC可以被划分成一个可与主处理器402相关联的主MAC420和一个可与通信前端416相关联的简化MAC 422。一般来说，媒体存取控制控制多个能被粘附到一个共享的通信媒体的装置对该媒体的访问。媒体存取控制，是局域网(LAN)中的、控制由LAN附接的装置对共享通信装置的访问的电力与电子工程协会(IEEE)子层(sublayer)。在开放系统互连(OSI)基准模型的上下文中，媒体存取控制层扩展到数据链路层(层1)之上和物理链路层(层2)之下。MAC能执行有关控制通信量响应、数据转移、管理通信量响应以及数据分段和重组的功能。
可以按照执行不同的MAC功能需要不同的响应时间，在主MAC 420与简化MAC 422之间选择性地划分MAC功能。主MAC 420可以负责管理毫秒级的功能和能在毫秒级被执行的功能，诸如管理通信量响应、数据分段和重组功能等。简化MAC 422可以负责管理微秒级的功能和需要在微秒级执行的功能，诸如通信量响应控制等。由主MAC 420执行的、不需要微秒级响应时间的管理通信量响应、数据分段和重组功能，可以由一个足够快的处理器402处理，该处理器运行一个高效的、非实时的操作系统408，诸如较晚版本的Microsoft Windows系列操作系统等。主MAC 420可以以软件形式实现。简化MAC 422可以以逻辑电路形式或者以带有相关联的存储装置424的微控制器形式实现。DMA引擎410可以被用于与主MAC 420和简化MAC 422一起进行数据转移，以满足系统400中对数据转移的实时要求。
尽管本文阐释并描述了具体实施例，所属技术领域中的普通熟练人员不难理解，任何被设计用来实现相同目的的配置都可以替代所示的具体实施例。本申请旨在保护对本发明的任何修改和变体。因此，本发明仅由权利要求书及其等同物限定。

Claims (28)

1.一种用于传送数据的系统，所述系统包含：
用于传输和接收数据的通信前端；
用于存储数据的存储装置；
适用于响应相应的流控制信号，向通信前端提供数据或从通信前端转移数据的直接存储器存取引擎，所述直接存储器存取引擎具有一个流控制协议以在所述存储装置和所述通信前端之间等时地传送数据，消除了对通信处理器的要求。
2.权利要求1的系统，进一步包含对数据排队并用信号通知直接存储器存取引擎所述数据已可用于传输的软件。
3.权利要求1的系统，进一步包含一个缓冲器空间，其中直接存储器存取引擎在预定的时间段内不受软件的干预而把由通信前端接收的数据转移该缓冲器空间。
4.权利要求3的系统，其中缓冲器空间经选择用来补偿所述存储装置中的存取延迟。
5.权利要求1的系统，进一步包含：
通信软件；和
由用于数据的传输和接收的通信软件所分配的命令与数据缓冲器。
6.权利要求5的系统，进一步包含：
运行非实时操作系统的处理器；
其中，所述直接存储器存取引擎适用于在不干涉处理器的正常操作的情况下以限时的方式向存储装置通过数据或从存储装置转移数据。
7.权利要求1的系统，进一步包含用来控制与数据的传输和接收相关联的功能的媒体存取控制。
8.权利要求7的系统，其中，所述媒体存取控制功能按照所选择的功能而划分。
9.权利要求8的系统，其中，媒体存取控制功能按照执行所选择的功能的响应时间而划分。
10.权利要求7的系统，其中，媒体存取控制功能包含：
通信量控制响应；
数据转移；
管理通信量响应；和
数据分段和重组。
11.权利要求7的系统，其中，划分媒体存取控制功能并且其中该划分包含：
主媒体存取控制；和
外部的简化媒体存取控制。
12.权利要求11的系统，其中，外部的简化媒体存取控制管理通信量控制响应。
13.权利要求11的系统，其中，主媒体存取控制管理管理通信量响应以及数据分段和重组。
14，一种用于传送数据的系统，所述系统包含：
用于传输和接收数据的通信前端；
用于存储数据的存储装置；用来控制数据的传输和接收的媒体存取控制；和
用来在系统内转移用于传输和接收的数据的直接存储器访问引擎，所述直接存储器存取引擎具有一个流控制协议以在所述存储装置和所述通信前端之间等时地传送数据，消除了对通信处理器的要求。
15.权利要求14的系统，其中所述媒体存取控制功能按照所选择的功能而划分。
16.权利要求14的系统，其中，媒体存取控制功能被分割，并包含：
主媒体存取控制；和
外部的简化媒体存取控制。
17.权利要求16的系统，其中，主媒体存取控制在主处理器上运行，并管理管理通信量响应以及数据分段和重组。
18.权利要求16的系统，其中，外部的简化媒体存取控制与通信前端相关联并管理通信量控制响应。
19.一种用于传送数据的方法，所述方法包含：
在存储装置中存储数据；
用信号通知直接存储器存取引擎所述数据可用于传输，且所述直接存储器存取引擎具有一个流控制协议；
根据所述流控制协议生成流控制信号；
响应流控制信号而向通信前端转移数据，所述数据在所述存储装置和所述通信前端之间等时地传送，消除了对通信处理器的要求；和
传输数据。
20.权利要求19的方法，进一步包含对数据和相关联的命令排队。
21.权利要求19的方法，包含实现媒体存取控制。
22.权利要求21的方法，包含：
在主处理器中实现一部分媒体存取控制；和
在外部实现另一部分媒体存取控制。
23.权利要求21的方法，包含：
在主处理器中实现管理通信量响应和数据分段与重组的媒体存取控制功能；
在通信前端上实现通信量控制响应的媒体存取控制功能；和
用媒体存取控制引擎移动数据。
24.一种用于传送数据的方法，所述方法包含：
提供用于实时地传输和接收数据的直接存储器存取引擎；和
把直接存储器存取引擎连接到运行非实时操作系统的处理器，所述直接存储器存取引擎具有一个流控制协议以在所述存储装置和所述通信前端之间等时地传送数据，消除了对通信处理器的要求。
25.权利要求24的方法，进一步包含把直接存储器存取引擎连接到通信前端。
26.权利要求24的方法，进一步包含提供媒体存取控制。
27.权利要求24的方法，包含：
在处理器上提供所选择的媒体存取控制功能；和
提供与通信前端相关联的其它所选择的媒体存取控制功能。
28.权利要求27的方法，进一步包含：
在主处理器上提供管理通信量响应媒体存取控制功能和数据分段与重组媒体存取控制功能；
提供与通信前端相关联的通信量控制响应媒体存取控制功能。
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Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1526472A3 (en) * 1995-02-13 2006-07-26 Intertrust Technologies Corp. Systems and methods for secure transaction management and electronic rights protection
US7016942B1 (en) * 2002-08-05 2006-03-21 Gary Odom Dynamic hosting
US8117624B2 (en) * 2003-09-16 2012-02-14 Matrox Electronic Systems Ltd. Method and apparatus for performing real-time commands in a non real-time operating system environment
US7346382B2 (en) 2004-07-07 2008-03-18 The Cleveland Clinic Foundation Brain stimulation models, systems, devices, and methods
US20060105720A1 (en) * 2004-11-18 2006-05-18 Nair Vijay K Signal interface for a wireless device
US7764612B2 (en) * 2005-06-16 2010-07-27 Acme Packet, Inc. Controlling access to a host processor in a session border controller
US7500072B2 (en) * 2006-04-25 2009-03-03 International Business Machines Corporation Migrating data that is subject to access by input/output devices
CN103984662B (zh) * 2014-05-29 2017-03-15 华为技术有限公司 一种读、写数据的方法及设备、存储系统
US10417083B2 (en) * 2017-11-30 2019-09-17 General Electric Company Label rectification and classification/prediction for multivariate time series data

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5434976A (en) * 1992-09-28 1995-07-18 Standard Microsystems Corporation Communications controller utilizing an external buffer memory with plural channels between a host and network interface operating independently for transferring packets between protocol layers
CN1111801A (zh) * 1994-03-16 1995-11-15 北村机电株式会社 环形变压器的卷绕铁芯
US5909564A (en) * 1997-03-27 1999-06-01 Pmc-Sierra Ltd. Multi-port ethernet frame switch
US6212195B1 (en) * 1998-12-01 2001-04-03 3Com Corporation Telecommunication apparatus and method for forwarding packets using separate collision domains

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5020020A (en) * 1989-04-07 1991-05-28 Digital Equipment Corporation Computer interconnect system with transmit-abort function
US6373841B1 (en) * 1998-06-22 2002-04-16 Agilent Technologies, Inc. Integrated LAN controller and web server chip
US6163819A (en) * 1998-07-21 2000-12-19 Micron Technology, Inc. Sequential data transfer circuit
US6681254B1 (en) * 1998-09-10 2004-01-20 International Business Machines Corporation Method of controlling the flow of information between senders and receivers across links being used as channels
US6529945B1 (en) * 1999-07-26 2003-03-04 International Business Machines Corporation Data buffer management between two different systems
US6651107B1 (en) * 1999-09-21 2003-11-18 Intel Corporation Reduced hardware network adapter and communication
US6404861B1 (en) * 1999-10-25 2002-06-11 E-Cell Technologies DSL modem with management capability
US6564267B1 (en) * 1999-11-22 2003-05-13 Intel Corporation Network adapter with large frame transfer emulation
JP3878785B2 (ja) 2000-03-16 2007-02-07 株式会社リコー ネットワークインタフェース回路
US20020161941A1 (en) * 2001-04-30 2002-10-31 Sony Corporation And Electronics, Inc System and method for efficiently performing a data transfer operation

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5434976A (en) * 1992-09-28 1995-07-18 Standard Microsystems Corporation Communications controller utilizing an external buffer memory with plural channels between a host and network interface operating independently for transferring packets between protocol layers
CN1111801A (zh) * 1994-03-16 1995-11-15 北村机电株式会社 环形变压器的卷绕铁芯
US5909564A (en) * 1997-03-27 1999-06-01 Pmc-Sierra Ltd. Multi-port ethernet frame switch
US6212195B1 (en) * 1998-12-01 2001-04-03 3Com Corporation Telecommunication apparatus and method for forwarding packets using separate collision domains

Also Published As

Publication number Publication date
CN1653436A (zh) 2005-08-10
US20050182865A1 (en) 2005-08-18
DE60311799T2 (de) 2007-11-22
WO2003098453A1 (en) 2003-11-27
US7099961B2 (en) 2006-08-29
US20030212839A1 (en) 2003-11-13
MY137150A (en) 2008-12-31
EP1506487A1 (en) 2005-02-16
US6865622B2 (en) 2005-03-08
EP1506487B1 (en) 2007-02-14
HK1071794A1 (en) 2005-07-29
AU2003225016A1 (en) 2003-12-02
ATE354129T1 (de) 2007-03-15
DE60311799D1 (de) 2007-03-29

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