CN1208906A - 存储装置和存储方法 - Google Patents

Abstract

一种存储输入图像数据的装置和方法,可以立即获得通过放大输入图像而形成的图像。在输入图像存储器2中,利用由分别相应于在垂直和水平方向的像素位置的水平和垂直地址指定的地址输入图像被按顺序地存储。在形成其像素数大于输入图像的像素倍增图像所需的输入图像的像素被存储在输入图像存储器中之后,这些像素被读出到像素倍增图像形成电路,并被用于形成像素倍增图像的像素。该像素倍增图像被存储在像素倍增图像存储器中。

Description

存储装置和存储方法

本发明涉及一种存储装置和存储方法，尤其涉及一种适用于例如存储放大的图像的存储装置和存储方法。

已知一种编码方法，其中高清晰度图像数据被设置作为最底层或第一层图像数据，然后形成较少像素数的第二层图像数据，接着形成图像数更少的第三层图像数据，最后形成最外层即第四层图像数据。这种编码被称为分层编码，在每层中的图像数据在具有和该层相应的清晰度(像素数)的监视器上显示。因而，用户可以选择和其监视器的清晰度相应的分层编码图像数据中的图像数据，以便观看相应的图像。

然而，在常规的分层编码中，原始的图像数据被设置作为第一层图像数据，并且只形成关于较少的像素数的高层中的图像数据。即，利用常规的分层编码，不能形成像素数大于原始图像数据的像素数的图像。

在分层编码中，例如当进行电子放大时，使用形成像素数大于原始图像数据的像素数的图像(下面按照惯例称为像素倍增图像)的方法是方便的。

即，如果制备像素数小于原始图像数据的像素数，则图像的尺寸可以立即缩小，并且，如果制备像素倍增图像，则图像尺寸可以立即增加。

一般地说，在电子放大中，和图像缩小功能相比，更通常使用图像放大功能。即，例如在用户正在观看被发送的或从记录介质重放的图像的情况下，很可能想要放大观看的图像的一部分或者全部。

从这些情况看来，本发明的目的在于，例如，提供一种存储装置和存储方法，用于存储图像的数据，使得图像可以直接地被放大。

为实现上述目的，按照本发明的一个方面，提供一种用于存储图像的存储装置，包括第一存储部分，其具有由至少第一和第二地址信号在其中指定的地址，用于存储输入的图像；形成部分，用于由输入的图像形成像素倍增图像，该图像是由大于形成输入图像的像素数的像素数形成的图像；以及第二存储部分，其具有由至少第一和第二地址信号指定的地址，用于存储像素倍增图像。

按照本发明的另一个方面，提供一种存储方法，包括以下步骤：利用第一存储部分存储输入图像，所述第一存储部分具有由至少第一和第二地址信号在其中指定的地址，由输入图像形成像素倍增图像，该图像是由大于形成输入图像的像素数的像素数形成的图像，利用第二存储部分存储像素倍增图像，所述第二存储部分具有由至少第一和第二地址信号在其中指定的地址。

图1是应用本发明的存储装置的实施例的结构方块图；

图2表示输入给图1所示的存储装置的输入图像；

图3说明在图1所示的像素倍增图像形成电路中进行的处理；

图4表示像素倍增图像；

图5是图1所示的存储装置第一种详细结构的方块图；

图6是图1所示的存储装置第二种详细结构的方块图；

图7是图1所示的像素倍增图像形成电路3的详细结构的方块图；

图8用于说明在图7所示的分级块形成电路41和预测值计算块形成电路42中进行的处理；

图9A和9B说明分级处理；

图10A和10B说明ADRC处理；以及

图11是进行学习以便获得预测系数的图像处理器的结构方块图。

图1表示应用本发明而得到的存储装置的实施例的结构。

该存储装置例如由呈一个芯片或其类似物的形式的互补金属氧化物半导体(CMOS)构成，其被设置用于存储对其输入的图像，并进行分层编码，以便形成并存储像素倍增图像，即其像素数大于输入图像的像素数的图像。

地址提供电路1被供给水平地址和垂直地址，这些地址是相应于构成输入给存储装置的图像(输入图像)的像素的水平方向或垂直方向的位置的地址。

本实施例将针对这样的情况进行说明，其中图像的一帧由水平方向的512个像素和垂直方向512线构成。因而每组水平地址和每组垂直地址由9位(log₂512)表示。

设置地址提供电路1用于根据需要处理对其提供的水平和垂直地址，并向输入图像存储器2和像素倍增图像存储器4提供地址。地址提供电路1除去水平和垂直地址之外，还具有时钟(在图5一图7中未示出)，读写(R/W)信号和选择标记。地址提供电路1被设置用于利用时钟同步向输入图像存储器2和像素倍增图像存储器4提供地址。地址提供电路1还用于按照读写信号和选择标记处理对其提供的水平和垂直地址。

读写信号是用于指定从存储装置读取图像数据或向存储装置写入图像数据的信号，选择标记是例如一位的标记，用于指定读取输入图像存储器2中存储的图像或读取像素倍增图像存储器4中存储的图像。只有在读写信号指定读取图像数据时，选择标记才是有效的(有效)。即如下所述，因为向输入图像存储器2写入图像数据和向像素倍增图像存储器4写入图像数据是相互并行地(基本上彼此同时地)进行的，所以在写时选择标记被忽略。

输入图像存储器2(第一存储装置)被设置用于利用来自地址提供电路1的地址存储来自读改写(RMW)电路5的图像数据，并向RMW电路5读出并输出在所述地址中存储的图像数据。输入图像存储器2存储输入给存储装置的图像(按照惯例称为原始图像)而不改变该图像。此外，输入图像存储器2可以存储至少一帧原始图像，即512×512个像素的图像数据，如图2所示。此外，构成输入图像存储器2的存储单元至少具有相应于例如对形成原始图像的每个像素规定的位数的数据长度。即，如果构成原始图像的一个像素例如由8位表示，则构成输入图像存储器2的存储单元至少具有8位的数据长度。

像素倍增图像形成电路3(形成装置)被设置用于由存储在输入图像存储器2中的原始图像形成像素倍增图像，并把像素倍增图像提供给像素倍增图像存储器4。即，对于构成原始图像的一个观测像素，例如图3所示的像素A₁，像素倍增图像形成电路3在观测像素A₁和位于观测像素A₁的右侧附近的像素A₂之间新形成像素a₁₂，在观测像素A₁和位于其下方附近的像素A₃之间形成像素a₁₃，并在观测像素A₁和位于观测像素A₁的右下方附近的像素A₄之间(像素A₂和A₃之间)形成像素a₁₂₃₄。像素倍增图像形成电路3对每个从所有形成原始图像的像素中连续地选择的观测像素进行这种处理，借以形成在水平方向和垂直方向的像素数为原始图像的两倍的图像，即形成具有1024×1024个像素的图像(列数×行数)，如图4所示。

关于在像素倍增图像形成电路3中形成像素倍增图像的方法，有一种方法可以使用，其中通过使用构成原始图像的多个像素进行加权附加并和一个像素相关而形成构成像素倍增图像的一个像素。即，在这种情况下，参看图3，像素倍增图像的像素a₁₂例如可以是在水平方向和a₁₂相邻的原始图像的一对像素A₁和A₂的平均(将A₁和A₂的加权设为1，通过A₁和A₂的加权附加获得)。此外，像素倍增图像的像素a₁₃例如可以是在垂直方向和a₁₃相邻的原始图像的一对像素A₁和A₃的平均。此外，像素倍增图像的像素a₁₂₃₄例如可以是在对角线方向和a₁₂₃₄相邻的原始图像的像素对A₁,A₂,A₃,A₄的平均。此外，在这种情况下，原始图像的像素A₁例如可以不加改变地用作像素倍增图像的相应位置的像素。

像素倍增图像存储器4(第二存储装置)被设置用于利用来自地址提供电路1的地址存储来自像素倍增图像形成电路3的图像数据，即在本实施例中的像素倍增图像，并读出并向RMW电路5输出利用这些地址存储的图像数据。像素倍增图像存储器4具有用于存储至少一帧的像素倍增图像的存储容量，即由1024×1024个像素形成的图像，在本例中如图4所示。构成像素倍增图像存储器4的存储单元具有至少为例如能够存储由像素倍增图像形成电路3提供的构成像素倍增图像的像素的数据长度，而不会丢失任何数据。此外，构成像素倍增图像存储器4的存储单元可以被设置为例如8位，即和输入图像存储器2的数据长度相同。

时钟被供给输入图像存储器2，像素倍增图像形成电路3和像素倍增图像存储器4。和该时钟同步，进行在输入图像存储器2和像素倍增图像存储器4中的数据的读写操作，并在像素倍增图像形成电路3中形成像素倍增图像。

RMW电路5被设置用于向输入图像存储器2写入作为原始数据向存储装置提供的图像数据，还用于读出并输出在输入图像存储器2中存储的图像数据或在像素倍增图像存储器4中存储的图像数据。时钟，读写信号和选择标记被提供给RMW电路5。RMW电路5被设置用于和时钟同步地并根据读写信号和选择标记进行各种处理。

图5是图1所示的存储装置的第一种详细结构。

下面针对这种情况对存储装置进行说明，即图像数据作为原始图像被提供给图2所示的存储装置，其中512×512个像素的每一个由8位表示，并且其中以逐行扫描的方式通过扫描提供图像数据。

此外，为了说明方便，构成原始图像的像素将以这种方式表示，使得最左和最上的像素是p(0,0)，并且在离开最左位置第(x+1)个位置离开最上位置第(y+1)个位置的像素是p(x,y)，用于表示其它像素。因为原始图像如上所述由512×512个像素构成，所以x和y具有范围为0-511(=2⁹-1)的整数值。

在本例中，如图4所示的由1024×1024个像素构成的像素倍增图像在像素倍增图像形成电路3中由原始图像形成。为了说明方便，形成这种像素倍增图像的像素将用这种方式表示，使得最左和最上的像素是q(0,0)，并且在离开最左位置第(m+1)个位置离开最上位置第(n+1)个位置的像素是q(m,n)，用于表示其它像素。因为像素倍增图像由1024×1024个像素构成，所以m和n具有范围为0-1023(=2¹⁰-1)的整数值。

此外，假定在每个数据写和数据读周期中，水平地址HA和垂直地址VA的组合(HA,VA)按以下顺序和时钟同步地提供：

(0,0),(1,0),…,(511,0)

(0,1),(1,1),…,(511,1),

(511,0),(511,1),…,(511,511 )，即相应于逐行扫描的顺序。

当图像数据被写入存储装置中时，通过和时钟同步进行逐行扫描向RMW电路5提供原始图像。与此同时，水平地址HA和垂直地址VA被提供给地址提供电路1，如上所述。

在图5所示的实施例中，地址电路1由包括在其中的延迟电路11a,11b,11c，和11d构成。延迟电路11a,11b,11c，和11d被设置用于根据所需的时间间隔延迟提供给地址提供电路1的水平地址HA和垂直地址VA，并把延迟的地址提供给构成像素倍增图像存储器4的存储器13a,13b,13c，和13d的地址端(AD)。地址提供电路1还用于向输入图像存储器2的地址端直接地提供提供给地址提供电路1的水平地址HA和垂直地址VA。

像素倍增图像形成电路3由图像形成电路12a,12b,12c，和12d构成。这些电路中的每一个表示设置用于读出存储在输入图像存储器2中的构成原始图像的一个或几个像素，从而由读出的这些像素连续地形成构成像素倍增图像的一个或几个像素，并分别把形成的像素提供给构成像素倍增图像存储器4的存储器13a,13b,13c，和13d。

像素倍增图像形成电路3由4个像素形成电路12a-12d构成的原因如下。即，虽然一帧原始图像由512×512个像素构成，但一帧像素倍增图像由1024×1024个像素构成。因而，只要简单地考虑这种关系，一个原始图像的像素对应于4个像素倍增图像的像素。那么，为了形成关于原始图像的一个像素的像素倍增图像的4个像素，像素倍增图像形成电路3就要由4个像素形成电路12a-12d构成，分别用于形成4个像素。

此处假定像素倍增图像得到4个像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)与原始图像的一个像素p(x,y)相关(例如，在图3的情况下，原始图像的像素A₁是一个观测像素，在附近形成有像素倍增图像的像素a₁₂,a₁₃,和a₁₂₃₄)，并假定像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)是分别在像素形成电路12a-12d中产生的。

像素倍增图像存储器4由4个存储器13a-13d构成，如上所述。存储器13a-13d被设置用于利用由延迟电路11a-11d提供的地址分别存储由像素形成电路12a-12d提供的像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)。因而每个存储器13a-13d具有能够存储512×512个像素的容量。

存储器13a-13d还被设置用于利用由延迟电路11a-11d提供的地址读出其中存储的像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)，并把像素输出到RMW电路5。

下面说明这种存储装置的操作。

首先，当图像数据被写入时，即当读写信号指定写时，地址提供电路1直接对输入图像存储器2提供被输入给地址提供电路1的水平地址HA和垂直地址VA。在另一方面，RMW电路5写入对其提供的原始图像数据。RMW电路5在由水平地址HA和垂直地址VA指定的输入图像存储器2的存储单元(未示出)中写入原始图像数据。重复同样的处理，以便在输入存储器2中存储由512×512个像素构成的一帧原始图像。即，用这种方式，第一层像素(像素值)：

p(0,0),p(1,0),…,p(511,0),

p(0,1),p(1,1),…,p(511,1),

p(511,0),p(511,1),…,p(511,511)被分别存储在输入图像存储器2中，其地址是：

(0,0),(1,0),…,(511,0),

(0,1),(1,1),…,(511,1),

(511,0),(511,1),…,(511,511)。

当用于产生形成像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)所需的原始图像的像素被存储在输入图像存储器2中时，原始图像的像素(像素值)被读出到像素倍增图像形成电路3的图像形成电路12a-12d，像素形成电路12a-12d分别产生像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)，并把这些像素分别提供给存储器13a-13d。

即，在原始图像的像素A₁的位置像素倍增图像的像素例如是A₁，如上面参看图图3所述。因而，当像素A₁被存储在输入图像存储器2中时，像素形成电路12a直接读出像素A₁，并将其提供给存储器13a作为像素倍增图像的像素q(2x,2y)。

再参看图3，像素倍增图像的像素a₁₂是原始图像的像素A₁和A₂的平均。因而，在存储完像素A₁又在输入图像存储器2中存储像素A₂之后，像素形成电路12b读出像素A₁和A₂。然后，像素形成电路12b计算像素A₁和A₂的平均，并输出计算结果到存储器13b作为像素倍增图像的像素q(2x+1,2y)。

再参看图3，像素倍增图像的像素a₁₃是原始图像的像素A₁和A₃的平均。因而，在输入图像存储器2中在存储完像素A₁接着存储相应于一行的像素(相应于一行的原始图像的像素)又存储完像素A₃之后，像素形成电路12c读出像素A₁和A₃。然后，像素形成电路12c计算像素A₁和A₃的平均，并输出计算结果到存储器13c作为像素倍增图像的像素q(2x,2y+1)。

再参看图3，像素倍增图像的像素a₁₂₃₄是原始图像的像素A₁到A₄的平均。因而，在存储完这些像素之后，像素形成电路12d读出像素A₁到A₄。然后，像素形成电路12d计算像素A₁到A₄的平均，并输出计算结果到存储器13d作为像素倍增图像的像素q(2x+1,2y+1)。

在另一方面，在地址提供电路1的延迟电路11a-11d中，水平地址HA和垂直地址VA分别被延迟由像素形成电路12a-12d所需的时间间隔，以便产生像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)并然后被分别提供给存储器13a-13d。

结果，在存储器13a-13d中，由像素形成电路12a-12d提供的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)被分别利用同一个地址(x,y)存储。

接着，在读出时，即，当读写信号指定读出时，并且当选择标记指定原始图像时，地址提供电路1直接向输入图像存储器2的地址端提供被提供给地址提供电路1的水平地址HA和垂直地址VA。然后，RMW电路5按顺序读出在由水平地址HA和垂直地址VA指定的输入图像存储器2的存储单元中存储的原始图像的像素。

由512×512个像素构成的一帧原始图像按上述方式从输入图像存储器2中读出，这样便输出逐行扫描的原始图像。

在另一方面，当选择标记指定像素倍增图像同时读写信号指定读出时，地址提供电路1在延迟电路11a-11d中延迟对其提供的水平地址HA和垂直地址VA，延迟的数量使得像素倍增图像可以按照逐行扫描的顺序被输出，并把延迟的地址输出到存储器13a-13d的地址端。

即，存储器13a-13d具有用同一个地址(x,y)在其中存储的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)。因此，为了从存储器13a-13d中按照逐行扫描的顺序读出像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1),对于像素q(2x,2y)，需要对存储器13b的地址(x,y)提供一个从该地址(x,y)被提供给存储器13a的时刻起相应于一个像素(像素倍增图像的一个像素)的延迟。还需要对存储器13c的地址(x,y)提供一个从地址(x,y)被提供给存储器13a的时刻起相应于一行的(在本例中像素倍增图像的1024个像素)的延迟。此外，需要对存储器13d的地址(x,y)提供一个从地址(x,y)被提供给存储器13a的时刻起相应于一行和一个像素的延迟(在本例中为1025个像素)。

因此，在延迟电路11a-11d中，水平地址HA和垂直地址VA的每一个组合(HA,VA)在被提供给存储器13a-13d的地址端之前被延迟上述的时间间隔。

此后，RMW电路5按顺序读出由来自延迟电路11a-11d的地址指定的存储在存储器13a-13d的存储单元中的像素倍增图像的像素。

因而，由1024×1024个像素构成的一帧像素倍增图像被从像素倍增图像存储器4(存储器13a-13d)中读出，借以输出逐行扫描的像素倍增图像。

如果原始图像和像素倍增图像具有相同的一帧间隔，则形成像素倍增图像的一帧的像素数是形成原始图像的一帧的像素数的4倍。因此，在读像素倍增图像时，需要使延迟电路11a-11d和RMW电路5利用一个时钟同步操作，所述时钟的频率为正常时钟频率的4倍(以后按照惯例称为“4倍时钟”)。例如，4倍时钟可以根据正常时钟由包括在地址提供电路1或RMW电路5中的PLL(锁相环)电路产生。

如上所述，在通过增加原始图像的像素数而形成像素倍增图像时，像素倍增图像被形成并和原始图像并行地被存储。因此，在需要放大原始图像的情况下，例如在电子放大等过程中，作为由放大原始图像形成图像而获得的像素倍增图像可以借助于从像素倍增图像存储器4中读出而立即得到。

图6表示图1所示的存储装置的第二种详细结构。在图6中，相应于图5所示的部分用相同的标号表示。

在本例中，地址提供电路1由延迟电路11和包括在其中的计数器21构成。延迟电路11被设置用于延迟对其提供的地址一个所需时间间隔，并在此之后，把延迟的地址提供给构成像素倍增图像存储器4的存储器22的地址端(AD)。计数器21例如是2位的计数器，被设置用于例如计数4倍时钟，并输出2位的计数值。

此外，地址提供电路1被设置用于通过把从计数器21输出的2位计数值中的最低有效位(附加的地址信号)加到被提供给地址提供电路1的9位水平地址HA中而形成10位水平地址HA′，该附加的位被设置为水平地址的最低有效位，并通过延迟电路11把水平地址HA′提供给存储器22的地址端(AD)。此外，地址提供电路1被设置用于通过把从计数器21输出的2位计数值中的最高有效位(附加的地址信号)加到被提供给地址提供电路1的9位垂直地址VA中而形成10位垂直地址VA′，该附加的位被设置为垂直地址的最低有效位，并通过延迟电路11把垂直地址VA′提供给存储器22的地址端(AD)。

因此，在图6所示的实施例中，当地址(x,y)被提供给输入图像存储器2时，地址提供电路1通过延迟电路11把地址(2x,2y),(2x+1,2y),(2x,2y+1)，和(2x+1,2y+1)提供给存储器22。

如上所述，像素倍增图像存储器4由存储器22构成，并且存储器22被设置用于利用由延迟电路11提供的地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)存储由像素形成电路12a-12d提供的像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)。因而，存储器22具有用于存储形成一帧像素倍增图像的1024×1024个像素的容量。

存储器22还被设置用于从由延迟电路11提供的地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)中读出利用这些地址存储的像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1),并把这些像素提供给RMW电路5。

下面说明本实施例的操作。

首先，当图像数据被写入时，即当读写信号指示写时，以和图5所示的实施例相同的方式把原始图像写入输入图像存储器2中。

当为产生形成像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)所需的原始图像的像素被存储在输入图像存储器2中时，像素倍增图像形成电路3的像素形成电路12a-12d便以和图5所示的结构相同的方式分别产生像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1)，和q(2x+1,2y+1)，并然后把这些像素提供给存储器22。

在另一方面，在地址提供电路1中，在由计数器21输出的2位计数值中的最低有效位或最高有效位被加到提供给地址提供电路1的9为的水平地址HA或垂直地址VA，附加的位被设置为水平地址或垂直地址的最低有效位。借以形成10位的水平地址HA′和10位的垂直地址VA′。即，当(x,y)作为水平地址HA和垂直地址VA的组合(HA,VA)被提供给地址提供电路1时，便产生4个地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)。这些地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)在延迟电路11中被分别延迟一个时间间隔，所述时间间隔是在原始图像的像素p(x,y)被存储在输入图像存储器2中之后，像素形成电路12a-12d为产生像素倍增图像的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)所需的。延迟的地址被提供给存储器22。

因而，在存储器2中，由像素形成电路12a-12d提供的像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)被分别利用地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)进行存储。

接着，在读出时，即当读写信号指定读时，并当选择标记指定原始图像时，原始图像以和图5所示的结构相同的方式从输入图像存储器2中读出，并且把逐行扫描的原始图像从RMW电路5中输出。

当选择标记指定像素倍增图像同时读写信号指示读时，地址提供电路1以上述方式形成10位水平地址HA′和10位垂直地址VA′，即地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)，并把这些地址输出到延迟电路11。在延迟电路11中，地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)被延迟，使得像素倍增图像可以按照逐行扫描的顺序被输出，并且然后被提供给存储器22的地址端。

即，当地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)被提供给存储器22时，像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)被读出。为了按照逐行扫描的方式读出这些像素q(2x,2y),q(2x+1,2y),q(2x,2y+1),和q(2x+1,2y+1)，对于用地址(2x,2y)存储的像素q(2x,2y)，需要对地址(2x+1,2y)提供一个从该地址(2x,2y)被提供的时刻起相应于一个像素(像素倍增图像的一个像素)的延迟。还需要对地址(2x,2y)提供一个从地址(2x,2y)被提供的时刻起相应于一行的(在本例中像素倍增图像的1024个像素)的延迟。此外，需要对地址(2x+1,2y+1)提供一个从地址(2x,2y)被提供的时刻起相应于一行和一个像素的延迟(在本例中为1025个像素)。

因此，在延迟电路11中，每个地址(2x,2y),(2x+1,2y),(2x,2y+1),和(2x+1,2y+1)目对于地址(2x,2y)被输出的时刻被延迟上述的时间间隔之后，被提供给存储器22的地址端。

RMW电路5读出存储在由来自延迟电路11的地址指定的存储器22的存储单元中的像素倍增图像的像素。

即，由1024×1024个像素形成的一帧像素倍增图像被从像素倍增图像存储器4(存储器22)中读出，借以输出逐行扫描的像素倍增图像。

在图6所示的实施例中，如果原始图像和像素倍增图像具有相同的一帧时间间隔，则需要在读出像素倍增图像时，使延迟电路11和RMW电路5在4倍时钟的同步下操作。

如上所述，在图6所示的实施例中，也形成像素倍增图像并和原始图像并行地存储，其中像素倍增图像是通过增加原始图像的像素数而形成的。因此，在需要放大原始图像的情况下，例如在电子放大等过程中，作为由放大原始图像形成图像而获得的像素倍增图像可以借助于从像素倍增图像存储器4中读出而立即得到。

在像素倍增图像形成电路3中，在上述的情况下，像素倍增图像通过使用原始图像进行加权相加而形成。不过，像素倍增图像也可以使用其它方法形成。例如，可以通过分类和适应处理等而形成。

图7表示在一种情况下像素倍增图像形成电路3(每个像素形成电路12a-12d)的结构的例子，其中像素倍增图像借助于分类和适应处理而形成。

每个分类块形成电路41和预测值计算块形成电路42接收存储在输入图像存储器2中的原始图像的图像数据(原始图像数据)。分类块形成电路41被设置用于由原始图像数据形成关于一个观测的原始图像数据项(观测的原始图像数据项)的分类块，这是用于按照原始图像数据的特征对原始图像数据进行分类使之成为预定的类的单位。

即，参见图8，在从最上位置起第i个位置并且从最左位置起第j个位置的原始图像数据(构成原始图像的像素(像素值))(在图中由符号○表示的位置)是X_ij，分类块形成电路41例如形成观测的原始图像数据X_ij和8个像素X_(i-1),(i-1),X_(i-1),j,X_(i-1),(j+1),X_i,(j-1),X_i,(j+1),X_(i-1),(j-1),X_(i-1),j和X_(i+1),(j+1)的分类块，其中的每一个位于观测的像素的左上方，正上方，右上方，左侧，右侧，左下方，正下方，右下方，共9个像素。这个分类块被提供给分类和适应处理电路43。

在这种情况下，分类块构成一个3×3(列数×行数)个像素的方块。不过，不一定把分类块限制为正方形。也可以呈其它的形状，例如矩形或十字形。此外，构成分类块的像素的数量也不限于3×3阵列的9个像素。

观测值计算块形成电路42被设置用于根据原始图像数据形成预测值计算块，每个预测值计算块围绕原始图像数据项被确定，作为计算构成像素倍增图像像素(像素值)的单元。即，参见图8，在3×3阵列中围绕原始图像数据项X_ij(图中用○表示)的9个像素(图中用×表示)自左至右自上而下用Y_ij(1),Y_ij(2),Y_ij(3),Y_ij(4),Y_ij(5),Y_ij(6),Y_ij(7),Y_ij(8),Y_ij(9)表示，然后，预测值计算块形成电路42例如形成围绕观测原始图像数据项X_ij的5×5正方形的预测值计算块，用于计算像素Y_ij(1)到Y_ij(9)的预测值，即由25个像素X_{(i-2), (j-2)},X_(i-2),(j-1),X_(i-2),j,X_(i-2),(j+1),X_(i-2),(j+2),X_(i-1),(i-2),X_{(i-1),(j- 1)},X_(i-1),j,X_(i-1),(j+1),X_(i-1),(j+2),X_i-,(j-2),X_i,(j-1),X_ij,X_i,(j+1),X_i,(j+2),X_(i+1),(j-2),X_(i+1),(j-1),X_(i+1),j,X_(i+1),(j+1),X_(i+1),(j+2),X_(i+2),(j-2),X_(i+2),(j-1),X_(i+2),j,X_(i+2),(j+1),和X_{(i+2), (j+2)}构成的块。

更具体地说，例如为了计算由图8的正方形围成的像素倍增图像中的9个像素Y₃₃(1)-Y₃₃(9)，形成由像素X₁₁,X₁₂,X₁₃,X₁₄,X₁₅,X₂₁,X₂₂,X₂₃,X₂₄,X₂₅,X₃₁,X₃₂,X₃₃,X₃₄,X₃₅,X₄₁,X₄₂,X₄₃,X₄₄,X₄₅,X₅₁,X₅₂,X₅₃,X₅₄,X₅₅构成的块(在这种情况下X₃₃是观测的原始图像数据)。

由预测值计算块形成电路42获得的预测值计算块被输入到分类和适应处理电路43。

预测值计算块的像素的数量和形状不限于上述的这些，它们和分类块的像素数量和形状有关。不过，最好形成预测值计算块的像素数量大于形成分类块的像素数量。

在按照上述方式进行处理的形成块(对于形成块可以有不同的处理)中，在图像的框架边缘可能没有整合的像素。在这种情况下，则通过假定在框架边缘外部具有和形成框架边缘的像素相同的像素。

分类和适应处理电路43包括自适应动态范围编码(ADRC)处理电路，分类电路45，预测系数ROM46，和预测电路47，并被设置用于进行分类和适应处理。

进行分类和适应处理用于把输入信号按照其特征将其分为几类，并对于每一类进行合适的适应处理，其中主要包括分类处理和适应处理。

下面简要说明分类处理和适应处理。

首先说明分类处理。

例如如图9A所示，观测像素以及与其相邻的3个像素形成2×2个像素的块(分类块)，每个像素用一位表示(具有0和1两种电平)。在这种情况下，相对于像素电平的分布，对于由含有观测像素的2×2阵列中的4个像素构成的块具有16(=(2¹)⁴)个图形，如图9B所示。在本例中，观测像素可被分类而成为16种图形之一。在分类电路45中使用这种图形进行分类处理。

分类处理还可以按照图像(块中的图像)的活性(activity)(图像的复杂性)(变化强度)等进行。

在本例中，对形成原始图像的每个像素分配8位。此外，在本例中，使用上述的3×3阵列中的9个像素构成的分类块。如果对这种分类块进行分类处理，则使用极大的分类量，即(2⁸)⁹。

因此，在本例中，对于分类块在ADRC处理电路中进行ADRC处理，使得减少构成分类块的像素数，借以减少分类量。

即，为了说明方便，下面讨论如图10A所示的由沿着行排列的4个像素构成的块的处理。在这块的ADRC处理中，检测像素值的最大值MAX和最小值MIN。然后，设置DR=MAX-MIN作为该块的动态范围，并把构成该块的每个像素的像素值根据其动态范围DR被重新量化为K位。

即，从该块中的每个像素值中减去最小值MIN，减得的差值除以DR/2^K。像素值被转换为相应于除得的结果的代码(ADRC代码)。例如，如果K=2，则对于由4(=2²)除动态范围DR而限定的域确定除得的值的大小。如图10(B)所示，如果除得的值属于最低电平的域、从最低电平倒数第二电平的域、倒数第三电平的域或最高电平的域，则该像素值被编码而成为两位，例如00B,01B,10B，或11B(B代表该值是二进制的)。以这种方式对这种代码进行译码，使得ADRC代码00B,01B,10B，或11B被转换为最低电平域的中值L₀₀，第二电平域的中值L₀₁，第三电平域的中值L₁₀，或最高电平域的中值L₁₁，并把最小值MIN加到转换的值上。

这种ADRC处理被称为非边缘匹配。本发明的申请人的日本专利申请公开5377/1991中和其它文件中披露了这种ADRC处理所细节。

如果进行ADRC处理以便以小于对构成块的每个像素指定的位数的位数重新量化，如上所述，可以减少分类数。这种ADRC处理在ADRC处理电路44中进行。

在本实施例中，分类处理在分类电路45中根据由ADRC处理电路44输出的ADRC代码进行。不过，进行分类处理也可以处理这些数据，它们已经经过例如预测编码(DPCM)、块舍位编码(BTC)、矢量量化(VQ)、离散余弦变换(DCT)、Hadamard变换等。

下面说明自适应处理。

下面说明一种处理，其中，例如图像(相应于上述的像素倍增图像)的像素(像素值)y的预测值E【y】是这样获得的，其中使用利用预定的预测系数w₁,w₂,…的线性组合规定的线性组合方式和通过使上述图像的像素变稀而获得的构成另一个图像(一个具有较少像素数的图像)(相应于上述的原始图像)的多个像素(像素值)x₁,x₂,…(以后按照惯例称为“学习数据”)。在这种情况下，预测值E【y】可由下式表示：

E【y】=W₁X₁+W₂X₂+…    …(1)

为了归纳，下面定义由一组预测系数w构成的矩阵W，由一组学习数据构成的矩阵X，和由一组预测值E【y】构成的矩阵Y′： $X=\left[\begin{array}{cc}{X}_{11}& X_{12}...X_{1n}\\ X_{21}& X_{22}...X_{2n}\\ ...& .........\\ X_{\mathrm{ml}}& X_{m2}...X_{m3}\end{array}\right]$ $W=\left[\begin{array}{c}{W}_1\\ W_2\\ ...\\ W_n\end{array}\right],Y^{\′}=\left[\begin{array}{c}E\left[y_1\right]\\ E\left[y_2\right]\\ ...\\ E\left[y_3\right]\end{array}\right]$ 然后，形成下面的观测方程：

      XW = Y′      …(2)

下面讨论通过对该观测方程利用最小平方法计算接近像素值y的预测值E【y】的过程。在这种情况下，如果由整个图像的一组像素值y构成的矩阵Y(下面按照惯例称为“教师数据”)和由关于整个图像的像素值y的一组余项构成的矩阵E被定义为 $E=\left[\begin{array}{c}{e}_1\\ e_2\\ ...\\ e_m\end{array}\right],Y=\left[\begin{array}{c}{y}_1\\ y_2\\ ...\\ y_n\end{array}\right]$ 则由方程(2)得到以下余项方程：

XW=Y+E    ....(3)

在这种情况下，用于获得接近整个图像的像素值y的预测值E【y】的预测系数w₁可以通过最小平方误差：

  m

  ∑e_i ²

  i=1获得。

因而，如果上面的关于预测系数w_i平方误差的微分为0，即，如果预测系数w_i满足以下的方程，则预测系数w_i是用于获得接近整个图像的像素值y的预测值E【y】的最佳值。 $e_1\frac{\∂e_1}{\∂w_i}+e_2\frac{\∂e_2}{\∂w_i}+...+e_m\frac{\∂e_m}{\∂w_i}=0(i=\mathrm{1,2},...,n)...\left(4\right)$ 式(3)对于预测系数w₁进行微分，得到下式： $\frac{\∂e_i}{\∂w_1}=x_{\mathrm{il}},\frac{\∂e_l}{\∂w_2}=x_{i2},...,\frac{\∂e_i}{\∂w_n}-x_{\mathrm{in}},(i-\mathrm{1,2},...m)...\left(5\right)$ 由式(4)和式(5)获得式(6)： $\underset{i=1}{\overset{m}{\mathrm{\Σ}}}{e}_i{x}_{i1}-0,\underset{i=1}{\overset{m}{\mathrm{\Σ}}}{e}_i{x}_{i2}-0,...\underset{i=1}{\overset{m}{\mathrm{\Σ}}}{e}_i{x}_{\mathrm{in}}=0...\left(6\right)$ 此外，考虑学习数据x、一组预测系数w、教师数据y和式(3)中的余项e之间的关系，由式(6)获得以下标准方程：

可以形成其数量和要获得的预测系数w的组数相同数量的方程(7)。因而，通过解方程(7)可以获得预测系数w的最佳组。为了解方程(7)，可以使用Gauss-Jordan消除方法或类似方法。

如上所述，在适应处理中，对于每一类都获得一组最佳预测系数w，使用这组预测系数w利用方程(1)获得接近整个图像的像素值的预测值E【y】。这种适应处理由预测系数ROM 46和预测电路47进行。

即，预测系数ROM 46通过学习(下面说明)存储先前获得的各类的预测系数组。预测系数ROM 46被设置用于接收从分类电路45输出的分类信息，读出利用相应于分类信息的地址存储的预测系数组(相应于分类信息的预测系数组)，并把该预测系数组提供给预测电路47。

预测电路47被设置用于通过使用由预测值计算块形成电路43提供的5×5个像素的预测值计算块和由预测系数ROM 46提供的预测系数组计算线性方程(1)，借以获得像素倍增图像的3×3个像素的预测值。

适应处理和例如上述的加权附加的内插处理的区别在于，在变稀的图像中不包含而在整个图像中包含的元素被重现。即，如果只由方程(1)来看，除去相应于内插滤波器的抽头系数的一组预测系数w通过利用教师数据的一种学习被获得，从而使包含在整个图像中的元素被重现之外，适应处理和使用内插滤波器的内插处理是相同的。基于这一点，可以说，适应处理具有产生图像的效果。

下面说明在图7所示的像素倍增图像形成电路3中进行的处理。

首先，在像素倍增图像形成电路3中，消除原始图像数据的块。即，在分类块形成电路41中，图像数据被分成围绕观测图像数据项的3×3个像素的分类块，然后把这块提供给分类和适应处理电路43。在预测值计算块形成电42中，原始图像数据被形成围绕观测原始图像数据项的5×5个像素的预测值计算块，并把这块提供给分类和适应处理电路43。

在分类和适应处理电路43中，分类块和预测值计算块被分别提供给ADRC处理部分44和适应处理电路46。

ADRC处理电路44接收分类块之后，则例如通过1位的ADRC处理(用于1位重新量化的ADRC)对分类块进行处理，把原始图像数据转换(编码)成为1位数据，并向分类电路45输出编码的数据。在分类电路45中，由ADRC处理进行处理过的分类块进行分类处理。即，形成由ADRC处理处理的分类块的像素的电平分布状态被检测，并确定分类块所属的种类。这分类确定的结果作为分类信息被提供给预测系数ROM 46。

在本例中，由3×3阵列中的9个像素构成并由ADRC处理进行处理的每个分类块经受分类处理。因而，每个分类块被分成512(=(2¹)⁹)个类中的一个类。

当预测系数ROM 46接收分类信息时，则从按照类存储的预测系数组中读出相应于分类信息的预测系数组，并把读出的系数提供给预测电路47。在预测电路47中，通过使用来自预测系数ROM 46的预测系数组和来自预测值计算块形成电路42的预测值计算块进行适应处理，即，进行方程(1)所示的计算，从而获得像素倍增图像的像素的预测值。

图11说明一种图像处理器的结构，这种图像处理器进行学习用于获得存储在图7所示的预测系数ROM 46中的预测系数组。

用于获得关于每类的预测系数组的学习图像数据(学习像素倍增图像)被提供给学习块形成电路91和教师块形成电路92。

学习块形成电路91例如从对其输入的图像数据中按照由图8中符号○表示的位置关系提取5×5个像素，并作为学习块把由这25个像素形成的块提供给ADRC处理93和学习数据存储器96。

在教师块形成电路92中，由提供的图像数据形成例如由3×3阵列中的9个像素构成的块。由9个像素构成的块作为教师块被提供给教师数据存储器98。

在学习块形成电路91中由图8中符号○表示的位置关系中的25个像素构成的块，即，由像素X₁₁,X₁₂,X₁₃,X₁₄,X₁₅,X₂₁,X₂₂,X₂₃,X₂₄,X₂₅,X₃₁,X₃₂,X₃₃,X₃₄,X₃₅,X₄₁,X₄₂,X₄₃,X₄₄,X₄₅,X₅₁,X₅₂,X₅₃,X₅₄,X₅₅构成的块被形成的情况下，在教师块形成电路中则形成由图8的正方形包围的3×3个像素的教师块。

ADRC处理电路93从25个形成学习块的像素中例如提取中心的9个像素(3×3个像素)，并利用1位ADRC处理处理这由9个像素构成的块，如图7所示的ADRC处理电路44处理的那样。由ADRC处理的3×3个像素的块被提供给分类电路94。在分类电路94中，来自ADRC处理电路93的块经受分类处理，如块在图7所示的分类电路45中处理的那样。这样获得的分类信息通过开关95的端子a被提供给学习数据存储器96和教师数据存储器98。

在学习数据存储器96或教师数据存储器98中，来自学习块形成电路91的学习块或来自教师块形成电路92的教师块利用相应于提供给存储器的分类信息的地址进行存储。

在学习数据存储器96中利用某个地址作为学习块存储有由图8所示的符号○表示的5×5个像素，即像素X₁₁,X₁₂,X₁₃,X₁₄,X₁₅,X₂₁,X₂₂,X₂₃,X₂₄,X₂₅,X₃₁,X₃₂,X₃₃,X₃₄,X₃₅,X₄₁,X₄₂,X₄₃,X₄₄,X₄₅,X₅₁,X₅₂,X₅₃,X₅₄,X₅₅构成的块的情况下，则由图8所示的正方形包围的3×3个像素的块(图中由符号×表示)作为教师块利用和学习数据存储器96中相同的地址被存储在教师数据存储器98中。

对于制备的所有学习图像重复相同的处理。用于启动在图7所示的像素倍增图像形成电路中的预测值计算的、由9个像素构成的每个学习块和教师块利用相同的地址被存储在学习数据存储器96和教师数据存储器98中，所述计算使用由具有和形成相应的学习块的25个像素相同位置关系的25个原始图像数据项构成的预测值计算块。

学习数据存储器96和教师数据存储器98被设置用于利用同一地址存储多个信息项，借以使多个学习块和多个教师块能够利用同一地址存储。

在关于所有学习图像的学习块和教师块都被存储在学习数据存储器96和教师数据存储器98中之后，已经选择端子a的开关95被改变为端子b，使得来自计数器97的输出能够作为地址被提供给学习数据存储器96和教师数据存储器98。计数器97对预定的时钟进行计数，并输出计数值。在学习数据存储器96或教师数据存储器98中，相应于计数值的学习数据块或教师块被提供给计算电路99。

因而，相应于计数器97的计数值的分类的一组学习块和一组教师块被提供给计算电路99。

当计算电路99收到关于某类的一组学习块和一组教师块时，它便利用最小平方法计算使误差最小的一组预测系数。

即，例如形成学习块的像素的像素值是X₁,X₂,X₃,…，并且如果要获得的预测系数是W₁,W₂,W₃…，则预测系数需要满足下式，以便通过这些值的线性组合获得构成教师块的一个像素的像素值y：

y=W₁X₁+W₂X₂+W₃X₃+…

在计算电路99中，使预测值W₁X₁+W₂X₂+W₃X₃+…和真值y的平方差为最小的预测系数W₁,W₂,W₃,…可以通过解上述式(7)所示的标准方程由相同类的学习块和相应的教师块获得。因而，可对于所有的类进行这一处理，从而形成关于这些类的预测系数组。

在计算电路99中对于每一类获得的预测系数组被提供给存储器100。来自计数器97的计数值和来自计算电路99的预测系数组被提供给存储器100。在存储器100中，来自计算电路99的预测系数组利用相应于来自计数器97的计数值的地址进行存储。

这样，最适合预测每类的块的3×3个像素的预测系数组利用相应于该类的地址存储在存储器100中。按上述方式在存储器100中存储的这些类的预测系数组被存储在图7所示的预测系数ROM 46中。

在本例中，其中在水平和垂直方向的像素数是原始图像的两倍的像素倍增图像被存储在像素倍增图像存储器4中。不过，在像素倍增图像存储器4中存储的形成像素倍增图像的像素数不限于此。

可以提供多个像素倍增图像存储器4，用于存储具有不同的大于原始图像的像素数的像素倍增图像。

在本例中，借助于处理提供给输入图像存储器2的水平地址HA和垂直地址VA而获得的地址被提供给像素倍增图像存储器4。另外，可向像素倍增图像存储器4提供和提供给输入图像存储器2的水平地址HA和垂直地址VA分开制备的独立的地址，以便进行访问。

此外，在本例中，输入图像存储器2和像素倍增图像存储器4中的每个通过被提供给分别相应于形成图像的像素的水平和垂直位置的水平地址和垂直地址而被访问。不过，例如，相对于时间的地址也可以提供给输入图像存储器2和像素倍增图像存储器4。在这种情况下，像素倍增图像通过使用随时间分布的原始图像的像素和在水平和垂直的空间方向上分布的原始图像的像素而被形成。

此外，输入图像存储器2和像素倍增图像存储器4不一定被彼此分开地形成。它们可以合并为一个存储器。在这种情况下，一个存储器的存储区域可以分配给输入图像存储器2和像素倍增图像存储器4。

在本例中，地址提供电路1、输入图像存储器2、像素倍增图像存储器4和RMW电路5被形成在一个芯片上。不过，并不总是需要这些元件被形成在一个芯片上。

在本例中，只形成通过增加原始图像的像素数而获得的像素倍增图像。不过，也可以形成通过减少原始图像的像素数而获得的图像，并和像素倍增图像同时地进行存储。

本发明可应用于处理以非隔行扫描方式扫描的图像，也可以处理以隔行扫描方式扫描的图像。

在本例中，存储装置是以硬件实现的。不过，本发明的存储装置可以借助于使计算机执行用于完成上述处理的程序而实现。

在图6所示的实施例中，像素倍增图像存储器4由一个存储器22构成。此外，在图6所示的结构中，像素倍增图像存储器4可以由4个存储器13a-13d构成，如图5所示的结构那样。在这种情况下，计数器21的输出可用作选择4个存储器13a-13d之一的信号，即一种芯片选择信号，而代替作为水平地址HA和垂直地址VA的最小有效位被附加。

在本例中，像素(像素值)被存储在例如由RAM(随机存取存储器)表示的存储器或其类似物中。另外，像素可以被存储(记录)在记录介质上，例如磁盘，磁光盘，或光卡上。

在本发明的存储装置和存储方法中，输入图像被存储在第一存储装置中，其中地址至少由第一和第二地址信号指定，并且由像素数大于输入图像的像素数构成的像素倍增图像由输入图像形成，像素倍增图像被存储在第二存储装置中，其中地址至少由第一和第二地址信号指定。因而，可以立即提供提供放大输入图像而获得的图像。

本发明不限于上述实施例，不脱离本发明的范围和构思可以作出其它改变和改型。

Claims (8)

1．一种用于存储图像的存储装置，包括：

第一存储部分，其具有由至少第一和第二地址信号在其中指定的地址，用于存储输入的图像；

形成部分，用于由输入的图像形成像素倍增图像，该图像是由大于形成输入图像的像素数的像素数形成的图像；以及

第二存储部分，其具有由至少第一和第二地址信号指定的地址，用于存储像素倍增图像。

2．如权利要求1所述的存储装置，其中所述第二存储部分具有至少通过第一和第二地址信号并通过在第一和第二地址信号上附加的附加地址信号而在其中存储的地址。

3．如权利要求1所述的存储装置，其中所述形成部分通过使用在形成输入图像的像素中的多个像素进行加权附加而形成构成像素倍增图像的像素。

4．如权利要求1所述的存储装置，其中所述形成部分通过使用用于计算构成像素倍增图像的像素的预测值的预测系数，通过线性组合形成输入图像的一些像素而形成像素倍增图像。

5．一种存储方法，包括以下步骤：

利用第一存储部分存储输入图像，所述第一存储部分具有由至少第一和第二地址信号在其中指定的地址；

由输入图像形成像素倍增图像，该图像是由大于形成输入图像的像素数的像素数形成的图像；以及

利用第二存储部分存储像素倍增图像，所述第二存储部分具有由至少第一和第二地址信号在其中指定的地址。

6．如权利要求5所述的存储方法，其中在所述使用第二存储部分的存储步骤中，所述第二存储部分具有至少通过第一和第二地址信号并通过在第一和第二地址信号上附加的附加地址信号而在其中存储的地址。

7．如权利要求5所述的存储方法，其中在所述形成步骤中，所述形成部分通过使用在形成输入图像的像素中的多个像素进行加权附加而形成构成像素倍增图像的像素。

8．如权利要求5所述的存储方法，其中在所述形成步骤，所述形成部分通过使用用于计算构成像素倍增图像的像素的预测值的预测系数，通过线性组合形成输入图像的一些像素而形成像素倍增图像。

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