CN117642804A - 像素驱动电路及其驱动方法、显示面板、显示装置 - Google Patents
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Abstract
一种像素驱动电路及其驱动方法、显示面板、显示装置。该像素驱动电路包括：驱动电路(1)、补偿电路(2)、第一复位电路(3)、第一隔离电路(4)、第二隔离电路(5)。驱动电路(1)连接第一节点(N1)、第二节点(N2)、第三节点(N3)，用于根据第一节点(N1)的电压利用第二节点(N2)向第三节点(N3)提供驱动电流；补偿电路(2)连接第三节点(N3)、第四节点(N4)、第一栅极驱动信号端(G1)，用于响应第一栅极驱动信号端(G1)的信号以导通第三节点(N3)和第四节点(N4)；第一复位电路(3)连接第一初始信号端(Vinit1)、第五节点(N5)、第一复位信号端(Re1)，用于响应第一复位信号端(Re1)的信号以将第一初始信号端(Vinit1)的信号传输到第五节点(N5)；第一隔离电路(4)连接第一节点(N1)、第四节点(N4)，用于响应一控制信号以导通第一节点(N1)和第四节点(N4)；第二隔离电路(5)连接第一节点(N1)、第五节点(N5)，用于响应一控制信号以导通第一节点(N1)和第五节点(N5)。该像素驱动电路能够降低第一节点(N1)的漏电流。
Description
本公开涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、显示面板、显示装置。
相关技术中，像素驱动电路包括有驱动晶体管，驱动晶体管根据其栅源电压差向其漏极提供驱动电流。然而，由于驱动晶体管栅极存在向其他节点漏电的问题，从而导致驱动晶体管提供的驱动电流不稳定。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
发明内容
根据本公开的一个方面，提供一种显示面板，该像素驱动电路包括：驱动电路、补偿电路、第一复位电路、第一隔离电路、第二隔离电路。驱动电路连接第一节点、第二节点、第三节点，用于根据所述第一节点的电压利用所述第二节点向所述第三节点提供驱动电流；补偿电路连接所述第三节点、第四节点、第一栅极驱动信号端，用于响应所述第一栅极驱动信号端的信号以导通所述第三节点和所述第四节点；第一复位电路连接第一初始信号端、第五节点、第一复位信号端，用于响应所述第一复位信号端的信号以将所述第一初始信号端的信号传输到所述第五节点；第一隔离电路连接所述第一节点、第四节点，用于响应一控制信号以导通所述第一节点和所述第四节点；第二隔离电路连接所述第一节点、第五节点，用于响应一控制信号以导通所述第一节点和所述第五节点。
本公开一种示例性实施例中，所述第四节点和所述第五节点连接。
本公开一种示例性实施例中，所述驱动电路包括：驱动晶体管，驱动晶体管的第一极连接所述第二节点，第二极连接所述第三节点，栅极连接 所述第一节点；所述补偿电路包括：第二晶体管，第二晶体管的第一极连接所述第四节点，第二极连接所述第三节点，栅极连接所述第一栅极驱动信号端；所述第一复位电路包括：第一晶体管，第一晶体管的第一极连接所述第一初始信号端，第二极连接所述第五节点，栅极连接所述第一复位信号端；所述第一隔离电路包括：第九晶体管，第九晶体管的第一极连接所述第一节点，第二极连接所述第四节点；所述第二隔离电路包括：第八晶体管，第八晶体管的第一极连接所述第一节点，第二极连接所述第五节点。
本公开一种示例性实施例中，所述第一晶体管、所述第二晶体管、所述第八晶体管、所述第九晶体管中任一晶体管为N型晶体管或P型晶体管。
本公开一种示例性实施例中，所述像素驱动电路用于驱动发光单元发光，所述像素驱动电路还包括：发光控制电路、第二复位电路、数据写入电路、存储电路。发光控制电路连接第一电源端、第二节点、第三节点、使能信号端、所述发光单元的第一电极，所述发光控制电路用于响应所述使能信号端的信号以连接所述第一电源端和所述第二节点，以及连接所述第三节点和所述发光单元的第一电极；第二复位电路连接所述发光单元的第一电极、第二初始信号端、第二复位信号端，用于响应所述第二复位信号端的信号以将所述第二初始信号端的信号传输到所述发光单元的第一电极；数据写入电路连接所述第二节点、数据信号端、第二栅极驱动信号端，用于响应所述第二栅极驱动信号端的信号以将所述数据信号端的信号传输到所述第二节点；存储电路连接于所述第一节点和所述第一电源端之间。
本公开一种示例性实施例中，所述数据写入电路包括：第四晶体管，第四晶体管的第一极连接所述数据信号端，第二极连接所述第二节点，栅极连接所述第二栅极驱动信号端；所述发光控制电路包括：第五晶体管、第六晶体管，第五晶体管的第一极连接所述第一电源端，第二极连接所述第二节点，栅极连接所述使能信号端；第六晶体管的第一极连接所述第三节点，第二极连接所述发光单元的第一电极，栅极连接所述使能信号端；所述第二复位电路包括：第七晶体管，第七晶体管的第一极连接所述第二初始信号端，第二极连接所述发光单元的第一电极，栅极连接所述第二复 位信号端；所述存储电路包括：电容，电容的第一电极连接所述第一节点，第二电极连接所述第一电源端。
本公开一种示例性实施例中，所述第一隔离电路和所述数据写入电路的导通电平逻辑相同，所述第一隔离电路连接所述第二栅极驱动信号端，所述第一隔离电路用于响应所述第二栅极驱动信号端的信号以导通所述第一节点和所述第四节点。
根据本公开的一个方面，提供一种像素驱动电路驱动方法，用于驱动上述的像素驱动电路，其中，所述驱动方法包括：
在复位阶段，利用所述第一复位电路将所述第一初始信号端的信号传输到所述第五节点，利用所述第二隔离电路导通所述第五节点和所述第一节点；
在数据写入阶段，利用所述补偿电路导通所述第四节点和所述第三节点，利用所述第一隔离电路导通所述第四节点和所述第一节点；
在发光阶段，利用所述第一复位电路断开所述第一初始信号端和所述第五节点，利用所述第二隔离电路断开所述第五节点和所述第一节点，利用所述补偿电路断开所述第四节点和所述第三节点，利用所述第一隔离电路断开所述第四节点和所述第一节点。
根据本公开的一个方面，提供一种显示面板，其中，所述显示面板包括上述的像素驱动电路。
根据本公开的一个方面，提供一种显示面板，其中，所述显示面板包括像素驱动电路，所述像素驱动电路包括：驱动晶体管、第八晶体管、第九晶体管、第一晶体管、第二晶体管。第八晶体管的第一极连接所述驱动晶体管的栅极，栅极连接第三复位信号线；第九晶体管的第一极连接所述驱动晶体管的栅极，栅极连接第二栅线；第一晶体管的第一极连接第一初始信号线，第二极连接所述第八晶体管的第二极，栅极连接第一复位信号线；第二晶体管的第一极连接所述第九晶体管的第二极，第二极连接所述驱动晶体管的第二极，栅极连接第一栅线。所述显示面板还包括：衬底基板、第一有源层、第一导电层、第二有源层、第三导电层。所述第一有源层包括第三有源部、第八有源部、第九有源部，所述第三有源部用于形成所述驱动晶体管的沟道区，所述第八有源部用于形成所述第八晶体管的沟 道区，所述第九有源部用于形成所述第九晶体管的沟道区；第一导电层位于所述第一有源层背离所述衬底基板的一侧，所述第一导电层包括：所述第三复位信号线、第二栅线、第一导电部，所述第三复位信号线在所述衬底基板上的正投影覆盖所述第八有源部在所述衬底基板上的正投影，所述第三复位信号线的部分结构用于形成所述第八晶体管的栅极，所述第二栅线在所述衬底基板上的正投影覆盖所述第九有源部在所述衬底基板上的正投影，所述第二栅线的部分结构用于形成所述第九晶体管的栅极，所述第一导电部在所述衬底基板上的正投影覆盖所述第三有源部在所述衬底基板上的正投影，所述第一导电部用于形成所述驱动晶体管的栅极；第二有源层位于所述第一导电层背离所述衬底基板的一侧，所述第二有源层包括第一有源部、第二有源部，所述第一有源部用于形成所述第一晶体管的沟道区，所述第二有源部用于形成所述第二晶体管的沟道区；第三导电层位于所述第二有源层背离所述衬底基板的一侧，所述第三导电层包括所述第一复位信号线、第一栅线，所述第一复位信号线在所述衬底基板上的正投影覆盖所述第一有源部在所述衬底基板上的正投影，所述第一复位信号线的部分结构用于形成所述第一晶体管的顶栅，所述第一栅线在所述衬底基板上的正投影覆盖所述第二有源部在所述衬底基板上的正投影，所述第一栅线的部分结构用于形成所述第二晶体管的顶栅。
本公开一种示例性实施例中，所述第三复位信号线在所述衬底基板上的正投影、第二栅线在所述衬底基板上的正投影、第一复位信号线在所述衬底基板上的正投影、第一栅线在所述衬底基板上的正投影均沿第一方向延伸；所述第一栅线在所述衬底基板上的正投影位于所述第一导电部在所述衬底基板上的正投影和所述第二栅线在所述衬底基板上的正投影之间；
所述第三复位信号线在所述衬底基板上的正投影位于所述第二栅线在所述衬底基板上的正投影远离所述第一导电部在所述衬底基板上的正投影的一侧；所述第一复位信号线在所述衬底基板上的正投影位于所述第三复位信号线在所述衬底基板上的正投影远离所述第一导电部在所述衬底基板上的正投影的一侧。
本公开一种示例性实施例中，所述显示面板还包括发光单元，所述像素驱动电路还包括第五晶体管、第七晶体管；所述第五晶体管的第一极连 接电源线，所述第五晶体管的第二极连接所述驱动晶体管的第一极，所述第七晶体管的第一极连接第二初始信号线，所述第七晶体管的第二极连接所述发光单元的第一电极。所述第一有源层还包括：第五有源部、第七有源部，述第五有源部用于形成所述第五晶体管的沟道区；所述第七有源部用于形成所述第七晶体管的沟道区。所述第一导电层还包括：使能信号线、第二复位信号线，所述使能信号线在所述衬底基板上的正投影沿所述第一方向延伸，且覆盖所述第五有源部在所述衬底基板上的正投影，所述使能信号线的部分结构用于形成所述第五晶体管的栅极；所述第二复位信号线在所述衬底基板上的正投影沿所述第一方向延伸，且覆盖所述第七有源部在所述衬底基板上的正投影，所述第二复位信号线的部分结构用于形成所述第七晶体管的栅极；其中，所述使能信号线在所述衬底基板上的正投影位于所述第一导电部在所述衬底基板上的正投影远离所述第一栅线在所述衬底基板上的正投影的一侧；所述第二复位信号线在所述衬底基板上的正投影位于所述使能信号线在所述衬底基板上的正投影远离所述第一导电部在所述衬底基板上的正投影的一侧。
本公开一种示例性实施例中，所述显示面板包括沿行列方向阵列分布的多个像素驱动电路，所述第一方向为行方向，本行像素驱动电路中的所述第二复位信号线复用为相邻下一行像素驱动电路中的所述第三复位信号线。
本公开一种示例性实施例中，所述显示面板包括沿行列方向阵列分布的多个像素驱动电路，所述第一方向为行方向，相邻下一行像素驱动电路中的所述第一复位信号线在所述衬底基板上的正投影位于本行像素驱动电路中所述第二复位信号线在所述衬底基板上的正投影和本行像素驱动电路中所述使能信号线在所述衬底基板上的正投影之间。
本公开一种示例性实施例中，所述显示面板还包括：第四导电层，第四导电层位于所述第三导电层背离所述衬底基板的一侧，所述第四导电层包括所述第二初始信号线，所述第二初始信号线在所述衬底基板上的正投影沿第二方向延伸，所述第二方向和所述第一方向相交。
本公开一种示例性实施例中，所述像素驱动电路还包括第四晶体管，所述第四晶体管的第一极连接数据线，第二极连接所述驱动晶体管的第一 极，所述显示面板还包括：第五导电层，第五导电层位于所述第四导电层背离所述衬底基板的一侧，所述第五导电层包括所述数据线、电源线，所述数据线在所述衬底基板上的正投影、所述电源线在所述衬底基板上的正投影沿所述第二方向延伸；所述显示面板还包括沿所述第一方向和第二方向阵列分布的多个重复单元，每个所述重复单元包括沿所述第一方向分布的两个所述像素驱动电路，同一所述重复单元中两个所述像素驱动电路镜像对称设置；所述第二方向为列方向，每列所述像素驱动电路对应设置一条所述电源线和一条所述数据线；在所述第一方向上相邻且位于不同所述重复单元的两像素驱动电路中，两所述数据线在所述衬底基板上的正投影位于两所述电源线在所述衬底基板上的正投影之间，且所述第二初始信号线在所述衬底基板上的正投影位于两所述数据线在所述衬底基板上的正投影之间。
本公开一种示例性实施例中，在所述第一方向上相邻且位于不同所述重复单元的两像素驱动电路对应设置一条所述第二初始信号线，所述第二初始信号线分别连接与其对应的两所述像素驱动电路中所述第七晶体管的第一极。
本公开一种示例性实施例中，所述显示面板包括沿第一方向和第二方向阵列分布的多个重复单元，所述第一方向和所述第二方向相交；每个所述重复单元包括沿所述第一方向分布的两个所述像素驱动电路，同一所述重复单元中两个所述像素驱动电路镜像对称设置；所述像素驱动电路还包括电容，所述电容的第一电极连接所述驱动晶体管的栅极，所述电容的第二电极连接电源线；所述第一方向为行方向，所述第二方向为列方向，所述显示面板还包括：第二导电层、第五导电层，第二导电层位于所述第一导电层和所述第二有源层之间，所述第二导电层包括第二导电部，所述第二导电部在所述衬底基板上的正投影和所述第一导电部在所述衬底基板上的正投影至少部分交叠，所述第一导电部复用为所述电容的第一电极，所述第二导电部用于形成所述电容的第二电极；第五导电层位于所述第三导电层背离所述衬底基板的一侧，所述第五导电层包括所述电源线，每列所述像素驱动电路对应设置一条所述电源线，所述电源线包括：第一延伸部、第二延伸部、第三延伸部，所述第二延伸部连接于所述第一延伸部和 所述第三延伸部之间；所述第二延伸部在所述衬底基板上的正投影在行方向上的尺寸大于第一延伸部在所述衬底基板上的正投影在行方向上的尺寸，且所述第二延伸部在所述衬底基板上的正投影在行方向上的尺寸大于所述第三延伸部在所述衬底基板上的正投影在行方向上的尺寸；其中，在同一所述重复单元中，相邻两所述电源线中的第二延伸部相连接，在行方向上相邻的两所述重复单元中相邻两所述第二导电部相连接。
本公开一种示例性实施例中，所述显示面板还包括发光单元，所述像素驱动电路还包括：第四晶体管、第五晶体管、第六晶体管、第七晶体管、电容；所述第四晶体管的第一极连接数据线，所述第四晶体管的第二极连接所述驱动晶体管的第一极；所述第五晶体管的第一极连接电源线，所述第五晶体管的第二极连接所述驱动晶体管的第一极；所述第六晶体管的第一极连接所述驱动晶体管的第二极，所述第六晶体管的第二极连接所述发光单元的第一电极；所述第七晶体管的第一极连接第二初始信号线，所述第七晶体管的第二极连接所述发光单元的第一电极；所述电容的第一电极连接所述驱动晶体管的栅极，所述电容的第二电极连接电源线；所述第一晶体管、第二晶体管为N型晶体管，所述驱动晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管、第八晶体管、第九晶体管为P型晶体管。
根据本公开的一个方面，提供一种显示装置，其中，所述显示装置包括上述的显示面板。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本公开。
此处的附图被并入说明书中并构成本说明书的一部分，示出了符合本公开的实施例，并与说明书一起用于解释本公开的原理。显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本公开像素驱动电路一种示例性实施例的结构示意图；
图2为图1所示像素驱动电路一种驱动方法中各控制信号的时序图；
图3为本公开像素驱动电路另一种示例性实施例的结构示意图；
图4为本公开显示面板一种示例性实施例中的结构版图；
图5为图4中遮挡层的结构版图；
图6为图4中第一有源层的结构版图；
图7为图4中第一导电层的结构版图；
图8为图4中第二导电层的结构版图；
图9为图4中第二有源层的结构版图；
图10为图4中第三导电层的结构版图；
图11为图4中第四导电层的结构版图；
图12为图4中第五导电层的结构版图；
图13为图4中遮挡层、第一有源层的结构版图；
图14为图4中遮挡层、第一有源层、第一导电层的结构版图；
图15为图4中遮挡层、第一有源层、第一导电层、第二导电层的结构版图；
图16为图4中遮挡层、第一有源层、第一导电层、第二导电层、第二有源层的结构版图；
图17为图4中遮挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层的结构版图；
图18为图4中遮挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层、第四导电层的结构版图；
图19为图4所示显示面板沿虚线AA剖开的部分剖视图；
图20为本公开显示面板另一种示例性实施例的结构版图；
图21为图20中第一有源层的结构版图；
图22为图20中第四导电层的结构版图；
图23为图20中阻挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层、第四导电层的结构版图。
现在将参考附图更全面地描述示例实施例。然而，示例实施例能够以 多种形式实施，且不应被理解为限于在此阐述的范例；相反，提供这些实施例使得本公开将更加全面和完整，并将示例实施例的构思全面地传达给本领域的技术人员。图中相同的附图标记表示相同或类似的结构，因而将省略它们的详细描述。
用语“一个”、“一”、“所述”用以表示存在一个或多个要素/组成部分/等；用语“包括”和“具有”用以表示开放式的包括在内的意思并且是指除了列出的要素/组成部分/等之外还可存在另外的要素/组成部分/等。
如图1所示，为本公开像素驱动电路一种示例性实施例的结构示意图。该像素驱动电路可以包括：驱动电路1、补偿电路2、第一复位电路3、第一隔离电路4、第二隔离电路5。驱动电路1连接第一节点N1、第二节点N2、第三节点N3，用于根据所述第一节点N1和第二节点N2的电压差向所述第三节点N3提供驱动电流；补偿电路2连接所述第三节点N3、第四节点N4、第一栅极驱动信号端G1，用于响应所述第一栅极驱动信号端G1的信号以导通所述第三节点N3和所述第四节点N4；第一复位电路3连接第一初始信号端Vinit1、第五节点N5、第一复位信号端Re1，用于响应所述第一复位信号端Re1的信号以将所述第一初始信号端Vinit1的信号传输到所述第五节点N5；第一隔离电路4连接所述第一节点N1、第四节点N4，用于响应一控制信号以导通所述第一节点N1和所述第四节点N4；第二隔离电路5连接所述第一节点N1、第五节点N5，用于响应一控制信号以导通所述第一节点N1和所述第五节点N5。
本示例性实施例中，在发光阶段，补偿电路2、第一复位电路3、第一隔离电路4、第二隔离电路5均关断，驱动电路1可以根据第一节点N1的电压利用第二节点N2向第三节点提供驱动电流。本示例性实施例通过增设第一隔离电路4和第二隔离电路5，可以降低第一节点N1向第一初始信号端Vinit1和第三节点N3的漏电流，从而可以提高像素驱动电路在发光阶段的稳定性。
如图1所示，该像素驱动电路可以用于驱动发光单元OLED发光，所述像素驱动电路还可以包括：发光控制电路6、数据写入电路7、第二复位电路8、存储电路9。发光控制电路6连接第一电源端VDD、第二节点N2、第三节点N3、使能信号端EM、所述发光单元OLED的第一电极，所述 发光控制电路6用于响应所述使能信号端EM的信号以连接所述第一电源端VDD和所述第二节点N2，以及连接所述第三节点N3和所述发光单元OLED的第一电极。发光单元OLED的第二电极可以连接第二电源端VSS。第二复位电路8连接所述发光单元OLED的第一电极、第二初始信号端Vinit2、第二复位信号端Re2，用于响应所述第二复位信号端Re2的信号以将所述第二初始信号端Vinit2的信号传输到所述发光单元OLED的第一电极。数据写入电路7连接所述第二节点N2、数据信号端Da、第二栅极驱动信号端G2，用于响应所述第二栅极驱动信号端G2的信号以将所述数据信号端Da的信号传输到所述第二节点N2；存储电路9连接于所述第一节点N1和所述第一电源端VDD之间。
如图1所示，所述驱动电路1可以包括：驱动晶体管T3，驱动晶体管T3的第一极连接所述第二节点N2，第二极连接所述第三节点N3，栅极连接所述第一节点N1；所述补偿电路2可以包括：第二晶体管T2，第二晶体管T2的第一极连接所述第四节点N4，第二极连接所述第三节点N3，栅极连接所述第一栅极驱动信号端G1。所述第一复位电路3包括：第一晶体管T1，第一晶体管T1的第一极连接所述第一初始信号端Vinit1，第二极连接所述第五节点N5，栅极连接所述第一复位信号端Re1；所述第一隔离电路4可以包括：第九晶体管T9，第九晶体管T9的第一极连接所述第一节点N1，第二极连接所述第四节点N4，栅极连接第二栅极驱动信号端G2；所述第二隔离电路5可以包括：第八晶体管T8，第八晶体管T8的第一极连接所述第一节点N1，第二极连接所述第五节点N5，栅极连接第三复位信号端Re3。
如图1所示，所述数据写入电路7可以包括：第四晶体管T4，第四晶体管T4的第一极连接所述数据信号端Da，第二极连接所述第二节点N2，栅极连接所述第二栅极驱动信号端G2；所述发光控制电路6可以包括：第五晶体管T5、第六晶体管T6，第五晶体管T5的第一极连接所述第一电源端VDD，第二极连接所述第二节点N2，栅极连接所述使能信号端EM；第六晶体管T6的第一极连接所述第三节点N3，第二极连接所述发光单元OLED的第一电极，栅极连接所述使能信号端EM；所述第二复位电路8可以包括：第七晶体管T7，第七晶体管T7的第一极连接所述第二初始信号端Vinit2， 第二极连接所述发光单元OLED的第一电极，栅极连接所述第二复位信号端Re2；所述存储电路可以包括：电容C，电容C的第一电极连接所述第一节点N1，第二电极连接所述第一电源端VDD。
如图1所示，第一晶体管T1、第二晶体管T2可以为N型晶体管，驱动晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、第八晶体管T8、第九晶体管T9可以为P型晶体管。
如图2所示，为图1所示像素驱动电路一种驱动方法中各控制信号的时序图。其中，G1表示第一栅极驱动信号端的时序图，G2表示第二栅极驱动信号端的时序图，Re1表示第一复位信号端的时序图，Re2表示第二复位信号端的时序图，Re3表示第三复位信号端的时序图，EM表示使能信号端的时序图。
该像素驱动电路的驱动方法可以包括复位阶段t1、数据写入阶段t2、发光阶段t3。在复位阶段t1：第一使能信号端EM、第一复位信号端Re1、第二复位信号端Re2、第二栅极驱动信号端G2输出高电平信号，第三复位信号端Re3、第一栅极驱动信号端G1输出低电平信号，第一晶体管T1、第八晶体管T8导通，第一初始信号端Vinit1向第一节点N1输入第一初始信号。在数据写入阶段t2：使能信号端EM、第三复位信号端Re3、第一栅极驱动信号端G1输出高电平信号，第一复位信号端Re1、第二栅极驱动信号端G2、第二复位信号端Re2输出低电平信号，第二晶体管T2、第四晶体管T4、第七晶体管T7导通，同时数据信号端Da输出数据信号以向第一节点N1写入补偿电压Vdata+Vth，其中Vdata为数据信号的电压，Vth为驱动晶体管T3的阈值电压，第二初始信号端Vini2向发光单元OLED的第一电极输入第二初始信号。在发光阶段t3：使能信号端EM输出低电平信号，第六晶体管T6、第五晶体管T5导通，驱动晶体管T3在第一节点N1的电压Vdata+Vth作用下驱动发光单元OLED发光。本公开像素驱动电路中驱动晶体管的输出电流I＝(μWCox/2L)(Vdata+Vth-Vdd-Vth)2。其中，μ为载流子迁移率；Cox为单位面积栅极电容量，W为驱动晶体管沟道的宽度，L驱动晶体管沟道的长度，Vgs为驱动晶体管栅源电压差，Vth为驱动晶体管阈值电压。该像素驱动电路能够避免驱动晶体管阈值对其输出电流的影响。应该理解的是，在其他示例性实施例中，该像素驱动电路还可 以有其他驱动方法，例如，第七晶体管T7还可以在数据写入阶段和发光阶段之间的时段导通，以对发光单元OLED的第一电极进行复位。
如图3所示，为本公开像素驱动电路另一种示例性实施例的结构示意图。相比较于图1所示像素驱动电路，图3所示像素驱动电路中第四节点N4和所述第五节点N5连接。该像素驱动电路同样可以降低第一节点N1向第一初始信号端Vinit1和第三节点N3的漏电流。
应该理解的是，在其他示例性实施例中，第一晶体管T1、第二晶体管T2中至少部分晶体管还可以为P型晶体管，驱动晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、第八晶体管T8、第九晶体管T9中至少部分晶体管还可以为N型晶体管。例如，第二晶体管T2和第九晶体管T9可以同为P型晶体管或同为N型晶体管，相应的，第二晶体管T2的栅极和第九晶体管T9的栅极可以连接同一控制信号端；再例如，第二晶体管T2和第四晶体管T4可以同为P型晶体管或同为N型晶体管，相应的，第二晶体管T2的栅极和第四晶体管T4的栅极可以连接同一控制信号端；再例如，第一晶体管T1和第八晶体管T8可以同为P型晶体管或同为N型晶体管，相应的，第一晶体管T1和第八晶体管T8的栅极可以连接同一控制信号端。此外，第八晶体管T8和第九晶体管T9中至少一个的栅极还可以连接有效电平端，即第八晶体管T8和第九晶体管T9中至少一个可以在该有效电平端的作用下一直导通。
本示例性实施例还提供一种显示面板，该显示面板可以包括依次层叠设置的衬底基板、遮挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层、第四导电层、第五导电层，其中，上述相邻层级之间可以设置有绝缘层。如图4-18所示，图4为本公开显示面板一种示例性实施例中的结构版图，图5为图4中遮挡层的结构版图，图6为图4中第一有源层的结构版图，图7为图4中第一导电层的结构版图，图8为图4中第二导电层的结构版图，图9为图4中第二有源层的结构版图，图10为图4中第三导电层的结构版图，图11为图4中第四导电层的结构版图，图12为图4中第五导电层的结构版图，图13为图4中遮挡层、第一有源层的结构版图，图14为图4中遮挡层、第一有源层、第一导电层的结构版图，图15为图4中遮挡层、第一有源层、第一导电层、第二导电层的 结构版图，图16为图4中遮挡层、第一有源层、第一导电层、第二导电层、第二有源层的结构版图，图17为图4中遮挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层的结构版图，图18为图4中遮挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层、第四导电层的结构版图。该显示面板可以包括多个图1所示的像素驱动电路。如图4所示，多个像素驱动电路中可以包括在第一方向X上相邻分布第一像素驱动电路P1和第二像素驱动电路P2，第一像素驱动电路P1和第二像素驱动电路P2可以以镜像对称面BB镜像对称设置。其中，镜像对称面BB可以垂直于衬底基板。且第一像素驱动电路P1在衬底基板上的正投影和第二像素驱动电路P2在衬底基板上的正投影可以以镜像对称面BB与衬底基板的交线为对称轴对称设置。其中，第一像素驱动电路P1和第二像素驱动电路P2可以形成一重复单元，该显示面板可以包括在第一方向X和第二方向Y上阵列分布的多个重复单元，其中，第一方向X可以为行方向，第二方向Y可以为列方向。
如图4、5、13所示，遮挡层可以包括多个遮挡部71、相邻遮挡部71之间可以相互连接。
如图4、6、14所示，第一有源层可以包括第三有源部63、第四有源部64、第五有源部65、第六有源部66、第七有源部67、第八有源部68、第九有源部69。其中，第三有源部63用于形成驱动晶体管T3的沟道区，第四有源部64用于形成第四晶体管T4的沟道区，第五有源部65用于形成第五晶体管T5的沟道区，第六有源部66用于形成第六晶体管T6的沟道区，第七有源部67用于形成第七晶体管T7的沟道区、第八有源部68用于形成第八晶体管T8的沟道区，第九有源部69用于形成第九晶体管T9的沟道区。此外，第一有源层还可以包括：第十有源部610、第十一有源部611、第十二有源部612、第十三有源部613、第十四有源部614、第十五有源部615、第十六有源部616、第十七有源部617。第十有源部610连接于第八有源部68远离第九有源部69的一端；第十一有源部611连接于第八有源部68和第九有源部69之间；第十二有源部612连接于第九有源部69远离第八有源部68的一端；第十三有源部613连接于第六有源部和第七有源部67之间；第十四有源部614连接于第四有源部64远离第三 有源部63的一端；第十五有源部615连接于第五有源部65远离第三有源部63的一端；第十六有源部616连接于第七有源部67远离第六有源部66的一端；第十七有源部617连接于第三有源部63和第六有源部66之间。遮挡部71在衬底基板上的正投影可以覆盖第三有源部63在衬底基板上的正投影，遮挡部71可以对第三有源部63进行遮光，以降低光照对驱动晶体管T3驱动特性的影响，此外，遮挡层还可以连接一稳定电压源，例如，遮挡层可以连接第一电源端VDD、第二电源端VSS、第一初始信号端Vinit1、第二初始信号端Vinit2等，遮挡层还可以屏蔽其他信号对驱动晶体管T3的噪音影响。第一有源层可以由多晶硅材料形成，相应的，驱动晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、第八晶体管T8、第九晶体管T9可以为P型的低温多晶硅薄膜晶体管。
如图4、7、14所示，第一导电层可以包括第二复位信号线Re2、第二栅线G2、使能信号线EM、第三复位信号线Re3、第一导电部11。第二复位信号线Re2在衬底基板上的正投影、第二栅线G2在衬底基板上的正投影、使能信号线EM在衬底基板上的正投影、第三复位信号线Re3在衬底基板上的正投影在衬底基板上的正投影均可以沿第一方向X延伸。在本示例性实施例中，某一结构在衬底基板上的正投影沿某一方向延伸，可以理解为，该结构在衬底基板上的正投影沿该方向直线延伸或弯折延伸。第二复位信号线Re2可以用于提供图1中的第二复位信号端，第二复位信号线Re2在衬底基板上的正投影可以覆盖第七有源部67在衬底基板上的正投影，第二复位信号线Re2的部分结构可以用于形成第七晶体管的栅极。第二栅线G2可以用于提供图1中的第二栅极驱动信号端，第二栅线G2在衬底基板上的正投影可以覆盖第四有源部64在衬底基板上的正投影、第九有源部69在衬底基板上的正投影，第二栅线G2的部分结构可以分别用于形成第四晶体管T4、第九晶体管T9的栅极。使能信号线EM可以用于提供图1中的使能信号端，使能信号线EM在衬底基板上的正投影可以覆盖第五有源部65在衬底基板上的正投影、第六有源部66在衬底基板上的正投影，使能信号线EM的部分结构可以分别用于形成第五晶体管T5、第六晶体管T6的栅极。第三复位信号线Re3可以用于提供图1中的第三复位信号端，第三复位信号线Re3在衬底基板上的正投影可以覆盖第八有源部68 在衬底基板上的正投影，第三复位信号线Re3的部分结构可以用于形成第八晶体管T8的栅极。第一导电部11在衬底基板上的正投影可以覆盖第三有源部63在衬底基板上的正投影，第一导电部11可以用于形成驱动晶体管T3的栅极以及电容C的第一电极。
如图4、7、14所示，第三复位信号线Re3在衬底基板上的正投影、第二栅线G2在衬底基板上的正投影、第一导电部11在衬底基板上的正投影、使能信号线EM在衬底基板上的正投影、第二复位信号线Re2在衬底基板上的正投影可以沿第二方向Y依次分布。本行像素驱动电路中第二复位信号线Re2还可以复用为相邻下一行像素驱动电路中第三复位信号线Re3，该设置可以降低像素驱动电路在第二方向Y上的尺寸。此外，该显示面板可以利用第一导电层为掩膜对第一有源层进行导体化处理，即第一有源层中被第一导电层覆盖的区域可以形成晶体管的沟道区，第一有源层中未被第一导电层覆盖的区域形成导体结构。
如图4、8、15所示，第二导电层可以包括第三栅线2G1、第四复位信号线2Re1、第一初始信号线Vinit1、第二导电部22。第三栅线2G1在衬底基板上的正投影、第四复位信号线2Re1在衬底基板上的正投影、第一初始信号线Vinit1在衬底基板上的正投影均可以沿第一方向X延伸。第三栅线2G1用于提供图1中的第一栅极驱动信号端；第一初始信号线Vinit1用于提供图1中的第一初始信号端，第四复位信号线2Re1用于提供图1中的第一复位信号端。第二导电部22在衬底基板上的正投影可以与第一导电部11在衬底基板上的正投影至少部分交叠，第二导电部22可以用于形成电容C的第二电极。在第一方向X上相邻重复单元中，相邻第二导电部22可以相连接。如图4、8、15所示，相邻下一行像素驱动电路中第一初始信号线Vinit1在衬底基板上的正投影可以位于本行像素驱动电路中第二复位信号线Re2在衬底基板上的正投影和本行像素驱动电路中使能信号线EM在衬底基板上的正投影之间。该设置可以降低像素驱动电路在第二方向Y上的尺寸。
如图4、9、16所示，第二有源层可以包括第一有源部81、第二有源部82，第一有源部81用于形成第一晶体管T1的沟道区，第二有源部82用于形成第二晶体管T2的沟道区。第二有源层还可以包括第十八有源部 818、第十九有源部819、第二十有源部820、第二十一有源部821。第十八有源部818和第十九有源部819连接于第一有源部81的两端。第二十有源部820和第二十一有源部821连接于第二有源部82的两端。第三栅线2G1在衬底基板上的正投影覆盖第二有源部82在衬底基板上的正投影，第三栅线2G1的部分结构用于形成第二晶体管T2的底栅；第四复位信号线2Re1在衬底基板上的正投影覆盖第一有源部81在衬底基板上的正投影，第四复位信号线2Re1的部分结构用于形成第一晶体管T1的底栅。其中，第二有源层可以由氧化铟镓锌形成，相应的，第一晶体管T1、第二晶体管T2可以为N型的金属氧化物薄膜晶体管。
如图4、10、17所示，第三导电层可以包括：第一栅线3G1、第一复位信号线3Re1。第一栅线3G1在衬底基板上的正投影沿第一方向X延伸且覆盖第二有源部82在衬底基板上的正投影，第一栅线3G1的部分结构可以用于形成第二晶体管T2的顶栅。第一栅线3G1可以通过过孔连接第三栅线2G1，连接于第一栅线3G1和第三栅线2G1之间的过孔可以位于显示面板显示区周围的边沿走线区。第一复位信号线3Re1在衬底基板上的正投影沿第一方向X延伸且覆盖第一有源部81在衬底基板上的正投影，第一复位信号线3Re1的部分结构可以用于形成第一晶体管T1的顶栅。第一复位信号线3Re1可以通过过孔连接第四复位信号线2Re1，连接于第一复位信号线3Re1和第四复位信号线2Re1之间的过孔可以位于显示面板显示区周围的边沿走线区。
如图4、10、17所示，相邻下一行像素驱动电路中第一复位信号线3Re1在衬底基板上的正投影可以位于本行像素驱动电路中第二复位信号线Re2在衬底基板上的正投影和相邻下一行像素驱动电路中第一初始信号线Vinit1在衬底基板上的正投影之间。该设置可以降低像素驱动电路在第二方向Y上的尺寸。此外，该显示面板可以利用第三导电层为掩膜对第二有源层进行导体化处理，即第二有源层中被第三导电层覆盖的区域可以形成晶体管的沟道区，第二有源层中未被第三导电层覆盖的区域形成导体结构。
如图4、11、18所示，第四导电层可以包括第二初始信号线Vinit2、第一桥接部41、第二桥接部42、第三桥接部43、第四桥接部44、第五桥接部45、第六桥接部46、第七桥接部47、第八桥接部48。第二初始信号 线Vinit2可以用于提供图1中的第二初始信号端。第二初始信号线Vinit2在衬底基板上的正投影可以第二方向Y延伸，第二初始信号线Vinit2可以通过过孔H连接第十六有源部616，以连接第七晶体管T7的第一极和第一初始信号端。本示例性实施例中，黑色方块表示过孔的位置。第一桥接部41可以分别通过过孔连接第一初始信号线Vinit1、第十八有源部818，以连接第一晶体管T1的第一极和第一初始信号端。第二桥接部42可以分别通过过孔连接第十五有源部615、第二导电部22，以连接第五晶体管T5的第一电极和电容C的第二电极。第三桥接部43可以分别通过过孔连接第十有源部610、第十九有源部819，以连接第八晶体管T8的第二极和第一晶体管T1的第二极。第四桥接部44可以分别通过过孔连接第十一有源部611、第一导电部11，以连接第八晶体管T8的第一极、第九晶体管T9的第一极、驱动晶体管T3的栅极。其中，如图9所示，第二导电部22上形成有开口221，连接于第四桥接部44和第一导电部11之间的过孔在衬底基板上的正投影位于开口221在衬底基板上的正投影以内，以使连接于第四桥接部44和第一导电部11之间的过孔和第二导电部22绝缘。第五桥接部45可以通过过孔连接第十三有源部613，以连接第六晶体管T6的第二极。第六桥接部46可以通过过孔连接第十四有源部614，以连接第四晶体管T4的第一极。第七桥接部47可以分别通过过孔连接第十七有源部617、第二十一有源部821，以连接第二晶体管T2的第二极和驱动晶体管的第二极。第八桥接部48可以分别通过过孔连接第二十有源部820、第十二有源部612，以连接第二晶体管T2的第一极和第九晶体管T9的第二极。
如图4、12所示，第五导电层可以包括数据线Da、电源线VDD、第九桥接部59。数据线Da在衬底基板上的正投影、电源线VDD在衬底基板上的正投影均可以沿第二方向Y延伸。数据线Da用于提供数据信号端，电源线VDD用于提供第一电源端。其中，数据线Da可以通过过孔连接第六桥接部46，以连接第四晶体管T4的第一极和数据信号端。电源端VDD可以通过过孔连接第二桥接部42，以连接第一电源端和第五晶体管T5的第一极。第九桥接部59可以通过过孔连接第五桥接部45，以连接第六晶体管T6的第二极，第九桥接部59还可以用于连接发光单元的第一电极。其中，电源线VDD可以包括第一延伸部VDD1、第二延伸部VDD2、第三延伸 部VDD3，第二延伸部VDD2连接于第一延伸部VDD1和第三延伸部VDD3之间，第二延伸部VDD2在所述衬底基板上的正投影在第一方向X上的尺寸可以大于第一延伸部VDD1在所述衬底基板上的正投影在第一方向X上的尺寸，且所述第二延伸部VDD2在所述衬底基板上的正投影在第一方向X上的尺寸可以大于所述第三延伸部VDD3在所述衬底基板上的正投影在第一方向X上的尺寸。第二延伸部VDD2在衬底基板上的正投影可以覆盖第一有源部81、第二有源部82在衬底基板上的正投影，第二延伸部VDD2可以降低光照对第一晶体管T1、第二晶体管T2的特性影响。第二延伸部VDD2在衬底基板上的正投影还可以覆盖第四桥接部44在衬底基板上的正投影，第二延伸部VDD2可以对第四桥接部44进行稳压和屏蔽，以降低驱动晶体管T3栅极在发光阶段的电压波动。在同一重复单元中，两电源线VDD中的第二延伸部VDD2可以相互连接，从而电源线VDD和第二导电部22可以形成网格结构，该网格结构的电源线可以降低其上电源信号的压降。
需要说明的是，如图4、18所示，画于第四导电层背离衬底基板一侧的黑色方块表示第四导电层连接面向衬底基板一侧的其他层级的过孔；画于第五导电层背离衬底基板一侧的黑色方块表示第五导电层连接面向衬底基板一侧的其他层级的过孔。该黑色方块仅表示过孔的位置，不同位置黑色方块所表示的不同过孔可以贯穿于不同绝缘层。
如图19所示，为图4所示显示面板沿虚线AA剖开的部分剖视图。该显示面板还可以包括第一绝缘层91、第二绝缘层92、第三绝缘层93、第四绝缘层94、第五绝缘层95、第一介电层96、钝化层97、第一平坦层98，其中，衬底基板90、遮挡层、第一绝缘层91、第一有源层、第二绝缘层92、第一导电层、第三绝缘层93、第二导电层、第四绝缘层94、第二有源层、第五绝缘层95、第三导电层、第一介电层96、第四导电层、钝化层97、第一平坦层98、第五导电层依次层叠设置。第一绝缘层91、第二绝缘层92、第三绝缘层93、第四绝缘层94、第五绝缘层95可以为单层结构或多层结构，且第一绝缘层91、第二绝缘层92、第三绝缘层93、第四绝缘层94、第五绝缘层95的材料可以为氮化硅，氧化硅，氮氧化硅中的至少一种；第一介电层96可以为氮化硅层；第一平坦层98的材料可以为有机材料，例如聚酰亚胺(PI)、聚对苯二甲酸乙二醇酯(PET)、聚萘二甲 酸乙二醇酯(PEN)、硅-玻璃键合结构(SOG)等材料。衬底基板90可以包括依次层叠设置的玻璃基板、阻挡层、聚酰亚胺层，阻挡层可以为无机材料。钝化层97可以为氧化硅层。第一导电层、第二导电层、第三导电层的材料可以是钼、铝、铜、钛、铌其中之一或者合金，或者钼/钛合金或者叠层等。第四导电层、第五导电层、第六导电层的材料可以包括金属材料，例如可以是钼、铝、铜、钛、铌其中之一或者合金，或者钼/钛合金或者叠层等，或者可以是钛/铝/钛叠层。电极层可以包括氧化铟锡层、银层。第一导电层、第二导电层、第三导电层中任一导电层的方块电阻可以大于第四导电层、第五导电层中任一导电层的方块电阻。
如图20-23所示，图20为本公开显示面板另一种示例性实施例的结构版图，图21为图20中第一有源层的结构版图，图22为图20中第四导电层的结构版图，图23为图20中阻挡层、第一有源层、第一导电层、第二导电层、第二有源层、第三导电层、第四导电层的结构版图。
图20所示显示面板与图4所示显示面板不同在于：图20所示显示面板在第一方向X上相邻的重复单元中，相邻第十六有源部616可以相连接，在第一方向X上相邻的重复单元中相邻像素驱动电路可以共用同一条第二初始信号线Vinit2。该设置可以简化显示面板结构，同时可以降低像素驱动电路在第一方向X上的尺寸。
需要说明的是，本公开中的附图比例可以作为实际工艺中的参考，但不限于此，例如：沟道的宽长比、各个膜层的厚度和间距、各个信号线的宽度和间距，可以根据实际需要进行调整。显示基板中像素的个数和每个像素中子像素的个数也不是限定为图中所示的数量，本公开中所描述的附图仅是结构示意图。此外，第一、第二等限定词仅用于限定不同的结构名称，其并没有特定顺序的含义。同一结构层可以通过同一构图工艺形成。
本示例性实施例还提供一种显示装置，其中，包括上述的显示面板。该显示装置可以为手机、平板电脑、电视等显示装置。
本领域技术人员在考虑说明书及实践这里公开的内容后，将容易想到本公开的其他实施例。本申请旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性原理并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施 例仅被视为示例性的，本公开的真正范围和精神由权利要求指出。
应当理解的是，本公开并不局限于上面已经描述并在附图中示出的精确结构，并且可以在不脱离其范围进行各种修改和改变。本公开的范围仅由所附的权利要求来限定。
Claims (20)
- 一种像素驱动电路，其中，包括：驱动电路，连接第一节点、第二节点、第三节点，用于根据所述第一节点的电压利用所述第二节点向所述第三节点提供驱动电流；补偿电路，连接所述第三节点、第四节点、第一栅极驱动信号端，用于响应所述第一栅极驱动信号端的信号以导通所述第三节点和所述第四节点；第一复位电路，连接第一初始信号端、第五节点、第一复位信号端，用于响应所述第一复位信号端的信号以将所述第一初始信号端的信号传输到所述第五节点；第一隔离电路，连接所述第一节点、第四节点，用于响应一控制信号以导通所述第一节点和所述第四节点；第二隔离电路，连接所述第一节点、第五节点，用于响应一控制信号以导通所述第一节点和所述第五节点。
- 根据权利要求1所述的像素驱动电路，其中，所述第四节点和所述第五节点连接。
- 根据权利要求1或2所述的像素驱动电路，其中，所述驱动电路包括：驱动晶体管，第一极连接所述第二节点，第二极连接所述第三节点，栅极连接所述第一节点；所述补偿电路包括：第二晶体管，第一极连接所述第四节点，第二极连接所述第三节点，栅极连接所述第一栅极驱动信号端；所述第一复位电路包括：第一晶体管，第一极连接所述第一初始信号端，第二极连接所述第五节点，栅极连接所述第一复位信号端；所述第一隔离电路包括：第九晶体管，第一极连接所述第一节点，第二极连接所述第四节点；所述第二隔离电路包括：第八晶体管，第一极连接所述第一节点，第二极连接所述第五节点。
- 根据权利要求3所述的像素驱动电路，其中，所述第一晶体管、所述第二晶体管、所述第八晶体管、所述第九晶体管中任一晶体管为N型晶体管或P型晶体管。
- 根据权利要求1所述的像素驱动电路，其中，所述像素驱动电路用于驱动发光单元发光，所述像素驱动电路还包括：发光控制电路，连接第一电源端、第二节点、第三节点、使能信号端、所述发光单元的第一电极，所述发光控制电路用于响应所述使能信号端的信号以连接所述第一电源端和所述第二节点，以及连接所述第三节点和所述发光单元的第一电极；第二复位电路，连接所述发光单元的第一电极、第二初始信号端、第二复位信号端，用于响应所述第二复位信号端的信号以将所述第二初始信号端的信号传输到所述发光单元的第一电极；数据写入电路，连接所述第二节点、数据信号端、第二栅极驱动信号端，用于响应所述第二栅极驱动信号端的信号以将所述数据信号端的信号传输到所述第二节点；存储电路，连接于所述第一节点和所述第一电源端之间。
- 根据权利要求5所述的像素驱动电路，其中，所述数据写入电路包括：第四晶体管，第一极连接所述数据信号端，第二极连接所述第二节点，栅极连接所述第二栅极驱动信号端；所述发光控制电路包括：第五晶体管，第一极连接所述第一电源端，第二极连接所述第二节点，栅极连接所述使能信号端；第六晶体管，第一极连接所述第三节点，第二极连接所述发光单元的第一电极，栅极连接所述使能信号端；所述第二复位电路包括：第七晶体管，第一极连接所述第二初始信号端，第二极连接所述发光单元的第一电极，栅极连接所述第二复位信号端；所述存储电路包括：电容，第一电极连接所述第一节点，第二电极连接所述第一电源端。
- 根据权利要求5所述的像素驱动电路，其中，所述第一隔离电路和所述数据写入电路的导通电平逻辑相同，所述第一隔离电路连接所述第二栅极驱动信号端，所述第一隔离电路用于响应所述第二栅极驱动信号端的信号以导通所述第一节点和所述第四节点。
- 一种像素驱动电路驱动方法，用于驱动权利要求1-7任一项所述的像素驱动电路，其中，所述驱动方法包括：在复位阶段，利用所述第一复位电路将所述第一初始信号端的信号传输到所述第五节点，利用所述第二隔离电路导通所述第五节点和所述第一节点；在数据写入阶段，利用所述补偿电路导通所述第四节点和所述第三节点，利用所述第一隔离电路导通所述第四节点和所述第一节点；在发光阶段，利用所述第一复位电路断开所述第一初始信号端和所述第五节点，利用所述第二隔离电路断开所述第五节点和所述第一节点，利用所述补偿电路断开所述第四节点和所述第三节点，利用所述第一隔离电路断开所述第四节点和所述第一节点。
- 一种显示面板，其中，所述显示面板包括权利要求1-7任一项所述的像素驱动电路。
- 一种显示面板，其中，所述显示面板包括像素驱动电路，所述像素驱动电路包括：驱动晶体管；第八晶体管，第一极连接所述驱动晶体管的栅极，栅极连接第三复位信号线；第九晶体管，第一极连接所述驱动晶体管的栅极，栅极连接第二栅线；第一晶体管，第一极连接第一初始信号线，第二极连接所述第八晶体管的第二极，栅极连接第一复位信号线；第二晶体管，第一极连接所述第九晶体管的第二极，第二极连接所述驱动晶体管的第二极，栅极连接第一栅线；所述显示面板还包括：衬底基板；第一有源层，所述第一有源层包括第三有源部、第八有源部、第九有 源部，所述第三有源部用于形成所述驱动晶体管的沟道区，所述第八有源部用于形成所述第八晶体管的沟道区，所述第九有源部用于形成所述第九晶体管的沟道区；第一导电层，位于所述第一有源层背离所述衬底基板的一侧，所述第一导电层包括：所述第三复位信号线、第二栅线、第一导电部，所述第三复位信号线在所述衬底基板上的正投影覆盖所述第八有源部在所述衬底基板上的正投影，所述第三复位信号线的部分结构用于形成所述第八晶体管的栅极，所述第二栅线在所述衬底基板上的正投影覆盖所述第九有源部在所述衬底基板上的正投影，所述第二栅线的部分结构用于形成所述第九晶体管的栅极，所述第一导电部在所述衬底基板上的正投影覆盖所述第三有源部在所述衬底基板上的正投影，所述第一导电部用于形成所述驱动晶体管的栅极；第二有源层，位于所述第一导电层背离所述衬底基板的一侧，所述第二有源层包括第一有源部、第二有源部，所述第一有源部用于形成所述第一晶体管的沟道区，所述第二有源部用于形成所述第二晶体管的沟道区；第三导电层，位于所述第二有源层背离所述衬底基板的一侧，所述第三导电层包括所述第一复位信号线、第一栅线，所述第一复位信号线在所述衬底基板上的正投影覆盖所述第一有源部在所述衬底基板上的正投影，所述第一复位信号线的部分结构用于形成所述第一晶体管的顶栅，所述第一栅线在所述衬底基板上的正投影覆盖所述第二有源部在所述衬底基板上的正投影，所述第一栅线的部分结构用于形成所述第二晶体管的顶栅。
- 根据权利要求10所述的显示面板，其中，所述第三复位信号线在所述衬底基板上的正投影、第二栅线在所述衬底基板上的正投影、第一复位信号线在所述衬底基板上的正投影、第一栅线在所述衬底基板上的正投影均沿第一方向延伸；所述第一栅线在所述衬底基板上的正投影位于所述第一导电部在所述衬底基板上的正投影和所述第二栅线在所述衬底基板上的正投影之间；所述第三复位信号线在所述衬底基板上的正投影位于所述第二栅线在所述衬底基板上的正投影远离所述第一导电部在所述衬底基板上的正投影的一侧；所述第一复位信号线在所述衬底基板上的正投影位于所述第三复位信号线在所述衬底基板上的正投影远离所述第一导电部在所述衬底基板上的正投影的一侧。
- 根据权利要求11所述的显示面板，其中，所述显示面板还包括发光单元，所述像素驱动电路还包括第五晶体管、第七晶体管；所述第五晶体管的第一极连接电源线，所述第五晶体管的第二极连接所述驱动晶体管的第一极，所述第七晶体管的第一极连接第二初始信号线，所述第七晶体管的第二极连接所述发光单元的第一电极；所述第一有源层还包括：第五有源部，所述第五有源部用于形成所述第五晶体管的沟道区；第七有源部，所述第七有源部用于形成所述第七晶体管的沟道区；所述第一导电层还包括：使能信号线，所述使能信号线在所述衬底基板上的正投影沿所述第一方向延伸，且覆盖所述第五有源部在所述衬底基板上的正投影，所述使能信号线的部分结构用于形成所述第五晶体管的栅极；第二复位信号线，所述第二复位信号线在所述衬底基板上的正投影沿所述第一方向延伸，且覆盖所述第七有源部在所述衬底基板上的正投影，所述第二复位信号线的部分结构用于形成所述第七晶体管的栅极；其中，所述使能信号线在所述衬底基板上的正投影位于所述第一导电部在所述衬底基板上的正投影远离所述第一栅线在所述衬底基板上的正投影的一侧；所述第二复位信号线在所述衬底基板上的正投影位于所述使能信号线在所述衬底基板上的正投影远离所述第一导电部在所述衬底基板上的正投影的一侧。
- 根据权利要求12所述的显示面板，其中，所述显示面板包括沿行列方向阵列分布的多个像素驱动电路，所述第一方向为行方向，本行像素驱动电路中的所述第二复位信号线复用为相邻下一行像素驱动电路中的所述第三复位信号线。
- 根据权利要求12所述的显示面板，其中，所述显示面板包括沿行列方向阵列分布的多个像素驱动电路，所述第一方向为行方向，相邻下 一行像素驱动电路中的所述第一复位信号线在所述衬底基板上的正投影位于本行像素驱动电路中所述第二复位信号线在所述衬底基板上的正投影和本行像素驱动电路中所述使能信号线在所述衬底基板上的正投影之间。
- 根据权利要求12所述的显示面板，其中，所述显示面板还包括：第四导电层，位于所述第三导电层背离所述衬底基板的一侧，所述第四导电层包括所述第二初始信号线，所述第二初始信号线在所述衬底基板上的正投影沿第二方向延伸，所述第二方向和所述第一方向相交。
- 根据权利要求15所述的显示面板，其中，所述像素驱动电路还包括第四晶体管，所述第四晶体管的第一极连接数据线，第二极连接所述驱动晶体管的第一极，所述显示面板还包括：第五导电层，位于所述第四导电层背离所述衬底基板的一侧，所述第五导电层包括所述数据线、电源线，所述数据线在所述衬底基板上的正投影、所述电源线在所述衬底基板上的正投影沿所述第二方向延伸；所述显示面板还包括沿所述第一方向和第二方向阵列分布的多个重复单元，每个所述重复单元包括沿所述第一方向分布的两个所述像素驱动电路，同一所述重复单元中两个所述像素驱动电路镜像对称设置；所述第二方向为列方向，每列所述像素驱动电路对应设置一条所述电源线和一条所述数据线；在所述第一方向上相邻且位于不同所述重复单元的两像素驱动电路中，两所述数据线在所述衬底基板上的正投影位于两所述电源线在所述衬底基板上的正投影之间，且所述第二初始信号线在所述衬底基板上的正投影位于两所述数据线在所述衬底基板上的正投影之间。
- 根据权利要求16所述的显示面板，其中，在所述第一方向上相邻且位于不同所述重复单元的两像素驱动电路对应设置一条所述第二初始信号线，所述第二初始信号线分别连接与其对应的两所述像素驱动电路中所述第七晶体管的第一极。
- 根据权利要求10所述的显示面板，其中，所述显示面板包括沿第一方向和第二方向阵列分布的多个重复单元，所述第一方向和所述第二方向相交；每个所述重复单元包括沿所述第一方向分布的两个所述像素驱动电路，同一所述重复单元中两个所述像素驱动电路镜像对称设置；所述像素驱动电路还包括电容，所述电容的第一电极连接所述驱动晶体管的栅极，所述电容的第二电极连接电源线；所述第一方向为行方向，所述第二方向为列方向，所述显示面板还包括：第二导电层，位于所述第一导电层和所述第二有源层之间，所述第二导电层包括第二导电部，所述第二导电部在所述衬底基板上的正投影和所述第一导电部在所述衬底基板上的正投影至少部分交叠，所述第一导电部复用为所述电容的第一电极，所述第二导电部用于形成所述电容的第二电极；第五导电层，位于所述第三导电层背离所述衬底基板的一侧，所述第五导电层包括所述电源线，每列所述像素驱动电路对应设置一条所述电源线，所述电源线包括：第一延伸部、第二延伸部、第三延伸部，所述第二延伸部连接于所述第一延伸部和所述第三延伸部之间；所述第二延伸部在所述衬底基板上的正投影在行方向上的尺寸大于第一延伸部在所述衬底基板上的正投影在行方向上的尺寸，且所述第二延伸部在所述衬底基板上的正投影在行方向上的尺寸大于所述第三延伸部在所述衬底基板上的正投影在行方向上的尺寸；其中，在同一所述重复单元中，相邻两所述电源线中的第二延伸部相连接，在行方向上相邻的两所述重复单元中相邻两所述第二导电部相连接。
- 根据权利要求10所述的显示面板，其中，所述显示面板还包括发光单元，所述像素驱动电路还包括：第四晶体管、第五晶体管、第六晶体管、第七晶体管、电容；所述第四晶体管的第一极连接数据线，所述第四晶体管的第二极连接所述驱动晶体管的第一极；所述第五晶体管的第一极连接电源线，所述第五晶体管的第二极连接所述驱动晶体管的第一极；所述第六晶体管的第一极连接所述驱动晶体管的第二极，所述第六晶体管的第二极连接所述发光单元的第一电极；所述第七晶体管的第一极连接第二初始信号线，所述第七晶体管的第二极连接所述发光单元的第一电极；所述电容的第一电极连接所述驱动晶体管的栅极，所述电容的第二电极连接电源线；所述第一晶体管、第二晶体管为N型晶体管，所述驱动晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管、第八晶体管、第九晶体管为P型晶体管。
- 一种显示装置，其中，所述显示装置包括权利要求9-19任一项所述的显示面板。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| PB01 | Publication | ||
| PB01 | Publication |