CN114822396B - 像素驱动电路和显示面板 - Google Patents

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Abstract

本申请提供一种像素驱动电路和显示面板，像素驱动电路包括发光元件、驱动晶体管、复位回路、第一电容、第一开关管、第二电容、预充电模块和阈值补偿回路。驱动晶体管与发光元件串联。复位回路在复位阶段导通以对驱动晶体管的控制端的电压进行复位。第二电容与第一开关管的控制端电连接。预充电模块在复位阶段将第二电容的电压充电至第一电压。阈值补偿回路包括串联的第一电容、驱动晶体管以及第一开关管，第一开关管的控制端的电压基于第一扫描信号从第一电压继续上升，以导通阈值补偿回路对驱动晶体管的阈值电压进行补偿。该像素驱动电路通过预充电模块在复位阶段将第二电容预充电至第一电压，可以缩短阈值补偿阶段的时长。

Description

像素驱动电路和显示面板
技术领域
本申请涉及显示技术领域，尤其涉及一种像素驱动电路和显示面板。
背景技术
由于OLED(Organic Light-Emitting Diode，有机发光半导体)显示屏具有功耗低、响应速度快、显示视角宽等优点，因此，OLED显示屏的应用越来越广泛。OLED显示装置按照驱动方式可以分为无源矩阵型OLED(PassiveMatrixOLED，PMOLED)和有源矩阵型OLED(ActiveMatrixOLED，AMOLED)两大类。
在AMOLED显示面板中，像素驱动电路呈阵列排布，早期的像素驱动电路采用2T1C结构，即每个像素驱动电路包括两个晶体管(T)与一个电容(C)，但晶体管存在阈值电压漂移的问题。为了解决晶体管的阈值电压漂移的问题，便衍生出采用阈值电压补偿的5T2C、7T1C、8T1C等类型的像素驱动电路。然而，由于在各帧扫描周期中加入了阈值电压补偿阶段，使得一帧扫描周期时长较长、像素驱动电路的充电速度较慢，不利于实现高刷新率。
发明内容
有鉴于此，本申请的主要目的在于提出像素驱动电路和显示面板，旨在解决现有的像素驱动电路扫描周期时长较长、像素驱动电路的充电速度较慢，不利于实现高刷新率的问题。
为实现上述目的，本申请提供一种像素驱动电路，所述像素驱动电路包括发光元件、驱动晶体管、复位回路、第一电容、第一开关管、第二电容、预充电模块以及阈值补偿回路。所述发光元件的第一端与参考电压端电连接，所述像素驱动电路用于驱动所述发光元件发光。所述驱动晶体管与所述发光元件的第二端电连接。所述第一电容串联于所述复位回路中，且所述第一电容的第一端与所述驱动晶体管的控制端电连接。其中，所述复位回路在复位阶段导通，以接收复位电压对所述第一电容充电来提升所述第一电容的第一端的电压，从而通过所述第一电容将所述驱动晶体管的控制端的电压复位至所述复位电压。所述第一开关管并联在所述发光元件的两端。所述第二电容的第一端与所述第一开关管的控制端电连接。所述预充电模块与所述第二电容的第一端电连接，所述预充电模块用于在所述复位阶段对所述第二电容进行充电，使得所述第二电容的第一端的电压上升至第一电压，其中，所述第一电压低于所述参考电压端的电压与所述第一开关管的阈值电压之和。所述阈值补偿回路包括串联电连接的所述第一电容、所述驱动晶体管以及所述第一开关管，其中，所述第二电容在阈值补偿阶段基于第一扫描信号继续充电，使得所述第一开关管的控制端的电压从所述第一电压开始继续上升，以导通所述第一开关管，从而导通所述阈值补偿回路。所述第一电容通过导通的所述阈值补偿回路放电，使得所述驱动晶体管的控制端的电压从所述复位电压下降至第二电压，所述驱动晶体管在其控制端的电压等于所述第二电压时进入临界导通状态，所述第二电压低于或者等于所述复位电压。
本申请提供的像素驱动电路，在复位阶段通过所述预充电模块将所述第二电容的第一端的电压预充电至所述第一电压，因此，当所述第二电容在接收到所述第一扫描信号时可以基于所述第一电压继续充电，而不需要从初始低电平开始充电，如此，可以缩短阈值补偿阶段的时长，即可以缩短每帧扫描周期的时长，有利于实现高刷新率。
可选地，所述预充电模块包括第二开关管和导通信号生成模块。所述第二开关管的第一连接端用于接收充电电压，所述第二开关管的第二连接端与所述第一开关管的控制端电连接。所述导通信号生成模块与所述第二开关管的控制端电连接，所述导通信号生成模块用于在所述复位阶段内的预设时间段生成导通信号，以导通所述第二开关管，从而使所述第二电容通过导通的所述第二开关管接收到所述充电电压而充电，以将所述第二电容的第一端的电压充电至所述第一电压。
可选地，所述导通信号生成模块包括T触发器，所述T触发器的时钟信号端用于在所述复位阶段内的预设时间段接收第一时钟信号，所述T触发器的输入端用于接收高电平电压，所述T触发器的输出端与所述第二开关管的控制端电连接，其中，所述第一时钟信号的持续时长为两个预设时钟周期。所述T触发器响应于所述第一时钟信号，在所述复位阶段内的预设时间段生成并输出所述导通信号。
可选地，所述导通信号生成模块包括D触发器和反相器。所述D触发器的时钟信号端用于在所述复位阶段内的预设时间段接收第二时钟信号，所述D触发器的输出端与所述第二开关管的控制端电连接，其中，所述第二时钟信号的持续时长为三个预设时钟周期。所述反相器的输入端与所述D触发器的输出端电连接，所述反相器的输出端与所述D触发器的输入端电连接。所述D触发器响应于所述第二时钟信号，在所述复位阶段内的预设时间段生成并输出所述导通信号。
可选地，所述复位回路还包括串联的第三开关管、第四开关管、第五开关管。所述第三开关管的第一连接端用于在所述复位阶段接收所述复位电压，所述第三开关管的第二连接端与所述驱动晶体管电连接。所述第四开关管电连接于所述第三开关管的第二连接端和所述驱动晶体管的控制端之间。所述第五开关管电连接于所述第一电容的第二端和所述参考电压端之间。在所述复位阶段，所述第三开关管基于其控制端接收到的第二扫描信号而导通，所述第四开关管基于其控制端接收到的第三扫描信号而导通，所述第五开关管基于其控制端接收到的所述第三扫描信号而导通，从而使得所述复位回路导通。
可选地，所述阈值补偿回路还包括所述第四开关管和所述第五开关管。在所述阈值补偿阶段，所述第四开关管基于其控制端接收到的所述第三扫描信号而导通，所述第五开关管基于其控制端接收到的所述第三扫描信号而导通，从而使得所述阈值补偿回路导通。
可选地，所述像素驱动电路还包括数据写入回路，所述数据写入回路包括串联电连接的第六开关管和所述第一电容。其中，所述第六开关管的第一连接端用于接收数据电压，所述第六开关管的第二连接端与所述第一电容的第二端电连接。在所述数据写入阶段，所述第五开关管断开，所述第六开关管基于其控制端接收到的第四扫描信号而导通，从而导通所述数据写入回路以将所述第一电容的第二端的电压上拉至所述数据电压。
可选地，所述像素驱动电路还包括发光回路，所述发光回路包括依次串联的所述第三开关管、所述驱动晶体管以及所述发光元件。在发光阶段，所述第三开关管基于其控制端接收到的所述第二扫描信号而导通，从而使得所述发光回路导通以接收驱动电压驱动所述发光元件发光。
可选地，所述发光回路还包括串联电连接于所述驱动晶体管和所述发光元件之间的第七开关管，所述第七开管和所述发光元件串联而成的电路与所述第一开关管并联电连接。在所述复位阶段，所述第七开关管断开，从而使得所述发光回路断开。在所述发光阶段，所述第七开关管基于其控制端接收到的第五扫描信号而导通，从而使得所述发光回路导通。
本申请还提供一种显示面板，所述显示面板包括基板和上述的像素驱动电路，所述基板包括显示区，所述若干个像素驱动电路阵列排布在所述基板的显示区内。
本申请的附加方面和优点将在下面的描述中部分给出，部分将从下面的描述中变得明显，或通过本申请的实践了解到。
附图说明
图1是本申请实施例提供的显示面板的结构示意图。
图2是本申请实施例提供的第一种像素驱动电路的结构示意图。
图3是图2所示的像素驱动电路的工作时序图。
图4a是图2所示的像素驱动电路在t12阶段的电路示意图。
图4b是图2所示的像素驱动电路在t2阶段的电路示意图。
图4c是图2所示的像素驱动电路在t3阶段的电路示意图。
图4d是图2所示的像素驱动电路在t4阶段的电路示意图。
图5是本申请实施例提供的第二种像素驱动电路的结构示意图。
图6是图5所示的像素驱动电路的工作时序图。
图7是本申请实施例提供的第三种像素驱动电路的结构示意图。
图8是图7所示的像素驱动电路的工作时序图。
主要元件符号说明：
显示面板 1
参考电压端 VSS
基板 1000
显示区 1001
非显示区 1002
像素驱动电路 100
扫描信号生成电路 110
扫描线 111
数据信号生成电路 120
数据线 121
基板 100
显示区 1001
非显示区 1002
发光元件 OLED
T触发器 U1
D触发器 U2
复位回路 L1
阈值补偿回路 L2
数据写入回路 L3
发光回路 L4
预充电模块 10
导通信号生成模块 101
第一节点 G1
第二节点 G2
反相器 D1
驱动晶体管 M
第一开关管 T1
第二开关管 T2
第三开关管 T3
第四开关管 T4
第五开关管 T5
第六开关管 T6
第七开关管 T7
第一电容 C1
第二电容 C2
如下具体实施方式将结合上述附图进一步说明本申请。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有付出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
在本申请的描述中，需要说明的是，术语“上”、“下”、“左”、“右”等指示的方位或者位置关系为基于附图所示的方位或者位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。此外，术语“第一”、“第二”等仅用于描述目的，而不能理解为指示或暗示相对重要性。
请参阅图1，本申请提供一种显示面板1，所述显示面板1包括基板1000，所述基板1000包括显示区1001和非显示区1002。其中，所述显示区1001内设置阵列排布的若干个像素驱动电路100，每个像素驱动电路100构成一个像素单元。所述非显示区1002内设置扫描信号生成电路110(又称作栅极驱动器)。所述扫描信号生成电路110通过多条扫描线111与各行所述像素驱动电路100电连接，所述扫描信号生成电路110用于为每一行所述像素驱动电路100生成相应的若干个扫描信号。
在本申请实施例中，所述显示面板1还包括数据信号生成电路120(又称作源极驱动器)，所述数据信号生成电路120通过多条数据线121与各行所述像素驱动电路100电连接，所述数据信号生成电路120用于为每一列像素驱动电路生成相应的一个数据信号DATA，并将所述数据信号DATA输出给该列像素驱动电路中的各个像素驱动电路100。
具体地，请参阅图2，所述像素驱动电路100包括发光元件OLED。其中，所述像素驱动电路100用于驱动所述发光元件发光。在本申请实施例中，所述发光元件为OLED，所述发光元件的第一端、第二端一一对应于OLED的阴极、阳极。在其他实施例中，所述发光元件还可以是LED(Light-Emitting Diode，发光二极管)、也可以是MicroLED(Micro Light-Emitting Diode，微发光二极管)或MiniLED(Mini Light-Emitting Diode，次毫米发光二极管)。
下面结合图3、图4a-图4d来介绍所述像素驱动电路100的电路结构及其工作原理。
如图3所示，所述像素驱动电路100在一帧扫描周期内依次工作于复位阶段(t1阶段)、阈值补偿阶段(t2阶段)，数据写入阶段(t3阶段)以及发光阶段(t4阶段)。
如图4a所示，所述像素驱动电路100包括复位回路L1，所述复位回路L1包括依次串联的所述第三开关管T3、所述第四开关管T4、所述第一电容C1以及所述第五开关管T5。具体地，所述第三开关管T3的第一连接端用于在所述复位阶段接收复位电压V0，所述第三开关管T3的第二连接端与所述驱动晶体管M的第一连接端(即漏极)以及所述第四开关管T4的第一连接端分别电连接，所述第四开关管T4的第二连接端与所述驱动晶体管M的控制端(即栅极)以及所述第一电容C1的第一端电连接，所述第一电容C1的第二端与所述第五开关管T5的第一连接端电连接，所述第五开关管T5的第二连接端与参考电压端VSS电连接。在本申请实施例中，将所述驱动晶体管M的控制端和所述第一电容C1的第一端之间的连接节点标注为第一节点G1。所述参考电压端VSS用于输出参考电压VSS，在本申请实施例中，所述参考电压VSS的电位为低电平，例如为地电位。
进一步地，请参阅图4d，所述像素驱动电路100还包括发光回路L4，所述发光回路L4包括依次串联所述第三开关管T3、所述驱动晶体管M以及所述发光元件OLED。所述发光元件OLED的第一端与参考电压端VSS电连接，所述发光元件OLED的第二端与所述驱动晶体管M的第二连接端(即源极)电连接。
如图4a所示，在所述复位阶段，所述第三开关管T3基于其控制端接收到的第二扫描信号SCAN2而导通，所述第四开关管T4基于其控制端接收到的第三扫描信号SCAN3而导通，所述第五开关管T5基于其控制端接收到的所述第三扫描信号SCAN3而导通，从而使得所述复位回路L1导通，以接收复位电压V0对所述第一电容C1充电来提升所述第一电容C1的第一端的电压，从而通过所述第一电容C1将所述驱动晶体管M的控制端的电压复位至所述复位电压V0。此时，所述驱动晶体管M的栅极电压Vg＝V0，源极电压为Vs＝VOLED，因此，所述驱动晶体管M因其栅源极电压Vgs大于其阈值电压Vth1而导通。其中，所述驱动晶体管M、开关管T3～T5均为高电平导通晶体管，例如NMOS管，当然，在其他实施例中，上述各个晶体管也可以采用低电平导通晶体管，例如PMOS管。上述各个晶体管可以采用非晶硅薄膜晶体管(a-Si TFT)，或者采用低温多晶硅薄膜晶体管(LTPS TFT)，又或者采用氧化物半导体薄膜晶体管(Oxide TFT)。其中，氧化物半导体薄膜晶体管的有源层采用氧化物半导体(Oxide)，比如铟镓锌氧化物(Indium Gallium Zinc Oxide，IGZO)。所述第二扫描信号SCAN2、所述第三扫描信号SCAN3均为高电平信号。
在所述复位阶段中，由于所述第三开关管T3、所述驱动晶体管M导通，使得所述发光回路L4导通，因此，所述发光元件OLED会短暂发光。而该发光时长极短，肉眼是感受不到的。
需要说明的是，在实际产品中，各条扫描线长度较长，会产生电阻电容负载(RCloading)，因此，所述扫描信号生成电路110通过扫描线向所述像素驱动电路100由输出低电平信号切换至输出高电平信号时，需要先对扫描线进行充电，即扫描线上的电压需要经历一定的充电时长才能从低电平上升至高电平。同理，当所述扫描信号生成电路110通过扫描线向所述像素驱动电路100由输出高电平信号切换至输出低电平信号时，需要先对扫描线进行放电，即扫描线上的电压需要经历一定的放电时长才能从高电平下降至低电平。因此，所述像素驱动电路100接收到的扫描信号并不是理想的方波，而是如图3所示的梯形波。
在本申请实施例中，所述像素驱动电路100还包括第一开关管T1、第二电容C2以及预充电模块10，所述第一开关管T1并联电连接于所述发光元件OLED两端，所述第二电容C2的第一端与所述第一开关管T1的控制端电连接，所述第二电容C2的第二端与所述参考电压端VSS电连接。所述预充电模块10用于在复位阶段对C2进行预充电。具体地，所述预充电模块10用于在所述复位阶段的预设时间段接收充电电压VAA对所述第二电容C2进行充电，使得所述第二电容C2的第一端的电压上升至第一电压V1，其中，所述第一电压V1低于所述参考电压端的电压VSS与所述第一开关管T1的阈值电压Vth2之和，换言之，所述第一开关管T1的栅源极电压为(V1-VSS)(小于其阈值电压Vth2)，如此，所述第一开关管T1在所述复位阶段内均保持持续断开，防止显示面板1短路。其中，所述第一开关管T1为高电平导通晶体管，例如NMOS。
所述预充电模块10包括第二开关管T2和导通信号生成模块101。在本申请实施例中，将所述第二开关管T2的控制端和所述第二电容C2的第一端之间的连接节点标注为第二节点G2。
其中，所述第二开关管T2的第一连接端用于接收所述充电电压VAA，所述第二开关管T2的第二连接端与所述第一开关管T1的控制端电连接。所述导通信号生成模块101与所述第二开关管T2的控制端电连接，所述导通信号生成模块101用于在所述复位阶段的预设时间段生成导通信号，以导通所述第二开关管T2，从而使所述第二电容C2通过导通的所述第二开关管T2接收到所述充电电压VAA而充电，以将所述第二电容C2的第一端的电压充电至所述第一电压V1。
在本实施例中，所述t1阶段包括t11、t12以及t13三个阶段，所述导通信号生成模块101包括T触发器U1，所述T触发器U1的时钟信号端c1用于在所述复位阶段内的预设时间段接收第一时钟信号CP1，所述T触发器U1的输入端1T用于接收高电平电压，所述T触发器U1的输出端Q与所述第二开关管T2的控制端电连接。在本申请实施例中，所述T触发器U1的输入端1T通过电阻R与所述第三开关管T3的第一连接端电连接以接收高电平电压，所述第一时钟信号CP1的持续时长为两个预设时钟周期，即所述第一时钟信号CP1包括两个时钟周期的脉冲信号。所述电阻R为限流电阻，用于保护所述T触发器U1。示例性地，所述电阻R的电阻值在100Ω到1KΩ之间。
在t11阶段，所述T触发器U1的输入端1T接收到高电平电压，在没有脉冲信号输入的情况下，所述T触发器U1的输出端Q输出低电平，使得所述第二开关管T2断开。当所述第一时钟信号CP1的第一个脉冲信号到来时，所述T触发器U1进入t12阶段，并通过其输出端Q输出所述导通信号，从而使得所述第二开关管T2导通。当所述第一时钟信号CP1的第二个脉冲信号到来时，所述T触发器U1进入t13阶段，并停止输出所述导通信号，从而使得所述第二开关管T2断开。在t12阶段内，所述第二开关管T2导通并接入所述充电电压VAA对所述第二电容充电，使得所述第二电容C2的第一端的电压上升至第一电压V1。在t11、t13以及t2～t4阶段，所述第二开关管T2均保持断开。在本申请实施例中，所述第二开关管T2为高电平导通晶体管，所述导通信号为高电平信号。可以理解的是，可以通过调整所述充电电压VAA的电压值，和/或，所述第一时钟信号CP1的周期来实现在t12阶段将所述第二电容C2的第一端的电压充电至预设的第一电压V1。需要说明的是，在其他实施例中，所述t1阶段可以只包括t12阶段，也可以只包括t11阶段和t12阶段，还可以只包括t12阶段和t13阶段，此处不作限定。
如图4b所示，所述像素驱动电路100还包括阈值补偿回路L2，所述阈值补偿回路L2包括依次串联的所述第五开关管T5、所述第一电容C1、所述第四开关管T4、所述驱动晶体管M以及第一开关管T1。
在所述阈值补偿阶段，所述第四开关管T4基于其控制端接收到的所述第三扫描信号SCAN3而导通，所述第五开关管T5基于其控制端接收到的所述第三扫描信号SCAN3而导通。所述第二电容C2基于第一扫描信号SCAN1继续充电，使得所述第一开关管T1的控制端的电压从所述第一电压V1开始继续上升，当所述第一开关管T1的漏源极电压大于其阈值电压Vth2时(即所述第一开关管T1的控制端的电压高于(VSS+Vth2)时)进入导通状态，从而导通所述阈值补偿回路L2。所述第一电容C1通过导通的所述阈值补偿回路L2放电，使得所述驱动晶体管M的控制端(即第一节点G1)的电压从所述复位电压V0逐渐下降直至第二电压V2(此时所述驱动晶体管M的栅源极电压Vgs＝Vth1)，从而使得所述驱动晶体管M进入临界导通状态，如此，所述第一电容C1的第一端的电压保持在所述第二电压V2，从而实现了对所述驱动晶体管M的阈值电压的补偿。其中，所述第二电压V2低于或者等于所述复位电压V0，V2＝VSS+Vth1。在所述阈值补偿阶段，所述发光元件OLED被导通的所述第一开关管T1短路而不会发光。
本申请提供的像素驱动电路100，在所述复位阶段通过所述预充电模块10将所述第二电容C2的第一端的电压预充电至所述第一电压V1，因此，当所述第二电容C2在接收到所述第一扫描信号SCAN1时可以基于所述第一电压V1继续充电，而不需要从初始低电平(例如0V)开始充电，如此，t2阶段的时长可以缩短Δt，即每帧扫描周期可以缩短Δt，有利于实现高刷新率。
如图4c所示，所述像素驱动电路100还包括数据写入回路L3，所述数据写入回路L3包括串联电连接的第六开关管T6和所述第一电容C1。其中，所述第六开关管T6的第一连接端用于接收数据信号DATA，所述第六开关管T6的第二连接端与所述第一电容C1的第二端电连接，其中，所述数据信号DATA的电压为数据电压VDATA。
在所述数据写入阶段，开关管T1～T5均断开，所述第六开关管T6基于其控制端接收到的第四扫描信号SCAN4而导通，从而导通所述数据写入回路L3以将所述第一电容C1的第二端的电压上拉至所述数据电压VDATA。在所述数据写入阶段，所述第一电容C1的第二端的电压的变化量为(VDATA-VSS)，由于所述第一电容C1的耦合作用，所述第一电容C1的第一端的电压变化量应与所述第一电容C1的第二端的电压变化量相等，因此，所述第一电容C1的第一端的电压被上拉至第三电压V3，其中，V3＝(VDATA-VSS)+V2＝VDATA+Vth1。所述第四扫描信号SCAN4为高电平信号。
如图4d所示，在所述发光阶段，所述第三开关管T3基于其控制端接收到的所述第二扫描信号SCAN2而导通，并通过其第一连接端接收驱动电压VDD，从而使得所述发光回路L4导通以所述接收驱动电压VDD驱动所述发光元件OLED发光。在本实施例中，所述第三开关管T3在所述复位阶段接收到的所述复位电压V0以及在所述发光阶段接收到所述驱动电压VDD相等，在另一实施例中，所述复位电压V0也可以小于所述驱动电压VDD。
具体地，对于所述驱动晶体管M而言，在所述发光阶段中，所述驱动晶体管M的栅极电压Vg＝V3＝VDATA+Vth1，源极电压Vs＝VSS+VOLED，此时，其栅源极电压Vgs＝Vg-Vs＝VDATA+Vth1-VSS-VOLED>Vth1，因此，所述驱动晶体管M导通。
另外，在本申请实施例中，在所述发光阶段中，由于所述第三开关管T3工作在线性区，而所述驱动晶体管M工作在饱和区，因此流过所述发光元件OLED的电流的大小主要取决于所述驱动晶体管M的源极与漏极之间的电流Ids。根据晶体管的工作特性，可知电流Ids与栅源极电压Vgs存在如下关系：
Ids＝(K/2)(Vgs-Vth1)2＝(K/2)(VDATA-VSS-VOLED)2
其中，K＝Cox×μ×W/L，Cox为单位面积栅极电容；μ为沟道电子运动的迁移率；W/L为所述驱动晶体管M的沟道的宽长比。
由上述公式可知，所述阈值补偿回路L3可以在所述阈值补偿阶段将所述驱动晶体管M的控制端的电压补偿至所述第二电压V2，从而使得流过所述发光元件OLED的电流Ids与所述驱动晶体管M的阈值电压Vth1无关，因此，不仅可以提高电流Ids，提高所述发光元件OLED的发光亮度，还可以消除由于不同驱动电路之间所述驱动晶体管M的阈值电压Vth1不同引起的显示亮度不均的现象。
请一并参阅图5-图6，图5是本申请实施例提供的第二种像素驱动电路100的结构示意图，图6是图5所示的像素驱动电路100的工作时序图。图5所示的像素驱动电路100与图3所示的像素驱动电路100电路结构相近，不同之处在于：图5所示的所述导通信号生成模块101包括D触发器U2和反相器D1。相较于T触发器U1，D触发器U2需要接受三个时钟周期的脉冲信号，但是，D触发器U2的电路结构更加简单。在其他实施例中，所述导通信号生成模块101还可以采用JK触发器，此处不作限定。
具体地，所述D触发器U2的时钟信号端c1用于在所述复位阶段内的预设时间段接收第二时钟信号CP2，所述D触发器U2的输出端Q与所述第二开关管T2的控制端电连接，所述反相器D1的输入端与所述D触发器U2的输出端Q电连接，所述反相器D1的输出端与所述D触发器U2的输入端D电连接。在本申请实施例中，所述第二时钟信号CP2的持续时长为三个预设时钟周期，即所述第二时钟信号CP1包括三个时钟周期的脉冲信号。
在t11阶段，所述D触发器U2在接收到所述第二时钟信号CP2之前，其输出端Q不输出信号，所述第二开关管T2断开。当所述第二时钟信号CP2的第一个脉冲信号的上升沿到来时，所述D触发器U2基于其输入端D的低电平，通过其输出端Q输出低电平信号，使得所述第二开关管T2继续保持断开。同时，所述反相器D1对所述低电平信号进行反相得到高电平信号并输出给所述D触发器U2的输入端D。
当所述第二时钟信号CP2的第二个脉冲信号的上升沿到来时，所述D触发器U2进入t12阶段，并基于其输入端D的高电平通过其输出端Q输出所述导通信号，使得所述第二开关管T2导通。同时，所述反相器D1对所述导通信号进行反相得到低电平信号并输出给所述D触发器U2的输入端D。
当所述第二时钟信号CP2的第三个脉冲信号的上升沿到来时，所述D触发器U2进入t13阶段，并基于其输入端D的低电平通过其输出端Q输出低电平信号，使得所述第二开关管T2断开。
请一并参阅图7-图8，图7是本申请实施例提供的第三种像素驱动电路100的结构示意图，图8是图7所示的像素驱动电路100的工作时序图。图7所示的像素驱动电路100与图3所示的像素驱动电路100电路结构相近，不同之处在于：所述发光回路L4还包括串联电连接于所述驱动晶体管M和所述发光元件OLED之间的第七开关管T7。
具体地，所述第七开管T7和所述发光元件OLED串联而成的电路与所述第一开关管T1并联电连接，即所述第七开管T7的第一连接端与所述驱动晶体管M的第二连接端电连接，所述第七开管T7的第二连接端与发光元件OLED的阳极电连接。
在所述复位阶段，所述第七开关管T7断开，从而使得所述发光回路L4断开。如此，可以避免所述发光元件OLED在所述复位阶段发光，能够提升显示面板1的显示效果。
在所述发光阶段，所述第七开关管T7基于其控制端接收到的第五扫描信号SCAN5而导通，从而使得所述发光回路L4导通。其中，所述第五扫描信号SCAN5为高电平信号。
尽管已经示出和描述了本申请的实施例，本领域的普通技术人员可以理解：在不脱离本申请的原理和宗旨的情况下可以对这些实施例进行多种变化、修改、替换和变型，本申请的范围由权利要求及其等同物限定。

Claims (10)

1.一种像素驱动电路，其特征在于，包括：
发光元件，所述发光元件的第一端与参考电压端电连接，所述像素驱动电路用于驱动所述发光元件发光；
驱动晶体管，与所述发光元件的第二端电连接；
复位回路；
第一电容，串联于所述复位回路中，且所述第一电容的第一端与所述驱动晶体管的控制端电连接；其中，所述复位回路在复位阶段导通，以接收复位电压对所述第一电容充电来提升所述第一电容的第一端的电压，从而通过所述第一电容将所述驱动晶体管的控制端的电压复位至所述复位电压；
第一开关管，并联在所述发光元件的两端；
第二电容，所述第二电容的第一端与所述第一开关管的控制端电连接；
预充电模块，与所述第二电容的第一端电连接，所述预充电模块用于在所述复位阶段对所述第二电容进行充电，使得所述第二电容的第一端的电压上升至第一电压，其中，所述第一电压低于所述参考电压端的电压与所述第一开关管的阈值电压之和；以及
阈值补偿回路，包括串联电连接的所述第一电容、所述驱动晶体管以及所述第一开关管，其中，所述第二电容在阈值补偿阶段基于第一扫描信号继续充电，使得所述第一开关管的控制端的电压从所述第一电压开始继续上升，以导通所述第一开关管，从而导通所述阈值补偿回路；所述第一电容通过导通的所述阈值补偿回路放电，使得所述驱动晶体管的控制端的电压从所述复位电压下降至第二电压，所述驱动晶体管在其控制端的电压等于所述第二电压时进入临界导通状态，所述第二电压低于或者等于所述复位电压。
2.如权利要求1所述的像素驱动电路，其特征在于，所述预充电模块包括：
第二开关管，所述第二开关管的第一连接端用于接收充电电压，所述第二开关管的第二连接端与所述第一开关管的控制端电连接；以及
导通信号生成模块，与所述第二开关管的控制端电连接，所述导通信号生成模块用于在所述复位阶段内的预设时间段生成导通信号，以导通所述第二开关管，从而使所述第二电容通过导通的所述第二开关管接收到所述充电电压而充电，以将所述第二电容的第一端的电压充电至所述第一电压。
3.如权利要求2所述的像素驱动电路，其特征在于，所述导通信号生成模块包括T触发器，所述T触发器的时钟信号端用于在所述复位阶段内的预设时间段接收第一时钟信号，所述T触发器的输入端用于接收高电平电压，所述T触发器的输出端与所述第二开关管的控制端电连接，其中，所述第一时钟信号的持续时长为两个预设时钟周期；
所述T触发器响应于所述第一时钟信号，在所述复位阶段内的预设时间段生成并输出所述导通信号。
4.如权利要求2所述的像素驱动电路，其特征在于，所述导通信号生成模块包括：
D触发器，所述D触发器的时钟信号端用于在所述复位阶段内的预设时间段接收第二时钟信号，所述D触发器的输出端与所述第二开关管的控制端电连接，其中，所述第二时钟信号的持续时长为三个预设时钟周期；以及
反相器，所述反相器的输入端与所述D触发器的输出端电连接，所述反相器的输出端与所述D触发器的输入端电连接；
所述D触发器响应于所述第二时钟信号，在所述复位阶段内的预设时间段生成并输出所述导通信号。
5.如权利要求1-4任意一项所述的像素驱动电路，其特征在于，所述复位回路还包括串联的第三开关管、第四开关管以及第五开关管，其中：
所述第三开关管的第一连接端用于在所述复位阶段接收所述复位电压，所述第三开关管的第二连接端与所述驱动晶体管电连接；
所述第四开关管电连接于所述第三开关管的第二连接端和所述驱动晶体管的控制端之间；
所述第五开关管电连接于所述第一电容的第二端和所述参考电压端之间；
在所述复位阶段，所述第三开关管基于其控制端接收到的第二扫描信号而导通，所述第四开关管基于其控制端接收到的第三扫描信号而导通，所述第五开关管基于其控制端接收到的所述第三扫描信号而导通，从而使得所述复位回路导通。
6.如权利要求5所述的像素驱动电路，其特征在于，所述阈值补偿回路还包括所述第四开关管和所述第五开关管；
在所述阈值补偿阶段，所述第四开关管基于其控制端接收到的所述第三扫描信号而导通，所述第五开关管基于其控制端接收到的所述第三扫描信号而导通，从而使得所述阈值补偿回路导通。
7.如权利要求6所述的像素驱动电路，其特征在于，所述像素驱动电路还包括数据写入回路，所述数据写入回路包括串联电连接的第六开关管和所述第一电容；其中，所述第六开关管的第一连接端用于接收数据电压，所述第六开关管的第二连接端与所述第一电容的第二端电连接；
在数据写入阶段，所述第五开关管断开，所述第六开关管基于其控制端接收到的第四扫描信号而导通，从而导通所述数据写入回路以将所述第一电容的第二端的电压上拉至所述数据电压。
8.如权利要求7所述的像素驱动电路，其特征在于，所述像素驱动电路还包括发光回路，所述发光回路包括依次串联的所述第三开关管、所述驱动晶体管以及所述发光元件；
在发光阶段，所述第三开关管基于其控制端接收到的所述第二扫描信号而导通，从而使得所述发光回路导通以接收驱动电压驱动所述发光元件发光。
9.如权利要求8所述的像素驱动电路，其特征在于，所述发光回路还包括串联电连接于所述驱动晶体管和所述发光元件之间的第七开关管，所述第七开关管和所述发光元件串联而成的电路与所述第一开关管并联电连接；
在所述复位阶段，所述第七开关管断开，从而使得所述发光回路断开；
在所述发光阶段，所述第七开关管基于其控制端接收到的第五扫描信号而导通，从而使得所述发光回路导通。
10.一种显示面板，其特征在于，包括基板和若干个如权利要求1至9任意一项所述的像素驱动电路，所述基板包括显示区，所述若干个像素驱动电路阵列排布在所述基板的显示区内。
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