CN114582265B - 显示面板及显示装置 - Google Patents

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Abstract

本申请公开了一种显示面板及显示装置，显示面板包括子像素、移位寄存器和像素驱动电路。子像素包括位于第一显示区的第一子像素和位于第二显示区的第二子像素，第一子像素用于实现第一显示区的显示，第二子像素用于实现第二像素的显示。移位寄存器用于向扫描线提供控制信号，从通过控制第一电路使第一子像素发光。像素驱动电路包括第一电路、第二电路和虚拟区域，第一电路用于驱动第一子像素，第二电路用于驱动第二子像素。第一子像素位于第一显示区，使得显示面板的边框区域可以发光显示，从而减小显示面板的边框，实现显示装置的窄边框设计。

Description

显示面板及显示装置
技术领域
本申请涉及显示领域，具体涉及一种显示面板及显示装置。
背景技术
随着电子设备的快速发展，用户对屏占比的要求越来越高，使得电子设备的全面屏显示受到业界越来越多的关注。
目前的电子设备，例如手机、平板电脑等移动终端，其显示屏幕周边具有黑边，即边框的尺寸大，从电子设备的正面看，透明面板的显示区域的占比小，其黑边(窄边)宽度较大，不便于用户的使用。目前的窄边框技术，需要尽量压缩封装区域的宽度和电路的尺寸，从而对封装的可靠性、抗跌能力、电路的驱动能力都造成了不利的影响，边框变窄愈加困难。
发明内容
本申请实施例提供一种显示面板及显示装置，目的在于如何减小显示面板的边框，并实现显示面板的窄边框设计。
本申请第一方面的实施例提供一种显示面板，显示面板具有第一显示区和第二显示区，显示面板包括：子像素，包括位于第一显示区的第一子像素和位于第二显示区的第二子像素；移位寄存器，位于第一显示区；像素驱动电路，位于第二显示区，像素驱动电路包括第一电路、第二电路和虚拟区域，第一电路用于驱动第一子像素，第二电路用于驱动第二子像素，其中，a个相邻的第二子像素形成像素块，第一电路和a个第二电路形成第一电路块，第一电路块内的a个第二电路用于驱动同一像素块内的a个第二子像素，虚拟区域和a个第二电路形成第二电路块，第二电路块内的a个第二电路用于驱动同一像素块内的a个第二子像素，a为大于1的整数，第一电路块内第一电路和第二电路的相对位置关系与第二电路块内虚拟区域和第二电路的相对位置关系相同。
根据本申请第一方面的实施方式，沿显示面板的厚度方向，第一电路的正投影尺寸和虚拟区域的尺寸相同。
根据本申请第一方面前述任一实施方式，第二电路块的个数为多个，各第二电路块与被其驱动的像素块的相对位置相同。
根据本申请第一方面前述任一实施方式，第一电路块内第一电路的数量和第二电路块内虚拟区域的数量相同。
根据本申请第一方面前述任一实施方式，沿显示面板的厚度方向，第一电路块的正投影尺寸和第二电路块的正投影尺寸相同。
根据本申请第一方面前述任一实施方式，虚拟区域内设置有虚拟电路，虚拟电路的结构与第一电路的结构相同。
根据本申请第一方面的实施方式，显示面板还包括第三显示区，第二显示区环绕至少部分第三显示区设置；子像素还包括位于第三显示区的第三子像素；像素驱动电路还包括用于驱动第三子像素的第三电路，其中，第三电路和a个第二电路形成第三电路块，第三电路块内的a个第二电路用于驱动同一像素块内的a个第二子像素，a为大于1的整数，各第三电路块与被其驱动的像素块的相对位置相同。
根据本申请第一方面前述任一实施方式，沿厚度方向，第一电路的正投影尺寸和第三电路的正投影尺寸相同。
根据本申请第一方面前述任一实施方式，第一电路块内第一电路的数量和第三电路块内第三电路的数量相同。
根据本申请第一方面前述任一实施方式，沿厚度方向，第一电路块的正投影尺寸和第三电路块的正投影尺寸相同。
根据本申请第一方面前述任一实施方式，第一电路块内第一电路和第二电路的相对位置关系与第三电路块内第三电路和第二电路的相对位置关系相同。
根据本申请第一方面前述任一实施方式，显示面板还包括连接线，连接线包括用于连接第一子像素和第一电路第一连接线和用于连接第三子像素和第三电路的第三连接线，至少部分第一连接线和第三连接线位于同一膜层。
根据本申请第一方面前述任一实施方式，显示面板还包括：信号线层，包括信号线，至少部分连接线位于信号线层，信号线包括数据线、扫描线、电源线、电压参考线和接地线中的至少一者。
根据本申请第一方面前述任一实施方式，至少部分连接线沿显示面板的厚度方向的正投影和像素驱动电路沿显示面板的厚度方向的正投影错位设置。
根据本申请第一方面前述任一实施方式，至少部分第一连接线沿第一方向延伸成型，且沿第一方向延伸成型的部分第一连接线位于其对应的第一电路块在第二方向的一侧，和/或，至少部分第三连接线沿第一方向延伸成型，且沿第一方向延伸成型的部分第三连接线位于其对应的第三电路块在第二方向的一侧，第一方向和第二方向相交。
根据本申请第一方面前述任一实施方式，第一连接线包括位于第一显示区的第一分段和位于第二显示区的第二分段，第二分段位于信号线层。
根据本申请第一方面前述任一实施方式，第一分段和第二分段位于不同的膜层。
根据本申请第一方面前述任一实施方式，第三连接线包括位于第三显示区的第三分段和位于第二显示区的第四分段位于信号线层。
根据本申请第一方面前述任一实施方式，第四分段和第三分段位于不同的膜层。
根据本申请第一方面前述任一实施方式，第一分段和第三分段位于相同的膜层。
根据本申请第一方面前述任一实施方式，相同颜色的子像素连接的连接线使用相同的材料制备成型。
根据本申请第一方面前述任一实施方式，第一电路块的个数为多个，且各第一电路块与被其驱动的像素块的相对位置相同。
根据本申请第一方面前述任一实施方式，第二显示区包括主显示区、第一过渡区和第二过渡区，第一过渡区位于主显示区和第一显示区之间，第二过渡区位于主显示区和第三显示区之间，第一电路位于第一过渡区，第三电路位于第二过渡区，虚拟区域位于主显示区。
根据本申请第一方面前述任一实施方式，第一子像素、第二子像素和第三子像素成行成列排布，第一电路、第二电路和第三电路成行成列排布，其中，至少部分第一电路和第二电路同行设置，且同行设置的第一电路和第二电路用于驱动同行的第一子像素和第二子像素；和/或，至少部分第三电路和第二电路同行设置，且同行设置的第三电路和第二电路用于驱动同行的第一子像素和第二子像素。
本申请第二方面的实施例提供一种显示装置，其包括上述任一第一方面实施例的显示面板。
在本申请第一方面实施例提供的显示面板中，显示面板包括子像素、移位寄存器和像素驱动电路。子像素包括第一子像素和第二子像素，第一子像素和移位寄存器均位于第一显示区，第一子像素用于实现第一显示区的显示，即移位寄存器所在的区域能够实现显示，因此能够减小显示面板的非显示区的面积，实现显示面板的窄边框设计。像素驱动电路包括第一电路和第二电路，第一电路用于驱动第一子像素，第二电路用于驱动第二子像素。第一电路和第二电路均位于第二显示区，第一电路位于第二显示区，即用于驱动移位寄存器所在区域的第一子像素的像素驱动电路位于第二显示区，第一电路能够为移位寄存器让位。第一电路块内第一电路和第二电路的相对位置关系与第二电路块内虚拟区域和第二电路的相对位置关系相同，能够保证第二显示区显示的均一性，改善将第一电路设置于第二显示区而对第二显示区显示效果的影响。
附图说明
通过阅读以下参照附图对非限制性实施例所作的详细描述，本申请的其它特征、目的和优点将会变得更明显，其中，相同或相似的附图标记表示相同或相似的特征，附图并未按照实际的比例绘制。
图1是本申请第一方面实施例提供的一种显示面板的俯视示意图；
图2是图1中Q区域的子像素101排布结构的局部放大示意图；
图3是图1中Q区域部分像素驱动电路的局部放大示意图；
图4是图1中Q’区域的子像素101排布结构的局部放大示意图；
图5是图1中Q’区域部分像素驱动电路的局部放大示意图；
图6是图2中B-B处的剖视图；
图7是图4中C-C处的剖视图；
图8是图3的局部放大结构示意图；
图9是图5的局部放大结构示意图；
图10是本申请实施例提供的一种显示装置的结构示意图；
图11是图10中D-D处的剖视图。
附图标记说明：
100、显示面板；200、感光组件；
11、衬底；12、阵列基板层；13、像素定义层；K1、第一像素开口；K2、第二像素开口；14、支撑柱；
101、子像素；100a、像素块；110、第一子像素；111、第一电极；112、第二电极；113、第一发光结构；120、第二子像素；121、第三电极；122、第四电极；123、第二发光结构；130、第三子像素；131、第五电极；132、第六电极；133、第三发光结构；
102、像素驱动电路；200a、第一电路块；200b、第二电路块；200c、第三电路块；210、第一电路；220、第二电路；230、第三电路；240、虚拟区域；
103、连接线；310、第一连接线；311、第一分段；312、第二分段；320、第二连接线；330、第三连接线；331、第三分段；332、第四分段；
104、第一信号线层；410、信号线；
105、移位寄存器；
AA1、第一显示区；AA2、第二显示区；AA3、第三显示区；NA、非显示区；
M、第一对称轴线；
X、第一方向；Y、第二方向；Z、厚度方向。
具体施方式
下面将详细描述本申请的各个方面的特征和示例性实施例，为了使本申请的目的、技术方案及优点更加清楚明白，以下结合附图及具体实施例，对本申请进行进一步详细描述。应理解，此处所描述的具体实施例仅被配置为解释本申请，并不被配置为限定本申请。对于本领域技术人员来说，本申请可以在不需要这些具体细节中的一些细节的情况下实施。下面对实施例的描述仅仅是为了通过示出本申请的示例来提供对本申请更好的理解。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括……”限定的要素，并不排除在包括要素的过程、方法、物品或者设备中还存在另外的相同要素。
应当理解，在描述部件的结构时，当将一层、一个区域称为位于另一层、另一个区域“上面”或“上方”时，可以指直接位于另一层、另一个区域上面，或者在其与另一层、另一个区域之间还包含其它的层或区域。并且，如果将部件翻转，该一层、一个区域将位于另一层、另一个区域“下面”或“下方”。
在诸如手机和平板电脑等电子设备上，需要在显示面板的一侧集成诸如前置摄像头、红外光传感器、接近光传感器等感光组件。在一些实施例中，可以在上述电子设备上设置透光显示区，将感光组件设置在透光显示区背面，在保证感光组件正常工作的情况下，实现电子设备的全面屏显示。
目前的窄边框技术，需要尽量压缩封装区域的宽度和电路的尺寸，从而对封装的可靠性、抗跌能力、电路的驱动能力都造成了不利的影响。
为解决上述问题，本申请实施例提供了一种显示面板及显示装置，以下将结合附图对显示面板及显示装置的各实施例进行说明。
本申请实施例提供一种显示面板，该显示面板可以是有机发光二极管(OrganicLight Emitting Diode，OLED)显示面板。
图1示出本申请第一方面实施例提供的一种显示面板的俯视示意图。
如图1所示，显示面板100具有第一显示区AA1和第二显示区AA2。可选的，第一显示区AA1为环状，第一显示区AA1环绕至少部分第二显示区AA2设置。第一显示区AA1即为显示面板100边框显示区。
可选的，显示面板100还包括第三显示区AA3。第二显示区AA2环绕至少部分第三显示区AA3设置。可选的，显示面板100还包括围绕第一显示区AA1、第二显示区AA2、第三显示区AA3的非显示区NA。可选的，第三显示区AA3的透光率大于第二显示区AA2的透光率。
本文中，优选第三显示区AA3的透光率大于或等于15％。为确保第三显示区AA3的透光率大于15％，甚至大于40％，甚至具有更高的透光率，本实施例中显示面板100的部分功能膜层的透光率均大于80％，甚至至少部分功能膜层的透光率均大于90％。
根据本申请实施例的显示面板100，第三显示区AA3的透光率大于第二显示区AA2的透光率，使得显示面板100在第一显示区AA1的背面可以集成感光组件200，实现例如摄像头的感光组件200的屏下集成，同时第三显示区AA3能够显示画面，提高显示面板100的显示面积，实现显示装置的全面屏设计。
第三显示区AA3的个数设置方式有多种，例如第三显示区AA3和第二显示区AA2的个数均为1个，用于实现感光组件200的屏下集成或者用于实现指纹识别。或者，在另一些可选的实施例中，第三显示区AA3的个数为两个，其中一第三显示区AA3用于实现感光组件200的屏下集成，另一第三显示区AA3用于实现指纹识别。
请一并参阅图1至图3，图2是图1中Q区域的子像素排布结构的局部放大示意图。图3是图1中Q区域部分像素驱动电路的局部放大示意图。
如图1至图3所示，本申请实施例提供的显示面板100包括子像素101、移位寄存器105和像素驱动电路102，子像素101包括位于第一显示区AA1的第一子像素110和位于第二显示区AA2的第二子像素120；像素驱动电路102位于第二显示区AA2，像素驱动电路102包括第一电路210、第二电路220和虚拟区域240，第一电路210用于驱动第一子像素110，第二电路220用于驱动第二子像素120。a个相邻的第二子像素120形成像素块100a，第一电路210和a个第二电路220形成第一电路块200a，第一电路块200a内的a个第二电路220用于驱动同一像素块100a内的a个第二子像素220，虚拟区域240和a个第二电路220形成第二电路块200b，第二电路块200b内的a个第二电路220用于驱动同一像素块100a内的a个第二子像素120，a为大于1的整数，第一电路块200a内第一电路210和第二电路220的相对位置关系与第二电路块200b内虚拟区域240和第二电路220的相对位置关系相同。
为了更好的展示第一电路210和第一子像素110的连接关系，图3中保留了第一显示区AA1的第一子像素110。且图3中仅展示了Q区域的部分像素驱动电路102。
图3中以点划线框示意出了第一电路块200a，位于同一点划线框内的第一电路210和第二电路220属于同一第一电路块200a，虚线框并不构成对本申请显示面板100结构上的限定。图3中以虚线框示意出了第二电路块200b，位于同一虚线框200b内的虚拟区域240和第二电路220属于同一第二电路块200b，虚线框并不构成对本申请显示面板100结构上的限定。
在本申请第一方面实施例提供的显示面板100中，显示面板100包括子像素101、像素驱动电路102和连接线103。子像素101包括第一子像素110和第二子像素120，第一子像素110和移位寄存器105均位于第一显示区AA1。像素驱动电路102包括位于第二显示区AA2的第一电路210和第二电路220，第一电路210用于驱动第一子像素110，第二电路220用于驱动第二子像素120。移位寄存器105位于第一显示区AA1，第一电路210和第二电路220均位于第二显示区AA2，即用于驱动移位寄存器105在所在区域的第一子像素110的像素驱动电路102位于第二显示区AA2，第一电路210设置在第一显示区AA1能够为移位寄存器105让位，从而减小边框宽度。
可选的，通过增加虚拟区域240，且使得第一电路块200a内第一电路210和第二电路220的相对位置关系与第二电路块200b内虚拟区域240和第二电路220的相对位置关系相同，能够进一步简化像素驱动电路102的布局和制备，且能够进一步改善第二显示区AA2显示的均一性。
第一电路210和a个第二电路220形成第一电路块200a，第一电路块内的a个第二电路220用于驱动同一像素块内的a个第二子像素，第一电路210用于驱动第一子像素110。多个第一电路块200a在列方向上呈阵列排布，其中多个第一电路210不共线。这样第一电路210在第一电路块200a内的相对位置不固定，这样可以提供更为优异的显示均一性效果。
可选的，设置虚拟区域240是为了使得第二电路块200b的布置与第一电路块200a以及第三电路块200c的布置尽量保持一致，改善显示差异，能够进一步改善第二显示区AA2显示的均一性。
可选的，第二电路块200b的个数为多个，各第二电路块200b与被其驱动的像素块100a的相对位置相同，以简化像素驱动电路102的布局和制备，能够改善第二显示区AA2显示的均一性。
被第二电路块200b驱动的像素块100a即被第二电路块200b内a个第二电路220驱动的a个相邻的第二子像素120所在的像素块100a。
各第二电路块200b与被该第二电路块200b驱动的像素块100a的相对位置相同是指：例如，显示面板100包括多个第二电路块200b，每个第二电路块200b与被其驱动的像素块100a在厚度方向上错位，各第二电路块200b与被该第二电路块200b驱动的像素块100a的错位尺寸和错位方向相同。
各第二电路块200b与被该第二电路块200b驱动的像素块100a的相对位置相同并不是指各第二电路块200b与被该第二电路块200b驱动的像素块100a的相对位置严格相同，在制造工艺误差范围只要各第二电路块200b与被该第二电路块200b驱动的像素块100a的相对位置大致相同，使得能够直接将第二电路块200b所在的阵列基板与第二子像素120所在的发光板整体对位连接实现各第二电路220能够驱动各第二子像素120即可。
可选的，沿显示面板的厚度方向Z，第一电路210的正投影尺寸和虚拟区域240的尺寸相同，能够进一步改善第二显示区AA2显示的均一性。例如第一电路210可以是2T1C电路、7T1C电路、7T2C电路、或9T1C电路中的任一种。本文中，“2T1C电路”指像素电路中包括2个薄膜晶体管(T)和1个电容(C)的像素电路，其它“7T1C电路”、“7T2C电路”、“9T1C电路”等依次类推。那么第一电路210沿厚度方向Z的正投影为第一电路210包括的薄膜晶体管和电容在厚度方向上的正投影面积之和。
可选的，显示面板10包括沿第一方向X延伸的第一导线和沿第二方向Y延伸的第二导线。第一导线例如为扫描线、发光控制信号线、电压参考线等。第二导线例如为数据信号线、电源线等。
假设两个第一电路210沿第二方向Y相邻设置，那么在沿第二方向Y上相邻的两个第一电路210中，上一第一电路210连接的第一导线至下一第一电路210连接的第一导线的距离可以为第一电路210在第二方向Y上的尺寸L。例如上一第一电路210连接的第一导线在第二方向Y上的中心至下一第一电路210连接的第一导线在第二方向Y上的中心的距离可以为第一电路210在第二方向Y上的尺寸L。
假设两个第一电路210沿第一方向X相邻设置，在沿第一方向X上相邻的两个第一电路210中，前一第一电路210连接的第二导线至后一第一电路210连接的第二导线之间的距离可以为第一电路210在第一方向X上的尺寸H。例如前一第一电路210连接的第二导线在第一方向X上的中心至后一第一电路210连接的第二导线在第一方向X上的中心之间的距离为第一电路210在第一方向X上的尺寸H。
当第一电路210和第二电路220沿第二方向Y相邻设置，且第一电路210位于第一电路210连接的第一导线和第二电路220连接的第一导线之间时，那么在沿第二方向Y上相邻的第一电路210和第二电路220中，第一电路210连接的第一导线在第二方向Y上的中心至第二电路220连接的第一导线在第二方向Y上的中心之间的距离可以为第一电路210在第二方向Y上的尺寸L。
当第一电路210和第二电路220沿第一方向X相邻设置，且第一电路210位于第一电路210连接的第二导线和第二电路220连接的第二导线之间时，在沿第一方向X上相邻的第一电路210和第二电路220中，第一电路210连接的第二导线至第二电路220连接的第二导线之间的距离可以为第一电路210在第一方向X上的尺寸H。
沿显示面板的厚度方向Z，第一电路210的正投影尺寸可以为H×L。
可选的，虚拟区域240的尺寸为H×L。
可选的，第一电路块200a内第一电路210的数量和第二电路块200b内虚拟区域240的数量相同，使得虚拟区域240和第一电路210所在区域的显示效果相同，能够进一步改善第二显示区AA2显示的均一性.
可选的，沿显示面板的厚度方向Z，第一电路块200a的正投影尺寸和第二电路块200b的正投影尺寸相同，那么第一电路块200a和第二电路块200b中的a个第二电路220的尺寸相同，能够进一步改善第二显示区AA2显示的均一性。
第一电路块200a的正投影尺寸为第一电路块200a内第一电路210和a个第二电路220的正投影尺寸之和。第二电路块200b的正投影尺寸为第二电路块200b内虚拟区域240和a个第二电路220的正投影尺寸之和。
当第一电路210和第二电路220沿第二方向Y相邻设置，且第二电路210位于第一电路210连接的第一导线和第二电路220连接的第一导线之间时，那么在沿第二方向Y上相邻的第一电路210和第二电路220中，第一电路210连接的第一导线在第二方向Y上的中心至第二电路220连接的第一导线在第二方向Y上的中心之间的距离可以为第二电路210在第二方向Y上的尺寸L’。
当第一电路210和第二电路220沿第一方向X相邻设置，且第二电路210位于第一电路210连接的第二导线和第二电路220连接的第二导线之间时，在沿第一方向X上相邻的第一电路210和第二电路220中，第一电路210连接的第二导线至第二电路220连接的第二导线之间的距离可以为第二电路210在第一方向X上的尺寸H’。
沿显示面板的厚度方向Z，第二电路220的正投影尺寸为L’×H’。
可选的，虚拟区域240内设置有虚拟电路，虚拟电路的结构与第一电路210的结构相同，使得虚拟区域240和第一电路210所在区域的显示效果相同，能够进一步改善第二显示区AA2显示的均一性。
可选的，第一电路块200a的个数为多个，各第一电路块200a与被该第一电路块200a驱动的像素块100a的相对位置相同。被第一电路块200a驱动的像素块100a即被第一电路块200a内a个第二电路220驱动的a个相邻的第二子像素120所在的像素块100a。
各第一电路块200a与被该第一电路块200a驱动的像素块100a的相对位置相同是指：例如，显示面板100包括多个第一电路块200a，每个第一电路块200a与被其驱动的像素块100a在厚度方向上错位，各第一电路块200a与被该第一电路块200a驱动的像素块100a的错位尺寸和错位方向相同。
各第一电路块200a与被该第一电路块200a驱动的像素块100a的相对位置相同并不是指各第一电路块200a与被该第一电路块200a驱动的像素块100a的相对位置严格相同，在制造工艺误差范围只要各第一电路块200a与被该第一电路块200a驱动的像素块100a的相对位置大致相同，使得能够直接将第一电路块200a所在的阵列基板与第二子像素120所在的发光板整体对位连接实现各第二电路220能够驱动各第二子像素120即可。
在这些可选的实施例中，各第一电路块200a与被其驱动的像素块100a的相对位置相同，以简化像素驱动电路102的布局和制备，能够改善第二显示区AA2显示的均一性，减少由于第一电路210设置于第二显示区AA2而对第二电路220和第二子像素120之间连接的影响。
请一并参阅图1、图4和图5，图4是图1中Q’区域的子像素排布结构的局部放大示意图。图5是图1中Q’区域部分像素驱动电路的局部放大示意图。
在一些可选的实施例中，如图1、图5和图6所示，显示面板100还包括第三显示区AA3，第二显示区AA2环绕至少部分第三显示区AA3设置；子像素101还包括位于第三显示区AA3的第三子像素130；像素驱动电路102还包括用于驱动第三子像素130的第三电路230。用于驱动第三显示区AA3子像素101的像素驱动电路102位于第二显示区AA2，能够提高第三显示区AA3的透光率，使得感光组件200能够透过第三显示区AA3获取光线信息，有利于感光组件200的屏下组成。
第三电路230和a个第二电路220形成第三电路块200c，第三电路块200c内的a个第二电路220用于驱动同一像素块100a内的a个第二子像素120，a为大于1的整数，各第三电路块200c与被其驱动的像素块100a的相对位置相同，以简化像素驱动电路102的布局和制备，能够改善第二显示区AA2显示的均一性。
被第三电路块200c驱动的像素块100a即被第三电路块200c内a个第二电路220驱动的a个相邻的第二子像素120所在的像素块100a。
为了更好的展示第三电路230和第三子像素130的连接关系，图5中保留了第三显示区AA3的第三子像素130。且图5中仅展示了Q’区域的部分像素驱动电路102。
图5中以虚线框示意出了第三电路块200c，位于同一虚线框内的第三电路230和第二电路220属于同一第三电路块200c，虚线框并不构成对本申请显示面板100结构上的限定。
可选的，沿显示面板的厚度方向Z，第一电路210的正投影尺寸和第三电路230的正投影尺寸相同，能够进一步改善第二显示区AA2显示的均一性。第三电路230的尺寸定义与第一电路210尺寸的定义相同，此处不再赘述。
可选的，第一电路块200a内第一电路210的数量和第三电路块200c内第三电路230的数量相同，使得第一电路210和第三电路230所在区域的显示效果更加接近，能够进一步改善第二显示区AA2显示的均一性。
可选的，沿显示面板的厚度方向Z，第一电路块200a的正投影尺寸和第三电路块200c的正投影尺寸相同，那么第一电路块200a和第三电路块200c中的a个第二电路220的尺寸相同，能够进一步改善第二显示区AA2显示的均一性。
可选的，第一电路块200a内第一电路210和第二电路220的相对位置关系与第三电路块200c内第三电路230和第二电路220的相对位置关系相同，进一步简化像素驱动电路102的布局和制备，能够进一步改善第二显示区AA2显示的均一性。
在一些可选的实施例中，如图3和图5所示，显示面板100还包括连接线103，连接线103包括用于连接第一子像素110和第一电路210的第一连接线310和用于连接第三子像素130和第三电路230的第三连接线330，至少部分第一连接线310和第三连接线330位于同一膜层。
在这些可选的实施例中，至少部分第一连接线310和第三连接线330位于同一膜层，使得至少部分第一连接线310和第三连接线330能够同步制备，无需增加制备工艺步骤制备部分第一连接线310和第三连接线330，也不会增加掩膜版的数量和制程，能够简化显示面板100的制备工艺并提高显示面板100的制备效率，还能够减薄显示面板100的厚度。
可选的，连接线103还包括第二连接线320，第二连接线320用于连接第二电路320和第二子像素120。
请一并参阅图3、图5至图7，图6是图2中B-B处的剖视图。图7是图4中C-C处的剖视图。
在一些可选的实施例中，如图3和图5至图7所示，显示面板100还包括：信号线层104，包括信号线410，至少部分连接线103位于信号线层104，信号线410包括数据线、扫描线、电源线、电压参考线和接地线中的至少一者，使得部分连接线103能够与数据线、扫描线、电源线、电压参考线和接地线中的至少一者同步制备，无需增加制备工艺步骤制备部分连接线103，也不会增加掩膜版的数量和制程，能够简化显示面板100的制备工艺并提高显示面板100的制备效率，还能够减薄显示面板100的厚度。
可选的，至少部分连接线103沿显示面板的厚度方向Z的正投影和像素驱动电路102沿显示面板的厚度方向Z的正投影错位设置，能够减小部分连接线103与像素驱动电路102的交叠面积，改善连接线103和像素驱动电路102之间形成的寄生电容对信号传输的影响。
可选的，至少部分第一连接线310沿第一方向X延伸成型，且沿第一方向X延伸成型的部分第一连接线310位于其对应的第一电路块200a在第二方向Y的一侧，和/或，至少部分第三连接线330沿第一方向X延伸成型，且沿第一方向X延伸成型的部分第三连接线330位于其对应的第三电路块200c在第二方向Y的一侧，第一方向X和第二方向Y相交。
在这些可选的实施例中，当部分第一连接线310沿第一方向X延伸成型，沿第一方向X延伸成型的部分第一连接线310位于其对应的第一电路块200a在第二方向Y的一侧时，一方面使得第一连接线310位于第一电路210之间预留的空间内，另一方面能够减小第一连接线310与第一电路210交叠面积，改善第一连接线310和第一电路210的相互影响。
当部分第三连接线330沿第一方向X延伸成型，沿第一方向X延伸成型的部分第三连接线330位于其对应的第三电路块200a在第二方向Y的一侧时，一方面使得第三连接线330位于第三电路230之间预留的空间内，另一方面能够减小第三连接线330与第三电路230交叠面积，改善第三连接线330和第三电路230之间的相互影响。
第一连接线310对应的第一电路块200a即第一连接线310连接的第一电路210所在的第一电路块200a，第三连接线330对应的第三电路块200c即第三连接线330连接的第三电路230所在的第三电路块200c。
请继续参阅图6和图7，显示面板100还可以包括衬底11、设置于衬底的阵列基板层12和像素定义层13。像素驱动电路102可以设置于阵列基板层12。第一电路210和第二电路220以及第三电路230均可以包括薄膜晶体管(Thin Film Transistor；TFT)。阵列基板层12还可以包括电容等结构。像素定义层13包括像素开口，像素开口包括位于第一显示区AA1的第一像素开口K1、位于第二显示区AA2的第二像素开口K2以及位于第三显示区AA3的第三像素开口K3。第一子像素110包括第一电极111、第二电极112和位于第一电极111和第二电极112之间的第一发光结构113，第一发光结构113位于第一像素开口K1。第一电极111通过第一连接线310连接于第一电路210的TFT。第二子像素120包括第三电极121、第四电极122和位于第三电极121和第四电极122之间的第二发光结构123，第二发光结构123位于第二像素开口K2。第三子像素130包括第五电极131、第六电极132和位于第五电极131和第六电极132之间的第三发光结构133，第三发光结构133位于第三像素开口K3。第五电极131通过第三连接线330连接于第三电路230的TFT。像素定义层13上还可以设置支撑柱14。第一电极111和第三电极121以及第五电极131可以为像素电极，第二电极112和第四电极122以及第六电极132可以互连为整面电极。
请一并参阅图6至图9，图8是图3的局部放大结构示意图，图9是图5的局部放大结构示意图。
如图6和图8所示，在一些可选的实施例中，第一连接线310包括位于第一显示区AA1的第一分段311和位于第二显示区AA2的第二分段312，第二分段312位于信号线层104，使得第一连接线310能够与信号线同步制备，无需增加制备工艺步骤制备部分第一连接线310，也不会增加掩膜版的数量和制程，能够简化显示面板100的制备工艺并提高显示面板100的制备效率，还能够减薄显示面板100的厚度。
可选的，第一分段311和第二分段312位于不同的膜层，以改善不同第一连接线310的短路连接风险。如图7和图9所示，在一些可选的实施例中，第三连接线330包括位于第三显示区AA3的第三分段331和位于第二显示区AA2的第四分段332，第四分段333位于信号线层104，使得第四分段332能够与信号线410同步制备，无需增加制备工艺步骤制备部分第四分段332，也不会增加掩膜版的数量和制程，能够简化显示面板100的制备工艺并提高显示面板100的制备效率，还能够减薄显示面板100的厚度。可选的，第四分段332和第三分段331位于不同的膜层，以改善不同第三连接线330的短路连接风险。
可选的，第三分段331可以选用透光材料制备成型，例如第三分段331的材料包括氧化烟锡等透光材料，以提高第一显示区AA1的透光率。
可选的，第一分段311和第三分段331位于相同的膜层。使得第一分段311能够与第三分段331同步制备，能够简化显示面板100的制备工艺并提高显示面板100的制备效率，还能够减薄显示面板100的厚度。
在一些可选的实施例中，相同颜色的子像素101连接的连接线103使用相同的材料制备成型。
在这些可选的实施例中，同种颜色的子像素101采用同种材料的连接线103，可以降低连接线103电阻不同导致的像素亮度的差异，能够进一步改善第二显示区AA2显示的均一性。
可选的，第二显示区AA2包括主显示区、第一过渡区和第二过渡区，第一过渡区位于主显示区和第一显示区AA1之间，第二过渡区位于主显示区和第三显示区AA3之间，第一电路210位于第一过渡区，使得第一电路210与第一显示区AA1之间的间距较小，能够减短第一电路210与第一子像素110之间的布线长度，第三电路230位于第二过渡区，使得第三电路230与第三显示区AA3之间的间距较小，能够减短第三电路230与第三子像素130之间的布线长度，虚拟区域240位于主显示区，能够进一步改善第二显示区AA2显示的均一性。
在一些可选的实施例中，第一子像素110、第二子像素120和第三子像素130成行成列排布，第一电路210、第二电路220和第三电路230成行成列排布，其中，至少部分第一电路210和第二电路220同行设置，且同行设置的第一电路10和第二电路220用于驱动同行的第一子像素110和第二子像素120；和/或，至少部分第三电路230和第二电路20同行设置，且同行设置的第三电路230和第二电路220用于驱动同行的第一子像素110和第二子像素120。
在这些可选的实施例中，第一电路210通过第一连接线310和第一子像素110连接，第二电路220通过第二连接线320和第二子像素120连接，第三电路23通过第三连接线330和第三子像素130连接，当同一行的第一电路210和第二电路220以及第三电路230和其驱动的第一子像素110和第二子像素120以及第三子像素130同行设置时，能够简化扫描线的形状，便于扫描线驱动同行的第一子像素110和第二子像素120以及第三子像素130，提高信号线传输的稳定性。
在一些可选的实施例中，第二显示区AA1关于第一对称轴线M对称设置，第一对称轴线M沿第二方向Y延伸，且第一对称轴线M经过第三显示区AA1的中心，多个第一电路210关于第一对称轴线M对称分布，且第一电路210和被其驱动的第一子像素110位于第一对称轴线M的同侧，以进一步减小第一电路210和其驱动的第一子像素110之间的距离，减小走线距离；多个第三电路230关于第一对称轴线M对称分布，且第三电路230和被其驱动的第三子像素130位于第一对称轴线M的同侧，以进一步减小第三电路230和其驱动的第三子像素130之间的距离，减小走线距离。
请参阅图10和图11，图10是本申请实施例提供的一种显示装置的结构示意图，图11是图10中D-D处的剖视图。
本申请第二方面实施例提供的显示装置可以包括上述任一实施方式的显示面板100。本实施例的显示装置中，显示面板100可以是上述其中一个实施例的显示面板100，显示面板100具有第一显示区AA1、第二显示区AA2和第三显示区AA3，第三显示区AA3的透光率大于第二显示区AA2的透光率。
在这些显示装置的显示面板100中，请一并参阅图2、图3和图11，用于驱动第一显示区AA1的第一子像素110的第一电路210设置于第二显示区AA2，能够为移位寄存器105的设置留有足够的空间，使得原本位于非显示区的移位寄存器105可以设置于能够显示的第一显示区AA1，从而能够减小显示装置的边框宽度。
可选的，如图11所示，显示面板100包括相对的第一表面S1和第二表面S2，其中第一表面S1为显示面。显示装置还包括感光组件200，该感光组件200位于显示面板100的第二表面S2侧，感光组件200与第三显示区AA3位置对应。
感光组件200可以是图像采集装置，用于采集外部图像信息。本实施例中，感光组件200为互补金属氧化物半导体(Complementary Metal Oxide Semiconductor，CMOS)图像采集装置，在其它一些实施例中，感光组件200也可以是电荷耦合器件(Charge-coupledDevice，CCD)图像采集装置等其它形式的图像采集装置。可以理解的是，感光组件200可以不限于是图像采集装置，例如在一些实施例中，感光组件200也可以是红外传感器、接近传感器、红外镜头、泛光感应元件、环境光传感器以及点阵投影器等光传感器。此外，显示装置在显示面板100的第二表面S2还可以集成其它部件，例如是听筒、扬声器等。
根据本发明实施例的显示装置，第三显示区AA3的透光率大于第二显示区AA2的透光率，使得显示面板100在第一显示区AA1的背面可以集成感光组件200，实现例如图像采集装置的感光组件200的屏下集成，同时第三显示区AA3能够显示画面，提高显示面板100的显示面积，实现显示装置的全面屏设计。第一子像素110位于第一显示区AA1，使得显示面板100的边框区域可以发光显示，从而减小显示面板100的边框，实现显示装置的窄边框设计。
依照本申请如上文的实施例，这些实施例并没有详尽叙述所有的细节，也不限制该发明仅为的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本申请的原理和实际应用，从而使所属技术领域技术人员能很好地利用本申请以及在本申请基础上的修改使用。本申请仅受权利要求书及其全部范围和等效物的限制。

Claims (23)

1.一种显示面板，其特征在于，所述显示面板具有第一显示区、第二显示区和第三显示区，所述第一显示区环绕至少部分所述第二显示区设置，所述第二显示区环绕至少部分所述第三显示区设置，所述显示面板包括：
子像素，包括位于所述第一显示区的第一子像素、位于所述第二显示区的第二子像素和位于所述第三显示区的第三子像素；
移位寄存器，位于所述第一显示区；
像素驱动电路，位于所述第二显示区，所述像素驱动电路包括第一电路、第二电路、虚拟区域和第三电路，所述第一电路用于驱动所述第一子像素，所述第二电路用于驱动所述第二子像素，所述第三电路用于驱动所述第三子像素，其中，a个相邻的所述第二子像素形成像素块，所述第一电路和a个所述第二电路形成第一电路块，所述第一电路块内的a个所述第二电路用于驱动同一所述像素块内的a个所述第二子像素，所述虚拟区域和a个所述第二电路形成第二电路块，所述第二电路块内的a个所述第二电路用于驱动同一所述像素块内的a个所述第二子像素，a为大于1的整数，所述第一电路块内所述第一电路和所述第二电路的相对位置关系与所述第二电路块内所述虚拟区域和所述第二电路的相对位置关系相同，所述第三电路和a个所述第二电路形成第三电路块，所述第三电路块内的a个所述第二电路用于驱动同一所述像素块内的a个所述第二子像素，a为大于1的整数，所述第一电路块内所述第一电路和所述第二电路的相对位置关系与所述第三电路块内所述第三电路和所述第二电路的相对位置关系相同。
2.根据权利要求1所述的显示面板，其特征在于，沿所述显示面板的厚度方向，所述第一电路的正投影尺寸和所述虚拟区域的尺寸相同。
3.根据权利要求2所述的显示面板，所述第二电路块的个数为多个，且各所述第二电路块与被其驱动的所述像素块的相对位置相同。
4.根据权利要求2所述的显示面板，所述第一电路块内所述第一电路的数量和所述第二电路块内所述虚拟区域的数量相同。
5.根据权利要求2所述的显示面板，沿所述显示面板的厚度方向，所述第一电路块的正投影尺寸和所述第二电路块的正投影尺寸相同。
6.根据权利要求2所述的显示面板，所述虚拟区域内设置有虚拟电路，所述虚拟电路的结构与所述第一电路的结构相同。
7.根据权利要求1所述的显示面板，其特征在于，各所述第三电路块与被其驱动的所述像素块的相对位置相同。
8.根据权利要求1所述的显示面板，沿所述显示面板的厚度方向，所述第一电路的正投影尺寸和所述第三电路的正投影尺寸相同。
9.根据权利要求1所述的显示面板，所述第一电路块内所述第一电路的数量和所述第三电路块内所述第三电路的数量相同。
10.根据权利要求1所述的显示面板，沿所述显示面板的厚度方向，所述第一电路块的正投影尺寸和所述第三电路块的正投影尺寸相同。
11.根据权利要求1所述的显示面板，其特征在于，还包括连接线，所述连接线包括用于连接所述第一子像素和所述第一电路的第一连接线和用于连接所述第三子像素和所述第三电路的第三连接线，至少部分所述第一连接线和所述第三连接线位于同一膜层。
12.根据权利要求11所述的显示面板，其特征在于，所述显示面板还包括：
信号线层，包括信号线，至少部分所述连接线位于所述信号线层，所述信号线包括数据线、扫描线、电源线、电压参考线和接地线中的至少一者。
13.根据权利要求12所述的显示面板，至少部分所述连接线沿所述显示面板的厚度方向的正投影和所述像素驱动电路沿所述显示面板的厚度方向的正投影错位设置。
14.根据权利要求12所述的显示面板，至少部分所述第一连接线沿第一方向延伸成型，且沿所述第一方向延伸成型的部分所述第一连接线位于其对应的所述第一电路块在第二方向的至少一侧，
和/或，至少部分所述第三连接线沿第一方向延伸成型，且沿所述第一方向延伸成型的部分所述第三连接线位于其对应的所述第三电路块在第二方向的至少一侧，所述第一方向和所述第二方向相交。
15.根据权利要求12所述的显示面板，其特征在于，所述第一连接线包括位于所述第一显示区的第一分段和位于所述第二显示区的第二分段，所述第二分段位于所述信号线层。
16.根据权利要求15所述的显示面板，所述第一分段和所述第二分段位于不同的膜层。
17.根据权利要求15所述的显示面板，所述第三连接线包括位于所述第三显示区的第三分段和位于所述第二显示区的第四分段，所述第四分段位于所述信号线层。
18.根据权利要求17所述的显示面板，所述第四分段和所述第三分段位于不同的膜层。
19.根据权利要求17所述的显示面板，所述第一分段和所述第三分段位于相同的膜层。
20.根据权利要求11所述的显示面板，其特征在于，相同颜色的所述子像素连接的所述连接线使用相同的材料制备成型。
21.根据权利要求1所述的显示面板，其特征在于，所述第一电路块的个数为多个，且各所述第一电路块与被其驱动的所述像素块的相对位置相同。
22.根据权利要求1所述的显示面板，其特征在于，所述第一子像素、所述第二子像素和所述第三子像素成行成列排布，所述第一电路、所述第二电路和所述第三电路成行成列排布，
其中，至少部分所述第一电路和所述第二电路同行设置，且同行设置的所述第一电路和所述第二电路用于驱动同行的所述第一子像素和所述第二子像素；
和/或，至少部分所述第三电路和所述第二电路同行设置，且同行设置的所述第三电路和所述第二电路用于驱动同行的所述第一子像素和所述第二子像素。
23.一种显示装置，其特征在于，包括根据权利要求1至22任一项所述的显示面板。
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