CN114267281A - 像素电路及显示面板 - Google Patents

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Abstract

本申请公开了一种像素电路及显示面板，该像素电路包括驱动模块、脉幅调制模块、脉宽调制模块、内部补偿模块以及电位保持模块，通过脉幅调制模块以脉幅调制方式控制高灰阶显示，脉宽调制模块以脉宽调制方式控制低灰阶显示，内部补偿模块对驱动模块的第一端进行内部补偿，实现了像素电路的内部补偿与混合驱动。

Description

像素电路及显示面板
技术领域
本申请涉及显示技术领域，具体涉及一种像素电路及显示面板。
背景技术
像素电路的驱动方式可以分为脉幅调制(PAM，Pulse Amplitude Modulation)驱动方式、脉宽调制(PWM，Pulse Width Modulation)驱动方式以及混合驱动方式，其中，混合驱动方式为脉幅调制驱动方式与脉宽调制驱动方式的结合，其可以解决低灰阶显示品味不佳的问题，例如，亮度离散、色点漂移等等。像素电路按照补偿方式的不同可以分为内部补偿型像素电路和外部补偿型像素电路，其中，外部补偿型像素电路需要依靠外部电路完成补偿功能，相比于内部补偿型像素电路，外部补偿型像素电路的制作成本较高。
因此，有必要提出一种兼有内部补偿与混合驱动方式的像素电路，以较低的成本实现高显示品质。
需要注意的是，上述关于背景技术的介绍仅仅是为了便于清楚、完整地理解本申请的技术方案。因此，不能仅仅由于其出现在本申请的背景技术中，而认为上述所涉及到的技术方案为本领域所属技术人员所公知。
发明内容
本申请提供一种像素电路及显示面板，以实现像素电路的内部补偿与混合驱动的技术问题。
第一方面，本申请提供一种像素电路，其包括驱动模块、脉幅调制模块、脉宽调制模块、内部补偿模块以及电位保持模块，脉幅调制模块的输出端与驱动模块的控制端电性连接；脉宽调制模块的输出端与驱动模块的控制端电性连接；内部补偿模块的输出端与驱动模块的第一端电性连接；电位保持模块的第一端与驱动模块的第一端电性连接。
在其中一些实施方式中，像素电路还包括发光控制模块、存储模块以及发光器件，发光控制模块的第一端与电位保持模块的第二端电性连接并接入电源正信号，发光控制模块的第二端与驱动模块的第二端电性连接，发光控制模块的控制端接入第一控制信号；存储模块的第一端与驱动模块的控制端电性连接，存储模块的第二端与驱动模块的第一端电性连接；发光器件的阳极与驱动模块的第一端电性连接，发光器件的阴极接入电源负信号。
在其中一些实施方式中，驱动模块包括驱动晶体管，驱动晶体管的栅极与脉幅调制模块的输出端、脉宽调制模块的输出端以及存储模块的第一端电性连接，驱动晶体管的源极/漏极中的一个与内部补偿模块的输出端、电位保持模块的第一端电性连接，驱动晶体管的源极/漏极中的另一个与发光控制模块的第二端电性连接；其中，驱动模块的控制端为驱动晶体管的栅极，驱动模块的第一端为驱动晶体管的源极/漏极中的一个，驱动模块的第二端为驱动晶体管的源极/漏极中的另一个。
在其中一些实施方式中，脉幅调制模块包括脉幅控制晶体管，脉幅控制晶体管的源极/漏极中的一个接入脉幅数据信号，脉幅控制晶体管的栅极接入第二控制信号，脉幅控制晶体管的源极/漏极中的另一个与驱动晶体管的栅极电性连接；其中，脉幅调制模块的输出端为脉幅控制晶体管的源极/漏极中的另一个。
在其中一些实施方式中，脉宽调制模块包括脉宽控制晶体管，脉宽控制晶体管的源极/漏极中的一个接入脉宽数据信号，脉宽控制晶体管的栅极接入第三控制信号，脉宽控制晶体管的源极/漏极中的另一个与驱动晶体管的栅极电性连接；其中，脉宽调制模块的输出端为脉宽控制晶体管的源极/漏极中的另一个。
在其中一些实施方式中，内部补偿模块包括补偿晶体管，补偿晶体管的源极/漏极中的一个接入复位信号，补偿晶体管的栅极接入第四控制信号，补偿晶体管的源极/漏极中的另一个与驱动晶体管的源极/漏极中的一个电性连接；其中，内部补偿模块的输出端为补偿晶体管的源极/漏极中的另一个。
在其中一些实施方式中，电位保持模块包括第一电容，第一电容的第一端与驱动晶体管的源极/漏极中的一个电性连接，第一电容的第二端与发光控制模块的第一端电性连接并接入电源正信号。
在其中一些实施方式中，像素电路的一帧时间包括写入阶段和发光阶段，在写入阶段中，内部补偿模块先复位驱动模块的第一端的电位，然后脉幅调制模块写入脉幅数据信号至驱动模块的控制端；在发光阶段中，脉宽调制模块写入脉宽数据信号至驱动模块的控制端以间歇性关断驱动模块。
在其中一些实施方式中，在脉幅调制模块的导通期间内，发光控制模块处于导通状态时内部补偿模块复位驱动模块的第一端的电位，发光控制模块处于关闭状态时脉幅调制模块输出具有脉冲的脉幅数据信号至驱动模块的控制端，且一帧时间中驱动模块的第一端的复位时间早于脉幅数据信号的脉冲开始时间；在脉幅调制模块的关闭期间且发光控制模块处于导通状态时，脉宽调制模块输出具有至少一个脉冲的脉宽数据信号至驱动模块的控制端，以控制发光器件在低灰阶显示中的发光时间。
第二方面，本申请提供一种显示面板，其包括上述至少一实施方式中的像素电路。
本申请提供的像素电路及显示面板，通过脉幅调制模块可以以脉幅调制方式控制高灰阶显示，脉宽调制模块可以以脉宽调制方式控制低灰阶显示，从而实现了混合驱动方式的高显示品质，内部补偿模块可以对驱动模块的第一端进行内部补偿以降低补偿的成本，实现了像素电路的内部补偿与混合驱动，进而能够以较低的成本实现高显示品质；又，电位保持模块可以对补偿后的驱动模块的第一端的电位进行保持，能够稳定驱动模块的控制端与驱动模块的第一端之间的压差，进而提高显示时间的控制精度。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1为本申请实施例提供的像素电路的第一种结构示意图。
图2为本申请实施例提供的像素电路的第二种结构示意图。
图3为本申请实施例提供的像素电路的第三种结构示意图。
图4为图3所示像素电路的时序示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本实施例提供了一种像素电路，如图1所示，该像素电路包括驱动晶体管T1、开关晶体管T2、开关晶体管T3、开关晶体管T4、存储电容Cst以及发光器件D1，驱动晶体管T1的源极/漏极中的一个接入电源正信号VDD，驱动晶体管T1的源极/漏极中的另一个与发光器件D1的阳极电性连接，发光器件D1的阴极接入电源负信号VSS；开关晶体管T4的源极/漏极中的一个接入参考信号Vref或者输出驱动晶体管T1的源极/漏极中的另一个的电位，开关晶体管T4的栅极接入控制信号SCAN2，开关晶体管T4的源极/漏极中的另一个与驱动晶体管T1的源极/漏极中的另一个电性连接；开关晶体管T2的源极/漏极中的一个接入脉幅数据信号DPAM，开关晶体管T2的栅极接入控制信号SCAN1，开关晶体管T2的源极/漏极中的另一个与驱动晶体管T1的栅极电性连接；开关晶体管T3的源极/漏极中的一个接入脉宽数据信号DPWM，开关晶体管T3的栅极接入控制信号SCAN3，开关晶体管T3的源极/漏极中的另一个与驱动晶体管T1的栅极电性连接；存储电容Cst的一端与驱动晶体管T1的栅极电性连接，存储电容Cst的另一端与驱动晶体管T1的源极/漏极中的另一个电性连接。
其中，在控制信号SCAN3的控制下，开关晶体管T3可以控制脉宽数据信号DPWM写入至驱动晶体管T1的栅极，以控制像素电路的低灰阶显示。在控制信号SCAN1的控制下，开关晶体管T2可以控制脉幅数据信号DPAM写入至驱动晶体管T1的栅极，以控制像素电路的高灰阶显示。在控制信号SCAN2的控制下，开关晶体管T4可以控制参考信号Vref写入至驱动晶体管T1的源极/漏极中的另一个，以初始化驱动晶体管T1的源极/漏极中的另一个的电位和/或发光器件D1的阳极电位；开关晶体管T4也可以输出驱动晶体管T1的源极/漏极中的另一个的电位至外部补偿系统，以便该外部补偿系统可以根据驱动晶体管T1的源极/漏极中的另一个的电位对脉幅数据信号DPAM和/或脉宽数据信号DPWM进行补偿。
基于上述分析，本实施例中的像素电路需要通过外部补偿系统实现对像素电路的补偿，然而，配置外部补偿系统显然需要增加成本。
有鉴于配置外部补偿系统需要增加成本的问题，本实施例提供了另一种像素电路，如图2所示，该像素电路包括驱动晶体管T1、开关晶体管T2、开关晶体管T4、开关晶体管T5、存储电容Cst、发光器件D1以及第一电容C1，开关晶体管T5的源极/漏极中的一个接入电源正信号VDD，开关晶体管T5的栅极接入控制信号SCAN3，开关晶体管T5的源极/漏极中的另一个与驱动晶体管T1的源极/漏极中的一个电性连接，驱动晶体管T1的源极/漏极中的另一个与发光器件D1的阳极电性连接，发光器件D1的阴极接入电源负信号VSS；开关晶体管T4的源极/漏极中的一个接入复位信号RESET，开关晶体管T4的栅极接入控制信号SCAN2，开关晶体管T4的源极/漏极中的另一个与驱动晶体管T1的源极/漏极中的另一个电性连接；开关晶体管T2的源极/漏极中的一个接入脉幅数据信号DPAM，开关晶体管T2的栅极接入控制信号SCAN1，开关晶体管T2的源极/漏极中的另一个与驱动晶体管T1的栅极电性连接；存储电容Cst的一端与驱动晶体管T1的栅极电性连接，存储电容Cst的另一端与驱动晶体管T1的源极/漏极中的另一个电性连接；第一电容C1的一端与驱动晶体管T1的源极/漏极中的另一个电性连接，第一电容C1的另一端与开关晶体管T5的源极/漏极中的一个电性连接，以保持驱动晶体管T1的源极/漏极中的另一个的电位。
其中，在控制信号SCAN1的控制下，开关晶体管T2可以控制数据信号DPAM写入至驱动晶体管T1的栅极，以控制像素电路的各灰阶显示。在控制信号SCAN2的控制下，开关晶体管T4可以控制复位信号RESET写入至驱动晶体管T1的源极/漏极中的另一个，以初始化驱动晶体管T1的源极/漏极中的另一个的电位和/或发光器件D1的阳极电位。
基于上述分析，本实施例中的像素电路虽然通过开关晶体管T4实现了内部补偿，但是在控制信号SCAN1的控制下，开关晶体管T2可以控制数据信号DPAM写入至驱动晶体管T1的栅极，其仅可以实现脉幅调制驱动方式，并不能够实现脉宽调制驱动方式，低灰阶的显示品质得不到控制。
在对像素电路的持续研发过程中，像素电路的结构也一直在不断变化，但是，一直缺少一种兼有内部补偿与混合驱动方式的像素电路，其能够以较低的成本实现高显示品质，有鉴于此，本实施例提供了另一种像素电路，如图3所示，该像素电路包括驱动模块10、脉幅调制模块20、脉宽调制模块30、内部补偿模块40以及电位保持模块50，脉幅调制模块20的输出端与驱动模块10的控制端电性连接；脉宽调制模块30的输出端与驱动模块10的控制端电性连接；内部补偿模块40的输出端与驱动模块10的第一端电性连接；电位保持模块50的第一端与驱动模块10的第一端电性连接。
本实施例提供的像素电路，通过脉幅调制模块20可以以脉幅调制方式控制高灰阶显示，脉宽调制模块30可以以脉宽调制方式控制低灰阶显示，从而实现了混合驱动方式的高显示品质，内部补偿模块40可以对驱动模块10的第一端进行内部补偿以降低补偿的成本，实现了像素电路的内部补偿与混合驱动，进而能够以较低的成本实现高显示品质；又，电位保持模块50可以对补偿后的驱动模块10的第一端的电位进行保持，能够稳定驱动模块10的控制端与驱动模块10的第一端之间的压差，进而提高显示时间的控制精度。
在其中一个实施例中，像素电路还包括发光控制模块60、存储模块70以及发光器件D1，发光控制模块60的第一端与电位保持模块50的第二端电性连接并接入电源正信号VDD，发光控制模块60的第二端与驱动模块10的第二端电性连接，发光控制模块60的控制端接入第一控制信号SCAN3；存储模块70的第一端与驱动模块10的控制端电性连接，存储模块70的第二端与驱动模块10的第一端电性连接；发光器件D1的阳极与驱动模块10的第一端电性连接，发光器件D1的阴极接入电源负信号VSS。
在其中一个实施例中，发光控制模块60包括发光控制晶体管T5，发光控制晶体管T5的源极/漏极中的一个接入电源正信号VDD，发光控制晶体管T5的源极/漏极中的另一个与驱动晶体管T1的源极/漏极中的另一个电性连接，发光控制晶体管T5的栅极接入第一控制信号SCAN3。
在其中一个实施例中，存储模块70包括存储电容Cst，存储电容Cst的一端与驱动晶体管T1的栅极电性连接，存储电容Cst的另一端与驱动晶体管T1的源极/漏极中的一个电性连接。
在其中一个实施例中，发光器件D1可以为迷你发光二极管、微发光二极管或者有机发光二极管中的一个。
在其中一个实施例中，驱动模块10包括驱动晶体管T1，驱动晶体管T1的栅极与脉幅调制模块20的输出端、脉宽调制模块30的输出端以及存储模块70的第一端电性连接，驱动晶体管T1的源极/漏极中的一个与内部补偿模块40的输出端、电位保持模块50的第一端电性连接，驱动晶体管T1的源极/漏极中的另一个与发光控制模块60的第二端电性连接；其中，驱动模块10的控制端为驱动晶体管T1的栅极，驱动模块10的第一端为驱动晶体管T1的源极/漏极中的一个，驱动模块10的第二端为驱动晶体管T1的源极/漏极中的另一个。
在其中一个实施例中，脉幅调制模块20包括脉幅控制晶体管T2，脉幅控制晶体管T2的源极/漏极中的一个接入脉幅数据信号DPAM，脉幅控制晶体管T2的栅极接入第二控制信号SCAN1，脉幅控制晶体管T2的源极/漏极中的另一个与驱动晶体管T1的栅极电性连接；其中，脉幅调制模块20的输出端为脉幅控制晶体管T2的源极/漏极中的另一个。
在其中一个实施例中，脉宽调制模块30包括脉宽控制晶体管T3，脉宽控制晶体管T3的源极/漏极中的一个接入脉宽数据信号DPWM，脉宽控制晶体管T3的栅极接入第三控制信号SCAN4，脉宽控制晶体管T3的源极/漏极中的另一个与驱动晶体管T1的栅极电性连接；其中，脉宽调制模块30的输出端为脉宽控制晶体管T3的源极/漏极中的另一个。
在其中一个实施例中，内部补偿模块40包括补偿晶体管T4，补偿晶体管T4的源极/漏极中的一个接入复位信号RESET，补偿晶体管T4的栅极接入第四控制信号SCAN2，补偿晶体管T4的源极/漏极中的另一个与驱动晶体管T1的源极/漏极中的一个电性连接；其中，内部补偿模块40的输出端为补偿晶体管T4的源极/漏极中的另一个。
在其中一个实施例中，电位保持模块50包括第一电容C1，第一电容C1的第一端与驱动晶体管T1的源极/漏极中的一个电性连接，第一电容C1的第二端与发光控制模块60的第一端电性连接并接入电源正信号VDD。
在其中一个实施例中，脉宽控制晶体管T3、脉幅控制晶体管T2、补偿晶体管T4以及发光控制晶体管T5均为N沟道型薄膜晶体管，例如，可以为N沟道型金属氧化物薄膜晶体管；驱动晶体管T1可以为P沟道型薄膜晶体管，例如，可以为P沟道型低温多晶硅薄膜晶体管，可以理解的是，如此配置既可以保证像素电路的动态性能，又可以保证像素电路的低漏电。
在其中一个实施例中，图3所示像素电路的工作过程具体如图4所示，一帧F1可以包括先后时间顺序的第一子帧F11和第二子帧F12，或者还可以包括后续的第三子帧F13至第M子帧F1M，其中，M可以为大于或者等于3的正整数。
其中，在第一子帧F11中，第一控制信号SCAN3、第二控制信号SCAN1、第四控制信号SCAN2均处于高电位，脉幅控制晶体管T2、补偿晶体管T4、发光控制晶体管T5均打开，复位信号RESET通过补偿晶体管T4对驱动晶体管T1的源极/漏极中的一个的电位进行补偿，并通过第一电容C1对补偿后的驱动晶体管T1的源极/漏极中的一个的电位进行保持。然后，第一控制信号SCAN3处于低电位，发光控制晶体管T5关闭；第二控制信号SCAN1仍然处于高电位，脉幅控制晶体管T2保持打开，脉幅数据信号DPAM的一个脉冲通过脉幅控制晶体管T2写入至驱动晶体管T1的栅极。也就是说，第一子帧F11是用于补偿以及通过脉幅调制驱动像素电路的高灰阶显示的。
在第二子帧F12中，第二控制信号SCAN1、第四控制信号SCAN2均处于低电位，脉幅控制晶体管T2、补偿晶体管T4均关闭；第一控制信号SCAN3处于高电位，发光控制晶体管T5保持打开；第三控制信号SCAN4处于高电位时，打开的脉宽控制晶体管T3输出处于高电位的脉宽数据信号DPWM至驱动晶体管T1的栅极，致使驱动晶体管T1关断，以控制低灰阶显示的时间，进而提高低灰阶的显示品质。
在后续的第三子帧F13至第M子帧F1M中的任一个中，脉宽数据信号DPWM可以具有至少一个脉冲，以控制低灰阶的显示品质。
也就是说，像素电路的一帧时间可以包括写入阶段即第一子帧F11和发光阶段即第二子帧F12或者第二子帧F12至第M子帧F1M中的至少一个，在写入阶段中，内部补偿模块40先复位驱动模块10的第一端的电位，然后脉幅调制模块20写入脉幅数据信号DPAM至驱动模块10的控制端；在发光阶段中，脉宽调制模块30写入脉宽数据信号DPWM至驱动模块10的控制端以间歇性关断驱动模块10。
具体地，在脉幅调制模块20的导通期间内，发光控制模块60处于导通状态时内部补偿模块40复位驱动模块10的第一端的电位，发光控制模块60处于关闭状态时脉幅调制模块20输出具有脉冲的脉幅数据信号DPAM至驱动模块10的控制端，且一帧时间中驱动模块10的第一端的复位时间早于脉幅数据信号DPAM的脉冲开始时间；在脉幅调制模块20的关闭期间且发光控制模块60处于导通状态时，脉宽调制模块30输出具有至少一个脉冲的脉宽数据信号DPWM至驱动模块10的控制端，以控制发光器件D1在低灰阶显示中的发光时间。
在其中一个实施例中，本实施例提供一种显示面板，其包括上述至少一实施例中的像素电路。
本实施例提供的显示面板，通过脉幅调制模块20可以以脉幅调制方式控制高灰阶显示，脉宽调制模块30可以以脉宽调制方式控制低灰阶显示，从而实现了混合驱动方式的高显示品质，内部补偿模块40可以对驱动模块10的第一端进行内部补偿以降低补偿的成本，实现了像素电路的内部补偿与混合驱动，进而能够以较低的成本实现高显示品质；又，电位保持模块50可以对补偿后的驱动模块10的第一端的电位进行保持，能够稳定驱动模块10的控制端与驱动模块10的第一端之间的压差，进而提高显示时间的控制精度。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
以上对本申请实施例所提供的像素电路及显示面板进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (10)

1.一种像素电路，其特征在于，包括：
驱动模块；
脉幅调制模块，所述脉幅调制模块的输出端与所述驱动模块的控制端电性连接；
脉宽调制模块，所述脉宽调制模块的输出端与所述驱动模块的控制端电性连接；
内部补偿模块，所述内部补偿模块的输出端与所述驱动模块的第一端电性连接；
电位保持模块，所述电位保持模块的第一端与所述驱动模块的第一端电性连接。
2.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括：
发光控制模块，所述发光控制模块的第一端与所述电位保持模块的第二端电性连接并接入电源正信号，所述发光控制模块的第二端与所述驱动模块的第二端电性连接，所述发光控制模块的控制端接入第一控制信号；
存储模块，所述存储模块的第一端与所述驱动模块的控制端电性连接，所述存储模块的第二端与所述驱动模块的第一端电性连接；以及
发光器件，所述发光器件的阳极与所述驱动模块的第一端电性连接，所述发光器件的阴极接入电源负信号。
3.根据权利要求2所述的像素电路，其特征在于，所述驱动模块包括驱动晶体管，所述驱动晶体管的栅极与所述脉幅调制模块的输出端、所述脉宽调制模块的输出端以及所述存储模块的第一端电性连接，所述驱动晶体管的源极/漏极中的一个与所述内部补偿模块的输出端、所述电位保持模块的第一端电性连接，所述驱动晶体管的源极/漏极中的另一个与所述发光控制模块的第二端电性连接；
其中，所述驱动模块的控制端为所述驱动晶体管的栅极，所述驱动模块的第一端为所述驱动晶体管的源极/漏极中的一个，所述驱动模块的第二端为所述驱动晶体管的源极/漏极中的另一个。
4.根据权利要求3所述的像素电路，其特征在于，所述脉幅调制模块包括脉幅控制晶体管，所述脉幅控制晶体管的源极/漏极中的一个接入脉幅数据信号，所述脉幅控制晶体管的栅极接入第二控制信号，所述脉幅控制晶体管的源极/漏极中的另一个与所述驱动晶体管的栅极电性连接；
其中，所述脉幅调制模块的输出端为所述脉幅控制晶体管的源极/漏极中的另一个。
5.根据权利要求4所述的像素电路，其特征在于，所述脉宽调制模块包括脉宽控制晶体管，所述脉宽控制晶体管的源极/漏极中的一个接入脉宽数据信号，所述脉宽控制晶体管的栅极接入第三控制信号，所述脉宽控制晶体管的源极/漏极中的另一个与所述驱动晶体管的栅极电性连接；
其中，所述脉宽调制模块的输出端为所述脉宽控制晶体管的源极/漏极中的另一个。
6.根据权利要求5所述的像素电路，其特征在于，所述内部补偿模块包括补偿晶体管，所述补偿晶体管的源极/漏极中的一个接入复位信号，所述补偿晶体管的栅极接入第四控制信号，所述补偿晶体管的源极/漏极中的另一个与所述驱动晶体管的源极/漏极中的一个电性连接；
其中，所述内部补偿模块的输出端为所述补偿晶体管的源极/漏极中的另一个。
7.根据权利要求6所述的像素电路，其特征在于，所述电位保持模块包括第一电容，所述第一电容的第一端与所述驱动晶体管的源极/漏极中的一个电性连接，所述第一电容的第二端与所述发光控制模块的第一端电性连接并接入所述电源正信号。
8.根据权利要求1所述的像素电路，其特征在于，所述像素电路的一帧时间包括写入阶段和发光阶段，在所述写入阶段中，所述内部补偿模块先复位所述驱动模块的第一端的电位，然后所述脉幅调制模块写入脉幅数据信号至所述驱动模块的控制端；在所述发光阶段中，所述脉宽调制模块写入脉宽数据信号至所述驱动模块的控制端以间歇性关断所述驱动模块。
9.根据权利要求2所述的像素电路，其特征在于，在所述脉幅调制模块的导通期间内，所述发光控制模块处于导通状态时所述内部补偿模块复位所述驱动模块的第一端的电位，所述发光控制模块处于关闭状态时所述脉幅调制模块输出具有脉冲的脉幅数据信号至所述驱动模块的控制端，且一帧时间中所述驱动模块的第一端的复位时间早于所述脉幅数据信号的脉冲开始时间；
在所述脉幅调制模块的关闭期间且所述发光控制模块处于导通状态时，所述脉宽调制模块输出具有至少一个脉冲的脉宽数据信号至所述驱动模块的控制端，以控制所述发光器件在低灰阶显示中的发光时间。
10.一种显示面板，其特征在于，包括如权利要求1至9任一项所述的像素电路。
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