CN112735349B - 液晶显示器及其驱动方法 - Google Patents

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Abstract

本申请提供一种液晶显示器及其驱动方法，通过在液晶显示器的源级驱动器内设置两个驱动能力不同的驱动组件，并使用驱动能力较强的驱动组件驱动数据信号的极性翻转后的第一条数据线，而使用驱动能力相对较弱的驱动组件驱动极性不翻转的数据线，因此可以提高极性翻转的数据线上对应的像素的液晶电容的充电电压，改善了像素阵列在极性翻转行存在的暗线。

Description

液晶显示器及其驱动方法
技术领域
本申请涉及液晶显示技术，尤其涉及一种液晶显示器及其驱动方法。
背景技术
液晶显示器(Liquid Crystal Display，简称：LCD)是一种显示装置，其构造是在两片相对平行的基板当中设置液晶层，下基板上设置薄膜晶体管(Thin Film Transistor，简称：TFT)，上基板上设置彩色滤光片，并通过下基板上的TFT上的信号和电压的改变控制液晶层内液晶分子的转动方向，并结合入射光的偏振以显示图像。
具体地，液晶层被划分为不同像素，TFT基板上与像素对应的区域内包括一个薄膜晶体管(thin film transistor，简称：TFT)、一个液晶电容和一个存储电容，则当该像素区域对应的栅极线上的驱动信号控制TFT导通时，数据线提供的数据信号经过TFT在液晶电容上累积电荷，并在达到目标电压后进行放电，从而实现显示。
在一些技术中，为了避免液晶材料产生极化而造成永久性的破坏，一些LCD中通过数据线在纵向做极性翻转的方式，对阵列基板上每个像素区域的液晶电容和存储电容两端电压的极性每间隔一段时间后进行翻转，通过极性不同的数据线对液晶电容进行充电。
但是，采用上述技术，LCD的像素阵列内所有极性翻转行对应的像素的液晶电容的电压均小于极性不翻转行对应的像素的液晶电容的电压，使得LCD的像素在极性翻转的行上形成一道暗线，导致液晶显示器具有水平横纹感，极大地影响了LCD的显示效果。
发明内容
本申请提供一种液晶显示器及其驱动方法，用于解决现有技术中，液晶显示器的像素阵列在极性翻转行存在暗线的问题，从而降低液晶显示器的水平横纹感，提高LCD的显示效果。
本申请第一方面提供一种液晶显示器，包括：多条数据线，沿第一方向平行间隔设置；多条栅极线，沿第二方向平行间隔设置，所述第一方向和所述第二方向垂直，所述多条数据线和所述多条栅极线交叉设置；多个像素区域；其中，每个像素区域位于两根栅极线和两根数据线之间，每个像素区域连接相邻的一根数据线和一根栅极线；源级驱动器，用于按照每n条数据线翻转极性的方式，依次向所述多条数据线提供数据信号，n为大于等于2的整数；所述源级驱动器包括：第一驱动组件和第二驱动组件；所述第一驱动组件用于向所述多条数据线中第一类数据线提供数据信号，其中，所述第一类数据线包括数据信号的极性翻转后的第一条数据线；所述第二驱动组件用于向所述多条数据线中第二类数据线提供数据信号，其中，所述第二类数据线包括数据信号的极性翻转后的第二条数据线到下一次极性翻转前的最后一条数据线之间的数据线；其中，所述第一驱动组件的驱动电流大于所述第二驱动组件的驱动电流。
在本申请第一方面一实施例中，所述第一驱动组件包括：第一输出缓冲电路，用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第二驱动组件包括：第二输出缓冲电路，用于对所述DAC输出的模式信号进行驱动后得到数据信号，并输出至所述第二类数据线；所述液晶显示器还包括：第一开关和第二开关；其中，所述DAC的输出端分别连接所述第一输出缓冲电路的输入端和所述第二输出缓冲电路的输入端，所述第一输出缓冲电路的输出端通过所述第一开关连接所述源级驱动器的输出端，所述第二输出缓冲电路的输出端通过所述第二开关连接所述源级驱动器的输出端，所述第一输出缓冲电路和所述第二输出缓冲电路并联连接。
在本申请第一方面一实施例中，所述源级驱动器用于，接收极性翻转POL信号和数据锁存TP信号；当确定所述TP信号的上升沿对应的POL信号的极性翻转时，通过闭合所述第一开关、断开所述第二开关，将所述DAC输出的模拟信号输入所述第一驱动组件；当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，通过断开所述第一开关、闭合所述第二开关，将所述DAC输出的模拟信号输入所述第二驱动组件。
在本申请第一方面一实施例中，所述第一驱动组件包括：第三输出缓冲电路和第一电阻件；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述第一电阻件接收驱动电源；所述第二驱动组件包括：所述第三输出缓冲电路和第二电阻件；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述第二电阻件接收驱动电源；所述第一电阻件的阻值大于所述第二电阻件的阻值；所述液晶显示器还包括：选择开关；其中，所述第一驱动组件和所述第二驱动组件分别连接所述开关电路的两个选择端，所述开关电路的另一端用于接收所述驱动电源，所述第一电阻件和所述第二电阻件并联连接。
在本申请第一方面一实施例中，所述源级驱动器用于，接收极性翻转POL信号和数据锁存TP信号；当确定所述TP信号的上升沿对应的POL信号的极性翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路通过所述第一电阻件接收所述驱动电源；当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路通过所述第二电阻件接收所述驱动电源。
在本申请第一方面一实施例中，所述第一驱动组件包括：第三输出缓冲电路；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第二驱动组件包括：所述第三输出缓冲电路和第二电阻件；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述第二电阻件接收驱动电源；所述液晶显示器还包括：选择开关；其中，所述第一驱动组件和所述第二驱动组件分别连接所述开关电路的两个选择端，所述开关电路的另一端用于接收所述驱动电源，所述第一电阻件和所述第二电阻件并联连接。
在本申请第一方面一实施例中，所述源级驱动器用于，接收极性翻转POL信号和数据锁存TP信号；当确定所述TP信号的上升沿对应的POL信号的极性翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路接收所述驱动电源；当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路通过所述第二电阻件接收所述驱动电源。
在本申请第一方面一实施例中，所述第一驱动组件包括：第三输出缓冲电路和第一阻值的滑动变阻器；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述滑动变阻器接收驱动电源；所述第二驱动组件包括：所述第三输出缓冲电路和第二阻值的所述滑动变阻器；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述滑动变阻器接收驱动电源；所述第一阻值大于所述第二阻值。
在本申请第一方面一实施例中，所述源级驱动器用于，接收极性翻转POL信号和数据锁存TP信号；当确定所述TP信号的上升沿对应的POL信号的极性翻转时，将所述滑动变阻器的阻值调整为所述第一阻值；当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，将所述滑动变阻器的阻值调整为所述第二阻值。
本申请第二方面提供一种液晶显示器的驱动方法，可应用于如本申请第一方面任一项提供的液晶显示器中的源级驱动器执行，所述方法包括：确定目标数据线属于所述第一类数据线或者所述第二类数据线；当所述目标数据线属于所述第一类数据线，使用所述第一驱动组件向所述目标数据线提供数据信号；当所述目标数据线属于所述第二类数据线，使用所述第二驱动组件向所述目标数据线提供数据信号。
在本申请第二方面一实施例中，所述确定目标数据线属于所述第一类数据线或者所述第二类数据线，包括：接收极性翻转POL信号和数据锁存TP信号；通过所述TP信号的上升沿对应的POL信号的极性是否翻转，确定目标数据线属于所述第一类数据线或者所述第二类数据线。
综上，本申请提供的液晶显示器及其驱动方法，通过在液晶显示器的源级驱动器内设置两个驱动能力不同的驱动组件，并使用驱动能力较强的驱动组件驱动数据信号的极性翻转后的第一条数据线，而使用驱动能力相对较弱的驱动组件驱动极性不翻转的数据线，因此可以提高极性翻转的数据线上对应的像素的液晶电容的充电电压，改善了像素阵列在极性翻转行存在的暗线。
附图说明
为了更清楚地说明本申请实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本申请的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动性的前提下，还可以根据这些附图获得其他的附图。
图1为本申请所应用的液晶显示器的结构剖面示意图；
图2为本申请提供的液晶显示器的一种像素结构示意图；
图3为本申请提供的液晶显示器的另一种像素结构示意图；
图4为本申请提供的液晶显示器的又一种像素结构示意图；
图5为本申请提供的液晶显示器的阵列基板上像素区域的示意图；
图6为本申请提供的液晶显示器的电容充电电压的示意图；
图7为本申请提供的液晶显示器的一实施例的结构示意图；
图8为本申请提供的液晶显示器的源级驱动器的工作原理示意图；
图9为本申请提供的源级驱动器一实施例的结构示意图；
图10为本申请提供的输出缓冲电路的结构示意图；
图11为本申请提供的源级驱动器控制时序的示意图；
图12为本申请提供的液晶显示器的液晶电容充电电压一实施例的示意图；
图13为本申请提供的液晶显示器的液晶电容充电电压另一实施例的示意图；
图14为本申请提供的源级驱动器另一实施例的结构示意图；
图15为本申请提供的源级驱动器一实施例的结构示意图；
图16为本申请提供的源级驱动器控制时序的示意图；
图17为本申请提供的液晶显示器的液晶电容充电电压一实施例的示意图；
图18为本申请提供的液晶显示器的液晶电容充电电压另一实施例的示意图；
图19为本申请提供的源级驱动器另一实施例的结构示意图；
图20为本申请提供的液晶显示器驱动方法一实施例的流程示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请的说明书和权利要求书及上述附图中的术语“第一”、“第二”、“第三”、“第四”等(如果存在)是用于区别类似的对象，而不必用于描述特定的顺序或先后次序。应该理解这样使用的数据在适当情况下可以互换，以便这里描述的本申请的实施例例如能够以除了在这里图示或描述的那些以外的顺序实施。此外，术语“包括”和“具有”以及他们的任何变形，意图在于覆盖不排他的包含，例如，包含了一系列步骤或单元的过程、方法、系统、产品或设备不必限于清楚地列出的那些步骤或单元，而是可包括没有清楚地列出的或对于这些过程、方法、产品或设备固有的其它步骤或单元。
图1为本申请所应用的液晶显示器的结构剖面示意图，其中，液晶显示器包括相对间隔设置的TFT基板13和彩膜基板(color filter substrate，简称：CF基板)11。CF基板11上还设置有公共电极110，该公共电极可以是一整面透明导电膜，例如氧化铟(indium tinoxide，简称：ITO)薄膜。TFT基板13和CF基板11之间填充有液晶层12，在液晶层12的液晶盒中填充有液晶分子120，TFT基板13上设置的各种配线和像素电极等，可用于向液晶层12内的液晶分子120提供信号和电压，来改变液晶层12内液晶分子120的转动方向，从而达到控制液晶层12内每个像素点偏振光出射方向，进而在LCD的每个像素点上实现不同强度、不同颜色光线的显示。
图2为本申请提供的液晶显示器的一种像素结构示意图，如图2所示，为了对液晶层内不同像素的液晶分子进行驱动，在如图2所示的TFT基板上，包括：多条彼此平行并间隔设置的数据线：Data1、Data2、Data3、Data4……、多条彼此平行并间隔设置的栅极线：Gate1、Gate2、Gate3、Gate4……，并且数据线和栅极线彼此交错设置。在液晶层内的像素以矩阵形式排列，同时，像素矩阵中每个像素分别设置于相应的数据线和栅极线的交汇处，每个像素连接与其相邻的数据线、并连接与其相邻的两个栅极线。例如，P11连接相邻的栅极线Gate1和数据线Data1、P22连接相邻的栅极线Gate2和数据线Data2等。
图3为本申请提供的液晶显示器的另一种像素结构示意图，如图3所示，像素矩阵中按照交错方式与数据线连接，例如，位于奇数行的像素P11、P12、P13、P14、P31、P32、P33、P34等与其左侧的数据线连接，位于偶数行的像素P21、P22、P23、P24、P41、P42、P43、P44等与其右侧的数据线连接，以此类推。
图4为本申请提供的液晶显示器的又一种像素结构示意图，如图4所示，像素矩阵中每两行按照交错方式与数据线连接，例如，第1行和第2行的像素P11、P12、P13、P14、P21、P22、P23、P24等与其左侧的数据线连接，第3行和第4行的像素P31、P32、P33、P34、P41、P42、P43、P44等与其右侧的数据线连接，以此类推。
更为具体地，图5为本申请提供的液晶显示器的阵列基板上像素区域的示意图，如图5中所示的像素区域可以与图2-4中任一像素对应。如图5所示的像素区域包括一个薄膜晶体管(thin film transistor，简称：TFT)、一个液晶电容Clc和一个存储电容Cst。则当该像素区域对应的栅极线Gate上的驱动信号控制TFT导通时，数据线Data提供的数据信号经过TFT在液晶电容Clc上累积电荷，并在达到目标电压Vcom后进行放电，从而实现显示。
而为了避免液晶材料产生极化(polarization)而造成永久性的破坏，一些LCD中通过数据线Data在纵向做极性翻转的方式，对阵列基板上每个像素区域的液晶电容Clc和存储电容Cst两端电压的极性每间隔一段时间后进行翻转。例如，以如图2-4中任一列数据线Data为例，在该数据线Data每间隔两行进行依次正负极性的转换，使得数据线Data给行1和行2提供的数据信号的极性为正、给行3和行4提供的数据信号的极性为负、以此类推。
此时，对于数据线Data连接的像素，在行1、行3、行5等奇数行，所获得的信号并不能给液晶电容充电至目标电压。例如，图6为本申请提供的液晶显示器的电容充电电压的示意图，其中，行1、行3、行5等奇数行的像素的液晶电容的电压并不能达到目标电压，而行2、行4等偶数行的像素的液晶电容的电压却可以达到目标电压。最终使得LCD的像素阵列内所有奇数行像素的液晶电容的电压均小于偶数行像素的液晶电容的电压，从而在极性翻转的奇数行上形成一道暗线，导致液晶显示器具有水平横纹感，极大地影响了LCD的显示效果。
因此，本申请提供一种液晶显示器及其驱动方法，用于改善液晶显示器的像素阵列在极性翻转行存在的暗线，降低液晶显示器的水平横纹感，进而提高LCD的显示效果。
下面以具体地实施例对本申请的技术方案进行详细说明。下面这几个具体的实施例可以相互结合，对于相同或相似的概念或过程可能在某些实施例不再赘述。
图7为本申请提供的液晶显示器的一实施例的结构示意图，如图7所示的液晶显示器中的像素结构采用如图2所示的像素结构作为示例性的说明，而非对其进行限定，本实施例中液晶显示器还可以采用如图3、图4或者其他任意形式的像素结构。
本实施例提供的液晶显示器中，用于驱动多条数据线的源级驱动器1按照每n条数据线翻转极性的方式，依次向液晶显示器的多条数据线提供数据信号，所述n可以是2、4等任意大于或等于2的整数。并且本实施例提供的源级驱动器1内包括至少两个驱动组件，记为第一驱动组件11和第二驱动组件12，并分别为多条数据线中的第一类数据线和第二类数据线提供数据信号。
具体地，液晶显示器中的多条数据线，可以按照是否为进行极性翻转后的第一根数据线划分为第一类数据线和第二类数据线。其中，第一类数据线是指源级驱动器所依次提供的数据信号进行极性翻转后的第一条数据线，第二类数据线是指源级驱动器所依次提供的数据信号进行极性翻转后的第二条数据线，直到下一次极性翻转之前的最后一条数据线。例如，当如图7所示的多条数据线Data每间隔两行进行一次正负极性的转换时，则数据线中发生极性翻转的行1、行3对应的数据线为第一类数据线，数据线中发生极性翻转之后的行2、行4对应的数据线为第二类数据线，以此类推。
特别地，本实施例中，第一驱动组件11的驱动电流大于第二驱动组件12的驱动电流。即，第一驱动组件11的驱动能力大于第二驱动组件的驱动能力，使得第一驱动组件11向数据线“推出”的数据信号的电压能够大于第二驱动组件12向数据线“推出”的数据信号的电压。因此，本实施例中设置的第一驱动组件和第二驱动组件，能够使得极性翻转后的第一条数据线对应的像素的电容的电压增大，以抵消如图7所示的翻转后的第一条数据线对应的像素的电容的电压较低所造成的暗线。
本申请还提供两种上述液晶显示器的源级驱动器1中，第一驱动组件11和第二驱动组件12可能的实现方式，下面分别进行说明。
首先，图8为本申请提供的液晶显示器的源级驱动器的工作原理示意图，如图8所示，源级驱动器(source drivre IC)通过S1的Line Buffer模块接收到显示数据后，通过S2的Level Shift模块将低电平(3.3V)的数字信号转换为高电平(10V-18V)的数字信号，随后由S3的DAC模块将数字信号转换成模拟信号，S4的输出缓冲电路(Output Buffer)对模拟信号进行驱动后增加驱动能力得到数据信号，并输出到数据线上。
而为了在如图8所示的源级驱动器内，实现分别使用第一驱动组件和第二驱动组件向第一类数据线和第二类数据线提供数据信号，第一种可能的实现方式为在源级驱动器内设置两个输出缓冲电路，即，在图8中S4部分的一个输出缓冲电路的基础上，增加另一个输出缓冲电路，使得两个输出缓冲电路分别向第一类数据线和第二类数据线提供数据信号。在设计上，第一输出缓冲电路OP1的设计面积大于第二输出缓冲电路OP2的设计面积，并且推荐的面积比可以是4:3。
图9为本申请提供的源级驱动器一实施例的结构示意图，示出了源级驱动器中与本申请相关的部分。如图9所示，本实施例的源级驱动器中，包括第一输出缓冲电路OP1和第二输出缓冲电路OP2。其中，DAC的输出端分别连接第一输出缓冲电路OP1的输入端和第二输出缓冲电路OP2的输入端，第一输出缓冲电路OP1和第二输出缓冲电路OP2并联连接。同时，为了对第一输出缓冲电路OP1和第二输出缓冲电路OP2进行选择与控制，第一输出缓冲电路OP1还通过第一开关K1连接源级驱动器的输出端，第二输出缓冲电路OP2还通过第二开关K2连接源级驱动器的输出端。
第一输出缓冲电路OP1和第二输出缓冲电路OP2均可单独用于接收DAC模块发送的模拟信号，并对模拟信号进行驱动后得到数据信号，随后再通过源级驱动器的输出端将数据信号输出到对应的数据线。例如，图10为本申请提供的输出缓冲电路的结构示意图，如图10所示可以是第一输出缓冲电路OP1和第二输出缓冲电路OP2中任一个，该输出缓冲电路可以通过输出端接收DAC模块输出的模拟信号，并接收驱动电源VAA和驱动电源HVAA，在两个驱动电源的作用下，将模拟信号进行驱动后输出数据信号。
则对于采用如图9所示结构的源级驱动器，可以设置控制逻辑，对第一开关和第二开关进行控制。具体地，源级驱动器可以根据接收到的极性翻转(Polarity，简称：POL)信号和数据锁存(data latch)信号(可以是TP信号)，通过第一开关和第二开关进行控制，从而实现将DAC输出的模拟信号输入到第一输出缓冲电路OP1或者第二输出缓冲电路OP2进行处理并得到数据信号。
图11为本申请提供的源级驱动器控制时序的示意图，其中，当多条数据线Data每间隔两行进行一次正负极性的转换，源级驱动器所接收到的POL信号也按照每两行进行一次正负极的转换。则当源级驱动器接收到TP信号后，判断TP信号的上升沿接收到的POL信号的极性为正，且前一个POL信号的极性为负(之前POL信号的极性可以进行存储)时，说明POL信号的极性发生了变化，此时控制如图9所示的第一开关闭合、第二开关断开，使得DAC输出的模拟信号输入第一输出缓冲电路OP1中，由驱动能力更强的输出缓冲电路对模拟信号进行驱动，随后可以在TP信号的下降沿输出数据信号。而当源级驱动器接收到TP信号后，判断TP信号后，判断TP信号的上升沿接收到的POL信号的极性为正，且前一个POL信号的极性也为正，说明POL信号的极性未发生变化，此时控制如图9所示的第一开关断开、第二开关闭合，使得DAC输出的模拟信号输入第二输出缓冲电路OP2中，随后可以在TP信号的下降沿输出数据信号。
综上，在本实施例如图7-11提供的源级驱动器中，通过设置两个驱动能力不同的输出缓冲电路，并使用驱动能力较强的输出缓冲电路驱动数据信号的极性翻转后的第一条数据线，而使用驱动能力相对较弱的输出缓冲电路驱动极性不翻转的数据线(应理解，这里的较弱仅相对于第一条数据线对应的另一个输出缓冲电路，而非与其他设备上的输出缓冲电路进行比较)。因此，使用本实施例提供的源级驱动器的液晶显示器，可以提高极性翻转的数据线上对应的像素的液晶电容的充电电压，尽可能改善像素阵列在极性翻转行存在的暗线。
例如，图12为本申请提供的液晶显示器的液晶电容充电电压一实施例的示意图，在使用本实施例提供的源级驱动器后，与如图6所示的电压相比，能够有效地提高行1、行3、行5等极性翻转行上的液晶电容的电压，从而能够改善液晶显示器的像素阵列在极性翻转行存在的暗线，进而降低液晶显示器的水平横纹感，来提高LCD的显示效果。
又例如，图13为本申请提供的液晶显示器的液晶电容充电电压另一实施例的示意图，如图13示出了当多条数据线Data每间隔4行进行一次正负极性的转换时，源级驱动器的控制逻辑，同样根据TP信号的上升沿确定出POL信号的极性是否发生变化，并通过控制第一开关和第二开关，实现使用驱动能力较强的输出缓冲电路驱动数据信号的极性翻转后的第一条数据线。
可选地，图14为本申请提供的源级驱动器另一实施例的结构示意图，如图14所示的源级驱动器与如图9所示相比，将第一开关和第二开关通过选择开关来代替，使得源级控制器根据POL信号和TP信号，通过控制选择开关，选择第一输出缓冲电路OP1或者第二输出缓冲电路OP2对模拟信号进行驱动，同样能够实现驱动能力较强的第一输出缓冲电路OP1驱动数据信号的极性翻转后的第一条数据线。
而为了在如图8所示的源级驱动器内，实现分别使用第一驱动组件和第二驱动组件向第一类数据线和第二类数据线提供数据信号，第二种可能的实现方式为在输出缓冲电路接收驱动电源的路径上设置电阻，使得输出缓冲电路在对不同类的数据线进行驱动时使用的驱动电源的电流不同。
具体地，图15为本申请提供的源级驱动器一实施例的结构示意图，示出了源级驱动器中与本申请相关的部分。如图15所示，本实施例的源级驱动器中，包括第三输出缓冲电路31、第一电阻件32、第二电阻件33和选择开关34。其中，第三输出缓冲电路31和第一电阻件32构成第一驱动电路，当第三输出缓冲电路31通过第一电阻件32接收驱动电源VAA，进而对DAC输出的模拟信号进行驱动后得到数据信号并输出至数据线；第三输出缓冲电路31和第二电阻件33构成第二驱动电路，当第三输出缓冲电路31通过第二电阻件33接收驱动电源VAA，进而对DAC输出的模拟信号进行驱动后得到数据信号并输出至数据线。
在本实施例中第一电阻件的阻值小于第二电阻件的阻值。使得第三输出缓冲电路31通过第一电阻件32接收的驱动电源VAA的电流大于通过第二电阻件33接收的驱动电源VAA的电流，能够使得第一驱动组件的驱动能力大于第二驱动组件的驱动能力。或者，在另一种具体的实现方式中，在如图15所示的第一电阻件32的位置可以不设置电阻，使得第三输出缓冲电路31直接可以通过导线接收驱动电源VAA，同时，如图15所示的第二电阻件33的位置可以设置电阻。
则对于采用如图15所示结构的输出缓冲电路，源级驱动器可以设置控制逻辑，对选择开关34进行控制。具体地，源级驱动器可以根据接收到的极性翻转(Polarity，简称：POL)信号和数据锁存(data latch)信号(可以是TP信号)，通过选择开关34的导通方向进行选择(S1或S2)，从而实现第三输出缓冲电路在对DAC输出的模拟信号进行驱动时，所接收到的驱动电源VAA的电流的大小。
图16为本申请提供的源级驱动器控制时序的示意图，其中，当多条数据线Data每间隔两行进行一次正负极性的转换，源级驱动器所接收到的POL信号也按照每两行进行一次正负极的转换。则当源级驱动器接收到TP信号后，判断TP信号的上升沿接收到的POL信号的极性为正，且前一个POL信号的极性为负(之前POL信号的极性可以进行存储)时，说明POL信号的极性发生了变化，此时控制如图15所示的选择开关切换到选择端S1，第三输出缓冲电路31在对DAC输出的模拟信号进行驱动时，通过选择端S1连接的第一电阻件33接收驱动电源VAA。而当源级驱动器接收到TP信号后，判断TP信号后，判断TP信号的上升沿接收到的POL信号的极性为正，且前一个POL信号的极性也为正，说明POL信号的极性未发生变化，此时控制如图15所示的选择开关34切换到选择端S2，第三输出缓冲电路31在对DAC输出的模拟信号进行驱动时，通过选择端S2连接的第二电阻件32接收驱动电源VAA。
综上，在本实施例提供的源级驱动器中，第三输出缓冲电路在对DAC输出的模拟信号进行驱动得到数据信号时，使用不同阻值的电阻件接收驱动电源VAA，使得在驱动数据信号的极性翻转后的第一条数据线时接收到的驱动电源的电流更大，而在驱动数据信号的极性翻转后的第一条数据线时接收到的驱动电源的电流相对较小。因此，使用本实施例提供的源级驱动器的液晶显示器，可以提高极性翻转的数据线上对应的像素的液晶电容的充电电压，尽可能改善像素阵列在极性翻转行存在的暗线。
例如，图17为本申请提供的液晶显示器的液晶电容充电电压一实施例的示意图，在使用本实施例提供的源级驱动器后，与如图6所示的电压相比，能够有效地提高行1、行3、行5等极性翻转行上的液晶电容的电压，从而能够改善液晶显示器的像素阵列在极性翻转行存在的暗线，进而降低液晶显示器的水平横纹感，来提高LCD的显示效果。
又例如，图18为本申请提供的液晶显示器的液晶电容充电电压另一实施例的示意图，如图18示出了当多条数据线Data每间隔4行进行一次正负极性的转换时，源级驱动器的控制逻辑，同样根据TP信号的上升沿确定出POL信号的极性是否发生变化，并通过控制选择开关，实现在驱动数据信号的极性翻转后的第一条数据线时接收到的驱动电源的电流更大。
可选地，图19为本申请提供的源级驱动器另一实施例的结构示意图，如图19所示的源级驱动器与如图15所示相比，将第一电阻件、第二电阻件和选择开关统一通过滑动变阻器35来替代。同时，源级控制器根据POL信号和TP信号，通过控制滑动变阻器的电阻，使得第三输出缓冲电路在对DAC输出的模拟信号进行驱动得到数据信号时，使用不同阻值的电阻件接收驱动电源VAA。例如，当确定TP信号上升沿对应的POL信号的极性翻转时，将滑动变阻器的阻值调整为第一阻值；当确定TP信号上升沿对应的POL信号的极性未翻转时，将滑动变阻器的阻值调整为第二阻值，由于第一阻值大于第二阻值，同样能够实现在驱动数据信号的极性翻转后的第一条数据线时接收到的驱动电源的电流更大。
进一步地，基于上述实施例中提供的液晶显示器，本申请还提供一种液晶显示器的驱动方法，可应用于本申请前述任一实施例中，并由液晶显示器内的源级驱动器执行。
具体地，图20为本申请提供的液晶显示器驱动方法一实施例的流程示意图，如图20所示的驱动方法包括：
S101：确定源级驱动器当前正在控制的目标数据线属于第一类数据线或者第二类数据线。
其中，作为执行主体的源级驱动器可以具体通过接收到的TP信号和POL信号，当确定TP信号上升沿对应的POL信号的极性翻转时，确定目标数据线属于第一类数据线、当确定TP信号上升沿对应的POL信号的极性未翻转时，确定目标数据线属于第二类数据线。
S102：当确定目标数据线属于第一类数据线时，使用第一驱动组件向目标数据线提供数据信号。
在本步骤中，源级驱动器使用驱动能力较强的第一驱动组件向目标数据线提供数据信号。具体的实现方式与源级驱动器的不同设置相关，具体可以参照前述实施例中的记载，不再赘述，例如可以通过控制第一开关第二开关、或者可以通过控制选择开关、又或者可以通过控制滑动变阻器的方式选择第一驱动区间接收DAC输出的模拟信号。
S103：当确定目标数据线属于第二类数据线时，使用第二驱动组件向目标数据线提供数据信号。
在本步骤中，源级驱动器使用驱动能力相对于第一驱动组件较弱的第二驱动组件向目标数据线提供数据信号。具体的实现方式与源级驱动器的不同设置相关，具体可以参照前述实施例中的记载，不再赘述，例如可以通过控制第一开关第二开关、或者可以通过控制选择开关、又或者可以通过控制滑动变阻器的方式选择第二驱动区间接收DAC输出的模拟信号。
可选的，本申请实施例还提供一种可读存储介质，所述存储介质中存储有指令，当其在计算机上运行时，使得计算机执行如本申请前述如图20所示实施例中由源级驱动器所执行的方法。
可选的，本申请实施例还提供一种运行指令的芯片，所述芯片用于执行如图20所示实施例中由源级驱动器所执行的方法。
本申请实施例还提供一种程序产品，所述程序产品包括计算机程序，所述计算机程序存储在存储介质中，至少一个处理器可以从所述存储介质读取所述计算机程序，所述至少一个处理器执行所述计算机程序时可实现如图20所示实施例中由源级驱动器所执行的方法。
本领域普通技术人员可以理解：实现上述各方法实施例的全部或部分步骤可以通过程序指令相关的硬件来完成。前述的程序可以存储于一计算机可读取存储介质中。该程序在执行时，执行包括上述各方法实施例的步骤；而前述的存储介质包括：ROM、RAM、磁碟或者光盘等各种可以存储程序代码的介质。
最后应说明的是：以上各实施例仅用以说明本申请的技术方案，而非对其限制；尽管参照前述各实施例对本申请进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分或者全部技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例技术方案的范围。

Claims (11)

1.一种液晶显示器，其特征在于，包括：
多条数据线，沿第一方向平行间隔设置；
多条栅极线，沿第二方向平行间隔设置，所述第一方向和所述第二方向垂直，所述多条数据线和所述多条栅极线交叉设置；
多个像素区域；其中，每个像素区域位于两根栅极线和两根数据线之间，每个像素区域连接相邻的一根数据线和一根栅极线；
源级驱动器，用于按照每n条数据线翻转极性的方式，依次向所述多条数据线提供数据信号，n为大于等于2的整数；
所述源级驱动器包括：第一驱动组件和第二驱动组件；
所述第一驱动组件用于向所述多条数据线中第一类数据线提供数据信号，其中，所述第一类数据线包括数据信号的极性翻转后的第一条数据线；
所述第二驱动组件用于向所述多条数据线中第二类数据线提供数据信号，其中，所述第二类数据线包括数据信号的极性翻转后的第二条数据线到下一次极性翻转前的最后一条数据线之间的数据线；
其中，所述第一驱动组件的驱动电流大于所述第二驱动组件的驱动电流。
2.根据权利要求1所述的液晶显示器，其特征在于，
所述第一驱动组件包括：第一输出缓冲电路，用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；
所述第二驱动组件包括：第二输出缓冲电路，用于对所述DAC输出的模式信号进行驱动后得到数据信号，并输出至所述第二类数据线；
所述液晶显示器还包括：第一开关和第二开关；其中，所述DAC的输出端分别连接所述第一输出缓冲电路的输入端和所述第二输出缓冲电路的输入端，所述第一输出缓冲电路的输出端通过所述第一开关连接所述源级驱动器的输出端，所述第二输出缓冲电路的输出端通过所述第二开关连接所述源级驱动器的输出端，所述第一输出缓冲电路和所述第二输出缓冲电路并联连接。
3.根据权利要求2所述的液晶显示器，其特征在于，所述源级驱动器用于，
接收极性翻转POL信号和数据锁存TP信号；
当确定所述TP信号的上升沿对应的POL信号的极性翻转时，通过闭合所述第一开关、断开所述第二开关，将所述DAC输出的模拟信号输入所述第一驱动组件；
当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，通过断开所述第一开关、闭合所述第二开关，将所述DAC输出的模拟信号输入所述第二驱动组件。
4.根据权利要求1所述的液晶显示器，其特征在于，
所述第一驱动组件包括：第三输出缓冲电路和第一电阻件；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述第一电阻件接收驱动电源；
所述第二驱动组件包括：所述第三输出缓冲电路和第二电阻件；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述第二电阻件接收驱动电源；
所述第一电阻件的阻值大于所述第二电阻件的阻值；
所述液晶显示器还包括：选择开关；其中，所述第一驱动组件和所述第二驱动组件分别连接所述开关电路的两个选择端，所述开关电路的另一端用于接收所述驱动电源，所述第一电阻件和所述第二电阻件并联连接。
5.根据权利要求4所述的液晶显示器，其特征在于，所述源级驱动器用于，
接收极性翻转POL信号和数据锁存TP信号；
当确定所述TP信号的上升沿对应的POL信号的极性翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路通过所述第一电阻件接收所述驱动电源；
当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路通过所述第二电阻件接收所述驱动电源。
6.根据权利要求1所述的液晶显示器，其特征在于，
所述第一驱动组件包括：第三输出缓冲电路；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；
所述第二驱动组件包括：所述第三输出缓冲电路和第二电阻件；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述第二电阻件接收驱动电源；
所述液晶显示器还包括：选择开关；其中，所述第一驱动组件和所述第二驱动组件分别连接所述开关电路的两个选择端，所述开关电路的另一端用于接收所述驱动电源，第一电阻件和所述第二电阻件并联连接。
7.根据权利要求6所述的液晶显示器，其特征在于，所述源级驱动器用于，
接收极性翻转POL信号和数据锁存TP信号；
当确定所述TP信号的上升沿对应的POL信号的极性翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路接收所述驱动电源；
当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，通过控制所述选择开关，控制所述第三输出缓冲电路通过所述第二电阻件接收所述驱动电源。
8.根据权利要求1所述的液晶显示器，其特征在于，
所述第一驱动组件包括：第三输出缓冲电路和第一阻值的滑动变阻器；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述滑动变阻器接收驱动电源；
所述第二驱动组件包括：所述第三输出缓冲电路和第二阻值的所述滑动变阻器；其中，所述第三输出缓冲电路用于对数字模拟转换DAC输出的模拟信号进行驱动后得到数据信号，并输出至所述第一类数据线；所述第三输出缓冲电路通过所述滑动变阻器接收驱动电源；
所述第一阻值大于所述第二阻值。
9.根据权利要求8所述的液晶显示器，其特征在于，所述源级驱动器用于，
接收极性翻转POL信号和数据锁存TP信号；
当确定所述TP信号的上升沿对应的POL信号的极性翻转时，将所述滑动变阻器的阻值调整为所述第一阻值；
当确定所述TP信号的上升沿对应的POL信号的极性未翻转时，将所述滑动变阻器的阻值调整为所述第二阻值。
10.一种液晶显示器的驱动方法，应用于源级驱动器，其特征在于，所述源级驱动器包括：第一驱动组件和第二驱动组件，所述第一驱动组件的驱动电流大于所述第二驱动区间的驱动电流；所述第一驱动组件用于向多条数据线中第一类数据线提供数据信号，所述第一类数据线包括数据信号的极性翻转后的第一条数据线；所述第二驱动组件用于向所述多条数据线中第二类数据线提供数据信号，所述第二类数据线包括数据信号的极性翻转后的第二条数据线到下一次极性翻转前的最后一条数据线之间的数据线；所述方法包括：
确定目标数据线属于所述第一类数据线或者所述第二类数据线；
当所述目标数据线属于所述第一类数据线，使用所述第一驱动组件向所述目标数据线提供数据信号；
当所述目标数据线属于所述第二类数据线，使用所述第二驱动组件向所述目标数据线提供数据信号。
11.根据权利要求10所述的驱动方法，其特征在于，所述确定目标数据线属于所述第一类数据线或者所述第二类数据线，包括：
接收极性翻转POL信号和数据锁存TP信号；
通过所述TP信号的上升沿对应的POL信号的极性是否翻转，确定目标数据线属于所述第一类数据线或者所述第二类数据线。
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