CN112394578B - 阵列基板、显示面板及其驱动方法 - Google Patents

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Abstract

一种阵列基板、显示面板及其驱动方法。该阵列基板包括沿第一方向和第二方向阵列排布的多个子像素；沿第一方向延伸的多条栅线以及沿第二方向延伸的多条数据线。多条数据线包括沿第一方向交替设置的第一数据线和第二数据线，第一数据线和第二数据线之间设置有沿第二方向排列的两列子像素，第一数据线和第二数据线分别被配置为传输不同极性的数据信号。沿第一方向排列的相邻两个子像素分别连接至第一数据线和第二数据线，且沿第二方向排列的相邻两个子像素分别连接至第一数据线和第二数据线。采用本公开实施例提供的阵列基板的显示装置中，各子像素在同一帧显示画面中的亮度分布均匀以尽量避免摇头纹不良。

Description

阵列基板、显示面板及其驱动方法
技术领域
本公开至少一个实施例涉及一种阵列基板、显示面板及其驱动方法。
背景技术
双栅线(dual gate)技术是将显示装置中的数据线的数量减少一半，栅线的数量增加一倍的驱动技术，即，将与数据线连接的源极驱动集成电路数量减半，将与栅线连接的栅极驱动集成电路的数量加倍。由于栅极驱动集成电路的单价比源极驱动集成电路的单价便宜，从而实现成本的降低。
发明内容
本公开的至少一实施例提供一种阵列基板、显示面板及其驱动方法。阵列基板包括：沿第一方向和第二方向阵列排布的多个子像素；沿所述第一方向延伸的多条栅线；以及沿所述第二方向延伸的多条数据线。所述多条数据线包括沿所述第一方向交替设置的第一数据线和第二数据线，所述第一数据线和所述第二数据线之间设置有沿所述第二方向排列的两列所述子像素，所述第一数据线和所述第二数据线分别被配置为传输不同极性的数据信号，且连接至同一数据线的不同子像素连接至不同栅线。沿所述第一方向排列的相邻两个子像素分别连接至所述第一数据线和所述第二数据线，且沿所述第二方向排列的相邻两个子像素分别连接至所述第一数据线和所述第二数据线。
在一些示例中，所述多个栅线包括沿所述第二方向交替设置的第一栅线和第二栅线，且沿所述第二方向排列的相邻两个所述子像素之间设置有所述第一栅线和所述第二栅线形成的栅线对。
在一些示例中，沿所述第一方向排列的所述子像素中，连接至同一数据线的两个子像素之间设置有奇数个子像素。
在一些示例中，沿所述第一方向排列的所述子像素中，连接至同一数据线的所述两个子像素之间设置有一个子像素。
在一些示例中，沿所述第一方向排列的所述相邻两个子像素分别连接至相邻的所述第一数据线和所述第二数据线。
在一些示例中，沿所述第二方向排列的所述子像素中，连接至同一数据线的两个子像素之间设置有奇数个子像素。
在一些示例中，沿所述第二方向排列的所述子像素中，连接至同一数据线的所述两个子像素之间设置有一个子像素。
在一些示例中，沿所述第二方向排列的所述相邻两个子像素分别连接至相邻的所述第一数据线和所述第二数据线。
在一些示例中，分别与沿所述第二方向排列的所述相邻两个子像素连接的两条栅线均位于所述相邻两个所述子像素之间，或者分别位于所述相邻两个所述子像素沿所述第二方向的两侧。
在一些示例中，沿所述第一方向排列的所述子像素中，位于同一数据线两侧且与该数据线紧邻的两个子像素连接至不同数据线。
在一些示例中，所述多个子像素划分为沿所述第一方向和所述第二方向阵列排布的多个子像素组，各子像素组包括沿所述第一方向排列的两个子像素；相邻的所述第一数据线和所述第二数据线之间设置有沿所述第二方向排列的一排所述子像素组，所述第一数据线和所述第二数据线分别与位于两者之间的子像素组中的所述两个子像素连接。所述子像素组包括第一子像素组和第二子像素组，所述第一子像素组中的子像素均连接至靠近该子像素的所述数据线，所述第二子像素组中的子像素均连接至远离该子像素的所述数据线，且所述第一子像素组和所述第二子像素组沿所述第一方向和所述第二方向均交替排列。
在一些示例中，沿所述第二方向排列的一排子像素的颜色相同，且沿所述第一方向排列的所述相邻两个子像素的颜色不同。
在一些示例中，沿所述第一方向排列的相邻的相同颜色子像素分别连接至所述第一数据线和所述第二数据线。
本公开的至少一实施例提供一种显示装置，包括上述阵列基板。
本公开的至少一实施例提供一种显示装置的驱动方法。该驱动方法包括：对所述多条栅线中的至少一条栅线输入栅极信号，以控制与所述至少一条栅线连接的子像素包括的薄膜晶体管开启或关闭。所述栅极信号被配置为处于至少三个阶段，所述至少三个阶段包括第一阶段、第二阶段以及第三阶段，在所述第一阶段中，所述栅极信号处于第一电平以对所述薄膜晶体管输入所述开启电压；在所述第二阶段中，所述栅极信号处于第二电平以保持所述薄膜晶体管处于开启状态，所述第二电平低于所述第一电平；以及在所述第三阶段中，所述栅极信号处于第三电平以使所述薄膜晶体管处于关闭状态。
附图说明
为了更清楚地说明本公开实施例的技术方案，下面将对实施例的附图作简单地介绍，显而易见地，下面描述中的附图仅仅涉及本公开的一些实施例，而非对本公开的限制。
图1A为一种双栅型阵列基板的局部结构示意图；
图1B为图1A所示的阵列基板用于显示时产生的周期性竖条纹；
图1C为对图1A所示的像素结构输入栅极信号时第一颜色子像素的像素电压波形图；
图1D为图1A所示的像素结构的部分子像素的亮度分布图；
图2A为本公开一实施例提供的阵列基板；
图2B为图2A所示的阵列基板中的子像素的亮度分布图；
图2C为本公开一实施例提供的阵列基板；以及
图3为对包括图2A所示的阵列基板的显示装置驱动时的时序图。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例的附图，对本公开实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本公开的一部分实施例，而不是全部的实施例。基于所描述的本公开的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其它实施例，都属于本公开保护的范围。
除非另外定义，本公开使用的技术术语或者科学术语应当为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。
在研究中，本申请的发明人发现：采用双栅技术的显示装置在应用列反转驱动方法时，容易产生摇头纹(V-line)等显示不良，也就是用户在摇头时会观察到显示屏出现了周期性明暗相间的竖条纹。
图1A为一种双栅型阵列基板的局部结构示意图。如图1A所示，该阵列基板包括沿X方向(行方向)和Y方向(列方向)阵列排布的多个子像素，多个子像素包括红色子像素10、绿色子像素20以及蓝色子像素30。阵列基板还包括沿Y方向延伸的数据线40以及沿X方向延伸的第一栅线51和第二栅线52，且相邻两条数据线40之间设置有两列子像素，第一栅线51和第二栅线52分别位于每行子像素沿Y方向的两侧。位于任一数据线40两侧且与该数据线40紧邻的子像素均连接至该数据线40，例如，红色子像素10和与其相邻的绿色子像素20(或者蓝色子像素30)均连接至位于两者之间的数据线40。连接至同一数据线40的不同子像素连接至不同栅线，例如，沿X方向排列的子像素中，连接至同一数据线40的两个子像素之一与第一栅线51连接，另一个与第二栅线52连接。
如图1A所示，可以采用列反转的方式对包括图1A所示的阵列基板的显示装置进行驱动。列反转方法(column inversion method)是指每隔既定的子像素列数，就将显示数据的极性反转。对于列反转方法，在一帧(frame)中，每条数据线上的数据信号的极性始终为同一极性(正极性或负极性)。如图1A所示，与同一条数据线40连接的两个子像素列所储存的电压极性都是相同的，且分别与相邻的两条数据线40连接的两个子像素列所储存的电压极性相反。
如图1A所示，在一帧中，第一条数据线41上的数据信号为正极性，第二条数据线42上的数据信号为负极性，第三条数据线43上的数据信号为正极性，即沿X方向，数据线40上的数据信号极性正负交替。由此，在一帧中，与第一条数据线41连接的两个子像素列被充入正极性数据信号，与第二条数据线42连接的两个子像素列被充入负极性数据信号，与第三条数据线43连接的两个子像素列被充入正极性数据信号，以此类推。从而，在一帧中，沿X方向排列的子像素列被充入数据信号的极性为正正负负的周期循环。
如图1A所示，在一帧中，第一条数据线41和第二条数据线42之间的两个子像素列被充入数据信号的极性分别为正极性和负极性。由此，在一帧中，相邻两条数据线之间的子像素列的亮度可以平均。然而，在一帧中，第一条数据线41和第三条数据线43之间的四个子像素列被充入数据信号的极性分别为正负负正，位于中间的相邻的两个子像素列充入数据信号的极性相同。在存在上述相邻两个子像素列被充入数据信号的极性相同的情况时，同一帧中，阵列基板上分布的子像素整体的亮暗可能出现无法中和的现象，需要在下一帧中，通过改变每条数据线上的数据信号的极性，才可以保证阵列基板上分布的子像素整体的亮度均匀。
在用户的眼睛固定且持续观察包括如图1A所示的阵列基板的显示装置时，由于下一帧中的数据线上的数据信号的极性都会被反转，所以相邻帧中，每个子像素列的亮度叠加后，亮度均匀；而在用户进行摇头时，可能会出现观察的画面丢帧，导致同一帧中亮度不能平均的相邻两个子像素列失去在下一帧中的亮度被中和的可能，从而产生了图1B所示的周期性竖条纹。
图1C为对图1A所示的像素结构输入栅极信号时第一颜色子像素的像素电压波形图，图1D为图1A所示的像素结构的部分子像素的亮度分布图。如图1A-图1D所示，阵列基板中栅线的开启顺序依次为G1-G2-G4-G3，即上述阵列基板上的栅线采用弓形扫描列反转方式。由于上述阵列基板为双栅型阵列基板，栅线会对相邻且不相连的子像素产生耦合电容。当该栅线上的栅极信号跳变时，通过电容耦合作用，与该栅线相邻且不相连的子像素的像素电压也会产生跳变，导致该子像素的亮度发生变化。
例如，如图1C所示，向栅线G1输入的栅极信号处于有效电平(能够使薄膜晶体管处于开启状态的电平)时，栅线G1对第一行第一列的第一颜色子像素10包括的薄膜晶体管施加开启电压，该第一颜色子像素10进行充电；在向栅线G2输入栅极信号时，第一颜色子像素10与栅线G2之间产生的耦合电容导致第一颜色子像素10的像素电压Vp发生跳变，但此时由于第一颜色子像素10仍然处于充电状态，所以第一颜色子像素10的像素电压Vp被拉回充电电压。在栅线G1上的栅极信号由有效电平变化为无效电平(能够使薄膜晶体管处于关闭状态的电平)时，第一颜色子像素10的薄膜晶体管关闭，第一颜色子像素10因其薄膜晶体管的栅极与源极之间的寄生电容Cgs的作用，会使得像素电压Vp下降ΔVp。然后在栅线G2上的栅极信号由有效电平变化为无效电平时，第一颜色子像素10由于其与栅线G2之间的耦合电容的影响而导致其像素电压Vp再次下降ΔVp’。由此，在上述被耦合电容影响的子像素被输入的数据信号为正极性时，该子像素的亮度会变暗(如图1D所示的位于第一行第一列的子像素中的加号表示被输入的数据信号为正极性，下箭头表示亮度变暗)；在上述被耦合电容影响的子像素被输入的数据信号为负极性时，该子像素的颜色会变亮(如图1D所示的位于第一行第三列的子像素的减号表示被输入的数据信号为负极性，上箭头表示亮度变亮)；而没有被耦合电容影响的子像素无论被输入的数据信号为正极性还是负极性，该子像素的亮度不变(如图1D所示的位于第一行第二列的子像素和位于第一行第四列的子像素的亮度均不变)。
如图1D所示，上述阵列基板上的栅线采用列反转方式时，子像素整体会出现亮度不均匀的现象，导致在用户摇头观看显示装置时，也会出现丢帧现象，从而出现竖条纹。
本公开的实施例提供一种阵列基板、显示面板及其驱动方法。该阵列基板包括：沿第一方向和第二方向阵列排布的多个子像素；沿第一方向延伸的多条栅线；以及沿第二方向延伸的多条数据线。多条数据线包括沿第一方向交替设置的第一数据线和第二数据线，第一数据线和第二数据线之间设置有沿第二方向排列的两列子像素，第一数据线和第二数据线分别被配置为传输不同极性的数据信号，且连接至同一数据线的不同子像素连接至不同栅线。沿第一方向排列的相邻两个子像素分别连接至第一数据线和第二数据线，且沿第二方向排列的相邻两个子像素分别连接至第一数据线和第二数据线。采用本公开实施例提供的阵列基板的显示装置中，各子像素在同一帧显示画面中的亮度分布均匀以尽量避免摇头纹不良。
下面结合附图对本公开实施例提供的阵列基板、显示面板及其驱动方法进行描述。
图2A为根据本公开实施例提供的阵列基板。如图2A所示，阵列基板包括：沿第一方向和第二方向阵列排布的多个子像素100、沿第一方向延伸的多条栅线200以及沿第二方向延伸的多条数据线300。例如，本公开实施例示意性的以图2A中的平行于X方向的方向为第一方向，平行于Y方向的方向为第二方向。
如图2A所示，多条数据线300包括沿第一方向交替设置的第一数据线310和第二数据线320，第一数据线310和第二数据线320之间设置有沿第二方向排列的两列子像素100，本公开实施例以沿Y方向排列的一排子像素100为子像素列为例，则第一数据线310与第二数据线320之间设置有两个子像素列。第一数据线310和第二数据线320分别被配置为传输不同极性的数据信号，且连接至同一数据线300的不同子像素100连接至不同栅线300。例如，本公开实施例示例性的示出第一数据线310被配置为传输正极性的数据信号，第二数据线320被配置为传输负极性的数据信号。本公开实施例不限于此，还可以第一数据线被配置为传输负极性的数据信号，第二数据线被配置为传输正极性的数据信号，只要两个数据线分别被配置为传输不同极性的数据信号即可。
如图2A所示，沿第一方向排列的相邻两个子像素100分别连接至第一数据线310和第二数据线320，且沿第二方向排列的相邻两个子像素100分别连接至第一数据线310和第二数据线320。本公开实施例提供的阵列基板用于显示画面时，沿第一方向和第二方向排列的子像素在同一帧中被施加相反极性的数据信号，可以使各子像素在同一帧显示画面中亮度分布均匀，从而尽量避免摇头纹的出现。
例如，如图2A所示，本公开实施例示意性的示出7条数据线300，沿X方向的箭头所指的方向，7条数据线300分别为数据线S1-S7，数据线S1、S3、S5以及S7为第一数据线310(例如被输入正极性的数据信号)，数据线S2、S4以及S6为第二数据线320(例如被输入负极性的数据信号)。
例如，如图2A所示，各子像素100包括薄膜晶体管，薄膜晶体管的栅极连接至栅线200，薄膜晶体管的源极和漏极之一连接至数据线300，薄膜晶体管的源极和漏极的另一个连接至子像素100包括的像素电极。
在一些示例中，如图2A所示，多个栅线200包括沿第二方向交替设置的第一栅线210和第二栅线220，沿第二方向排列的相邻两个子像素100之间设置有第一栅线210和第二栅线220形成的栅线对。本公开实施例以沿X方向排列的一排子像素100为子像素行，则相邻两个子像素行之间设置有第一栅线210和第二栅线220。本公开实施例提供的阵列基板为双栅线型(dual gate)阵列基板，采用双栅线型阵列基板的显示装置可以降低成本。
例如，如图2A所示，本公开实施例示意性的示出8条栅线，沿与Y方向的箭头指向相反的方向，8条栅线分别为栅线G1-G8。栅线G1、G3、G5以及G7为第一栅线210，栅线G2、G4、G6以及G8为第二栅线220。
在一些示例中，沿第一方向排列的子像素100中，连接至同一数据线300的两个子像素100之间设置有奇数个子像素100，从而使沿第一方向排列的相邻两个子像素100可以分别连接至第一数据线310和第二数据线320。例如，图2C为本公开一实施例的阵列基板。为了更清楚地图示，图2C仅仅示出了各个子像素100与数据线的连接关系，子像素与栅线的栅线的连接关系例如可以参考其他实施例。如图2C所示，沿第一方向排列的子像素100中，连接至同一数据线300的两个子像素100之间设置有三个子像素100。
例如，沿X方向排列的子像素100中，连接至同一数据线300的两个子像素100之间的子像素100的数量可以为一个、三个等。例如，为了简化数据线300与子像素100连接线的布局，如图2A所示，可以将连接至同一数据线300的两个子像素100之间设置的子像素100的数量设置为一个。
在一些示例中，如图2A所示，沿第一方向排列的相邻两个子像素100分别连接至相邻的第一数据线310和第二数据线320，可以方便子像素中的薄膜晶体管与数据线的连接。
在一些示例中，沿第二方向排列的子像素100中，连接至同一数据线300的两个子像素100之间设置有奇数个子像素100，从而使沿第二方向排列的相邻两个子像素100可以分别连接至第一数据线310和第二数据线320。
例如，沿Y方向排列的子像素100中，连接至同一数据线300的两个子像素100之间的子像素100的数量可以为一个、三个等。例如，为了简化数据线300与子像素100连接线的布局，如图2A所示，可以将连接至同一数据线300的两个子像素100之间设置的子像素100的数量设置为一个。
例如，如图2A所示，沿第一方向和第二方向排列的子像素100中，连接至同一数据线300的两个子像素100之间均设置一个子像素100。
在一些示例中，如图2A所示，沿第二方向排列的相邻两个子像素100分别连接至相邻的第一数据线310和第二数据线320，可以方便子像素中的薄膜晶体管与数据线的连接。
在一些示例中，如图2A所示，分别与沿第二方向排列的相邻两个子像素100连接的两条栅线200可以均位于这两个相邻的子像素100之间，也可以分别位于这两个相邻的子像素100沿第二方向的两侧。
例如，如图2A所示，第一个子像素列中，第二个子像素和第三个子像素分别连接至同一栅线组中的第一栅线210和第二栅线220，即第二个子像素的薄膜晶体管位于其靠近第三个子像素的一侧，且第三个子像素的薄膜晶体管位于其靠近第二个子像素的一侧。第一个子像素列中，第三个子像素和第四个子像素分别连接至不同栅线组中的栅线，且第四个子像素的薄膜晶体管位于其远离第三个子像素的一侧。
在一些示例中，如图2A所示，沿第一方向排列的子像素100中，位于同一数据线300两侧且与该数据线300紧邻的两个子像素100连接至不同数据线300。本公开实施例中通过将位于数据线两侧且与该数据线紧邻的两个子像素连接至不同数据线，以使沿第一方向排列的相邻的两个子像素被输入的数据信号的极性不再相同，从而使整个显示画面的亮度均匀以尽量避免摇头纹的出现。
例如，在相邻的第一数据线310和第二数据线320之间的两个子像素列之间还可以设置用于触控的触控电极线(图中未示出)，该触控电极线平行于数据线300。
在一些示例中，如图2A所示，多个子像素100划分为沿第一方向和第二方向阵列排布的多个子像素组1000，各子像素组1000包括沿第一方向排列的两个子像素100，相邻的第一数据线310和第二数据线320之间设置有沿第二方向排列的一排子像素组1000，各子像素组1000中的两个子像素100分别连接至位于该子像素组1000两侧的第一数据线310和第二数据线320。也就是，相邻的第一数据线310和第二数据线320分别与位于这两者之间的子像素组1000中的两个子像素100连接。并且，子像素组1000包括第一子像素组1100和第二子像素组1200，第一子像素组1100中的子像素100均连接至靠近该子像素100的数据线300，第二子像素组1200中的子像素100均连接至远离该子像素100的数据线300，且第一子像素组1100和第二子像素组1200沿第一方向和第二方向均交替排列。也就是，第一子像素组1100中的子像素100连接至与其紧邻的数据线300，而第二子像素组1200中的子像素100和与其连接的数据线300之间设置有另一个子像素100。
例如，如图2A所示，多个子像素100可以包括第一颜色子像素110、第二颜色子像素120以及第三颜色子像素130，沿第二方向排列的一排子像素100的颜色相同，且沿第一方向排列的相邻两个子像素100的颜色不同。也就是，同一子像素列中的子像素100的颜色均为同一种颜色，同一子像素行中可以包括交替排列的第一颜色子像素110、第二颜色子像素120以及第三颜色子像素130。即，沿X方向排列的子像素100可以依次为第一颜色子像素110、第二颜色子像素120以及第三颜色子像素130。
例如，第一颜色子像素110可以为红色子像素，第二颜色子像素120可以为绿色子像素，第三颜色子像素130可以为蓝色子像素。
在一些示例中，如图2A所示，沿第一方向排列的相邻的相同颜色子像素100分别连接至第一数据线310和第二数据线320。
例如，如图2A所示，位于第一行的沿X方向排列的第一颜色子像素110依次与数据线S1、数据线S2、数据线S5和数据线S6连接，从而保证沿第一方向排列的相邻的相同颜色子像素分别被输入不同极性的驱动数据信号，以保证最后显示画面的亮度均匀性。
例如，图2B为图2A所示的阵列基板中的子像素的亮度分布图。如图2A所示，位于第一行且沿X方向排列的子像素100中，第一个子像素连接至栅线G1和数据线S1，第二个子像素120连接至栅线G2和数据线S2，第三个子像素连接至栅线G2和数据线S3，第四个子像素连接至栅线G1和数据线S2，第五个子像素连接至栅线G1和数据线S3，第六个子像素连接至栅线G2和数据线S4，第七个子像素连接至栅线G2和数据线S5，第八个子像素连接至栅线G1和数据线S4，第九个子像素连接至栅线G1和数据线S5，第十个子像素连接至栅线G2和数据线S6，第十一个子像素连接至栅线G2和数据线S7，第十二个子像素连接至栅线G1和数据线S6。数据线S1、S3、S5以及S7被配置为传输正极性的数据信号，数据线S2、S4以及S6被配置为传输负极性的数据信号。
例如，本公开实施例以阵列基板中栅线的开启顺序依次为G1-G2-G4-G3-G5-G6-G8-G7为例进行描述。本公开实施例不限于此，栅线的开启顺序还可以采用其他顺序。
例如，如图2A和图2B所示，以位于第一行的子像素、栅线G1和栅线G2为例进行描述，向栅线G1输入的栅极信号处于有效电平时，栅线G1对与栅线G1连接的第一个子像素、第四个子像素、第五个子像素、第八个子像素、第九个子像素以及第十二个子像素的薄膜晶体管施加开启电压，上述六个子像素进行充电，上述有效电平指可以使薄膜晶体管处于开启状态的电压；然后向栅线G2输入栅极信号后，上述六个子像素中的像素电压因受到与栅线G2产生的耦合电容的影响而产生电压跳变。由于第一个子像素、第五个子像素以及第九个子像素与传输正极性数据信号的数据线连接，因此，在栅线G2上的栅极信号处于无效电平后，第一个子像素、第五个子像素以及第九个子像素的亮度会变暗(如图2B所示的加号表示被输入的数据信号的极性为正极性，下箭头表示子像素的亮度变暗)；由于第四个子像素、第八个子像素以及第十二个子像素与传输负极性数据信号的数据线连接，因此，在栅线G2上的栅极信号处于无效电平后，第四个子像素、第八个子像素以及第十二个子像素的亮度会变亮(如图2B所示的减号表示被输入的数据信号的极性为负极性，上箭头表示子像素的亮度变亮)；由于位于第一行的与栅线G2连接的第二个子像素、第三个子像素、第六个子像素、第七个子像素、第十个子像素以及第十一个子像素没有被耦合电容影响像素电压，因此亮度不变(如图2B所示的没有上箭头或者下箭头的子像素的亮度不变)。由此，位于第一行且沿X方向排列的子像素的亮度分布依次为最暗、中亮、中亮、最亮、最暗、中亮、中亮、最亮、最暗、中亮、中亮以及最亮。同理，如图2B所示的其他子像素的亮度变化规律同上。由此，本公开实施例通过调整子像素中的薄膜晶体管与数据线的连接关系，尽量使相邻两个子像素列的亮度中和以使包括上述像素结构的显示装置在同一帧显示画面中的亮度均匀，避免摇头纹的出现。
例如，上述阵列基板可以为用于液晶显示面板的阵列基板。每个子像素可以包括一个像素电极，该像素电极与相应的数据线连接。
例如，上述数据线按照在第一方向上的排列顺序，可以分为奇数列数据线和偶数列数据线。奇数列数据线和偶数列数据线交替设置。例如，奇数列数据线可以被配置为施加正极性数据信号，偶数列数据线可以被配置为施加负极性数据信号；或者，奇数列数据线可以被配置为施加负极性数据信号，偶数列数据线可以被配置为施加正极性数据信号。
例如，上述正极性和负极性数据信号的施加可以由数据线相连的数据驱动器来控制。例如，数据驱动器被配置为给奇数列数据线施加正极性数据信号，给偶数列数据线施加负极性数据信号；或者，给奇数列数据线施加负极性数据信号，给偶数列数据线施加正极性数据信号。
本公开另一实施例提供一种显示装置，包括上述阵列基板。采用本公开实施例提供的显示装置中，各子像素在同一帧显示画面中亮度分布均匀以尽量避免摇头纹的出现。
例如，该显示装置可以为液晶显示器件以及包括该液晶显示器件的电视、数码相机、手机、手表、平板电脑、笔记本电脑、导航仪等任何具有显示功能的产品或者部件，本实施例不限于此。
本公开另一实施例提供一种对上述显示装置的驱动方法，该驱动方法包括对多条栅线中的至少一条栅线输入栅极信号，以控制与该栅线连接的子像素包括的薄膜晶体管开启或关闭。栅极信号被配置为处于至少三个阶段，至少三个阶段包括第一阶段、第二阶段以及第三阶段。在第一阶段中，栅极信号处于第一电平以对薄膜晶体管输入开启电压；在第二阶段中，栅极信号处于第二电平以保持薄膜晶体管处于开启状态，第二电平低于第一电平；以及在第三阶段中，栅极信号处于第三电平以使薄膜晶体管处于关闭状态。
图3为对包括图2A所示的阵列基板的显示装置驱动时的时序图。如图2A和图3所示，对栅线G1输入栅极信号以控制与栅线G1连接的位于第一行的第一个子像素100的薄膜晶体管开启，数据线S1通过被开启的薄膜晶体管对第一个子像素100进行充电，以使第一个子像素100的像素电压Vp逐渐增加到充电电压值。
例如，对栅线G1输入的栅极信号被配置为处于至少三个阶段，图3示意性的示出薄膜晶体管为N型为例，但不限于此。图3示意性的示出栅极信号处于四个阶段，但不限于此，只要大于三个阶段即可。如图3所示，在第一阶段P1中，栅极信号处于第一电平(有效电平)以对第一个子像素100的薄膜晶体管输入开启电压，数据线S1对位于第一行的第一个子像素100输入数据信号。然后栅极信号逐渐减小至第二阶段P2，第二阶段P2中的栅极信号处于第二电平(有效电平)以保持薄膜晶体管仍处于开启状态，且第二电平低于第一电平。图3中示意性示出第二电平为0V，但不限于此，还可以是4V或者大于0V的电平以保持薄膜晶体管仍处于开启状态。在栅极信号由第一电平下降到第二电平的过程中，像素电压Vp也在下降，且栅线G1的栅极信号处于第二电平时，像素电压Vp也处于平缓阶段。栅线G1的栅极信号从第二阶段P2到第三阶段P3的过程中，栅极信号由第二电平减小至第三电平(无效电平)，以使第一个子像素100的薄膜晶体管处于关闭状态。在栅极信号由第二电平下降到第三电平的过程中，像素电压Vp也在下降，且栅线G1的栅极信号处于第三阶段中的第三电平时，像素电压Vp也处于平缓阶段。由此，在栅线G1的栅极信号由第一电平分阶段下降至第三电平的过程中，像素电压Vp下降了ΔVp，相比于第一电平直接下降至第三电平的过程，本公开实施例中通过将栅极信号分阶段下降至使薄膜晶体管处于关闭状态的第三电平，可以使得像素电压Vp下降的电压ΔVp更少。
如图3所示，在栅线G1上的栅极信号下降至第三电平之前，还包括第四阶段P4，此时栅极信号处于第四电平，第四电平可以是有效电平，也可以是无效电平，本公开实施例对此不作限制。在第四电平为有效电平时，第一个子像素100的薄膜晶体管仍处于开启状态，第四电平小于第二电平。在栅极信号由第二电平下降到第四电平的过程中，像素电压Vp也在下降，且栅线G1的栅极信号处于第四阶段中的第四电平时，像素电压Vp也处于平缓阶段。栅线G1的栅极信号从第四阶段P4到至第三阶段P3的过程中，栅极信号由第四电平减小至第三电平以使第一个子像素100的薄膜晶体管处于关闭状态。由此，在栅线G1的栅极信号由第一电平依次下降至第二电平、第四电平以及第三电平的过程中，像素电压Vp下降了ΔVp，相比于第一电平直接下降至第三电平的过程，本公开实施例中通过将栅极信号分阶段下降至第三电平可以使得像素电压Vp下降的电压ΔVp更少。
例如，对栅线G2输入的栅极信号也被配置为处于与栅线G1相同的四个阶段。由于输入栅线G2的栅极信号不是直接从第一电平降低到第三电平，而是采用分阶段下降方式下降至第三电平，该过程可以降低栅线G2与第一个子像素100产生的耦合电容对第一个子像素100的像素电压Vp的影响，以使该像素电压Vp再次下降的电压ΔVp’尽量小。
由此，本公开实施例通过对输入栅线中的栅极信号分阶段降低至无效电平，可以进一步降低耦合电容对像素电压的影响，从而进一步改善摇头纹不良。
有以下几点需要说明：
(1)本公开的实施例附图中，只涉及到与本公开实施例涉及到的结构，其他结构可参考通常设计。
(2)在不冲突的情况下，本公开的同一实施例及不同实施例中的特征可以相互组合。
以上所述仅是本公开的示范性实施方式，而非用于限制本公开的保护范围，本公开的保护范围由所附的权利要求确定。

Claims (13)

1.一种显示装置的驱动方法，所述显示装置包括阵列基板，所述阵列基板包括：
沿第一方向和第二方向阵列排布的多个子像素；
沿所述第一方向延伸的多条栅线；以及
沿所述第二方向延伸的多条数据线，所述多条数据线包括沿所述第一方向交替设置的第一数据线和第二数据线，所述第一数据线和所述第二数据线之间设置有沿所述第二方向排列的两列所述子像素，所述第一数据线和所述第二数据线分别被配置为传输不同极性的数据信号，且连接至同一数据线的不同子像素连接至不同栅线；
其中，沿所述第一方向排列的相邻两个子像素分别连接至所述第一数据线和所述第二数据线，且沿所述第二方向排列的相邻两个子像素分别连接至所述第一数据线和所述第二数据线；
所述驱动方法包括：
对所述多条栅线中的至少一条栅线输入栅极信号，以控制与所述至少一条栅线连接的子像素包括的薄膜晶体管开启或关闭，
其中，所述显示装置采用列反转驱动方式，所述栅极信号被配置为处于至少三个阶段，所述至少三个阶段包括第一阶段、第二阶段以及第三阶段，
在所述第一阶段中，所述栅极信号处于第一电平以对所述薄膜晶体管输入开启电压；
在所述第二阶段中，所述栅极信号处于第二电平以保持所述薄膜晶体管处于开启状态，所述第二电平低于所述第一电平；以及
在所述第三阶段中，所述栅极信号处于第三电平以使所述薄膜晶体管处于关闭状态。
2.根据权利要求1所述的显示装置的驱动方法，其中，所述多个栅线包括沿所述第二方向交替设置的第一栅线和第二栅线，且沿所述第二方向排列的相邻两个所述子像素之间设置有所述第一栅线和所述第二栅线形成的栅线对。
3.根据权利要求1所述的显示装置的驱动方法，其中，沿所述第一方向排列的所述子像素中，连接至同一数据线的两个子像素之间设置有奇数个子像素。
4.根据权利要求3所述的显示装置的驱动方法，其中，沿所述第一方向排列的所述子像素中，连接至同一数据线的所述两个子像素之间设置有一个子像素。
5.根据权利要求4所述的显示装置的驱动方法，其中，沿所述第一方向排列的所述相邻两个子像素分别连接至相邻的所述第一数据线和所述第二数据线。
6.根据权利要求1-5任一项所述的显示装置的驱动方法，其中，沿所述第二方向排列的所述子像素中，连接至同一数据线的两个子像素之间设置有奇数个子像素。
7.根据权利要求6所述的显示装置的驱动方法，其中，沿所述第二方向排列的所述子像素中，连接至同一数据线的所述两个子像素之间设置有一个子像素。
8.根据权利要求7所述的显示装置的驱动方法，其中，沿所述第二方向排列的所述相邻两个子像素分别连接至相邻的所述第一数据线和所述第二数据线。
9.根据权利要求8所述的显示装置的驱动方法，其中，分别与沿所述第二方向排列的所述相邻两个子像素连接的两条栅线均位于所述相邻两个所述子像素之间，或者分别位于所述相邻两个所述子像素沿所述第二方向的两侧。
10.根据权利要求1所述的显示装置的驱动方法，其中，沿所述第一方向排列的所述子像素中，位于同一数据线两侧且与该数据线紧邻的两个子像素连接至不同数据线。
11.根据权利要求1所述的显示装置的驱动方法，其中，所述多个子像素划分为沿所述第一方向和所述第二方向阵列排布的多个子像素组，各子像素组包括沿所述第一方向排列的两个子像素；
相邻的所述第一数据线和所述第二数据线之间设置有沿所述第二方向排列的一排所述子像素组，所述第一数据线和所述第二数据线分别与位于两者之间的子像素组中的所述两个子像素连接，
其中，所述子像素组包括第一子像素组和第二子像素组，所述第一子像素组中的子像素均连接至靠近该子像素的所述数据线，所述第二子像素组中的子像素均连接至远离该子像素的所述数据线，且所述第一子像素组和所述第二子像素组沿所述第一方向和所述第二方向均交替排列。
12.根据权利要求1所述的显示装置的驱动方法，其中，沿所述第二方向排列的一排子像素的颜色相同，且沿所述第一方向排列的所述相邻两个子像素的颜色不同。
13.根据权利要求12所述的显示装置的驱动方法，其中，沿所述第一方向排列的相邻的相同颜色子像素分别连接至所述第一数据线和所述第二数据线。
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