JP2020522761A - 液晶表示パネル及び装置 - Google Patents
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Abstract
Description
前記第1画素は、第1薄膜トランジスタ、第1充電コンデンサ、第2充電コンデンサ、第1蓄積コンデンサ及び第1液晶コンデンサを含み、前記第1薄膜トランジスタのゲートは、対応する走査線に接続され、前記第1薄膜トランジスタのソースは、対応するデータ線に接続され、前記第1充電コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、前記第1充電コンデンサの他端は、前記第2充電コンデンサに接続され、前記第1蓄積コンデンサ及び前記第1液晶コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、
前記第2画素は、第2薄膜トランジスタ、第2蓄積コンデンサ及び第2液晶コンデンサを含み、前記第2薄膜トランジスタのゲートは、対応する走査線に接続され、前記第2薄膜トランジスタのソースは、対応するデータ線に接続され、前記第2薄膜トランジスタのドレインは、前記第1充電コンデンサの他端に接続され、前記第2蓄積コンデンサ及び第2液晶コンデンサの一端は、前記第2薄膜トランジスタのドレインに接続され、前記第1画素の輝度は、前記第2画素の輝度よりも大きい液晶表示パネルが提供される。
前記第1領域に位置する前記第1画素及び前記第1領域に位置する前記第2画素は、行単位で交互に設けられ、前記第2領域に位置する前記第1画素及び前記第2領域に位置する前記第2画素は、行単位で交互に設けられる。
前記第1画素は、第1薄膜トランジスタ、第1充電コンデンサ及び第2充電コンデンサを含み、前記第1薄膜トランジスタのゲートは、対応する走査線に接続され、前記第1薄膜トランジスタのソースは、対応するデータ線に接続され、前記第1充電コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、前記第1充電コンデンサの他端は、前記第2充電コンデンサに接続され、
前記第2画素は、第2薄膜トランジスタを含み、前記第2薄膜トランジスタのゲートは、対応する走査線に接続され、前記第2薄膜トランジスタのソースは、対応するデータ線に接続され、前記第2薄膜トランジスタのドレインは、前記第1充電コンデンサの他端に接続される液晶表示パネルが提供される。
前記第1領域に位置する前記第1画素及び前記第1領域に位置する前記第2画素は、行単位で交互に設けられ、前記第2領域に位置する前記第1画素及び前記第2領域に位置する前記第2画素は、行単位で交互に設けられる。
Claims (20)
- 複数本のデータ線、複数本の走査線及び複数の画素群を含む液晶表示パネルであって、
各画素群は、第1画素及び第2画素を含み、
画素の行ごとには、一本の走査線が対応して設けられ、
画素の列ごとには、一本のデータ線が対応して設けられ、
前記第1画素は、第1薄膜トランジスタ、第1充電コンデンサ、第2充電コンデンサ、第1蓄積コンデンサ及び第1液晶コンデンサを含み、
前記第1薄膜トランジスタのゲートは、対応する走査線に接続され、
前記第1薄膜トランジスタのソースは、対応するデータ線に接続され、
前記第1充電コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、
前記第1充電コンデンサの他端は、前記第2充電コンデンサに接続され、
前記第1蓄積コンデンサ及び前記第1液晶コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、
前記第2画素は、第2薄膜トランジスタ、第2蓄積コンデンサ及び第2液晶コンデンサを含み、
前記第2薄膜トランジスタのゲートは、対応する走査線に接続され、
前記第2薄膜トランジスタのソースは、対応するデータ線に接続され、
前記第2薄膜トランジスタのドレインは、前記第1充電コンデンサの他端に接続され、
前記第2蓄積コンデンサ及び第2液晶コンデンサの一端は、前記第2薄膜トランジスタのドレインに接続され、
前記第1画素の輝度は、前記第2画素の輝度よりも大きい、液晶表示パネル。 - 前記第1画素及び前記第2画素は、行単位で交互に設けられる、請求項1に記載の液晶表示パネル。
- 前記第1画素及び前記第2画素は、交差するように設けられる、請求項1に記載の液晶表示パネル。
- 前記第1画素は、第2k+1列の第n行又は第2k列の第n+1行に位置し、
前記第2画素は、第2k+1列の第n+1行又は第2k列の第n行に位置し、
液晶表示パネルは、N行の画素を含み、0<n<N、N≧2、k≧0である、請求項3に記載の液晶表示パネル。 - 前記液晶表示パネルは、第1領域及び第2領域を含み、
前記第1領域における前記第1画素及び前記第2領域における第2画素は、同じ行に位置し、
前記第1領域における前記第2画素及び前記第2領域における第1画素は、同じ行に位置し、
前記第1領域に位置する前記第1画素及び前記第1領域に位置する前記第2画素は、行単位で交互に設けられ、
前記第2領域に位置する前記第1画素及び前記第2領域に位置する前記第2画素は、行単位で交互に設けられる、請求項1に記載の液晶表示パネル。 - 前記第1領域の面積は、前記第2領域の面積に等しい、請求項5に記載の液晶表示パネル。
- 前記液晶表示パネルは、二つの第1領域と、二つの前記第1領域の間に位置する第2領域と、を含む、請求項5に記載の液晶表示パネル。
- 二つの前記第1領域の面積の合計は、前記第2領域の面積に等しい、請求項6に記載の液晶表示パネル。
- 複数本のデータ線、複数本の走査線及び複数の画素群を含む液晶表示パネルであって、
各画素群は、第1画素及び第2画素を含み、
画素の行ごとには、一本の走査線が対応して設けられ、
画素の列ごとには、一本のデータ線が対応して設けられ、
前記第1画素は、第1薄膜トランジスタ、第1充電コンデンサ及び第2充電コンデンサを含み、
前記第1薄膜トランジスタのゲートは、対応する走査線に接続され、
前記第1薄膜トランジスタのソースは、対応するデータ線に接続され、
前記第1充電コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、
前記第1充電コンデンサの他端は、前記第2充電コンデンサに接続され、
前記第2画素は、第2薄膜トランジスタを含み、
前記第2薄膜トランジスタのゲートは、対応する走査線に接続され、
前記第2薄膜トランジスタのソースは、対応するデータ線に接続され、
前記第2薄膜トランジスタのドレインは、前記第1充電コンデンサの他端に接続される、液晶表示パネル。 - 前記第1画素及び前記第2画素は、行単位で交互に設けられる、請求項9に記載の液晶表示パネル。
- 前記第1画素及び前記第2画素は、交差するように設けられる、請求項9に記載の液晶表示パネル。
- 前記第1画素は、第2k+1列の第n行又は第2k列の第n+1行に位置し、
前記第2画素は、第2k+1列の第n+1行又は第2k列の第n行に位置し、
液晶表示パネルは、N行の画素を含み、0<n<N、N≧2、k≧0である、請求項11に記載の液晶表示パネル。 - 前記液晶表示パネルは、第1領域及び第2領域を含み、
前記第1領域における前記第1画素及び前記第2領域における第2画素は、同じ行に位置し、
前記第1領域における前記第2画素及び前記第2領域における第1画素は、同じ行に位置し、
前記第1領域に位置する前記第1画素及び前記第1領域に位置する前記第2画素は、行単位で交互に設けられ、
前記第2領域に位置する前記第1画素及び前記第2領域に位置する前記第2画素は、行単位で交互に設けられる、請求項9に記載の液晶表示パネル。 - 前記第1領域の面積は、前記第2領域の面積に等しい、請求項13に記載の液晶表示パネル。
- 前記液晶表示パネルは、二つの第1領域と、二つの前記第1領域の間に位置する第2領域と、を含む、請求項13に記載の液晶表示パネル。
- 二つの前記第1領域の面積の合計は、前記第2領域の面積に等しい、請求項14に記載の液晶表示パネル。
- 前記第1画素の輝度は、前記第2画素の輝度よりも大きい、請求項9に記載の液晶表示パネル。
- バックライトモジュールと、
複数本のデータ線、複数本の走査線及び複数の画素群を含む液晶表示パネルと、を含む液晶表示装置であって、
各画素群は、第1画素及び第2画素を含み、
画素の行ごとには、一本の走査線が対応して設けられ、
画素の列ごとには、一本のデータ線が対応して設けられ、
前記第1画素は、第1薄膜トランジスタ、第1充電コンデンサ及び第2充電コンデンサを含み、
前記第1薄膜トランジスタのゲートは、対応する走査線に接続され、
前記第1薄膜トランジスタのソースは、対応するデータ線に接続され、
前記第1充電コンデンサの一端は、前記第1薄膜トランジスタのドレインに接続され、
前記第1充電コンデンサの他端は、前記第2充電コンデンサに接続され、
前記第2画素は、第2薄膜トランジスタを含み、
前記第2薄膜トランジスタのゲートは、対応する走査線に接続され、
前記第2薄膜トランジスタのソースは、対応するデータ線に接続され、
前記第2薄膜トランジスタのドレインは、前記第1充電コンデンサの他端に接続される、液晶表示装置。 - 前記第1画素及び前記第2画素は、行単位で交互に設けられる、請求項18に記載の液晶表示装置。
- 前記第1画素及び前記第2画素は、交差するように設けられる、請求項18に記載の液晶表示装置。
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