CN113741105B - 阵列基板及其驱动方法和显示装置 - Google Patents

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Abstract

本发明涉及一种阵列基板及其驱动方法和显示装置。所述阵列基板，包括：沿第一方向和第二方向阵列排布的多个子像素；沿第一方向延伸且沿第二方向排列的多条栅线；沿第二方向延伸且沿第一方向排列的多条数据线，多条数据线包括沿第一方向交替排列的第一数据线与第二数据线，相邻的第一数据线与第二数据线之间包括两排沿第二方向排列的子像素，第一数据线与第二数据线被配置为传输不同极性的数据电压信号，任意相邻的两个子像素中一个子像素连接至第一数据线，另一个子像素连接至第二数据线，连接至同一条数据线的不同子像素连接至不同的栅线。根据本发明的实施例，有利于尽量避免摇头纹不良。

Description

阵列基板及其驱动方法和显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种阵列基板及其驱动方法和显示 装置。
背景技术
在液晶显示器不断向着低成本、高品质方向发展的背景下，阵列基板行驱 动(Gate Driver On Array，简称GOA)技术以其低成本和高集成度等优点得到 了广泛的应用。基于低成本和窄边框的设计理念，以双栅线(Dual Gate)进行 驱动的GOA驱动方案获得了广泛应用。
相关技术中，在奇数行的扫描时钟信号(Clock，简称CK)为高电平期间开启 的像素一直处于存储电量状态，而偶数行的扫描时钟信号下拉时耦合奇数行驱 动的像素，造成奇数行驱动的像素的存电状态减弱，使得奇数行像素电荷驱动 不足，导致显示同一颜色的子像素正负极性亮度不一致，进而对显示的显示效 果和质量造成不利的影响。
发明内容
本发明提供一种阵列基板及其驱动方法和显示装置，以解决相关技术中的 不足。
根据本发明实施例的第一方面，提供一种阵列基板，包括：
沿第一方向和第二方向阵列排布的多个子像素；
沿所述第一方向延伸且沿所述第二方向排列的多条栅线；
沿所述第二方向延伸且沿所述第一方向排列的多条数据线，所述多条数据 线包括沿所述第一方向交替排列的第一数据线与第二数据线，相邻的所述第一 数据线与所述第二数据线之间包括两排沿第二方向排列的子像素，所述第一数 据线与所述第二数据线被配置为传输不同极性的数据电压信号，任意相邻的两 个子像素中一个子像素连接至所述第一数据线，另一个子像素连接至所述第二 数据线，连接至同一条数据线的不同子像素连接至不同的栅线。
在一个实施例中，所述多个子像素包括至少两种颜色的子像素，沿所述 第一方向排列的相邻两个子像素的颜色不同，沿所述第二方向排列且位于同 一排的子像素的颜色相同。
在一个实施例中，同一排沿所述第二方向排列的子像素中，第奇数个子 像素连接至紧邻的所述第一数据线和紧邻的所述第二数据线中的一条，第偶 数个子像素连接至紧邻的所述第一数据线和紧邻的所述第二数据线中的另一 条。
在一个实施例中，所述多条栅线包括多个栅线对，每个所述栅线对包括 第一栅线与第二栅线，同一个栅线对中的所述第一栅线、所述第二栅线分别 位于同一排沿所述第一方向排列的子像素的第一侧、第二侧，所述第一侧与 所述二侧相对；同一排沿所述第一方向排列的子像素中，与所述第二数据 线紧邻的子像素连接至所述第一栅线和所述第二栅线中的一条，与所述第一 数据线紧邻的子像素连接至所述第一栅线和所述第二栅线中的另一条。
在一个实施例中，沿所述第一方向排列的位于相邻的所述第一数据线与 所述第二数据线之间的两个子像素组成一个子像素对；所述子像素对包括第 一类子像素对与第二类子像素对，所述第一类子像素对中的子像素连接至靠 近所述子像素的数据线，所述第二类子像素对中的子像素连接至远离所述子 像素的数据线；所述第一类子像素对与所述第二类子像素对沿所述第一方向 交替排列，且所述第一类子像素对与所述第二类子像素对沿所述第二方向交 替排列。
根据本发明实施例的第二方面，提供一种阵列基板的驱动方法，用于驱动 上述的阵列基板，所述方法，包括：
按照预设驱动顺序向多条栅线提供栅极驱动信号；
在向每一条所述栅线提供所述栅极驱动信号时，向各个所述数据线输入对 应的数据电压信号。
在一个实施例中，所述多个子像素包括至少两种颜色的子像素，沿所述第 一方向排列的相邻两个子像素的颜色不同，沿所述第二方向排列且位于同一排 的子像素的颜色相同。
在一个实施例中，所述多条栅线包括多个栅线对，每个所述栅线对包括第 一栅线与第二栅线，同一个栅线对中的第一栅线、第二栅线分别位于同一排沿 第一方向排列的子像素的第一侧、第二侧，所述第一侧与所述二侧相对；同一 排沿所述第一方向排列的子像素中，与所述第二数据线紧邻的子像素连接至所 述第一栅线和所述第二栅线中的一条，与所述第一数据线紧邻的子像素连接至 所述第一栅线和所述第二栅线中的另一条。
在一个实施例中，所述按照预设驱动顺序向多条栅线提供所述栅极驱动信 号，包括：依次向第i+8p条栅线提供所述栅极驱动信号，其中，p以0为起点 依次递增，针对每个p的值，i的取值顺序为1、5、2、6、3、7、4、8，p为大 于或等于0的整数；其中，向第i+8p条栅线提供的所述栅极驱动信号与向第i 条栅线提供的所述栅极驱动信号相同。
根据本发明实施例的第三方面，提供一种显示装置，包括上述的阵列基板。
根据上述实施例可知，由于相邻子像素连接至传输不同极性数据电压信号 的数据线，因此，可以控制相邻子像素的极性相反，进而使任意两条数据线之 间的子像素的亮度得以平均，有利于尽量避免摇头纹不良。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的， 并不能限制本发明。
附图说明
此处的附图被并入说明书中并构成本说明书的一部分，示出了符合本发明 的实施例，并与说明书一起用于解释本发明的原理。
图1A是根据相关技术示出的一种阵列基板的局部结构示意图；
图1B是根据相关技术示出的一种阵列基板上部分子像素的亮度分布示 意图；
图2是根据本发明实施例示出的一种阵列基板的结构示意图；
图3是根据本发明实施例示出的一种阵列基板的驱动方法的流程图；
图4是根据本发明实施例示出的一种阵列基板的栅极驱动信号的时序示意 图；
图5是根据相关技术示出的一种阵列基板的栅极驱动信号的时序示意图。
具体实施方式
这里将详细地对示例性实施例进行说明，其示例表示在附图中。下面的描 述涉及附图时，除非另有表示，不同附图中的相同数字表示相同或相似的要素。 以下示例性实施例中所描述的实施方式并不代表与本发明相一致的所有实施方 式。相反，它们仅是与如所附权利要求书中所详述的、本发明的一些方面相一 致的装置和方法的例子。
相关技术中，采用双栅技术的显示装置在应用列反转驱动方法时，容易产 生摇头纹(V-line)等显示不良，也就是用户在摇头时会观察到显示屏出现了周 期性明暗相间的竖条纹。摇头纹的产生请参见如下介绍。
如图1A所示，双栅型阵列基板包括沿X方向(行方向)和Y方向(列方 向)阵列排布的多个子像素，多个子像素可以包括红色子像素11、绿色子像素 12以及蓝色子像素13。阵列基板还包括沿Y方向延伸的数据线14以及沿X方 向延伸的第一栅线15和第二栅线16，且相邻两条数据线14之间包括有两列子 像素，相邻的第一栅线15和第二栅线16构成一个栅线对，同一个栅线对中的 第一栅线15和第二栅线16分别位于同一行子像素沿Y方向的两侧。其中，同 一个栅线对中，第一栅线15位于对应的一行子像素的第一侧，第二栅线16位于该行子像素的第二侧，第一侧与第二侧相对，例如，第一栅线15位于对应的 一行子像素的上侧，第二栅线16位于该行子像素的下侧。位于任一条数据线14 两侧且与该数据线14相邻的子像素均连接至该数据线14，例如，红色子像素 11和与其相邻的绿色子像素12均连接至位于两者之间的数据线14。连接至同 一数据线14的不同子像素连接至不同栅线，例如，沿X方向排列的子像素中， 连接至同一数据线14的两个子像素中的一个子像素与第一栅线15连接，另一 个子像素与第二栅线16连接。
如图1A所示，可以采用列反转的方式对包括图1A所示的阵列基板的显示 装置进行驱动。列反转方法(column inversion method)是指每隔指定的子像素 列数，就将数据电压信号的极性反转。对于列反转方法，在显示同一帧(frame) 图像时，每条数据线上的数据电压信号的极性始终为同一极性(正极性或负极 性)。其中，正极性的符号为“+”，负极性的符号为“-”。如图1A所示，与同 一条数据线14连接的两列子像素所储存的电压极性都是相同的，且分别与相邻 的两条数据线14连接的两列子像素所储存的电压极性相反。
如图1A所示，在显示同一帧图像时，第一条数据线S1上的数据电压信号 为正极性，第二条数据线S2上的数据电压信号为负极性，第三条数据线S3上 的数据电压信号为正极性，以此类推。也就是，沿X方向，数据线14上的数据 电压信号的极性正负交替。因此，在显示同一帧图像时，与第一条数据线S1连 接的两列子像素被充入正极性数据电压信号，与第二条数据线S2连接的两列子 像素被充入负极性数据电压信号，与第三条数据线S3连接的两列子像素被充入 正极性数据电压信号，以此类推。因此，在显示同一帧图像时，沿X方向排列 的子像素列被充入数据电压信号的极性以“正正负负”的周期循环。
如图1A所示，在显示同一帧图像时，第一条数据线S1和第二条数据线S2 之间的两列子像素被充入数据电压信号的极性分别为正极性和负极性。由此， 在显示同一帧图像时，相邻两条数据线之间的子像素列的亮度可以平均。然而， 在显示同一帧图像时，第一条数据线S1和第三条数据线S3之间的四列子像素 被充入数据电压信号的极性分别为正负负正，位于中间的相邻的两列子像素充 入数据电压信号的极性相同。在存在上述相邻两列子像素被充入数据电压信号 的极性相同的情况时，在显示同一帧图像时，阵列基板上分布的子像素整体的 亮暗可能出现无法中和的现象，需要在显示下一帧图像时，通过改变每条数据 线上的数据电压信号的极性，才可以保证阵列基板上分布的子像素整体的亮度 均匀。
图1B为图1A所示的阵列基板的部分子像素的亮度分布图。如图1A和图 1B所示，阵列基板中栅线的开启顺序依次为G1、G2、G4、G3。由于上述阵列 基板为双栅型阵列基板，栅线会对相邻且不相连的子像素产生耦合拉动，从而 导致相邻两列子像素的亮度不同且无法中和，并且相邻的相同颜色的子像素列 的亮度也不同且无法中和，容易出现摇头纹。上述耦合拉动指栅线和与其相邻 且不相连的子像素之间形成耦合电容，当该栅线上的电压跳变时，电容耦合作 用使与该栅线相邻且不相连的子像素的像素电压发生跳变，从而导致像素亮度 发生变化的现象。
例如，如图1A和图1B所示，向栅线G1输入的栅极信号处于有效电平(能 够使薄膜晶体管T处于开启状态的电平)时，栅线G1对第一行第一列的红颜色 子像素11包括的薄膜晶体管施加开启电压，该红颜色子像素11进行充电；在 向栅线G2输入栅极信号时，红颜色子像素11与栅线G2之间产生的耦合电容导 致红颜色子像素11的像素电压发生跳变。因此，在上述被耦合电容影响的子像 素被输入的数据电压信号为正极性时，该子像素的亮度会变暗(如图1B所示的 位于第一行第一列的子像素中的加号表示被输入的数据电压信号为正极性，下 箭头表示亮度变暗)；在上述被耦合电容影响的子像素被输入的数据电压信号为 负极性时，该子像素的颜色会变亮(如图1B所示的位于第一行第三列的子像素 的减号表示被输入的数据电压信号为负极性，上箭头表示亮度变亮)；而没有被 耦合电容影响的子像素无论被输入的数据电压信号为正极性还是负极性，该子 像素的亮度不变(如图1B所示的位于第一行第二列的子像素和位于第一行第四 列的子像素的亮度均不变)。
在用户的眼睛固定且持续观察包括如图1A所示的阵列基板的显示装置时， 由于下一帧图像中的数据线上的数据电压信号的极性都会被反转，所以在显示 相邻两帧图像时，每列子像素的亮度叠加后，亮度均匀。而在用户进行摇头时， 可能会出现观察的画面丢帧，导致显示同一帧图像时亮度不能平均的相邻两列 子像素失去在显示下一帧图像时亮度被中和的可能，从而产生周期性竖条纹。
同理，当阵列基板中栅线的开启顺序为G1、G2、G3、G4、G5、G6、G7、 G8时，栅线也会对相邻且不相连的子像素产生耦合拉动，从而导致相邻两列子 像素的亮度不同且无法中和，并且相邻的相同颜色的子像素列的亮度也不同且 无法中和，容易出现摇头纹。
例如，如图1A所示，向栅线G1输入的栅极信号处于有效电平(能够使薄 膜晶体管T处于开启状态的电平)时，栅线G1对第一行第一列的红颜色子像素 11包括的薄膜晶体管T施加开启电压，该红颜色子像素11进行充电；在向栅线 G2输入栅极信号时，第一行第一列的红颜色子像素11与栅线G2之间产生的耦 合电容导致第一行第一列的红颜色子像素11的像素电压发生跳变。因此，在上 述被耦合电容影响的子像素被输入的数据电压信号为正极性时，该子像素的亮 度会变暗；在上述被耦合电容影响的子像素被输入的数据电压信号为负极性时， 该子像素的颜色会变亮；而没有被耦合电容影响的子像素无论被输入的数据电压信号为正极性还是负极性，该子像素的亮度不变(如图1A所示的位于第一行 第二列的绿颜色子像素12和位于第一行第四列的红颜色子像素11的亮度均不 变)。
类似的，当阵列基板中栅线的开启顺序为G1、G3、G2、G4、G5、G7、G6、 G8时，也容易出现摇头纹。
为解决上述技术问题，采用数据线通过向左或者向右地跨越像素以驱动不 同行的不同像素的方案，这样，在显示同一个颜色的时候将被耦合像素的位置 打散，但是，由此带来的问题就是由于数据线多次跨越、围绕像素走线，寄生 电阻、寄生电容的值很大，并且在实现纯色图像时每根数据线上的电压多次发 生0伏到5伏转换，在重载驱动功耗方面表现力很差。
本发明实施例提供一种阵列基板及其驱动方法和显示装置，可以解决上述 技术问题，有利于尽量避免摇头纹不良。
本发明实施例提供一种阵列基板。如图2所示，该阵列基板包括：沿第一 方向和第二方向阵列排布的多个子像素20、沿第一方向延伸且沿第二方向排列 的多条栅线25以及沿第二方向延伸且沿第一方向排列的多条数据线24，多条数 据线24包括沿第一方向交替排列的第一数据线241与第二数据线242，相邻的 第一数据线241与第二数据线242之间包括两排沿第二方向排列的子像素20， 第一数据线241与第二数据线242被配置为传输不同极性的数据电压信号，任 意相邻的两个子像素20中一个子像素20连接至第一数据线241，另一个子像素 20连接至第二数据线242，连接至同一条数据线24的不同子像素20连接至不同的栅线25。
本实施例中，由于相邻子像素连接至传输不同极性数据电压信号的数据线， 因此，可以控制相邻子像素的极性相反，进而使任意两条数据线之间的子像素 的亮度得以平均，有利于尽量避免摇头纹不良。
以上对本发明实施例中的阵列基板进行了简要的介绍，下面对本发明实施 例中的阵列基板进行详细的介绍。
本发明实施例提供一种阵列基板。如图2所示，该阵列基板包括：沿第一 方向和第二方向阵列排布的多个子像素20、沿第一方向延伸且沿第二方向排列 的多条栅线25以及沿第二方向延伸且沿第一方向排列的多条数据线24。
在本实施例中，如图2所示，第一方向可以是X方向，也就是行方向，第 二方向可以是Y方向，也就是列方向。
在本实施例中，阵列排布的多个子像素20可以包括至少两种颜色的子像素。 例如，阵列排布的多个子像素20可以包括3种颜色的子像素：红颜色子像素21、 绿颜色子像素22以及蓝颜色子像素23，但不限于此。
在本实施例中，如图2所示，沿第一方向排列的相邻两个子像素20的颜色 不同，沿第二方向排列且位于同一排的子像素的颜色相同。即，在X方向上， 同一行子像素20中，红颜色子像素21、绿颜色子像素22以及蓝颜色子像素23 依次周期性排列，相邻两个的子像素20的颜色不同，在Y方向上，同一列中的 子像素20的颜色相同，例如，第一列子像素20为红颜色子像素21，第二列子 像素20为绿颜色子像素22，第三列子像素20为蓝颜色子像素23。
在本实施例中，如图2所示，栅线25沿X方向延伸，在Y方向上多条栅 线25依次排列。多条栅线25包括多个栅线对，每个栅线对包括第一栅线251 与第二栅线252两条栅线。位于同一排沿第一方向排列的子像素20与同一个栅 线对中的两条栅线连接。同一个栅线对中的第一栅线251、第二栅线252分别位 于同一排沿第一方向排列的子像素20的第一侧、第二侧，第一侧与二侧相对， 例如，第一侧为上侧，第二侧为下侧。例如，对于同一行子像素20连接的同一 栅线对中的两条栅线，第一栅线251位于该行子像素20的上侧，第二栅线252位于该行子像素20的下侧。
在本实施例中，如图2所示，多条数据线24包括沿第一方向交替排列的第 一数据线241与第二数据线242，第一数据线241与第二数据线242被配置为传 输不同极性的数据电压信号，例如，第一数据线241被配置为传输正极性的数 据电压信号，第二数据线242被配置为传输负极性的数据电压信号。
在本实施例中，如图2所示，相邻的第一数据线241与第二数据线242之 间包括两排沿第二方向排列的子像素20。例如，第一条第一数据线241(数据 线S1)与第一条第二数据线242(数据线S2)之间包括一列红颜色子像素21 与一列绿颜色子像素22，第一条第二数据线242(数据线S2)与第二条第一数 据线241(数据线S3)之间包括一列蓝颜色子像素23与一列红颜色子像素21， 第二条第一数据线241(数据线S3)与第二条第二数据线242(数据线S4)之 间包括一列绿颜色子像素22与一列蓝颜色子像素23。
在本实施例中，如图2所示，任意相邻的两个子像素20中一个子像素20 连接至第一数据线241，另一个子像素20连接至第二数据线242。具体地，在 第一方向上，相邻的两个子像素20中一个子像素20连接至第一数据线241，另 一个子像素20连接至第二数据线242，且在第二方向上，相邻的两个子像素20 中一个子像素20连接至第一数据线241，另一个子像素20连接至第二数据线 242。例如，在第一行子像素20中，位于第一行第一列的红颜色子像素21与位 于第一行第二列的绿颜色子像素22中，红颜色子像素21与第一条第一数据线241(数据线S1)连接，绿颜色子像素22与第一条第二数据线242(数据线S2) 连接。再如，在第一列子像素20中，位于第一行第一列的红颜色子像素21与 位于第二行第一列的红颜色子像素21中，位于第一行第一列的红颜色子像素21 与第一条第一数据线241(数据线S1)连接，位于第二行第一列的红颜色子像 素21与第一条第二数据线242(数据线S2)连接。
在本实施例中，如图2所示，连接至同一条数据线24的不同子像素20连 接至不同的栅线25。例如，在第一列子像素20中，位于第一行第一列的红颜色 子像素21与位于第二行第二列的绿颜色子像素22均连接至第一条第一数据线 241(数据线S1)，其中，位于第一行第一列的红颜色子像素21连接至第一条栅 线G1，位于第二行第二列的绿颜色子像素22连接至第三条栅线G3。
本实施例中，由于相邻子像素连接至传输不同极性数据电压信号的数据线， 因此，可以控制相邻子像素的极性相反，进而使任意两条数据线之间的子像素 的亮度得以平均，有利于尽量避免摇头纹不良。
在本实施例中，同一排沿第二方向排列的子像素中，第奇数个子像素连接 至紧邻的第一数据线和紧邻的第二数据线中的一条，第偶数个子像素连接至紧 邻的第一数据线和紧邻的第二数据线中另一条。例如，在第一列红颜色的子像 素21中，位于奇数行的子像素与第一条第一数据线241(数据线S1)连接，位 于偶数行的子像素与第一条第二数据线242(数据线S2)连接。
在本实施例中，同一排沿第一方向排列的子像素中，与第二数据线紧邻的 子像素连接至第一栅线和第二栅线中的一条，与第一数据线紧邻的子像素连接 至第一栅线和第二栅线中的另一条。例如，第一行子像素中，与第二数据线242 紧邻的子像素与第二栅线252连接，与第一数据线241紧邻的子像素与第一栅 线251连接。
在本实施例中，如图2所示，沿第一方向排列的位于相邻的第一数据线241 与第二数据线242之间的两个子像素组成一个子像素对。子像素对包括第一类 子像素对26与第二类子像素对27，第一类子像素对26中的子像素连接至靠近 子像素的数据线24，第二类子像素对27中的子像素连接至远离子像素的数据线 24。例如，第一行子像素20中位于数据线S3与数据线S4之间的绿颜色子像素22与蓝颜色子像素23组成一个第一类子像素对26，该第一类子像素对26中， 绿颜色子像素22连接至靠近该绿颜色子像素22的数据线S3，蓝颜色子像素23 连接至靠近该蓝颜色子像素23的数据线S4；第一行子像素20中位于数据线S4 与数据线S5之间的红颜色子像素21与绿颜色子像素22组成一个第二类子像素 对27，该第二类子像素对27中，红颜色子像素21连接至远离该红颜色子像素 21的数据线S5，绿颜色子像素22连接至远离该绿颜色子像素22的数据线S4。
在本实施例中，如图2所示，第一类子像素对26与第二类子像素对27沿 第一方向交替排列，且第一类子像素对26与第二类子像素对27沿第二方向交 替排列。这样，可以便于布线，且有利于降低寄生电阻与寄生电容。
本发明的实施例还提出了一种阵列基板的驱动方法。该阵列基板的驱动方 法，用于驱动上述任一实施例所述的阵列基板，如图3所示，该阵列基板的驱 动方法，包括以下步骤301～步骤302：
在步骤301中，按照预设驱动顺序向多条栅线提供栅极驱动信号。
在步骤302中，在向每一条栅线提供栅极驱动信号时，向各个数据线输入 对应的数据电压信号。
在本实施例中，多个子像素包括至少两种颜色的子像素，沿第一方向排列 的相邻两个子像素的颜色不同，沿第二方向排列且位于同一排的子像素的颜色 相同。
在本实施例中，多条栅线包括多个栅线对，每个栅线对包括第一栅线与第 二栅线，同一个栅线对中的第一栅线、第二栅线分别位于同一排沿第一方向排 列的子像素的第一侧、第二侧，第一侧与所述二侧相对；同一排沿第一方向排 列的子像素中，与第二数据线紧邻的子像素连接至第一栅线和第二栅线中的一 条，与第一数据线紧邻的子像素连接至第一栅线和第二栅线中的另一条。
在本实施例中，第1排沿第一方向排列的子像素与第3排沿第一方向排列 的子像素中同一颜色的子像素与同一条数据线连接，第2排沿第一方向排列 的子像素与第4排沿第一方向排列的子像素中同一颜色的子像素与同一条数 据线连接。例如，第1行第1列的红颜色子像素21与第3行第1列的红颜色 子像素21与第一条第一数据线241(数据线S1)连接，第2行第1列的红 颜色子像素21与第4行第1列的红颜色子像素21与第一条第二数据线242(数据线S2)连接。这样，可以使第1排沿第一方向排列的子像素与第3排 沿第一方向排列的子像素的驱动时序相邻时，数据线上的电压保持不变，进 而可以减少数据线上电压转换的次数，降低功耗，也可以使第2排沿第一方 向排列的子像素与第4排沿第一方向排列的子像素的驱动时序相邻时，数据 线上的电压保持不变，进而可以减少数据线上电压转换的次数，降低功耗。
同理，在第5排沿第一方向排列的子像素至第8排沿第一方向排列的子像 素中，第5排沿第一方向排列的子像素与第7排沿第一方向排列的子像素中同 一颜色的子像素与同一条数据线连接，第6排沿第一方向排列的子像素与第8 排沿第一方向排列的子像素中同一颜色的子像素与同一条数据线连接。这样， 可以使第5排沿第一方向排列的子像素与第7排沿第一方向排列的子像素的驱 动时序相邻时，数据线上的电压保持不变，进而可以减少数据线上电压转换的 次数，降低功耗，也可以使第6排沿第一方向排列的子像素与第8排沿第一方 向排列的子像素的驱动时序相邻时，数据线上的电压保持不变，进而可以减少 数据线上电压转换的次数，降低功耗。
在本实施例中，如图2所示，第1排沿第一方向排列的子像素与第1条栅 线G1、第2条栅线G2连接，第2排沿第一方向排列的子像素与第3条栅线G3、 第4条栅线G4连接，第3排沿第一方向排列的子像素与第5条栅线G5、第6 条栅线G6连接，第4排沿第一方向排列的子像素与第7条栅线G7、第8条栅 线G8连接，第5排沿第一方向排列的子像素与第9条栅线G9、第10条栅线 G10连接，第6排沿第一方向排列的子像素与第11条栅线G11、第12条栅线 G12连接，第7排沿第一方向排列的子像素与第13条栅线G13、第14条栅线 G14连接，第8排沿第一方向排列的子像素与第15条栅线G15、第16条栅线 G16连接。
在本实施例中，可以依次向第i+8p条栅线提供所述栅极驱动信号，其中，p 以0为起点依次递增，针对每个p的值，i的取值顺序为1、5、2、6、3、7、4、8，p为大于或等于0的整数；其中，向第i+8p条栅线提供的栅极驱动信号与向 第i条栅线提供的栅极驱动信号相同。
例如，p为0时，i的取值顺序为1、5、2、6、3、7、4、8。即，在驱动第 1～4排沿第一方向排列的子像素时，可以依次向第1、5、2、6、3、7、4、8条 栅线提供栅极驱动信号。例如，第1～4排沿第一方向排列的子像素的栅极驱动 信号如图4所示。如图4所示：
首先，向第1条栅线G1输入第一栅极驱动信号CLK1；
接着，在与第1条栅线G1连接的子像素充电完成后，向第5条栅线G5输 入第五栅极驱动信号CLK5；
接着，在与第5条栅线G5连接的子像素充电完成后，向第2条栅线G2输 入第二栅极驱动信号CLK2；
接着，在与第2条栅线G2连接的子像素充电完成后，向第6条栅线G6输 入第六栅极驱动信号CLK6；
接着，在与第6条栅线G6连接的子像素充电完成后，向第3条栅线G3输 入第三栅极驱动信号CLK3；
接着，在与第3条栅线G3连接的子像素充电完成后，向第7条栅线G7输 入第七栅极驱动信号CLK7；
接着，在与第7条栅线G7连接的子像素充电完成后，向第4条栅线G4输 入第四栅极驱动信号CLK4；
接着，在与第4条栅线G4连接的子像素充电完成后，向第8条栅线G8输 入第八栅极驱动信号CLK8。
图4中，信号STV0～STV4为阵列基板上栅极驱动电路的开启信号，信号 Dummy为哑信号，即无效信号，1H为数据线24给一行子像素20充电的有效 电平时间，8H为数据线给一行子像素充电的有效电平时间的8倍。
再如，p为1时，i的取值顺序为1、5、2、6、3、7、4、8，则i+8p的取值 顺序为9、13、10、14、11、15、12、16。即，在驱动第5～8排沿第一方向排列 的子像素时，可以依次向第9、13、10、14、11、15、12、16条栅线提供栅极 驱动信号。由于向第i+8p条栅线提供的栅极驱动信号与向第i条栅线提供的栅 极驱动信号相同，因此，向第9条栅线提供的栅极驱动信号与向第1条栅线提 供的栅极驱动信号相同，向第13条栅线提供的栅极驱动信号与向第5条栅线提供的栅极驱动信号相同，向第10条栅线提供的栅极驱动信号与向第2条栅线提 供的栅极驱动信号相同，向第14条栅线提供的栅极驱动信号与向第6条栅线提 供的栅极驱动信号相同，向第11条栅线提供的栅极驱动信号与向第3条栅线提 供的栅极驱动信号相同，向第15条栅线提供的栅极驱动信号与向第7条栅线提 供的栅极驱动信号相同，向第12条栅线提供的栅极驱动信号与向第4条栅线提 供的栅极驱动信号相同，向第16条栅线提供的栅极驱动信号与向第8条栅线提 供的栅极驱动信号相同。
因此，在本实施例中，第5～8排沿第一方向排列的子像素的驱动时序与第 1～4排沿第一方向排列的子像素的驱动时序相同，具体如下：
首先，向第9条栅线G1输入第一栅极驱动信号CLK1；
接着，在与第9条栅线G1连接的子像素充电完成后，向第13条栅线G13 输入第五栅极驱动信号CLK5；
接着，在与第13条栅线G13连接的子像素充电完成后，向第10条栅线G10 输入第二栅极驱动信号CLK2；
接着，在与第10条栅线G10连接的子像素充电完成后，向第14条栅线G14 输入第六栅极驱动信号CLK6；
接着，在与第14条栅线G14连接的子像素充电完成后，向第11条栅线G11 输入第三栅极驱动信号CLK3；
接着，在与第11条栅线G11连接的子像素充电完成后，向第15条栅线G15 输入第七栅极驱动信号CLK7；
接着，在与第15条栅线G15连接的子像素充电完成后，向第12条栅线G12 输入第四栅极驱动信号CLK4；
接着，在与第12条栅线G12连接的子像素充电完成后，向第16条栅线G16 输入第八栅极驱动信号CLK8。
在本实施例中，向第1～4排沿第一方向排列的子像素提供栅极驱动信号的 过程中，第二条数据线S2驱动的子像素的颜色顺序为RRGGBBRR，第三条数 据线S3驱动的子像素的颜色顺序为GGBBBBRR，第四条数据线S4驱动的子像 素的颜色顺序为GGBBRRGG，其中，R为红颜色，G为绿颜色，B为蓝颜色。 当显示纯色画面时，例如，显示红色画面时，第二条数据线S2首先持续输出恒 定的红颜色子像素的数据电压，为红颜色子像素充电，当为绿颜色子像素充电 时，转换一次电压，持续输出恒定的绿颜色子像素的数据电压，当为蓝颜色子 像素充电时，再转换一次电压，持续输出恒定的蓝颜色子像素的数据电压，当 为红颜色子像素充电时，再转换一次电压，持续输出恒定的红颜色子像素的数 据电压，第二条数据线S2的数据电压转换了3次。同理，第三条数据线S3的 数据电压转换了2次，第三条数据线S3的数据电压转换了3次。
但是，如果按照如图5所示的驱动时序向第1～4排沿第一方向排列的子像 素提供栅极驱动信号时，即依次向栅线G1、G2、G4、G3、G5、G6、G8、G7 输入按照如图5所示的栅极驱动信号时，第二条数据线S2驱动的子像素的颜色 顺序为RGRBRGRB，第三条数据线S3驱动的子像素的颜色顺序为GBRBGBRB， 第四条数据线S4驱动的子像素的颜色顺序为GBGRGBGR，第二条数据线S2 的数据电压转换了7次，第三条数据线S3的数据电压转换了7次，第三条数据线S3的数据电压转换了7次。
经对比发现，按照如图4所示的驱动时序向第1～4排沿第一方向排列的子 像素提供栅极驱动信号时，即依次向栅线G1、G5、G2、G6、G3、G7、G4、 G8输入栅极驱动信号时，可以使第1排沿第一方向排列的子像素与第3排沿第 一方向排列的子像素的驱动时序相邻，数据线上的电压保持不变，使第2排沿 第一方向排列的子像素与第4排沿第一方向排列的子像素的驱动时序相邻，数 据线上的电压保持不变，进而可以减少数据线上电压转换的次数，降低功耗。
在向第1～4排沿第一方向排列的子像素提供栅极驱动信号时，相关技术中， 采用图5所示的驱动时序，数据电压转换了7次，而本实施例中采用图4所示 的驱动时序，数据电压转换了3次，相关功耗会节省约50％。
本发明的实施例还提出了一种显示装置，包括显示模组，还包括上述任一 实施例所述的阵列基板。
本实施例中，由于相邻子像素连接至传输不同极性数据电压信号的数据线， 因此，可以控制相邻子像素的极性相反，进而使任意两条数据线之间的子像素 的亮度得以平均，有利于尽量避免摇头纹不良。
需要说明的是，本实施例中的显示装置可以为：电子纸、手机、平板电脑、 电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
需要指出的是，在附图中，为了图示的清晰可能夸大了层和区域的尺寸。 而且可以理解，当元件或层被称为在另一元件或层“上”时，它可以直接在其 他元件上，或者可以存在中间的层。另外，可以理解，当元件或层被称为在 另一元件或层“下”时，它可以直接在其他元件下，或者可以存在一个以上的 中间的层或元件。另外，还可以理解，当层或元件被称为在两层或两个元件“之 间”时，它可以为两层或两个元件之间唯一的层，或还可以存在一个以上的中 间层或元件。通篇相似的参考标记指示相似的元件。
在本发明中，术语“第一”、“第二”仅用于描述目的，而不能理解为指示 或暗示相对重要性。术语“多个”指两个或两个以上，除非另有明确的限定。
本领域技术人员在考虑说明书及实践这里公开的公开后，将容易想到本 发明的其它实施方案。本发明旨在涵盖本发明的任何变型、用途或者适应性 变化，这些变型、用途或者适应性变化遵循本发明的一般性原理并包括本发 明未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被 视为示例性的，本发明的真正范围和精神由下面的权利要求指出。
应当理解的是，本发明并不局限于上面已经描述并在附图中示出的精确 结构，并且可以在不脱离其范围进行各种修改和改变。本发明的范围仅由所 附的权利要求来限制。

Claims (5)

1.一种阵列基板，其特征在于，包括：
沿第一方向和第二方向阵列排布的多个子像素，所述多个子像素包括至少两种颜色的子像素，沿所述第一方向排列的相邻两个子像素的颜色不同，沿所述第二方向排列且位于同一排的子像素的颜色相同；
沿所述第一方向延伸且沿所述第二方向排列的多条栅线，所述多条栅线包括多个栅线对，每个所述栅线对包括第一栅线与第二栅线，同一个栅线对中的第一栅线、第二栅线分别位于同一排沿第一方向排列的子像素的第一侧、第二侧，所述第一侧与所述第二侧相对；
沿所述第二方向延伸且沿所述第一方向排列的多条数据线，所述多条数据线包括沿所述第一方向交替排列的第一数据线与第二数据线，相邻的所述第一数据线与所述第二数据线之间包括两排沿第二方向排列的子像素，所述第一数据线与所述第二数据线被配置为传输不同极性的数据电压信号，任意相邻的两个子像素中一个子像素连接至所述第一数据线，另一个子像素连接至所述第二数据线，连接至同一条数据线的不同子像素连接至不同的栅线；同一排沿所述第一方向排列的子像素中，与所述第二数据线紧邻的子像素连接至所述第一栅线和所述第二栅线中的一条，与所述第一数据线紧邻的子像素连接至所述第一栅线和所述第二栅线中的另一条；
所述阵列基板配置为以下述方法驱动：按照预设驱动顺序向多条栅线提供栅极驱动信号；在向每一条所述栅线提供所述栅极驱动信号时，向各个所述数据线输入对应的数据电压信号；
其中，所述按照预设驱动顺序向多条栅线提供所述栅极驱动信号，包括：依次向第i+8p条栅线提供所述栅极驱动信号，其中，p以0为起点依次递增，针对每个p的值，i的取值顺序为1、5、2、6、3、7、4、8，p为大于或等于0的整数；其中，向第i+8p条栅线提供的所述栅极驱动信号与向第i条栅线提供的所述栅极驱动信号相同。
2.根据权利要求1所述的阵列基板，其特征在于，同一排沿所述第二方向排列的子像素中，第奇数个子像素连接至紧邻的所述第一数据线和紧邻的所述第二数据线中的一条，第偶数个子像素连接至紧邻的所述第一数据线和紧邻的所述第二数据线中的另一条。
3.根据权利要求1-2任一项所述的阵列基板，其特征在于，沿所述第一方向排列的位于相邻的所述第一数据线与所述第二数据线之间的两个子像素组成一个子像素对；
所述子像素对包括第一类子像素对与第二类子像素对，所述第一类子像素对中的子像素连接至靠近所述子像素的数据线，所述第二类子像素对中的子像素连接至远离所述子像素的数据线；
所述第一类子像素对与所述第二类子像素对沿所述第一方向交替排列，且所述第一类子像素对与所述第二类子像素对沿所述第二方向交替排列。
4.一种阵列基板的驱动方法，其特征在于，用于驱动权利要求1所述的阵列基板，所述方法，包括：
按照预设驱动顺序向多条栅线提供栅极驱动信号；
在向每一条所述栅线提供所述栅极驱动信号时，向各个所述数据线输入对应的数据电压信号；
其中，所述按照预设驱动顺序向多条栅线提供所述栅极驱动信号，包括：
依次向第i+8p条栅线提供所述栅极驱动信号，其中，p以0为起点依次递增，针对每个p的值，i的取值顺序为1、5、2、6、3、7、4、8，p为大于或等于0的整数；
其中，向第i+8p条栅线提供的所述栅极驱动信号与向第i条栅线提供的所述栅极驱动信号相同。
5.一种显示装置，其特征在于，包括权利要求1至3任一项所述的阵列基板。
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