CN111986615B - 像素电路及显示面板 - Google Patents
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Abstract
本申请公开了一种像素电路及显示面板,其包括第一驱动晶体管、第二驱动晶体管、第一切换晶体管以及第二切换晶体管;通过第一切换晶体管、第二切换晶体管控制第一驱动晶体管和第二驱动晶体管交替工作,可以缩短第一驱动晶体管和/或第二驱动晶体管的工作周期,能够提高驱动晶体管的稳定性。
Description
技术领域
本申请涉及显示技术领域,尤其涉及面内驱动技术领域,具体涉及一种像素电路和显示面板。
背景技术
当今,社会科技迅猛发展,显示面板也被越来越多的应用在工作和生活中。因此,人们对于显示面板的要求也是越来越高。Mini-LED由于其独特的优势,如对比度高,稳定性好,制程较micro-LED简单等优势,逐渐越来越受到广泛的关注。
但是,Mini-LED所需的电流较大,驱动薄膜晶体管(TFT)长期承受大电流的工作环境,其稳定性较差,进而容易造成显示不均一甚至是显示失效等问题。
发明内容
本申请提供一种像素电路及显示面板,解决了像素电路中驱动晶体管长期处于工作状态,导致其稳定性较差的问题。
第一方面,本申请提供一种像素电路,其包括第一驱动晶体管、第二驱动晶体管、第一切换晶体管以及第二切换晶体管;第一驱动晶体管串接于第一电源信号与第二电源信号构成的发光回路,用于控制流经发光回路的电流;第二驱动晶体管与第一驱动晶体管并联且串接于发光回路,用于控制流经发光回路的电流;第一切换晶体管的输出端与第一驱动晶体管的控制端连接,用于根据第一控制信号控制第一驱动晶体管;第二切换晶体管的输出端与第二驱动晶体管的控制端连接,用于根据第二控制信号控制第二驱动晶体管;其中,第一驱动晶体管与第二驱动晶体管交替工作。
基于第一方面,在第一方面的第一种实施方式中,像素电路还包括写入晶体管,写入晶体管的输出端与第一驱动晶体管的输出端和第二驱动晶体管的输出端连接,用于根据第一扫描信号控制数据信号写入至像素电路。
基于第一方面的第一种实施方式,在第一方面的第二种实施方式中,像素电路还包括补偿晶体管,补偿晶体管的输入端与第一驱动晶体管的输入端和第二驱动晶体管的输入端连接,补偿晶体管的输出端与第一切换晶体管的输入端和第二切换晶体管的输入端连接,补偿晶体管的控制端用于接入第一扫描信号。
基于第一方面的第二种实施方式,在第一方面的第三种实施方式中,像素电路还包括存储电容,存储电容的第一端与补偿晶体管的输出端连接,存储电容的第二端与第二电源信号连接。
基于第一方面的第三种实施方式,在第一方面的第四种实施方式中,像素电路还包括初始化晶体管,初始化晶体管的输出端与存储电容的第一端连接,用于根据第二扫描信号初始化存储电容的第一端的电位至初始电压信号的电位。
基于第一方面的第四种实施方式,在第一方面的第五种实施方式中,像素电路还包括第一发光控制晶体管和第二发光控制晶体管;第一发光控制晶体管串接于发光回路且第一发光控制晶体管的输出端与第一驱动晶体管的输入端和第二驱动晶体管的输入端连接,用于根据发光控制信号通断控制发光回路;第二发光控制晶体管串接于发光回路且第二发光控制晶体管的输入端与第一驱动晶体管的输出端和第二驱动晶体管的输出端连接,用于根据发光控制信号通断控制发光回路。
基于第一方面的第五种实施方式,在第一方面的第六种实施方式中,像素电路还包括发光器件,发光器件串接于发光回路,且发光器件的输入端与第一电源信号连接,或者,发光器件的输出端与第二电源信号连接。
基于第一方面的任一实施方式,在第一方面的第七种实施方式中,第一电源信号的电位大于第二电源信号的电位。
基于第一方面的任一实施方式,在第一方面的第八种实施方式中,第一驱动晶体管、第二驱动晶体管、第一切换晶体管、第二切换晶体管、写入晶体管、补偿晶体管、初始化晶体管、第一发光控制晶体管以及第二发光控制晶体管中至少一个为N型薄膜晶体管。
第二方面,本申请提供一种显示面板,其包括上述任一实施方式中的像素电路。
本申请提供的像素电路及显示面板,通过第一切换晶体管、第二切换晶体管控制第一驱动晶体管和第二驱动晶体管交替工作,可以缩短第一驱动晶体管和/或第二驱动晶体管的工作周期,能够提高驱动晶体管的稳定性,进而增强像素电路及显示面板的信赖性和使用寿命。
附图说明
下面结合附图,通过对本申请的具体实施方式详细描述,将使本申请的技术方案及其它有益效果显而易见。
图1为本申请实施例提供的像素电路的第一种结构示意图。
图2为本申请实施例提供的像素电路的第二种结构示意图。
图3为本申请实施例提供的像素电路的时序示意图。
具体实施方式
下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚、完整地描述。显然,所描述的实施例仅仅是本申请一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例,都属于本申请保护的范围。
如图1或者图2所示,本实施例提供了一种像素电路,其包括第一驱动晶体管T4、第二驱动晶体管T5、第一切换晶体管T2以及第二切换晶体管T3;第一驱动晶体管T4串接于第一电源信号VDD与第二电源信号VSS构成的发光回路,用于控制流经发光回路的电流;第二驱动晶体管T5与第一驱动晶体管T4并联且串接于发光回路,用于控制流经发光回路的电流;第一切换晶体管T2的输出端与第一驱动晶体管T4的控制端连接,用于根据第一控制信号LC1控制第一驱动晶体管T4;第二切换晶体管T3的输出端与第二驱动晶体管T5的控制端连接,用于根据第二控制信号LC2控制第二驱动晶体管T5;其中,第一驱动晶体管T4与第二驱动晶体管T5交替工作。
其中,在本实施例中,第一切换晶体管T2、第二切换晶体管T3可以但不限于为同类型的薄膜晶体管,例如,可以均为N沟道型薄膜晶体管,也可以均为P沟道型薄膜晶体管。对应地,第一控制信号LC1、第二控制信号LC2的工作周期是交替的或者至少部分重叠的。
当第一切换晶体管T2、第二切换晶体管T3均为N沟道型薄膜晶体管时,第一控制信号LC1、第二控制信号LC2的工作周期是其位于高电平持续期间,那么可以理解的是,当第一控制信号LC1、第二控制信号LC2的工作周期以交替方式进行工作时,可以是第一控制信号LC1的下降沿与第二控制信号LC2的上升沿相重合或者是在同一时刻,也可以是第二控制信号LC2的上升沿位于第一控制信号LC1的上升沿与下降沿之间。
当第一切换晶体管T2、第二切换晶体管T3均为P沟道型薄膜晶体管时,第一控制信号LC1、第二控制信号LC2的工作周期是其位于低电平持续期间,那么可以理解的是,当第一控制信号LC1、第二控制信号LC2的工作周期以交替方式进行工作时,可以是第一控制信号LC1的上升沿与第二控制信号LC2的下降沿相重合或者是在同一时刻,也可以是第二控制信号LC2的下降沿位于第一控制信号LC1的下降沿与上升沿之间。
同样地,第一切换晶体管T2可以为N沟道型薄膜晶体管,第二切换晶体管T3可以为P沟道型薄膜晶体管;或者,第一切换晶体管T2可以为P沟道型薄膜晶体管,第二切换晶体管T3可以为N沟道型薄膜晶体管。这样的话,还可以采用第一控制信号LC1、第二控制信号LC2中任一控制信号即可,例如,第一控制信号LC1或者第二控制信号LC2与第一切换晶体管T2的控制端和第二切换晶体管T3的控制端连接,此时,第一控制信号LC1或者第二控制信号LC2处于高电位状态时,第一切换晶体管T2打开,第二切换晶体管T3关闭;或者第一切换晶体管T2关闭,第二切换晶体管T3打开。第一控制信号LC1或者第二控制信号LC2处于低电位状态时,第一切换晶体管T2关闭,第二切换晶体管T3打开;或者第一切换晶体管T2打开,第二切换晶体管T3关闭。
通过上述可知,第一切换晶体管T2可以控制第一驱动晶体管T4的控制端是否接入对应的驱动信号,第二切换晶体管T3可以控制第二驱动晶体管T5的控制端是否接入对应的驱动信号,以便第一驱动晶体管T4与第二驱动晶体管T5可以进行交替工作,使得驱动晶体管可以得到对应的轮休,有利于恢复驱动晶体管的电特性,进而提高驱动晶体管的工作稳定性,从而提升驱动电路整体的工作寿命,增强其信赖性。
综上所述,本申请实施例提供的像素电路,通过第一切换晶体管T2、第二切换晶体管T3控制第一驱动晶体管T4和第二驱动晶体管T5交替工作,可以提高驱动晶体管的稳定性,进而增强像素电路及显示面板的信赖性和使用寿命。
如图1或者图2所示,在其中一个实施例中,像素电路还包括写入晶体管T8,写入晶体管T8的输出端与第一驱动晶体管T4的输出端和第二驱动晶体管T5的输出端连接,用于根据第一扫描信号S1控制数据信号Vdata写入至像素电路。
如图1或者图2所示,在其中一个实施例中,像素电路还包括补偿晶体管T9,补偿晶体管T9的输入端与第一驱动晶体管T4的输入端和第二驱动晶体管T5的输入端连接,补偿晶体管T9的输出端与第一切换晶体管T2的输入端和第二切换晶体管T3的输入端连接,补偿晶体管T9的控制端用于接入第一扫描信号S1。
如图1或者图2所示,在其中一个实施例中,像素电路还包括存储电容C1,存储电容C1的第一端与补偿晶体管T9的输出端连接,存储电容C1的第二端与第二电源信号VSS连接。
如图1或者图2所示,在其中一个实施例中,像素电路还包括初始化晶体管T1,初始化晶体管T1的输出端与存储电容C1的第一端连接,用于根据第二扫描信号S2初始化存储电容C1的第一端的电位至初始电压信号VI的电位。
如图1或者图2所示,在其中一个实施例中,像素电路还包括第一发光控制晶体管T6和第二发光控制晶体管T7;第一发光控制晶体管T6串接于发光回路且第一发光控制晶体管T6的输出端与第一驱动晶体管T4的输入端和第二驱动晶体管T5的输入端连接,用于根据发光控制信号EM通断控制发光回路;第二发光控制晶体管T7串接于发光回路且第二发光控制晶体管T7的输入端与第一驱动晶体管T4的输出端和第二驱动晶体管T5的输出端连接,用于根据发光控制信号EM通断控制发光回路。
在其中一个实施例中,像素电路还包括发光器件LED,发光器件LED串接于发光回路,且发光器件LED的输入端与第一电源信号VDD连接,或者,发光器件LED的输出端与第二电源信号VSS连接。
需要进行说明的是,如图1所示,发光器件LED的输入端可以与第一电源信号VDD连接,发光器件LED的输出端可以与第一发光控制晶体管T6的输入端连接。也可以是如图2所示,发光器件LED的输入端可以与第二发光控制晶体管T7的输出端连接,发光器件LED的输出端与第二电源信号VSS连接。
其中,本实例中的发光器件LED可以为mini-led、micro-led以及oled中的任一种。
在其中一个实施例中,第一电源信号VDD的电位大于第二电源信号VSS的电位。
在其中一个实施例中,第一驱动晶体管T4、第二驱动晶体管T5、第一切换晶体管T2、第二切换晶体管T3、写入晶体管T8、补偿晶体管T9、初始化晶体管T1、第一发光控制晶体管T6以及第二发光控制晶体管T7中至少一个为N型薄膜晶体管。
需要进行说明的是,第一控制信号LC1和/或第二控制信号LC2可以但不限于为频率较低或者低频率的时钟信号。
需要进行说明的是,在本申请的实施例中描述的对应晶体管的输入端可以是其漏极,也可以是其源极。在本申请的实施例中描述的对应晶体管的输出端可以是其漏极,也可以是其源极。在本申请的实施例中描述的对应晶体管的控制端是其栅极。
如图3所示,本实例提供的两种结构的像素电路的工作时序可以包括如下阶段:
复位阶段,当第N-1级扫描信号SCAN(N-1)从低电位变成高电位,初始化晶体管T1打开,即可向Q点写入初始电压信号VI,实现复位。
其中,第一控制信号LC1和第二控制信号LC2为低频时钟信号,互为反相,一个为高电位(VGH),另一个为低电位(VGL)。所以,第一切换晶体管T2和第二切换晶体管T3是其中一个处于开态,则另一个处于关态。通过第一控制信号LC1和第二控制信号LC2来控制是第一驱动晶体管T4或第二驱动晶体管T5工作,这样它们就可以一半时间工作一半时间休息,使得对应的驱动晶体管的电性得以恢复,从而稳定性和信赖性得到提升。
补偿阶段,当第N级扫描信号SCAN(N)从低电位变成高电位,写入晶体管T8和补偿晶体管T9打开,将数据信号Vdata写入到Q点,同时完成对应驱动晶体管的阈值电压(Vth)补偿。
发光阶段,发光控制信号EM从低电位变成高电位,第一发光控制晶体管T6和第二发光控制晶体管T7打开,发光器件LED开始发光。
需要进行说明的是,第一扫描信号S1可以但不限于为第N级扫描信号SCAN(N),也可以是其它类的方波信号。第二扫描信号S2可以但不限于为第N-1级扫描信号SCAN(N-1),也可以是其它类的方波信号。
需要进行说明的是,第一电源信号VDD可以为直流高电位信号,第二电源信号VSS可以为直流低电位信号。
在其中一个实施例中,本申请提供一种显示面板,其包括上述任一实施例中的像素电路。
需要进行说明的是,像素电路中的晶体管以薄膜形成于显示面板的膜层结构中时,第一驱动晶体管T4的尺寸与第二驱动晶体管T5的尺寸可以相同,且大于第一发光控制晶体管T6或者第二发光控制晶体管T7的尺寸。其中,第一发光控制晶体管T6的尺寸可以但不限于与第二发光控制晶体管T7的尺寸相同。第一切换晶体管T2、第二切换晶体管T3、写入晶体管T8、补偿晶体管T9以及初始化晶体管T1中任一晶体管的尺寸均小于第一发光晶体管或者第二发光晶体管的尺寸。
本实施例提供的显示面板可以通过第一切换晶体管T2、第二切换晶体管T3控制第一驱动晶体管T4和第二驱动晶体管T5交替工作,可以提高驱动晶体管的稳定性,进而增强像素电路及显示面板的信赖性和使用寿命。
在上述实施例中,对各个实施例的描述都各有侧重,某个实施例中没有详述的部分,可以参见其他实施例的相关描述。
以上对本申请实施例所提供的像素电路及显示面板进行了详细介绍,本文中应用了具体个例对本申请的原理及实施方式进行了阐述,以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想;本领域的普通技术人员应当理解:其依然可以对前述各实施例所记载的技术方案进行修改,或者对其中部分技术特征进行等同替换;而这些修改或者替换,并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。
Claims (10)
1.一种像素电路,其特征在于,包括:
第一驱动晶体管,串接于第一电源信号与第二电源信号构成的发光回路,用于控制流经所述发光回路的电流;
第二驱动晶体管,与所述第一驱动晶体管并联且串接于所述发光回路,用于控制流经所述发光回路的电流;
第一切换晶体管,所述第一切换晶体管的输出端与所述第一驱动晶体管的控制端连接,用于根据第一控制信号控制所述第一驱动晶体管;
第二切换晶体管,所述第二切换晶体管的输出端与所述第二驱动晶体管的控制端连接,用于根据第二控制信号控制所述第二驱动晶体管;以及
存储电容,所述存储电容的第一端与所述第一切换晶体管的输入端和所述第二切换晶体管的输入端连接;
其中,所述第一驱动晶体管与所述第二驱动晶体管交替工作。
2.根据权利要求1所述的像素电路,其特征在于,所述像素电路还包括:
写入晶体管,所述写入晶体管的输出端与所述第一驱动晶体管的输出端和所述第二驱动晶体管的输出端连接,用于根据第一扫描信号控制数据信号写入至所述像素电路。
3.根据权利要求2所述的像素电路,其特征在于,所述像素电路还包括:
补偿晶体管,所述补偿晶体管的输入端与所述第一驱动晶体管的输入端和所述第二驱动晶体管的输入端连接,所述补偿晶体管的输出端与所述第一切换晶体管的输入端和所述第二切换晶体管的输入端连接,所述补偿晶体管的控制端用于接入所述第一扫描信号。
4.根据权利要求3所述的像素电路,其特征在于,所述存储电容的第二端与所述第二电源信号连接。
5.根据权利要求4所述的像素电路,其特征在于,所述像素电路还包括:
初始化晶体管,所述初始化晶体管的输出端与所述存储电容的第一端连接,用于根据第二扫描信号初始化所述存储电容的第一端的电位至初始电压信号的电位。
6.根据权利要求5所述的像素电路,其特征在于,所述像素电路还包括:
第一发光控制晶体管,串接于所述发光回路且第一发光控制晶体管的输出端与所述第一驱动晶体管的输入端和所述第二驱动晶体管的输入端连接,用于根据发光控制信号通断控制所述发光回路;和
第二发光控制晶体管,串接于所述发光回路且第二发光控制晶体管的输入端与所述第一驱动晶体管的输出端和所述第二驱动晶体管的输出端连接,用于根据所述发光控制信号通断控制所述发光回路。
7.根据权利要求6所述的像素电路,其特征在于,所述像素电路还包括:
发光器件,所述发光器件串接于所述发光回路,且所述发光器件的输入端与所述第一电源信号连接,或者,所述发光器件的输出端与所述第二电源信号连接。
8.根据权利要求1至7任一项所述的像素电路,其特征在于,所述第一电源信号的电位大于所述第二电源信号的电位。
9.根据权利要求6所述的像素电路,其特征在于,所述第一驱动晶体管、所述第二驱动晶体管、所述第一切换晶体管、所述第二切换晶体管、所述写入晶体管、所述补偿晶体管、所述初始化晶体管、所述第一发光控制晶体管以及所述第二发光控制晶体管中至少一个为N型薄膜晶体管。
10.一种显示面板,其特征在于,包括如权利要求1至9任一项所述的像素电路。
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