CN110910834B - 源极驱动器、显示面板及其控制方法、显示装置 - Google Patents

源极驱动器、显示面板及其控制方法、显示装置 Download PDF

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Abstract

本发明实施例提供一种源极驱动器、显示面板及其控制方法、显示装置，涉及显示技术领域，可提高源极驱动器的兼容性。一种源极驱动器，包括：多级移位寄存器、开关电路、以及使能控制电路；移位寄存器包括依次级联的多级移位寄存器单元；相邻两级移位寄存器中，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元，通过一个开关电路电连接；移位寄存器被配置为在第一起始信号的控制下对数字化图像数据进行采样；第n级移位寄存器的第一起始信号由第n‑1级移位寄存器输出，其中，n≥2；使能控制电路被配置为在来自时序控制器的信号的控制下，向开关电路输出第一开启信号或者第一关闭信号。

Description

源极驱动器、显示面板及其控制方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种源极驱动器、显示面板及其控制方法、显示装置。
背景技术
OLED(Organic Light-Emitting Diode，有机发光二极管)具有自发光、发光效率高、效应时间短、使用温度范围宽等诸多优点，被业界公认是最具发展潜力的显示装置。根据驱动方式，OLED可分为PMOLED(Passive matrix Organic Light-emitting Diode，无源矩阵有机发光二极管)和AMOLED(Active-Matrix Organic Light-emitting Diode，有源矩阵有机发光二极管)两大类。其中，AMOLED具有超轻薄，宽视觉，低功耗，响应快，色彩逼真等特点，越来越多应用于手机、电视、平板等显示产品。并且，AMOLED发光效率高，适用于高清晰度大尺寸显示产品。
发明内容
本发明的实施例提供一种源极驱动器、显示面板及其控制方法、显示装置，可提高源极驱动器的兼容性。
为达到上述目的，本发明的实施例采用如下技术方案：
第一方面，提供一种源极驱动器，包括：多级移位寄存器、开关电路、以及使能控制电路；所述移位寄存器包括依次级联的多级移位寄存器单元；相邻两级所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与后一级所述移位寄存器中第一级所述移位寄存器单元，通过一个所述开关电路电连接；所述移位寄存器被配置为在第一起始信号的控制下对数字化图像数据进行采样；第n级移位寄存器的所述第一起始信号由第n-1级移位寄存器输出，其中，n≥2；所述使能控制电路被配置为在来自时序控制器的信号的控制下，向所述开关电路输出第一开启信号或者第一关闭信号。
可选的，所述源极驱动器还包括选通电路和多个数模转换电路；所述数模转换电路与所述移位寄存器一一对应；所述数模转换电路被配置为结合来自灰阶控制器的伽马信号，将接收到的来自与其对应的所述移位寄存器的数字化图像数据，转换为模拟灰阶信号，并通过所述数模转换电路的输出端输出；所述选通电路至少与所述数模转换电路的输出端和第一参考信号端电连接；所述选通电路被配置为在不同时段输出来自所述数模转换电路的模拟灰阶信号或者所述第一参考信号端提供的第一参考信号。
在此基础上，可选的，所述选通电路与所述数模转换电路的输出端、第一参考信号端和第二参考信号端电连接；所述选通电路被配置为在不同时段输出来自所述数模转换电路的模拟灰阶信号、或者所述第一参考信号端提供的第一参考信号、或者所述第二参考信号端提供的第二参考信号。
可选的，所述源极驱动器还包括多个输出缓冲电路；所述输出缓冲电路与所述选通电路的输出端电连接，且所述输出缓冲电路与所述数模转换电路一一对应；所述使能控制电路还被配置为在来自所述时序控制器的信号的控制下，向与通过所述开关电路接收第一起始信号的移位寄存器对应的输出缓冲电路，输出第二开启信号或者第二关闭信号；与通过所述开关电路接收第一起始信号的移位寄存器对应的输出缓冲电路被配置为在所述第二开启信号的控制下，至少将接收到的来自与其对应的数模转换电路的模拟灰阶信号输出，或者将接收到的所述第一参考信号输出；除与通过所述开关电路接收第一起始信号的移位寄存器之外，其余的移位寄存器对应的输出缓冲电路被配置为至少将接收到的来自与该输出缓冲电路对应的所述数模转换电路的模拟灰阶信号输出，或者将接收到的所述第一参考信号输出。
可选的，所述源极驱动器还包括多个数据锁存电路；所述数据锁存电路与所述移位寄存器一一对应；所述数据锁存电路被配置为存储来自与其对应的所述移位寄存器输出的数字化图像数据，并在驱动控制信号的控制下向所述数模转换电路输出。
在此基础上，可选的，所述源极驱动器还包括电平转换电路；所述电平转换电路的输入端与所述数据锁存电路电连接，所述电平转换电路的输出端与所述数模转换电路电连接；所述电平转换电路被配置为将来自所述移位寄存器的低电平的数字化图像数据，转化为高电平的数字化图像数据，并输出至与所述移位寄存器对应的所述数模转换电路。
可选的，所述源极驱动器还包括数据处理器；所述数据处理器与所述移位寄存器电连接；所述数据处理器被配置为对数字化图像数据进行预处理后，传输至所述移位寄存器。
在此基础上，可选的，所述源极驱动器还包括多个接口电路；所述接口电路与所述数据处理器电连接；所述接口电路被配置为将接收到的来自所述时序控制器的图像数据转换为数字化图像数据，并输出至所述数据处理器。
可选的，所述开关电路包括反相器、第一传输门和第二传输门；所述第一传输门包括第一P型晶体管和第一N型晶体管；所述第一N型晶体管的栅极与所述反相器的输入端和所述使能控制电路电连接，所述第一P型晶体管的栅极与所述反相器的输出端电连接；相邻两个所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与所述第一P型晶体管的第一极和所述第一N型晶体管的第一极电连接，后一级所述移位寄存器中第一级所述移位寄存器单元与所述第一P型晶体管的第二极和所述第一N型晶体管的第二极电连接；所述第二传输门包括第二P型晶体管和第二N型晶体管；所述第二P型晶体管的栅极与所述反相器的输入端和所述使能控制电路电连接，所述第二N型晶体管的栅极与所述反相器的输出端电连接；相邻两个所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与所述第二P型晶体管的第一极和所述第二N型晶体管的第一极电连接。
第二方面，提供一种显示面板，所述显示面板具有显示区和周边区；所述周边区设置有至少一个如上述的源极驱动器、以及时序控制器；所述时序控制器与所述源极驱动器电连接。
在此基础上，可选的，所述显示区包括多个亚像素，所述亚像素包括像素驱动电路；所述源极驱动器通过数据线与所述像素驱动电路电连接。
第三方面，提供一种显示装置，包括如上述的显示面板。
第四方面，提供一种显示面板的控制方法，所述显示面板具有显示区和周边区；所述显示区包括多个亚像素，所述亚像素包括像素驱动电路，所述周边区设置有源极驱动器和时序控制器：所述源极驱动器包括多级移位寄存器、开关电路、使能控制电路、选通电路以及多个数模转换电路；所述移位寄存器包括依次级联的多级移位寄存器单元；相邻两级所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与后一级所述移位寄存器中第一级所述移位寄存器单元，通过一个所述开关电路电连接；所述数模转换电路与所述移位寄存器一一对应；所述选通电路至少与所述数模转换电路的输出端和第一参考信号端电连接；所述显示面板的控制方法包括：所述使能控制电路在来自所述时序控制器的信号的控制下，向所述开关电路输出第一开启信号或第一关闭信号；所述移位寄存器在第一起始信号的控制下对数字化图像数据进行采样；第n级移位寄存器的所述第一起始信号由第n-1级移位寄存器输出，并通过开启的所述开关电路传输至第n级移位寄存器，其中，n≥2；所述数模转换电路结合来自灰阶控制器的伽马信号，将接收到的来自与其对应的所述移位寄存器的数字化图像数据，转换为模拟灰阶信号，并通过所述数模转换电路的输出端输出；在一行的数据写入阶段：所述选通电路输出来自所述数模转换电路的模拟灰阶信号；所述像素驱动电路接收来自所述源极驱动器的模拟灰阶信号；在一行的消隐阶段：所述选通电路输出所述第一参考信号端提供的第一参考信号。
在此基础上，可选的，所述选通电路与所述数模转换电路的输出端、第一参考信号端和第二参考信号端电连接；所述显示面板的控制方法包括：在一行的阈值电压补偿阶段：所述选通电路输出所述第二参考信号端提供的第二参考信号；所述像素驱动电路接收所述第二参考信号，以对所述像素驱动电路中的驱动晶体管进行阈值电压补偿。
综上所述，本发明实施例提供一种源极驱动器、显示面板及其控制方法、显示装置，源极驱动器包括：多级移位寄存器、开关电路、以及使能控制电路。移位寄存器包括依次级联的多级移位寄存器单元；相邻两级移位寄存器中，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元，通过一个开关电路电连接；移位寄存器用于在第一起始信号的控制下对数字化图像数据进行采样；第n级移位寄存器的第一起始信号由第n-1级移位寄存器输出，其中，n≥2；使能控制电路用于在来自时序控制器的信号的控制下，向开关电路输出第一开启信号或者第一关闭信号。在此基础上，相比于只通过一个移位寄存器进行采样的源极驱动器，其数据输出通道的个数固定，本发明可以通过开关电路选择进行采样的移位寄存器的个数，对源极驱动器的数据输出通道的个数进行调整，当显示面板分辨率较大时，开启多个移位寄存器，增加源极驱动器的数据输出通道，当显示面板分辨率较小时，开启较少的移位寄存器，减少源极驱动器的数据输出通道，从而使得源极驱动器可以适应各个分辨率的显示面板，提高源极驱动器的兼容性。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种显示装置的结构示意图；
图2为本发明实施例提供的一种像素驱动电路的结构示意图；
图3为本发明实施例提供的一种源极驱动器的结构示意图；
图4为本发明实施例提供的另一种源极驱动器的结构示意图；
图5为本发明实施例提供的又一种源极驱动器的结构示意图；
图6为本发明实施例提供的又一种源极驱动器的结构示意图；
图7为本发明实施例提供的又一种源极驱动器的结构示意图；
图8为现有技术提供的一种源极驱动器的结构示意图；
图9为本发明实施例提供的一种开关电路的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例提供一种显示装置，包括显示面板。如图1所示，显示面板具有显示区(active area，简称AA区)和周边区S。周边区S例如围绕AA区一圈设置。上述AA区中设置有多个亚像素P。
需要说明的是，图1中以上述多个亚像素P呈阵列形式排列为例进行示意，但本发明实施例不限于此，上述多个亚像素还可以以其他方式进行排布。
在此基础上，亚像素包括像素驱动电路。并且，亚像素中还设置有发光器件。如图2所示，像素驱动电路与发光器件L电连接，以驱动发光器件L发光。
示例的，发光器件L为OLED。
其中，像素驱动电路一般由薄膜晶体管(Thin Film Transistor，简称TFT)、电容(Capacitance，简称C)等电子器件组成。例如，如图2所示，像素驱动电路可以是由三个TFT和一个电容构成的3T1C结构的像素驱动电路。
在此基础上，在本发明的一些实施例中，如图3所示，周边区S设置有至少一个源极驱动器10和时序控制器20，时序控制器20与源极驱动器10电连接。
并且，源极驱动器10通过数据线DL与像素驱动电路电连接。
需要说明的是，多个源极驱动器10依次级联。
在本发明的一些实施例中，如图1所示，周边区S还设置有灰阶控制器30，灰阶控制器30与源极驱动器10和时序控制器20电连接。
灰阶控制器30用于在根据来自时序控制器20的显示图像中亚像素的灰阶数据，向源极驱动器10输出伽马信号GMA。
在上述的基础上，本发明实施例提供一种源极驱动器，如图3所示，该源极驱动器包括：多级移位寄存器110、开关电路120、以及使能控制电路130。
其中，移位寄存器110包括依次级联的多个移位寄存器单元。并且，各移位寄存器中移位寄存器单元的个数不完全相同。
相邻两级移位寄存器中，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元，通过一个开关电路电连接。
其中，开关电路120的个数为至少一个。
可以理解的是，在开关电路120的个数为一个的情况下，该开关电路120可以位于任一相邻两级移位寄存器之间(如图3所示)，即，第n-1级移位寄存器中最后一级移位寄存器单元和第n级移位寄存器中第一级移位寄存器单元通过一个开关电路级联。在此情况下，第一级至第n-1级移位寄存器依次级联，第n级至最后一级移位寄存器依次级联，其中，n≥2。
在开关电路120有多个的情况下，可以是奇数级移位寄存器中最后一级移位寄存器单元和与其相邻的偶数级移位寄存器中第一级移位寄存器单元，通过一个开关电路电连接，例如，如图4所示，以图4左侧第一个移位寄存器为第一级移位寄存器，以图4右侧第一个移位寄存器为最后一级移位寄存器，第一级移位寄存器中最后一级移位寄存器单元与第二级移位寄存器中第一级移位寄存器单元通过一个开关电路120电连接，第二级移位寄存器中最后一级移位寄存器单元与第三级移位寄存器中第一级移位寄存器单元直接连接。或者，可以是偶数级移位寄存器中最后一级移位寄存器单元和与其相邻的奇数级移位寄存器中第一级移位寄存器单元，通过一个开关电路电连接。例如，如图5所示，以图5左侧第一个移位寄存器为第一级移位寄存器，以图5右侧第一个移位寄存器为最后一级移位寄存器，第二级移位寄存器中最后一级移位寄存器单元与第三级移位寄存器中第一级移位寄存器单元通过一个开关电路120电连接，第一级移位寄存器中最后一级移位寄存器单元与第二级移位寄存器中第一级移位寄存器单元直接连接。
在本发明的一些实施例中，如图6所示，任意相邻两级移位寄存器中，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元，通过一个开关电路120电连接。
可以理解的是，除了第一级移位寄存器以外，其余各级移位寄存器均可以通过开关电路120，与其前一级移位寄存器级联。
在此基础上，移位寄存器110用于在第一起始信号DIO1的控制下，对数字化图像数据进行采样。第n级移位寄存器的第一起始信号DIO1由第n-1级移位寄存器输出。
需要说明的是，在显示面板包括多个依次级联的源极驱动器10的情况下，第一级源极驱动器中第一级移位寄存器的第一起始信号DIO1来自于时序控制器20，除第一级源极驱动器，每级源极驱动器的第一级移位寄存器的第一起始信号DIO1来自于上一级源极驱动器。
并且，移位寄存器110中最后一级移位寄存器单元在采样结束的同时，输出第二起始信号DIO2，该第二起始信号DIO2作为下一级移位寄存器的第一起始信号DIO1，即，第n-1级移位寄存器输出的第二起始信号DIO2为第n级移位寄存器的第一起始信号DIO1。
使能控制电路130用于在来自时序控制器20的信号的控制下，向开关电路120输出第一开启信号或者第一关闭信号。
可以理解的是，开关电路120在第一开启信号的控制下，使得第n-1级移位寄存器中最后一级移位寄存器单元与第n级移位寄存器中第一级移位寄存器单元连接，在第一关闭信号的控制下，第n-1级移位寄存器中最后一级移位寄存器单元与第n级移位寄存器中第一级移位寄存器单元断开。
其中，第一开启信号可以是高电平信号，第一关闭信号可以是低电平信号。
需要说明的是，使能控制电路130接受的来自时序控制器20的信号，与显示面板的分辨率、源极驱动器10具有的数据输出通道个数等因素有关。
在此基础上，第n-1级移位寄存器在第一起始信号DIO1的控制下，对数字化图像数据进行采样，在第n级移位寄存器最后一级移位寄存器单元将采样的数字化图像数据输出的同时，输出的第二起始信号DIO2。在第n-1级移位寄存器和第n级移位寄存器之间的开关电路120在第一开启信号的控制下开启，开关电路120将第n-1级移位寄存器输出的第二起始信号DIO2传输至第n级移位寄存器，作为第n级移位寄存器的第一起始信号DIO1，控制第n级移位寄存器对数字化图像数据进行采样。
在源极驱动器10中，第n-1级移位寄存器和第n级移位寄存器之间的开关电路120在第一关闭信号的控制下，开关电路120将第n-1级移位寄存器输出的第二起始信号DIO2输出至与该源极驱动器10级联的下一级源极驱动器中第一级移位寄存器，作为下一级源极驱动器中第一级移位寄存器的第一起始信号DIO1。
可以理解的是，在显示面板包括多个依次级联的源极驱动器10的情况下，除第一级源极驱动器，每级源极驱动器将其前一级源极驱动器输出的第二起始信号DIO2作为该源极驱动器中第一级移位寄存器的第一起始信号DIO1。
示例的，在源极驱动器10中第一级移位寄存器和第二级移位寄存器之间的开关电路120在第一关闭信号的控制下，第一级移位寄存器输出的第二起始信号DIO2，不会传输至第二级移位寄存器，而是传输至与该源极驱动器10级联的下一级源极驱动器10中第一级移位寄存器，作为下一级源极驱动器10中第一级移位寄存器的第一起始信号DIO1。在此情况下，该源极驱动器10从第二级至最后一级源极驱动器均不工作，下一级源极驱动器10中第一级移位寄存器开始进行采样。在源极驱动器10中第一级至最后一级移位寄存器均进行采样的情况下，源极驱动器10中的开关电路120均处于开启状态，最后一级移位寄存器在采样结束时输出第二起始信号DIO2，作为下一级源极驱动器中第一级移位寄存器的第一起始信号DIO1，使得下一级源极驱动器中移位寄存器逐级进行采样。
在此基础上，相比于如图8所示的源极驱动器10只通过一个移位寄存器110进行采样，其数据输出通道(即向数据线输出数据的接口)的个数固定，本发明可以通过开关电路120选择进行采样的移位寄存器110的个数，对源极驱动器10的数据输出通道的个数进行调整，当显示面板分辨率较大时，开启较多的移位寄存器110，增加源极驱动器10的数据输出通道，当显示面板分辨率较小时，开启较少的移位寄存器110，减少源极驱动器10的数据输出通道，从而使得源极驱动器10可以适应各个分辨率的显示面板。
示例的，在每级移位寄存器110中均有24级移位寄存器单元的情况下，第一级移位寄存器在来自于时序控制器20的第一起始信号DIO1的控制下，从第一级至第24级移位寄存器单元依次进行采样，串行输出24个采样的数字化图像数据，并在第24级移位寄存器单元输出采样的数字化图像数据的同时输出第二起始信号DIO2，作为第二级移位寄存器的第一起始信号DIO1。在此基础上，位于第一级移位寄存器中第24级移位寄存器单元和第二级移位寄存器中第一级移位寄存器单元之间的一个开关电路，在第一开启信号的控制下导通，将由第一级移位寄存器输出的第二起始信号DIO2作为第二级移位寄存器的第一起始信号DIO1，传输至第二级移位寄存器中第一级移位寄存器单元，使得第二级移位寄存器中第一级至第24级移位寄存器单元依次进行采样，串行输出24个采样的数字化图像数据，并在第24级移位寄存器单元输出采样的数字化图像数据的同时输出第二起始信号DIO2，作为第三级移位寄存器的第一起始信号DIO1。如果位于第二级移位寄存器中第24级移位寄存器单元和第三级移位寄存器中第一级移位寄存器单元之间的一个开关电路接收到第一关闭信号，则第三级移位寄存器不会接收到由第二级移位寄存器输出的第二起始信号DIO2，作为第三级移位寄存器的第一起始信号DIO1，即，第三级移位寄存器不工作，且从第三级至最后一级移位寄存器均不会工作，该源极驱动器10只有第一级移位寄存器和第二级移位寄存器工作，输出48个采样的数字化图像数据。在此基础上，可以通过开关电路120选取进行采样的移位寄存器的个数，当n级移位寄存器且每级移位寄存器中有m个移位寄存器单元(m为大于1的正整数)时，可以输出m×n个采样的数字化图像数据。
需要说明的是，上述的第一级移位寄存器和最后一级移位寄存器是相对的，移位寄存器中第一级移位寄存器单元和最后一级移位寄存器单元也是相对的，均是根据移位寄存器的正向采样和反向采样而定。例如，在源极驱动器10接收到的来自时序控制器20的方位信号SHL(Select High or Low)为高电平时，图6中的源极驱动器10中从第一级移位寄存器至最后一级移位寄存器依次进行正向采样，即，图6中的移位寄存器110从左至右进行采样，在此情况下，第一级移位寄存器中第一级移位寄存器单元接收来自于时序控制器20的第一起始信号DIO1，第一级移位寄存器中最后一级移位寄存器单元输出第二起始信号DIO2，作为第二级移位寄存器的第一起始信号DIO1。在方位信号SHL为低电平时，图7中的源极驱动器10中从最后一级移位寄存器至第一级移位寄存器依次进行反向采样，即，图7的中的移位寄存器110从右至左进行采样，在此情况下，最后一级移位寄存器中最后一级移位寄存器单元可以看成第一级移位寄存器中第一级移位寄存器单元，接收来自于时序控制器20的第一起始信号DIO1，最后一级移位寄存器中第一级移位寄存器单元可以看成第一级移位寄存器中最后一级移位寄存器单元，输出第二起始信号DIO2。
综上所述，本发明实施例提供一种源极寄存器10，包括：多级移位寄存器110、开关电路120、以及使能控制电路130。移位寄存器110包括依次级联的多级移位寄存器单元；相邻两级移位寄存器中，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元，通过一个开关电路120电连接；移位寄存器110用于在第一起始信号DIO1的控制下对数字化图像数据进行采样；第n级移位寄存器的第一起始信号由第n-1级移位寄存器输出，其中，n≥2；使能控制电路130用于在来自时序控制器20的信号的控制下，向开关电路120输出第一开启信号或者第一关闭信号。在此基础上，相比于只通过一个移位寄存器110进行采样的源极驱动器10，其数据输出通道的个数固定，本发明可以通过开关电路120选择进行采样的移位寄存器110的个数，对源极驱动器10的数据输出通道的个数进行调整，当显示面板分辨率较大时，开启多个移位寄存器110，增加源极驱动器10的数据输出通道，当显示面板分辨率较小时，开启较少的移位寄存器110，减少源极驱动器10的数据输出通道，从而使得源极驱动器10可以适应各个分辨率的显示面板，提高源极驱动器10的兼容性。
在本发明的一些实施例中，如图3-图7所示，源极驱动器10还包括选通电路140和多个数模转换电路150。
其中，数模转换电路150与移位寄存器110一一对应。
可以理解的是，数模转换电路150和移位寄存器110的数量相同。
数模转换电路150用于结合来自灰阶控制器30的伽马信号GMA，将接收到的来自与其对应的移位寄存器110的数字化图像数据，转换为模拟灰阶信号，并通过数模转换电路150的输出端输出。
选通电路140至少与数模转换电路150的输出端和第一参考信号端Vref1电连接。
选通电路140用于在不同时段输出来自数模转换电路150的模拟灰阶信号或者第一参考信号端Vref1提供的第一参考信号。
其中，第一参考信号的电位位于模拟灰阶信号的电位的最高值和最低值之间。
需要说明的是，数模转换电路150包括多个数模转换单元，且数模转换电路150中数模转换单元的个数与该数模转换电路150对应的移位寄存器110中移位寄存器单元的个数正相关。
在此基础上，在一行的数据写入阶段，选通电路140输出来自数模转换电路150的模拟灰阶信号，以使像素驱动电路进行数据写入。在一行的消隐阶段，选通电路140输出第一参考信号，对数据线DL进行预充，使得数据线DL上的信号的电位等于第一参考信号的电位。
可以理解的是，模拟灰阶信号的电位的幅值范围较大(例如幅值范围为12V)，当来自数模转换电路150的模拟灰阶信号传输至数据线DL时，各数据线DL中信号的电位由第一参考信号的电位变换至该数据线DL的模拟灰阶信号的电位，使得各数据线DL中信号的电位翻转时间所处的变化范围均缩小，从而缩短了显示面板中的各数据线DL中信号的电位最大翻转的时间，提高了显示面板的刷新频率。在本发明的一些实施例中，如图3-图7所示，选通电路140与数模转换电路150的输出端、第一参考信号端Vref1和第二参考信号端Vref2电连接。
选通电路140用于在不同时段输出来自数模转换电路150的模拟灰阶信号、或者第一参考信号端Vref1提供的第一参考信号、或者第二参考信号端Vref2提供的第二参考信号。
其中，在一行的阈值电压补偿阶段，选通电路140输出第二参考信号。在此情况下，像素驱动电路可以根据第二参考信号对像素驱动电路中的驱动晶体管进行阈值电压补偿。
需要说明的是，该选通电路140接收多个信号，在某一时段输出接收的多个信号中的一个信号，以实现选通电路140的选通功能。在此基础上，能够实现上述的选通功能的电路均可以作为本发明实施例中的选通电路140，本发明在此对选通电路140的具体结构不做限定，本领域技术人员可以根据实际情况进行设置。
在此基础上，可选的，源极驱动器10还包括带隙基准电路，该带隙基准电路与第一参考信号端Vref1和第二参考信号端Vref2电连接。带隙基准电路用于通过第一参考信号端Vref1和第二参考信号端Vref2向选通电路140分别提供第一参考信号和第二参考信号。在本发明的一些实施例中，如图3-图7所示，源极驱动器10还包括多个输出缓冲电路160。
其中，输出缓冲电路160与选通电路140的输出端电连接，且输出缓冲电路160与数模转换电路150一一对应。
可以理解的是，输出缓冲电路160与数模转换电路150的数量相同。一个输出缓冲电路160的输出端与一根数据线DL电连接。
使能控制电路130还用于在来自时序控制器20的信号的控制下，向与通过开关电路120接收第一起始信号的移位寄存器110对应的输出缓冲电路160，输出第二开启信号或者第二关闭信号。
与通过开关电路120接收第一起始信号DIO1的移位寄存器110对应的输出缓冲电路160用于在第二开启信号的控制下，至少将接收到的来自与其对应的数模转换电路150的模拟灰阶信号输出，或者将接收到的第一参考信号输出。
除与通过开关电路120接收第一起始信号DIO1的移位寄存器110之外，其余的移位寄存器110对应的输出缓冲电路160用于至少将接收到的来自与该输出缓冲电路160对应的数模转换电路150的模拟灰阶信号输出，或者将接收到的第一参考信号输出。
可以理解的是，与通过开关电路120接收第一起始信号DIO1的移位寄存器110对应的输出缓冲电路160还用于在第二关闭信号的控制下，不输出信号。
其中，与通过开关电路120接收第一起始信号DIO1的移位寄存器110指的是，该移位寄存器110中第一级移位寄存器单元通过开关电路120，接收由其前一级移位寄存器中最后一级移位寄存器单元输出的第一起始信号DIO1。
需要说明的是，输出缓冲电路160接收的第二开启信号或者第二关闭信号，与该输出缓冲电路160对应的移位寄存器110中第一级移位寄存器单元所电连接的开关电路120接收的第一开启信号或者第一关闭信号有关。其中，第一开启信号的电位低于第二开启信号的电位，第一关闭信号的电位低于第二关闭信号的电位。
可以理解的是，当移位寄存器110通过开关电路120接收第一起始信号DIO1处于工作状态时，该移位寄存器110对应的输出缓冲电路160也开始工作，当移位寄存器110通过开关电路120未接收到第一起始信号DIO1处于不工作状态时，该移位寄存器110对应的输出缓冲电路160也不工作。例如，第二级移位寄存器中第一级移位寄存器单元所电连接的开关电路120接收的是第一开启信号，第二级移位寄存器对应的输出缓冲电路160接收的是第二开启信号，即，第二级移位寄存器工作，其对应的输出缓冲电路160工作；第二级移位寄存器中第一级移位寄存器单元所电连接的开关电路120接收的是第一关闭信号，第二级移位寄存器对应的输出缓冲电路160接收的是第二关闭信号，即，第二级移位寄存器不工作，其对应的输出缓冲电路160不工作。
在此基础上，源极驱动器10可以通过开关电路120，使得移位寄存器110的开启或关闭，则与该移位寄存器110对应的输出缓冲电路160也相应的开启或关闭，从而对源极驱动器10的数据输出通道的个数进行调整，以适应各个分辨率的显示面板，并且，当无需工作的移位寄存器110在开关电路120的作用下处于关闭状态时，其对应的输出缓冲电路160可以在第二关闭信号的控制下不工作，使得输出缓冲电路160无需一直保持工作状态，从而降低源极驱动器10的功耗。
并且，输出缓冲电路160可以提高源极驱动器10的驱动能力，即，源极驱动器10的带负载能力。
在本发明的一些实施例中，如图3-图7所示，源极驱动器10还包括多个数据锁存电路170。
其中，数据锁存电路170与移位寄存器110一一对应。
可以理解的是，数据锁存电路170与移位寄存器110的数量相同。
数据锁存电路170用于存储来自与其对应的移位寄存器110输出的数字化图像数据，并在驱动控制信号STB的控制下向数模转换电路150输出。
需要说明的是，数据锁存电路170的输出为并行输出。可以理解的是，由于移位寄存器110中的移位寄存器单元依次对数据化图像数据进行采样和输出，即，移位寄存器110的输出为串行输出，因此，数据锁存电路170依次锁存对应的移位寄存器110输出的数字化图像数据。
需要说明的是，每个数据锁存电路170包括多个数据锁存单元，且数据锁存电路170中数据锁存单元的个数与该数据锁存电路170对应的移位寄存器110正相关。
示例的，数据锁存电路170中数据锁存单元的个数可以为该数据锁存电路170对应的移位寄存器110中移位寄存器单元的个数乘以该移位寄存器110所采样的数据容量的大小。例如，移位寄存器110所采样的数据容量为80bit，且该移位寄存器110包括24个移位寄存器单元，则其对应的数据锁存电路170中至少有1920个数据锁存单元，在此情况下，若数据以10bit传输，则该移位寄存器110和数据锁存电路170所对应的输出通道为192个。
在本发明的一些实施例中，如图3-图7所示，源极驱动器10还包括电平转换电路180。
电平转换电路180的输入端与数据锁存电路170电连接，电平转换电路180的输出端与数模转换电路150电连接。
电平转换电路180用于将来自移位寄存器110的低电平的数字化图像数据，转化为高电平的数字化图像数据，并输出至于移位寄存器110对应的数模转换电路150。
需要说明的是，电平转换电路180的输出为并行输出。
可以理解的是，电平转换电路180将低电平的数字化图像数据转化为高电平的数字化图像数据，以适用于像素驱动电路中驱动晶体管的电压。
在本发明的一些实施例中，如图3-图7所示，源极驱动器10还包括数据处理器190。
其中，数据处理器190与移位寄存器110电连接。
数据处理器190用于为对数字化图像数据进行预处理后，传输至移位寄存器110。
示例的，该预处理包括对数字化图像数据进行数据反向处理、串并转换处理、实现数据交换(SWAP)功能等。
可以理解的是，数据处理器190是对数字信号进行处理，相比于将数据处理器190设置在输出缓冲电路160的输入端之前对模拟信号进行处理，能够提高对信号处理的速度和精度。并且，将数据处理器190设置在低电压区域，相比于设置在高电压区域，可以减小晶体管的面积，缩小源极驱动器10的尺寸。
在此基础上，在本发明的一些实施例中，如图3-图7所示，源极驱动器10还包括多个接口电路101。
其中，接口电路101与数据处理器190电连接。
接口电路101用于将接收到的来自时序控制器20的图像数据转换为数字化图像数据，并输出至数据处理器190。
可以理解的是，在多个亚像素P至少包括第一颜色亚像素、第二颜色亚像素和第三颜色亚像素的情况下，接口电路101的个数为3N个，N为正整数，分别接收第一颜色亚像素所要显示的图像数据、第二颜色亚像素所要显示的图像数据、以及第三颜色亚像素所要显示的图像数据，其中，第一颜色、第二颜色和第三颜色为三基色。在多个亚像素还包括第四颜色亚像素的情况下，接口电路101的个数为4N个，分别接收第一颜色亚像素所要显示的图像数据、第二颜色亚像素所要显示的图像数据、第三颜色亚像素所要显示的图像数据、以及第四颜色亚像素所要显示的图像数据，其中，第四颜色为白色。
其中，各接口电路101均具有相同结构。
需要说明的是，多个接口电路101各自接收的图像数据可以根据显示面板中亚像素的位置进行调整，本发明在此不做限定。并且，本发明对接口电路101的接口类型也不做限定，本领域技术人员可以根据实际情况进行设置。
示例的，接口电路101可以包括微型低压差分信号(Mini Low VoltageDifferential Signaling，简称Mini-LVDS)接口、点到点(Point-to-Point，简称P2P)接口等。
在本发明的一些实施例中，开关电路120包括反相器F、第一传输门121和第二传输门122。
如图9所示，第一传输门121包括第一P型晶体管MP1和第一N型晶体管MN1。
其中，第一N型晶体管MN1的栅极与反相器F的输入端和使能控制电路130电连接，第一P型晶体管MP1的栅极与反相器F的输出端电连接。
相邻两个移位寄存器110中，前一级移位寄存器中最后一级移位寄存器单元与第一P型晶体管MP1的第一极和第一N型晶体管MN1的第一极电连接，后一级移位寄存器中第一级移位寄存器单元与第一P型晶体管MP1的第二极和第一N型晶体管MN1的第二极电连接。
第二传输门122包括第二P型晶体管MP2和第二N型晶体管MN2。
第二P型晶体管MP2的栅极与反相器F的输入端和使能控制电路130电连接，第二N型晶体管MN2的栅极与反相器F的输出端电连接。
相邻两个移位寄存器中，前一级移位寄存器中最后一级移位寄存器单元与第二P型晶体管MP2的第一极和第二N型晶体管MN2的第一极电连接。
需要说明的是，在显示面板包括多个源极驱动器10的情况下，除最后一级源极驱动器，每级源极驱动器第二传输门122中第二P型晶体管MP2的第二极和第二N型晶体管MN2的第二极与下一级源极驱动器中的第一级移位寄存器中第一级移位寄存器单元电连接。
可以理解的是，在来自使能控制电路130的第一开启信号为高电平的情况下，第一N型晶体管MN1开启，该高电平的第一开启信号通过反相器F变为低电平，使得第一P型晶体管MP1开启，第二P型晶体管MP2截止，该高电平的第一开启信号通过反相器F变为低电平，使得第二N型晶体管MN2截止。此时，相邻两个移位寄存器10中，第一传输门121开启，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元连接，使得后一级移位寄存器接收前一级移位寄存器输出的第二起始信号DIO2，作为后一级移位寄存器的第一起始信号DIO1，后一级移位寄存器开始工作。
在来自使能控制电路130的第一关闭信号为低电平的情况下，第一N型晶体管MN1截止，该低电平的第一关闭信号通过反相器F变为高电平，使得第一P型晶体管MP1截止。第二P型晶体管MP2开启，该低电平的第一关闭信号通过反相器F变为高电平，使得第二N型晶体管MN1开启。此时，相邻两个移位寄存器10中，第一传输门121断开，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元断开，使得后一级移位寄存器不工作。第二传输门122开启，前一级移位寄存器输出的第二起始信号DIO2通过第二传输门122，传输至下一级源极驱动器中的第一级移位寄存器中第一级移位寄存器单元，作为该下一级源极驱动器中的第一级移位寄存器的第一起始信号DIO1，该第一级移位寄存器开始工作。
在此基础上，本发明实施例提供一种显示面板的控制方法，如图1所示，显示面板具有AA区和周边区S。AA区包括多个亚像素P，亚像素P包括像素驱动电路，周边区S设置有源极驱动器10和时序控制器20。
参考图3-图7，源极驱动器10包括多级移位寄存器110、多个开关电路120、使能控制电路130、选通电路140以及多个数模转换电路150。
移位寄存器110包括依次级联的多级移位寄存器单元。相邻两级移位寄存器110中，前一级移位寄存器中最后一级移位寄存器单元与后一级移位寄存器中第一级移位寄存器单元，通过一个开关电路电连接。
数模转换电路150与移位寄存器一一对应。选通电路140至少与数模转换电路150的输出端和第一参考信号端Vref1电连接。
显示面板的控制方法包括：
使能控制电路130在来自时序控制器20的信号的控制下，向开关电路120输出第一开启信号或第一关闭信号。
移位寄存器110在第一起始信号DIO1的控制下对数字化图像数据进行采样；第n级移位寄存器的第一起始信号DIO1由第n-1级移位寄存器输出，并通过开启的开关电路120传输至第n级移位寄存器，其中，n≥2。
可以理解的是，开关电路120在第一开启信号的控制下开启时，使得第n-1级移位寄存器中最后一级移位寄存器单元与第n级移位寄存器中第一级移位寄存器单元连接，第n级移位寄存器的第一起始信号DIO1由第n-1级移位寄存器输出，第n级移位寄存器开始进行采样。开关电路120在第一关闭信号的控制下，第n-1级移位寄存器中最后一级移位寄存器单元与第n级移位寄存器中第一级移位寄存器单元断开，第n级移位寄存器不会进行采样。
例如，第一级移位寄存器在来自时序控制器20的第一起始信号DIO1的控制下，对数字化图像数据进行采样，在第一级移位寄存器中最后一级移位寄存器单元在采样结束的同时输出第二起始信号DIO2，作为第二级移位寄存器的第一起始信号DIO1。如果第一级移位寄存器中最后一级移位寄存器单元与第二级移位寄存器中第一级移位寄存器单元通过一个开关电路120电连接，当开关电路120在第一开启信号的控制下开启时，第二级移位寄存器才会接收到由第一级移位寄存器输出的第二起始信号DIO2，作为第一起始信号DIO1，开始进行采样；当开关电路120接收到第一关闭信号时，第二级移位寄存器与第一级移位寄存器断开，第二级移位寄存器不进行采样。如果第一级移位寄存器中最后一级移位寄存器单元与第二级移位寄存器中第一级移位寄存器单元直接连接，那么在第一级移位寄存器采样结束时，第二级移位寄存器直接开始进行采样。
在此基础上，数模转换电路150结合来自灰阶控制器30的伽马信号GMA，将接收到的来自与其对应的移位寄存器110的数字化图像数据，转换为模拟灰阶信号，并通过数模转换电路150的输出端输出。
在一行的数据写入阶段：选通电路140输出来自数模转换电路150的模拟灰阶信号，像素驱动电路接收来自源极驱动器10的模拟灰阶信号。在一行的消隐阶段：选通电路140输出第一参考信号端Vref1提供的第一参考信号。
在此基础上，参考图3-图7，选通电路140与数模转换电路150的输出端、第一参考信号端Vref1和第二参考信号端Vref2电连接。
显示面板的控制方法包括：
在一行的阈值电压补偿阶段：选通电路140输出第二参考信号端Vref2提供的第二参考信号；像素驱动电路接收第二参考信号，以对像素驱动电路中的驱动晶体管进行阈值电压补偿。
以下，结合如图2所示的像素驱动电路，对上述的显示面板的控制方法进行详细说明。
其中，如图2所示，像素驱动电路包括第一晶体管M1、第二晶体管M2、驱动晶体管DT以及电容C。其中，第一晶体管M1的栅极与第一栅线G1连接，第一晶体管M1的第一极与数据线DL连接，第一晶体管M1的第二极与驱动晶体管DT的栅极连接。第二晶体管M2的栅极与第二栅线G2连接，第二晶体管M2的第一极与侦测信号线SL连接，第二晶体管M2的第二极与驱动晶体管DT的第二极连接。驱动晶体管DT的第一极与第一电压端VDD连接，驱动晶体管DT的第二极与发光器件L的第一极连接，发光器件L的第二极接地。电容C的第一极与驱动晶体管DT的栅极连接，电容C的第二极与驱动晶体管DT的第二极连接。
需要说明的是，上述第一晶体管M1、第二晶体管M2和驱动晶体管DT可以为N型晶体管，也可以为P型晶体管；可以为增强型晶体管，也可以为耗尽型晶体管；上述第一晶体管M1、第二晶体管M2和驱动晶体管DT的第一极可以为源极，第二极可以为漏极，或者上述晶体管的第一极可以为漏极，第二极为源极，本发明对此不作限定。
此外，本发明以上述第一晶体管M1、第二晶体管M2和驱动晶体管DT均为N型晶体管为例进行说明。
在此基础上，该像素驱动电路的驱动方法在一行显示时间内包括：消隐阶段、重置阶段、阈值电压补偿阶段、数据写入阶段、发光阶段。
在一行的消隐阶段，第一晶体管M1和第二晶体管M2截止，源极驱动器10将选通电路140输出的第一参考信号传输至数据线DL，使得数据线DL中信号的电位与第一参考信号的电位Vref1相同。此时，驱动晶体管DT截止，发光器件L不发光。
在一行的重置阶段：源极驱动器10将选通电路140输出的第二参考信号传输至数据线DL，使得数据线DL中信号的电位变换至第二参考信号的电位Vref2。第一晶体管M1开启，驱动晶体管DT的栅极电位Vg达到第二参考信号的电位Vref2。第二晶体管M2开启，来自侦测信号线SL的信号通过第二晶体管M2传输至驱动晶体管DT的源极，使得驱动晶体管DT的源极电位Vs为来自侦测信号线SL的信号的电位VSL。其中，当驱动晶体管DT的栅源电位差Vgs＝Vref2-VSL大于驱动晶体管DT的阈值电压Vth时，驱动晶体管DT的开启。
需要说明的是，发光器件L的第一极的电位为来自侦测信号线SL的信号的电位VSL，在重置阶段该来自侦测信号线SL的信号的电位VSL控制发光器件L不发光。在此基础上，本领域技术人员可以在满足发光器件L不发光的条件下，设定第二参考信号的电位Vref2和来自侦测信号线SL的信号的电位VSL的幅值。
在一行的阈值电压补偿阶段：第一晶体管M1保持开启，第二晶体管M2截止，此时，驱动晶体管DT的栅极电压Vg＝Vref2，源极电压Vs从重置阶段的VSL逐渐变化至Vref2-Vth，驱动晶体管DT逐渐截止，即，驱动晶体管DT的栅源电位差Vgs由Vref2-VSL逐渐变为驱动晶体管DT的阈值电压Vth，从而完成了对驱动晶体管DT的阈值电压Vth的侦测，并且保证了后续在像素数据写入阶段，能够驱动晶体管DT的阈值电压Vth进行补偿，以消除驱动晶体管DT的阈值电压Vth对实际驱动的影响。此时，发光器件L不发光。
在一行的数据写入阶段：第一晶体管M1保持开启，第二晶体管M2截止，源极驱动器10将选通电路140输出的来自数模转换电路150的模拟灰阶信号，传输至数据线DL，使得模拟灰阶信号写入像素驱动电路，此时，驱动晶体管DT的栅极的电位为模拟灰阶信号的电位Vdata，同时，该模拟灰阶信号存储至电容C。在此情况下，驱动晶体管DT开启。
在此基础上，驱动晶体管DT的源极电位Vs＝Vref2-Vth，栅极电位Vg＝Vdata，此时流经驱动晶体管DT的驱动电流I＝K×(Vgs-Vth)2＝K×(Vdata-Vref2+Vth-Vth)2＝K×(Vdata-Vref2)2，K为导电常数。可以看出，此时流经驱动晶体管DT的驱动电流I与驱动晶体管DT的阈值电压Vth无关，从而实现了对驱动晶体管DT的阈值电压Vth的补偿，消除了驱动晶体管DT的阈值电压Vth对实际驱动的影响。
在一行的发光阶段：第一晶体管M1和第二晶体管M2均截止。电容C对驱动晶体管DT的栅极持续放电，驱动晶体管DT保持开启，发光器件L发光。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (14)

1.一种源极驱动器，其特征在于，包括：多级移位寄存器、开关电路、以及使能控制电路；
所述移位寄存器包括依次级联的多级移位寄存器单元；相邻两级所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与后一级所述移位寄存器中第一级所述移位寄存器单元，通过一个所述开关电路电连接；
所述移位寄存器被配置为在第一起始信号的控制下对数字化图像数据进行采样；第n级移位寄存器的所述第一起始信号由第n-1级移位寄存器输出，其中，n≥2；
所述使能控制电路被配置为在来自时序控制器的信号的控制下，向所述开关电路输出第一开启信号或者第一关闭信号；所述开关电路被配置为在所述第一关闭信号的控制下，将与其连接的前一级移位寄存器单元输出的第二起始信号仅传输至与所述源极驱动器级联的下一级源极驱动器中的第一级移位寄存器。
2.根据权利要求1所述的源极驱动器，其特征在于，所述源极驱动器还包括选通电路和多个数模转换电路；
所述数模转换电路与所述移位寄存器一一对应；所述数模转换电路被配置为结合来自灰阶控制器的伽马信号，将接收到的来自与其对应的所述移位寄存器的数字化图像数据，转换为模拟灰阶信号，并通过所述数模转换电路的输出端输出；
所述选通电路至少与所述数模转换电路的输出端和第一参考信号端电连接；所述选通电路被配置为在不同时段输出来自所述数模转换电路的模拟灰阶信号或者所述第一参考信号端提供的第一参考信号。
3.根据权利要求2所述的源极驱动器，其特征在于，所述选通电路与所述数模转换电路的输出端、第一参考信号端和第二参考信号端电连接；
所述选通电路被配置为在不同时段输出来自所述数模转换电路的模拟灰阶信号、或者所述第一参考信号端提供的第一参考信号、或者所述第二参考信号端提供的第二参考信号。
4.根据权利要求2所述的源极驱动器，其特征在于，所述源极驱动器还包括多个输出缓冲电路；
所述输出缓冲电路与所述选通电路的输出端电连接，且所述输出缓冲电路与所述数模转换电路一一对应；
所述使能控制电路还被配置为在来自所述时序控制器的信号的控制下，向与通过所述开关电路接收第一起始信号的移位寄存器对应的输出缓冲电路，输出第二开启信号或者第二关闭信号；
与通过所述开关电路接收第一起始信号的移位寄存器对应的输出缓冲电路被配置为在所述第二开启信号的控制下，至少将接收到的来自与其对应的数模转换电路的模拟灰阶信号输出，或者将接收到的所述第一参考信号输出；
除与通过所述开关电路接收第一起始信号的移位寄存器之外，其余的移位寄存器对应的输出缓冲电路被配置为至少将接收到的来自与该输出缓冲电路对应的所述数模转换电路的模拟灰阶信号输出，或者将接收到的所述第一参考信号输出。
5.根据权利要求2所述的源极驱动器，其特征在于，所述源极驱动器还包括多个数据锁存电路；
所述数据锁存电路与所述移位寄存器一一对应；
所述数据锁存电路被配置为存储来自与其对应的所述移位寄存器输出的数字化图像数据，并在驱动控制信号的控制下向所述数模转换电路输出。
6.根据权利要求5所述的源极驱动器，其特征在于，所述源极驱动器还包括电平转换电路；
所述电平转换电路的输入端与所述数据锁存电路电连接，所述电平转换电路的输出端与所述数模转换电路电连接；所述电平转换电路被配置为将来自所述移位寄存器的低电平的数字化图像数据，转化为高电平的数字化图像数据，并输出至与所述移位寄存器对应的所述数模转换电路。
7.根据权利要求1所述的源极驱动器，其特征在于，所述源极驱动器还包括数据处理器；所述数据处理器与所述移位寄存器电连接；
所述数据处理器被配置为对数字化图像数据进行预处理后，传输至所述移位寄存器。
8.根据权利要求7所述的源极驱动器，其特征在于，所述源极驱动器还包括多个接口电路；所述接口电路与所述数据处理器电连接；
所述接口电路被配置为将接收到的来自所述时序控制器的图像数据转换为数字化图像数据，并输出至所述数据处理器。
9.根据权利要求1所述的源极驱动器，其特征在于，所述开关电路包括反相器、第一传输门和第二传输门；
所述第一传输门包括第一P型晶体管和第一N型晶体管；
所述第一N型晶体管的栅极与所述反相器的输入端和所述使能控制电路电连接，所述第一P型晶体管的栅极与所述反相器的输出端电连接；
相邻两个所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与所述第一P型晶体管的第一极和所述第一N型晶体管的第一极电连接，后一级所述移位寄存器中第一级所述移位寄存器单元与所述第一P型晶体管的第二极和所述第一N型晶体管的第二极电连接；
所述第二传输门包括第二P型晶体管和第二N型晶体管；
所述第二P型晶体管的栅极与所述反相器的输入端和所述使能控制电路电连接，所述第二N型晶体管的栅极与所述反相器的输出端电连接；
相邻两个所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与所述第二P型晶体管的第一极和所述第二N型晶体管的第一极电连接。
10.一种显示面板，其特征在于，所述显示面板具有显示区和周边区；所述周边区设置有至少一个如权利要求1-9任一项所述的源极驱动器、以及时序控制器；
所述时序控制器与所述源极驱动器电连接。
11.根据权利要求10所述的显示面板，其特征在于，所述显示区包括多个亚像素，所述亚像素包括像素驱动电路；
所述源极驱动器通过数据线与所述像素驱动电路电连接。
12.一种显示装置，其特征在于，包括权利要求10或11所述的显示面板。
13.一种显示面板的控制方法，其特征在于，所述显示面板具有显示区和周边区；所述显示区包括多个亚像素，所述亚像素包括像素驱动电路，所述周边区设置有源极驱动器和时序控制器：
所述源极驱动器包括多级移位寄存器、开关电路、使能控制电路、选通电路以及多个数模转换电路；所述移位寄存器包括依次级联的多级移位寄存器单元；相邻两级所述移位寄存器中，前一级所述移位寄存器中最后一级所述移位寄存器单元与后一级所述移位寄存器中第一级所述移位寄存器单元，通过一个所述开关电路电连接；
所述数模转换电路与所述移位寄存器一一对应；所述选通电路至少与所述数模转换电路的输出端和第一参考信号端电连接；
所述显示面板的控制方法包括：
所述使能控制电路在来自所述时序控制器的信号的控制下，向所述开关电路输出第一开启信号或第一关闭信号；所述开关电路被配置为在所述第一关闭信号的控制下，将与其连接的前一级移位寄存器单元输出的第二起始信号仅传输至与所述源极驱动器级联的下一级源极驱动器中的第一级移位寄存器；
所述移位寄存器在第一起始信号的控制下对数字化图像数据进行采样；第n级移位寄存器的所述第一起始信号由第n-1级移位寄存器输出，并通过开启的所述开关电路传输至第n级移位寄存器，其中，n≥2；
所述数模转换电路结合来自灰阶控制器的伽马信号，将接收到的来自与其对应的所述移位寄存器的数字化图像数据，转换为模拟灰阶信号，并通过所述数模转换电路的输出端输出；
在一行的数据写入阶段：
所述选通电路输出来自所述数模转换电路的模拟灰阶信号；所述像素驱动电路接收来自所述源极驱动器的模拟灰阶信号；
在一行的消隐阶段：
所述选通电路输出所述第一参考信号端提供的第一参考信号。
14.根据权利要求13所述的显示面板的控制方法，其特征在于，所述选通电路与所述数模转换电路的输出端、第一参考信号端和第二参考信号端电连接；
所述显示面板的控制方法包括：
在一行的阈值电压补偿阶段：
所述选通电路输出所述第二参考信号端提供的第二参考信号；所述像素驱动电路接收所述第二参考信号，以对所述像素驱动电路中的驱动晶体管进行阈值电压补偿。
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