CN110827765B - 显示面板及其驱动方法、显示装置 - Google Patents

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Abstract

一种显示面板及其驱动方法、显示装置。该显示面包括像素单元组、第一数据线、第二数据线、至少一条栅线、至少一条发光控制线和扫描电路。像素单元组包括相邻的第一像素单元和第二像素单元，第一像素单元和第二像素单元分别包括第一像素电路和第二像素电路，第一像素电路包括第一选通控制端和第一发光控制端，第二像素电路包括第二选通控制端和第二发光控制端；第一数据线与第一像素电路连接，第二数据线与第二像素电路连接；以及扫描电路包括第一扫描信号端与第二扫描信号端，第一扫描信号端通过至少一条栅线与第一选通控制端和第二选通控制端连接，第二扫描信号端通过至少一条发光控制线与第一发光控制端和第二发光控制端连接。

Description

显示面板及其驱动方法、显示装置
技术领域
本公开的实施例涉及一种显示面板及其驱动方法、显示装置。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)显示面板由于具有视角宽、对比度高、响应速度快以及相比于无机发光显示器件的更高的发光亮度、更低的驱动电压等优势而逐渐受到人们的广泛关注。由于上述特点，有机发光二极管(OLED)显示面板可以适用于手机、显示器、笔记本电脑、数码相机、仪器仪表等具有显示功能的装置。
发明内容
本公开的至少一个实施例提供了一种显示面板，其包括：像素单元组、第一数据线、第二数据线、至少一条栅线、至少一条发光控制线和扫描电路。像素单元组包括相邻的第一像素单元和第二像素单元，第一像素单元和第二像素单元分别包括第一像素电路和第二像素电路，第一像素电路包括第一选通控制端和第一发光控制端，第二像素电路包括第二选通控制端和第二发光控制端；第一数据线与第一像素电路连接，第二数据线与第二像素电路连接；以及扫描电路包括第一扫描信号端与第二扫描信号端，第一扫描信号端通过至少一条栅线与第一选通控制端和第二选通控制端连接，第二扫描信号端通过至少一条发光控制线与第一发光控制端和第二发光控制端连接。
本公开的至少一个实施还例提供了一种显示装置，其包括本公开任一实施例提供的显示面板。
本公开的至少一个实施又例提供了一种本公开任一实施例的显示面板的驱动方法，其包括：使用扫描电路的第一扫描信号端在第一时间段内同时向第一选通控制端和第二选通控制端提供的选通信号，其中，第一时间段依次包括第一子时间段和第二子时间段；以及在第一子时间段内，通过第一数据线向第一像素电路写入第一数据信号，并通过第二数据线向第二像素电路写入第二数据信号。
附图说明
为了更清楚地说明本公开实施例的技术方案，下面将对实施例的附图作简单地介绍，显而易见地，下面描述中的附图仅仅涉及本公开的一些实施例，而非对本公开的限制。
图1A是一种像素电路的示意图；
图1B是图1A示出的像素电路的驱动时序图；
图2本公开的至少一个实施例提供的一种显示面板示意图；
图3本公开的至少一个实施例提供的另一种显示面板示意图；
图4是图3示出的显示面板的驱动时序图；
图5本公开的至少一个实施例提供的再一种显示面板示意图；
图6是图5示出的显示面板的驱动时序图；
图7是一种显示装置的示意图；以及
图8是本公开的至少一个实施例提供的显示面板的驱动方法的示意性流程图。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例的附图，对本公开实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本公开的一部分实施例，而不是全部的实施例。基于所描述的本公开的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其他实施例，都属于本公开保护的范围。
除非另作定义，此处使用的技术术语或者科学术语应当为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。同样，“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
OLED显示装置通常包括多个按阵列排布的像素单元，每个像素单元例如可以包括像素电路。在OLED显示装置中，各个像素电路中的驱动晶体管的阈值电压由于制备工艺可能存在差异，而且由于例如温度变化的影响，驱动晶体管的阈值电压可能会产生漂移现象。因此，各个驱动晶体管的阈值电压的不同可能会导致显示不良(例如显示不均匀)，所以就需要对驱动晶体管的阈值电压进行补偿。
图1A示出了一种具有阈值补偿能力的像素电路。如图1A所示，该像素电路为7T1C型像素电路，也即，具有七个晶体管和一个存储电容C1的像素电路。具体而言，该像素电路包括第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、存储电容C1、发光元件(例如oled)、第一节点N1以及第二节点N2。第二晶体管T2和第四晶体管T4的控制端配置为像素电路的选通控制端GAT，与栅线连接，以接收扫描信号；第五晶体管T5和第六晶体管T6的控制端配置为像素电路的发光控制端EM，与发光控制线连接，以接收发光控制信号；第一晶体管T1和第七晶体管T7的控制端配置为像素电路的复位控制端RESE，与复位线连接，以连接复位信号。第三晶体管T3的控制端连接至第二节点N2以及存储电容C1的第一端，第一节点N1连接至第一电源端ELVDD，发光元件的第二端连接至第二电源端ELVSS；此处，第一电源端ELVDD和第二电源端ELVSS配置为恒压源，且第一电源端ELVDD输出的电压V1例如大于第二电源端ELVSS输出的电压V2，ELVSS输出的电压V2例如为零(例如接地)。第一晶体管T1的第二端和第七晶体管T7的第一端配置为接收初始电压Vinit，第四晶体管T4的第一端配置像素电路的数据信号接收端DAT，与数据线连接以接收数据信号(例如，数据电压Vdata)。该像素电路中以各个晶体管为P型晶体管为例进行说明，但是本公开实施例不限于这种情形，例如像素电路中至少一个晶体管可以为N型晶体管。当P型晶体管的栅极接收低于阈值电压的低电平信号时，该P型晶体管导通，而当接收高于阈值电压的高电平信号时，该P型晶体管截止。
图1B示出了图1A所示的像素电路的驱动时序图。如图1B所示，像素电路的每个驱动周期包括复位阶段Tre、补偿阶段Tc以及发光阶段Tem。
在复位阶段Tre，像素电路的复位控制端RESE接收低电平信号，由此第一晶体管T1和第七晶体管T7导通，由此初始电压Vinit分别经第一晶体管T1和第七晶体管T7导通被施加至发光元件的阳极以及第二节点N2，由此发光元件的阳极和第二节点N2的电压被设置为初始电压Vinit并因此被复位，该初始电压Vinit可使得第三晶体管T3(驱动晶体管)处于导通状态。此时第一节点N1的电压为V1。
在补偿阶段Tc，像素电路的选通控制端GAT接收低电平信号，由此第二晶体管T2和第四晶体管T4导通，因此使得数据电压Vdata被施加至第三晶体管T3的源极，且使得第三晶体管T3的漏极和栅极电连接。由于第三晶体管T3处于导通状态，因此可通过第三晶体管T3的漏极和栅极进行存储电容C1进行充电，随着第三晶体管T3的栅极的电压升高，充电过程结束。此时，第三晶体管T3的源极(第一端)的电压Vt1为Vdata，漏极(第二端)以及栅极(控制端)的电压Vt2变化至Vdata+Vth，也即第二节点N2的电压也为Vdata+Vth，并存储在存储电容C1第一端(也即，与第二节点N2相连的一端)，此处，Vth为第三晶体管T3的阈值电压，此时第一节点N1的电压仍为V1。
在发光阶段Tem，发光控制端EM接收低电平信号，由此第五晶体管T5和第六晶体管T6导通，进而第三晶体管T3的第一端经由导通的第五晶体管T5连接至第一电源端ELVDD，并且第三晶体管T3的第一端的电压Vt1改变为V1；此时，在存储电容C1的作用下，第三晶体管T3的控制端的电压Vtg即第二节点N2的电压仍为Vdata+Vth。由于第三晶体管T3处于饱和状态下输出的电流Ids可如下计算公式得到：
Ids＝1/2×K(Vgs-Vth)2
＝1/2×K(Vtg-Vt1-Vth)2
＝1/2×K(Vdata+Vth-V1-Vth)2
＝1/2×K(Vdata-V1)2。
这里，K＝W/L×C×μ，W/L为第三晶体管T3的沟道的宽长比(即，宽度与长度的比值)，μ为电子迁移率，C为单位面积的电容。
由上述公式可知，第三晶体管T3处于饱和状态下输出的电流Ids与第三晶体管T3的阈值电压无关，由此图1A所示的像素电路具有阈值补偿功能。
本公开的发明人在研究中注意到，在显示面板的刷新频率提升时(例如，从60Hz提升至120Hz)，由于栅极驱动电路输出的扫描信号以及复位信号的(脉冲)时间减小，复位阶段Tre、补偿阶段Tc以及发光阶段Tem的时间长度均减小(例如，减半)。此时，由于补偿阶段Tc的时间较短，即数据写入时间较短，从而不能对存储电容C1充分充电，导致像素电路的阈值电压补偿能力不足。下面以图1A示出的像素电路做示例性说明。如图1A所示，在补偿阶段Tc的时间较短的情况下，第三晶体管T3的控制端的电压Vt2难以充分变化至Vdata+Vth，并使得存储在存储电容C1与第二节点相连的一端的电压并非Vdata+Vth(例如小于Vdata+Vth)。这种情况下，电流Ids与第三晶体管T3的阈值电压Vth依然有一定的关系，由此导致像素电路的阈值电压补偿能力不足并降低了显示面板的补偿效果以及亮度均匀度。
本公开的实施例提供了一种显示面板及其驱动方法、显示装置，该显示面板包括：像素单元组、第一数据线、第二数据线、至少一条栅线、至少一条发光控制线和扫描电路。像素单元组包括相邻的第一像素单元和第二像素单元，第一像素单元和第二像素单元分别包括第一像素电路和第二像素电路，第一像素电路包括第一选通控制端和第一发光控制端，第二像素电路包括第二选通控制端和第二发光控制端；第一数据线与第一像素电路连接，第二数据线与第二像素电路连接；以及扫描电路包括第一扫描信号端与第二扫描信号端，第一扫描信号端通过至少一条栅线与第一选通控制端和第二选通控制端连接，第二扫描信号端通过至少一条发光控制线与第一发光控制端和第二发光控制端连接。该显示面板及其驱动方法、显示装置在显示面板刷新频率较大的情况下仍然能够保证显示面板的阈值补偿能力，由此可以提升显示面板和显示装置的补偿效果以及亮度均匀度。
下面通过几个示例对根据本公开实施例提供的显示面板进行非限制性的说明，如下面所描述的，在不相互抵触的情况下这些具体示例中不同特征可以相互组合，从而得到新的示例，这些新的示例也都属于本公开保护的范围。
图2本公开的至少一个实施例提供的一种显示面板100示意图。如图2所示，该显示面板100包括像素单元组以及用于该像素单元组的第一数据线121、第二数据线122、至少一条栅线123、至少一条发光控制线124和扫描电路130。多个像素单元组构成多行和多列的像素阵列。
如图2所示，像素单元组包括相邻的第一像素单元P1和第二像素单元P2，该第一像素单元P1和第二像素单元P2例如在第一数据线121延伸方向相邻，因此在同一列中位于不同的行。第一像素单元P1和第二像素单元P2分别包括第一像素电路111和第二像素电路112(图2中未示出，参见图3)，第一数据线121与第一像素电路111连接，用于为第一像素电路111提供数据电压信号，第二数据线122与第二像素电路112连接，用于为第二像素电路112提供数据电压信号。这里，第一像素电路111和第二像素电路112具有相同的组成，例如如图1A所示的像素电路，但是本公开的实施例对此不作额外的限制，只要其通过选通信号控制补偿时间即可。
需要说明的是，在本公开的实施例中，相邻的第一像素单元P1和第二像素单元P2是指第一像素单元P1和第二像素单元P2之间没有设置其它像素单元；对应地，第一像素电路111和第二像素电路112之间没有设置其它像素电路。
如图2所示，扫描电路130包括第一扫描信号端OUT1与第二扫描信号端OUT2；扫描电路130的第一扫描信号端OUT1通过栅线123与第一像素单元P1和第二像素单元P2相连，并向第一像素单元P1和第二像素单元P2提供相同的选通信号；扫描电路130的第二扫描信号端OUT2通过发光控制线124与第一像素单元P1和第二像素单元P2相连，并向第一像素单元P1和第二像素单元P2提供相同的发光控制信号。
如图2所示，该显示面板100还包括复用电路140，复用电路140与第一数据线121和第二数据线122连接，且配置为分时地将来自数据驱动电路(图中未示出，可参见图3)的数据信号提供给第一数据线121和第二数据线122。
由于扫描电路130的第一扫描信号端OUT1通过栅线123同时与第一像素电路111和第二像素电路112相连，并同时向第一像素电路111和第二像素电路112提供相同的选通信号，因此，可以在相同的时间段对第一像素电路111和第二像素电路112进行阈值电压补偿，由此增加了像素电路的补偿阶段的时间长度(例如，时间长度加倍)，并提升了本公开的实施例提供的显示面板100的阈值电压补偿能力，进而提升了显示面板100的补偿效果以及亮度均匀度。基于此，本公开的实施例提供的显示面板100适用于要求显示面板100刷新频率较高的应用领域(例如，虚拟显示、增强显示等显示领域)。
下面以图3示出的显示面板100为例对本公开的实施例提供的显示面板100做具体说明。
如图3所示，该显示面板100包括像素单元组以及用于该像素单元组的第一数据线121、第二数据线122、至少一条栅线123、至少一条发光控制线124和扫描电路130。像素单元组包括相邻的(在第一数据线121延伸方向上相邻)第一像素单元P1和第二像素单元P2，第一像素单元P1和第二像素单元P2分别包括第一像素电路111和第二像素电路112，第一像素电路111和第二像素电路112例如可以实现为图1A示出的7T1C型像素电路、6T1C型像素电路、5T2C型像素电路或其它具有阈值补偿功能的像素电路。
多个像素单元组构成多行和多列的像素阵列。如图3所示的示例中，每个像素单元组的第一像素单元P1和第二像素单元P2分别位于同一列但位于不同行，例如分别位于奇数行和偶数行。
如图3所示，第一像素电路111包括第一选通控制端GAT1、第一发光控制端EM1、第一复位控制端RESE1和第一数据信号接收端DAT1；第二像素电路112包括第二选通控制端GAT2、第二发光控制端EM2、第二复位控制端RESE2和第二数据信号接收端DAT2。第一数据线121与第一像素电路111的第一数据信号接收端DAT1连接，第二数据线122与第二像素电路112的第二数据信号接收端DAT2连接。
例如，第一选通控制端GAT1和第二选通控制端GAT2为两个在空间上分立的控制端，第一发光控制端EM1和第二发光控制端EM2为两个在空间上分立的控制端，第一复位控制端RESE1和第二复位控制端RESE2为两个在空间上分立的控制端。
如图3所示，扫描电路130包括第一扫描子电路131和第二扫描子电路132，第一扫描子电路131包括第一扫描信号端OUT1以用于输出扫描信号(以及复位信号)，第二扫描子电路132包括第二扫描信号端OUT2以用于输出发光控制信号。例如，扫描电路130可以通过半导体芯片实现，该半导体芯片通过绑定方式与栅线、发光控制线连接；或者，扫描电路130可以通过GOA方式，从而与像素阵列制备在同一基板(阵列基板)之上。例如，对于GOA方式，第一扫描子电路131包括第一移位寄存器单元(图中未示出)，第一移位寄存器单元配置为可级联且包括第一扫描信号端OUT1，第二扫描子电路132包括第二移位寄存器单元(图中未示出)，第二移位寄存器单元配置为可级联且包括第二扫描信号端OUT2。
第一扫描信号端OUT1通过至少一条栅线123与第一选通控制端GAT1和第二选通控制端GAT2连接，以在第一时间段t1同时向第一选通控制端GAT1和第二选通控制端GAT2提供相同的选通信号(Vgat1、Vgat2……)；第二扫描信号端OUT2通过至少一条发光控制线124与第一发光控制端EM1和第二发光控制端EM2连接，以在第二时间段t2同时向第一发光控制端EM1和第二发光控制端EM2提供相同的发光控制信号(Vem1、Vem2……)。
如图3所示，像素单元组在第一数据线121延伸方向和栅线123延伸方向上重复排布，显示面板100在第一数据线121延伸方向包括例如N个像素单元组。第一扫描子电路131在第一数据线121延伸方向上重复排布并顺次级联，第二扫描子电路132在第一数据线121延伸方向上重复排布并顺次级联。
例如，如图3所示，在一个示例中，第m级扫描电路130的第一扫描信号端OUT1除了与m行的像素单元组的第一选通控制端GAT1和第二选通控制端GAT2连接之外，还与第m+1行的像素单元组的第一复位控制端RESE1和第二复位控制端RESE2连接，并同时向第m+1行的像素单元组的第一复位控制端RESE1和第二复位控制端RESE2提供相同的复位控制信号，此处，m大于等于1且小于N。由此，第一像素电路111的第一复位控制端RESE1和第二像素电路112的第二复位控制端RESE2可以在位于第一时间段t1之前的第三时间段t3接收到复位控制信号(Vrese1、Vrese2……)，并对第一像素电路111和第二像素电路112执行复位操作。需要说明的是，像素单元组的第一复位控制端RESE1和第二复位控制端RESE2不限于与第一扫描信号端OUT1电连接，在另一个示例中，扫描电路130还可以包括第三扫描子电路(图中未示出)，且第三扫描子电路包括第三移位寄存器单元。第三移位寄存器单元配置为可级联且包括第三扫描信号端。第m级扫描电路130的第三扫描信号端与第m行的像素单元组的第一复位控制端RESE1和第二复位控制端RESE2连接。
如图3所示，该显示面板100还包括复用电路140和数据驱动电路150。数据驱动电路150包括第一数据信号输出端151，复用电路140与第一数据信号输出端151以及第一数据线121和第二数据线122连接，且配置为分时地将第一数据信号输出端151与第一数据线121和第二数据线122电连接，从而分别向第一数据线121和第二数据线122施加数据电压信号。数据驱动电路150例如可以通过半导体芯片实现，该半导体芯片通过绑定方式与相应的信号线连接。
图4是图3示出的显示面板的驱动时序图。如图4所示，第一时间段t1依次包括第一子时间段ts1和第二子时间段ts2。在位于第一子时间段ts1之前的且与第一子时间段ts1在时间上相邻的第一写入时间段tr1内，复用电路140配置为将第一数据线121连接至第一数据信号输出端151，以将第一数据信号Vdata1写入到第一数据线121，例如存储在与第一数据线121的寄生电容或另外设置的存储电容(图中未示出)中；在位于第一子时间段ts1中第二写入时间段tr2内，复用电路140配置为将第二数据线122连接至第二数据信号Vdata2输出端，以将第二数据信号Vdata2写入到第二数据线122，例如存储在与第二数据线121的寄生电容或另外设置的存储电容(图中未示出)中。例如，第一写入时间段tr1和第二写入时间段tr2均等于或均小于第一时间段t1的一半，第一子时间段ts1和第二子时间段ts2例如均等于或均小于第一时间段t1的一半，第一写入时间段tr1、第二写入时间段tr2的时间长度、第一子时间段ts1和第二子时间段ts2例如均为1H，而第一时间段t1的时间长度例如为2H。
如图4所示，在第一子时间段ts1和第二子时间段ts2内，同时向第一选通控制端GAT1和第二选通控制端GAT2提供相同的低电平信号，以使得可以在第一子时间段ts1内通过第一数据线121向第一像素电路111写入第一数据信号Vdata1，并且还可以在第一子时间段ts1内通过第二数据线122向第二像素电路112写入第二数据信号Vdata2，由此可以在相同的时间段(也即，第一子时间段ts1和第二子时间段ts2)对第一像素电路111和第二像素电路112进行阈值电压补偿。因此，本公开的实施例提供的显示面板100增加了像素电路的补偿阶段的时间长度(例如，时间长度加倍)，并提升了阈值电压补偿能力，进而提升了补偿效果以及亮度均匀度。
需要说明的是，第一写入时间段tr1和第二写入时间段tr2与第一子时间段ts1的关系不限于图4示出的关系，根据实际应用需求，第二写入时间段tr2还可以位于第一子时间段ts1之前，且与第一子时间段ts1在时间上相邻，并且第一写入时间段tr1还可以位于第二写入时间段tr2之前且与第二写入时间段tr2在时间上相邻。
复用电路140的具体结构可以根据实际应用需求进行设定，本公开的实施例对此不做具体限定。
例如，本公开的实施例提供的复用电路140可以实现为图3所示的复用电路140。如图3所示，该复用电路140包括第一选择电路141、第二选择电路142、第一复用控制线SW1、第二复用控制线SW2以及复用信号发生电路144。第一选择电路141的第一端连接到第一数据线121，第二选择电路142的第一端连接到第二数据线122，并且第一选择电路141的第二端和第二选择电路142的第二端均连接到第一数据信号输出端151。
第一选择电路141和第二选择电路142的具体结构可以根据实际应用需求进行设定，本公开的实施例对此不做具体限定。例如，本公开的实施例提供的第一选择电路141和第二选择电路142可以实现为图3所示的结构。
如图3所示，在一个示例中，第一选择电路141包括第一复用晶体管CT1，第二选择电路142包括第二复用晶体管CT2，且第一复用晶体管CT1和第二复用晶体管CT2的类型相同(例如，均为P型晶体管)。在图3所示的示例中，第一复用晶体管CT1的第一端和第二端分别配置为第一选择电路141的第一端和第二端，第二复用晶体管CT2的第一端和第二端分别配置为第二选择电路142的第一端和第二端。
如图3所示，第一复用晶体管CT1的控制端连接至第一复用控制线SW1，并且第二复用晶体管CT2的控制端连接至第二复用控制线SW2。复用信号发生电路144配置为经由第一复用控制线SW1向第一复用晶体管CT1的控制端提供第一复用控制信号，并经由第二复用控制线SW2向第二复用晶体管CT2的控制端第二复用控制信号。如图4所示，第一复用控制信号的低电平和第二复用控制信号可以具有相同的波形，但是彼此相差半个周期，因此第一复用控制信号的低电平脉冲部分和第二复用控制信号的低电平脉冲部分在时间上不重叠，由此使得第一复用晶体管CT1和第二复用晶体管CT2在不同的时间导通(分别在第一写入时间段tr1和第二写入时间段tr2导通)，进而使得复用电路140可以为分时地将第一数据信号输出端151与第一数据线121和第二数据线122电连接。又例如，第一复用控制信号和第二复用控制信号可以彼此反相。复用信号发生电路144可以通过各种适当的方式实现，例如通过对于FPGA编程实现等。
下面结合图4并以第一像素电路111和第二像素电路112实现为图1A示出的7T1C型像素电路为例对本公开的实施例提供的显示面板100驱动过程以及阈值补偿原理做示例性说明。
如图4所示，在第三时间段t3，第一像素电路111的复位控制端RESE1和第二像素电路112的复位控制端RESE2均接收低电平信号，以使得第一像素电路111的第一晶体管T1和第七晶体管T7以及第二像素电路112的第一晶体管T1和第七晶体管T7均处于导通状态，由此初始电压Vinit分别经第一晶体管T1和第七晶体管T7导通被施加至发光元件的阳极以及第二节点N2，由此发光元件的阳极和第二节点N2的电压被设置为初始电压Vinit并因此被复位，该初始电压Vinit可使得第三晶体管T3(驱动晶体管)处于导通状态。此时第一节点N1的电压为V1。
如图4所示，在第一时间段t1，第一像素电路111的选通控制端GAT1和第二像素电路112的选通控制端GAT2均接收低电平信号，以使得第一像素电路111的第二晶体管T2和第四晶体管T4以及第二像素电路112的第二晶体管T2和第四晶体管T4均处于导通状态。
如图4所示，在第一写入时间段tr1，复用信号发生电路144向第一复用晶体管CT1的控制端提供低电平信号并使得第一复用晶体管CT1导通，由此第一数据信号输出端151连接至第一数据线121，并将第一数据信号Vdata1写入到第一数据线121，由于寄生电容或另外设置的存储电容(未示出)，该数据信号Vdata1得以保存。由于在第一子时间段ts1和第二子时间段ts2，第一像素电路111的第二晶体管T2和第四晶体管T4均处于导通状态，存储在存储电容C1中的第一数据信号Vdata1在第一子时间段ts1写入到第一像素电路111的第三晶体管T3的第一端，以使得第一像素电路111的第三晶体管T3的第一端的电压Vt1为Vdata1；并且，在第一子时间段ts1和第二子时间段ts2内，第一像素电路111的第三晶体管T3的控制端的电压Vt2变化至Vdata1+Vth1，且存储在第一像素电路111的存储电容C1的与第二节点N2相连的一端上。此处，Vth1为第一像素电路111的第三晶体管T3的阈值电压。
如图4所示，在第二写入时间段tr2(也即，第一子时间段ts1)，复用信号发生电路144向第二复用晶体管CT2的控制端提供低电平信号并使得第二复用晶体管CT2导通，由此第一数据信号输出端151连接至第二数据线122，并将第二数据信号Vdata2写入到第二数据线122，由于寄生电容或另外设置的存储电容(未示出)，该数据信号Vdata2得以保存。由于在第一子时间段ts1和第二子时间段ts2，第二像素电路112的第二晶体管T2和第四晶体管T4均处于导通状态，存储在存储电容C1中的第二数据信号Vdata2在第一子时间段ts1写入到第二像素电路112的第三晶体管T3的第一端，由此使得第二像素电路112的第三晶体管T3的第一端的电压Vt1为Vdata2；第二像素电路112的第三晶体管T3的控制端的电压Vt2变化至Vdata2+Vth2，并且存储在第二像素电路112的存储电容C1的与第二节点N2相连的一端上。此处，Vth2为第二像素电路112的第三晶体管T3的阈值电压。
如图4所示，在第二时间段t2，第一像素电路111的发光控制端EM1和第二像素电路112的发光控制端EM2均接收低电平信号，以使得第一像素电路111的五晶体管T5和第六晶体管T6以及第二像素电路112的五晶体管T5和第六晶体管T6均处于导通状态。进而，第一像素电路111的第三晶体管的第一端的电压Vt1和控制端的电压Vtg分别为V1以及Vdata1+Vth1，并且第一像素电路111的第三晶体管T3处于饱和状态下输出的电流Ids1＝1/2×K(Vdata1-V1)2；第二像素电路112的第三晶体管的第一端的电压Vt1和控制端的电压Vtg分别为V1以及Vdata2+Vth2，并且第二像素电路112的第三晶体管T3处于饱和状态下输出的电流Ids2＝1/2×K(Vdata2-V1)2.。因此，第一像素电路111的第三晶体管T3处于饱和状态下输出的电流Ids1与第一像素电路111的第三晶体管T3的阈值电压Vth1无关，且第二像素电路112的第三晶体管T3处于饱和状态下输出的电流Ids2与第二像素电路112的第三晶体管T3的阈值电压Vth2无关，也即，本公开的实施例提供的显示面板100具有阈值电压补偿功能。
由于第一像素电路111的选通控制端GAT1和第二像素电路112的选通控制端GAT2均在第一时间段t1导通，并且可以在第一子时间段ts1内将第一数据信号Vdata1和第二数据信号Vdata2分别写入第一像素电路111和第二像素电路112中，因此，第一像素电路111的第三晶体管T3的控制端的电压Vt2可以在第一子时间段ts1和第二子时间段ts2内变化至Vdata1+Vth1，并且经由导通的第二晶体管T2存储在第一像素电路111的存储电容C1的与第二节点N2相连的一端上，并且第二像素电路112的第三晶体管T3的控制端的电压Vt2可以在第一子时间段ts1和第二子时间段ts2内变化至Vdata2+Vth2，并且经由导通的第二晶体管T2存储在第二像素电路112的存储电容C1的与第二节点N2相连的一端上，由此第一像素电路111和第二像素电路112的均可以在第一子时间段ts1和第二子时间段ts2内进行阈值补偿，由此本公开的实施例提供的显示面板100增加了像素电路的补偿阶段的时间长度(例如，时间长度加倍)，并提升了阈值电压补偿能力，进而提升了补偿效果以及亮度均匀度。
例如，在另一个示例中，本公开的实施例提供的复用电路140可以实现为图5示出的复用电路140。如图5所示，该复用电路140包括第一选择电路141、第二选择电路142、第一复用控制线SW1、反相器143以及复用信号发生电路144。第一选择电路141的第一端和第二选择电路142的第一端分别连接到第一数据线121和第二数据线122。第一选择电路141的第二端和第二选择电路142的第二端均连接到第一数据信号输出端151，并且第一选择电路141的控制端连接至第一复用控制线SW1，第二选择电路142的控制端经由反相器143连接至第一复用控制线SW1。
如图5所示，在一个示例中，第一选择电路141包括第一复用晶体管CT1，第二选择电路142包括第二复用晶体管CT2，且第一复用晶体管CT1和第二复用晶体管CT2的类型相同(例如，均为P型晶体管)。在图5所示的示例中，第一复用晶体管CT1的第一端和第二端分别配置为第一选择电路141的第一端和第二端，第二复用晶体管CT2的第一端和第二端分别配置为第二选择电路142的第一端和第二端。第一复用晶体管CT1的控制端连接至第一复用控制线SW1，第二复用晶体管CT2的控制端经由反相器143连接至第一复用控制线SW1。
反相器143配置为将接收到的复用控制信号反相后提供给第二复用晶体管CT2的控制端，反相器143可以为任何实现信号反相功能的电路结构。因此，第一选择电路141的控制端和第二选择电路142的控制端接收的信号彼此反相。由此第一复用晶体管CT1和第二复用晶体管CT2在不同的时间导通(分别在第一写入时间段tr1和第二写入时间段tr2导通)，进而复用电路140可以为分时地将第一数据信号输出端151与第一数据线121和第二数据线122电连接。
对于如图5所示的复用电路140，第一复用晶体管CT1和第二复用晶体管CT2的类型还可以相反(例如，分别为P型晶体管和N型晶体管)，此时，第一复用晶体管CT1的控制端和第二复用晶体管CT2的控制端可以均连接至第一复用控制线SW1(也即，无需设置反相器143)，并配置为接收相同的复用控制信号。由于第一复用晶体管CT1和第二复用晶体管CT2的类型相反，并且第一复用晶体管CT1的控制端和第二复用晶体管CT2的控制端接收相同的复用控制信号，因此第一复用晶体管CT1和第二复用晶体管CT2在不同的时间导通(分别在第一写入时间段tr1和第二写入时间段tr2导通)，进而复用电路140可以为分时地将第一数据信号输出端151与第一数据线121和第二数据线122电连接。
有以下几点需要说明。
(1)为清楚起见，图3和图5示出的显示面板100仅示例性地示出了两行两列的像素单元组，显示面板100所包含的像素单元组的个数可以根据实际应用需求进行设定。
(2)图3和图5均以一行像素单元组设置一根栅线123和一根发光控制线124为例对本公开提供的显示面板100做示例性说明，但本公开的显示面板100不限于此。根据实际应用需求，本公开提供的显示面板100一行像素单元组还可以设置两根栅线123和两根发光控制线124。此时，一根栅线123和一根发光控制线124与第一像素电路111电连接，另一根栅线123和另一根发光控制线124与第二像素电路112电连接，具体设置方式可以参见图2，在此不再赘述。
(3)图3和图5均以单边驱动(也即，栅线123的一端设置第一扫描子电路131)为例对本公开提供的显示面板100做示例性说明，但本公开的显示面板100不限于单边驱动。根据实际应用需求，本公开提供的显示面板100还可以采用双边驱动(参见图2)；此时，栅线123的两端各设置一个第一扫描子电路131，发光控制线124的两端各设置一个第二扫描子电路132。
(4)图2、图3和图5均以像素单元组包括两个相邻的像素单元(也即，第一像素单元和第二像素单元)为例对本公开提供的显示面板100做示例性说明，但本公开的显示面板100不限于此。根据实际应用需求，本公开提供的像素单元组还可以包括在第一数据线延伸方向相邻的三个或者更多个像素单元(例如，第一像素单元、第二像素单元以及第三像素单元)。
(5)本公开的实施例以第一像素电路和第二像素电路包括的晶体管均为P型晶体管为例对本公开的显示面板的驱动时序进行示例性说明，但本公开的实施例不限于此。在第一像素电路和第二像素电路的至少部分晶体管采用N型晶体管的情况下，可以对图4和图6示出的驱动时序做适应性调整，在此不再赘述。
(6)图3和图5中示出的第一选通控制端GAT1、第一发光控制端EM1、第一复位控制端RESE1和第一数据信号接收端DAT1之间的位置关系以及第二像素电路112包括第二选通控制端GAT2、第二发光控制端EM2、第二复位控制端RESE2和第二数据信号接收端DAT2之间的位置关系仅为示例，根据实际应用需求，本公开的实施例还可以采用其它设置方式。
例如，图7是本公开的至少一个实施例提供的显示装置10的示意图。该显示装置10包括本公开任一实施例所述的显示面板100。需要说明的是，对于该显示面板100和显示装置10的其它必不可少的组成部分(例如薄膜晶体管控制装置、时钟电路等)可以采用适用的常规部件，这些均是本领域的普通技术人员所应该理解的，在此不做赘述，也不应作为对本发明的限制。该显示装置可以在刷新频率较大的情况下依然能够保证阈值补偿能力，由此可以提升补偿效果以及亮度均匀度。
本公开的至少一个实施例还提供了一种显示面板的驱动方法，如图8所示，该显示面板的驱动方法包括以下的步骤。
步骤S10：使用扫描电路的第一扫描信号端在第一时间段内同时向第一选通控制端和第二选通控制端提供的选通信号。
此处，例如，第一时间段依次包括第一子时间段和第二子时间段。
步骤S20：在第一子时间段内，通过第一数据线向第一像素电路写入第一数据信号，并通过第二数据线向第二像素电路写入第二数据信号。
该显示面板的驱动方法还包括以下的步骤S30和步骤S40。
步骤S30：在第一写入时间段内，将第一数据信号写入到第一数据线，以在第一子时间段内向第一像素电路写入第一数据信号.
步骤S40：在第二写入时间段内，将第二数据信号写入到第二数据线，以在第一子时间段内向第二像素电路写入第二数据信号。
例如，在一个示例中，第一写入时间段位于第一子时间段之前，且与第一子时间段在时间上相邻；以及第二写入时间段位于第一子时间段中。又例如，在另一个示例中，第二写入时间段位于第一子时间段之前，且与第一子时间段在时间上相邻；以及第一写入时间段位于第二写入时间段之前且与第二写入时间段在时间上相邻。
该显示面板的驱动方法还可以包括以下的步骤S50。
步骤S50：使用扫描电路的第二扫描信号端在第二时间段同时向第一发光控制端和第二发光控制端提供相同的发光控制信号。
例如，第一写入时间段和第二写入时间段均等于第一时间段的一半，且第一子时间段和第二子时间段均等于第一时间段的一半。
该显示面板的驱动方法还包括以下的步骤S301和步骤S401。
步骤S301：在第一写入时间段内，将第一数据线连接至第一数据信号输出端，以将第一数据信号写入到第一数据线。
步骤S401：在第二写入时间段内，将第二数据线连接至第二数据信号输出端，以将第二数据信号写入到第二数据线。
本公开的实施例提供了一种显示面板及其驱动方法、显示装置。该显示面板及其驱动方法、显示装置可以在显示面板刷新频率较大的情况下保证显示面板的阈值补偿能力，由此可以提升显示面板和显示装置的补偿效果以及亮度均匀度，
虽然上文中已经用一般性说明及具体实施方式，对本公开作了详尽的描述，但在本公开实施例基础上，可以对之作一些修改或改进，这对本领域技术人员而言是显而易见的。因此，在不偏离本公开精神的基础上所做的这些修改或改进，均属于本公开要求保护的范围。
以上所述仅是本发明的示范性实施方式，而非用于限制本发明的保护范围，本发明的保护范围由所附的权利要求确定。

Claims (14)

1.一种显示面板的驱动方法，所述显示面板包括像素单元组、第一数据线、第二数据线、至少一条栅线、至少一条发光控制线和扫描电路，
所述驱动方法包括：
使用所述扫描电路的第一扫描信号端在第一时间段内同时向所述像素单元组的第一像素单元的第一像素电路的第一选通控制端和所述像素单元组的第二像素单元的第二像素电路的第二选通控制端提供选通信号，其中，所述第一时间段依次包括第一子时间段和位于所述第一子时间段之后的第二子时间段；
在所述第一子时间段内，通过所述第一数据线向所述第一像素电路写入第一数据信号，并通过所述第二数据线向所述第二像素电路写入第二数据信号；
在位于所述第一子时间段之前的第一写入时间段内，将所述第一数据信号写入到所述第一数据线，以在所述第一子时间段内向所述第一像素电路写入所述第一数据信号；以及
在第二写入时间段内，将所述第二数据信号写入到所述第二数据线，以在所述第一子时间段内向所述第二像素电路写入所述第二数据信号，
其中，所述第一像素单元和所述第二像素单元彼此相邻，所述第一像素电路包括所述第一选通控制端和第一发光控制端，所述第二像素电路包括所述第二选通控制端和第二发光控制端；
所述第一数据线与所述第一像素电路连接，所述第二数据线与所述第二像素电路连接；以及
所述扫描电路包括所述第一扫描信号端与第二扫描信号端，所述第一扫描信号端通过所述至少一条栅线与所述第一选通控制端和所述第二选通控制端连接，所述第二扫描信号端通过所述至少一条发光控制线与所述第一发光控制端和所述第二发光控制端连接。
2.根据权利要求1所述的显示面板的驱动方法，还包括复用电路和数据驱动电路，其中，所述数据驱动电路包括第一数据信号输出端，所述复用电路与所述第一数据信号输出端以及所述第一数据线和所述第二数据线连接，且配置为分时地将所述第一数据信号输出端与所述第一数据线和所述第二数据线电连接。
3.根据权利要求2所述的显示面板的驱动方法，其中，所述复用电路包括第一选择电路和第二选择电路，
所述第一选择电路的第一端连接到所述第一数据线，所述第二选择电路的第一端连接到所述第二数据线，以及所述第一选择电路的第二端和所述第二选择电路的第二端均连接到所述第一数据信号输出端。
4.根据权利要求3所述的显示面板的驱动方法，其中，所述第一选择电路包括第一复用晶体管，所述第二选择电路包括第二复用晶体管；
所述第一复用晶体管的第一端和第二端分别配置为所述第一选择电路的第一端和第二端，所述第二复用晶体管的第一端和第二端分别配置为所述第二选择电路的第一端和第二端。
5.根据权利要求4所述的显示面板的驱动方法，其中，所述第一复用晶体管的控制端和所述第二复用晶体管的控制端配置为接收相同的复用控制信号。
6.根据权利要求5所述的显示面板的驱动方法，其中，所述第一复用晶体管和所述第二复用晶体管的类型相反。
7.根据权利要求5所述的显示面板的驱动方法，其中，所述复用电路还包括反相器，
所述反相器的一端与所述第二复用晶体管的控制端电连接，所述反相器的另一端配置为接收所述复用控制信号，所述第一复用晶体管和所述第二复用晶体管的类型相同。
8.根据权利要求4所述的显示面板的驱动方法，其中，所述第一复用晶体管的控制端和所述第二复用晶体管的控制端配置为分别接收彼此反相的复用控制信号，
所述第一复用晶体管和所述第二复用晶体管的类型相同。
9.根据权利要求5-8任一所述的显示面板的驱动方法，其中，所述复用电路还包括复用信号发生电路，
所述复用信号发生电路配置为向所述第一复用晶体管和所述第二复用晶体管的控制端提供相同的或反相的复用控制信号。
10.根据权利要求1-8任一所述的显示面板的驱动方法，其中，所述扫描电路包括第一扫描子电路和第二扫描子电路，
所述第一扫描子电路包括所述第一扫描信号端，所述第二扫描子电路包括所述第二扫描信号端。
11.根据权利要求10所述的显示面板的驱动方法，其中，所述第一扫描子电路包括第一移位寄存器单元，所述第一移位寄存器单元配置为可级联且包括所述第一扫描信号端，
所述第二扫描子电路包括第二移位寄存器单元，所述第二移位寄存器单元配置为可级联且包括所述第二扫描信号端。
12.根据权利要求1所述的显示面板的驱动方法，其中，
所述第一写入时间段与所述第一子时间段在时间上相邻，以及所述第二写入时间段位于所述第一子时间段中；或者
所述第二写入时间段位于所述第一子时间段之前，且与所述第一子时间段在时间上相邻，以及所述第一写入时间段位于所述第二写入时间段之前且与所述第二写入时间段在时间上相邻。
13.根据权利要求1或12所述的显示面板的驱动方法，还包括：使用所述扫描电路的第二扫描信号端在第二时间段同时向所述第一发光控制端和所述第二发光控制端提供相同的发光控制信号。
14.根据权利要求1或12所述的显示面板的驱动方法，其中，所述显示面板还包括复用电路和数据驱动电路，所述数据驱动电路包括第一数据信号输出端，所述显示面板的驱动方法还包括：
在所述第一写入时间段内，将所述第一数据线连接至所述第一数据信号输出端，以将所述第一数据信号写入到所述第一数据线；以及
在所述第二写入时间段内，将所述第二数据线连接至所述第二数据信号输出端，以将所述第二数据信号写入到所述第二数据线。
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