CN109961732A - 显示设备 - Google Patents

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Abstract

一种显示设备，能够使从时序控制器发送到电平移位器IC的信号的转换最小化。该显示设备包括：栅极驱动器，被配置为驱动面板的栅极线；数据驱动器，被配置为驱动面板的数据线；时序控制器，被配置为控制栅极驱动器和数据驱动器的操作；以及电平移位器IC，被配置为接收来自时序控制器的多个控制信号，并产生和输出多个栅极控制信号以控制栅极驱动器的驱动，其中电平移位器IC根据时序控制器的控制、通过逻辑处理从时序控制器接收或在电平移位器IC中缓冲的导通时钟和关断时钟来产生多个扫描时钟，并将多个扫描时钟输出到栅极驱动器。

Description

显示设备
相关申请的交叉引用
本申请要求于2017年12月22日提交的韩国专利申请No.10-2017-0177832的权益，该申请通过引用的方式结合于此，如同在此完全阐述一样。
技术领域
本公开涉及一种能够使从时序控制器发送到电平移位器集成电路的信号的转换最小化的显示设备。
背景技术
用于显示图像的显示设备通常包括使用液晶的液晶显示器(LCD)、使用OLED的有机发光二极管(OLED)显示器、以及使用电泳粒子的电泳显示器(EPD)。
显示设备包括用于通过像素阵列显示图像的面板、用于驱动面板的栅极驱动器和数据驱动器、以及时序控制器。
栅极驱动器可以包括多个栅极集成电路(IC)并且连接到面板。可替换地，栅极驱动器可以与面板的薄膜晶体管(TFT)阵列一起形成在基板上，使得栅极驱动器可以作为面板内栅极(GIP)类型安装到面板中。
嵌入到面板中的GIP型栅极驱动器从由时序控制器控制的电平移位器集成电路(IC)接收多个栅极控制信号。
例如，电平移位器IC通过逻辑处理从时序控制器接收并以预定时段摆动的导通时钟和关断时钟来产生多个不同的扫描时钟，将扫描时钟电平移位，以及将电平移位的扫描时钟提供给栅极驱动器。
然而，由于通过连续重复的信号转换来发送导通时钟和关断时钟，所以功耗增加并且电磁干扰(EMI)增加。因此，有必要减少信号转换。
具体地，应用于OLED显示设备的电平移位器IC需要将用于产生扫描脉冲的扫描时钟和用于产生感测脉冲的感测时钟提供到栅极驱动器，并进一步将用作栅极驱动器的进位信号的进位时钟提供到栅极驱动器。为此，电平移位器IC需要接收三对导通时钟和关断时钟，以便从时序控制器产生扫描时钟、进位时钟和感测时钟。
这样，由于连续重复信号转换的三对导通时钟和关断时钟从时序控制器发送到电平移位器IC，所以功耗增加并且EMI也增加。
发明内容
因此，本公开涉及一种显示设备，其基本上消除了由于背景技术的限制和缺点而导致的一个或多个问题。
在各种实施例中，本公开提供了一种能够使从时序控制器发送到电平移位器IC的信号的转换最小化的显示设备。
本公开的其他优点、目的和特征将部分地在下面的说明中阐述，并且部分地对于本领域普通技术人员在研究以下内容时将变得显而易见，或者可以从本公开的实践中获知。本公开的目的和其他优点可以通过书面说明书及其权利要求以及附图中特别指出的结构来实现和获得。
为了实现这些目的和其他优点并且根据本公开的目的，如本文所体现和广泛描述的，显示设备包括：栅极驱动器，被配置为驱动面板的栅极线；数据驱动器，被配置为驱动面板的数据线；时序控制器，被配置为控制栅极驱动器和数据驱动器的操作；以及电平移位器集成电路(IC)，被配置为从时序控制器接收多个控制信号并产生和输出用于控制栅极驱动器的驱动的多个栅极控制信号，其中电平移位器IC根据时序控制器的控制、通过逻辑处理从时序控制器接收或者在电平移位器IC中缓冲的导通时钟和关断时钟来产生多个扫描时钟，并将多个扫描时钟输出到栅极驱动器。
电平移位器IC可以从时序控制器接收先前数据重写控制信号，或通过从时序控制器接收的多个控制信号的逻辑组合产生先前数据重写控制信号。当先前数据重写控制信号被禁用时，电平移位器IC可以使用从时序控制器接收的导通时钟和关断时钟产生多个扫描时钟。电平移位器IC在先前数据重写控制信号被启用时，可以使用在电平移位器IC中缓冲的导通时钟和关断时钟来产生多个扫描时钟。时序控制器在先前数据重写控制信号被启用时，可以停止发送导通时钟和关断时钟。
电平移位器IC可以包括扫描时钟产生器。扫描时钟产生器可以包括第一多路复用器(MUX)，被配置为根据先前数据重写控制信号的控制来选择性地输出从时序控制器接收的当前水平时段的导通时钟和由第一缓冲器缓冲的先前水平时段的导通时钟中的任一个；第二MUX，被配置为根据先前数据重写控制信号的控制来选择性地输出从时序控制器接收的当前水平时段的关断时钟和由第二缓冲器缓冲的先前水平时段的关断时钟中的任一个；逻辑处理器，被配置为通过逻辑处理分别由第一MUX和第二MUX输出的导通时钟和关断时钟来产生多个扫描时钟；以及电平移位器，被配置为对多个扫描时钟进行电平移位并将电平移位的扫描时钟输出到栅极驱动器。第一缓冲器可以缓冲并输出在每个水平时段期间从第一MUX反馈的导通时钟，并且第二缓冲器可以缓冲并输出在每个水平时段期间从第二MUX反馈的关断时钟。
电平移位器IC还可包括第一逻辑门，其被配置为逻辑地组合从时序控制器接收的栅极起始脉冲、导通时钟和关断时钟，并且当栅极起始脉冲、导通时钟和关断时钟的所有均为逻辑高时启用先前数据重写控制信号；以及第二逻辑门，其被配置为逻辑组合栅极起始脉冲、导通时钟和关断时钟，并在仅栅极起始脉冲为逻辑高时输出起始脉冲。
时序控制器可以包括：发送器，被配置为通过将关于多个栅极控制信号的时序配置信息串行化来将串行时序信息发送到电平移位器IC，并且在每个水平时段期间先前数据重写控制信号被嵌入到串行时序信息中。电平移位器IC还可以包括接收器，该接收器被配置为使用从时序控制器接收的串行时序信息来产生下一个水平时段的导通时钟和关断时钟，并且将下一个水平时段的导通时钟和关断时钟输出到扫描时钟产生器。
时序控制器在先前数据重写控制信号处于关断状态时，可以将关于导通时钟和关断时钟的时序配置信息发送到电平移位器IC，并且在先前数据重写控制信号处于导通状态时停止发送关于导通时钟和关断时钟的时序配置信息。
在发送导通时钟和关断时钟时，时序控制器还可以发送第二导通时钟、第二关断时钟、第三导通时钟和第三关断时钟。电平移位器IC还可包括感测时钟产生器以及进位时钟产生器，该感测时钟产生器被配置为根据时序控制器的控制、使用从时序控制器接收的第二导通时钟和第二关断时钟或使用在电平移位器IC中缓冲的第二导通时钟和第二关断时钟来产生多个感测时钟，并将多个感测时钟输出到栅极驱动器，该进位时钟产生器被配置为根据时序控制器的控制、使用从时序控制器接收的第三导通时钟和第三关断时钟或使用在电平移位器IC中缓冲的第三导通时钟和第三关断时钟来产生多个进位时钟，并将多个进位时钟输出到栅极驱动器。感测时钟产生器和进位时钟产生器中的每一个可以包括与扫描时钟产生器相同的元件。
应理解，本公开的前述总体性描述和以下详细描述都是示例性和解释性的，并且旨在提供对要求保护的本公开的进一步说明。
附图说明
被包括以提供对本公开的进一步理解并且被并入本申请并构成其一部分的附图示出了本公开的实施例，并且与描述一起用于解释本公开的原理。在附图中：
图1是示意性地示出根据本公开的实施例的显示设备的结构的框图；
图2是根据本公开第一实施例的时序控制器和电平移位器IC的框图；
图3是根据本公开第一实施例的电平移位器IC的输入和输出信号的时序图；
图4是根据本公开第二实施例的时序控制器和电平移位器IC的框图；
图5是根据本公开第二实施例的电平移位器IC的输入和输出信号的时序图；
图6是示出根据本公开实施例的电平移位器IC的扫描时钟产生方法的流程图；
图7是根据本公开第三实施例的时序控制器和电平移位器IC的框图；
图8是根据本公开第三实施例的电平移位器IC的输入和输出信号的时序图；以及
图9是示出根据本公开的实施例的显示设备的系统构造的框图。
具体实施方式
现在将详细参考本公开的示例性实施例，其示例在附图中示出。只要有可能，在整个附图中将使用相同的附图标记来表示相同或相似的部分。
图1是示意性地示出根据本公开的实施例的显示设备的结构的框图。
参考图1，显示设备包括面板100、GIP型栅极驱动器200、数据驱动器300、时序控制器400、电平移位器IC500、伽马电压产生器600和电源管理电路700。时序控制器400、伽马电压产生器600和电源管理电路700各自可以包括单独的IC。数据驱动器300可以包括多个数据驱动IC。
电源管理电路700使用外部接收的输入电压，产生并输出显示设备的所有电路结构的操作(即，面板100、栅极驱动器200、数据驱动器300、时序控制器400、电平移位器IC500和伽马电压产生器600的操作)所需的各种驱动电压。例如，电源管理电路700使用输入电压产生并输出提供给时序控制器400、数据驱动器300和电平移位器IC500的数字块驱动电压、提供给数据驱动器300的模拟块驱动电压、提供给栅极驱动器200和电平移位器IC500的栅极导通电压和栅极关断电压、以及驱动面板100所需的驱动电压。
面板100通过像素阵列PA显示图像，该像素阵列PA包括以矩阵形式排列的子像素。基本像素可以包括至少三个子像素，其能够通过白色(W)、红色(R)、绿色(G)和蓝色(B)子像素之间的颜色混合来表示白色。例如，基本像素可以包括R/G/B子像素或W/R/G/B子像素。基本像素可包括R/G/B子像素、W/R/G子像素、B/W/R子像素或G/B/W子像素。
面板100可以是各种显示面板(例如LCD面板和OLED面板)中的一种。面板可以是具有触摸感测功能的触摸显示面板。
栅极驱动器200与构成面板100的像素阵列PA的TFT阵列一起形成在基板上，并且作为GIP类型嵌入到面板100的两侧部分或一侧部分的非显示区域中。布置在面板100的两侧部分的一对栅极驱动器200同时驱动两端的相应栅极线。栅极驱动器200从电平移位器IC500接收多个栅极控制信号并执行移位操作，从而单独驱动面板100的栅极线。栅极驱动器200在每条栅极线的驱动时段期间将栅极导通电压(或栅极高电压(VGH))的扫描信号提供到相应的栅极线，并且在每条栅极线的非驱动时段期间，将栅极关断电压(或栅极低电压(VGL))的扫描信号提供给相应的栅极线。
数据驱动器300从时序控制器400接收多个数据控制信号和图像数据，并锁存图像数据。然后，数据驱动器300将锁存的图像数据转换为模拟数据信号，并单独地将模拟数据信号提供给面板100的数据线。数据驱动器300从伽马电压产生器600接收多个参考伽马电压并将伽马电压分段成分别对应于数据的分级值的多个分级电压。数据驱动器300使用分段的分级电压将数字数据转换为模拟数据电压，并将数据电压提供给面板100的每条数据线。
伽马电压产生器600产生包括具有不同电压电平的多个不同参考伽马电压的参考伽马电压集合，并将该参考伽马电压集合提供给数据驱动器300。伽马电压产生器600可以根据时序控制器400的控制产生与显示设备的伽马电压特性相对应的多个参考伽马电压，并将参考伽马电压提供给数据驱动器300。伽马电压产生器600可以包括可编程伽马IC。伽马电压产生器600从时序控制器400接收伽马数据，根据伽马数据产生或调整参考伽马电压，并将参考伽马电压输出到数据驱动器300。
时序控制器400从外部主机系统接收图像数据和时序控制信号。主机系统可以是计算机、电视系统、机顶盒和便携式终端系统(例如平板电脑或蜂窝电话)中的任一种。时序控制信号包括点时钟、数据启用信号、垂直同步信号和水平同步信号。
时序控制器400关于图像数据执行各种图像处理，例如用于降低功耗的亮度校正或图像质量校正，并将图像处理的数据提供给数据驱动器300。
时序控制器400使用存储在其中的时序控制信号和时序配置(例如，起始时序和脉冲宽度)信息来产生用于控制数据驱动器300的操作的多个数据控制信号，并将数据控制信号提供给数据驱动器300。时序控制器400产生用于控制电平移位器IC500的操作的多个控制信号，并将控制信号提供给电平移位器IC500。
具体地，时序控制器400产生用于确定由电平移位器IC500产生的每个GIP时钟的上升时序的导通时钟和用于确定每个GIP时钟的下降时序的关断时钟，并将导通时钟和关断时钟提供到电平移位器IC500。这里，时序控制器400可以仅在部分水平时段期间提供导通时钟和关断时钟，并且控制电平移位器IC500以在其他时段期间重写先前时段的导通时钟和关断时钟。当电平移位器IC 500重写先前时段的导通时钟和关断时钟时，时序控制器400停止发送导通时钟和关断时钟，使得与重复提供导通时钟和关断时钟的相关技术相比，可以最小化发送信号的转换。
电平移位器IC500在时序控制器400的控制下产生多个栅极控制信号并将其电平移位，并将电平移位的栅极控制信号提供给栅极驱动器200。
例如，电平移位器IC500对从时序控制器400接收的起始脉冲和复位脉冲进行电平移位，并将电平移位的起始脉冲和复位脉冲提供给栅极驱动器200。电平移位器IC500通过逻辑处理从时序控制器400接收或在其中缓冲的导通时钟和关断时钟来产生并电平移位多个GIP时钟，并将电平移位的GIP时钟提供给栅极驱动器200。
具体地，电平移位器IC500将从时序控制器400接收的导通时钟和关断时钟存储在缓冲器中，以使用导通时钟和关断时钟用于逻辑处理。在根据时序控制器400的控制将先前数据重写(以下称为PDRW)模式启用时，电平移位器IC 500可以通过逻辑处理存储在缓冲器中的先前水平时段的导通时钟和关断时钟来产生GIP时钟。
可以通过从时序控制器400接收PDRW控制信号或者通过从时序控制器400接收的控制信号的逻辑组合来启用或禁用电平移位器IC500的PDRW模式。这将在后面详细描述。
同时，当面板100是OLED面板时，数据驱动器300还可以包括感测单元，该感测单元用于根据时序控制器400的控制使用电流或电压感测指示每个子像素的电特性(例如，驱动TFT的阈值电压和迁移率、以及OLED元件的阈值电压)的像素电流，将像素电流转换为数字感测数据，并将数字感测数据提供给时序控制器400。
时序控制器400使用从数据驱动器300接收的每个子像素的感测数据来更新每个子像素的补偿值。时序控制器400将对应的补偿值应用于与每个子像素相对应的图像数据，以补偿由子像素之间的特征差异引起的亮度非均匀性。
栅极驱动器200可以使用从电平移位器IC500接收的扫描时钟向栅极线提供扫描信号以用于扫描操作，并且使用从电平移位器IC500接收的感测时钟向栅极线提供感测信号以用于感测操作。栅极驱动器可以使用从电平移位器IC500接收的进位时钟来执行移位操作。
电平移位器IC 500可以分别使用从时序控制器400接收或在其中缓冲的第一导通和关断时钟、第二导通和关断时钟以及第三导通和关断时钟来产生多个扫描时钟、感测时钟和进位时钟。电平移位器IC500可以将所产生的时钟输出到栅极驱动器200。
当根据时序控制器400的控制启用PDRW模式，使得电平移位器IC500使用其中缓冲的上述三对导通时钟和关断时钟时，时序控制器400可以停止发送三对导通时钟和关断时钟，从而最小化发送信号的转换。
图2是根据本公开第一实施例的时序控制器和电平移位器IC的框图。
图3是图2中所示的电平移位器IC的输入和输出信号的时序图。
参考图2，电平移位器IC500-1可以包括电平移位器502和扫描时钟产生器520。
参考图2和图3，电平移位器502对从时序控制器400-1接收的第一起始脉冲GST进行电平移位，并将具有栅极导通电压VGH和栅极关断电压VGL的第二起始脉冲VST输出到栅极驱动器200。
扫描时钟产生器520根据从时序控制器400-1接收的PDRW控制信号，使用从时序控制器400-1接收或在其中缓冲的导通时钟ON_CLK和关断时钟OFF_CLK来产生并电平移位多个扫描时钟SCCLK1至SCCLKn，并将电平移位的扫描时钟输出到栅极驱动器200。
扫描时钟产生器520包括第一多路复用器(以下称为MUX1)508、第一缓冲器504、第二多路复用器(以下称为MUX2)510、第二缓冲器506、逻辑处理器512和电平移位器单元514。
在PDRW控制信号的禁用时段期间，时序控制器400-1产生具有一个水平(1H)时段的导通时钟ON_CLK和关断时钟OFF_CLK，并将导通时钟ON_CLK和关断时钟OFF_CLK发送到电平移位器IC 500-1。时序控制器400-1在PDRW控制信号的启用时段期间停止发送导通时钟ON_CLK和关断时钟OFF_CLK，从而最小化信号转换。
当从时序控制器400-1接收的PDRW控制信号处于禁用状态时，MUX1508和MUX2 510分别选择1H时段的导通时钟ON_CLK和1H时段的关断时钟OFF_CLK，并将所选择的时钟提供给逻辑处理器512。第一缓冲器504和第二缓冲器506以数据形式存储在每个水平时段期间分别从MUX1 508和MUX2 510反馈的导通时钟和关断时钟。
当从时序控制器400-1接收的PDRW控制信号处于启用状态时，MUX1508和MUX2 510选择分别存储在第一缓冲器504和第二缓冲器506中的先前水平时段的导通时钟ON_CLK和关断时钟OFF_CLK，并将所选择的时钟输出到逻辑处理器512。在这种情况下，第一缓冲器504和第二缓冲器506在每个水平时段期间以数据的形式存储分别从MUX1 508和MUX2 510反馈的导通时钟和关断时钟，并更新导通时钟和关断时钟。因此，在PDRW控制信号的启用时段期间，MUX1 508和MUX2 510可以在每个水平时段期间重复输出分别存储在第一缓冲器504和第二缓冲器506中的导通时钟和关断时钟。第一缓冲器504可以在每个水平时段期间将导通时钟的上升沿信息存储为数据，并且第二缓冲器506可以将关断时钟的下降沿信息存储为数据。
逻辑处理器512通过逻辑处理分别从MUX1 508和MUX2 510接收的导通时钟ON_CLK和关断时钟OFF_CLK来输出多个扫描时钟SCCLK1至SCCLKn。电平移位器单元514对多个扫描时钟SCCLK1至SCCLKn进行电平移位，并将电平移位的扫描时钟输出至栅极驱动器200。逻辑处理器512可以通过逻辑处理从MUX1 508接收的导通时钟ON_CLK的上升沿信息和从MUX2510接收的关断时钟OFF_CLK的下降沿信息来产生扫描时钟SCCLK1至SCCLKn。在这种情况下，逻辑处理器512可以通过进一步应用在内部存储器中预设的上升沿延迟值和下降沿延迟值来执行逻辑处理。
参考图3，从栅极低电压VGL上升到栅极高电压VGH的多个扫描时钟SCCLK1至SCCLKn中的每一个的上升时间由多个导通时钟ON_CLK中的每一个的上升沿来确定。从栅极高电压VGH下降到栅极低电压VLH的多个扫描时钟SCCLK1至SCCLKn中的每一个的下降时间由与导通时钟ON_CLK具有相位差的多个关断时钟OFF_CLK中的每一个的下降沿来确定。每个扫描时钟SCCLK1至SCCLKn的高时段与相邻扫描时钟的高时段部分重叠。
同时，应用于OLED显示设备的电平移位器IC500-1还可以包括扫描时钟产生器530和进位时钟产生器540，该扫描时钟产生器530和进位时钟产生器540具有与如图2所示的扫描时钟产生器520相同的结构。
感测时钟产生器530根据从时序控制器400-1接收的PDRW控制信号，使用从时序控制器400-1接收或在其中缓冲的第二导通时钟ON_CLK2和第二关断时钟OFF_CLK2产生多个感测时钟SECLK1至SECLKn，将感测时钟SECLK1至SECLKn电平移位，并将电平移位的感测时钟SECLK1到SECLKn输出到栅极驱动器200。
进位时钟产生器540根据从时序控制器400-1接收的PDRW控制信号，使用从时序控制器400-1接收或在其中缓冲的第三导通时钟ON_CLK3和第三关断时钟OFF_CLK3产生多个进位时钟CRCLK1至CRCLKn，将进位时钟CRCLK1至CRCLKn电平移位，并将电平移位的进位时钟CRCLK1至CRCLKn输出到栅极驱动器200。
感测时钟产生器530和进位时钟产生器540中的每一个包括MUX1508、第一缓冲器504、MUX2 510、第二缓冲器506、逻辑处理器512和电平移位器单元514，它们被构造成与扫描时钟产生器520中的相同，并且其详细操作描述如上所述。
第一至第三导通时钟ON_CLK、ON_CLK2和ON_CLK3可以具有相同或不同的上升时间。第一至第三关断时钟OFF_CLK、OFF_CLK2和OFF_CLK3可以具有相同或不同的下降时间。扫描时钟SCCLK1至SCCLKn、感测时钟SECLK1至SECLKn以及进位时钟CRCLK1至CRCLKn可以具有相同或不同的脉冲类型。
图4是根据本公开第二实施例的时序控制器和电平移位器IC的框图。
图5是图4中所示的电平移位器IC的输入和输出信号的时序图。图6是示出根据本公开的实施例的电平移位器IC的扫描时钟产生方法的流程图。
图4中示出的根据本公开的第二实施例的电平移位器IC 500-2与图2中所示出的根据本公开的第一实施例的电平移位器IC 500-1的不同之处在于：PDRW控制信号通过从时序控制器400-2接收的多个控制信号的逻辑组合而在内部产生。将省略重复元件的描述。
参考图4，时序控制器400-2不将PDRW控制信号提供给电平移位器IC500-2。相反，时序控制器400-2修改多个控制信号GST、ON_CLK和OFF_CLK的逻辑，使得控制信号的特定逻辑组合可以指示PDRW控制信号的启用时段和禁用时段。
电平移位器IC 500-2还包括第一逻辑(与)门522以及第二逻辑门524，第一逻辑(与)门522用于通过逻辑组合从时序控制器400-2接收的第一起始脉冲GST、导通时钟ON_CLK和关断时钟OFF_CLK来产生PDRW控制信号，第二逻辑门524用于通过逻辑组合第一起始脉冲GST、导通时钟ON_CLK和关断时钟OFF_CLK来产生第二起始脉冲VST。
参考图4和5，第一逻辑门522在第一起始脉冲GST、导通时钟ON_CLK和关断时钟OFF_CLK中的所有均是高电平时，启用PDRW控制信号，并且在其他情况下禁用PDRW控制信号。
参考图4和5，第二逻辑门524在仅第一起始脉冲GST是高电平并且导通时钟ON_CLK和关断时钟OFF_CLK是低电平时，产生第二起始脉冲VST。电平移位器501将第二起始脉冲VST电平移位，并将电平移位的第二起始脉冲VST输出到栅极驱动器200。
参考图4和6，第一逻辑(与)门522从时序控制器400-2接收第一起始脉冲GST、导通时钟ON_CLK和关断时钟OFF_CLK。当第一起始脉冲GST、导通时钟ON_CLK和关断时钟OFF_CLK中的至少一个是低电平时，第一逻辑(与)门禁用PDRW控制信号(S604；N)。当第一起始脉冲GST、导通时钟ON_CLK和关断时钟OFF_CLK中的所有都是高电平时，第一逻辑(与)门522启用PDRW控制信号(S604；Y)。
如果PDRW控制信号被禁用(S604；N)，则MUX1 508和MUX2 510选择并输出从时序控制器400-2接收的当前时段的导通时钟ON_CLK和关断时钟OFF_CLK，并将所选择的导通时钟ON_CLK和关断时钟OFF_CLK分别存储在第一缓冲器504和第二缓冲器506中(S606)。
如果启用PDRW控制信号(S604；Y)，则MUX1 508和MUX2 510分别选择从第一缓冲器504和第二缓冲器506接收的先前时段的导通时钟ON_CLK和关断时钟OFF_CLK，并且将所选择的导通时钟ON_CLK和关断时钟OFF_CLK分别存储在第一缓冲器504和第二缓冲器506中(S608)。
逻辑处理器512使用分别从MUX1 508和MUX2 510接收的导通时钟和关断时钟OFF_CLK、通过逻辑处理来产生扫描时钟SCCLK1至SCCLKn。电平移位器单元514将扫描时钟电平移位，并将电平移位的扫描时钟输出到栅极驱动器200(S610和S612)。
图7是根据本公开第三实施例的时序控制器和电平移位器IC的框图。
图8是图7中所示的根据本公开的第三实施例的电平移位器IC的输入和输出信号的时序图。
参照图7和8，时序控制器400-3和电平移位器IC500-3使用串行接口发送和接收多个控制信息。
时序控制器400-3的发送器TX将多个控制信号的上升时序信息和下降时序信息串行化，并将第一和第二串行时序信息STD1和STD2发送到电平移位器IC500-3。更详细地，时序控制器400-3以1H为单位将第一至第三导通时钟ON_CLK、ON_CLK2和ON_CLK3的上升时序信息串行化，并将第一至第三关断时钟OFF_CLK、OFF_CLK2和OFF_CLK3的下降时序信息串行化，并将第一串行时序信息STD1和第二串行时序信息STD2发送到电平移位器IC500-3。
具体地，时序控制器400-3的发送器TX将PDRW控制信号嵌入到第一和第二串行时序信息STD1和STD2中的任一个中，并将PDRW控制信号嵌入其中的第一和第二串行时序信息STD1和STD2发送到电平移位器IC 500-3中。在这种情况下，时序控制器400-3的发送器TX还在每个水平时段期间向电平移位器IC500-3发送时钟CLK和指示时序信息有效的启用时段的有效数据信号VD。时序控制器400-3在PDRW控制信号处于关断状态(即，0)时，发送关于导通时钟ON_CLK、ON_CLK2和ON_CLK3以及关断时钟OFF_CLK、OFF_CLK2和OFF_CLK3的时序信息，并且在PDRW控制信号处于导通状态(即，1)时不发送时序信息，从而最小化发送信号的转换。
电平移位器IC500-3的接收器RX与时钟CLK同步地接收从时序控制器400-3接收的第一和第二串行时序信息STD1和STD2。接收器RX使用在有效数据信号VD的启用时段期间发送的第一和第二串行时序信息STD1和STD2产生多个控制信号GST、ON_CLK至ON_CLK3和OFF_CLK至OFF_CLK3，并在下一个水平时段期间输出所产生的控制信号。例如，电平移位器IC500-3的接收器RX在第(N-1)个水平时段期间、使用在第(N-2)个水平时段期间接收的时序信息产生多个控制信号。
第一串行时序信息STD1可以包括导通时钟ON_CLK至ON_CLK3的上升时序信息。第二串行时序信息STD2可以包括关断时钟OFF_CLK至OFF_CLK3的下降时序信息。第一串行时序信息STD1还可以包括在每个水平时段期间的PDRW控制信号。
参考图8，扫描时钟SCCLK1至SCCLKn中的每一个可以包括上升栅极脉冲调制(GPM)持续时间和下降GPM持续时间，其分别在上升沿和下降沿通过中间电压(VDD)。
逻辑处理器512通过导通时钟ON_CLK的第一和第二时序信息t11和t13确定每个扫描时钟SCCLK的上升GPM持续时间，并且通过关断时钟OFF_CLK的第一和第二时序信息t12和t14确定每个扫描时钟SCCLK的下降GPM持续时间。
如果PDRW控制信号处于关断状态，即PDRW控制信号被禁用，则MUX1 508和MUX2510选择并输出从接收器RX接收的当前时段的导通时钟ON_CLK和关断时钟OFF_CLK，并且将所选择的时钟存储在第一和第二缓冲器504和506中。如果PDRW控制信号处于导通状态，即，如果启用PDRW控制信号，则MUX1 508和MUX2 510选择并输出从第一和第二缓冲器504和506接收的先前时段的导通时钟ON_CLK和关断时钟OFF_CLK，并将所选择的时钟存储在第一和第二缓冲器504和506中。
逻辑处理器512通过使用从MUX1 508和MUX2 510接收的导通时钟ON_CLK和关断时钟OFF_CLK执行逻辑处理来产生多个扫描时钟SCCLK1至SCCLKn，将扫描时钟电平移位，并将电平移位的扫描时钟输出到栅极驱动器200。
感测时钟产生器530和进位时钟产生器540以与扫描时钟产生器520相同的方式操作。感测时钟产生器530和进位时钟产生器540分别产生感测时钟SECLK1至SECLKn和进位时钟CRCLK1至CRCLKn，并将产生的时钟输出到栅极驱动器200。感测时钟SECLK1至SECLKn和进位时钟CRCLK1至CRCLKn可以不包括GPM持续时间。
在根据实施例的显示设备中，电平移位器IC通过重写从时序控制器接收的导通时钟和关断时钟以及导通时钟和关断时钟的时序信息来产生多个GIP时钟，以便将从时序控制器发送到电平移位器IC的信号的转换最小化，并因此可以降低功耗和EMI。
在根据实施例的显示设备中，时序控制器和电平移位器IC使用串行接口发送和接收时序信息，使得即使在电平移位器IC中所需的控制信号的数量增加时，也可以减少时序控制器与电平移位器IC之间的发送线路的数量。因此，由于可以减少时序控制器的输出引脚的数量、电平移位器IC的输入引脚的数量、以及印刷电路板(PCB)上的时序控制器和电平移位器IC之间的布线线路和布线区域的数量，因此可以降低制造成本和EMI。
图9是示出根据本公开的实施例的显示设备的系统构造的视图。
参考图9，时序控制器400、电源管理电路700(图1中示出)和伽马电压产生器600(图1中示出)中的每一个包括单独的IC并且安装在控制PCB 410中。电平移位器IC 500安装在源PCB 800中。扁平柔性电缆(FFC)420通过连接器互锁并连接在控制PCB 410和源PCB800之间。根据面板100的尺寸，包括一个或多个源PCB 800。多个源PCB 800中的每一个通过位于X轴方向上在内侧的多个FFC 420中的每一个连接到控制PCB 410。
数据驱动器300(图1中示出)包括多个数据IC 310，用于分开驱动像素阵列PA的数据线。多个数据IC 310中的每一个分别安装到每个电路膜320中，例如膜上芯片(COF)330。其中安装有数据IC 310的多个COF 330通过由带状自动键合(TAB)的各向异性导电膜(ACF)被键合并连接到面板100和源PCB 800，并位于面板100和源PCB 800之间。
电平移位器IC 500安装在栅极驱动器200附近的源PCB800中。多个电平移位器IC500中的每个安装在多个源PCB 800中的每个上的在X轴方向上靠近栅极驱动器200的外侧。每个电平移位器IC 500通过在栅极驱动器200附近的COF 330向栅极驱动器200提供多个栅极控制信号。
与将电平移位器IC 500安装到控制PCB 410中的情况相比，安装在源PCB 800中的电平移位器IC 500可以减少通过控制PCB 410、FFC 420、连接器和源PCB 800的发送线路的数量。
在根据实施例的显示设备中，电平移位器IC通过重写从时序控制器接收的导通时钟和关断时钟以及导通和关断时钟的时序信息来产生多个GIP时钟，从而使从时序控制器发送到电平移位器IC的信号的转换最小化，因此可以降低功耗和EMI。
在根据实施例的显示设备中，时序控制器和电平移位器IC通过时序控制器和电平移位器IC使用串行接口来发送和接收时序信息，使得即使在电平移位器IC中所需的控制信号的数量增加时也可以减小时序控制器和电平移位器IC之间的发送线路的数量。因此，由于可以减少时序控制器的输出引脚的数量、电平移位器IC的输入引脚的数量、以及PCB上的时序控制器和电平移位器IC之间的布线线路和布线区域的数量，因此可以降低制造成本和EMI。
根据实施例的显示设备及其接口方法适用于所有显示设备，例如OLED显示器和LCD。
对于本领域技术人员显而易见的是，在不脱离本公开的精神和范围的情况下，可以在本公开中进行各种修改和变化。因此，本公开旨在覆盖在所附权利要求及其等同物的范围内的本公开的修改和变化。
可以组合上述各种实施例以提供进一步的实施例。根据以上详细描述，可以对实施例进行这些和其他改变。通常，在所附权利要求中，所使用的术语不应被解释为将权利要求限制于说明书和权利要求中公开的特定实施例，而是应该被解释为包括所有可能的实施例以及这些权利要求所拥有的这样的等同物的全部范围。因此，权利要求不受本公开的限制。

Claims (8)

1.一种显示设备，包括：
栅极驱动器，被配置为驱动面板的栅极线；
数据驱动器，被配置驱动所述面板的数据线；
时序控制器，被配置为控制所述栅极驱动器和所述数据驱动器的操作；以及
电平移位器集成电路(IC)，被配置为从所述时序控制器接收多个控制信号，并产生和输出用于控制所述栅极驱动器的驱动的多个栅极控制信号，
其中，所述电平移位器集成电路根据所述时序控制器的控制、通过逻辑处理从所述时序控制器接收或在所述电平移位器集成电路中缓冲的导通时钟和关断时钟来产生多个扫描时钟，并将所述多个扫描时钟输出到所述栅极驱动器。
2.根据权利要求1所述的显示设备，
其中所述电平移位器集成电路：
从所述时序控制器接收先前数据重写控制信号，或者通过对从所述时序控制器接收的多个控制信号的逻辑组合来产生所述先前数据重写控制信号，
当所述先前数据重写控制信号被禁用时，使用从所述时序控制器接收的导通时钟和关断时钟来产生所述多个扫描时钟，以及
当所述先前数据重写控制信号被启用时，使用在所述电平移位器集成电路中缓冲的导通时钟和关断时钟来产生所述多个扫描时钟，以及
其中，当所述先前数据重写控制信号被启用时，所述时序控制器停止发送所述导通时钟和所述关断时钟。
3.根据权利要求2所述的显示设备，
其中所述电平移位器集成电路包括扫描时钟产生器，以及
其中所述扫描时钟产生器包括：
第一多路复用器(MUX)，被配置为根据所述先前数据重写控制信号的控制，选择性地输出从所述时序控制器接收的当前水平时段的导通时钟和由第一缓冲器缓冲的先前水平时段的导通时钟中的任一个；
第二多路复用器，被配置为根据所述先前数据重写控制信号的控制，选择性地输出从所述时序控制器接收的当前水平时段的关断时钟和由第二缓冲器缓冲的先前水平时段的关断时钟中的任一个；
逻辑处理器，被配置为通过逻辑处理分别由所述第一多路复用器和所述第二多路复用器输出的导通时钟和关断时钟，来产生所述多个扫描时钟；以及
电平移位器，被配置为将所述多个扫描时钟电平移位，并将电平移位的扫描时钟输出到所述栅极驱动器。
4.根据权利要求3所述的显示设备，
其中所述第一缓冲器缓冲并输出在每个水平时段期间从所述第一多路复用器反馈的导通时钟，以及
其中所述第二缓冲器缓冲并输出在每个水平时段期间从所述第二多路复用器反馈的关断时钟。
5.根据权利要求4所述的显示设备，其中，所述电平移位器集成电路还包括：
第一逻辑门，被配置为逻辑组合从所述时序控制器接收的栅极起始脉冲、导通时钟和关断时钟，并且当所述栅极起始脉冲、所述导通时钟和所述关断时钟中的所有均为逻辑高时启用所述先前数据重写控制信号；以及
第二逻辑门，被配置为逻辑组合所述栅极起始脉冲、所述导通时钟和所述关断时钟，并且在仅所述栅极起始脉冲为逻辑高时输出起始脉冲。
6.根据权利要求4所述的显示设备，
其中，所述时序控制器包括发送器，所述发送器被配置为通过将关于所述多个栅极控制信号的时序配置信息串行化来将串行时序信息发送到所述电平移位器集成电路，并且在每个水平时段期间所述先前数据重写控制信号被嵌入到所述串行时序信息中，并且
其中，所述电平移位器集成电路还包括接收器，所述接收器被配置为使用从所述时序控制器接收的串行时序信息产生下一个水平时段的导通时钟和关断时钟，并将所述下一个水平时段的导通时钟和关断时钟输出到所述扫描时钟产生器。
7.根据权利要求6所述的显示设备，其中，所述时序控制器：
在所述先前数据重写控制信号处于关断状态时，将关于所述导通时钟和所述关断时钟的时序配置信息发送到所述电平移位器集成电路，并且
在所述先前数据重写控制信号处于导通状态时，停止发送关于所述导通时钟和所述关断时钟的时序配置信息。
8.根据权利要求3至7中任一项所述的显示设备，
其中，在发送所述导通时钟和所述关断时钟时，所述时序控制器还发送第二导通时钟、第二关断时钟、第三导通时钟和第三关断时钟，
其中所述电平移位器集成电路还包括：
感测时钟产生器，被配置为根据所述时序控制器的控制、使用从所述时序控制器接收的第二导通时钟和第二关断时钟或者使用在所述电平移位器集成电路中缓冲的第二导通时钟和第二关断时钟来产生多个感测时钟，并将所述多个感测时钟输出到所述栅极驱动器，以及
进位时钟产生器，被配置为根据所述时序控制器的控制、使用从所述时序控制器接收的第三导通时钟和第三关断时钟或者使用在所述电平移位器集成电路中缓冲的第三导通时钟和第三关断时钟来产生多个进位时钟，并将所述多个进位时钟输出到所述栅极驱动器，以及
其中所述感测时钟产生器和所述进位时钟产生器中的每个包括与所述扫描时钟产生器相同的元件。
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