CN108877712A - 显示面板 - Google Patents

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Abstract

一种显示面板，包含：多列像素电路和多个移位寄存器。每列像素电路包含多个像素电路，且多列像素电路包含第一列群组和第二列群组，第一列群组包含：第一标准列和第一参考列。第一标准列包含M个像素电路。第一参考列包含N个像素电路，其中M、N均为正整数。其中第一列群组中任意一列所包含的像素电路的数量小于等于M，且(M‑N)/M＝0～11％。多个移位寄存器包含多个第一移位寄存器和多个第二移位寄存器，其中多个第一移位寄存器分别耦接于第一列群组，多个第二移位寄存器分别耦接于第二列群组。其中多个第一移位寄存器各自包含一第一驱动晶体管，多个第二移位寄存器各自包含一第二驱动晶体管，且第一驱动晶体管和第二驱动晶体管的宽长比不相同。

Description

显示面板
技术领域
本发明有关一种显示面板，尤指一种具有多组不同驱动能力的移位寄存器的显示面板。
背景技术
图1为传统的液晶像素电路100的功能方块图。像素电路100包含开关晶体管110、液晶电容120以及存储电容130，其中像素电路100通过栅极信号线101耦接于移位寄存器103。移位寄存器103通过切换开关晶体管110的开关状态，来控制数据电压Vdata写入液晶电容120和存储电容130的时机。当移位寄存器103改变输出电压以关断开关晶体管110时，栅极信号线101上的电压变化量会通过耦合电容105传递至像素电路100，进而拉低了节点N1的电压。在此情况下，开关晶体管110会延迟关闭，使得漏电流Ileak经由开关晶体管110流入像素电路100。
若像素电路100和移位寄存器103是应用于矩形显示面板，由于每条栅极信号线具有相同的等效阻抗，每一列像素电路100关闭所需的时间会近似于相同。因此，漏电流Ileak造成的灰阶偏移量对于显示面板上所有的像素电路100而言也会近似于相同，使得人眼不会观察到亮度不均匀(Mura)的现象。然而，若像素电路100和移位寄存器103是应用于近年来十分热门的非矩形显示面板，由于非矩形显示面板每一列包含的像素电路100的数目不尽相同，每一条栅极信号线101上的寄生元件107也会具有不尽相同的等效阻抗。在此情况下，由于移位寄存器103的输出信号延迟程度的不同，每列像素电路100关闭所需的时间也会不同。因此，每列像素电路100会由漏电流Ileak充入不同电荷量，造成每列的像素电路100具有不同程度的灰阶偏移，使得人眼观察到明显的亮度不均匀。
发明内容
有鉴于此，如何提供可避免亮度不均匀现象的非矩形显示面板，实为业界有待解决的问题。
本发明提供一种显示面板，该显示面板包含：多列像素电路和多个移位寄存器。每列像素电路包含多个像素电路，且该多列像素电路包含第一列群组和第二列群组，该第一列群组包含：第一标准列和第一参考列。第一标准列包含M个像素电路。第一参考列包含N个像素电路，其中M、N均为正整数。其中该第一列群组中任意一列所包含的像素电路的数量小于等于M，且(M-N)/M＝0～11％。多个移位寄存器包含多个第一移位寄存器和多个第二移位寄存器，其中该多个第一移位寄存器分别耦接于该第一列群组，该多个第二移位寄存器分别耦接于该第二列群组。其中该多个第一移位寄存器各自包含一第一驱动晶体管，该多个第二移位寄存器各自包含一第二驱动晶体管，且该第一驱动晶体管和该第二驱动晶体管的宽长比不相同。
以下结合附图和具体实施例对本发明进行详细描述，但不作为对本发明的限定。
附图说明
图1为传统的液晶像素电路的功能方块图。
图2为根据本发明一实施例的显示面板简化后的功能方块图。
图3为图2中的多个第一移位寄存器简化后的功能方块图。
图4为依据本发明一实施例的显示面板简化后的功能方块图。
图5为图4的显示面板依据本发明一实施例的分组结果示意图。
其中，附图标记：
100、400：传统像素电路
101：栅极信号线
103：传统移位寄存器
105：耦合电容
107：寄生元件
110：开关晶体管
120：液晶电容
130：存储电容
200：显示面板
210、410：像素电路
220、220-a～220-n、540：第一移位寄存器
222：第一驱动晶体管
224：控制电路
230、230-a～230-n、550：第二移位寄存器
240、430：栅极信号线
250、510：第一列群组
252、512：第一标准列
254、524：第一参考列
260、520：第二列群组
262、522：第二标准列
264、524：第二参考列
420：移位寄存器
530：第三列群组
532：第三标准列
534：第三参考列
560：第三移位寄存器
CLK：控制时钟脉冲信号
Vhck：开关时钟脉冲信号
Vss：参考电压
具体实施方式
下面结合附图对本发明的结构原理和工作原理作具体的描述：
以下将结合相关附图来说明本发明的实施例。在附图中，相同的标号表示相同或类似的元件或方法流程。
图2为根据本发明一实施例的显示面板200简化后的功能方块图。显示面板200包含多个像素电路210、多个第一移位寄存器220-a～220-n、多个第二移位寄存器230-a～230-n和多个栅极信号线240，其中多个像素电路210耦接于多个栅极信号线240，且排列成具有多列的非矩形形状。多个像素电路210包含第一列群组250和第二列群组260，其中多个第一移位寄存器220各自耦接于第一列群组250的其中一列像素电路，多个第二移位寄存器230各自耦接于第二列群组260的其中一列像素电路。第一移位寄存器220和第二移位寄存器230分别用于通过栅极信号线240控制本身所耦接的像素电路210的开启或关闭，以更新像素电路210存储的数据电压。为使图面简洁而易于说明，显示面板200中的其他元件与连接关系并未示出于图2中。
实际上，像素电路210可以用液晶像素电路、有机发光二极管像素电路或微发光二极管像素电路等等种类的像素电路来实现。
本发明说明书和附图中使用的元件编号中的小写英文索引a～n，只是为了方便指称个别的元件和信号，并非有意将前述元件的数量局限在特定数目。在本发明说明书和附图中，若使用某一元件编号时没有指明该元件编号的索引，则代表该元件编号是指称所属元件群组中不特定的任一元件。例如，元件编号220-a指称的对象是第一移位寄存器220-a，而元件编号220指称的对象则是第一移位寄存器220-a～220-n中不特定的任意第一移位寄存器220。又例如，元件编号230-a指称的对象是第二移位寄存器230-a，而元件编号230指称的对象则是第二移位寄存器230-a～230-n中不特定的任意第二移位寄存器230。
请参照图2，第一列群组250和第二列群组260中每一列所包含的像素电路210的数量不尽相同。例如，第一列群组250包含一第一标准列252和一第一参考列254，第一标准列252和第一参考列254各自包含M个和N个像素电路210，其中M大于等于N，且M和N均为正整数。
又例如，第二列群组260包含一第二标准列262和一第二参考列264，第二标准列262和第二参考列264各自包含X个和Y个像素电路210，其中X大于等于Y，且X和Y均为正整数。
如前所述，为了防止显示面板200发生亮度不均匀(Mura)现象，显示面板200中的每个像素电路210由开启状态切换至关闭状态所需的时间需大致相同。然而，由于栅极信号线240上的等效阻抗正相关于栅极信号线240所耦接的像素电路210的数量，所以显示面板200的每个栅极信号线240的等效组抗不尽相同。
换言之，第一移位寄存器220和第二移位寄存器230所对应的输出负载也不尽相同。因此，第一移位寄存器220和第二移位寄存器230的驱动能力需分别依据各自所对应的输出负载来设置。多个第一移位寄存器220-a～220-n可具有相同的驱动能力，多个第二移位寄存器230-a～230-n也可具有相同的驱动能力，以降低电路设计难度。
具体而言，第一移位寄存器220的驱动能力是依据多个第一移位寄存器220-a～220-n的第一平均输出负载来设置。例如，藉由将第一列群组250包含的所有像素电路210的数量，除以第一列群组250所包含的列数，可以得到对应于多个第一移位寄存器220-a～220-n的一第一平均输出负载。通过相似的方法，可以得到对应于多个第二移位寄存器230-a～230-n的一第二平均输出负载，然后依据第二平均输出负载来设置第二移位寄存器230的驱动能力。
换言之，第一平均输出负载代表多个第一移位寄存器220-a～220-n平均耦接的像素电路210的数量，第二平均输出负载代表多个第二移位寄存器230-a～230-n平均耦接的像素电路210的数量，且第一移位寄存器220的驱动功率正相关于第一平均输出负载，第二移位寄存器230的驱动功率也正相关于第二平均输出负载。
因此，在某些第一平均输出负载大于第二平均输出负载的实施例中，第一移位寄存器220的驱动功率会大于等于第二移位寄存器230的驱动功率。
在另一实施例中，若某一第一移位寄存器220具有多个第一移位寄存器220-a～220-n中最大的输出负载，则每个第一移位寄存器220的驱动能力，被设置为相同于该某一第一移位寄存器220的驱动能力。若某一第二移位寄存器230具有多个第二移位寄存器230-a～230-n中最大的输出负载，则每个第二移位寄存器230的驱动能力，被设置为相同于该某一第二移位寄存器230的驱动能力。
例如，请参照图2，第一移位寄存器220-n耦接于第一列群组250中包含最多像素电路210的最宽列(例如，第一标准列252)，使得第一移位寄存器220-n具有多个第一移位寄存器220-a～220-n中最大的输出负载。因此，多个第一移位寄存器220-a～220-n的驱动能力，均相同于第一移位寄存器220-n的驱动能力。另一方面，第二移位寄存器230-n耦接于第二列群组260中包含最多像素电路210的最宽列(例如，第二标准列262)，使得第二移位寄存器230-n具有多个第二移位寄存器230-a～230-n中最大的输出负载。因此，多个第二移位寄存器230-a～230-n的驱动能力，均相同于第二移位寄存器230-n的驱动能力。
以下将结合图3进一步说明第一移位寄存器220和第二移位寄存器230的驱动功率的设置方式。图3为图2中的多个第一移位寄存器220-a～220-n简化后的功能方块图。第一移位寄存器220包含一第一驱动晶体管222和一控制电路224，其中第一驱动晶体管222耦接于栅极信号线240，控制电路224耦接于第一驱动晶体管222的控制端，其中多个第一移位寄存器220-a～220-n依序串联。
第一移位寄存器220还用于接收至少一控制时钟脉冲信号CLK、一开关时钟脉冲信号Vhck和一参考电压Vss。控制电路224用于依据至少一控制时钟脉冲信号CLK切换第一驱动晶体管222的开关状态，以使多个第一移位寄存器220能够通过各自的第一驱动晶体管222依序输出开关时钟脉冲信号Vhck至栅极信号线240。亦即，第一驱动晶体管222可对栅极信号线240进行充电或放电，以开启或关闭对应的多个像素电路210。
值得注意的是，第一驱动晶体管222的宽长比(W/L ratio)越大，第一驱动晶体管222对栅极信号线240进行充电或放电的速度也会越快。因此，第一移位寄存器220的驱动功率可以用第一驱动晶体管222的宽长比来表示。由前述可知，第一移位寄存器220的驱动功率正相关于第一平均输出负载，所以第一驱动晶体管222的宽长比也正相关于第一平均输出负载。
相似地，第二移位寄存器230的驱动功率，也可以用第二移位寄存器230中用于对栅极信号线240进行充放电的第二驱动晶体管(未示出)来表示。因此，第二移位寄存器230的第二驱动晶体管的宽长比正相关于第二输出负载。
在某些实施例中，第一移位寄存器220的整体电路面积和第一驱动晶体管222的宽长比成正相关，以进一步提升第一移位寄存器220的驱动能力。因此，第一移位寄存器220的驱动功率可以用第一移位寄存器220的整体电路面积来表示，且第一移位寄存器220的整体电路面积正相关于第一平均输出负载。相似地，第二移位寄存器230的驱动功率也可以用第二移位寄存器230的整体电路面积来表示，且第二移位寄存器230的整体电路面积正相关于第二平均输出负载。
因此，在第一移位寄存器220的驱动功率大于第二移位寄存器的驱动功率230的情况下，第一移位寄存器220的整体电路面积会大于第二移位寄存器230的整体电路面积。
请再参照图2，以下将结合图2进一步说明第一列群组250和第二列群组260的分组方式(亦即，第一移位寄存器220和第二移位寄存器230的分组方式)。
在一实施例中，对第一列群组250而言，第一标准列252包含M个像素电路210，且显示面板200的任意一列包含的像素电路210的数量小于或等于M。第一参考列254包含N个像素电路210，且第一列群组250的任意一列包含的像素电路210的数量大于或等于N。亦即，第一标准列252可以是显示面板200中包含最多像素电路210的一列，第一参考列254可以是第一列群组250中包含最少像素电路210的一列，其中M和N均为正整数，且(M-N)/M＝0～11％。
另外，对第二列群组260而言，第二标准列262包含X个像素电路210，且第二列群组260的任意一列包含的像素电路210的数量小于等于X。第二参考列264包含Y个像素电路210，且第二列群组260的任意一列包含的像素电路210的数量大于等于Y。亦即，第二标准列262可以是第二列群组260中包含最多像素电路210的一列，第二参考列264可以是第二列群组260中包含最少像素电路210的一列，其中X和Y均为正整数，且(X-Y)/X＝0～11％。
换言之，多列像素电路210可划分为不同的列群组，且一个列群组耦接的多个移位寄存器具有相同的驱动能力。例如，第一列群组250耦接于彼此具有相同驱动能力的第一移位寄存器220-a～220-n，第二列群组260耦接于彼此具有相同驱动能力的第二移位寄存器230-a～230-n。另外，每一个列群组中包含最少像素电路210的最窄列(例如，第一参考列254)的像素电路210数量，是包含最多像素电路210的最宽列(例如，第一标准列252)的像素电路210数量的至少89％。
请同样参照图2，在另一实施例中，显示面板200的任意一列包含的像素电路210的数量同样小于或等于M，M为正整数，且显示面板200的多列像素电路210可以依据M的大小为依据进一步进行分组。
对第一列群组250而言，第一参考列254包含N个像素电路210，且第一列群组250的任意一列包含的像素电路210的数量大于等于N，其中N为正整数。在此情况下，N/M＝70～100％，且(M-N)/M＝5～7％。
另外，对第二列群组260而言，第二标准列262包含X个像素电路210，且第二列群组260的任意一列包含的像素电路210的数量小于等于X。第二参考列264包含Y个像素电路210，且第二列群组260的任意一列包含的像素电路210的数量大于等于Y，其中X和Y为正整数。在此情况下，X/M＝70～100％，且(X-Y)/M＝5～7％。
换言之，多列像素电路210可依据第一标准列252包含的像素电路210的数量(亦即，M)划分为不同的列群组，且每个列群组会耦接于彼此具有相同驱动能力的多个移位寄存器。例如，第一列群组250耦接于彼此具有相同驱动能力的第一移位寄存器220-a～220-n，第二列群组260耦接于彼此具有相同驱动能力的第二移位寄存器230-a～230-n。
在本实施例中，第一列群组250和第二列群组260的分组结果可如下表一所示，其中像素电路数量(％)代表某一列包含的像素电路210的数量与第一标准列252所包含的像素电路210的数量的比值：
表一：列群组的分组结果
在本实施例中，第一标准列252和第二标准列262包含的像素电路数量210也可以有较大差距。例如，在第一标准列252包含M个像素电路210，且第一标准列252是显示面板200包含最多像素210的一列的情况下，第二标准列262包含X个像素电路210，第二参考列264包含Y个像素电路210。此时，第二列群组260需满足X/M＝40～70％，以及(X-Y)/M＝7～9％此一条件，于另一实施例中，第二列群组260则需满足X/M＝0～40％，以及(X-Y)/M＝9～11％此一条件。
由上述内容可知，每个第一移位寄存器220所耦接的像素电路210的数量，会落在M的一第一百分比范围(例如，70～100％)之内，其中第一百分比范围由一第一上限(例如，100％)和一第一下限(例如，70％)界定。相似地，每个第二移位寄存器230所耦接的像素电路210的数量，会落在M的一第二百分比范围(例如，40～70％)之内，其中第二百分比范围由一第二上限(例如，70％)和一第二下限(例如，40％)界定。
另外，任意两个第一移位寄存器220所耦接的像素电路210的数量差值的绝对值，会落在M的一第三百分比范围(例如，5～7％)之内，且第三百分比范围由一第三上限(例如，7％)和一第三下限(例如，5％)界定。例如，当N/M＝70～100％时，第一标准列252和第一参考列254的像素电路210的数量差值的绝对值为M的5～7％。
任意两个第二移位寄存器230所耦接的像素电路210的数量的差值的绝对值，会落在M的一第四百分比范围(例如，7～9％)之内，且第四百分比范围由一第四上限(例如，9％)和一第三下限(例如，7％)界定。例如，当X/M＝40～70％时，第二标准列262和第二参考列264的像素电路210的数量差值的绝对值为M的7～9％。
表二示出了第一百分比范围和第三百分比范围之间的对应关系，以及第二百分比范围和第四百分比范围之间的对应关系。如表二所示，前述的第二上限和第二下限会大致上分别与第四上限和第四下限成反比。例如，当第二百分比范围为70～100％时，第四百分比范围会是5～7％，当第二百分比范围为40～70％时，第四百分比范围会是7～9％，而当第二百分比范围为0～40％时，第四百分比范围会是9～11％。
表二：第一百分比范围至第四百分比范围的对应关系
此外，在第一移位寄存器220的驱动功率大于第二移位寄存器230的驱动功率的实施例中，第一上限会大于等于第二上限。
图4为依据本发明一实施例的显示面板400简化后的功能方块图。显示面板400包含多列像素电路410、多个栅极信号线420和多个移位寄存器430，其中每个移位寄存器430通过一个栅极信号线420耦接于一列像素电路410。为使图面简洁而易于说明，显示面板400中的其他元件与连接关系并未示出于图4中。
显示面板400中的每列像素电路410包含的像素电路410的数量以及每个移位寄存器430的驱动能力可以依据前述图2的分组方式设置。例如，请参照图5，多列像素电路410可以包含第一列群组510、第二列群组520和第三列群组530。耦接于第一列群组510的多个移位寄存器420可设置为具有相同驱动能力的多个第一移位寄存器540。耦接于第二列群组520的多个移位寄存器420可设置为具有相同驱动能力的多个第二移位寄存器550，而耦接于第三列群组530的多个移位寄存器420可设置为具有相同驱动能力的多个第三移位寄存器560。
在本实施例中，第一列群组510包含一第一标准列512和一第一参考列514。第一标准列512和第一参考列514分别包含M个和N个像素电路410，M和N为正整数。显示面板400中任意一列包含的像素电路410的数量小于等于M，而第一列群组510中任意一列包含的像素电路410的数量大于等于N。其中第一列群组510满足N/M＝70～100％，且(M-N)/M＝5～7％此一条件。
第二列群组520包含一第二标准列522和一第二参考列524。第二标准列522和第二参考列524分别包含X个和Y个像素电路410，X和Y为正整数。第二列群组520中任意一列包含的像素电路410的数量小于等于X但大于等于Y。其中第二列群组满足X/M＝40～70％，且(X-Y)/M＝7～9％此一条件。
第三列群组530包含一第三标准列532和一第三参考列534。第三标准列532和第三参考列534分别包含I个和J个像素电路410，I和J为正整数。第三列群组530中任意一列包含的像素电路410的数量小于等于I但大于等于J。其中第三列群组满足I/M＝0～40％，且(I-J)/M＝9～11％此一条件。
在本实施例中，第一列群组510平均每一列包含的像素电路410个数，大于等于第二列群组520平均每一列包含的像素电路410个数。第二列群组520平均每一列包含的像素电路410个数，又大于等于第三列群组530平均每一列包含的像素电路410个数。因此，第一移位寄存器540的驱动能力被设置为大于等于第二移位寄存器550的驱动能力，第二移位寄存器550的驱动能力被设置为大于等于第三移位寄存器560的驱动能力。
显示面板400中许多功能方块的运作方式以及优点，相似于显示面板200，为简洁起见，在此不重复赘述。
本发明提出的非矩形显示面板200和400可以确保任意两个像素电路210或410的亮度差异不大于一阶灰阶。
另外，显示面板200和400中的移位寄存器是采用群组设计，且同一群组的移位寄存器具有相同的电路面积。由于不必针对每一条不同阻抗的栅极信号线分别设计不同电路面积的移位寄存器，显示面板200和400具有简化电路设计的优势。
在说明书及权利要求中使用了某些词汇来指称特定的元件。然而，所属技术领域中具有通常知识者应可理解，同样的元件可能会用不同的名词来称呼。说明书及权利要求并不以名称的差异做为区分元件的方式，而是以元件在功能上的差异来做为区分的基准。在说明书及权利要求所提及的「包含」为开放式的用语，故应解释成「包含但不限定于」。另外，「耦接」在此包含任何直接及间接的连接手段。因此，若文中描述第一元件耦接于第二元件，则代表第一元件可通过电性连接或无线传输、光学传输等信号连接方式而直接地连接于第二元件，或者通过其他元件或连接手段间接地电性或信号连接至该第二元件。
另外，除非说明书中特别指明，否则任何单数格的用语都同时包含复数格的涵义。
当然，本发明还可有其它多种实施例，在不背离本发明精神及其实质的情况下，熟悉本领域的技术人员当可根据本发明作出各种相应的改变和变形，但这些相应的改变和变形都应属于本发明所附的权利要求的保护范围。

Claims (12)

1.一种显示面板，其特征在于，包含：
多列像素电路，其中每列像素电路包含多个像素电路，且该多列像素电路包含一第一列群组和一第二列群组，该第一列群组包含：
一第一标准列，包含M个像素电路；以及
一第一参考列，包含N个像素电路，其中M、N均为正整数；
其中，该第一列群组中任意一列所包含的像素电路的数量小于等于M，且(M-N)/M＝0～11％；以及
多个移位寄存器，包含多个第一移位寄存器和多个第二移位寄存器，其中该多个第一移位寄存器分别耦接于该第一列群组，该多个第二移位寄存器分别耦接于该第二列群组；
其中，该多个第一移位寄存器各自包含一第一驱动晶体管，该多个第二移位寄存器各自包含一第二驱动晶体管，且该第一驱动晶体管和该第二驱动晶体管的宽长比不相同。
2.如权利要求1所述的显示面板，其特征在于，其中若该第一列群组中任意一列所包含的像素电路的数量大于等于N，且N/M＝70～100％，则(M-N)/M＝5～7％。
3.如权利要求1所述的显示面板，其特征在于，其中，该多列像素电路中任意一列所包含的像素电路的数量小于等于M，且该第二列群组包含：
一第二标准列，包含X个像素电路；以及
一第二参考列，包含Y个像素电路，其中该第二标准列中任意一列所包含的像素电路的数量大于等于Y且小于等于X；
其中，X和Y均为正整数，且当X/M＝70～100％时，(X-Y)/M＝5～7％。
4.如权利要求1所述的显示面板，其特征在于，其中，该多列像素电路中任意一列所包含的像素电路的数量小于等于M，且该第二列群组包含：
一第二标准列，包含X个像素电路；以及
一第二参考列，包含Y个像素电路，其中该第二标准列中任意一列所包含的像素电路的数量大于等于Y且小于等于X；
其中，X和Y均为正整数，且当X/M＝40～70％时，(X-Y)/M＝7～9％。
5.如权利要求1所述的显示面板，其特征在于，其中，该多列像素电路中任意一列所包含的像素电路的数量小于等于M，且该第二列群组包含：
一第二标准列，包含X个像素电路；以及
一第二参考列，包含Y个像素电路，其中该第二标准列中任意一列所包含的像素电路的数量大于等于Y且小于等于X；
其中，X和Y均为正整数，且当X/M＝0～40％时，(X-Y)/M＝9～11％。
6.一种显示面板，其特征在于，包含：
多列像素电路，排列成一非矩形的形状；
多个第一移位寄存器，耦接于该多列像素电路中的部分像素电路，其中每个第一移位寄存器具有一第一驱动功率；
多个第二移位寄存器，耦接于该多列像素电路中的另一部分像素电路，其中每个第二移位寄存器具有一第二驱动功率；
其中该第一驱动功率正相关于该多个第一移位寄存器的一第一平均输出阻抗，该第二驱动功率正相关于该多个第二移位寄存器的一第二平均输出阻抗，且该第一驱动功率大于该第二驱动功率。
7.如权利要求6所述的显示面板，其特征在于，其中该第一驱动功率代表该第一移位寄存器的所有晶体管宽长比总和，该第二驱动功率代表该第二移位寄存器的所有晶体管宽长比总和，且该第一移位寄存器的所有晶体管宽长比总和大于该第二移位寄存器的所有晶体管宽长比总和。
8.如权利要求6所述的显示面板，其特征在于，其中该第一驱动功率代表每个第一移位寄存器的一第一驱动晶体管的宽长比，该第二驱动功率代表每个第二移位寄存器的一第二驱动晶体管的宽长比，且该第一驱动晶体管的宽长比大于该第二驱动晶体管的宽长比，
其中，该第一驱动晶体管用于对一第一栅极信号线进行充电或放电，该第二驱动晶体管用于对一第二栅极信号线进行充电或放电，且该第一栅极信号线和该第二栅极信号线耦接于该多列像素电路。
9.如权利要求6所述的显示面板，其特征在于，其中，该多个第一移位寄存器的第一平均输出阻抗代表该多个第一移位寄存器平均耦接的像素电路的数量，该多个第二移位寄存器的第二平均输出阻抗代表该多个第二移位寄存器平均耦接的像素电路的数量。
10.如权利要求6所述的显示面板，其特征在于，其中，该多列像素电路包含一第一标准列，该第一标准列包含M个像素电路，M为正整数且该多列像素电路中任意一列所包含的像素电路的数量小于等于M，
其中，每个第一移位寄存器耦接的像素电路的数量位于M的一第一百分比范围内，每个第二移位寄存器耦接的像素电路的数量位于M的一第二百分比范围内，
其中，该第一百分比范围由一第一上限和一第一下限界定，该第二百分比范围由一第二上限和一第二下限界定，且该第一上限大于等于该第二上限。
11.如权利要求10所述的显示面板，其特征在于，其中，任意两个第一移位寄存器耦接的像素电路的数量的差值的绝对值，位于M的一第三百分比范围内，任意两个第二移位寄存器耦接的像素电路的数量的差值的绝对值，位于M的一第四百分比范围内，
其中，该第四百分比范围由一第四上限和一第四下限界定，且该第二上限和该第二下限分别大致与该第四上限和该第四下限成反比。
12.如权利要求11所述的显示面板，其特征在于，其中，该第二百分比范围和该第四百分比范围依据以下规则设置：
当该第二百分比范围为70～100％时，该第四百分比范围为5～7％；
当该第二百分比范围为40～70％时，该第四百分比范围为7～9％；
当该第二百分比范围为0～40％时，该第四百分比范围范围为9～11％。
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