TWI660335B - 顯示面板 - Google Patents

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Abstract

一種顯示面板，包含：多列畫素電路和多個移位暫存器。每列畫素電路包含多個畫素電路，且多列畫素電路包含第一列群組和第二列群組，第一列群組包含：第一標準列和第一參考列。第一標準列包含M個畫素電路。第一參考列包含N個畫素電路，其中M、N皆為正整數。其中第一列群組中任意一列所包含的畫素電路之數量小於等於M，且(M-N)/M=0~11%。多個移位暫存器包含多個第一移位暫存器和多個第二移位暫存器，其中多個第一移位暫存器分別耦接於第一列群組，多個第二移位暫存器分別耦接於第二列群組。其中多個第一移位暫存器各自包含一第一驅動電晶體，多個第二移位暫存器各自包含一第二驅動電晶體，且第一驅動電晶體和第二驅動電晶體的寬長比不相同。

Description

顯示面板
本揭示文件有關一種顯示面板，尤指一種具有多組不同驅動能力的移位暫存器之顯示面板。
第1圖為傳統的液晶畫素電路100的功能方塊圖。畫素電路100包含開關電晶體110、液晶電容120以及儲存電容130，其中畫素電路100透過閘極訊號線101耦接於移位暫存器103。移位暫存器103透過切換開關電晶體110的開關狀態，來控制資料電壓Vdata寫入液晶電容120和儲存電容130的時機。當移位暫存器103改變輸出電壓以關斷開關電晶體110時，閘極訊號線101上的電壓變化量會透過耦合電容105傳遞至畫素電路100，進而拉低了節點N1的電壓。在此情況下，開關電晶體110會延遲關閉，使得漏電流Ileak經由開關電晶體110流入畫素電路100。
若畫素電路100和移位暫存器103是應用於矩形顯示面板，由於每條閘極訊號線具有相同的等效阻抗，每一列畫素電路100關閉所需的時間會近似於相同。因此，漏電流Ileak造成的灰階偏移量對於顯示面板上所有的畫素電路100而言也會近似於相同，使得人眼不會觀察到亮度不 均勻(Mura)之現象。然而，若畫素電路100和移位暫存器103是應用於近年來十分熱門之非矩形顯示面板，由於非矩形顯示面板每一列包含的畫素電路100之數目不盡相同，每一條閘極訊號線101上之寄生元件107也會具有不盡相同的等效阻抗。在此情況下，由於移位暫存器103之輸出訊號延遲程度的不同，每列畫素電路100關閉所需的時間也會不同。因此，每列畫素電路100會由漏電流Ileak充入不同電荷量，造成每列之畫素電路100具有不同程度的灰階偏移，使得人眼觀察到明顯之亮度不均勻。
有鑑於此，如何提供可避免亮度不均勻現象之非矩形顯示面板，實為業界有待解決的問題。
本揭示文件提供一種顯示面板，該顯示面板包含：多列畫素電路和多個移位暫存器。每列畫素電路包含多個畫素電路，且該多列畫素電路包含第一列群組和第二列群組，該第一列群組包含：第一標準列和第一參考列。第一標準列包含M個畫素電路。第一參考列包含N個畫素電路，其中M、N皆為正整數。其中該第一列群組中任意一列所包含的畫素電路之數量小於等於M，且(M-N)/M=0~11%。多個移位暫存器包含多個第一移位暫存器和多個第二移位暫存器，其中該多個第一移位暫存器分別耦接於該第一列群組，該多個第二移位暫存器分別耦接於該第二列群組。其中該多個第一移位暫存器各自包含 一第一驅動電晶體，該多個第二移位暫存器各自包含一第二驅動電晶體，且該第一驅動電晶體和該第二驅動電晶體的寬長比不相同。
100、400‧‧‧傳統畫素電路
101‧‧‧閘極訊號線
103‧‧‧傳統移位暫存器
105‧‧‧耦合電容
107‧‧‧寄生元件
110‧‧‧開關電晶體
120‧‧‧液晶電容
130‧‧‧儲存電容
200‧‧‧顯示面板
210、410‧‧‧畫素電路
220、220-a~220-n、540‧‧‧第一移位暫存器
222‧‧‧第一驅動電晶體
224‧‧‧控制電路
230、230-a~230-n、550‧‧‧第二移位暫存器
240、430‧‧‧閘極訊號線
250、510‧‧‧第一列群組
252、512‧‧‧第一標準列
254、524‧‧‧第一參考列
260、520‧‧‧第二列群組
262、522‧‧‧第二標準列
264、524‧‧‧第二參考列
420‧‧‧移位暫存器
530‧‧‧第三列群組
532‧‧‧第三標準列
534‧‧‧第三參考列
560‧‧‧第三移位暫存器
CLK‧‧‧控制時脈信號
Vhck‧‧‧開關時脈信號
Vss‧‧‧參考電壓
為讓揭示文件之上述和其他目的、特徵、優點與實施例能更明顯易懂，所附圖式之說明如下：第1圖為傳統的液晶畫素電路的功能方塊圖。
第2圖為根據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。
第3圖為第2圖中的多個第一移位暫存器簡化後的功能方塊圖。
第4圖為依據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。
第5圖為第4圖的顯示面板依據本揭示文件一實施例的分組結果示意圖。
以下將配合相關圖式來說明本發明的實施例。在圖式中，相同的標號表示相同或類似的元件或方法流程。
第2圖為根據本揭示文件一實施例的顯示面板200簡化後的功能方塊圖。顯示面板200包含多個畫素電路210、多個第一移位暫存器220-a~220-n、多個第二移位暫存器230-a~230-n和多個閘極訊號線240，其中多個畫素電 路210耦接於多個閘極訊號線240，且排列成具有多列之非矩形形狀。多個畫素電路210包含第一列群組250和第二列群組260，其中多個第一移位暫存器220各自耦接於第一列群組250的其中一列畫素電路，多個第二移位暫存器230各自耦接於第二列群組260的其中一列畫素電路。第一移位暫存器220和第二移位暫存器230分別用於透過閘極訊號線240控制本身所耦接的畫素電路210之開啟或關閉，以更新畫素電路210儲存之資料電壓。為使圖面簡潔而易於說明，顯示面板200中的其他元件與連接關係並未繪示於第2圖中。
實作上，畫素電路210可以用液晶畫素電路、有機發光二極體畫素電路或微發光二極體畫素電路等等種類的畫素電路來實現。
本案說明書和圖式中使用的元件編號中的小寫英文索引a~n，只是為了方便指稱個別的元件和信號，並非有意將前述元件的數量侷限在特定數目。在本案說明書和圖式中，若使用某一元件編號時沒有指明該元件編號的索引，則代表該元件編號是指稱所屬元件群組中不特定的任一元件。例如，元件編號220-a指稱的對象是第一移位暫存器220-a，而元件編號220指稱的對象則是第一移位暫存器220-a~220-n中不特定的任意第一移位暫存器220。又例如，元件編號230-a指稱的對象是第二移位暫存器230-a，而元件編號230指稱的對象則是第二移位暫存器230-a~230-n中不特定的任意第二移位暫存器230。
請參照第2圖，第一列群組250和第二列群組260中每一列所包含的畫素電路210的數量不盡相同。例如，第一列群組250包含一第一標準列252和一第一參考列254，第一標準列252和第一參考列254各自包含M個和N個畫素電路210，其中M大於等於N，且M和N皆為正整數。
又例如，第二列群組260包含一第二標準列262和一第二參考列264，第二標準列262和第二參考列264各自包含X個和Y個畫素電路210，其中X大於等於Y，且X和Y皆為正整數。
如前所述，為了防止顯示面板200發生亮度不均勻(Mura)現象，顯示面板200中的每個畫素電路210由開啟狀態切換至關閉狀態所需的時間需大致相同。然而，由於閘極訊號線240上之等效阻抗正相關於閘極訊號線240所耦接的畫素電路210的數量，所以顯示面板200的每個閘極訊號線240的等效組抗不盡相同。
換言之，第一移位暫存器220和第二移位暫存器230所對應之輸出負載也不盡相同。因此，第一移位暫存器220和第二移位暫存器230之驅動能力需分別依據各自所對應的輸出負載來設置。多個第一移位暫存器220-a~220-n可具有相同的驅動能力，多個第二移位暫存器230-a~230-n也可具有相同的驅動能力，以降低電路設計難度。
具體而言，第一移位暫存器220的驅動能力是依據多個第一移位暫存器220-a~220-n的第一平均輸出負 載來設置。例如，藉由將第一列群組250包含的所有畫素電路210之數量，除以第一列群組250所包含的列數，可以得到對應於多個第一移位暫存器220-a~220-n的一第一平均輸出負載。通過相似的方法，可以得到對應於多個第二移位暫存器230-a~230-n的一第二平均輸出負載，然後依據第二平均輸出負載來設置第二移位暫存器230的驅動能力。
換言之，第一平均輸出負載代表多個第一移位暫存器220-a~220-n平均耦接的畫素電路210的數量，第二平均輸出負載代表多個第二移位暫存器230-a~230-n平均耦接的畫素電路210的數量，且第一移位暫存器220的驅動功率正相關於第一平均輸出負載，第二移位暫存器230的驅動功率也正相關於第二平均輸出負載。
因此，在某些第一平均輸出負載大於第二平均輸出負載的實施例中，第一移位暫存器220的驅動功率會大於等於第二移位暫存器230的驅動功率。
在另一實施例中，若某一第一移位暫存器220具有多個第一移位暫存器220-a~220-n中最大的輸出負載，則每個第一移位暫存器220的驅動能力，被設置為相同於該某一第一移位暫存器220的驅動能力。若某一第二移位暫存器230具有多個第二移位暫存器230-a~230-n中最大的輸出負載，則每個第二移位暫存器230的驅動能力，被設置為相同於該某一第二移位暫存器230的驅動能力。
例如，請參照第2圖，第一移位暫存器220-n耦接於第一列群組250中包含最多畫素電路210的最寬列 (例如，第一標準列252)，使得第一移位暫存器220-n具有多個第一移位暫存器220-a~220-n中最大的輸出負載。因此，多個第一移位暫存器220-a~220-n的驅動能力，皆相同於第一移位暫存器220-n的驅動能力。另一方面，第二移位暫存器230-n耦接於第二列群組260中包含最多畫素電路210的最寬列(例如，第二標準列262)，使得第二移位暫存器230-n具有多個第二移位暫存器230-a~230-n中最大的輸出負載。因此，多個第二移位暫存器230-a~230-n的驅動能力，皆相同於第二移位暫存器230-n的驅動能力。
以下將配合第3圖進一步說明第一移位暫存器220和第二移位暫存器230之驅動功率的設置方式。第3圖為第2圖中的多個第一移位暫存器220-a~220-n簡化後之功能方塊圖。第一移位暫存器220包含一第一驅動電晶體222和一控制電路224，其中第一驅動電晶體222耦接於閘極訊號線240，控制電路224耦接於第一驅動電晶體222的控制端，其中多個第一移位暫存器220-a~220-n依序串聯。
第一移位暫存器220還用於接收至少一控制時脈信號CLK、一開關時脈信號Vhck和一參考電壓Vss。控制電路224用於依據至少一控制時脈信號CLK切換第一驅動電晶體222的開關狀態，以使多個第一移位暫存器220能夠透過各自的第一驅動電晶體222依序輸出開關時脈信號Vhck至閘極訊號線240。亦即，第一驅動電晶體222可對閘極訊號線240進行充電或放電，以開啟或關閉對應的多個畫素電路210。
值得注意的是，第一驅動電晶體222的寬長比(W/L ratio)越大，第一驅動電晶體222對閘極訊號線240進行充電或放電的速度也會越快。因此，第一移位暫存器220的驅動功率可以用第一驅動電晶體222的寬長比來表示。由前述可知，第一移位暫存器220的驅動功率正相關於第一平均輸出負載，所以第一驅動電晶體222的寬長比也正相關於第一平均輸出負載。
相似地，第二移位暫存器230的驅動功率，也可以用第二移位暫存器230中用於對閘極訊號線240進行充放電的第二驅動電晶體(未繪示)來表示。因此，第二移位暫存器230的第二驅動電晶體的寬長比正相關於第二輸出負載。
在某些實施例中，第一移位暫存器220的整體電路面積和第一驅動電晶體222的寬長比成正相關，以進一步提升第一移位暫存器220的驅動能力。因此，第一移位暫存器220的驅動功率可以用第一移位暫存器220的整體電路面積來表示，且第一移位暫存器220的整體電路面積正相關於第一平均輸出負載。相似地，第二移位暫存器230的驅動功率也可以用第二移位暫存器230的整體電路面積來表示，且第二移位暫存器230的整體電路面積正相關於第二平均輸出負載。
因此，在第一移位暫存器220的驅動功率大於第二移位暫存器的驅動功率230的情況下，第一移位暫存器220的整體電路面積會大於第二移位暫存器230的整體電路 面積。
請再參照第2圖，以下將配合第2圖進一步說明第一列群組250和第二列群組260的分組方式(亦即，第一移位暫存器220和第二移位暫存器230的分組方式)。
在一實施例中，對第一列群組250而言，第一標準列252包含M個畫素電路210，且顯示面板200的任意一列包含的畫素電路210的數量小於或等於M。第一參考列254包含N個畫素電路210，且第一列群組250的任意一列包含的畫素電路210的數量大於或等於N。亦即，第一標準列252可以是顯示面板200中包含最多畫素電路210的一列，第一參考列254可以是第一列群組250中包含最少畫素電路210的一列，其中M和N皆為正整數，且(M-N)/M=0~11%。
另外，對第二列群組260而言，第二標準列262包含X個畫素電路210，且第二列群組260的任意一列包含的畫素電路210的數量小於等於X。第二參考列264包含Y個畫素電路210，且第二列群組260的任意一列包含的畫素電路210的數量大於等於Y。亦即，第二標準列262可以是第二列群組260中包含最多畫素電路210的一列，第二參考列264可以是第二列群組260中包含最少畫素電路210的一列，其中X和Y皆為正整數，且(X-Y)/X=0~11%。
換言之，多列畫素電路210可劃分為不同的列群組，且一個列群組耦接的多個移位暫存器具有相同的驅動能力。例如，第一列群組250耦接於彼此具有相同驅動能力的第一移位暫存器220-a~220-n，第二列群組260耦接於 彼此具有相同驅動能力的第二移位暫存器230-a~230-n。另外，每一個列群組中包含最少畫素電路210的最窄列(例如，第一參考列254)的畫素電路210數量，是包含最多畫素電路210的最寬列(例如，第一標準列252)的畫素電路210數量的至少89%。
請同樣參照第2圖，在另一實施例中，顯示面板200的任意一列包含的畫素電路210的數量同樣小於或等於M，M為正整數，且顯示面板200的多列畫素電路210可以依據M的大小為依據進一步進行分組。
對第一列群組250而言，第一參考列254包含N個畫素電路210，且第一列群組250的任意一列包含的畫素電路210的數量大於等於N，其中N為正整數。在此情況下，N/M=70~100%，且(M-N)/M=5~7%。
另外，對第二列群組260而言，第二標準列262包含X個畫素電路210，且第二列群組260的任意一列包含的畫素電路210的數量小於等於X。第二參考列264包含Y個畫素電路210，且第二列群組260的任意一列包含的畫素電路210的數量大於等於Y，其中X和Y為正整數。在此情況下，X/M=70~100%，且(X-Y)/M=5~7%。
換言之，多列畫素電路210可依據第一標準列252包含的畫素電路210的數量(亦即，M)劃分為不同的列群組，且每個列群組會耦接於彼此具有相同驅動能力的多個移位暫存器。例如，第一列群組250耦接於彼此具有相同驅動能力的第一移位暫存器220-a~220-n，第二列群組260 耦接於彼此具有相同驅動能力的第二移位暫存器230-a~230-n。
在本實施例中，第一列群組250和第二列群組260的分組結果可如下表一所示，其中畫素電路數量(%)代表某一列包含的畫素電路210的數量與第一標準列252所包含的畫素電路210的數量的比值：
在本實施例中，第一標準列252和第二標準列262包含的畫素電路數量210也可以有較大差距。例如，在第一標準列252包含M個畫素電路210，且第一標準列252是顯示面板200包含最多畫素210的一列的情況下，第二標準列262包含X個畫素電路210，第二參考列264包含Y個畫素電路210。此時，第二列群組260需滿足X/M=40~70%，以及(X-Y)/M=7~9%此一條件，於另一實施例中，第二列 群組260則需滿足X/M=0~40%，以及(X-Y)/M=9~11%此一條件。
由上述內容可知，每個第一移位暫存器220所耦接的畫素電路210的數量，會落在M的一第一百分比範圍(例如，70~100%)之內，其中第一百分比範圍由一第一上限(例如，100%)和一第一下限(例如，70%)界定。相似地，每個第二移位暫存器230所耦接的畫素電路210的數量，會落在M的一第二百分比範圍(例如，40~70%)之內，其中第二百分比範圍由一第二上限(例如，70%)和一第二下限(例如，40%)界定。
另外，任意兩個第一移位暫存器220所耦接的畫素電路210的數量差值之絕對值，會落在M的一第三百分比範圍(例如，5~7%)之內，且第三百分比範圍由一第三上限(例如，7%)和一第三下限(例如，5%)界定。例如，當N/M=70~100%時，第一標準列252和第一參考列254的畫素電路210的數量差值之絕對值為M的5~7%。
任意兩個第二移位暫存器230所耦接的畫素電路210的數量的差值之絕對值，會落在M的一第四百分比範圍(例如，7~9%)之內，且第四百分比範圍由一第四上限(例如，9%)和一第三下限(例如，7%)界定。例如，當X/M=40~70%時，第二標準列262和第二參考列264的畫素電路210的數量差值之絕對值為M的7~9%。
表二繪示了第一百分比範圍和第三百分比範圍之間的對應關係，以及第二百分比範圍和第四百分比範圍 之間的對應關係。如表二所示，前述的第二上限和第二下限會大致上分別與第四上限和第四下限成反比。例如，當第二百分比範圍為70~100%時，第四百分比範圍會是5~7%，當第二百分比範圍為40~70%時，第四百分比範圍會是7~9%，而當第二百分比範圍為0~40%時，第四百分比範圍會是9~11%。
此外，在第一移位暫存器220的驅動功率大於第二移位暫存器230的驅動功率的實施例中，第一上限會大於等於第二上限。
第4圖為依據本揭示文件一實施例的顯示面板400簡化後的功能方塊圖。顯示面板400包含多列畫素電路410、多個閘極訊號線420和多個移位暫存器430，其中每個移位暫存器430透過一個閘極訊號線420耦接於一列畫素電路410。為使圖面簡潔而易於說明，顯示面板400中的其他元件與連接關係並未繪示於第4圖中。
顯示面板400中的每列畫素電路410包含的畫素電路410的數量以及每個移位暫存器430的驅動能力可以依據前述第2圖的分組方式設置。例如，請參照第5圖，多 列畫素電路410可以包含第一列群組510、第二列群組520和第三列群組530。耦接於第一列群組510的多個移位暫存器420可設置為具有相同驅動能力的多個第一移位暫存器540。耦接於第二列群組520的多個移位暫存器420可設置為具有相同驅動能力的多個第二移位暫存器550，而耦接於第三列群組530的多個移位暫存器420可設置為具有相同驅動能力的多個第三移位暫存器560。
在本實施例中，第一列群組510包含一第一標準列512和一第一參考列514。第一標準列512和第一參考列514分別包含M個和N個畫素電路410，M和N為正整數。顯示面板400中任意一列包含的畫素電路410的數量小於等於M，而第一列群組510中任意一列包含的畫素電路410的數量大於等於N。其中第一列群組510滿足N/M=70~100%，且(M-N)/M=5~7%此一條件。
第二列群組520包含一第二標準列522和一第二參考列524。第二標準列522和第二參考列524分別包含X個和Y個畫素電路410，X和Y為正整數。第二列群組520中任意一列包含的畫素電路410的數量小於等於X但大於等於Y。其中第二列群組滿足X/M=40~70%，且(X-Y)/M=7~9%此一條件。
第三列群組530包含一第三標準列532和一第三參考列534。第三標準列532和第三參考列534分別包含I個和J個畫素電路410，I和J為正整數。第三列群組530中任意一列包含的畫素電路410的數量小於等於I但大於等於 J。其中第三列群組滿足I/M=0~40%，且(I-J)/M=9~11%此一條件。
在本實施例中，第一列群組510平均每一列包含的畫素電路410個數，大於等於第二列群組520平均每一列包含的畫素電路410個數。第二列群組520平均每一列包含的畫素電路410個數，又大於等於第三列群組530平均每一列包含的畫素電路410個數。因此，第一移位暫存器540的驅動能力被設置為大於等於第二移位暫存器550的驅動能力，第二移位暫存器550的驅動能力被設置為大於等於第三移位暫存器560的驅動能力。
顯示面板400中許多功能方塊的運作方式以及優點，相似於顯示面板200，為簡潔起見，在此不重複贅述。
本揭示文件提出的非矩形顯示面板200和400可以確保任意兩個畫素電路210或410之亮度差異不大於一階灰階。
另外，顯示面板200和400中的移位暫存器是採用群組設計，且同一群組的移位暫存器具有相同的電路面積。由於不必針對每一條不同阻抗的閘極訊號線分別設計不同電路面積的移位暫存器，顯示面板200和400具有簡化電路設計的優勢。
在說明書及申請專利範圍中使用了某些詞彙來指稱特定的元件。然而，所屬技術領域中具有通常知識者應可理解，同樣的元件可能會用不同的名詞來稱呼。說明書及申請專利範圍並不以名稱的差異做為區分元件的方 式，而是以元件在功能上的差異來做為區分的基準。在說明書及申請專利範圍所提及的「包含」為開放式的用語，故應解釋成「包含但不限定於」。另外，「耦接」在此包含任何直接及間接的連接手段。因此，若文中描述第一元件耦接於第二元件，則代表第一元件可通過電性連接或無線傳輸、光學傳輸等信號連接方式而直接地連接於第二元件，或者通過其他元件或連接手段間接地電性或信號連接至該第二元件。
另外，除非說明書中特別指明，否則任何單數格的用語都同時包含複數格的涵義。
以上僅為本發明的較佳實施例，凡依本發明請求項所做的均等變化與修飾，皆應屬本發明的涵蓋範圍。

Claims (10)

  1. 一種顯示面板，包含：多列畫素電路，其中每列畫素電路包含多個畫素電路，且該多列畫素電路包含一第一列群組和一第二列群組，該第一列群組包含：一第一標準列，包含M個畫素電路；以及一第一參考列，包含N個畫素電路，其中M、N皆為正整數；其中，其中該第一列群組中任意一列所包含的畫素電路之數量小於等於M，且(M-N)/M=0~11%；以及多個移位暫存器，包含多個第一移位暫存器和多個第二移位暫存器，其中該多個第一移位暫存器分別耦接於該第一列群組，該多個第二移位暫存器分別耦接於該第二列群組；其中，該多個第一移位暫存器各自包含一第一驅動電晶體，該多個第二移位暫存器各自包含一第二驅動電晶體，且該第一驅動電晶體和該第二驅動電晶體的寬長比不相同。
  2. 如請求項1的顯示面板，其中若該第一列群組中任意一列所包含之畫素電路之數量大於等於N，且N/M=70~100%，則(M-N)/M=5~7%。
  3. 如請求項1的顯示面板，其中，該多列畫素電路中任意一列所包含的畫素電路之數量小於等於M，且該第二列群組包含：一第二標準列，包含X個畫素電路；以及一第二參考列，包含Y個畫素電路，其中該第二標準列中任意一列所包含的畫素電路之數量大於等於Y且小於等於X；其中，X和Y皆為正整數，且當X/M=70~100%時，(X-Y)/M=5~7%。
  4. 如請求項1的顯示面板，其中，該多列畫素電路中任意一列所包含的畫素電路之數量小於等於M，且該第二列群組包含：一第二標準列，包含X個畫素電路；以及一第二參考列，包含Y個畫素電路，其中該第二標準列中任意一列所包含的畫素電路之數量大於等於Y且小於等於X；其中，X和Y皆為正整數，且當X/M=40~70%時，(X-Y)/M=7~9%。
  5. 如請求項1的顯示面板，其中，該多列畫素電路中任意一列所包含的畫素電路之數量小於等於M，且該第二列群組包含：一第二標準列，包含X個畫素電路；以及一第二參考列，包含Y個畫素電路，其中該第二標準列中任意一列所包含的畫素電路之數量大於等於Y且小於等於X；其中，X和Y皆為正整數，且當X/M=0~40%時，(X-Y)/M=9~11%。
  6. 一種顯示面板，包含：多列畫素電路，排列成一非矩形的形狀；多個第一移位暫存器，耦接於該多列畫素電路中的部分畫素電路，其中每個第一移位暫存器具有一第一驅動功率；多個第二移位暫存器，耦接於該多列畫素電路中的另一部分畫素電路，其中每個第二移位暫存器具有一第二驅動功率；其中該第一驅動功率正相關於該多個第一移位暫存器的一第一平均輸出阻抗，該第二驅動功率正相關於該多個第二移位暫存器的一第二平均輸出阻抗，且該第一驅動功率大於該第二驅動功率；其中該第一驅動功率還正相關於每個第一移位暫存器的一第一驅動電晶體的寬長比，該第二驅動功率還正相關於每個第二移位暫存器的一第二驅動電晶體的寬長比，且該第一驅動電晶體的寬長比大於該第二驅動電晶體的寬長比；其中，該第一驅動電晶體用於對一第一閘極信號線進行充電或放電，該第二驅動電晶體用於對一第二閘極信號線進行充電或放電，且該第一閘極信號線和該第二閘極信號線耦接於該多列畫素電路。
  7. 如請求項6的顯示面板，其中該第一驅動功率正相關於該第一移位暫存器的所有電晶體寬長比總和，該第二驅動功率正相關於該第二移位暫存器的所有電晶體寬長比總和，且該第一移位暫存器的所有電晶體寬長比總和大於該第二移位暫存器的所有電晶體寬長比總和。
  8. 如請求項6的顯示面板，其中，該多個第一移位暫存器的第一平均輸出阻抗正相關於該多個第一移位暫存器平均耦接的畫素電路的數量，該多個第二移位暫存器的第二平均輸出阻抗正相關於該多個第二移位暫存器平均耦接的畫素電路的數量。
  9. 如請求項6的顯示面板，其中，該多列畫素電路包含一第一標準列，該第一標準列包含M個畫素電路，M為正整數且該多列畫素電路中任意一列所包含的畫素電路之數量小於等於M，其中，每個第一移位暫存器耦接的畫素電路的數量位於位於M的一第一百分比範圍內，每個第二移位暫存器耦接的畫素電路的數量位於M的一第二百分比範圍內，其中，該第一百分比範圍為70~100%，該第二百分比範圍為70~100%、40~70%或0~40%。
  10. 如請求項9的顯示面板，其中，任意兩個第一移位暫存器耦接的畫素電路的數量的差值之絕對值，位於M的一第三百分比範圍內，任意兩個第二移位暫存器耦接的畫素電路的數量的差值之絕對值，位於M的一第四百分比範圍內，其中，該第三百分比範圍為5~7%，且該第二百分比範圍和該第四百分比範圍依據以下規則設置：當該第二百分比範圍為70~100%時，該第四百分比範圍為5~7%；當該第二百分比範圍為40~70%時，該第四百分比範圍為7~9%；當該第二百分比範圍為0~40%時，該第四百分比範圍範圍為9~11%。
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