CN108009114A - 一种优化ncsi时钟信号线等长的结构 - Google Patents

一种优化ncsi时钟信号线等长的结构 Download PDF

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    • G06F13/40—Bus structure
    • G06F13/4063—Device-to-bus coupling
    • G06F13/4068—Electrical coupling

Abstract

本发明涉及一种优化NCSI时钟信号线等长的结构，其特征在于，包括主板和网卡，所述主板上设置有BMC芯片、时钟源以及主板接口，所述的BMC芯片与主板接口连接；所述的时钟源通过L2时钟线连接到主板接口，所述的时钟源通过T1时钟线连接到第一时钟信号连接器，第一时钟信号连接器通过T2时钟线连接到第二时钟信号连接器，第二时钟信号连接器通过T3时钟线连接到BMC芯片；所述的网卡包括网卡接口和PHY芯片，所述的PHY芯片与网卡接口之间通过L4时钟线连接，所述的主板接口和网卡接口之间通过L3线缆连接。

Description

一种优化NCSI时钟信号线等长的结构
技术领域
本发明属于服务器时钟线路设计技术领域，具体涉及一种优化NCSI时钟信号线等长的结构。
背景技术
随着IT技术的快速发展，人们对服务器的管理技术要求得越来越高，其中可靠性和稳定性是一个非常重要的指标要求。
现有技术中常规的做法是：利用BMC芯片通过NCSI信号总线连接网卡芯片，通过共享服务器网卡芯片的网口把服务器的监控信息发送出去或者接收进来。
在服务器系统NCSI链路设计过程中，时钟信号线的等长设计尤为重要。比如：AST2500在使用外部50MHz时钟源时，要求NCSI时钟信号线4inch等长。
例如：某NCSI链路拓扑如图1所示，该链路使用外部50MHZ时钟源，其中BMC芯片为AST2500，链路中有一段线缆用于连接主板和网卡。图中实线代表NCSI数据链路，虚线代表时钟链路， L1 、L2、L3、L4分别为各部分时钟线长度；根据 AST2500芯片对时钟信号的要求，从50MHZ时钟源到主板BMC和到网卡PHY芯片的时钟线至多有4inch的长度差。即图1中L1与L2+L3+L4的和相差4inch以内。由于链路中有线缆，通常情况下从50MHZ时钟源到网卡PHY芯片的长度要大于到主板BMC的长度；针对上述链路，通常会在主板上将50MHZ时钟源到BMC的时钟线绕长，以满足时钟线等长要求，绕线示意图，如图2所示。但是，当线缆较长或者主板上空间有限时，并不能单纯的通过绕线方式满足时钟线设计要求。且当链路时钟线不满足设计要求时会恶化信号质量，常常导致一些不可预见问题的出现，极大的增加了系统设计风险。此为现有技术的不足之处。
因此，针对现有技术中的上述缺陷，提供设计一种优化NCSI时钟信号线等长的结构；以解决现有技术中的上述缺陷，是非常有必要的。
发明内容
本发明的目的在于，针对上述现有技术存在的缺陷，提供设计一种优化NCSI时钟信号线等长的结构，以解决上述技术问题。
为实现上述目的，本发明给出以下技术方案：
一种优化NCSI时钟信号线等长的结构，其特征在于，包括主板和网卡，所述主板上设置有BMC芯片、时钟源以及主板接口，所述的BMC芯片与主板接口连接；
所述的时钟源通过L2时钟线连接到主板接口，所述的时钟源通过T1时钟线连接到第一时钟信号连接器，第一时钟信号连接器通过T2时钟线连接到第二时钟信号连接器，第二时钟信号连接器通过T3时钟线连接到BMC芯片；
所述的网卡包括网卡接口和PHY芯片，所述的PHY芯片与网卡接口之间通过L4时钟线连接，所述的主板接口和网卡接口之间通过L3线缆连接。
作为优选，所述的BMC芯片为AST2500芯片。
作为优选，所述的时钟源为50MHZ时钟源。
本发明的有益效果在于，主板上增加两个时钟信号连接器，时钟线从时钟源引出以后进入第一时钟信号连接器，经时钟线缆到第二时钟信号连接器，再经过板载走线到BMC。
在主板上增加两个NCSI时钟信号连接器，通过在时钟信号链路中引入线缆以解决时钟信号线等长的问题。
避免了当NCSI链路较长时主板绕线空间不够的问题，尤其对当链路中存在较长线缆时有较好的优化效果，减小了链路设计风险，提高了系统设计成功率。
此外，本发明设计原理可靠，结构简单，具有非常广泛的应用前景。
由此可见，本发明与现有技术相比，具有突出的实质性特点和显著地进步，其实施的有益效果也是显而易见的。
附图说明
图1是现有技术中NCSI链路拓扑图。
图2是现有技术中NCSI时钟链路绕线拓扑图。
图3是本发明提供的一种优化NCSI时钟信号线等长的结构拓扑图。
其中，1-主板，2-网卡，3-BMC芯片，4-时钟源，5-主板接口，6-L2时钟线，7-T1时钟线，8-第一时钟信号连接器， 9-T2时钟线，10-第二时钟信号连接器，11-T3时钟线，12-网卡接口，13-PHY芯片，14-L4时钟线，15-L3线缆。
具体实施方式
下面结合附图并通过具体实施例对本发明进行详细阐述，以下实施例是对本发明的解释，而本发明并不局限于以下实施方式。
如图1所示，本发明提供的一种优化NCSI时钟信号线等长的结构，包括主板1和网卡2，所述主板1上设置有BMC芯片3、时钟源4以及主板接口5，所述的BMC芯片3与主板接口5连接；
所述的时钟源4通过L2时钟线6连接到主板接口5，所述的时钟源4通过T1时钟线7连接到第一时钟信号连接器8，第一时钟信号连接器8通过T2时钟线9连接到第二时钟信号连接器10，第二时钟信号连接器10通过T3时钟线11连接到BMC芯片3；
所述的网卡2包括网卡接口12和PHY芯片13，所述的PHY芯片13与网卡接口12之间通过L4时钟线14连接，所述的主板接口5和网卡接口12之间通过L3线缆15连接。
本实施例中，所述的BMC芯片3为AST2500芯片。
本实施例中，所述的时钟源4为50MHZ时钟源。
以上公开的仅为本发明的优选实施方式，但本发明并非局限于此，任何本领域的技术人员能思之的没有创造性的变化，以及在不脱离本发明原理前提下所作的若干改进和润饰，都应落在本发明的保护范围内。

Claims (3)

1.一种优化NCSI时钟信号线等长的结构，其特征在于，包括主板（1）和网卡（2），所述主板（1）上设置有BMC芯片（3）、时钟源（4）以及主板接口（5），所述的BMC芯片（3）与主板接口（5）连接；
所述的时钟源（4）通过L2时钟线（6）连接到主板接口（5），所述的时钟源（4）通过T1时钟线（7）连接到第一时钟信号连接器（8），第一时钟信号连接器（8）通过T2时钟线（9）连接到第二时钟信号连接器（10），第二时钟信号连接器（10）通过T3时钟线（11）连接到BMC芯片（3）；
所述的网卡（2）包括网卡接口（12）和PHY芯片（13），所述的PHY芯片（13）与网卡接口（12）之间通过L4时钟线（14）连接，所述的主板接口（5）和网卡接口（12）之间通过L3线缆（15）连接。
2.根据权利要求1所述的一种优化NCSI时钟信号线等长的结构，其特征在于，所述的BMC芯片（3）为AST2500芯片。
3.根据权利要求1或2所述的一种优化NCSI时钟信号线等长的结构，其特征在于，所述的时钟源（4）为50MHZ时钟源。
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