CN106057757A - 一种硅通孔结构及其制作方法 - Google Patents

一种硅通孔结构及其制作方法 Download PDF

Info

Publication number
CN106057757A
CN106057757A CN201610535367.2A CN201610535367A CN106057757A CN 106057757 A CN106057757 A CN 106057757A CN 201610535367 A CN201610535367 A CN 201610535367A CN 106057757 A CN106057757 A CN 106057757A
Authority
CN
China
Prior art keywords
hole
silicon
substrate
blind hole
insulating barrier
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN201610535367.2A
Other languages
English (en)
Inventor
李春泉
谢星华
黄红艳
尚玉玲
张明
周远畅
谢小天
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Guilin University of Electronic Technology
Original Assignee
Guilin University of Electronic Technology
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Guilin University of Electronic Technology filed Critical Guilin University of Electronic Technology
Priority to CN201610535367.2A priority Critical patent/CN106057757A/zh
Publication of CN106057757A publication Critical patent/CN106057757A/zh
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/481Internal lead connections, e.g. via connections, feedthrough structures
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76898Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics formed through a semiconductor substrate

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

本发明公开了一种硅通孔结构及其制作方法,所述硅通孔结构,包括基底,其特征是,所述基底设有通孔,通孔贯穿基底的正面和背面,所述通孔与基底的接触面间设有绝缘层,通孔的两端设有凸起块;所述硅通孔结构的制作方法,其特征是,包括如下步骤:1)制作第一盲孔;2)制作第一绝缘层;3)填充导电材料;4)制作第二盲孔;5)制作第二绝缘层;6)贯通两盲孔;7)形成硅通孔。这种硅通孔结构能够使芯片三维叠层封装更加简单可靠。这种方法降低了加工高深宽比或超高深宽比的硅通孔结构的难度,实现了高深宽比或超高深宽比的硅通孔结构的制作,工艺简单同时兼容了半导体的制作工艺。

Description

一种硅通孔结构及其制作方法
技术领域
本发明涉及微电子封装技术,具体是一种硅通孔结构及其制作方法。
背景技术
在过去的几十年间,半导体器件体积缩小已使集成电路的速度、性能、密度以及单位功能成本取得了不断改善。
3D-硅通孔集成技术是微电子核心技术之一,3D-硅通孔互连提供了超越“摩尔”的方法,是目前最先进,最复杂的封装技术;3D-硅通孔集成技术可以获得更好的电性能、低功耗、噪声更小的封装尺寸。3D-硅通孔技术将广泛地应用于微电子领域,包括智能手机、物联网器件、传感器、存储器、太阳能电池、LED和功率器件等高端产品,尤其是智能手机等消费类电子产品。
目前,在已出现的许多新的3D封装技术中,硅通孔技术是3D领域多芯片叠层化集成和电互连的关键性技术,其优势有:互连长度可以缩短到与芯片厚度相等,使逻辑模块垂直堆叠代替了水平分布,硅通孔技术显著的减小了芯片延迟和电感效应,有利于提高数字信号传输速度和微波的传输,可以实现高密度、高深宽比的连接,从而能够实现复杂的多片全硅系统集成,密度比当前用于先进多片模块的物理封装高出许多倍,同时更加节能,预期硅通孔能把芯片的功耗降低大约40%。
硅通孔结构是通过深反应离子刻蚀技术在硅基底上形成盲孔,然后再制作绝缘层、溅射种子层、电镀填孔,背面减薄等半导体工艺完成硅通孔结构的制作。其形貌主要有直孔硅通孔和斜孔硅通孔两种。但是由于工艺的限制,目前一些工艺步骤只能完成深宽比小于10:1的硅通孔的加工,如CVD绝缘层、PVD种子层以及电镀填充等。如果制作深宽比大于10:1的硅通孔结构,那么从工艺上目前就难以实现了,这就需要我们重新设计硅通孔结构,以达到深宽比小于10:1的工艺限制。
发明内容
本发明的目的是针对现有技术的不足,而提供一种硅通孔结构及其制作方法。这种硅通孔结构能够使芯片三维叠层封装更加简单可靠。
这种方法可以降低加工高深宽比或超高深宽比的硅通孔结构的难度,实现高深宽比或超高深宽比的硅通孔结构的制作。
实现本发明目的的技术方案是:
一种硅通孔结构,包括基底,与现有技术不同的是,所述基底设有通孔,通孔贯穿基底的正面和背面,所述通孔与基底的接触面间设有绝缘层,通孔的两端设有凸起块。
所述通孔由分别从基底的正面和背面相向刻蚀的第一盲孔和第二盲孔贯通形成。
所述通孔的数量为至少2个。
基底材料可以是硅、有机物和玻璃等;
通孔材料可以是铜、多晶硅、钨和高分子材料等;
绝缘层材料一般为二氧化硅;
凸起块作为芯片三维叠层封装时连接多层基底间硅通孔的桥梁,凸起块使芯片三维叠层封装连接更方便、可靠性更好,凸起块材料可以是铜、钨和高分子材料等。
一种硅通孔结构的制作方法,包括如下步骤:
1)制作第一盲孔:从基底的正面即上表面开始刻蚀第一盲孔;
2)制作第一绝缘层:在第一盲孔和基底的接触面间制作第一绝缘层,同时在第一盲孔的开口端刻蚀与凸起块尺寸大小相同的第一凹槽;
3)填充导电材料:在第一盲孔和第一凹槽中电镀填充导电材料,在第一绝缘层中填充绝缘材料;
4)制作第二盲孔:基底背面减薄,并刻蚀第二盲孔,第二盲孔的深度至第一绝缘层为止;
5)制作第二绝缘层:在第二盲孔和在基底的接触面间制作第二绝缘层,同时在第二盲孔的开口端刻蚀与凸起块尺寸大小相同的第二凹槽;
6)贯通两盲孔:刻蚀第一盲孔底部使第一盲孔和第二盲孔贯通形成通孔;
7)形成硅通孔:在第二盲孔和第二凹槽中电镀填充导电材料,同时在第二绝缘层中填充绝缘材料,完成硅通孔结构的制作。
这种硅通孔结构能够使芯片三维叠层封装更加简单可靠。
这种方法采用对基底进行减薄,通过双面刻蚀、双面填充硅通孔的方法,实现了超高深宽比硅通孔结构的制作,同时降低了高深宽比硅通孔结构的工作难度。与此同时,具有工艺简单,可靠性高以及兼容半导体工艺的优点。
这种方法降低了加工高深宽比或超高深宽比的硅通孔结构的难度,实现了高深宽比或超高深宽比的硅通孔结构的制作,工艺简单同时兼容了半导体的制作工艺。
附图说明
图1为实施例中硅通孔结构的三维示意图;
图2为实施例中方法的流程示意图;
图3为实施例的方法中步骤1的示意图;
图4为实施例的方法中步骤2的示意图;
图5为实施例的方法中步骤3的示意图;
图6为实施例的方法中步骤4的示意图;
图7为实施例的方法中步骤5的示意图;
图8为实施例的方法中步骤6的示意图;
图9为实施例的方法中步骤7的示意图。
图中,1.通孔 1-1.第一盲孔 1-2.第二盲孔 2.绝缘层2-1.第一绝缘层 2-2.第二绝缘层 3.凸起块 3-1.第一凹槽 3-2.第二凹槽 4.基底 5导电材料 6.绝缘材料。
具体实施方式:
下面结合附图和实施例对本发明内容作进一步的阐述,但不是对本发明的限定。
实施例:
参照图1,一种硅通孔结构,包括基底4,所述基底4设有通孔1,通孔1贯穿基底4的正面和背面,所述通孔1与基底4的接触面间设有绝缘层2,通孔1的两端设有凸起块3。
所述通孔1由分别从基底4的正面和背面相向刻蚀的第一盲孔1-1和第二盲孔1-2贯通形成。
所述通孔1的数量为至少2个。
基底4材料可以是硅、有机物和玻璃等;
通孔1材料可以是铜、多晶硅、钨和高分子材料等;
绝缘层2材料为二氧化硅;
凸起块3作为芯片三维叠层封装时连接多层基底间硅通孔的桥梁,凸起块3使芯片三维叠层封装连接更方便、可靠性更好,凸起块3材料可以是铜、钨和高分子材料等。
参照图2,一种硅通孔结构的制作方法,包括如下步骤:
1)制作第一盲孔1-1:从基底4的正面即上表面开始刻蚀第一盲孔1-1;如图3所示,具体地在硅基底4上通过深反应离子刻蚀法形成第一盲孔1-1,孔径20,孔深100。第一盲孔1-1也可以采用其他方法刻蚀形成,如等离子体刻蚀、离子束喷射、X射线和电子束照射等方法。
2)制作第一绝缘层2-1:在第一盲孔1-1和基底4的接触面间制作第一绝缘层2-1,同时在第一盲孔1-1的开口端刻蚀与凸起块3尺寸大小相同的第一凹槽3-1;如图4所示,具体地在第一盲孔1-1外壁通过TEOS-CVD法制作一层厚度为1的绝缘材料2-1,然后在淀积的绝缘材料2-1上溅射形成Ti/Cu种子层,厚度分别为50和200,其中,绝缘材料2-1为二氧化硅。
3)填充导电材料5:在第一盲孔1-1和第一凹槽3-1中电镀填充导电材料5,在第一绝缘层2-1中填充绝缘材料6;如图5所示,通过电镀铜填充导电材料5,完成正面硅通孔前程制作工艺;
4)制作第二盲孔1-2:基底4背面减薄,并刻蚀第二盲孔1-2,第二盲孔1-2的深度至第一绝缘层2-1为止;如图6所示;以基底4正面第一盲孔1-1孔中心为中心,采用深反应离子刻蚀技术刻蚀基底4背面,形成孔径为40,孔深为200的第二盲孔1-2,刻蚀深度的要求是直到暴露出正面第一盲孔1-1底部的绝缘材料2-1为止,刻蚀方法可以是离子体刻蚀、离子束喷射、X射线和电子束照射等方法。
具体地使基底4厚度减薄到300,减薄过程是通过机械加工和化学反应的方法对基底4进行一系列减薄、研磨、抛光工艺,使基底4表面达到所需要的厚度、平整度以及粗糙度。
5)制作第二绝缘层2-2:在第二盲孔1-2和在基底4的接触面间制作第二绝缘层2-2,同时在第二盲孔1-2的开口端刻蚀与凸起块3尺寸大小相同的第二凹槽3-2;如图7所示,对第二盲孔1-2外壁进行绝缘层2-2淀积,该绝缘层2-2的厚度为1,淀积方法可以是TEOS-CVD、SOG-CVD或其他淀积方法,所用绝缘层材料为二氧化硅。
6)贯通两盲孔:刻蚀第一盲孔1-1底部使第一盲孔1-1和第二盲孔1-2贯通形成通孔1;如图8所示,在刻蚀过程中,要求不破坏第二盲孔1-2外壁的二氧化硅绝缘层2-2。
7)形成硅通孔:在第二盲孔1-2和第二凹槽3-2中电镀填充导电材料5,同时在第二绝缘层2-2中填充绝缘材料6,完成硅通孔结构的制作。如图9所示,溅射Ti/Cu种子层的厚度分别为50和200,与第一盲孔1-1中的种子层厚度一致,然后电镀铜填充硅通孔孔中导电材料5,完成背面硅通孔后程制作工艺,从而形成完整的硅通孔结构制作。

Claims (4)

1.一种硅通孔结构,包括基底,其特征是,所述基底设有通孔,通孔贯穿基底的正面和背面,所述通孔与基底的接触面间设有绝缘层,通孔的两端设有凸起块。
2.根据权利要求1所述的硅通孔结构,其特征是,所述通孔由分别从基底的正面和背面相向刻蚀的第一盲孔和第二盲孔贯通形成。
3.根据权利要求1所述的硅通孔结构,其特征是,所述通孔的数量为至少2个。
4.一种硅通孔结构的制作方法,其特征是,包括如下步骤:
1)制作第一盲孔:从基底的正面即上表面开始刻蚀第一盲孔;
2)制作第一绝缘层:在第一盲孔和基底的接触面间制作第一绝缘层,同时在第一盲孔的开口端刻蚀与凸起块尺寸大小相同的第一凹槽;
3)填充导电材料:在第一盲孔和第一凹槽中电镀填充导电材料,在第一绝缘层中填充绝缘材料;
4)制作第二盲孔:基底背面减薄,并刻蚀第二盲孔,第二盲孔的深度至第一绝缘层为止;
5)制作第二绝缘层:在第二盲孔和在基底的接触面间制作第二绝缘层,同时在第二盲孔的开口端刻蚀与凸起块尺寸大小相同的第二凹槽;
6)贯通两盲孔:刻蚀第一盲孔底部使第一盲孔和第二盲孔贯通形成通孔;
7)形成硅通孔:在第二盲孔和第二凹槽中电镀填充导电材料,同时在第二绝缘层中填充绝缘材料,完成硅通孔结构的制作。
CN201610535367.2A 2016-07-08 2016-07-08 一种硅通孔结构及其制作方法 Pending CN106057757A (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201610535367.2A CN106057757A (zh) 2016-07-08 2016-07-08 一种硅通孔结构及其制作方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201610535367.2A CN106057757A (zh) 2016-07-08 2016-07-08 一种硅通孔结构及其制作方法

Publications (1)

Publication Number Publication Date
CN106057757A true CN106057757A (zh) 2016-10-26

Family

ID=57185159

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201610535367.2A Pending CN106057757A (zh) 2016-07-08 2016-07-08 一种硅通孔结构及其制作方法

Country Status (1)

Country Link
CN (1) CN106057757A (zh)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN110797299A (zh) * 2019-09-30 2020-02-14 福建省福联集成电路有限公司 一种通孔结构及其制作方法
CN111599749A (zh) * 2020-06-01 2020-08-28 联合微电子中心有限责任公司 一种高深宽比对通型tsv结构及其制备方法和硅转接板
CN113161289A (zh) * 2021-04-22 2021-07-23 浙江集迈科微电子有限公司 一种高深宽比tsv金属柱的电镀工艺
CN113782489A (zh) * 2021-08-27 2021-12-10 上海华虹宏力半导体制造有限公司 硅通孔及其形成方法
CN115172272A (zh) * 2022-07-29 2022-10-11 武汉新芯集成电路制造有限公司 高深宽比tsv电联通结构及其制造方法

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20070069376A1 (en) * 2005-09-29 2007-03-29 Infineon Technologies Ag Component with chip through-contacts
CN102376689A (zh) * 2011-09-09 2012-03-14 华中科技大学 具有台阶的硅通孔结构及其制备工艺
CN103367285A (zh) * 2013-07-26 2013-10-23 中国科学院微电子研究所 一种通孔结构及其制作方法
CN103890940A (zh) * 2011-10-28 2014-06-25 英特尔公司 包括结合使用双镶嵌型方案制造的微细间距背侧金属再分布线的穿硅过孔的3d互连结构
CN104600059A (zh) * 2015-02-03 2015-05-06 华进半导体封装先导技术研发中心有限公司 一种带有ipd的tsv孔结构及其加工方法

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20070069376A1 (en) * 2005-09-29 2007-03-29 Infineon Technologies Ag Component with chip through-contacts
CN102376689A (zh) * 2011-09-09 2012-03-14 华中科技大学 具有台阶的硅通孔结构及其制备工艺
CN103890940A (zh) * 2011-10-28 2014-06-25 英特尔公司 包括结合使用双镶嵌型方案制造的微细间距背侧金属再分布线的穿硅过孔的3d互连结构
CN103367285A (zh) * 2013-07-26 2013-10-23 中国科学院微电子研究所 一种通孔结构及其制作方法
CN104600059A (zh) * 2015-02-03 2015-05-06 华进半导体封装先导技术研发中心有限公司 一种带有ipd的tsv孔结构及其加工方法

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN110797299A (zh) * 2019-09-30 2020-02-14 福建省福联集成电路有限公司 一种通孔结构及其制作方法
CN111599749A (zh) * 2020-06-01 2020-08-28 联合微电子中心有限责任公司 一种高深宽比对通型tsv结构及其制备方法和硅转接板
CN111599749B (zh) * 2020-06-01 2022-06-24 联合微电子中心有限责任公司 一种高深宽比对通型tsv结构及其制备方法和硅转接板
CN113161289A (zh) * 2021-04-22 2021-07-23 浙江集迈科微电子有限公司 一种高深宽比tsv金属柱的电镀工艺
CN113782489A (zh) * 2021-08-27 2021-12-10 上海华虹宏力半导体制造有限公司 硅通孔及其形成方法
CN115172272A (zh) * 2022-07-29 2022-10-11 武汉新芯集成电路制造有限公司 高深宽比tsv电联通结构及其制造方法

Similar Documents

Publication Publication Date Title
US7985620B2 (en) Method of fabricating via first plus via last IC interconnect
CN103367285B (zh) 一种通孔结构及其制作方法
CN106057757A (zh) 一种硅通孔结构及其制作方法
CN101483150B (zh) 一种加工硅通孔互连结构的工艺方法
CN101483149B (zh) 一种硅通孔互连结构的制备方法
CN102468279B (zh) 集成电路装置及其制造方法
CN102364671B (zh) 制造硅通孔的方法
CN104008998B (zh) 多芯片层叠封装方法
CN102104009B (zh) 一种三维硅基电容器的制作方法
CN103219303B (zh) 一种tsv背面漏孔的封装结构及方法
CN102376641B (zh) 铜填充硅通孔的制作方法
CN103474417B (zh) 一种三维互连结构及其制备方法
CN102760710A (zh) 硅穿孔结构及其形成方法
CN101866908A (zh) 一种用硅通孔互连形成的电感环
US20190229039A1 (en) Semiconductor devices having conductive vias and methods of forming the same
CN206210778U (zh) 一种硅通孔结构
CN103227158B (zh) 信号线tsv和地线tsv工艺集成的结构及方法
CN102376642A (zh) 一种硅通孔工艺
CN112331617A (zh) 一种埋入式键合工艺三维集成方法
CN105405821A (zh) 一种晶圆级tsv封装结构及封装工艺
CN104637861A (zh) 硅通孔工艺方法
CN104183571B (zh) 直通硅晶穿孔及其制作工艺
CN105493277A (zh) 穿透硅通孔的制造方法
CN104576507B (zh) 基于硅通孔技术的三维封装方法
CN103378030A (zh) 硅通孔结构

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
WD01 Invention patent application deemed withdrawn after publication
WD01 Invention patent application deemed withdrawn after publication

Application publication date: 20161026