CN105047549A - 利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法 - Google Patents
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- 229910052751 metal Inorganic materials 0.000 title claims abstract description 46
- 239000002184 metal Substances 0.000 title claims abstract description 46
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 title claims abstract description 44
- 229910052710 silicon Inorganic materials 0.000 title claims abstract description 44
- 239000010703 silicon Substances 0.000 title claims abstract description 44
- 238000000034 method Methods 0.000 title claims abstract description 31
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 claims abstract description 17
- 239000000463 material Substances 0.000 claims abstract description 13
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 claims abstract description 12
- 238000000137 annealing Methods 0.000 claims abstract description 9
- 229910052581 Si3N4 Inorganic materials 0.000 claims abstract description 8
- 230000004888 barrier function Effects 0.000 claims abstract description 8
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims abstract description 8
- 229910021332 silicide Inorganic materials 0.000 claims abstract description 4
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 claims abstract description 4
- 229910021341 titanium silicide Inorganic materials 0.000 claims abstract description 4
- 229910021417 amorphous silicon Inorganic materials 0.000 claims description 3
- 238000011982 device technology Methods 0.000 claims description 3
- 239000000428 dust Substances 0.000 claims description 3
- CJNBYAVZURUTKZ-UHFFFAOYSA-N hafnium(IV) oxide Inorganic materials O=[Hf]=O CJNBYAVZURUTKZ-UHFFFAOYSA-N 0.000 claims description 3
- 238000000151 deposition Methods 0.000 abstract 3
- 238000009792 diffusion process Methods 0.000 description 8
- UMVBXBACMIOFDO-UHFFFAOYSA-N [N].[Si] Chemical compound [N].[Si] UMVBXBACMIOFDO-UHFFFAOYSA-N 0.000 description 5
- 229910004200 TaSiN Inorganic materials 0.000 description 3
- 229910008482 TiSiN Inorganic materials 0.000 description 3
- QRXWMOHMRWLFEY-UHFFFAOYSA-N isoniazide Chemical compound NNC(=O)C1=CC=NC=C1 QRXWMOHMRWLFEY-UHFFFAOYSA-N 0.000 description 3
- 230000004048 modification Effects 0.000 description 3
- 238000012986 modification Methods 0.000 description 3
- 239000004065 semiconductor Substances 0.000 description 2
- 239000013078 crystal Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 229910000765 intermetallic Inorganic materials 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42364—Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the insulating layer, e.g. thickness or uniformity
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/401—Multistep manufacturing processes
Abstract
本发明提供了一种利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,包括:在晶圆上形成氮化硅层,并且在氮化硅层中形成凹槽,而且在凹槽的底部形成内层,并且在内层表面以及凹槽侧壁上依次沉积高k材料介电层和氮化钛层;在所述氮化钛层上淀积冗余硅层;在所述冗余硅层上淀积氮化钽阻挡层;执行退火,以使得所述冗余硅层分别与所述氮化钛层和所述氮化钽阻挡层融合而分别形成氮硅化钛层和氮硅化钽层。
Description
技术领域
本发明涉及半导体制造领域,更具体地说,本发明涉及一种利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法。
背景技术
在高K(高介电常数)金属栅半导体工艺中,由于金属栅各层金属化合物最终晶向形成的不确定性,造成了功函数的不确定性,最终使得器件的阈值电压存在着很大的波动性。
目前,有许多工艺都在尝试降低这种器件的波动性,金属栅层间的冗余硅技术便是其中之一,但是这类应用并不成熟,方法也不够优化。
发明内容
本发明所要解决的技术问题是针对现有技术中存在上述缺陷,提供一种降低高k金属栅器件阈值电压波动的方法,其利用冗余硅的淀积和扩散,与其上下层的栅极金属分别形成氮硅化合物,从而获得良好的材料性能以抑制功函数的波动和阻挡后续上层金属原子的向下扩散,最终降低金属栅器件的阈值电压波动性和不确定性。
为了实现上述技术目的,根据本发明,提供了一种利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,包括:第一步骤:在晶圆上形成氮化硅层,并且在氮化硅层中形成凹槽,而且在凹槽的底部形成内层,并且在内层表面以及凹槽侧壁上依次沉积高k材料介电层和氮化钛层;第二步骤:在所述氮化钛层上淀积冗余硅层;第三步骤:在所述冗余硅层上淀积氮化钽阻挡层;第四步骤:执行退火,以使得所述冗余硅层分别与所述氮化钛层和所述氮化钽阻挡层融合而分别形成氮硅化钛层和氮硅化钽层。
优选地,在高k金属栅器件工艺中执行所述利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法。
优选地,所述利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法还包括:淀积P型金属栅并最终形成P型金属栅极。
优选地,所述冗余硅层的厚度为5-50埃。
优选地,在第四步骤中,退火温度为50-1250摄氏度。
优选地,在第四步骤中,退火时间为0.1-1000秒。
优选地,所述高k材料介电层的材料为HfO2。
优选地,所述冗余硅层的材料为无定形硅。
在本发明中,提供一种降低高k金属栅器件阈值电压波动的方法,其利用冗余硅的淀积和扩散,与其上下层的栅极金属分别形成氮硅化合物TaSiN和TiSiN,这两种氮硅化合物因其无定形性,本身具有较小的功函数波动,且可以阻挡后续上层金属原子的向下扩散,最终降低金属栅器件的阈值电压波动性和不确定性。由此,本发明能够获得良好的材料性能以抑制功函数的波动和阻挡后续上层金属原子的向下扩散,最终降低金属栅器件的阈值电压波动性和不确定性。
附图说明
结合附图,并通过参考下面的详细描述,将会更容易地对本发明有更完整的理解并且更容易地理解其伴随的优点和特征,其中:
图1示意性地示出了根据本发明优选实施例的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法的第一步骤。
图2示意性地示出了根据本发明优选实施例的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法的第二步骤。
图3示意性地示出了根据本发明优选实施例的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法的第三步骤。
图4示意性地示出了根据本发明优选实施例的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法的第四步骤。
需要说明的是,附图用于说明本发明,而非限制本发明。注意,表示结构的附图可能并非按比例绘制。并且,附图中,相同或者类似的元件标有相同或者类似的标号。
具体实施方式
为了使本发明的内容更加清楚和易懂,下面结合具体实施例和附图对本发明的内容进行详细描述。
图1至图4示意性地示出了根据本发明优选实施例的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法的各个步骤。
如图1至图4所示,根据本发明优选实施例的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法包括在高k金属栅器件工艺中执行下述各个步骤:
第一步骤:在晶圆10上按照正常工艺流程至高k介电层上方的氮化钛(TiN)淀积完成;换言之,在晶圆10上形成氮化硅层20,并且在氮化硅层20中形成凹槽,而且在凹槽的底部形成内层11,并且在内层11表面以及凹槽侧壁上依次沉积高k材料介电层30和氮化钛层40;优选地,所述高k材料介电层30的材料为HfO2。
第二步骤:在所述氮化钛层40上淀积冗余硅层50;优选地,所述冗余硅层50的材料为无定形硅。优选地,所述冗余硅层50的厚度为5-50埃。
第三步骤:在所述冗余硅层50上淀积氮化钽阻挡层60;
第四步骤:充分退火,以使得所述冗余硅层50分别与所述氮化钛层40和所述氮化钽阻挡层60融合而分别形成氮硅化钛(TiSiN)层70和氮硅化钽(TaSiN)层80。优选地,在第四步骤中,退火温度为50-1250摄氏度(℃),退火时间为0.1-1000秒(s)。
随后,即可执行后续的工艺,例如P型金属栅淀积以及后续正常金属栅工艺以形成P型金属栅极。
在本发明中,提供一种降低高k金属栅器件阈值电压波动的方法,其利用冗余硅的淀积和扩散,与其上下层的栅极金属分别形成氮硅化合物TaSiN和TiSiN,这两种氮硅化合物因其无定形性,本身具有较小的功函数波动,且可以阻挡后续上层金属原子的向下扩散,最终降低金属栅器件的阈值电压波动性和不确定性。由此,本发明能够获得良好的材料性能以抑制功函数的波动和阻挡后续上层金属原子的向下扩散,最终降低金属栅器件的阈值电压波动性和不确定性。
此外,需要说明的是,除非特别说明或者指出,否则说明书中的术语“第一”、“第二”、“第三”等描述仅仅用于区分说明书中的各个组件、元素、步骤等,而不是用于表示各个组件、元素、步骤之间的逻辑关系或者顺序关系等。
可以理解的是,虽然本发明已以较佳实施例披露如上,然而上述实施例并非用以限定本发明。对于任何熟悉本领域的技术人员而言,在不脱离本发明技术方案范围情况下,都可利用上述揭示的技术内容对本发明技术方案作出许多可能的变动和修饰,或修改为等同变化的等效实施例。因此,凡是未脱离本发明技术方案的内容,依据本发明的技术实质对以上实施例所做的任何简单修改、等同变化及修饰,均仍属于本发明技术方案保护的范围内。
Claims (8)
1.一种利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于包括:
第一步骤:在晶圆上形成氮化硅层,并且在氮化硅层中形成凹槽,而且在凹槽的底部形成内层,并且在内层表面以及凹槽侧壁上依次沉积高k材料介电层和氮化钛层;
第二步骤:在所述氮化钛层上淀积冗余硅层;
第三步骤:在所述冗余硅层上淀积氮化钽阻挡层;
第四步骤:执行退火,以使得所述冗余硅层分别与所述氮化钛层和所述氮化钽阻挡层融合而分别形成氮硅化钛层和氮硅化钽层。
2.根据权利要求1所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于,在高k金属栅器件工艺中执行所述利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法。
3.根据权利要求1或2所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于还包括:淀积P型金属栅并最终形成P型金属栅极。
4.根据权利要求1或2所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于,所述冗余硅层的厚度为5-50埃。
5.根据权利要求1或2所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于,在第四步骤中,退火温度为50-1250摄氏度。
6.根据权利要求1或2所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于,在第四步骤中,退火时间为0.1-1000秒。
7.根据权利要求1或2所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于,所述高k材料介电层的材料为HfO2。
8.根据权利要求1或2所述的利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法,其特征在于,所述冗余硅层的材料为无定形硅。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201510375660.2A CN105047549B (zh) | 2015-06-30 | 2015-06-30 | 利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201510375660.2A CN105047549B (zh) | 2015-06-30 | 2015-06-30 | 利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN105047549A true CN105047549A (zh) | 2015-11-11 |
CN105047549B CN105047549B (zh) | 2018-08-24 |
Family
ID=54453997
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201510375660.2A Active CN105047549B (zh) | 2015-06-30 | 2015-06-30 | 利用冗余硅工艺降低高k金属栅器件阈值电压波动的方法 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN105047549B (zh) |
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C06 | Publication | ||
PB01 | Publication | ||
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GR01 | Patent grant |