CN104036713A - 显示器驱动集成电路和图像显示系统 - Google Patents

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Abstract

一种显示器驱动集成电路包括帧缓冲器、输出选择器和时间控制器。输出选择器选择性地输出从帧缓冲器读取的图像数据和从显示器驱动集成电路外部的源发送的图像数据其中之一。时间控制器在自刷新模式下控制将从所述帧缓冲器读取的图像数据输出到显示面板，以及当所述显示器驱动集成电路退出自刷新模式时控制内部显示时间跟踪外部显示时间，以便当内部显示时间与外部显示时间同步时控制所述输出选择器将从所述源发送的图像数据输出到显示面板。

Description

显示器驱动集成电路和图像显示系统
相关申请的交叉引用
本申请要求于2013年3月7日在韩国知识产权局（KIPO）提交的韩国专利申请No.10-2013-0024236的优先权，其公开通过引用全部并入此处。
技术领域
本发明构思的示范性实施例通常涉及显示器驱动集成电路（在下文中，称作“显示器驱动IC”）和图像显示系统，并且更加具体来说，涉及能够控制自刷新显示器的显示器驱动IC和图像显示系统。
背景技术
智能电话可以包括高清显示器，高清显示器通过显示器驱动IC从主机接收图像信号以显示图像信号。但是，当显示器从主机接收静止图像时，会不必要地消耗电力。
面板自刷新（PSR）技术可以用于使用安装在显示器中的存储器在最小化功耗的同时显示图像，由此显著增加便携式环境下电池的可使用时间。
但是，当使用PSR技术显示图像时可能发生屏幕闪烁。而且，屏幕闪烁可能使显示图像的质量变差。
发明内容
本发明构思的至少一个示范性实施例提供一种能够通过响应于输入图像的时间控制帧速率来防止屏幕闪烁的显示器驱动IC和图像显示系统。
本发明构思的至少一个示范性实施例提供一种能够提高图像显示质量的显示器驱动IC和图像显示系统。
根据本发明构思的示范性实施例，一种显示器驱动集成电路包括帧缓冲器、输出选择器和时间控制器。输出选择器选择性地输出从帧缓冲器读取的图像数据和从显示器驱动集成电路外部的源发送的图像数据其中之一。所述时间控制器在自刷新模式下控制将从所述帧缓冲器读取的图像数据输出到显示面板；以及当所述显示器驱动集成电路退出自刷新模式时控制内部显示时间跟踪外部显示时间，以便当内部显示时间与外部显示时间同步时控制所述输出选择器输出从所述源发送的图像数据到显示面板。
在一个示范性实施例中，所述时间控制器在所述外部显示时间与所述内部显示时间之间的第一时间差小于第一阈值时通过将所述内部显示时间的垂直空白间隔延长第一时间差，来在所述外部显示时间与所述内部显示时间同步的状态下控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及当所述外部显示时间与所述内部显示时间之间的第二时间差等于或者大于第一阈值时，所述时间控制器通过响应于第二时间差增加和降低所述帧缓冲器的帧读取速率二者之一以跟踪从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据帧帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
当第二时间差等于或者大于第一阈值且小于第二阈值时，所述时间控制器可以通过将所述帧缓冲器的帧读取速率降低到低于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及当第二时间差等于或者大于第二阈值时，所述时间控制器可以通过将所述帧缓冲器的帧读取速率增加为大于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
第一阈值可以是当垂直空白间隔被延长时被允许用于一个帧间隔的最大垂直空白间隔。
第二阈值可以是当垂直空白间隔被延长以将帧读取速率降低为低于从所述源发送的图像数据的帧传输速率时获得的最大垂直空白间隔被设置为闪烁间隔的情况下的间隔。
根据本发明构思的示范性实施例，一种图像显示系统包括图像显示设备和主机。主机在所述图像显示设备显示静止图像时控制所述图像显示设备在自刷新模式下运行。所述图像显示设备包括显示面板和显示器驱动集成电路。所述显示面板显示图像。显示器驱动集成电路在自刷新模式下利用内部显示时间显示静止图像在所述显示面板上；以及当所述图像显示设备从自刷新模式退出时，通过控制内部显示时间跟踪图像数据的显示时间，根据从所述主机发送的图像数据驱动所述显示面板以使得内部显示时间与从所述主机发送的图像数据的显示时间同步。
在示范性实施例中，一种显示器驱动集成电路包括帧缓冲器、输出选择器和时间控制器。输出选择器可以选择性地输出从帧缓冲器读取的图像数据和从显示器驱动集成电路外部的源发送的图像数据其中之一。所述时间控制器可以在自刷新模式下可以将从所述帧缓冲器读取的图像数据输出到显示面板；以及当所述显示器驱动集成电路退出自刷新模式时控制内部显示时间跟踪外部显示时间，以便当内部显示时间与外部显示时间同步时控制所述输出选择器输出从所述源发送的图像数据到显示面板。
所述时间控制器可以在所述外部显示时间与所述内部显示时间之间的第一时间差小于第一阈值时通过将所述内部显示时间的垂直空白间隔延长第一时间差，来在所述外部显示时间与所述内部显示时间同步的状态下控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及当所述外部显示时间与所述内部显示时间之间的第二时间差等于或者大于第一阈值时，所述时间控制器可以通过响应于第二时间差增加和降低所述帧缓冲器的帧读取速率二者之一以跟踪从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
当第二时间差等于或者大于第一阈值且小于第二阈值时，所述时间控制器可以通过将所述帧缓冲器的帧读取速率降低到低于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及当第二时间差等于或者大于第二阈值时，所述时间控制器可以通过将所述帧缓冲器的帧读取速率增加为大于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
第一阈值可以是当垂直空白间隔被延长时被允许用于一个帧间隔的最大垂直空白间隔。
第二阈值可以是当垂直空白间隔被延长以将帧比读取率降低为低于从所述源发送的图像数据的帧传输速率时获得的最大垂直空白间隔被设置为闪烁间隔的情况下的间隔。
所述主机可以通过显示器端口接口或者嵌入式显示器端口接口连接到所述显示器驱动集成电路。
根据本发明构思的示范性实施例，一种显示器驱动集成电路包括控制器和帧缓冲器。所述控制器被配置为接收外部图像数据以及基于接收到的图像数据确定时间。所述帧缓冲器被配置为接收所述外部图像数据。所述控制器被配置为基于所确定时间执行以下其中之一：i)将外部图像数据转发到显示面板，或者ii）将外部图像数据存储在所述帧缓冲器中、从所述帧缓冲器读取图像数据以及将读取如果图像数据转发到所述显示面板。
在示范性实施例中，所述控制器通过将接收到图像数据与所转发的图像数据相比较确定差，来确定所述时间。在示范性实施例中，当所述差小于第一阈值时，所述控制器将所述外部图像数据转发到所述显示面板，以及否则，将所述外部图像数据存储在所述帧缓冲器中，从所述帧缓冲器读取图像数据，以及将所读取的图像数据转发到所述显示面板。在示范性实施例中，当所述差大于第一阈值且小于第二阈值时，所述控制器以高于接收外部图像数据的速率的速率从所述帧缓冲器读取图像数据。在示范性实施例中，当所述差大于第二阈值且小于第三阈值时，所述控制器以低于接收外部图像数据的速率的速率从所述帧缓冲器读取图像数据。在示范性实施例中，所述显示器驱动集成电路还包括多路复用器，其被配置为接收所述外部图像数据以及所述帧缓冲器的输出，并且基于所述时间受控制信号控制。在示范性实施例中，所述控制器在退出自刷新模式时仅执行所述存储、读取和转发。
附图说明
从以下结合附图的详细说明中将更加清楚地理解本发明构思的示范性实施例。
图1是示出根据发明构思的示范性实施例的图像显示系统的框图。
图2是示出根据发明构思的实施例的、图1中示出的控制器的框图。
图3是当图像显示系统退出自刷新模式时在再同步（resynchronization）过程期间屏幕闪烁的图。
图4是示出根据本发明构思的示范性实施例的帧同步控制的阈值的图。
图5是示出根据本发明构思的实施例控制由时间控制器执行的再同步的方法的流程图。
图6是示出内部显示时间与外部显示时间之间的时间差小于第一阈值的示例的图。
图7是示出内部显示时间与外部显示时间之间的时间差在第一阈值与第二阈值之间的示例的图。
图8是示出内部显示时间与外部显示时间之间的时间差等于或者大于第二阈值的示例的图。
具体实施方式
将参考附图更加充分地描述本发明构思，附图中示出本发明构思的示范性实施例。然而，本发明构思可以以许多不同形式具体实现而且不应当将本发明构思释为限制为这里阐述的实施例。贯穿本申请，相同参考标记指代同样的元素。
应当理解，当元件称为是"连接"或者"耦接"到另一元件时，其可以直接连接或者耦接到另一个元件或者可以存在居间元件。如这里所使用的那样，单数形式“一”、“一个”和“该”是用来也包括复数形式，除非上下文清楚地表示不是如此。
图1是示出根据发明构思的示范性实施例的图像显示系统的框图。
参考图1，根据本发明构思的示范性实施例的图像显示系统包括同步单元100和源单元200。
例如，同步单元100可以包括用于接收和显示图像数据的图像显示设备，诸如计算机监视器、液晶显示器、有机发光二极管（OLED）显示器、等离子体显示面板（PDP）或者电视（TV）。源单元200包括能够发送图像数据的主机，诸如个人计算机（PC）主体、计算机、微处理器和微计算机。
为了降低在静止图像显示状态下的功耗，主机200可以指示图像显示设备100执行面板自刷新（PSR）操作，以使得图像显示设备100存储图像并且重复地显示所存储的图像，或者运行驱动器以切断到图形子系统的组件的电源或者切断到图像显示设备100的组件的电源。主机200可以使用通过接口发送的扩展分组发送命令到图像显示设备100，以允许图像显示设备100存储图像和切断到组件的电源。
主机200的接口协议分组单元可以取决于ANSI/TIA/EIA-644-A（2001）或者低电压差分信号（LVDS）可用的显示端口或者LVDS。主机200的显示接口可以包括显示端口（DP）或者LVDS兼容接口以及并入串出（parallel-in-serial-out，PISO）接口。
DP接口可以由视频电子标准联合（VESA）发布以采用通过集成LVDS——其是内部接口标准——和数字视觉接口（Digital Visual Interface，DVI）——其是外部连接标准——而来的接口方案DP接口指的是数字方案中能够使能芯片之间的内部连接和产品之间的外部连接的技术因为两个接口被组合为一个，所以可以扩展数据带宽以使得可以提供较高颜色深度和较高清晰度。
举例来说，DP接口的带宽最大值可以是10.8Gbps，该值至少比现有的DVI的带宽（例如，最大值4.95Gbps）大两倍。DP接口同时可以利用支持使用微分组架构的多流，通过一个连接器传输最大6个1080i数据流（三个1080p数据流）。
视频电子标准联合（VESA）提供嵌入式显示端口（'eDP'）标准eDP标准是相应于设计用于装备有诸如膝上型计算机、平板PC、上网本和一体化台式计算机这样的显示器的设备的DP接口的接口标准。例如，eDP v1.3包括PSR技术。
PSR技术可以提高系统中省电功能，并且延长便携式PC环境下电池的使用寿命。PSR技术可以使用安装在显示器中的存储器在最小化功耗的同时显示图像，由此显著增加在便携式PC环境下电池的可使用时间。
图像显示设备100包括显示器控制单元110和显示单元120。显示器控制单元110可以包括eDP接收机。图像显示设备100可以通过eDP接口与主机200通信。显示单元120包括显示面板122、数据驱动电路124和扫描驱动电路126。
主机200可以通过eDP发射机将图像数据发送给包括在图像显示设备100中的显示器控制单元110。显示器控制单元110可以通过eDP接收机接收图像数据并且提供图像数据给显示单元120。而且，显示器控制单元110生成用于控制包括在显示单元120中的数据驱动电路124和扫描驱动电路126的操作时间的时间控制信号。用于在显示控制单元110与数据驱动电路124之间发送数据的接口可以实现为微型LVDS接口，但是示范性实施例不限制于此。显示器控制单元110可以配置为显示器驱动IC。
显示面板122包括多个数据线和扫描线（或者栅极线）。在显示面板122中，数据线与扫描线（或者栅极线）相交。显示面板122包括以由数据线和扫描线定义的矩阵的形式对准的像素。薄膜晶体管（TFT）可以形成在数据线和扫描线的交叉处。显示面板22可以实现为诸如液晶显示器（LCD）、场发射显示器（FED）、等离子体显示面板（PDP）、包括无机电致发光器件、有机发光二极管（OLED）电泳显示器件（EPD）的有机电致发光器件（EL）这样的平面板显示器的显示面板。当显示面板122实现为LCD的显示面板时，需要背光单元。背光单元可以包括直下型背光单元（direct type backlightunit）或者边缘型背光单元（edge type backlight unit）。
数据驱动电路124在显示器控制单元110的控制下锁存数字图像数据。数据驱动电路124将数字图像数据变换为数据电压以将数据电压输出到数据线。扫描驱动电路126在控制器110的控制下按顺序将与数据电压同步的扫描脉冲供应给扫描线。
图2是示出根据本发明构思的示范性实施例的、在图1中示出的显示器控制单元110的框图。
参考图2，显示器控制单元110包括安装在板上的显示器驱动集成电路（DDI）和外围电路组件。在这里显示器控制单元110将称作DDI110。
DDI110包括时间控制器112、帧缓冲器114、写电路116、读电路118和输出选择器119。
DDI110具有响应于来自主机200的命令以进入自刷新模式的性能，包括切断到组件的电源或者存储图像以将所存储的图像重复输出到显示单元。时间控制器112激活写电路116和帧缓冲器114以响应于来自主机200的信号SRM存储图像数据帧，以及激活读电路118以读取所存储的图像数据帧。在示范性实施例中，写电路116和帧缓冲器114的激活指的是向写电路116和帧缓冲器114提供足以对各个设备供电的电力。时间控制器112通过控制信号SEL控制输出选择器119，例如多路复用器（MUX），以使得静止图像数据被传输到输出端口。而且，时间控制器112输出将静止图像数据同步的同步信号Sync。
如果检测到静止图像显示状态，则主机200执行用于PSR驱动的预备检查过程。也就是说，主机200读取包括在时间控制器112中的“沉PSR性能（sink PSR Capability）显示器端口结构数据（DPCD）寄存器”以确定PSR性能。指示时间控制器112的PSR性能的信息被记录在"沉PSR性能DPCD寄存器"中。时间控制器112根据主机200的请求返回“沉PSR性能”信息到主机200。
在确认了"沉PSR性能"信息之后，主机200更新包括在时间控制器112中的"沉PSR结构DPCD寄存器"以设置诸如"PSR激活下的源发射机状态"、"PSR激活下的CRC验证"和"帧捕获指示"之类的状态。如果实现了所述更新，则时间控制器112发送"ACK"信号到主机200。
接下来，时间控制器112根据主机200的请求激活记录在"沉PSR结构DPCD寄存器"中的PSR功能，然后发送"ACK"信号到主机200。主机200发送静止图像数据到时间控制器112以使得静止图像数据被存储在远程帧缓冲器（例如，114）中。
在示范性实施例中，在帧缓冲器114存储图像数据帧之后，DDI110激活状态信号以通知主机200已经实现了图像数据的存储并且显示所存储的图像。
时间控制器112在SRM信号被禁止之后禁止帧缓冲器114和关联的逻辑，并且通过控制信号SEL控制输出选择器119——例如多路复用MUX，以使得多路复用器将从输入端口（在这种情况下，LVDS RX）输入的图像传送到输出端口LVDS TX。在示范性实施例中，禁止帧缓冲器114指的是运行帧缓冲器需要的电力被抑制或者切断。
当图像显示系统退出自刷新模式时，逻辑时钟被选通（gate）并且帧缓冲器114被关断（例如，禁止），因此DDI110可以使用少量电力。
在具有上述结构的系统中，因为主机200在自刷新模式操作期间没有识别图像显示设备100的帧同步，所以当图像显示系统从自刷新模式退出时，需要在主机200与图像显示设备100之间实现再同步。
图3是当图像显示系统存在自刷新模式时在再同步（resynchronization）过程期间屏幕闪烁的图。
在图3中，参考标记PSR表示面板自刷新间隔，参考标记Resync.表示当图像显示系统退出自刷新模式时系统与输入帧同步的时间间隔，参考标记Live表示从主机200发送的输入帧显示在面板中而不使用帧缓冲器的间隔。
如果当图像显示系统退出自刷新模式时垂直空白间隔（VBI）如图3中所示增加以用于DDI110与主机200之间的帧同步，则发生屏幕闪烁。在示范性实施例中，VBI是连续图像数据帧之间的时间段，其中不存在图像数据。
尽管根据显示面板120的物理属性确定闪烁发生的VBI的长度，但是如果帧同步如图3中所示匹配，则存在对选择可用显示面板120的限制。
因此，本发明构思的至少一个示范性实施例提供一种当主机200不知道图像显示设备100的同步时间时使图像显示设备100同步时间自己匹配的方法，该方法可以显示图像而没有屏幕闪烁。
图4是示出根据本发明构思的示范性实施例的用于控制帧同步的阈值的图。
参考图4，从帧缓冲器114读取的图像信号的第一帧间隔包括区域A、区域B和区域C，它们被第一阈值402和第二阈值404划分。例如，区域的边界可以由阈值定义。
第一阈值402是当延长VBI时被允许用于一个帧间隔的最大VBI。也就是说，第一阈值402用来确定时间差是否小到在不使用存储器（例如，帧缓冲器114）的情况下可以再同步。因此，当时间差大于第一阈值402时，需要使用存储器来防止闪烁。
第二阈值404是当VBI被延长以将帧速率降低为低于从外部提供的图像数据的帧速率时获得的最大VBI被设置为闪烁间隔的情况下的间隔。也就是说，第二阈值404用来确定帧速率需要被设置得高于还是低于当使用存储器时输入的帧速率。也就是说，第二阈值404用来设置当VBI延至低于用于再同步的帧速率时能够防止闪烁的范围。
当时间差变为大于第二阈值404时，帧速率被设置为大于输入的帧速率以通过缩短空白间隔实现再同步。
此外，确定从主机200发送的输入帧的显示时间位于三个区域A-C当中的位置，以便通过根据所发送的输入帧的时间调整速率来控制再同步，以使得可以显示图像而没有屏幕闪烁。
时间控制器112可以发送第一信号S1到写电路116，发送第二信号S2到读电路118。第一信号S1可以用于激活和禁止写电路116，第二信号S2可以用于激活和禁止读电路118。时间控制器112可以通过控制激活写电路116和读电路118来调整帧缓冲器114的帧读取速率。
图5是示出根据本发明构思的实施例控制由时间控制器112执行的再同步的方法的流程图。图6是示出内部显示时间与外部显示时间之间的时间差小于第一阈值402的示例的图，图7是示出内部显示时间与外部显示时间之间的时间差在第一阈值402和第二阈值404之间的示例的图，图8是示出内部显示时间和外部显示时间之间的时间差等于或者大于第二阈值404的示例的图。
参考图5，时间控制器112响应于SRM信号激活控制信号以控制MUX119选择从帧缓冲器114输出的图像数据。而且，时间控制器112重复地从帧缓冲器114读取存储的静止图像，以及将读取的静止图像显示在显示面板120上（S102）。时间控制器112检查在自刷新模式操作期间是否从主机200发送了激活的帧数据（S104）。在示范性实施例中，激活的帧数据表示移动或者改变图像。例如，当第一帧的图像数据与第二帧的图像数据相差大于阈值量时，其可以被解释为激活的帧数据或者运动图像数据。当在步骤S104中发送了激活的帧数据时，时间控制器112将输出帧的显示时间与输入帧的显示时间相比较（S106）。根据图4中所示的情况，时间控制器112计算内部显示时间与外部显示时间之间的时间差，并且确定时间差位于三个区域A、B、C当中的位置。
也就是说，如图6中所示，当输出帧的显示时间602与输入帧的显示时间604之间的第一时间差606小于第一阈值402时，确定第一时间差606包括在区域A中。
也就是说，如图7中所示，当输出帧的显示时间702与输入帧的显示时间704之间的第二时间差707在第一阈值402和第二阈值404之间时，确定第二时间差706包括在区域B中。
也就是说，如图8中所示，当输出帧的显示时间802与输入帧的显示时间804之间的第三时间差806等于或者大于第二阈值404时，确定第三时间差806包括在区域C中。
当时间差小于阈值402时，也就是说，当时间差包括在区域A中时（见图6），时间控制器112输出存储在帧缓冲器中的电流帧数据到帧缓冲器114而不将输入图像数据存储在帧缓冲器114中，并且延长空白间隔以控制再同步（S110）。如果通过步骤S110实现了再同步（S112），则时间控制器112在再同步时间608禁止控制信号SEL以控制MUX119选择从主机提供的图像数据。因此，在再同步过程期间丢失一帧的状态下从主机提供的图像数据显示在显示面板120上（S122）。
当时间差在第一阈值402与第二阈值404之间时，也就是说，当时间差包括在区域B中时（见图7），时间控制器112将输入图像数据存储在帧缓冲器114中，并且以低于输入帧速率的速率，也就是说，以长的VBI，从帧缓冲器114读取所存储的图像数据（S114）。通过上述过程，时间控制器112在再同步时间708执行再同步（S116），并且禁止控制信号SEL以控制MUX119选择从主机200发送的图像数据。因此，从主机发送的图像数据显示在显示面板120上（S122）。
当时间差806等于或者大于第二阈值404时，也就是说，当时间差806包括在区域C中时（见图8），时间控制器112将输入图像数据存储在帧缓冲器114中，并且以高于输入帧速率的速率，也就是说，以短的空白间隔，从帧缓冲器114读取所存储的图像数据（S118）。通过上述过程，时间控制器112在再同步时间808执行再同步（S116）并且禁止控制信号SEL以控制MUX119选择从主机200发送的图像数据。因此，从主机发送的图像数据显示在显示面板120上（S122）。
尽管已经在图2示出DDI110为具有特定逻辑电路布局，但是本发明构思不限制于此。
本发明构思的至少一个实施例可以具体实现为在计算机可读介质上的、具有计算机可运行指令的计算机可读代码。例如，图5的操作可以具体实现计算机可运行指令。计算机可读记录介质是可以存储数据为程序的任意数据存储设备，这些程序今后可以由计算机系统读取计算机可读记录介质的例子包括只读存储器（ROM）、随机存取存储器（RAM）、CD-ROM、磁带、软盘以及光数据存储器件等等。
前述是本发明构思的说明并且将不理解为对其的限制。尽管已经描述了本发明构思的少数示范性实施例，但是在示范性实施例中许多修改是可能的而不在实质上脱离本发明构思。因此，所有这些修改将包括在本发明构思的范围内。

Claims (20)

1.一种显示器驱动集成电路，包括：
帧缓冲器；
输出选择器，被配置为选择性地输出从所述帧缓冲器读取的图像数据和从所述显示器驱动集成电路外部的源发送的图像数据其中之一；以及
时间控制器，被配置为在自刷新模式下控制将从所述帧缓冲器读取的图像数据输出到显示面板，以及当所述显示器驱动集成电路退出自刷新模式时控制内部显示时间跟踪外部显示时间，以便当内部显示时间与外部显示时间同步时控制所述输出选择器将从所述源发送的图像数据输出到显示面板。
2.如权利要求1所述的显示器驱动集成电路，其中，所述时间控制器在所述外部显示时间与所述内部显示时间之间的第一时间差小于第一阈值时通过将所述内部显示时间的垂直空白间隔延长第一时间差，来在所述外部显示时间与所述内部显示时间同步的状态下控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及
当所述外部显示时间与所述内部显示时间之间的第二时间差等于或者大于第一阈值时，所述时间控制器通过响应于第二时间差增加和降低所述帧缓冲器的帧读取速率二者之一以跟踪从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的读取图像数据帧的速率，即，帧读取速率与从所述源发送图像数据帧的速率，即，帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
3.如权利要求2所述的显示器驱动集成电路，其中，当第二时间差等于或者大于第一阈值且小于第二阈值时，所述时间控制器通过将所述帧缓冲器的帧读取速率降低到低于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及
当第二时间差等于或者大于第二阈值时，所述时间控制器通过将所述帧缓冲器的帧读取速率增加为大于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
4.如权利要求3所述的显示器驱动集成电路，其中，第一阈值是当垂直空白间隔被延长时被允许用于一个帧间隔的最大垂直空白间隔。
5.如权利要求3所述的显示器驱动集成电路，其中，第二阈值是当垂直空白间隔被延长以将帧读取速率降低为低于从所述源发送的图像数据的帧传输速率时获得的最大垂直空白间隔被设置为闪烁间隔的情况下的间隔。
6.一种图像显示系统，包括：
图像显示设备；以及
主机，被配置为当所述图像显示设备显示静止图像时控制所述图像显示设备在自刷新模式下运行，
其中所述图像显示设备包括：
显示面板，被配置为显示图像；以及
显示器驱动集成电路，被配置为在自刷新模式下利用内部显示时间显示静止图像在所述显示面板上，以及当所述图像显示设备从自刷新模式退出时，通过控制内部显示时间跟踪图像数据的显示时间，根据从所述主机发送的图像数据驱动所述显示面板以使得内部显示时间与从所述主机发送的图像数据的显示时间同步。
7.如权利要求6所述的图像显示系统，其中，所述显示器驱动集成电路包括：
帧缓冲器；
输出选择器，被配置为选择性地输出从所述帧缓冲器读取的图像数据和从所述显示器驱动集成电路外部的源发送的图像数据其中之一；以及
时间控制器，被配置为在自刷新模式下控制将从所述帧缓冲器读取的图像数据输出到显示面板，以及当所述显示器驱动集成电路退出自刷新模式时控制内部显示时间跟踪外部显示时间，以便当内部显示时间与外部显示时间同步时控制所述输出选择器将从所述源发送的图像数据输出到显示面板。
8.如权利要求7所述的图像显示系统，其中，所述时间控制器在所述外部显示时间与所述内部显示时间之间的第一时间差小于第一阈值时通过将所述内部显示时间的垂直空白间隔延长第一时间差，来在所述外部显示时间与所述内部显示时间同步的状态下控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板，以及
当所述外部显示时间与所述内部显示时间之间的第二时间差等于或者大于第一阈值时，所述时间控制器通过响应于第二时间差增加和降低所述帧缓冲器的帧读取速率二者之一以跟踪从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的读取图像数据帧的速率，即，帧读取速率与从所述源发送图像数据帧的速率，即，帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
9.如权利要求8所述的图像显示系统，其中，当第二时间差等于或者大于第一阈值且小于第二阈值时，所述时间控制器通过将所述帧缓冲器的帧读取速率降低到低于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板；以及
当第二时间差等于或者大于第二阈值时，所述时间控制器通过将所述帧缓冲器的帧读取速率增加为大于从所述源发送的图像数据的帧传输速率，在所述帧缓冲器的帧读取速率与从所述源发送的图像数据的帧传输速率同步的状态下，将从所述源发送的图像数据存储在所述帧缓冲器中，并且控制所述输出选择器将从所述源发送的图像数据输出到所述显示面板。
10.如权利要求9所述的图像显示系统，其中，第一阈值是当垂直空白间隔被延长时被允许用于一个帧间隔的最大垂直空白间隔。
11.如权利要求9所述的图像显示系统，其中，第二阈值是当垂直空白间隔被延长以将帧读取速率降低为低于从所述源发送的图像数据的帧传输速率时获得的最大垂直空白间隔被设置为闪烁间隔的情况下的间隔。
12.如权利要求6所述的图像显示系统，其中，所述主机通过显示器端口接口或者嵌入式显示器端口接口连接到所述显示器驱动集成电路。
13.一种显示器驱动集成电路，包括：
控制器，被配置为接收外部图像数据以及基于接收到的图像数据确定时间；以及
帧缓冲器，被配置为接收所述外部图像数据，
其中，所述控制器被配置为基于所确定的时间执行以下其中之一：i)将所述外部图像数据转发到显示面板，或者ii）将外部图像数据存储在所述帧缓冲器中、从所述帧缓冲器读取图像数据以及将读取的图像数据转发到所述显示面板。
14.如权利要求13所述的显示器驱动集成电路，其中，所述控制器通过将接收到图像数据与所转发的图像数据相比较确定差，来确定所述时间。
15.如权利要求14所述的显示器驱动集成电路，其中，当所述差小于第一阈值时，所述控制器将所述外部图像数据转发到所述显示面板，否则，将所述外部图像数据存储在所述帧缓冲器中、从所述帧缓冲器读取图像数据、以及将所读取的图像数据转发到所述显示面板。
16.如权利要求14所述的显示器驱动集成电路，其中，当所述差大于第一阈值且小于第二阈值时，所述控制器以高于接收外部图像数据的速率的速率从所述帧缓冲器读取图像数据。
17.如权利要求16所述的显示器驱动集成电路，其中，当所述差大于第二阈值且小于第三阈值时，所述控制器以低于接收外部图像数据的速率的速率从所述帧缓冲器读取图像数据。
18.如权利要求14所述的显示器驱动集成电路，其中，当确定所述帧缓冲器将要把所述外部图像数据转发到所述显示面板时，所述控制器禁止所述帧缓冲器。
19.如权利要求14所述的显示器驱动集成电路，还包括多路复用器，其接收所述外部图像数据以及所述帧缓冲器的输出，并且基于所述时间受控制信号控制。
20.如权利要求14所述的显示器驱动集成电路，其中，所述控制器在退出自刷新模式时仅执行所述存储、读取和转发。
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