CN103890831B - 驱动电路、驱动方法、显示单元和电子装置 - Google Patents

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Abstract

提供了一种用于通过线序扫描驱动多个像素电路的驱动器。对于属于一条水平线的多个像素电路，所述驱动器在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，第二准备时段在其他水平线的第一准备时段以外的定时结束，并且在随后的写入时段中执行亮度信息的写入。

Description

驱动电路、驱动方法、显示单元和电子装置
技术领域
本公开涉及驱动诸如有机EL的发光器件的驱动电路、驱动方法、包括这样的驱动电路的显示单元和电子装置。
背景技术
近年来，在执行图像显示的显示单元的领域中，已经开发和商业化这样的显示单元（有机EL显示单元），其使用发光亮度根据通过其中的电流值变化的电流驱动光学器件作为发光器件，例如有机EL（电致发光）器件。不同于诸如液晶器件的器件，有机EL器件是自发光器件，并且不需要为其提供光源（背光）。因此，与需要光源的液晶显示单元相比，有机EL显示单元具有诸如高图像可视性、低功耗和高器件响应速度的特性。
作为有机EL显示单元的驱动方案，存在简单的（无源）矩阵方案和有源矩阵方案，如同液晶显示单元。前者具有简单的结构，然而，具有诸如难以实现大的和高清晰度显示单元的困难。因此，当前，后者有源矩阵方案已经被积极地开发（例如，专利文献1等）。在该方案中，通过为每个像素安排的有机EL器件的电流通过为每个有机EL器件提供的像素电路中的晶体管控制。
引用列表
专利文献
专利文献1：日本未审专利申请公开No.2008-33193
发明内容
顺带提及，在显示单元中，诸如点缺陷（圆点缺陷（dot defect））和线缺陷的缺陷可能在制造时在一些情况下出现。诸如点缺陷和线缺陷的这样的缺陷对于用户通常可能是明显的。已经购买具有许多上述缺陷的显示单元的用户感觉不公平。因此，期望减少这样的缺陷。
相应地，期望提供一种驱动电路、驱动方法、显示单元和电子装置，其能够减少显示中的缺陷。
本技术实施例的一种驱动电路包括驱动部分，其通过线序扫描驱动多个像素电路。对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入。第二准备时段在其他水平线的第一准备时段以外的定时结束。
本公开实施例的一种驱动方法包括：在通过线序驱动来驱动多个像素电路时，对于属于一条水平线的多个像素电路，在第一准备时段中基于第一电压执行第一准备驱动；然后在第二准备时段中基于第一电压执行第二准备驱动，第二准备时段在其他水平线的第一准备时段以外的定时结束；以及在随后的写入时段中执行亮度信息的写入。
本公开实施例的一种显示单元包括多个像素电路以及通过线序扫描驱动所述多个像素电路的驱动部分。对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束。
本公开实施例的一种电子装置包括上述显示单元。其示例可以包括电视装置、数字相机、个人计算机、摄像机和诸如移动电话的移动终端装置。
在根据本公开的一些实施例的驱动电路、驱动方法、显示单元和电子装置中，在驱动多个像素电路时，对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入。此时，第二准备时段在其他水平线的第一准备时段以外的定时结束。
根据本公开的一些实施例的驱动电路、驱动方法、显示单元和电子装置，一条水平线的第二准备时段在其他水平线的第一准备时段以外的定时结束。因此，可能减少显示中的缺陷。
附图说明
图1是图示根据本发明第一实施例的显示单元的配置示例的框图。
图2是图示图1所示的每个像素的配置示例的电路图。
图3是图示图1所示的数据线驱动电路的主要部分的配置示例的框图。
图4是图示图1所示的显示单元的操作示例的定时波形图。
图5是图示图1所示的显示单元中的每行中的操作示例的示意图。
图6是图示缺陷像素的配置示例的电路图。
图7是图示当显示单元包括缺陷像素时显示单元的操作示例的示意图。
图8是图示在初始化时段和Vth校正时段中每个像素的状态的电路图。
图9是图示当显示单元包括缺陷像素时显示单元的操作示例的定时波形图。
图10是图示当显示单元包括缺陷像素时显示单元的操作示例的另一定时波形图。
图11是图示根据比较示例的显示单元的操作示例的示意图。
图12是图示根据比较示例的显示单元的操作示例的定时波形图。
图13是图示根据比较示例的显示单元的操作示例的另一定时波形图。
图14是图示根据比较示例的显示单元中的显示缺陷的说明图。
图15是图示根据比较示例的显示单元的操作示例的示意图。
图16是图示根据第一实施例的修改的显示单元的操作示例的示意图。
图17是图示根据第二实施例的显示单元的操作示例的示意图。
图18是图示根据第二实施例的修改的显示单元的操作示例的示意图。
图19是图示根据第二实施例的另一修改的显示单元的操作示例的示意图。
图20是图示根据第二实施例的另一修改的显示单元的操作示例的示意图。
图21是图示对其应用根据任一实施例的显示单元的电视装置的外观配置的透视图。
图22是图示根据修改的像素的配置示例的电路图。
具体实施方式
下面将参考附图详细描述本公开的一些实施例。要注意，将按照以下顺序给出描述。
1.第一实施例
2.第二实施例
3.应用示例
[1.第一实施例]
[配置示例]
图1图示根据第一实施例的显示单元的配置示例。显示单元1是使用有机EL器件的有源矩阵方案的显示单元。要注意，根据本公开实施例的驱动电路和驱动方法通过本实施例体现，因此将在此一起说明。该显示单元1包括显示面板10和驱动电路20。
显示面板10包括像素阵列部分13，并且通过有源矩阵驱动执行像素显示。在像素阵列部分13中，多个像素11按矩阵安排。这里，每个像素11由红色的像素11R、绿色的像素11G和蓝色的像素11B配置。要注意，以下，“像素11”适当地统指像素11R、像素11G和像素11B。
像素阵列部分13包括多个扫描线WSL、多个电源线DSL、和多个数据线DTL。多个扫描线WSL和多个电源线DSL在行方向上延伸。多个数据线DTL在列方向上延伸。这些扫描线WSL、电源线DSL和数据线DTL的每个的一端连接到驱动电路20。上述像素11的每个安排在扫描线WSL和数据线DTL的交叉点。
图2图示像素11的电路配置。像素11包括写入晶体管Tr1、驱动晶体管Tr2、有机EL器件12和电容器Cs和Csub。换句话说，在该示例中，像素11使用写入晶体管Tr1、驱动晶体管Tr2和电容器Cs配置，并且具有所谓的“2Tr1C”配置。
写入晶体管Tr1和驱动晶体管Tr2每个例如可以由n沟道MOS（金属氧化物半导体）类型的TFT（薄膜晶体管）配置。写入晶体管Tr1的栅极连接到扫描线WSL，其源极连接到数据线DTL，并且其漏极连接到驱动晶体管Tr2的栅极和电容器Cs的一端。驱动晶体管Tr2的栅极连接到写入晶体管Tr1的漏极和电容器Cs的一端，其漏极连接到电源线DSL，并且其源极连接到电容器Cs的另一端和有机EL器件12的阳极。要注意，TFT的类型不特别限定，并且例如可以是逆交错（inverse-staggered）结构（所谓的底部栅极类型）或交错结构（所谓的顶部栅极类型）。
电容器Cs的一端连接到驱动晶体管Tr2的栅极，并且其另一端连接到驱动晶体管Tr2的源极。有机EL器件12是发光器件，其发射对应于像素11R、11G和11B的每个的颜色的光。有机EL器件12的阳极连接到驱动晶体管Tr2的源极和电容器Cs的另一端，并且其阴极接地。电容器Csub的一端连接到有机EL器件12的阳极，并且其另一端接地。
驱动电路20基于从外部提供的图像信号Sdisp和同步信号Ssync驱动显示面板10。如图1所示，该驱动电路20包括图像信号处理电路21、定时生成电路22、扫描线驱动电路23、数据线驱动电路24和电源线驱动电路25。
图像信号处理电路21对从外部提供的数字图像信号Sdisp执行预定校正，并且输出校正的图像信号Sdisp2到数据线驱动电路24。该预定校正的示例可以包括伽马校正和过驱动校正。
定时生成电路22是这样的电路，其基于从外部输入的同步信号Ssync提供控制信号给扫描线驱动电路23、数据线驱动电路24和电源线驱动电路25的每个，并且执行控制以允许这些电路相互同步地操作。
扫描线驱动电路23根据从定时生成电路22提供的控制信号，顺序地施加扫描线信号WS到多个扫描线WSL，从而顺序地选择多个像素11。具体地，扫描线驱动电路23选择性地输出电压Von和电压Voff，从而生成上述扫描线信号WS。电压Von在写入晶体管Tr1设为导通（ON）状态时施加。电压Voff在写入晶体管设为截止（OFF）状态时施加。
数据线驱动电路24根据从定时生成电路22提供的控制信号，生成包括模拟图像信号（亮度信号）的数据线信号Sig，并且施加生成的数据线信号Sig到每条数据线DTL。
图3图示数据线驱动电路24的主要部分的配置示例。数据线驱动电路24包括D-A（数字-模拟）转换电路31、偏移电压生成部分32、开关部分33和开关控制电路34。
D-A转换电路31基于图像信号Sdisp2对数据信号执行D-A转换，从而生成要提供给像素11的像素电压Vpix。偏移电压生成电路32生成偏移电压Vofs（稍后将描述）。
开关部分33基于来自开关控制电路34的指令，时分地选择从D-A转换电路31提供的像素电压Vpix和从偏移电压生成电路32提供的偏移电压Vofs，并且将选择的电压提供给数据线DTL。
开关部分33包括反相器IV和开关SW1和SW2。反相器IV将从开关控制电路34提供的SW控制信号反相，并输出反相信号。开关SW1根据从开关控制电路34提供的SW控制信号开或关。像素电压Vpix从D-A转换电路31提供到开关SW1的一端。开关SW1的另一端连接到开关SW2的另一端，并且连接到数据线DTL。开关SW2根据来自反相器IV的输出信号开或关。偏移电压Vofs从偏移电压生成电路32提供到开关SW2的一端。开关SW2的另一端连接到开关SW1的另一端，并且连接到数据线DTL。
开关控制电路34生成用于控制开关部分33中的开关SW1和SW2的开和关的SW控制信号，并且将生成的SW控制信号提供给开关部分33。
由于该配置，数据线驱动电路24时分地施加偏移电压Vofs和像素电压Vpix到每条数据线DTL，从而驱动显示面板10中的每个像素11。具体地，如稍后将描述的，数据线驱动电路24在初始化时段P1和P2（稍后将描述）和Vth校正时段P3和P4（稍后将描述）中施加偏移电压Vofs到数据线DTL，并且在信号写入时段P5（稍后将描述）中施加像素电压Vpix到数据线DTL。
这里，如稍后将描述的，初始化时段P1和P2每个是这样的时段，其中通过基于偏移电压Vofs，增加像素11中的驱动晶体管Tr2的栅极-源极电压Vgs以大于驱动晶体管Tr2的阈值电压Vth，初始化像素11。此外，如稍后将描述的，Vth校正时段P3和P4每个是这样的时段，其中基于偏移电压Vofs校正驱动晶体管Tr2的阈值电压Vth。此外，信号写入时段P5是这样的时段，其中在驱动晶体管Tr2的栅极和源极之间设置根据像素电压Vpix的预定电压。如稍后将描述的，在显示单元1中，初始化时段P1和P2（稍后将描述）短于Vth校正时段P3和P4（稍后将描述）。
电源线驱动电路25根据从定时生成电路22提供的控制信号，顺序地提供电源线信号DS到多个电源线DSL，并且从而控制每个有机EL器件12的发光操作和消光操作。具体地，如稍后将描述的，电源线驱动电路25在初始化时段P1和P2（稍后将描述）中施加低于偏移电压Vofs的电压Vini到每个电源线DSL，并且在Vth校正时段P3和P3（稍后将描述）和信号写入时段（P5）（稍后将描述）中施加高于偏移电压Vofs的电压Vccp到其。
这里，驱动电路20对应于本公开中的“驱动部分”的具体示例。初始化时段P1和P2对应于本公开中的“第一准备时段”的具体示例。Vth校正时段P3和P4对应于本公开中的“第二准备时段”的具体示例。信号写入时段P5对应于本公开中的“写入时段”的具体示例。偏移电压Vofs对应于本公开中的“第一电压”的具体示例。电压Vini对应于本公开中的“第二电压”的具体示例。电压Vccp对应于本公开中的“第三电压”的具体示例。
[操作和功能]
随后，将对本实施例的显示单元1的操作和功能给出描述。
[一般操作的概述]
首先，将参考图1描述显示单元1的一般操作的概述。驱动电路20基于图像信号Sdisp和同步信号Ssync对显示面板10执行显示驱动。具体地，首先，图像信号处理电路21基于图像信号Sdisp执行诸如伽马校正和过驱动校正的校正，从而生成图像信号Sdisp2。定时控制电路22基于同步信号Ssync控制扫描线驱动电路23、数据线驱动电路24和电源线驱动电路25。扫描线驱动电路23生成扫描线信号WS，并且顺序地将生成的扫描线信号WS施加到多个扫描线WSL。数据线驱动电路24生成包括像素电压Vpix和偏移电压Vofs的数据线信号Sig，并且将生成的数据线信号Sig施加到多个数据线DTL的每个。电源线驱动电路25生成电源线信号DS，并且将生成的电源线信号DS施加到多个电源线DSL。显示面板10基于已经从驱动电路20提供的扫描线信号WSL、数据线信号Sig和电源线信号DS执行显示。
[具体操作]
接着，将描述显示单元1的具体操作。
图4图示显示单元1中的显示操作的定时图。该图图示一个关注像素上的显示驱动的操作示例。在图4中，（A）示出扫描线信号WS的波形，（B）示出电源线信号DS的波形，（C）示出驱动晶体管Tr2的栅极电压Vg的波形，（D）示出驱动晶体管Tr2的源极电压Vs的波形，以及（E）示出数据线信号Sig的波形。在图4的（C）到（E）中，使用相同电压轴示出各个波形。
显示单元1中的每个像素11通过交替地重复发光（发光时段P0）和消光（消光时段P10）执行显示。具体地，在消光时段P10中，每个像素11首先在多个（该示例中两个）水平时段（1H）（初始化时段P1和P2）中执行初始化，并且在其之后的多个（该示例中两个）水平时段（Vth校正时段P3和P4）中执行驱动晶体管Tr2的Vth校正。此外，在Vth校正时段P4之后的信号写入时段P5中，在像素11中写入像素电压Vpix。此后，像素11在发光时段P9中发给。换句话说，在该示例中，显示单元1在对应于四个水平时段的时段中，对每个像素11执行初始化、Vth校正和信号的写入。以下，将描述其细节。
首先，在定时t0，在扫描线信号Ws的电压为电压Voff的时段（图4的（A））中，电源线驱动电路25将电源线信号DS的电压从电压Vccp减少到电压Vini（图4的（B））。相应地，驱动晶体管Tr2的源极电压Vs开始朝电压Vini减少（图4的（D）），并且根据于此，驱动晶体管Tr2的栅极电压Vg开始减少（图4的（C））。此外，像素11消光，并且消光时段P10开始。
接着，在从定时t1到定时t2的时段（初始化时段P1）中，驱动电路20对像素11执行第一初始化。具体地，在定时t1，在数据线驱动电路24正在输出偏移电压Vofs作为数据信号Sig的时段（图4的（E））中，扫描线驱动电路23首先将扫描线信号WS的电压从电压Voff增加到电压Von（图的（A））。结果，写入晶体管Tr1变为导通（ON）状态，并且驱动晶体管Tr2的栅极电压Vg变为偏移电压Vofs（图4的（C））。另一方面，驱动晶体管Tr2的源极电压Vs继续朝电压Vini减少（图4的（D））。
接着，在定时t2，扫描线驱动电路23将扫描线信号WS的电压从电压Von朝电压Voff减少（图4的（A））。结果，写入晶体管Tr1变为截止（OFF）状态。此时，驱动晶体管Tr2的栅极变为浮置状态，并且维持电容器Cs的两端之间的电压（电压Vgs）。因此，在从定时t2到定时t3的时段中，驱动晶体管Tr2的栅极电压Vg根据驱动晶体管Tr2的源极电压Vs的变化减少（图的（C）和（D））。
接着，在从定时t3到定时t4的时段（初始化时段P2）中，驱动电路20对像素11执行第二初始化。其操作类似于上述初始化时段P1的情况中的操作。具体地，在定时t3，在数据线驱动电路24正在输出偏移电压Vofs作为数据线信号Sig的时段（图4的（E））中，扫描线驱动电路23首先将扫描线信号WS的电压从电压Voff增加到电压Von（图4的（A））。结果，写入晶体管Tr1变为导通状态，并且驱动晶体管Tr2的栅极电压Vg变为偏移电压Vofs（图4的（C））。另一方面，驱动晶体管Tr2的源极电压Vs会聚到电压Vini（图4的（D））。驱动晶体管Tr2的栅极-源极电压Vgs在该最终状态下高于该驱动晶体管Tr2的阈值电压Vth（Vgs>Vth），如图4所示。因此，像素11的初始化完成。
接着，在定时t4，扫描线驱动电路23将扫描线信号WS的电压从电压Von减少到电压Voff（图4的（A））。结果，写入晶体管Tr1变为截止状态，并且维持电容器Cs的两端之间的电压（电压Vgs）。此时，驱动晶体管Tr2的源极电压Vs已经在定时t4会聚到电压Vini，因此，不变化（图4的（D））。因此，在从定时t4到定时t5的时段中，驱动晶体管Tr2的栅极电压Vg几乎维持在偏移电压Vofs（图4的（C））。
接着，在从定时t6到定时t7的时段（Vth校正时段P3）中，驱动电路20对像素11执行第一Vth校正。具体地，在该Vth校正之前，在定时t5，在数据线驱动电路24正在输出偏移电压Vofs作为数据线信号Sig的时段（图4的（E））中，扫描线驱动电路23首先将扫描线信号WS从电压Voff增加到电压Von（图4的（A））。接着，在定时t6，电源线驱动电路25将电源线信号DS的电压从电压Vini增加到电压Vccp（图4的（B））。结果，在从定时t6到定时t7的时段中，电流Id在驱动晶体管Tr2的漏极和源极之间流动，并且器件电容Csub充电，从而驱动晶体管Tr2的源极电压Vs增加（图4的（D））。另一方面，驱动晶体管Tr2的栅极电压Vg维持在偏移电压Vofs（图4的（C）），因为写入晶体管Tr1处于导通状态。以此方式，在从定时t6到定时t7的时段中，驱动晶体管Tr2的栅极-源极电压Vgs随着时间经过而减少。
该操作是所谓的负反馈操作。具体地，如上所述，当电流Id在驱动晶体管Tr2的漏极和源极之间流动并且栅极-源极电压Vgs减少时，漏极和源极之间的电流Id减少。换句话说，驱动晶体管Tr2的漏极和源极之间的电流Id由于该负反馈操作朝0（零）会聚。换句话说，由于该负反馈操作，驱动晶体管Tr2的栅极-源极电压Vgs会聚，以便等于驱动晶体管Tr2的阈值电压Vth（Vgs=Vth）。
接着，在定时t7，扫描线驱动电路23将扫描线信号WS的电压从电压Von减少到Voff（图4的（A））。结果，写入晶体管Tr1变为截止状态，并且电容器Cs的两端之间的电压（电压Vgs）维持。因此，在从定时t7到定时t8的时段中，驱动晶体管Tr2的栅极电压Vg根据驱动晶体管Tr2的源极电压Vs的变化而增加（图4的（C）和（D））。
接着，在从定时t8到定时t9的时段（Vth校正时段P4）中，驱动电路20对像素11执行第二Vth校正。其操作类似于上述Vth校正时段P3中的操作。具体地，在定时t8，在数据线驱动电路24正在输出偏移电压Vofs作为数据线信号Sig的时段（图4的（E））中，扫描线驱动电路23首先将扫描线信号WS从电压Voff增加到电压Von（图4的（A））。结果，在从定时t8到定时t9的时段中，电流Id在驱动晶体管Tr2的漏极和源极之间流动，并且器件电容Csub充电，从而驱动晶体管Tr2的源极电压Vs增加（图4的（D））。相应地，驱动晶体管Tr2的栅极-源极电压Vgs由于上述负反馈操作变得等于驱动晶体管Tr2的阈值电压。换句话说，驱动晶体管Tr2的源极电压Vs会聚到电压（Vofs-Vth）。因此，驱动晶体管Tr2的Vth校正完成。
接着，在定时t9，扫描线驱动电路23将扫描线信号WS的电压从电压Von减少到Voff（图4的（A））。结果，写入晶体管Tr1变为截止状态。
接着，在从定时t10到定时t11的时段（信号写入时段P5）中，驱动电路20对像素11执行像素电压Vpix的写入。具体地，在该像素电压Vpix的写入之前，数据线驱动电路24首先将数据线信号Sig的电压从偏移电压Vofs增加到像素电压Vpix（图4的（E））。此外，在定时t10，扫描线驱动电路23将扫描线信号WS从电压Voff增加到电压Von（图4的（A））。结果，写入晶体管Tr1变为导通状态。因此，驱动晶体管Tr2的栅极电压Vg增加到像素电压Vpix（图4的（C））。此时，驱动晶体管Tr2的栅极-源极电压Vgs变得高于阈值电压Vth（Vgs>Vth），并且电流Id在漏极和源极之间流动。因此，器件电容Csub充电，并且驱动晶体管Tr2的源极电压Vs增加（图4的（D））。通过上述操作，驱动晶体管Tr2的栅极-源极电压Vgs设为与像素电压Vpix对应的电压Vemi。因此，像素电压Vpix的写入完成。
接着，在定时t11，扫描线驱动电路23将扫描线信号WS的电压从电压Von减少到Voff（图4的（A））。结果，写入晶体管Tr1变为截止状态，并且电容器Cs的两端之间的电压（即，驱动晶体管Tr2的栅极-源极电压Vgs）维持在电压Vemi。此时，电流Id在漏极和源极之间流动。因此，器件电容Csub充电，并且驱动晶体管Tr2的源极电压Vs增加（图4的（D））。根据与此，驱动晶体管Tr2的栅极电压Vg也增加（图4的（E））。此外，当连接到驱动晶体管Tr2的源极的有机EL器件12的阳极的电压变为大于该有机EL器件12的阈值电压Vel时，电流在有机EL器件12的阳极和阴极之间流动，有机EL器件12发光，并且发光时段P9开始。
此后，在预定时段经过之后，显示单元1从发光时段P9（P0）移动到消光时段P10。此外，驱动电路20执行驱动以便重复该系列操作。
图5图示显示面板10中各行中的像素11的操作状态，并且图示从第（n-4）行到第n行的总共五行中的各个像素11的操作状态。这里，例如，像素11（n）表示第n行中的像素11，并且像素11（n-1）表示第（n-1）行中的像素11。
如图5所示，显示单元1中的每个像素11在对应于四个水平时段（1H）的时段中执行初始化、Vth校正、和信号写入。具体地，像素11在第一水平时段中的初始化时段P1和第二水平时段中的初始化时段P2的每个中执行初始化。像素11在第三水平时段中的Vth校正时段和第四水平时段中的Vth校正时段的每个中执行Vth校正。随后，像素11基于该像素信号Vpix发光。
显示单元1基于行对各个像素11执行该系列操作，以便允许各操作移位一个水平时段。具体地，例如，在显示单元1中，当第n行中的像素11（n）在初始化时段P1中执行第一初始化操作时，第（n-1）行中的像素11（n-1）可以在初始化时段P2中执行第二初始化操作。类似地，例如，当第n行中的像素11（n）在初始化时段P2中执行第二初始化操作时，第（n-1）行中的像素11（n-1）在Vth校正时段P3中执行第一Vth校正操作。
如图5所示，在显示单元1中，一个像素11（例如，像素11（n））的初始化时段P1和P2安排在与另一像素11（例如，像素11（n-2））的Vth校正时段P3和P4相同的水平时段中。此时，在像素水平时段中，一个像素11（例如，像素11（n））的初始化时段P1和P2短于另一像素11（例如，像素11（n-2））的Vth校正时段P3和P4，因此先结束。
[关于显示缺陷]
接着，将关于显示单元中的像素的缺陷给出描述。
图6图示已经出现点缺陷的像素的示例。在使用有机EL器件的显示单元中，如图6所示，点缺陷可能由于例如电容器Cs的两端之间的短路而出现。在这样的像素11（以下也称为“缺陷像素11S”）中，驱动晶体管Tr2的栅极-源极电压Vgs变为0V，并且驱动晶体管Tr2保持在截止状态。因此，不允许执行根据像素信号Vpix的显示，并且出现圆点缺陷。
此外，不允许缺陷像素11S正常地执行诸如初始化操作和Vth校正操作的操作。具体地，如图4所示，例如，在初始化时段P1和P2中，偏移电压Vofs从数据线驱动电路24经由处于导通状态的写入晶体管Tr1提供给驱动晶体管Tr2的栅极，并且电压Vini经由处于导通状态的写入晶体管Tr1从电源线驱动电路25提供给驱动晶体管Tr2的源极。因此，在缺陷像素11S的情况下，其中电容器Cs的两端短路，偏移电压Vofs和电压Vini变为相互接近，偏移电压Vofs减少，电压Vini增加，并且在该初始化时段P1和P2中，例如电压Vofs和电压Vini可以具有几乎相等的电压。因此，不允许缺陷像素11S正常地执行初始化操作。
此外，在初始化时段P1和P2中，已经如上所述减少的偏移电压Vofs也经由数据线DTL提供给其他像素11，如下面将描述的。
图7图示第n行中的像素11（n）是缺陷像素11S的情况下，从第（n-4行）到第n行的各个像素11的操作状态。例如，在显示单元1中，在定时t20，像素11（n）在初始化时段P1中执行第一初始化操作，像素11（n-2）在Vth校正时段P3中执行第一Vth校正操作，并且像素11（n-3）在Vth校正时段P4中执行第二Vth校正。
图8图示在图7所示的定时t20各行中的像素11的状态。要注意，为了描述的方便，在该图中在定时t20，使用显示开-关状态的开关来图示写入晶体管Tr1。
如图7和8所示，在定时t20，像素11（n）和11（n-1）执行初始化操作，并且像素11（n-3）和11（n-2）执行Vth校正操作。因此，这些像素11（n-3）到11（n）中的所有写入晶体管Tr1处于导通状态。相应地，还经由数据线DTL提供已经由于对缺陷像素11S（像素11（n））的初始化操作而减少的偏移电压Vofs给执行Vth校正操作的像素（n-3）和11（n-2）。
接着，将对像素11（n-3）的操作给出描述。
图9图示像素11（n-3）和像素11（n）（缺陷像素11S）的操作的定时图。（A）示出要提供给像素11（n-3）的扫描线信号WS（n-3）的波形，（B）示出要提供给像素11（n-3）的电源线信号DS（n-3）的波形，（C）示出要提供给像素11（n）的扫描线信号WS（n）的波形，（D）示出要提供给像素11（n）的电源线信号DS（n）的波形，以及（E）示出要提供给像素11（n-3）和像素11（n）的数据线信号Sig的波形。
如图9所示，在像素11（n）（缺陷像素11S）的初始化时段P1和P2中，因为电容器Cs的两端短路，所以数据线信号Sig的偏移电压Vofs朝向电压Vini减少电压ΔV（图9的（E）），并且电源线信号DS（n）的电压Vini朝向偏移电压Vofs增加（图9的（D））。像素11（n-3）基于这样的数据线信号Sig的电压执行Vth校正操作。
图10图示像素11（n-3）的操作的定时图。（A）示出扫描线信号WS（n-3）的波形，（B）示出电源线信号DS（n-3）的波形，（C）示出驱动晶体管Tr2的栅极电压Vg的波形，（D）示出驱动晶体管Tr2的源极电压Vs的波形，以及（E）示出数据线信号Sig的波形。
驱动电路20以类似于图4所示的定时图的方式驱动像素11（n-3）。具体地，驱动电路20驱动像素11（n-3）以便在从定时t31到定时t32的时段（初始化时段P1）中对像素11（n-3）执行第一初始化，在从定时t33到定时t34的时段（初始化时段P2）中对像素11（n-3）执行第二初始化，并且在从定时t36到定时t37的时段（Vth校正时段）中对像素11（n-3）执行第一Vth校正操作。
接着，在从定时t38到定时t40的时段（Vth校正时段P4）中，驱动电路20执行第二Vth校正。具体地，扫描线驱动电路23首先将扫描线信号WS（n-3）的电压从电压Voff增加到电压Von（图10的（A））。此时，如使用图9描述的，数据线信号Sig的偏移电压Vofs在从定时t38到定时t39的时段中减少电压ΔV（图10的（E））。换句话说，在从定时t38到定时t39的时段中，在缺陷像素11S（像素11（n））中，偏移电压Vofs和电压Vini变得相互接近。因此，偏移电压Vofs减少。结果，在像素11（n-3）中，电流Id在驱动晶体管Tr2的漏极和源极之间流动，并且器件电容Csub充电，从而驱动晶体管Tr2的源极电压Vs增加（图10的（D））。随后，在定时t39，当偏移电压Vofs增加ΔV并且返回原始电压时，由于负反馈操作，驱动晶体管Tr2的源极电压Vs增加，直到驱动晶体管Tr2的栅极-源极电压Vgs变得等于驱动晶体管Tr2的阈值电压Vth。结果，驱动晶体管Tr2的源极电压Vs会聚到电压（Vofs-Vth）（图10的（D）），并且Vth校正完成。
随后，在从定时t41到定时t42的时段（信号写入时段P5）中，驱动电路20以类似于图4所示的定时图的方式在像素11（n-3）中执行像素电压Vpix的写入。因此，驱动晶体管Tr2的栅极-源极电压Vgs设为与像素电压Vpix对应的电压Vemi。此外，在定时t42，在驱动电路20将扫描线信号WS（n-3）的电压从电压Von减少到电压Voff之后，有机EL器件12以对应于该电压Vemi的亮度发光。
以此方式，在显示单元1中，即使在一部分像素（例如，像素11（n））中出现点缺陷时，也可能抑制对其他像素（例如，像素11（n-3））的影响，不同于根据稍后将描述的比较示例的显示单元。
[比较示例]
接着，将对根据比较示例的显示单元1R给出描述。水平时段（1H）中初始化时段P1和P2的结束定时不同于本实施例的情况。具体地，在本实施例中，初始化时段P1和P2比该水平时段（1H）中其他行中的Vth校正时段P3和P4结束早。然而，在本比较示例中，初始化时段P1和P2与该水平时段（1H）的其他行中的Vth校正时段P3和P4在相同时间结束。
图11图示在根据本比较示例的显示单元1R中像素11（n）是缺陷像素11S的情况下，从第（n-4）行到第n行的各个像素的操作状态。类似于本实施例的显示单元1的情况（图5和7），显示单元1R对像素11执行初始化、Vth校正和信号写入，并且基于行执行该系列操作以便允许各操作移位一个水平时段，在对应于四个水平时段（1H）的时段中。此时，在显示单元1R中，在每个水平时段（1H）中初始化时段P1和P2与Vth校正时段P3和P4在相同时间结束。
如图11所示，在定时r20，类似于本实施例的显示单元1的情况（图7），从第（n-3）行到第n行的像素11（n-3）到11（n）执行初始化操作或Vth校正操作。因此，这些像素中的所有写入晶体管Tr1变为导通状态。结果，缺陷像素11S（像素11（n））中已经变得低于期望值的偏移电压Vofs还经由数据线DTL提供给像素（n-3）到11（n-1）。
图12图示根据本比较示例的显示单元1R中的像素11（n-3）和像素11（n）（缺陷像素11S）的操作的定时图。（A）示出扫描线信号WS（n-3）的波形，（B）示出电源线信号DS（n-3）的波形，（C）示出扫描线信号WS（n）的波形，（D）示出电源线信号DS（n）的波形，以及（E）示出数据线信号Sig的波形。
在像素11（n）（缺陷像素11S）的初始化时段P1和P2中，因为电容器Cs的两端短路，所以数据线信号Sig的偏移电压Vofs朝向电压Vini减少电压ΔV（图12的（E）），并且电源线信号DS（n）的电压Vini朝向偏移电压Vofs增加（图12的（D）），如同本实施例中的显示单元1的情况（图9）。
图13图示根据本比较示例的显示单元1R中的像素11（n-3）的操作的定时图。（A）示出扫描线信号WS（n-3）的波形，（B）示出电源线信号DS（n-3）的波形，（C）示出驱动晶体管Tr2的栅极电压Vg的波形，（D）示出驱动晶体管Tr2的源极电压Vs的波形，以及（E）示出数据线信号Sig的波形。
根据显示单元1R的驱动电路20R执行驱动以便在从定时r31到定时r32的时段（初始化时段P1）中对像素11（n-3）执行第一初始化，在从定时r33到定时r34的时段（初始化时段P2）中对像素11（n-3）执行第二初始化，并且在从定时r36到定时r37的时段（Vth校正时段）中对像素11（n-3）执行第一Vth校正操作。这些操作几乎与本实施例的情况相同。要注意，在显示单元1R中，初始化时段P1和P2的时间段长于本实施例的情况中的那些；然而，初始化时段P1和P2中的操作本身几乎与本实施例的情况的那些相同。
接着，在从定时r38到定时r40的时段（Vth校正时段P4）中，驱动电路20R执行第二Vth校正。具体地，扫描线驱动电路23首先将扫描线信号WS（n-3）的电压从电压Voff增加到电压Von（图13的（A））。此时，如使用图12描述的，数据线信号Sig的偏移电压Vofs在从定时r38到定时r39的时段中减少电压ΔV（图13的（E））。结果，在像素11（n-3）中，电流Id在驱动晶体管Tr2的漏极和源极之间流动，并且器件电容Csub充电。此外，由于负反馈操作，驱动晶体管Tr2的源极电压Vs增加，直到驱动晶体管Tr2的栅极-源极电压Vgs变得等于驱动晶体管Tr2的阈值电压Vth。相应地，驱动晶体管Tr2的源极电压Vs会聚到电压（Vofs-ΔV-Vth）（图13的（D））。换句话说，在根据比较示例的显示单元1R中，驱动晶体管Tr2的源极电压Vs会聚到比根据本实施例的显示单元1中的会聚电压（Vofs-Vth）低电压ΔV的电压（图13的（D））。
接着，在定时r40，扫描线驱动电路23将扫描线信号WS（n-3）的电压从电压Von减少到电压Voff（图13的（A））。结果，写入晶体管Tr1变为截止状态。此时，如使用图12描述的，数据线信号Sig的偏移电压Vofs增加ΔV，并且返回原始电压（图13的（E））。
随后，在从定时r41到定时r42的时段（信号写入时段P5）中，驱动电路20R以类似于图10所示的定时图的方式在像素11（n-3）中执行像素电压Vpix的写入。此时，驱动晶体管Tr2的源极电压（Vofs-ΔV-Vth）在定时t41低于根据本实施例的显示单元1中的源极电压（Vofs-Vth）。因此，驱动晶体管Tr2的栅极-源极电压Vgs设为比根据本实施例的电压Vemi高的电压Vemir。此外，在定时r42，在驱动电路20R将扫描线信号WS（n-3）的电压从电压Von减少到电压Voff之后，有机EL器件12以对应于该电压Vemir的亮度发光。换句话说，在根据本比较示例的显示单元1R中，像素11（n-3）中的有机EL器件12以高于期望亮度的亮度发光。
如上所述，在根据本比较示例的显示单元1R中，例如，当一部分像素11包括点缺陷时，其他像素中的显示操作可能被影响。具体地，在显示单元1R中，如图11等所示，在一个水平时段（1H）中，初始化时段P1和P2与其他行中的Vth校正时段P3和P4在相同时间结束。结果，如图13所示，在像素11（n-3）中，在紧接在信号写入时段P5之前的第二Vth校正时段P4中，驱动晶体管Tr2的源极电压Vs在Vth校正操作结束的定时r40减少。因此，不允许正常地执行Vth校正。相应地，在紧接在其之后的信号写入时段P5中，驱动晶体管Tr2的栅极-源极电压Vgs设为高电压Vemir，因此，以比期望亮度高的亮度执行发光。
在该示例中，已经给出这样的描述，其中第n行中的像素11（n）（缺陷像素11S）影响第（n-3）行中的像素11（n-3）的显示操作。然而，类似地，第n行中的像素11（n）（缺陷像素11S）还影响第（n-23）行中的像素11（n-2）的显示操作。具体地，如图11所示，以与像素11（n）的初始化时段P1中偏移电压Vofs的移位影响像素11（n-3）的Vth校正时段P4中的操作的方式类似的方式，像素11（n）的初始化时段P2中偏移电压Vofs的移位还影响像素11（n-2）的Vth校正时段P4中的操作。
此外，该偏移电压Vofs还提供给显示面板10中的其他行中的像素11。具体地，如图3所示，偏移电压Vofs由数据线驱动电路24中的偏移电压生成电路32生成，并且分发和提供给每列中的像素11。因此，偏移电压Vofs还提供给显示面板10中的其他列中的第（n-3）行和第（n-2）行中的像素11。结果，如图14所示，由于像素11（n）（缺陷像素11S）中的点缺陷，对于两行出现线缺陷。
此外，在该示例中提供两个初始化时段P1和P2。然而，当提供更多初始化时段时，显示中的缺陷可能进一步增加。图15图示在根据比较示例的显示单元1R中提供四个初始化时段的情况下的操作示例。在该示例中，第n行中的像素11（n）（缺陷像素11S）影响四个像素11（n-5）到11（n-2）的显示操作。在该情况下，对于四行出现如图14所示的线缺陷。以此方式，提供的初始化时段越多，显示中出现越多缺陷。
另一方面，在根据本实施例的显示单元1中，如图5等所示，在一个水平时段（1H）中，初始化时段P1和P2比其他行中的Vth校正时段P3和P4结束早。结果，如图10所示，在根据显示单元1的像素11（n-3）中，在紧接在信号写入时段P5之前的第二Vth校正时段中，在偏移电压Vofs增加电压ΔV以返回原始电压之后，允许正常地执行Vth校正。因此，可能减少如图14所示的线缺陷出现的可能性。
以此方式，在显示单元1中，即使在一部分像素（例如，像素11（n））中出现点缺陷时，也可能它抑制对其他像素（例如，像素11（n-3））的影响。
[效果]
如上所述，在本实施例中，初始化时段比其他行中的Vth校正时段结束早。因此，即使在像素包括点缺陷时，也可能抑制它对其他像素的显示操作的影响。
[修改1-1]
在上述实施例中，提供了两个初始化时段。然而，这不是限制性的。例如，可以提供三个或更多初始化时段，或者可以只提供一个初始化时段。类似地，在上述实施例中，提供了两个Vth校正时段。然而，这不是限制性的。例如，可以提供三个或更多Vth校正时段，或者可以只提供一个Vth校正时段。下面将描述本修改的示例。
图16图示提供一个初始化时段和一个Vth校正时段的情况下的操作示例。图16的（A）示出在一个水平时段（1H）中初始化时段Q1和Vth校正时段Q2在相同时间开始的情况下的示例。图16的（B）示出在一个水平时段（1H）中初始化时段Q1在Vth校正时段Q2已经开始之后开始的情况下的示例。同样在这些情况下，初始化时段Q1比其他行的Vth校正时段Q2结束早。因此，如同上述实施例的情况，允许正常地执行Vth校正。因此，即使在像素包括点缺陷时，也可能抑制它对其他像素的显示操作的影响。
[2.第二实施例]
接着，将关于根据第二实施例的显示单元2给出描述。在本实施例中，在相互不同的水平时段中提供其他行的初始化时段和Vth校正时段。要注意，相同符号附接到与根据上述第一实施例的显示单元1中的组件基本相同的组件，并且将适当地省略其描述。
图17图示根据显示单元2的显示面板10中各行中的像素11的操作状态，并且图示从第（n-9）行到第n行总共十行中的各个像素11的操作状态。
显示单元2中的每个像素11在与六个相邻水平时段对应的时段以外的第一和第三水平时段（初始化时段P1和P2）中执行初始化，并且在第四和第六水平时段（Vth校正时段P3和P4）中执行Vth校正。在该示例中，初始化时段P1和P2每个的长度几乎与Vth校正时段P3和P4每个的长度相同。此外，在提供Vth校正时段P4的水平时段中，或者在提供Vth校正时段P4的水平时段随后的水平时段（信号写入时段P5）中，在每个像素11中写入像素信号Vpix。此后，每个像素11基于该像素信号Vpix发光。具体地，如图17所示，例如，对于像素11（n-1），在提供Vth校正时段P4的水平时段中，提供信号写入时段P5，并且对于像素11（n），在提供Vth校正时段P4的水平时段随后的水平时段中，提供信号写入时段P5。
显示单元2基于两行执行该系列操作，以便允许操作移位两个水平时段。具体地，例如，如图17所示，像素11（n-1）和11（n）在相同水平时段中执行初始化（初始化时段P1和P2）和Vth校正（Vth校正时段P3和P4）。类似地，像素11（n-3）和11（n-2）在相同水平时段中执行初始化（初始化时段P1和P2）和Vth校正（Vth校正时段P3和P4）。此时，当像素11（n-1）和11（n）在初始化时段P1中执行第一初始化操作时，像素11（n-3）和11（n-2）在初始化时段P2中执行第二初始化操作，并且当像素11（n-1）和11（n）在Vth校正时段P3中执行第一Vth校正操作时，像素11（n-3）和11（n-2）在Vth校正时段P4中执行第二Vth校正操作。
相应地，在显示单元2中，如图17所示，初始化时段P1和P2安排在与另一行中的Vth校正时段的水平时段不同的水平时段中。在该情况下，即使在一部分像素11包括点缺陷、并且在该缺陷像素11S的初始化操作时（初始化时段P1和P2）偏移电压Vofs移位时，该偏移电压Vofs的移位不影响其他像素的Vth校正，因为任何其他像素在该水平时段中不执行Vth校正。因此，即使在像素包括点缺陷时，也可能抑制它对其他像素的显示操作的影响。
如上所示，在本实施例中，初始化时段提供在与另一行中的Vth校正时段的水平时段不同的水平时段中。因此，即使在像素包括点缺陷时，也可能抑制它对其他像素的显示操作的影响。
[修改2-1]
在上述实施例中，在提供Vth校正时段P4的水平时段中，或者在提供Vth校正时段P4随后的水平时段中提供信号写入时段P5。然而，此时，提供该信号写入时段P5的水平时段可以对每帧改变。下面将描述其细节。
图18图示根据本修改的各行中的像素11的操作状态。（A）示出一帧中的操作状态，以及（B）示出另一帧中的操作状态。在本实施例中，如图18所示，提供信号写入时段P5的水平时段对于每帧改变。具体地，例如，在图18的（A）中，在提供Vth校正时段P4的水平时段随后的水平时段中，在像素11（n）中写入像素信号Vpix（信号写入时段P5），并且在图18的（B）中，在提供Vth校正时段P4的水平时段中，在像素11（n）中写入像素信号Vpix（信号写入时段P5）。
以此方式，在本实施例中，提供信号写入时段P5的水平时段对于每帧改变。结果，即使在从在Vth校正时段P4中执行Vth校正到信号写入时段中执行像素信号Vpix的写入的时间影响该像素的发光亮度时，发光亮度通过显示多帧而会聚，因此可能抑制图像质量的劣化。
[修改2-2]
在上述实施例中，提供了两个初始化时段。然而，这不是限制性的。例如，可以提供三个或更多初始化时段，或者可以只提供一个初始化时段。类似地，在上述实施例中，提供了两个Vth校正时段。然而，这不是限制性的。例如，可以提供三个或更多Vth校正时段，或者可以只提供一个Vth校正时段。下面将描述本修改的示例。
图19图示提供一个初始化时段和一个Vth校正时段的情况下的操作示例。根据本修改的每个像素11在对应于两个水平时段（1H）的时段中的前一水平时段中执行初始化（初始化时段Q1），并且在后一水平时段中执行Vth校正（Vth校正时段Q2）。此外，在提供Vth校正时段Q2的水平时段中，或者在提供Vth校正时段Q2的水平时段随后的水平时段中，在每个像素11中写入像素信号Vpix（信号写入时段Q3）。此后，每个像素11基于该像素信号Vpix发光。
根据本修改的显示单元基于两行执行该系列操作，以便允许操作移位两个水平时段。具体地，例如，如图19所示，像素11（n-3）和11（n-2）在相同水平时段中执行初始化（初始化时段Q1），并且在随后的水平时段中执行Vth校正（Vth校正时段Q2）。此外，像素11（n-1）和11（n）在随后的水平时段中执行初始化（初始化时段Q1），并且在另一随后的水平时段中执行Vth校正（Vth校正时段Q2）。
同样在该情况下，在与另一行的Vth校正时段Q2的水平时段不同的水平时段中提供初始化时段Q1。因此，如同上述实施例的情况，允许正常地执行Vth校正。因此，即使在像素包括点缺陷时，也可能抑制它对其他像素的显示操作的影响。
[修改2-3]
在上述实施例中，水平时段P1和P2安排在与六个相邻水平时段（1H）对应的时段中的第一和第三时段中，并且Vth校正时段安排在其中的第四和第六水平时段中。然而，这不是限制性的。此外，在上述实施例中，初始化时段P1和P2每个的长度与Vth校正时段P3和P4每个的长度几乎相同。然而，这不是限制性的。例如，如图20所示，初始化时段P1和P2可以安排在与十个相邻水平时段（1H）对应的时段中的第一和第五时段中，并且Vth校正时段安排在其中的第六和第十水平时段中。此外，初始化时段P1和P2每个的长度可以短于Vth校正时段P3和P4每个的长度。
[3.应用示例]
接着，将关于上述实施例和修改中描述的显示单元的应用示例给出描述。
图21图示对其应用根据上述实施例等的显示单元的任一的电视装置的外观。该电视装置例如可以包括图像显示屏部分510，其包括前面板511和滤色镜512。该图像显示屏部分510可以由根据上述实施例等的显示单元的任一配置。
除了上述电视装置以外，根据上述实施例等的显示单元可应用于任何领域中的电子装置，如数字相机、笔记本个人计算机、移动终端装置（如移动电话）、移动游戏机和摄像机。换句话说，根据上述实施例等的显示单元可应用于显示图像的任何领域中的电子装置。
已经参考一些实施例描述了本技术。然而，本技术不限于这些实施例等，并且可以进行各种修改。
例如，在上述实施例中，像素11具有所谓的“2Tr1C”配置，其使用写入晶体管Tr1、驱动晶体管Tr2和电容器Cs配置。然而，这不是限制性的。可替代地，例如，如图22所示，可以采用所谓的“5Tr1C”，其进一步使用晶体管Tr3到Tr5配置。晶体管Tr3用于提供偏置电压Vofs给驱动晶体管Tr2的栅极。具体地，在上述实施例中尽管偏移电压Vofs经由写入晶体管Tr1提供给驱动晶体管Tr2的栅极，但是在本修改中偏置电压Vofs经由晶体管Tr3提供给驱动晶体管Tr2的栅极。晶体管Tr4用于提供电压Vccp给驱动晶体管Tr2的漏极。晶体管Tr5用于提供电压Vini给驱动晶体管Tr2的漏极。具体地，在上述实施例中，尽管电源线驱动电路25经由电源线DSL提供包括电压Vccp和电压Vini的电源线信号DS给驱动晶体管Tr2的漏极，但是在本修改中，电压Vccp经由晶体管Tr4提供给驱动晶体管Tr2的漏极，并且电压Vini经由晶体管Tr5提供给驱动晶体管Tr2的漏极。
例如，在上述实施例的每个中使用有机EL器件作为显示器件。然而，这不是限制性的。可替代地，例如，可以用无机EL器件。
要注意，本技术可以具有下述配置。
（1）一种驱动电路，包括：
驱动部分，通过线序扫描驱动多个像素电路，
对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束。
（2）如上述（1）所述的驱动电路，其中，每个像素电路中的第一准备时段和第二准备时段属于相互不同的水平时段。
（3）如上述（2）所述的驱动电路，其中，一条水平线的第二准备时段和其他水平线之一的第一准备时段属于相同的水平时段，以及
在每个水平时段中，其他水平线之一的第一准备时段比一条水平线的第二准备时段先结束。
（4）如上述（3）所述的驱动电路，其中，其他水平线之一的第一准备时段比一条水平线的第二准备时段短。
（5）如上述（2）所述的驱动电路，其中，一条水平线的第一准备时段和其他水平线的每个的第二准备时段属于相互不同的水平时段。
（6）如上述（5）所述的驱动电路，其中，第一准备时段具有与第二准备时段的长度相同的长度。
（7）如上述（1）到（6）的任一所述的驱动电路，其中，
为每个像素电路提供多个第二准备时段，
所述多个第二准备时段属于相互不同的水平时段，以及
所述多个第二准备时段的最后时段在其他水平线的第一准备时段以外的定时结束。
（8）如上述（1）到（7）的任一所述的驱动电路，其中，为每个像素电路提供多个第一准备时段。
（9）如上述（1）到（8）的任一所述的驱动电路，其中，
所述像素电路每个包括发光器件、晶体管和电容器，所述晶体管具有连接到发光器件的源极，并且所述电容器插入在所述晶体管的栅极和源极之间，
在第一准备时段中，所述驱动部分施加第一电压到所述晶体管的栅极，并且施加第二电压到所述晶体管的漏极，第二电压低于第一电压，以及
在第二准备时段中，所述驱动部分施加第一电压到所述晶体管的栅极，并且施加第三电压到所述晶体管的漏极，第三电压高于第一电压。
（10）如上述（9）所述的驱动电路，其中，所述发光器件是电致发光器件。
（11）一种驱动方法，包括：
在通过线序驱动来驱动多个像素电路时，
对于属于一条水平线的多个像素电路，
在第一准备时段中基于第一电压执行第一准备驱动；
然后在第二准备时段中基于第一电压执行第二准备驱动，第二准备时段在其他水平线的第一准备时段以外的定时结束；以及
在随后的写入时段中执行亮度信息的写入。
（12）一种显示单元，包括：
多个像素电路；以及
驱动部分，通过线序扫描驱动所述多个像素电路，
对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束。
（13）一种电子装置，包括：
显示单元；以及
控制电路，利用所述显示单元执行操作控制，
所述显示单元包括
多个像素电路，以及
驱动部分，通过线序扫描驱动多个像素电路，
对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束。
本申请要求2011年10月26日向日本专利局提供的日本专利申请JP2011-235045的优先权，在此通过引用并入其全部内容。
本领域技术人员应当理解是，根据迄今的设计要求和其他因素，可以出现各种修改、组合、子组合和替换，只要它们在所附权利要求或其等效的范围内。

Claims (11)

1.一种驱动电路，包括：
驱动部分，通过线序扫描驱动多个像素电路，
对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束，
其中，一条水平线的第二准备时段和其他水平线之一的第一准备时段属于相同的水平时段，以及
在每个水平时段中，其他水平线之一的第一准备时段比一条水平线的第二准备时段先结束，
每个像素电路中的第一准备时段和第二准备时段属于相互不同的水平时段。
2.如权利要求1所述的驱动电路，其中，其他水平线之一的第一准备时段比一条水平线的第二准备时段短。
3.如权利要求1所述的驱动电路，其中，一条水平线的第一准备时段和其他水平线的每个的第二准备时段属于相互不同的水平时段。
4.如权利要求3所述的驱动电路，其中，第一准备时段具有与第二准备时段的长度相同的长度。
5.如权利要求1所述的驱动电路，其中，
为每个像素电路提供多个第二准备时段，
所述多个第二准备时段属于相互不同的水平时段，以及
所述多个第二准备时段的最后时段在其他水平线的第一准备时段以外的定时结束。
6.如权利要求1所述的驱动电路，其中，为每个像素电路提供多个第一准备时段。
7.如权利要求1所述的驱动电路，其中，
所述像素电路每个包括发光器件、晶体管和电容器，所述晶体管具有连接到发光器件的源极，并且所述电容器插入在所述晶体管的栅极和源极之间，
在第一准备时段中，所述驱动部分施加第一电压到所述晶体管的栅极，并且施加第二电压到所述晶体管的漏极，第二电压低于第一电压，以及
在第二准备时段中，所述驱动部分施加第一电压到所述晶体管的栅极，并且施加第三电压到所述晶体管的漏极，第三电压高于第一电压。
8.如权利要求7所述的驱动电路，其中，所述发光器件是电致发光器件。
9.一种驱动方法，包括：
在通过线序驱动来驱动多个像素电路时，
对于属于一条水平线的多个像素电路，
在第一准备时段中基于第一电压执行第一准备驱动；
然后在第二准备时段中基于第一电压执行第二准备驱动，第二准备时段在其他水平线的第一准备时段以外的定时结束；以及
在随后的写入时段中执行亮度信息的写入，
其中，一条水平线的第二准备时段和其他水平线之一的第一准备时段属于相同的水平时段，以及
在每个水平时段中，其他水平线之一的第一准备时段比一条水平线的第二准备时段先结束，
每个像素电路中的第一准备时段和第二准备时段属于相互不同的水平时段。
10.一种显示单元，包括：
多个像素电路；以及
驱动部分，通过线序扫描驱动所述多个像素电路，
对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束，
其中，一条水平线的第二准备时段和其他水平线之一的第一准备时段属于相同的水平时段，以及
在每个水平时段中，其他水平线之一的第一准备时段比一条水平线的第二准备时段先结束，
每个像素电路中的第一准备时段和第二准备时段属于相互不同的水平时段。
11.一种电子装置，包括：
显示单元；以及
控制电路，利用所述显示单元执行操作控制，
所述显示单元包括
多个像素电路，以及
驱动部分，通过线序扫描驱动多个像素电路，
对于属于一条水平线的多个像素电路，所述驱动部分在第一准备时段中基于第一电压执行第一准备驱动，然后在第二准备时段中基于第一电压执行第二准备驱动，并且在随后的写入时段中执行亮度信息的写入，并且第二准备时段在其他水平线的第一准备时段以外的定时结束，
其中，一条水平线的第二准备时段和其他水平线之一的第一准备时段属于相同的水平时段，以及
在每个水平时段中，其他水平线之一的第一准备时段比一条水平线的第二准备时段先结束，
每个像素电路中的第一准备时段和第二准备时段属于相互不同的水平时段。
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