CN103399829B - 高可靠性随机存储系统 - Google Patents
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Abstract
本发明提供一种高可靠性随机存储系统，包括主设备模块、随机存储器和位于主设备模块和随机存储器之间的总线连接器；随机存储器和总线连接器之间设有一总线ECC桥接模块，该总线ECC桥接模块包括至少2个选通控制寄存器、至少2个总线应答选通器、至少2个总线传输选通器和ECC桥接器；总线传输选通器的第一总线输入端和ECC桥接器的编码输入端均连接到总线连接器；总线应答选通器的第一应答输入端和ECC桥接器的解码输入端均连接到随机存储器端；ECC桥接器的编码输入端和总线连接器之间设有第一开关，随机存储器和ECC桥接器的解码输入端之间设有第二开关。本发明可根据不同的应用场合灵活选择各个随机存储器是否需要ECC校验或者随机存储器内是否需要ECC校验，方便系统的扩展应用且提高了整体的效率。
Description
技术领域
本发明涉及一种随机存储器，具体涉及一种高可靠性随机存储系统。
背景技术
受电磁干扰或工艺缺陷的影响,，随机存储设备或总线传输存在一定的单Bit状态翻转错误的几率。这在汽车电子等可靠性要求极高的系统中是不能允许的。所以在可靠性要求较高的嵌入式系统中一般会在总线级加入支持纠错和检错的ECC功能。挂载在总线上的Slave可以共享ECC逻辑，而且原IP基本可以在重用的基础上得到ECC保护。
在现有的技术中，挂载在总线上的需要ECC保护的Slave是通过外挂一个ECC模块实现的，系统设计人员要在设计初始阶段就分配好需要ECC保护的memory区域，并将该区域映射到相应的Slave端口，在外部通过ECC模块进行保护。该方法比较不灵活，而且一旦相应的memory空间被设定为受ECC保护的区域，即使在不同的应用场合不再需要对该区域进行ECC保护，仍然不能重用该区域，不仅灵活性差，而且可移植性也较低，不利于系统性能的提升。
发明内容
本发明目的是提供一种高可靠性随机存储系统，该随机存储系统可根据不同的应用场合灵活选择各个随机存储器是否需要ECC校验或者随机存储器内是否需要ECC校验，方便系统的扩展应用，提高了整体的效率，灵活实现可重用该区域，而且可移植性也好，有利于系统性能的提升。
为达到上述目的，本发明采用的技术方案是：一种高可靠性随机存储系统，包括主设备模块、随机存储器和位于主设备模块和随机存储器之间的总线连接器；所述随机存储器和总线连接器之间设有一总线ECC桥接模块，该总线ECC桥接模块包括至少2个选通控制寄存器、至少2个总线应答选通器、至少2个总线传输选通器和用于数据编码、解码和纠错的ECC桥接器；
所述总线传输选通器的第一总线输入端和ECC桥接器的Master编码输入端均连接到所述总线连接器，所述ECC桥接器的Slave编码输出端连接到所述总线传输选通器的第二总线输入端，所述总线传输选通器的第一总线输入端用于接收来自主设备模块的存储数据和控制信号，所述总线传输选通器的第二总线输入端用于接收来自ECC桥接器的具有ECC校验码的编码存储数据和编码控制信号，总线传输选通器的输出端和控制端分别连接到随机存储器和选通控制寄存器，所述总线传输选通器根据选通控制寄存器的配置从而将第一总线输入端、第二总线输入端中一端数据和控制信号传输给所述随机存储器；
所述总线应答选通器的第一应答输入端和ECC桥接器的Slave解码输入端均连接到所述随机存储器，所述ECC桥接器的Master解码输出端连接到所述总线应答选通器的第二应答输入端，所述总线应答选通器的第一应答输入端用于接收来自随机存储器的存储数据和应答信号，所述总线应答选通器的第二应答输入端用于接收来自ECC桥接器的解码存储数据和解码应答信号，总线应答选通器的输出端和控制端分别连接到总线连接器和选通控制寄存器，所述总线应答选通器根据选通控制寄存器的配置从而将第一应答输入端、第二应答输入端中一端数据和应答信号传输给所述供主设备模块读取的总线连接器；
所述ECC桥接器的Master编码输入端和总线连接器之间设有第一开关，所述随机存储器和ECC桥接器的Slave解码输入端之间设有第二开关，所述第一开关和第二开关的控制端连接到所述选通控制寄存器并根据选通控制寄存器的配置开启或关闭第一开关和第二开关；所述选通控制寄存器、总线应答选通器和总线传输选通器的数目相等。
上述技术方案中的进一步改进方案如下：
1. 上述方案中，所述随机存储器内分为校验数据存储区和非校验数据存储区，所述校验数据存储区用于存储经所述ECC桥接器生成相应ECC码的存储数据，所述非校验数据存储区用于存储来自总线的存储数据。
2. 上述方案中，所述随机存储器数目至少2个，其中部分随机存储器用于存储校验数据，其余随机存储器用于存储非校验数据。
由于上述技术方案运用，本发明与现有技术相比具有下列优点和效果：
本发明高可靠性随机存储系统，可根据不同的应用场合灵活选择各个随机存储器是否需要ECC校验或者随机存储器内是否需要ECC校验，方便系统的扩展应用，且灵活实现可重用该区域，可移植性也好，有利于系统性能的提升；其次，ECC桥接器的编码输入端和总线之间设有第一开关，所述随机存储器和ECC桥接器的解码输入端之间设有第二开关，所述第一开关和第二开关的控制端连接到所述选通控制寄存器并根据选通控制寄存器的配置开启或关闭第一开关和第二开关，有效避免了ECC桥接器在非校验状态下工作，大大提高了整体的效率，并有效较低了系统的功耗。
附图说明
附图1为现有存储系统的总线示意图；
附图2为本发明高可靠性随机存储系统结构示意图。
以上附图中：1、主设备模块；2、随机存储器；3、总线连接器；4、总线ECC桥接模块；5、选通控制寄存器；6、总线应答选通器；7、总线传输选通器；8、ECC桥接器；9、第一开关；10、第二开关。
具体实施方式
下面结合附图及实施例对本发明作进一步描述：
实施例：一种高可靠性随机存储系统，包括主设备模块1、随机存储器2和位于主设备模块1和随机存储器2之间的总线连接器3；所述随机存储器2和总线连接器3之间设有一总线ECC桥接模块4，该总线ECC桥接模块4包括至少2个选通控制寄存器5、至少2个总线应答选通器6、至少2个总线传输选通器7和用于数据编码、解码和纠错的ECC桥接器8；
ECC桥接器侦查总线Master的访问信号，判断master是否对slave发出了有效的总线访问，若是，则启动内部状态机，总线Master接口发出操作命令数据给ECC控制模块，若否，内部状态机不发生变化；
ECC桥接器判断总线Master接口发出的操作命令为读时，向Slave发出一个读请求。如读回数据无ECC校验错，则将解码后读数据传递给Master。如发现校验错，进入纠错状态。如纠错失败，向Master发出访问出错信号。如纠错成功，将纠错后的数据传递给Master；当ECC桥接器判断总线Master接口发出的操作命令为写时，进入总线写状态，写数据总线通过ECC校验码生成逻辑生成校验位，并和原数据合并成写数据总线，传递给Slave；
所述总线传输选通器7的第一总线输入端和ECC桥接器8的Master编码输入端均连接到所述总线连接器3，所述ECC桥接器8的Slave编码输出端连接到所述总线传输选通器7的第二总线输入端，所述总线传输选通器7的第一总线输入端用于接收来自主设备模块1的存储数据和控制信号，所述总线传输选通器7的第二总线输入端用于接收来自ECC桥接器8的具有ECC校验码的编码存储数据和编码控制信号，总线传输选通器7的输出端和控制端分别连接到随机存储器2和选通控制寄存器5，所述总线传输选通器7根据选通控制寄存器5的配置从而将第一总线输入端、第二总线输入端中一端数据和控制信号传输给所述随机存储器2；
所述总线应答选通器6的第一应答输入端和ECC桥接器8的Slave解码输入端均连接到所述随机存储器2，所述ECC桥接器8的Master解码输出端连接到所述总线应答选通器6的第二应答输入端，所述总线应答选通器6的第一应答输入端用于接收来自随机存储器的存储数据和应答信号，所述总线应答选通器6的第二应答输入端用于接收来自ECC桥接器8的解码存储数据和解码应答信号，总线应答选通器6的输出端和控制端分别连接到总线连接器3和选通控制寄存器5，所述总线应答选通器6根据选通控制寄存器5的配置从而将第一应答输入端、第二应答输入端中一端数据和应答信号传输给所述供主设备模块1读取的总线连接器3；
所述ECC桥接器8的编码输入端和总线连接器3之间设有第一开关9，所述随机存储器2和ECC桥接器8的解码输入端之间设有第二开关10，所述第一开关9和第二开关10的控制端连接到所述选通控制寄存器5并根据选通控制寄存器5的配置开启或关闭第一开关9和第二开关10；上述第一开关的主要功能是将总线的正常访问gate-off，不使能内部的状态机，第二开关的功能是屏蔽掉slave的正常应答，使内部状态机保持IDLE状态。第一开关和第二开关的引入大大降低了系统的功耗。所述选通控制寄存器5、总线应答选通器6和总线传输选通器7的数目相等。
上述随机存储器2内分为校验数据存储区和非校验数据存储区，所述校验数据存储区用于存储经所述ECC桥接器8生成相应ECC码的存储数据，所述非校验数据存储区用于存储来自总线连接器3的存储数据。
上述随机存储器2数目至少2个，其中部分随机存储器2用于存储校验数据，其余随机存储器2用于存储非校验数据。
通过一组寄存器0～寄存器n来控制相应的n个slave即随机存储器2是否要进行ECC保护，当寄存器n为“0”时，默认不需要对slave_n进行ECC保护；当寄存器n设为“1”时，表示需要对slave_n进行ECC保护；从图中可以看到，总线连接器输出的总线传输信号一路直接输入到了总线传输选通器的一个输入端，总线连接器输出的总线传输信号经过ECC编码后得到了带有ECC编码的另一路总线传输信号输入到了总线传输选通器的另外一个输入端；同理，总线应答信号也是一样，连接总线应答选通器的一路输入直接来自于slave的输出端口，另一路是slave输出的应答信号经过ECC解码后的信号；总线传输选通器和总线应答选通器的选通端是由控制寄存器0～控制寄存器n来控制的。这种总线ECC校验的特点就是将ECC模块耦合在原总线连接器中，系统可以灵活控制各个slave是否需要ECC校验，方便系统的扩展应用。
上述实施例只为说明本发明的技术构思及特点，其目的在于让熟悉此项技术的人士能够了解本发明的内容并据以实施，并不能以此限制本发明的保护范围。凡根据本发明精神实质所作的等效变化或修饰，都应涵盖在本发明的保护范围之内。
Claims (2)
1.一种高可靠性随机存储系统，包括主设备模块（1）、随机存储器（2）和位于主设备模块（1）和随机存储器（2）之间的总线连接器（3）；其特征在于：所述随机存储器（2）和总线连接器（3）之间设有一总线ECC桥接模块（4），该总线ECC桥接模块（4）包括至少2个选通控制寄存器（5）、至少2个总线应答选通器（6）、至少2个总线传输选通器（7）和用于数据编码、解码和纠错的ECC桥接器（8）；
所述总线传输选通器（7）的第一总线输入端和ECC桥接器（8）的Master编码输入端均连接到所述总线连接器（3），所述ECC桥接器（8）的Slave编码输出端连接到所述总线传输选通器（7）的第二总线输入端，所述总线传输选通器（7）的第一总线输入端用于接收来自主设备模块（1）的存储数据和控制信号，所述总线传输选通器（7）的第二总线输入端用于接收来自ECC桥接器（8）的具有ECC校验码的编码存储数据和编码控制信号，总线传输选通器（7）的输出端连接到随机存储器（2），总线传输选通器（7）的控制端连接到选通控制寄存器（5），所述总线传输选通器（7）根据选通控制寄存器（5）的配置从而将第一总线输入端、第二总线输入端中一端数据和控制信号传输给所述随机存储器（2）；
所述总线应答选通器（6）的第一应答输入端和ECC桥接器（8）的Slave解码输入端均连接到所述随机存储器（2），所述ECC桥接器（8）的Master解码输出端连接到所述总线应答选通器（6）的第二应答输入端，所述总线应答选通器（6）的第一应答输入端用于接收来自随机存储器的存储数据和应答信号，所述总线应答选通器（6）的第二应答输入端用于接收来自ECC桥接器（8）的解码存储数据和解码应答信号，总线应答选通器（6）的输出端连接到总线连接器（3），总线应答选通器（6）的控制端连接到选通控制寄存器（5），所述总线应答选通器（6）根据选通控制寄存器（5）的配置从而将第一应答输入端、第二应答输入端中一端数据和应答信号传输给总线连接器（3）；
所述ECC桥接器（8）的Master编码输入端和总线连接器（3）之间设有第一开关（9），所述随机存储器（2）和ECC桥接器（8）的Slave解码输入端之间设有第二开关（10），所述第一开关（9）和第二开关（10）的控制端连接到所述选通控制寄存器（5）并根据选通控制寄存器（5）的配置开启或关闭第一开关（9）和第二开关（10）；所述选通控制寄存器（5）、总线应答选通器（6）和总线传输选通器（7）的数目相等。
2.根据权利要求1所述的高可靠性随机存储系统，其特征在于：所述随机存储器（2）内分为校验数据存储区和非校验数据存储区，所述校验数据存储区用于存储经所述ECC桥接器（8）生成相应ECC码的存储数据，所述非校验数据存储区用于存储来自总线连接器（3）的存储数据。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201310316435.2A CN103399829B (zh) | 2013-07-25 | 2013-07-25 | 高可靠性随机存储系统 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| CN201310316435.2A CN103399829B (zh) | 2013-07-25 | 2013-07-25 | 高可靠性随机存储系统 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| CN103399829A CN103399829A (zh) | 2013-11-20 |
| CN103399829B true CN103399829B (zh) | 2017-03-01 |
Family
ID=49563461
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| CN201310316435.2A Active CN103399829B (zh) | 2013-07-25 | 2013-07-25 | 高可靠性随机存储系统 |
Country Status (1)
| Country | Link |
|---|---|
| CN (1) | CN103399829B (zh) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1864232A (zh) * | 2003-06-12 | 2006-11-15 | 因芬尼昂技术股份公司 | 磁阻随机存取存储器中的错误检测和修正方法及装置 |
| CN102831028A (zh) * | 2012-09-07 | 2012-12-19 | 苏州国芯科技有限公司 | 基于数据总线的ecc纠错方法及系统 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7490217B2 (en) * | 2006-08-15 | 2009-02-10 | International Business Machines Corporation | Design structure for selecting memory busses according to physical memory organization information stored in virtual address translation tables |
-
2013
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Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1864232A (zh) * | 2003-06-12 | 2006-11-15 | 因芬尼昂技术股份公司 | 磁阻随机存取存储器中的错误检测和修正方法及装置 |
| CN102831028A (zh) * | 2012-09-07 | 2012-12-19 | 苏州国芯科技有限公司 | 基于数据总线的ecc纠错方法及系统 |
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| CN103399829A (zh) | 2013-11-20 |
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| C06 | Publication | ||
| PB01 | Publication | ||
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