CN103036560A - 锁相环、其闭环频率自动校准电路及方法 - Google Patents

Abstract

一种锁相环，其包括鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器、sigma-delta调制器以及闭环频率自动校准电路；该压控振荡器至少包括电容阵列和振荡器；一来自晶振的参考时钟信号输入至鉴频鉴相器和处理器，鉴频鉴相器依次通过电荷泵和环路滤波器连接振荡器，振荡器通过分频器连接鉴频鉴相器和sigma-delta调制器。上述发明可大大缩短校准时间，提高校准效率。本发明还涉及一种闭环频率自动校准电路及方法。

Description

锁相环、其闭环频率自动校准电路及方法

 

技术领域

本发明涉及一种锁相环、其闭环频率自动校准电路及方法。

 

背景技术

锁相环电路是一种反馈控制电路，其特点是利用来自外部晶振提供的输入参考时钟，来控制环路内部振荡信号的频率以及相位，从而得到需要的频率信号。锁相环被广泛的应用于无线通信、导航、控制、仪器仪表等领域中。典型的锁相环电路，如图1所示，由鉴频鉴相器11、电荷泵12、环路滤波器13、压控振荡器14和分频器15构成，若要实现小数分频的锁相环电路时，还需要加入sigma-delta调制器16来实现小数分频比。此外，在现代无线通信系统中，往往需要高的振荡频率以及宽的调谐范围，而针对这种高指标的压控振荡器，设计者一般采用电感电容压控振荡器，并且为了达到低的相位噪声性能，必须压低压控振荡器的压控增益，所以一般还需要采用开关电容阵列19来实现分段式的调谐曲线（如图2所示），这种结构的压控振荡器同时也为锁相环引入了另外一个功能模块——用于控制电容开关阵列的自动频率控制电路18。

传统的自动频率控制电路采用纯数字的方法，需要断开环路，箝位压控振荡器控制电压值，然后比较固定周期数内参考信号以及分频器输出信号的周期个数，根据比较值进行调整开关电容阵列的控制字，如此往复，最终得到需要的频率段。尽管这种方法被广泛的采用，但是其有着明显的缺点，每次调整频率时，都需要断开环路，增加了捕捉时间；比较两个信号时，需要两个计数器，而且由于压控振荡器的相邻调谐曲线间的频差小，所以需要很长的计数周期，才能够分辨出要求的频差，这意味着两个计数器的位数要足够多，增加了额外的功耗以及面积。

 

发明内容

针对现有技术的不足，本发明的目的旨在于提供一种频率校准效率高的锁相环、其闭环频率自动校准电路及方法。

为实现上述目的，本发明采用如下技术方案：

一种闭环频率自动校准电路，用于校准锁相环的压控振荡器的频率，其包括钳位电路、电压偏置电路、细调比较器、处理器、第一计数器和第二计数器；

电压偏置电路用于产生细调上限电压和细调下限电压，其中，细调上限电压大于细调下限电压；

该细调比较器包括用于接收细调上限电压的第一输入端、用于接收细调下限电压的第二输入端、用于接收压控振荡器的控制电压的第三输入端、用于输出细调上限比较信号的第一输出端以及用于输出细调下限比较信号的第二输出端；

该细调比较器用于将细调上限电压和细调下限电压分别与来自压控振荡器的控制电压进行比对，若控制电压大于细调上限电压，则该细调上限比较信号为第五电平信号，若控制电压小于细调上限电压，则该细调上限比较信号为第六电平信号；若控制电压大于细调下限电压，则该细调下限比较信号为第七电平信号，若控制电压小于细调下限电压，则该细调下限比较信号为第八电平信号，其中，该细调上限电压大于细调下限电压，该第五电平信号和第六电平信号不相同，该第七电平信号和第八电平信号不相同；

当该细调上限比较信号出现为第五电平信号时，处理器控制第一计数器开始对第五电平信号持续的时钟周期个数进行计数，若在预设的N个时钟周期内，该细调上限比较信号保持为第五电平信号，处理器减小压控振荡器的电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；

当该细调下限电压为第八电平信号，处理器控制第二计算器开始对第八电平信号持续的时钟周期个数进行计数，若在N个时钟周期内，细调下限电压始终保持为第八电平信号，处理器增大压控振荡器的电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；

当细调上限比较信号为第六电平信号或该细调下限比较信号为第七电平信号时，处理器不调整压控振荡器的电容阵列的电容阵列控制字；

其中，N和M均为正整数。

闭环频率自动校准电路还包括粗调比较器，该电压偏置电路还用于产生粗调上限电压和粗调下限电压，其中，该粗调上限电压大于粗调下限电压，该粗调上限电压大于细调上限电压，粗调下限电压小于细调下限电压；

该粗调比较器包括用于接收粗调上限电压的第一输入端、用于接收粗调下限电压的第二输入端、用于接收压控振荡器14的控制电压的第三输入端、用于输出粗调上限比较信号的第一输出端以及用于输出粗调下限比较信号的第二输出端；

该粗调比较器用于将粗调上限电压和粗调下限电压分别与控制电压进行比对，若控制电压大于粗调上限电压，则该粗调上限比较信号为第一电平信号，若控制电压小于粗调上限电压，则该粗调上限比较信号为第二电平信号；若控制电压大于粗调下限电压，则该粗调下限比较信号为第三电平信号，若控制电压小于粗调下限电压，则该粗调下限比较信号为第四电平信号，其中，该第一电平信号和第二电平信号不相同，该第三电平信号和第四电平信号不相同；

当该细调上限比较信号出现为第五电平信号时，处理器控制第一计数器开始对第五电平信号持续的时钟周期个数进行计数，若在预设的N个时钟周期内，该细调上限比较信号保持为第五电平信号，粗调比较器将粗调上限电压与控制电压进行比对，若控制电压大于粗调上限电压，处理器根据二分法进行减小电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；若控制电压小于粗调上限电压，处理器对电容阵列的电容阵列控制字进行减一，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；

当该细调下限电压为第八电平信号，处理器控制第二计算器开始对第八电平信号持续的时钟周期个数进行计数，若在N个时钟周期内，细调下限电压始终保持为第八电平信号，粗调比较器将预设的粗调下限电压与控制电压进行对比，若控制电压小于粗调下限电压，处理器根据二分法进行增加电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；若控制电压大于粗调下限电压，处理器对电容阵列的电容阵列控制字进行加一，同时，处理器控制钳位电路将控制电压上拉为预设的电位，持续M个时钟周期后控制钳位电路处于高阻态。

粗调比较器和细调比较器均为迟滞比较器。

该第一计数器和第二计数器均为高位计数器。

该第一电平信号为高电平信号，该第二电平信号为低电平信号；该第三电平信号为低电平信号，该第四电平信号为高电平信号。

该第五电平信号为高电平信号，该第六电平信号为低电平信号；该第七电平信号为低电平信号，该第八电平信号为高电平信号。

本发明还采用如下技术方案：

一种锁相环，其包括鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器、sigma-delta调制器以及上述的闭环频率自动校准电路；该压控振荡器至少包括电容阵列和振荡器；一来自晶振的参考时钟信号输入至鉴频鉴相器和处理器，鉴频鉴相器依次通过电荷泵和环路滤波器连接振荡器，振荡器通过分频器连接鉴频鉴相器和sigma-delta调制器。

本发明还采用以下技术方案：

一种锁相环的闭环频率自动校准方法，应用于一锁相环的闭环频率自动校准电路，该闭环频率自动校准电路包括钳位电路、用于产生细调上限电压和细调下限电压的电压偏置电路、细调比较器、处理器、第一和第二计数器，该方法包括以下步骤：

步骤A：通过处理器将钳位电路设为高阻态，锁相环处于捕捉状态；

步骤B：通过细调比较器将细调上限电压和细调下限电压分别与来自锁相环的压控振荡器的控制电压进行比对，若控制电压大于细调上限电压，执行步骤C；若控制电压小于细调下限电压，执行步骤F；若控制电压大于细调下限电压且小于细调上限电压且持续N个时钟周期，重新执行步骤B；

步骤C：通过第一计数器对控制电压大于细调上限电压的时钟周期个数进行计数，若在N个时钟周期内，控制电压保持大于细调上限电压，则执行步骤D；若在N个时钟周期内，出现控制电压小于细调上限电压，则执行步骤E；

步骤D：通过处理器减小压控振荡器的电容阵列的电容阵列控制字，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，执行步骤A；

步骤E：对第一计数器清零，再返回执行步骤B；

步骤F：通过第二计数器对控制电压小于细调下限电压的时钟周期个数进行计数，若在N个时钟周期内，控制电压保持小于细调下限电压，则执行步骤G；若在N个时钟周期内，出现控制电压大于细调下限电压，则执行步骤H；

步骤G：通过处理器增大压控振荡器的电容阵列的电容阵列控制字，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，执行步骤A；以及

步骤H：对第二计数器清零，再返回执行步骤B；

其中，N和M均为正整数，细调上限电压大于细调下限电压。

该闭环频率自动校准电路还包括粗调比较器，该电压偏置电路还用于产生粗调上限电压和粗调下限电压，其中，该粗调上限电压大于粗调下限电压，该粗调上限电压大于细调上限电压，粗调下限电压小于细调下限电压；上述步骤D包括以下步骤：

步骤D1：通过粗调比较器将粗调上限电压与控制电压进行比对，若控制电压大于粗调上限电压，执行步骤D2；若控制电压小于粗调上限电压，执行步骤D3；

步骤D2：通过处理器根据二分法进行减小电容阵列的电容阵列控制字，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，返回执行步骤A；以及

步骤D3：通过处理器对电容阵列的电容阵列控制字进行减一，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，返回执行步骤A；

该步骤G包括以下步骤：

步骤G1：通过粗调比较器将预设的粗调下限电压与控制电压进行对比，若控制电压小于粗调下限电压，执行步骤G2；若控制电压大于粗调下限电压，执行步骤G3；

步骤G2：通过处理器根据二分法进行增加电容阵列的电容阵列控制字，同时，通过处理器控制钳位电路将控制电压上拉为预设的电位，持续M个时钟周期后，返回执行步骤A；以及

步骤G3：通过处理器对电容阵列的电容阵列控制字进行加一，同时，通过处理器控制钳位电路将控制电压上拉为预设的电位，持续M个时钟周期后，返回执行步骤A。

本发明的有益效果如下：

1、实现了闭环的频率自动校准方法，调整频率时无需断开环路，可减少校准时间。

2、本发明根据控制电压与粗调上限电压、粗调下限电压的大小关系选择性地采用二分法增减或直接加/减一对电容阵列控制字进行赋值，可大大缩短校准时间，提高校准效率。

3、本发明采用第一和第二计数器可避免压控振荡器的电容阵列控制字的错误跳变，使得系统更稳定。

4、本发明的粗调比较器和细调比较器采用迟滞比较器可使得锁相环抗干扰能力提高，捕捉过程更稳定。

 

附图说明

图1为现有技术的锁相环的较佳实施方式的方框图。

图2为带有电容阵列结构的压控振荡器调谐曲线。

图3为本发明锁相环的较佳实施方式的方框图。

图4为本发明的闭环频率自动校准方法的较佳实施例的流程图。

 

具体实施方式

下面将结合附图以及具体实施方式，对本发明做进一步描述：

请参见图3，本发明涉及一种锁相环，其较佳实施方式包括鉴频鉴相器11、电荷泵12、环路滤波器13、压控振荡器14、分频器15、sigma-delta调制器16、闭环频率自动校准电路50。该压控振荡器14至少包括电容阵列18和振荡器120。该闭环频率自动校准电路50包括钳位电路51、电压偏置电路52、粗调比较器53、细调比较器54、处理器55、计数器56和57。

一来自晶振的参考时钟信号输入至鉴频鉴相器11、处理器55、计数器56和57，鉴频鉴相器11依次通过电荷泵12和环路滤波器13连接振荡器120，振荡器120通过分频器15连接鉴频鉴相器11和sigma-delta调制器16。

电压偏置电路52用于产生粗调上限电压Vb_hi_c和粗调下限电压Vb_lo_c以及细调上限电压Vb_hi_f和细调下限电压Vb_lo_f，该电压偏置电路52可由适当阻值的若干电阻串联而成。

该粗调比较器53包括用于接收粗调上限电压Vb_hi_c的第一输入端、用于接收粗调下限电压Vb_lo_c的第二输入端、用于接收压控振荡器14的控制电压Vctr的第三输入端、用于输出粗调上限比较信号Vo_hi_c的第一输出端以及用于输出粗调下限比较信号Vo_lo_c的第二输出端。

该粗调比较器53用于将粗调上限电压Vb_hi_c和粗调下限电压Vb_lo_c分别与控制电压Vctr进行比对，若控制电压Vct大于粗调上限电压Vb_hi_c，则该粗调上限比较信号Vo_hi_c为第一电平信号，若控制电压Vct小于粗调上限电压Vb_hi_c，则该粗调上限比较信号Vo_hi_c为第二电平信号；若控制电压Vct大于粗调下限电压Vb_lo_c，则该粗调下限比较信号Vo_lo_c为第三电平信号，若控制电压Vct小于粗调下限电压Vb_lo_c，则该粗调下限比较信号Vo_lo_c为第四电平信号，其中，该第一电平信号和第二电平信号不相同，该第三电平信号和第四电平信号不相同。

该细调比较器54包括用于接收细调上限电压Vb_hi_f的第一输入端、用于接收细调下限电压Vb_lo_f的第二输入端、用于接收压控振荡器14的控制电压Vctr的第三输入端、用于输出细调上限比较信号Vo_hi_f的第一输出端以及用于输出细调下限比较信号Vo_lo_f的第二输出端。

该细调比较器54用于将细调上限电压Vb_hi_f和细调下限电压Vb_lo_f分别与来自压控振荡器14的控制电压Vctr进行比对，若控制电压Vctr大于细调上限电压Vb_hi_f，则该细调上限比较信号Vo_hi_f为第五电平信号，若控制电压Vctr小于细调上限电压Vb_hi_f，则该细调上限比较信号Vo_hi_f为第六电平信号；若控制电压Vctr大于细调下限电压Vb_lo_f，则该细调下限比较信号Vo_lo_f为第七电平信号，若控制电压Vctr小于细调下限电压Vb_lo_f，则该细调下限比较信号Vo_lo_f为第八电平信号，其中该第五电平信号和第六电平信号不相同，该第七电平信号和第八电平信号不相同。

上述的粗调上限电压Vb_hi_c大于细调上限电压Vb_hi_f，粗调下限电压Vb_lo_c小于细调下限电压Vb_lo_f。

当该细调上限比较信号Vo_hi_f出现为第五电平信号如高电平信号时，即控制电压Vctr大于细调上限电压Vb_hi_f时，则处理器55控制计算器56开始对第五电平信号持续的时钟周期个数进行计数，若在预设的N个时钟周期内，该细调上限比较信号Vo_hi_f保持为第五电平信号，则处理器55检测粗调比较器的第一输出端的粗调上限比较信号Vo_hi_c。

若粗调上限比较信号Vo_hi_c为第一电平信号如高电平信号，此意味着压控振荡器14所接收的控制频率比实际需要的频率低，则处理器55根据二分法减小电容阵列18的电容阵列控制字，以获得更适合的频率。若粗调上限比较信号Vo_hi_c为第二电平信号如低电平信号，也就是说，控制电压Vctr在细调上限电压Vb_hi_f和粗调上限电压Vb_hi_c之间，说明压控振荡器14实际需要的频率在目前电容阵列值的附近，则处理器55控制电容阵列18对电容阵列控制字进行减一，以获得合适的频率。

若在预设的N个时钟周期内，该细调上限比较信号Vo_hi_f出现为第六电平信号如低电平信号，则该处理器55对计数器56清零，并在检测到下一个为第五电平信号的细调上限比较信号Vo_hi_f时使该计数器56重新计数，如此循环。

当细调下限电压Vb_lo_f为第八电平信号如高电平信号时，处理器55控制计数器57开始计数，若在N个时钟周期内（其中N为正整数），细调下限电压Vb_lo_f始终保持为第八电平信号，则检测粗调比较器53的第二输出端口的粗调下限比较信号Vo_lo_c。

若粗调下限比较信号Vo_lo_c为第四电平信号如高电平信号时，此时控制电压Vctr小于粗调下限电压Vb_lo_c，即压控振荡器14所获得的频率比实际需要的频率高，则该处理器55根据二分法进行增加电容阵列18的电容阵列控制字，以获得符合实际需要的频率。

若粗调下限比较信号Vo_lo_c为第三电平信号如低电平信号，此时控制电压Vctr在粗调下限电压Vb_lo_c和细调下限电压Vb_lo_f之间，说明压控振荡器14实际需要的频率对应的电容阵列控制字在目前的电容阵列控制字附件，则处理器55控制电容阵列18对其电容阵列控制字进行加一，以获得符合实际需要的频率。

若在N个时钟周期内，细调上限电压Vb_hi_f出现为第七电平信号如低电平信号，则处理器55对计数器57进行清零，并在下一个为第八电平信号的细调上限电压Vb_hi_f出现时使计数器57重新计数，如此循环。

当细调上限比较信号Vo_hi_f为第六电平信号或该细调下限比较信号Vo_lo_f为第七电平信号时，控制信号Vctr在细调下限比较信号Vo_lo_f和细调上限比较信号Vo_hi_f之间时，处理器不调整压控振荡器的电容阵列的电容阵列控制字。

上述过程中，处理器55控制电容阵列18对电容阵列控制字重新赋值的同时，该处理器55设置该钳位电路51的控制端的信号为高电平信号（也可设置为低电平信号），以使得该钳位电路51将环路滤波器13的输入电压和压控振荡器14的控制电压Vctr上拉为锁相环供电电压的二分之一，在M个时钟周期后（其中M为正整数），该处理器55将钳位电路51的控制信号置为低电平信号，以使得钳位电路51处于高阻态，进而使得锁相环处于捕捉状态。

本实施例中，该粗调比较器53和细调比较器54均采为迟滞比较器，以使得锁相环的锁定值更稳定。

在其他实施例中，若对校准精度的要求不高，可不需要细调比较器54，电压偏置电路52对应设置为只输出一个上限电压和一个下限电压，如此，可简化电路。

请参见图4，本发明还涉及一种闭环频率自动校准方法，其包括以下步骤：

步骤S001：将钳位电路51设为高阻态以使得锁相环处于捕捉状态，此时，环路滤波器13的输入电压和压控振荡器14的控制电压Vctr不受钳位电路51的控制。

步骤S002：通过细调比较器54将预设的细调上限电压Vb_hi_f和细调下限电压Vb_lo_f分别与来自压控振荡器14的控制电压Vctr进行比对，若控制电压Vctr大于细调上限电压Vb_hi_f，执行步骤S003；若控制电压Vctr小于细调下限电压Vb_lo_f，执行步骤S008；若控制电压Vctr大于细调下限电压Vb_lo_f且小于细调上限电压Vb_hi_f且持续N个时钟周期，重新执行步骤S002。

步骤S003：通过计数器56对控制电压Vctr大于细调上限电压Vb_hi_f的时钟周期个数进行计数，若在N个时钟周期内，控制电压Vctr保持大于细调上限电压Vb_hi_f，则执行步骤S004；若在N个时钟周期内，出现控制电压Vctr小于细调上限电压Vb_hi_f，则执行步骤S007。

步骤S004：通过粗调比较器53将预设的粗调上限电压Vb_hi_c与控制电压Vctr进行比对，若控制电压Vctr大于粗调上限电压Vb_hi_c，执行步骤S005；若控制电压Vctr小于粗调上限电压Vb_hi_c，执行步骤S006。

步骤S005：通过处理器55对电容阵列18的电容阵列控制字根据二分法进行减小，以获得更适合的频率，同时，通过钳位电路51将控制电压Vctr上拉为预设的电位如锁相环供电电压的二分之一，M个时钟周期后，返回执行步骤S001。

步骤S006：通过处理器55对电容阵列18的电容阵列控制字进行减一，以获得合适的频率，同时，通过处理器55控制钳位电路51将控制电压Vctr上拉为预设的电位，持续M个时钟周期后，返回执行步骤S001。

步骤S007：对计数器56清零，再返回执行步骤S002。

步骤S008：通过计数器57对控制电压Vctr小于细调下限电压Vb_lo_f的时钟周期个数进行计数，若在N个时钟周期内，控制电压Vctr保持小于细调下限电压Vb_lo_f，则执行步骤S009；若在N个时钟周期内，出现控制电压Vctr大于细调下限电压Vb_lo_f，则执行步骤S010。

步骤S009：通过粗调比较器53将预设的粗调下限电压Vb_lo_c与控制电压Vctr进行对比，若控制电压Vctr小于粗调下限电压Vb_lo_c，执行步骤S010；若控制电压Vctr大于粗调下限电压Vb_lo_c，执行步骤S011。

步骤S010：通过处理器55对电容阵列18的电容阵列控制字根据二分法进行增加，以获得符合实际需要的频率，同时，通过处理器55控制钳位电路51将控制电压Vctr上拉为预设的电位如锁相环供电电压的二分之一，持续M个时钟周期后，返回执行步骤S001。

步骤S011：通过处理器55对电容阵列18的电容阵列控制字进行加一，以获得符合实际需要的频率，同时，通过处理器55控制钳位电路51将控制电压Vctr上拉为预设的电位，持续M个时钟周期后，返回执行步骤S001。

步骤S012：对计数器57进行清零，再返回执行步骤S002。

对于本领域的技术人员来说，可根据以上描述的技术方案以及构思，做出其它各种相应的改变以及变形，而所有的这些改变以及变形都应该属于本发明权利要求的保护范围之内。

Claims (9)

1.一种闭环频率自动校准电路，用于校准锁相环的压控振荡器的频率，其特征在于：其包括钳位电路、电压偏置电路、细调比较器、处理器、第一计数器和第二计数器；

电压偏置电路用于产生细调上限电压和细调下限电压，其中，细调上限电压大于细调下限电压；

该细调比较器包括用于接收细调上限电压的第一输入端、用于接收细调下限电压的第二输入端、用于接收压控振荡器的控制电压的第三输入端、用于输出细调上限比较信号的第一输出端以及用于输出细调下限比较信号的第二输出端；

该细调比较器用于将细调上限电压和细调下限电压分别与来自压控振荡器的控制电压进行比对，若控制电压大于细调上限电压，则该细调上限比较信号为第五电平信号，若控制电压小于细调上限电压，则该细调上限比较信号为第六电平信号；若控制电压大于细调下限电压，则该细调下限比较信号为第七电平信号，若控制电压小于细调下限电压，则该细调下限比较信号为第八电平信号，该第五电平信号和第六电平信号不相同，该第七电平信号和第八电平信号不相同；

当该细调上限比较信号出现为第五电平信号时，处理器控制第一计数器开始对第五电平信号持续的时钟周期个数进行计数，若在预设的N个时钟周期内，该细调上限比较信号保持为第五电平信号，处理器减小压控振荡器的电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；

当该细调下限电压为第八电平信号，处理器控制第二计算器开始对第八电平信号持续的时钟周期个数进行计数，若在N个时钟周期内，细调下限电压始终保持为第八电平信号，处理器增大压控振荡器的电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；

当细调上限比较信号为第六电平信号或该细调下限比较信号为第七电平信号时，处理器不调整压控振荡器的电容阵列的电容阵列控制字；

其中，N和M均为正整数。

2.如权利要求1所述的闭环频率自动校准电路，其特征在于：闭环频率自动校准电路还包括粗调比较器，该电压偏置电路还用于产生粗调上限电压和粗调下限电压，其中，该粗调上限电压大于粗调下限电压，该粗调上限电压大于细调上限电压，粗调下限电压小于细调下限电压；

该粗调比较器包括用于接收粗调上限电压的第一输入端、用于接收粗调下限电压的第二输入端、用于接收压控振荡器的控制电压的第三输入端、用于输出粗调上限比较信号的第一输出端以及用于输出粗调下限比较信号的第二输出端；

该粗调比较器用于将粗调上限电压和粗调下限电压分别与控制电压进行比对，若控制电压大于粗调上限电压，则该粗调上限比较信号为第一电平信号，若控制电压小于粗调上限电压，则该粗调上限比较信号为第二电平信号；若控制电压大于粗调下限电压，则该粗调下限比较信号为第三电平信号，若控制电压小于粗调下限电压，则该粗调下限比较信号为第四电平信号，其中，该第一电平信号和第二电平信号不相同，该第三电平信号和第四电平信号不相同；

当该细调上限比较信号出现为第五电平信号时，处理器控制第一计数器开始对第五电平信号持续的时钟周期个数进行计数，若在预设的N个时钟周期内，该细调上限比较信号保持为第五电平信号，粗调比较器将粗调上限电压与控制电压进行比对，若控制电压大于粗调上限电压，处理器根据二分法进行减小电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；若控制电压小于粗调上限电压，处理器对电容阵列的电容阵列控制字进行减一，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；

当该细调下限电压为第八电平信号，处理器控制第二计算器开始对第八电平信号持续的时钟周期个数进行计数，若在N个时钟周期内，细调下限电压始终保持为第八电平信号，粗调比较器将预设的粗调下限电压与控制电压进行对比，若控制电压小于粗调下限电压，处理器根据二分法进行增加电容阵列的电容阵列控制字，同时处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后控制钳位电路处于高阻态；若控制电压大于粗调下限电压，处理器对电容阵列的电容阵列控制字进行加一，同时，处理器控制钳位电路将控制电压上拉为预设的电位，持续M个时钟周期后控制钳位电路处于高阻态。

3.如权利要求2所述的闭环频率自动校准电路，其特征在于：粗调比较器和细调比较器均为迟滞比较器。

4.如权利要求2所述的闭环频率自动校准电路，其特征在于：该第一计数器和第二计数器均为高位计数器。

5.如权利要求2所述的闭环频率自动校准电路，其特征在于：该第一电平信号为高电平信号，该第二电平信号为低电平信号；该第三电平信号为低电平信号，该第四电平信号为高电平信号。

6.如权利要求1所述的闭环频率自动校准电路，其特征在于：该第五电平信号为高电平信号，该第六电平信号为低电平信号；该第七电平信号为低电平信号，该第八电平信号为高电平信号。

7.一种锁相环，其特征在于：其包括鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器、sigma-delta调制器以及如权利要求1至6中任一项所述的闭环频率自动校准电路；该压控振荡器至少包括电容阵列和振荡器；一来自晶振的参考时钟信号输入至鉴频鉴相器和处理器，鉴频鉴相器依次通过电荷泵和环路滤波器连接振荡器，振荡器通过分频器连接鉴频鉴相器和sigma-delta调制器。

8.一种锁相环的闭环频率自动校准方法，应用于一锁相环的闭环频率自动校准电路，其特征在于：该闭环频率自动校准电路包括钳位电路、用于产生细调上限电压和细调下限电压的电压偏置电路、细调比较器、处理器、第一和第二计数器，该方法包括以下步骤：

步骤A：通过处理器将钳位电路设为高阻态，锁相环处于捕捉状态；

步骤B：通过细调比较器将细调上限电压和细调下限电压分别与来自锁相环的压控振荡器的控制电压进行比对，若控制电压大于细调上限电压，执行步骤C；若控制电压小于细调下限电压，执行步骤F；若控制电压大于细调下限电压且小于细调上限电压且持续N个时钟周期，重新执行步骤B；

步骤C：通过第一计数器对控制电压大于细调上限电压的时钟周期个数进行计数，若在N个时钟周期内，控制电压保持大于细调上限电压，则执行步骤D；若在N个时钟周期内，出现控制电压小于细调上限电压，则执行步骤E；

步骤D：通过处理器减小压控振荡器的电容阵列的电容阵列控制字，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，执行步骤A；

步骤E：对第一计数器清零，再返回执行步骤B；

步骤F：通过第二计数器对控制电压小于细调下限电压的时钟周期个数进行计数，若在N个时钟周期内，控制电压保持小于细调下限电压，则执行步骤G；若在N个时钟周期内，出现控制电压大于细调下限电压，则执行步骤H；

步骤G：通过处理器增大压控振荡器的电容阵列的电容阵列控制字，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，执行步骤A； 以及

步骤H：对第二计数器清零，再返回执行步骤B；

其中，N和M均为正整数，细调上限电压大于细调下限电压。

9.如权利要求1所述的锁相环的闭环频率自动校准方法，其特征在于：该闭环频率自动校准电路还包括粗调比较器，该电压偏置电路还用于产生粗调上限电压和粗调下限电压，其中，该粗调上限电压大于粗调下限电压，该粗调上限电压大于细调上限电压，粗调下限电压小于细调下限电压；上述步骤D包括以下步骤：

步骤D1：通过粗调比较器将粗调上限电压与控制电压进行比对，若控制电压大于粗调上限电压，执行步骤D2；若控制电压小于粗调上限电压，执行步骤D3；

步骤D2：通过处理器根据二分法进行减小电容阵列的电容阵列控制字，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，返回执行步骤A；以及

步骤D3：通过处理器对电容阵列的电容阵列控制字进行减一，同时通过处理器控制钳位电路将压控振荡器的控制电压上拉至预设的电位，持续M个时钟周期后，返回执行步骤A；

该步骤G包括以下步骤：

步骤G1：通过粗调比较器将预设的粗调下限电压与控制电压进行对比，若控制电压小于粗调下限电压，执行步骤G2；若控制电压大于粗调下限电压，执行步骤G3；

步骤G2：通过处理器根据二分法进行增加电容阵列的电容阵列控制字，同时，通过处理器控制钳位电路将控制电压上拉为预设的电位，持续M个时钟周期后，返回执行步骤A；以及

步骤G3：通过处理器对电容阵列的电容阵列控制字进行加一，同时，通过处理器控制钳位电路将控制电压上拉为预设的电位，持续M个时钟周期后，返回执行步骤A。

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