CN101527128B - 显示装置 - Google Patents

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Abstract

本发明提供一种显示装置，其所包含的垂直驱动电路具有移位寄存电路和公共电极驱动电路，移位寄存电路具有多个根据从外部输入的传输时钟来输出公共电极驱动用脉冲的基本电路，公共电极驱动电路具有多个公共基本电路，其每一个被输入传输时钟和从移位寄存电路的各基本电路输出的各公共电极驱动用脉冲，各公共基本电路包括根据公共电极驱动用脉冲来输入交流信号的电路A；根据由电路A所输入的交流信号来对相对应的公共电极输出第一公共电压或者输出电压电平与第一公共电压不同的第二公共电压的电路B；以及根据传输时钟来保持电路B的状态的电路C。能够使对浮置存储器节点的写入次数增多，并使浮置存储器节点的相对于漏电流的时间似然提高。

Description

显示装置
技术领域
本发明涉及一种显示装置，尤其涉及一种有效适用于具有驱动公共电极的公共电极驱动电路的显示装置的技术。
背景技术
例如，将薄膜晶体管(TFT：Thin Film Transistor)作为有源元件来使用的有源矩阵型液晶显示装置，在隔着液晶而相对配置的基板中的一块基板的液晶一侧的面上具有由在x方向上延伸且在y方向上并列设置的扫描线和在y方向上延伸且在x方向上并列设置的图像线所包围的像素区域。并且，该像素区域上具有通过提供来自扫描线的扫描信号而进行工作的像素晶体管(TFT)。
液晶显示装置具有向各扫描线分别提供扫描信号的垂直驱动电路和向各图像线分别提供图像信号的水平驱动电路，这些驱动电路具有移位寄存电路。
另一方面，还已知用多晶硅(polysilicon)来形成构成上述有源元件的薄膜晶体管的半导体层的多晶硅型液晶显示装置。在这种多晶硅型液晶显示装置中，构成垂直驱动电路和水平驱动电路的薄膜晶体管(例如MOS晶体管)也在与构成有源元件的薄膜晶体管相同的工序中而被形成在上述一块基板面上。
在该垂直驱动电路内具有单沟道(n-MOS)的公共电极驱动电路的液晶显示装置例如被记载于下述专利文献1中。
作为本发明申请相关的在先技术文献有日本特开2007-156054号公报(专利文献1)。
在记载于上述专利文献1中的单沟道的公共电极驱动电路中，将正极性的公共电压、或者负极性的公共电压输出到各公共电极的晶体管的栅极所连接的节点成为浮置(浮动)存储器(floating memory)节点，并且，对该浮置存储器节点的写入是在1帧中进行一次写入(更新)。
因此，浮置存储器节点的漏电流影响工作稳定性，尤其是在与浮置存储器节点连接的晶体管的阈值电压Vth较低时，晶体管的漏电流增大，因此不利于稳定工作，结果是阈值的似然有可能变小。
本发明是为解决上述现有技术存在的问题而完成的发明，本发明的目的在于提供这样一种技术，其在具有单沟道的公共电极驱动电路的显示装置中，能够增加对浮置存储器节点的写入次数，使相对于浮置存储器节点的漏电流的时间似然提高。
本发明的上述和其他目的以及新的特征，将通过本说明书的记载和附图而得到明确。
简单说明本申请所公开的发明中具有代表性的技术方案的概要如下。
(1)一种显示装置，包括具有多个像素和多个公共电极的显示面板、垂直驱动电路，上述垂直驱动电路具有移位寄存电路和公共电极驱动电路，上述移位寄存电路具有多个根据从外部输入的传输时钟来输出公共电极驱动用脉冲的基本电路，上述公共电极驱动电路具有多个公共基本电路，该多个公共基本电路的每一个被输入上述传输时钟和从上述移位寄存电路的各基本电路输出的各公共电极驱动用脉冲，上述各公共基本电路分别包括电路A、电路B以及电路C，其中，上述电路A根据上述公共电极驱动用脉冲来输入交流信号；上述电路B根据由上述电路A所输入的上述交流信号来对相对应的上述公共电极输出第一公共电压或者输出电压电平与上述第一公共电压不同的第二公共电压；上述电路C根据上述传输时钟来保持上述电路B的状态。
(2)根据(1)所述的显示装置，上述电路A包括第一晶体管，其控制电极被输入上述公共电极驱动用脉冲，根据该公共电极驱动用脉冲来使第一交流信号输入其第二电极；第二晶体管，其控制电极被输入上述公共电极驱动用脉冲，根据该公共电极驱动用脉冲来使第二交流信号输入其第二电极；第三晶体管，其采用二极管连接方式，且与上述第一晶体管的第一电极连接；以及第四晶体管，其采用二极管连接方式，且与上述第二晶体管的第一电极连接。
(3)根据(2)所述的显示装置，上述电路A还包括第五晶体管，其第二电极与上述第三晶体管的第一电极连接，其控制电极与上述第一晶体管的第一电极连接；第六晶体管，其第二电极与上述第四晶体管的第一电极连接，其控制电极与上述第二晶体管的第一电极连接。
(4)根据(2)或(3)所述的显示装置，上述电路B包括第七晶体管，其控制电极被输入由上述第一晶体管所输入的第一交流信号电压，基于该第一交流信号电压来对上述相对应的公共电极输出上述第一公共电压；第八晶体管，其控制电极被输入由上述第二晶体管所输入的第二交流信号电压，基于该第二交流信号电压来对上述相对应的公共电极输出上述第二公共电压。
(5)根据(4)所述的显示装置，上述电路C包括第一电容元件；第二电容元件；电路C1，其按第一传输时钟的各时钟来对上述第一电容元件进行充电，按相位与上述第一传输时钟不同的第二传输时钟的各时钟来通过上述第一电容元件对上述第七晶体管的控制电极所连接的节点的电压进行升压；电路C2，其按第一传输时钟的各时钟来对上述第二电容元件进行充电，按上述第二传输时钟的各时钟来通过上述第二电容元件对上述第八晶体管的控制电极所连接的节点的电压进行升压。
(6)根据(5)所述的显示装置，上述电路C1包括第九晶体管，其采用二极管连接方式，且其第二电极被输入第一传输时钟；第十晶体管，其第二电极与上述第九晶体管的第一电极连接，其控制电极与上述第七晶体管的控制电极连接；第十一晶体管，其采用二极管连接方式，且其第二电极与上述第十晶体管的第一电极连接，其第一电极与上述第七晶体管的控制电极连接；以及第十二晶体管，其第二电极被输入上述第二传输时钟，其控制电极与上述第七晶体管的控制电极连接，上述第一电容元件连接在上述第十二晶体管的第一电极和上述第十晶体管的第一电极之间，上述电路C2包括第十三晶体管，其采用二极管连接方式，且其第二电极被输入上述第一传输时钟；第十四晶体管，其第二电极与上述第十三晶体管的第一电极连接，其控制电极与上述第八晶体管的控制电极连接；第十五晶体管，其采用二极管连接方式，且其第二电极与上述第十四晶体管的第一电极连接，其第一电极与上述第八晶体管的控制电极连接；以及第十六晶体管，其第二电极被输入上述第二传输时钟，其控制电极与上述第八晶体管的控制电极连接，上述第二电容元件连接在上述第十六晶体管的第一电极与上述第十四晶体管的第一电极之间。
(7)根据(5)或(6)所述的显示装置，上述电路C包括：第十七晶体管，其第二电极与上述第八晶体管的控制电极连接，其控制电极与上述第七晶体管的控制电极连接；第十八晶体管，其第二电极与上述第十七晶体管的第一电极连接，其控制电极与上述第七晶体管的控制电极连接，并且其第一电极被输入基准电压；第十九晶体管，其第二电极与上述第七晶体管的控制电极连接，其控制电极与上述第八晶体管的控制电极连接；以及第二十晶体管，其第二电极与上述第十九晶体管的第一电极连接，其控制电极与上述第八晶体管的控制电极连接，并且其第一电极被输入基准电压。
(8)根据(2)～(7)中任一项所述的显示装置，上述第一交流信号和上述第二交流信号是在每一显示行相位彼此不同的信号，上述各公共电极驱动电路按每一显示行交替向上述相对应的各公共电极输出上述第一公共电压和上述第二公共电压。
(9)根据(2)～(7)中任一项所述的显示装置，上述第一交流信号和上述第二交流信号，在一帧内电压电平不发生变化，在下一帧内上述第一交流信号的电压电平和上述第二交流信号的电压电平发生反转，上述各公共电极驱动电路按每一帧交替向上述相对应的各公共电极输出上述第一公共电压和上述第二公共电压。
简单说明根据本申请公开的发明中具有代表性的技术方案所得到的效果如下。
根据本发明，在具有单沟道的公共电极驱动电路的显示装置中，能够增加对浮置存储器节点的写入次数，使浮置存储器节点的相对于漏电流的时间似然提高。
附图说明
图1是表示本发明实施例的液晶显示装置的等效电路的电路图。
图2是表示本发明实施例的垂直驱动电路的概略结构的框图。
图3是表示图2所示的公共基本电路的电路结构的电路图。
图4A是表示图3所示的电路的输入信号和各节点的电压变化的图。
图4B是表示图3所示的电路的输入信号的变形例的图。
图5是表示现有的垂直驱动电路的概略结构的框图。
图6是表示图5所示的移位寄存电路的输入信号和输出信号的图。
图7是表示图5所示的公共基本电路的电路结构的电路图。
图8是表示图7所示的电路的输入信号和各节点的电压变化的图。
具体实施例
以下，参照附图详细说明将本发明应用于液晶显示装置的实施例。
在用于说明实施例的所有附图中，对具有相同功能的部分标以相同的标号，省略对其的重复说明。
图1是表示本发明实施例的液晶显示装置的等效电路的电路图。
如图1所示，本实施例的液晶显示装置，在隔着液晶而彼此相对配置的一对基板中的一块基板的液晶面上，具有在x方向上延伸的n条扫描线(也称为栅极线)(X1、X2、...、Xn)、在x方向上延伸的n条公共电极(也称为公共线)(CT1、CT2、...、CTn)、与x方向交叉并在y方向上延伸的m条图像线(也称为漏极线或者源极线)(Y1、Y2、...、Ym)。
由扫描线和图像线所包围的区域是像素区域，1个像素区域中设有像素晶体管(TFT)，其栅极连接在扫描线上，其漏极(或源极)连接在图像线上，其源极(或漏极)连接在像素电极(PX)上。而且，在像素电极(PX)和公共电极(CT1、CT2、...、CTn)之间设有液晶电容(LC)和保持电容(Cadd)。
各扫描线(X1、X2、...、Xn)连接在垂直驱动电路(XDV)上，垂直驱动电路(XDV)将选择扫描信号依次提供给X1～Xn(或者Xn～X1)扫描线。
各公共电极(CT1、CT2、...、CTn)连接在垂直驱动电路(XDV)上，垂直驱动电路(XDV)以与选择扫描信号相同的定时，将施加到CT1～CTn(或者CTn～CT1)公共电极的电压依次切换极性而进行交流驱动。各图像线(Y1、Y2、...、Ym)连接在开关元件(S1、S2、...、Sm)的漏极(或源极)上。开关元件(S1、S2、...、Sm)的源极(或漏极)连接在视频线(DATA)上，栅极连接在水平驱动电路(YDV)上，水平驱动电路(YDV)对S1～Sm(或者Sm～S1)开关元件依次进行扫描。
本实施例的液晶显示面板的结构为，使设有像素电极、薄膜晶体管等的第一基板(也称为TFT基板、有源矩阵基板)(未图示)和形成有滤色片等的第二基板(也称为对置基板)(未图示)隔开预定间隔地重合在一起，利用在这两块基板之间的边缘部附近设置成框状的密封材料使这两块基板贴合，并且从设置在密封材料的局部的液晶注入口向这两块基板之间的密封材料的内侧注入液晶并进行封密，进而在这两块基板的外侧粘贴偏振片。
这样，本实施例的液晶显示面板成为在一对基板之间夹持有液晶的构造。另外，只要是TN方式或VA方式的液晶显示面板，对置电极就被设置于对置基板一侧。当为IPS(In Plane Switching：板内切换)方式的液晶显示面板时，对置电极被设置在TFT基板一侧。在本发明中，由于与液晶面板的内部构造无关，因此省略液晶面板的内部构造的详细说明。另外，无论是何种结构的液晶面板都可以应用本发明。进而，在液晶显示面板的背面一侧配置有背光源，但由于本发明与背光源的内部构造无关，因此在本说明书中，也省略对背光源内部构造的详细说明。
在本实施例中，垂直驱动电路(XDV)和水平驱动电路(YDV)的各晶体管的半导体层由多晶硅构成，在与构成有源元件的薄膜晶体管相同的工序中被形成在一块基板面上。
在对本实施例的垂直驱动电路进行说明之前，对现有的垂直驱动电路的结构进行说明。
图5是表示现有的垂直驱动电路的概略结构的框图。
在图5中，10是移位寄存电路、11是公共电极驱动电路、S/R是构成移位寄存电路10的多个基本电路、COMA是构成公共电极驱动电路的多个公共基本电路。
第n级的公共基本电路(COMAn)，其输出端子(O1n)、输入端子(I2n)与前级的公共基本电路(COMAn-1)连接，而输入端子(I1n)、输出端子(O2n)与下一级公共基本电路(COMAn+1)连接。第一级公共基本电路(COMA1)的输入端子(I21)被输入起始脉冲(VIN)。
移位寄存电路10的输入信号和输出信号示于图6。
起始脉冲(VIN)被输入到第一级的基本电路(S/R1)时，移位寄存电路10开始驱动，与第一传输时钟(SV1)和第二传输时钟(SV2)同步地，输出从上级到下级每次相位偏移1个时钟的信号。
从各基本电路(S/R)输出对各扫描线(G)的选择扫描电压和、被输入到各公共基本电路(COMA)的公共电极驱动用脉冲(COMAIN)。
图7示出图5所示的公共基本电路(COMA)的电路结构。
在公共电极驱动用脉冲(COMAIN)为高电平(以下称为H电平)时，n型MOS晶体管(以下简称为晶体管)(Tr101、Tr102)根据M1、M2交流信号的电压电平，使节点(node11)、节点(node12)这2个节点中的一个为H电平，使另一个为低电平(以下称为L电平)。
当节点(node11)为H电平时，晶体管(Tr103)导通，正极性的公共电压(CM11)被输出到公共电极(CT)，当节点(node12)为H电平时，晶体管(Tr104)导通，负极性的公共电压(CM12)被输出到公共电极(CT)。
在本说明书中，正极性的公共电压的“正极性”是指电位比施加在像素电极(PX)上的电压高，而与是大于还是小于0V无关。同样，负极性的公共电压的“负极性”是指电位比施加在像素电极(PX)上的电压位，而与是大于还是小于0V无关。
在公共电极驱动用脉冲(COMAIN)从H电平变化到L电平(即节点(node13)从H电平到L电平)时，晶体管(Tr105、Tr106)维持节点(node11)的H电平。同样，在公共电极驱动用脉冲(COMAIN)从H电平变化到L电平时，晶体管(Tr116、Tr117)维持节点(node12)的H电平。
晶体管(Tr107，Tr108)在节点(node11)为H电平的期间，使节点(node12)完全变为L电平，防止节点(node11)和节点(node12)同时变为H电平。同样，晶体管(Tr122，Tr123)在节点(node12)为H电平的期间，使节点(node11)完全变为L电平，防止节点(node11)和节点(node12)同时变为H电平。
经由晶体管(Tr111)而被输入下一级公共电极驱动用脉冲(COMAINn+1)的晶体管(Tr109)在节点(node11)为H电平状态时，使节点(node15)变为H电平。同样，晶体管(Tr110)在节点(node12)为H电平状态时，也使节点(node16)变为H电平。
在公共电极驱动用脉冲(COMAINn+1)从H电平变为L电平时，二极管连接的晶体管(Tr111)将节点(node14)维持在H电平。
在保持节点(node11)的H电平状态并且节点(node15)从L电平变化到H电平时，电容元件(C11)使节点(node11)的电压上升，使节点(node11)的电压比H电平高，从而使晶体管(Tr103)的导通电阻降低。电容元件(C13)也进行与电容元件(C11)同样的工作。
电容元件(C 12)保持节点(node15)的H电平状态。电容元件(C14)保持节点(node16)的H电平状态。
在节点(node11)从L电平变为H电平时，晶体管(Tr112)防止因电容元件(C11)而节点(node15)的电压上升。同样，在节点(node12)从L电平变为H电平时，晶体管(Tr118)也防止因电容元件(C13)而节点(node16)的电压上升。
在前级的公共电极驱动用脉冲(COMAINn-1)变为H电平时，晶体管(Tr113)使节点(node15)变为L电平。同样，在前级的公共电极驱动用脉冲(COMAINn-1)变为H电平时，晶体管(Tr119)也使节点(node16)变为L电平。
在前级的公共电极驱动用脉冲(COMAINn-1)变为H电平时，晶体管(Tr114、Tr115)使节点(node11)变为L电平。同样地，在前级的公共电极驱动用脉冲(COMAINn-1)变为H电平时，晶体管(Tr120，Tr121)也使节点(node12)变为L电平。
图8示出图7所示的电路的输入信号与各节点的电压变化。
在期间t11中，前级的公共电极驱动用脉冲(COMAINn-1)变为H电平时，晶体管(Tr113～Tr115)和晶体管(Tr119-Tr121)导通，节点(node11)、节点(node12)、节点(node15)、节点(node16)变为L电平。
接着，在期间t12中，本级的公共电极驱动用脉冲(COMAINn)变为H电平时，晶体管(Tr101，Tr102)导通，同时交流信号(M1)变为H电平时，晶体管(Tr105，Tr106)变为导通，节点(node11)变为H电平，电容元件(C11)被充电。
在节点(node11)为H电平的期间，利用晶体管(Tr107，Tr108)，将节点(node12)固定在L电平。此时，晶体管(Tr1112)导通，作为浮置节点的节点(node15)被固定在L电平。
节点(node11)利用电容元件(C11)而保持H电平状态，因此晶体管(Tr109)为导通状态，在该状态下，在期间t13中，下一级的公共电极驱动用脉冲(COMAINn+1)变为H电平，节点(node15)变为H电平。
节点(node15)变为H电平时，利用电容元件(C11)而使节点(node11)的电压上升(充电)，节点(node11)的电压变得高于H电平，使晶体管(Tr103)的导通电阻降低。
在下一帧中，交流信号(M1，M2)的相位反转(倒相)，在期间t14中，前级的公共电极驱动用脉冲(COMAINn-1)变为H电平时，节点(node11)、节点(node12)、节点(node15)、节点(node16)变为L电平。此后，节点(node12)进行同样的驱动。
在图7所示的公共基本电路(COMA)中，将正极性的公共电压(CM11)或者负极性的公共电压(CM12)输出到各自的公共电极的晶体管(Tr103、Tr104)的栅极所连接的节点，成为浮置存储器节点(node11、node12)，并且对该浮置存储器节点的写入是在1帧进行一次写入(更新)。
因此，连接在浮置存储器节点(node11、node12)上的晶体管的漏电流会影响工作稳定性，尤其是连接在浮置存储器节点(node11，node12)上的晶体管的阈值电压Vth较低时，晶体管的漏电流增大，因此有损稳定工作，其结果是阈值的似然有可能变小。
另外，公共基本电路(COMA)的构成元件需要(a)节点(node11)的电压保持用和升压用的电容元件(C11)、节点(node12)的电压保持用和升压用的电容元件(C13)、节点(node15)的电压保持用的电容元件(C12)、节点(node16)的电压保持用的电容元件(C14)；(b)节点(node11)的复位用晶体管(Tr107、Tr108、Tr114、Tr115)、节点(node12)的复位用晶体管(Tr122、Tr123、Tr120、Tr121)、节点(node15)的复位用晶体管(Tr112，Tr113)、节点(node16)的复位用晶体管(Tr118、Tr119)，需要许多元件，因此难以缩小电路规模。
图2是示出本实施例的垂直驱动电路的概略结构的框图。
如图2所示，在本实施例中，公共电极驱动电路11的各公共基本电路(COMB)不是被从前一级或者下一级的公共基本电路输入信号，而是各公共基本电路(COMB)被输入第一传输时钟和第二传输时钟(SV1、SV2)。
在本实施例中，移位寄存电路10的输入信号和输出信号也与图6相同。移位寄存电路10具有如下功能：当起始脉冲(VIN)被输入到第一级基本电路(S/R1)时，开始驱动，与第一传输时钟(SV1)和第二传输时钟(SV2)同步地，输出从上级到下级每次相位偏移一个时钟的信号。
从各基本电路(S/R)输出对各扫描线(G)的选择扫描电压、以及被输入到各公共基本电路(COMA)的公共电极驱动用脉冲(COMBIN)。
图3示出图2所示的公共基本电路(COMB)的电路结构。
晶体管(Tr201)的栅极被输入公共电极驱动用脉冲(COMBIN)，晶体管(Tr201)的漏极被输入交流信号(M1)。另外，晶体管(Tr201)的源极上连接有按二极管方式连接的晶体管(Tr205)，晶体管(Tr205)的源极与晶体管(Tr206)的漏极连接，晶体管(Tr206)的栅极与晶体管(Tr201)的源极连接。
另外，晶体管(Tr202)的栅极被输入公共电极驱动用脉冲(COMBIN)，晶体管(Tr202)的漏极被输入交流信号(M2)。另外，晶体管(Tr202)的源极上连接有按二极管方式连接的晶体管(Tr213)，晶体管(Tr213)的源极与晶体管(Tr214)的漏极连接，晶体管(Tr214)的栅极与晶体管(Tr202)的源极连接。
晶体管(Tr206)的源极与晶体管(Tr203)的栅极连接，晶体管(Tr203)的漏极被输入正极性的公共电压(CM21)。同样，晶体管(Tr214)的源极与晶体管(Tr204)的栅极连接，晶体管(Tr204)的漏极被输入负极性的公共电压(CM22)。
当公共电极驱动用脉冲(COMBIN)为高电平(以下称为H电平)时，晶体管(Tr201、Tr202)根据M1、M2交流信号的电压电平使节点(node21)、节点(node22)这两个节点中的一个为H电平，另一个为低电平(以下称为L电平)。
当节点(node21)为H电平时，晶体管(Tr203)导通，在公共电极(CT)输出正极性的公共电压(CM21)，当节点(node22)为H电平时，晶体管(Tr204)导通，在公共电极(CT)输出负极性的公共电压(CM22)。
当公共电极驱动用脉冲(COMBIN)从H电平变为L电平时，晶体管(Tr205、Tr206)使节点(node21)维持在H电平。同样，当公共电极驱动用脉冲(COMBIN)从H电平变化到L电平时，晶体管(Tr213、Tr214)使节点(node22)维持在H电平。
连接在晶体管(Tr220)的源极和基准电压(VSS)之间的晶体管(Tr207、Tr208)，它们各自的栅极与晶体管(Tr203)的栅极连接。另外，连接在晶体管(Tr212)的源极和基准电压(VSS)之间的晶体管(Tr215、Tr216)，它们各自的栅极与晶体管(Tr204)的栅极连接。
晶体管(Tr207、Tr208)在节点(node21)为H电平的期间，使节点(node22)完全变为L电平，防止节点(node21)和节点(node22)同时变为H电平。同样，晶体管(Tr215、Tr216)在节点(node22)为H电平的期间，使节点(node21)完全变为L电平，防止节点(node21)和节点(node22)同时变为H电平。
与图7所示的现有的电路结构相比，在本实施例中，节点(node21)侧附加由晶体管(Tr209)～晶体管(Tr212)、电容元件(C21)构成的电路，在节点(node22)侧附加由晶体管(Tr217)～晶体管(Tr219)、电容元件(C22)构成的电路。
即，在节点(node21)侧，在二极管连接的晶体管(Tr209)的源极和二极管连接的晶体管(Tr212)的漏极之间连接有晶体管(Tr210)，晶体管(Tr212)的源极与晶体管(Tr203)的栅极连接。另外，在晶体管(Tr212)的漏极和晶体管(Tr211)的源极之间连接有电容元件(C21)。
在此，晶体管(Tr210)和晶体管(Tr211)的栅极与晶体管(Tr203)的栅极连接。另外，晶体管(Tr209)的漏极被输入第一传输时钟(SV1)，晶体管(Tr211)的漏极被输入第二传输时钟(SV2)。
节点(node21)为H电平的期间，晶体管(Tr210)为导通状态，因此当第一传输时钟(SV1)为H电平时，节点(node24)为H电平。该节点(node24)的H电平由电容元件(C21)所保持。
节点(node21)为H电平的期间，晶体管(Tr211)为导通状态，因此当第二传输时钟(SV2)为H电平时，由电容元件(C21)使节点(node24)的电压按第二传输时钟(SV2)的各时钟来升压(充电)。由此，经由二极管连接的晶体管(Tr212)，节点(node21)的电压也上升。节点(node22)侧的电路也为同样的结构。
图4A示出图3所示的电路中输入信号与各节点的电压变化。
在期间t21中，当本级的公共电极驱动用脉冲(COMBINn)变为H电平时，晶体管(Tr201、Tr202)导通，同时交流信号(M1)变为H电平时，晶体管(Tr205、Tr206)导通，因此节点(node21)变为H电平。
节点(node21)为H电平的期间，利用晶体管(Tr207、Tr208)，使节点(node22)固定在L电平。此时，第一传输时钟(SV1)也为H电平，因此节点(node24)也为H电平，该H电平由电容元件(C21)所保持。
在节点(node21)为H电平的期间，晶体管(Tr211)处于导通状态，因此在期间t22中，当第二传输时钟(SV2)变为H电平时，节点(node24)被升压，由此通过晶体管(Tr212)，节点(node21)的电压高于H电平，从而使晶体管(Tr203)的导通电阻降低。
在下一帧中，M1、M2交流信号反转，节点(node22)变为H电平，进而按第二传输时钟(SV2)的每个时钟来升压。
在上述说明中，对在扫描线依次驱动中采用1行反转交流驱动方法的情况进行了说明，但是在扫描线依次驱动中采用帧反转交流驱动方法的情况也能应用本发明所述的电路。
在扫描线依次驱动中采用帧反转交流驱动方法时，M1、M2交流信号如图4B所示那样，输入电压电平按每一帧反转的交流信号。
通过使用这样的交流信号，例如，交流信号(M1)在1帧期间为H电平的情况下，各公共基本电路(COMB)的节点(node21)始终被施加H电平的电压，因此对于全部扫描线仅输出CM21正极性公共电压。
在下一帧中，使交流信号(M1)和交流信号(M2)的相位反转，对于全部扫描线仅输出CM22负极性公共电压。
如上所述，在本实施例中，使用第一传输时钟和第二传输时钟这一对时钟的一方(图3中为第二传输时钟(SV2))，按各时钟进行浮置存储器节点(node21、node22)的升压。
因此，在本实施例中，与现有的电路那样的在1个周期进行一次对存储器节点的写入相比，能够相对于漏电流进行极为稳定的工作，能够维持很高的工作稳定性。
例如，当将240级构成的公共电极驱动电路作为例子时，与现有技术相比，浮置存储器节点的保持时间的约束大致被放宽120倍。也就是说，与浮置存储器节点(node21、node22)连接的晶体管的漏电流的似然大致增大120倍，可以降低使用晶体管的阈值电压Vth标准。
另外，在本实施例中，为了使晶体管(Tr203、Tr204)的导通电阻降低，并不使用下一级的输出而使用SV1、SV2的传输时钟。因此，各公共基本电路(COMB)的构成元件需要(a)节点(node21)的电压保持用和升压用的电容元件(C21)以及节点(node22)的电压保持用和升压用的电容元件(C22)；(b)节点(node21)的复位用晶体管(Tr207、Tr208)以及节点(node22)的复位用晶体管(Tr215、Tr216)，但是不需要现有电路中的用于对下一级输出进行保持、复位的元件，能够缩小电路规模。
由此，不仅能够容易应对窄边缘化的问题，还能由似然增大带来成品率的提高，由于电路的紧凑化还能增加由1块基板得到的面板数，从而能够降低成本。
在上述说明中，对于用n型薄膜晶体管构成公共电极驱动电路的情况进行了说明，但是本实施例不仅是由n型薄膜晶体管构成的nMOS单沟道结构，也可以是由p型薄膜晶体管构成的pMOS单沟道结构。此时，VSS基准电压为H电平，逻辑相反。
进而，在上述说明中，对使用MOS(Metal Oxide Semiconductor：金属氧化物半导体)型TFT作为晶体管的情况进行了说明，但是也可以使用一般的MOS-FET或者MIS(Metal Insulator Semiconductor：金属绝缘体半导体)型FET等。
另外，在上述说明中，对将本发明应用于液晶显示模块的实施例进行了说明，但是本发明不限于此，例如，当然也可以应用于使用有机EL元件等的EL显示装置。
以上，根据上述实施例对由本发明人完成的发明进行了具体的说明，但是本发明显然不限于上述实施例，而是在不脱离其要旨的范围内可以进行各种变更。

Claims (3)

1.一种显示装置，包括：
具有多个像素和多个公共电极的显示面板；和
垂直驱动电路，
该显示装置的特征在于，
上述垂直驱动电路具有：
移位寄存电路；和
公共电极驱动电路，其中，
上述移位寄存电路具有：根据从外部输入的传输时钟来输出公共电极驱动用脉冲的多个基本电路，
上述公共电极驱动电路具有：被输入上述传输时钟和从上述移位寄存电路的各基本电路输出的各公共电极驱动用脉冲的多个公共基本电路，
上述各公共基本电路包括电路A、电路B以及电路C，其中，
上述电路A根据上述公共电极驱动用脉冲来输入交流信号；
上述电路B根据由上述电路A输入的上述交流信号来向对应的上述公共电极输出第一公共电压或者第二公共电压，其中该第二公共电压的电压电平与上述第一公共电压的电压电平不同；
上述电路C根据上述传输时钟来保持上述电路B的状态，
上述电路A包括：
第一晶体管，其控制电极被输入上述公共电极驱动用脉冲，根据该公共电极驱动用脉冲来使第一交流信号输入其第二电极；
第二晶体管，其控制电极被输入上述公共电极驱动用脉冲，根据该公共电极驱动用脉冲来使第二交流信号输入其第二电极；
第三晶体管，其采用二极管连接方式，且与上述第一晶体管的第一电极连接；以及
第四晶体管，其采用二极管连接方式，且与上述第二晶体管的第一电极连接，
上述电路A还包括
第五晶体管，其第二电极与上述第三晶体管的第一电极连接，其控制电极与上述第一晶体管的第一电极连接；和
第六晶体管，其第二电极与上述第四晶体管的第一电极连接，其控制电极与上述第二晶体管的第一电极连接，
上述电路B包括：
第七晶体管，其控制电极被输入由上述第一晶体管输入的第一交流信号电压，根据该第一交流信号电压来向上述对应的公共电极输出上述第一公共电压；和
第八晶体管，其控制电极被输入由上述第二晶体管输入的第二交流信号电压，根据该第二交流信号电压来向上述对应的公共电极输出上述第二公共电压，
上述电路C包括：
第一电容元件；
第二电容元件；
电路C1，其按第一传输时钟的各时钟来对上述第一电容元件进行充电，并按相位与上述第一传输时钟的相位不同的第二传输时钟的各时钟来通过上述第一电容元件使上述第七晶体管的控制电极连接的节点的电压升压；以及
电路C2，其按第一传输时钟的各时钟来对上述第二电容元件进行充电，并按上述第二传输时钟的各时钟来通过上述第二电容元件使上述第八晶体管的控制电极连接的节点的电压升压，
上述电路C1包括：
第九晶体管，其采用二极管连接方式，且其第二电极被输入第一传输时钟；
第十晶体管，其第二电极与上述第九晶体管的第一电极连接，其控制电极与上述第七晶体管的控制电极连接；
第十一晶体管，其采用二极管连接方式，且其第二电极与上述第十晶体管的第一电极连接，其第一电极与上述第七晶体管的控制电极连接；以及
第十二晶体管，其第二电极被输入上述第二传输时钟，其控制电极与上述第七晶体管的控制电极连接，
上述第一电容元件连接在上述第十二晶体管的第一电极和上述第十晶体管的第一电极之间，
上述电路C2包括：
第十三晶体管，其采用二极管连接方式，且其第二电极被输入上述第一传输时钟；
第十四晶体管，其第二电极与上述第十三晶体管的第一电极连接，其控制电极与上述第八晶体管的控制电极连接；
第十五晶体管，其采用二极管连接方式，且其第二电极与上述第十四晶体管的第一电极连接，其第一电极与上述第八晶体管的控制电极连接；以及
第十六晶体管，其第二电极被输入上述第二传输时钟，其控制电极与上述第八晶体管的控制电极连接，
上述第二电容元件连接在上述第十六晶体管的第一电极与上述第十四晶体管的第一电极之间，
上述电路C还包括：
第十七晶体管，其第二电极与上述第八晶体管的控制电极连接，其控制电极与上述第七晶体管的控制电极连接；
第十八晶体管，其第二电极与上述第十七晶体管的第一电极连接，其控制电极与上述第七晶体管的控制电极连接，并且其第一电极被输入基准电压；
第十九晶体管，其第二电极与上述第七晶体管的控制电极连接，其控制电极与上述第八晶体管的控制电极连接；以及
第二十晶体管，其第二电极与上述第十九晶体管的第一电极连接，其控制电极与上述第八晶体管的控制电极连接，并且其第一电极被输入基准电压。
2.根据权利要求1所述的显示装置，其特征在于，
上述第一交流信号和上述第二交流信号是按每一显示行而相位彼此不同的信号，
上述各公共电极驱动电路按每一显示行交替向上述对应的各公共电极输出上述第一公共电压和上述第二公共电压。
3.根据权利要求1所述的显示装置，其特征在于，
上述第一交流信号的电压电平和上述第二交流信号的电压电平在一帧内不发生变化，而在下一帧内发生反转，
上述各公共电极驱动电路按每一帧交替向上述对应的各公共电极输出上述第一公共电压和上述第二公共电压。
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Applicant before: Hitachi Displays, Ltd.

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Co-applicant after: IPS Pioneer Support Society

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Owner name: APAN DISPLAY EAST, INC.

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Patentee after: JAPAN DISPLAY Inc.

Patentee after: Panasonic Liquid Crystal Display Co.,Ltd.

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Application publication date: 20090909

Assignee: BOE TECHNOLOGY GROUP Co.,Ltd.

Assignor: JAPAN DISPLAY Inc.|Panasonic Liquid Crystal Display Co.,Ltd.

Contract record no.: 2013990000688

Denomination of invention: Image display

Granted publication date: 20111214

License type: Common License

Record date: 20131016

LICC Enforcement, change and cancellation of record of contracts on the licence for exploitation of a patent or utility model
TR01 Transfer of patent right
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Patentee after: PANASONIC INTELLECTUAL PROPERTY CORPORATION OF AMERICA

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