发明内容
本发明解决的问题是提供一种半导体存储器,所述半导体存储器具有较好的数据保持力。
为解决上述问题,本发明提供一种栅极结构形成方法,包括:依次在半导体衬底上形成隧穿绝缘层和第一多晶硅层;在第一多晶硅层上形成由氮化硅构成的第一层间绝缘层;在第一层间绝缘层上形成高k介质构成的第二层间绝缘层;在第二层间绝缘层上形成第二多晶硅层。
在形成第一层间绝缘层之后还包括对第一层间绝缘层在含氧气氛中进行退火。
所述退火气氛为N2O,退火温度为680至750℃。
在形成第二层间绝缘层之后还包括对第二层间绝缘层进行退火。
所述退火气氛为N2,退火温度为750至850℃。
本发明还提供一种栅极结构,包括依次形成在半导体衬底上的隧穿绝缘层、第一多晶硅层、第一层间绝缘层、第二层间绝缘层及第二多晶硅层,所述第一层间绝缘层为氮化硅,第二层间绝缘层为高k介质。
在形成第一层间绝缘层之后还包括对第一层间绝缘层在含氧气氛中进行退火。
所述退火气氛为N2O,退火温度为680至750℃。
在形成第二层间绝缘层之后还包括对第二层间绝缘层进行退火。
所述退火气氛为N2,退火温度为750至850℃。
本发明还提供一种半导体存储器,包括依次形成在半导体衬底上的隧穿绝缘层、第一多晶硅层、第一层间绝缘层、第二层间绝缘层及第二多晶硅层,所述隧穿绝缘层、第一多晶硅层、第一层间绝缘层、第二层间绝缘层及第二多晶硅层构成栅极结构;形成于半导体衬底中、栅极结构两侧的源极、漏极,在栅极结构上加电压,在半导体衬底中形成的导电沟道把源极和漏极相电连接,所述第一层间绝缘层为氮化硅,第二层间绝缘层为高k介质。
在形成第一层间绝缘层之后还包括对第一层间绝缘层在含氧气氛中进行退火。
所述退火气氛为N2O,退火温度为680至750℃。
在形成第二层间绝缘层之后还包括对第二层间绝缘层进行退火。
所述退火气氛为N2,退火温度为750至850℃。
本发明还提供一种半导体存储器的形成方法,包括:依次在半导体衬底上形成隧穿绝缘层和第一多晶硅层;在第一多晶硅层上形成由氮化硅构成的第一层间绝缘层;在第一层间绝缘层上形成高k介质构成的第二层间绝缘层;在第二层间绝缘层上形成第二多晶硅层,所述隧穿绝缘层、第一多晶硅层、第一层间绝缘层、第二层间绝缘层及第二多晶硅层构成栅极结构;在半导体衬底中、栅极结构两侧形成源极和漏极,在栅极结构上加电压,在半导体衬底中形成的导电沟道把源极和漏极相电连接。
在形成第一层间绝缘层之后还包括对第一层间绝缘层在含氧气氛中进行退火。
所述退火气氛为N2O,退火温度为680至750℃。
在形成第二层间绝缘层之后还包括对第二层间绝缘层进行退火。
所述退火气氛为N2,退火温度为750至850℃。
与现有技术相比,本发明具有以下优点:以富-O氮化硅和高k介质比如Al2O3层替代传统的ONO层间绝缘层(氧化硅-氮化硅-氧化硅)形成栅极,阻止电荷由浮栅向控制栅泄漏,同时加强了福勒-雷诺(F-N)电子隧穿,因此加强了擦写操作。
本发明通过以富-氧氮化硅和高k介质比如Al2O3层替代传统的ONO层间介电层(氧化硅-氮化硅-氧化硅)形成栅极,形成存储器,通过高k的层间绝缘层增加了层间绝缘层的电容耦合。
具体实施方式
下面结合附图对本发明的具体实施方式做详细的说明。
本发明首先提供了一种栅极结构的形成方法,包括:依次在半导体衬底上形成隧穿绝缘层和第一多晶硅层;在第一多晶硅层上形成由氮化硅构成的第一层间绝缘层;在第一层间绝缘层上形成高k介质构成的第二层间绝缘层;在第二层间绝缘层上形成第二多晶硅层。
参考图1所示,为在半导体衬底11上形成隧穿绝缘层12的结构示意图。图1中所示的半导体衬体11为硅,还可以使用绝缘体上硅(SOI)作为半导体衬底11。图中所示的隧穿绝缘层12可以为SiO
2、USG(未掺杂硅酸盐玻璃)、BPSG(硼磷硅玻璃)、PSG(磷硅玻璃)、SiN、SiON、SiOF、AlN、Al
2O
3、BN、类金刚石、SOG(旋涂玻璃)、FOX(可流动氧化物)、聚合物等组中的至少一种及它们的组合构成。所述隧穿绝缘层12的厚度范围为60
至80
。
参考图2所示,在隧穿绝缘层12上形成第一多晶硅层13,第一多晶硅层13的厚度范围为2700至3300
。第一多晶硅层13作为半导体存储器的浮栅,第一多晶硅层13的形成工艺可以通过本领域技术人员公知的任何方法制备。
参考图3所示,在第一多晶硅层13上形成第一层间绝缘层14,所述第一绝缘层14为SiN,第一层间绝缘层14的厚度范围为10至20,第一层间绝缘层14的形成工艺可以通过本领域技术人员公知的任何方法制备。
作为本发明的一个实施方式,采用化学气相沉积(CVD)装置形成第一层间绝缘层14,所述第一层间绝缘层14的厚度为15。
形成第一层间绝缘层14之后,把第一层间绝缘层14在含N2O气氛中进行退火处理,退火处理的目的是为了降低氮化硅层的介电常数(从介电常数k=9下降至k=4),防止电荷泄漏,所述退火温度范围为680至750℃,所述退火时间为25至45 mins。
作为本发明的一个实施方式,把第一层间绝缘层14放置在含N2O气氛中,在700℃下,退火30mins。
参照图4所示,在第一层间绝缘层上形成第二层间绝缘层15,第二层间绝缘层15为高k材料,可以为Al
2O
3、H
fO
2、Z
rO
2等高介电常数材料,第二层间绝缘层15的厚度范围为100至150
,本发明中第二层间绝缘层15的形成工艺可以通过本领域技术人员公知的任何方法制备。
作为本发明的一个实施方式,所述第二层间绝缘层15采用Al
2O
3,采用低压化学气相沉积(LPCVD)装置形成第二层间绝缘层15,所述第二层间绝缘层15的厚度为105
第一层间绝缘层14和第二层间绝缘层15共同组成了半导体存储器的层间绝缘层,然后对层间绝缘层进行退火,退火温度范围为700至900℃,退火时间为50至70mins。
作为本发明的一个实施例,把第一层间绝缘层14和第二层间绝缘层15在N2气氛中,在800℃下退火,退火时间为60mins。
参照图5所示,在第二层间绝缘层15上形成第二多晶硅层16,第二多晶硅层16的厚度范围为1110至1290
。所述第二多晶硅层16作为半导体存储器的控制栅,第二多晶硅层16的形成工艺可以通过本领域技术公知的任何方法制备。
基于上述工艺实施后,形成了本发明的栅极结构,所述栅极结构包括依次形成在半导体衬底上的隧穿绝缘层12、第一多晶硅层13、第一层间绝缘层14、第二层间绝缘层15及第二多晶硅层16,所述第一层间绝缘层14为氮化硅,第二层间绝缘层15为高k介质。
参照图6,形成了栅极结构之后,定义出栅极图形,分别刻蚀第二多晶硅层16、第二层间绝缘层15、第一层间绝缘层14、第一多晶硅层13和隧穿绝缘层12,形成半导体存储器的栅极,形成半导体存储器的栅极的方法为本领域技术人员熟知的现有技术。本实施例中,给出一个比较优选的技术方案:在第二多晶硅层16上沉积氮氧化硅(SiON)抗反射介电覆膜(DARC)层(图中未示出),作为随后步骤的保护层,沉积氮氧化硅抗反射介电覆膜层的方法为等离子增强化学气相沉积法(PECVD);接着在氮氧化硅抗反射介电覆膜层上形成光刻胶,根据设计好的栅极的图案进行光刻胶的曝光和显影,定义出栅极的图形,然后蚀刻掉栅极以外的氮氧化硅抗反射介电覆膜层、第二多晶硅层16、然后去除光刻胶,采用氮氧化硅抗反射介电覆膜层作为硬掩模层,分别蚀刻栅极以外的第二层间绝缘层15、第一层间绝缘层14和第一多晶硅层13,最后蚀刻隧穿绝缘层12,蚀刻隧穿绝缘层12的时间要尽量的短,以防止过蚀形成底切(footcut),蚀刻后,第一多晶硅层13形成浮栅13a,第二多晶硅层16形成控制栅,第一层间绝缘层14和第二层间绝缘层15构成层间绝缘层14a,隧穿绝缘层12形成隧穿绝缘层12a。所述层间绝缘层14a由富-O的氮化硅层和高-k介质比如Al2O3构成。
参考图7所示,形成半导体存储器的栅极之后,在半导体衬底11中采用离子注入形成源、漏极17、18,形成源、漏极17、18的工艺为本领域技术人员熟知的现有技术。在本发明的一个实施例中,半导体衬底11选用p型硅,因此,对源极和漏极进行n型掺杂注入。
参照图8所示,形成源、漏极17、18之后在半导体衬底上形成侧墙18,侧墙18和半导体衬底11和半导体存储器的栅的侧面相接触。形成侧墙18的目的为防止短沟道效应。
基于以上工艺实施以后,得到最终的半导体存储器件700结构为图8所示。所述半导体存储器件700包括形成于半导体衬底11中源极17、漏极18和形成于半导体衬底11上的栅极结构,其中在栅极结构上加电压,在半导体衬底中形成的导电沟道把源极17和漏极18连接。半导体存储器700的栅极结构包括依次堆叠形成在半导体衬底11上的隧穿绝缘层12a、浮栅13a、层间绝缘层14a以及控制栅16a。
半导体存储器700的编程、擦除和读出操作通过以下方法完成。参照图9,本发明的半导体存储器700可以通过沟道热电子注入(CHE,Channel-hot-electron)进行编程,外围电路通过字线将大于半导体存储器700的阈值电压在控制栅16a上加正电压Vg,使得存储器700的沟道开启,所述沟道把源极17和漏极18相电连接,外围电路通过位线把待存储的数据信息通过在漏极18上加电压Vd存入层间绝缘层中,半导体衬底11电压Vb为负电压。
作为本发明的一个实施方式,外围电路通过字线在控制栅16a上加正电压Vg为10V,使得存储器700的沟道开启,源极17电压Vs为0V,半导体底11电压Vb为-8V,外围电路通过位线在漏极18上加电压Vd为5V,通过上述操作,把数据信息存入半导体存储单元中。
若需要对半导体存储单元进行擦除,参照图10,外围电路通过字线在控制栅16a上电压Vg为负,源极17和漏极18浮置,半导体衬底11电压Vb加正电压,通过福勒-雷诺(F-N)隧穿把存储在层间绝缘层中的电荷擦除。
作为本发明的一个实施方式,外围电路通过字线在控制栅16a上加负电压Vg为-8V,源极17电压Vs和漏极18电压Vd浮置,半导体底11电压Vb为10V,通过福勒-雷诺(F-N)隧穿把存储在层间绝缘层中的电荷擦除。
若需要读取数据,参考电压通过字线加到控制栅16a上,如果半导体存储器700是被编程过的,则半导体存储器700的沟道将不会导通。如果半导体存储器700是被擦除过的,则浮栅13a上的正电荷降低了半导体存储器700的阈值电压,因此读周期期间的存储单元将会导通。
本发明通过采用高-k材料作为层间绝缘层来替代现有技术中的ONO层中的氮化硅和氧化硅,高-k材料的介电常数比氧化硅的要高,因此可以将高-k材料的厚度减小,从而减小存储单元的面积,而同时在层间绝缘层和浮栅之间保持较高的耦合比,这种较高的耦合比也使得可以编程电压降低。本发明采用氧化铝作为层间绝缘层而制备的快闪存储器单元的擦除电压与采用二氧化硅作为栅介质相比降低达40%,与采用ONO作为层间绝缘层相比,相同的厚度下,采用氧化铝作为层间绝缘层的快闪存储器单元的擦除电压降低了27%,因此,可以降低快闪存储器的操作电压,实现较短的编程/擦除时间。
虽然本发明己以较佳实施例披露如上,但本发明并非限定于此。任何本领域技术人员,在不脱离本发明的精神和范围内,均可作各种更动与修改,因此本发明的保护范围应当以权利要求所限定的范围为准。